JP2508427B2 - Ic回路 - Google Patents
Ic回路Info
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- JP2508427B2 JP2508427B2 JP61214908A JP21490886A JP2508427B2 JP 2508427 B2 JP2508427 B2 JP 2508427B2 JP 61214908 A JP61214908 A JP 61214908A JP 21490886 A JP21490886 A JP 21490886A JP 2508427 B2 JP2508427 B2 JP 2508427B2
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Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、複数の回路ブロツクにより構成されるもの
に好適なIC回路に関する。
に好適なIC回路に関する。
本発明は、複数の回路ブロツクより構成されるものに
好適なIC回路において、所定の回路ブロツクの前段に、
入力信号のスルー状態とシフトレジスタとしての作動状
態とが選択できる入力コンデイシヨンレジスタを接続
し、所定の回路ブロツクの後段に、入力信号のスルー状
態とシフトレジスタとしての作動状態とが選択できる出
力コンデイシヨンレジスタを接続し、各コンディション
レジスタを個別に制御できるようにしたことにより、こ
の所定の回路ブロツクだけのテストが簡単に行なえるよ
うにしたものである。
好適なIC回路において、所定の回路ブロツクの前段に、
入力信号のスルー状態とシフトレジスタとしての作動状
態とが選択できる入力コンデイシヨンレジスタを接続
し、所定の回路ブロツクの後段に、入力信号のスルー状
態とシフトレジスタとしての作動状態とが選択できる出
力コンデイシヨンレジスタを接続し、各コンディション
レジスタを個別に制御できるようにしたことにより、こ
の所定の回路ブロツクだけのテストが簡単に行なえるよ
うにしたものである。
従来、比較的回路構成が大規模なIC回路として、第2
図に示す如きものがあつた。この第2図において、
(1)はIC回路全体を示し、このIC回路(1)には複数
の回路ブロツク(2),(3),(4),(5),
(6),(7),(8)…が所定の接続がなされた状態
で設けてある。そして、例えば回路ブロツク(3),
(4),(5)には夫々IC回路(1)の外部からの信号
入力端子として端子(3a),(3b),(3c),(4a),
(4b),(4c),(5a)及び(5b)があり、この夫々の
回路ブロツク(3),(4)及び(5)の所定の出力信
号が回路ブロツク(2)に供給される。また、この回路
ブロツク(2)の所定の出力信号が回路ブロツク
(6),(7)及び(8)に供給される。さらに、この
回路ブロツク(6),(7)及び(8)には夫々IC回路
(1)の外部への信号出力端子として端子(6a),(6
b),(6c),(7a),(7b),(7c),(8a)及び(8
b)がある。また、図示はしないがIC回路(1)には上
述の外にも回路ブロツクが設けてあり、夫々の回路ブロ
ツクを所定の接続で配置してある。
図に示す如きものがあつた。この第2図において、
(1)はIC回路全体を示し、このIC回路(1)には複数
の回路ブロツク(2),(3),(4),(5),
(6),(7),(8)…が所定の接続がなされた状態
で設けてある。そして、例えば回路ブロツク(3),
(4),(5)には夫々IC回路(1)の外部からの信号
入力端子として端子(3a),(3b),(3c),(4a),
(4b),(4c),(5a)及び(5b)があり、この夫々の
回路ブロツク(3),(4)及び(5)の所定の出力信
号が回路ブロツク(2)に供給される。また、この回路
ブロツク(2)の所定の出力信号が回路ブロツク
(6),(7)及び(8)に供給される。さらに、この
回路ブロツク(6),(7)及び(8)には夫々IC回路
(1)の外部への信号出力端子として端子(6a),(6
b),(6c),(7a),(7b),(7c),(8a)及び(8
b)がある。また、図示はしないがIC回路(1)には上
述の外にも回路ブロツクが設けてあり、夫々の回路ブロ
ツクを所定の接続で配置してある。
このようにしてIC回路(1)の内部を複数のブロツク
で構成することにより、設計等を容易化することができ
る。例えば、回路ブロツク毎に別の設計者により設計す
ることで、効率よく設計することができる。
で構成することにより、設計等を容易化することができ
る。例えば、回路ブロツク毎に別の設計者により設計す
ることで、効率よく設計することができる。
ところが、上述の如きIC回路(1)の各回路ブロツク
は内部に一体に組込まれているため、個々の回路ブロツ
クだけの動作テストはできない不都合があつた。即ち、
このIC回路(1)の動作テストを行なうときには、入力
端子(3a),(3b)…からテスト信号を供給し、各回路
ブロツクを通過して出力端子(6a),(6b)…から出力
される信号の状態を検出していたが、このような動作テ
ストでは出力信号に異常が発生しても、どの回路ブロツ
クが原因であるのか簡単にはわからなかつた。このた
め、テスト信号としての多種の複雑な信号を用意して出
力端子(6a),(6b)…に得られる信号だけで各回路ブ
ロツクの状態を知ることができるようにしなければなら
ず、テスト信号の開発に手間がかかると共にテスト時間
も長く必要とする不都合があつた。
は内部に一体に組込まれているため、個々の回路ブロツ
クだけの動作テストはできない不都合があつた。即ち、
このIC回路(1)の動作テストを行なうときには、入力
端子(3a),(3b)…からテスト信号を供給し、各回路
ブロツクを通過して出力端子(6a),(6b)…から出力
される信号の状態を検出していたが、このような動作テ
ストでは出力信号に異常が発生しても、どの回路ブロツ
クが原因であるのか簡単にはわからなかつた。このた
め、テスト信号としての多種の複雑な信号を用意して出
力端子(6a),(6b)…に得られる信号だけで各回路ブ
ロツクの状態を知ることができるようにしなければなら
ず、テスト信号の開発に手間がかかると共にテスト時間
も長く必要とする不都合があつた。
本発明は之等の点に鑑み、内部の所定の回路ブロツク
だけのテストが簡単に行なえるIC回路を提供することを
目的とする。
だけのテストが簡単に行なえるIC回路を提供することを
目的とする。
本発明のIC回路は、例えば第1図に示す如く、所定の
回路ブロック(2)の前段に、入力信号のスルー状態と
シフトレジスタとしての作動状態とが選択できる入力コ
ンデイションレジスタ(10)を接続し、この所定の回路
ブロックの後段に、入力信号のスルー状態とシフトレジ
スタとしての作動状態とが選択できる出力コンデイショ
ンレジスタ(11)を接続し、入力コンディションレジス
タ(10)及び出力コンディションレジスタ(11)への、
スルー信号入力端子(12)から供給される信号の状態に
より、スルー状態とシフトレジスタとしての作動状態と
の選択をできるようにし、スルー信号入力端子(12)か
ら供給される信号により、入力コンディションレジスタ
(10)及び出力コンディションレジスタ(11)でシフト
レジスタとしての作動状態が選択されたとき、第1のシ
フトレジスタ動作信号入力端子(10b)に得られる信号
により、入力コンディションレジスタ(10)のシフトレ
ジスタとしての動作を制御すると共に、第2のシフトレ
ジスタ動作信号入力端子(11b)に得られる信号によ
り、出力コンディションレジスタ(11)のシフトレジス
タとしての動作を制御するようにしたものである。
回路ブロック(2)の前段に、入力信号のスルー状態と
シフトレジスタとしての作動状態とが選択できる入力コ
ンデイションレジスタ(10)を接続し、この所定の回路
ブロックの後段に、入力信号のスルー状態とシフトレジ
スタとしての作動状態とが選択できる出力コンデイショ
ンレジスタ(11)を接続し、入力コンディションレジス
タ(10)及び出力コンディションレジスタ(11)への、
スルー信号入力端子(12)から供給される信号の状態に
より、スルー状態とシフトレジスタとしての作動状態と
の選択をできるようにし、スルー信号入力端子(12)か
ら供給される信号により、入力コンディションレジスタ
(10)及び出力コンディションレジスタ(11)でシフト
レジスタとしての作動状態が選択されたとき、第1のシ
フトレジスタ動作信号入力端子(10b)に得られる信号
により、入力コンディションレジスタ(10)のシフトレ
ジスタとしての動作を制御すると共に、第2のシフトレ
ジスタ動作信号入力端子(11b)に得られる信号によ
り、出力コンディションレジスタ(11)のシフトレジス
タとしての動作を制御するようにしたものである。
本発明のIC回路は、入力コンデイシヨンレジスタ(1
0)と出力コンデイシヨンレジスタ(11)とを、通常作
動時には入力信号のスルー状態となるようにし、テスト
時にはシフトレジスタとして作動するようにすること
で、シフトレジスタとなつた入力コンデイシヨンレジス
タ(10)にテスト信号を供給して、出力コンデイシヨン
レジスタ(11)から所定の回路ブロツク(2)を介した
このテスト信号を取出すことができ、所定の回路ブロツ
ク(2)だけのテストが簡単に行なえる。
0)と出力コンデイシヨンレジスタ(11)とを、通常作
動時には入力信号のスルー状態となるようにし、テスト
時にはシフトレジスタとして作動するようにすること
で、シフトレジスタとなつた入力コンデイシヨンレジス
タ(10)にテスト信号を供給して、出力コンデイシヨン
レジスタ(11)から所定の回路ブロツク(2)を介した
このテスト信号を取出すことができ、所定の回路ブロツ
ク(2)だけのテストが簡単に行なえる。
以下、本発明のIC回路の一実施例を、第1図を参照し
て説明しよう。この第1図において、第2図に対応する
部分には同一符号を付し、その詳細説明は省略する。
て説明しよう。この第1図において、第2図に対応する
部分には同一符号を付し、その詳細説明は省略する。
本例のIC回路は、第1図に示す如く構成する。この第
1図において、(9)はIC回路全体を示し、このIC回路
(9)内には第2図例と同様に複数の回路ブロツク
(2),(3),(4),(5),(6),(7),
(8)…が配置してあり、本例は回路ブロツク(2)の
テストできるようにしたものである。即ち、回路ブロツ
ク(2)には、他の回路ブロツクからの信号入力部とし
て、I1,I2,I3…In(nは整数)があり、他の回路ブロ
ツクへの信号出力部としてO1,O2,O3…On(nは整数)
があるとすると、他の回路ブロツクとこの信号入力部I1
〜Inとの間に入力コンデイシヨンレジスタ(10)を接続
し、信号出力部O1〜Onと他の回路ブロツクとの間に出力
コンデイシヨンレジスタ(11)を接続する。この入力コ
ンデイシヨンレジスタ(10)は、IC回路(9)の外部か
らの信号が供給される端子としてテスト信号入力端子
(10a)とシフトレジスタ作動信号入力端子(10b)とを
備え、後述するスルー信号の供給状態によりテスト信号
をシフトレジスタ作動信号に同期させて回路ブロツク
(2)の各入力部に順次供給する。また、出力コンデイ
シヨンレジスタ(11)は、IC回路(9)の外部へ信号を
出力する端子としてテスト信号出力端子(11a)を備
え、IC回路(9)の外部から信号が供給される端子とし
てシフトレジスタ作動信号入力端子(11b)を備え、後
述するスルー信号の供給状態により回路ブロツク(2)
の各出力部の出力信号をシフトレジスタ作動信号に同期
させて出力端子(11a)から順次出力させる。そして、
双方のコンデイシヨンレジスタ(10),(11)にはIC回
路(9)の外部から入力端子(12)を介してスルー信号
が供給されるようにしてあり、双方のコンデイシヨンレ
ジスタ(10),(11)と回路ブロツク(2)にはIC回路
(9)の外部から入力端子(13)を介してクロツク信号
が供給されるようにしてある。
1図において、(9)はIC回路全体を示し、このIC回路
(9)内には第2図例と同様に複数の回路ブロツク
(2),(3),(4),(5),(6),(7),
(8)…が配置してあり、本例は回路ブロツク(2)の
テストできるようにしたものである。即ち、回路ブロツ
ク(2)には、他の回路ブロツクからの信号入力部とし
て、I1,I2,I3…In(nは整数)があり、他の回路ブロ
ツクへの信号出力部としてO1,O2,O3…On(nは整数)
があるとすると、他の回路ブロツクとこの信号入力部I1
〜Inとの間に入力コンデイシヨンレジスタ(10)を接続
し、信号出力部O1〜Onと他の回路ブロツクとの間に出力
コンデイシヨンレジスタ(11)を接続する。この入力コ
ンデイシヨンレジスタ(10)は、IC回路(9)の外部か
らの信号が供給される端子としてテスト信号入力端子
(10a)とシフトレジスタ作動信号入力端子(10b)とを
備え、後述するスルー信号の供給状態によりテスト信号
をシフトレジスタ作動信号に同期させて回路ブロツク
(2)の各入力部に順次供給する。また、出力コンデイ
シヨンレジスタ(11)は、IC回路(9)の外部へ信号を
出力する端子としてテスト信号出力端子(11a)を備
え、IC回路(9)の外部から信号が供給される端子とし
てシフトレジスタ作動信号入力端子(11b)を備え、後
述するスルー信号の供給状態により回路ブロツク(2)
の各出力部の出力信号をシフトレジスタ作動信号に同期
させて出力端子(11a)から順次出力させる。そして、
双方のコンデイシヨンレジスタ(10),(11)にはIC回
路(9)の外部から入力端子(12)を介してスルー信号
が供給されるようにしてあり、双方のコンデイシヨンレ
ジスタ(10),(11)と回路ブロツク(2)にはIC回路
(9)の外部から入力端子(13)を介してクロツク信号
が供給されるようにしてある。
以上のようにしてIC回路(9)は構成され、通常動作
時には外部からスルー信号入力端子(12)に例えばハイ
レベル信号を供給することで、各回路ブロツクからの信
号がこの双方のコンデイシヨンレジスタ(10),(11)
内をスルー状態で他の回路ブロツクへ供給されるように
なる。即ち、回路ブロツク(3),(4),(5)等か
ら回路ブロツク(2)の各入力部I1〜Inへの信号の供給
及び回路ブロツク(2)の各出力部O1〜Onから回路ブロ
ツク(6),(7),(8)等への信号の供給に入力及
び出力コンデイシヨンレジスタ(10),(11)が影響を
与えない状態になる。このような状態になることで、従
来のIC回路と同様の回路として機能する。
時には外部からスルー信号入力端子(12)に例えばハイ
レベル信号を供給することで、各回路ブロツクからの信
号がこの双方のコンデイシヨンレジスタ(10),(11)
内をスルー状態で他の回路ブロツクへ供給されるように
なる。即ち、回路ブロツク(3),(4),(5)等か
ら回路ブロツク(2)の各入力部I1〜Inへの信号の供給
及び回路ブロツク(2)の各出力部O1〜Onから回路ブロ
ツク(6),(7),(8)等への信号の供給に入力及
び出力コンデイシヨンレジスタ(10),(11)が影響を
与えない状態になる。このような状態になることで、従
来のIC回路と同様の回路として機能する。
そして、本例のIC回路(9)は、外部からスルー信号
入力端子(12)に例えばローレベル信号を供給すること
で、双方のコンデイシヨンレジスタ(10),(11)がシ
フトレジスタとして作動するようになる。このようにし
てシフトレジスタとして作動させながらテスト信号を供
給することで回路ブロツク(2)のテストが行なわれ
る。即ち、入力コンデイシヨンレジスタ(10)のテスト
信号入力端子(10a)に供給されるテスト信号をシフト
レジスタ作動用信号入力端子(10b)に得られる信号に
同期して順次シフトさせ、回路ブロツク(2)の各信号
入力部I1〜Inにこのシフトさせた信号を順次供給する。
そして、この各入力部I1〜Inの信号に応じて出力する回
路ブロツク(2)の各信号出力部O1〜Onの出力信号が出
力コンデイシヨンレジスタ(11)に供給されるが、出力
コンデイシヨンレジスタ(11)もシフトレジスタとして
作動するため、この各信号出力部O1〜Onの出力信号をシ
フトレジスタ作動用信号入力端子(11b)に得られる信
号に同期して順次シストさせ、テスト信号出力端子(11
a)から各信号出力部O1〜Onの出力信号を全て順次出力
させる。
入力端子(12)に例えばローレベル信号を供給すること
で、双方のコンデイシヨンレジスタ(10),(11)がシ
フトレジスタとして作動するようになる。このようにし
てシフトレジスタとして作動させながらテスト信号を供
給することで回路ブロツク(2)のテストが行なわれ
る。即ち、入力コンデイシヨンレジスタ(10)のテスト
信号入力端子(10a)に供給されるテスト信号をシフト
レジスタ作動用信号入力端子(10b)に得られる信号に
同期して順次シフトさせ、回路ブロツク(2)の各信号
入力部I1〜Inにこのシフトさせた信号を順次供給する。
そして、この各入力部I1〜Inの信号に応じて出力する回
路ブロツク(2)の各信号出力部O1〜Onの出力信号が出
力コンデイシヨンレジスタ(11)に供給されるが、出力
コンデイシヨンレジスタ(11)もシフトレジスタとして
作動するため、この各信号出力部O1〜Onの出力信号をシ
フトレジスタ作動用信号入力端子(11b)に得られる信
号に同期して順次シストさせ、テスト信号出力端子(11
a)から各信号出力部O1〜Onの出力信号を全て順次出力
させる。
このようにして入力コンデイシヨンレジスタ(10)の
テスト信号入力端子(10a)に供給したテスト信号が、
回路ブロツク(2)内の各信号入出力部を介して出力コ
ンデイシヨンレジスタ(11)のテスト信号出力端子(11
a)から出力されることにより、テスト信号はIC回路
(9)内の回路ブロツク(2)だけを通過した状態とな
り、この出力端子(11a)に得られる信号の状態を監視
することで、回路ブロツク(2)だけのチエツクができ
る。
テスト信号入力端子(10a)に供給したテスト信号が、
回路ブロツク(2)内の各信号入出力部を介して出力コ
ンデイシヨンレジスタ(11)のテスト信号出力端子(11
a)から出力されることにより、テスト信号はIC回路
(9)内の回路ブロツク(2)だけを通過した状態とな
り、この出力端子(11a)に得られる信号の状態を監視
することで、回路ブロツク(2)だけのチエツクができ
る。
このように本例によるIC回路(9)によると、スルー
信号入力端子(12)に供給するスルー信号の状態を変え
て入出力コンデイシヨンレジスタ(10),(11)をシフ
トレジスタとすることで、直接外部との信号入出力端子
を持たない回路ブロツク(2)だけをチエツクすること
ができる。このため、テスト信号としては一組の回路ブ
ロツク(2)だけをチエツクする信号でよいため短かい
簡単な信号でよく、チエツク時間を短かくできると共に
テスト信号の開発に手間がかからない。
信号入力端子(12)に供給するスルー信号の状態を変え
て入出力コンデイシヨンレジスタ(10),(11)をシフ
トレジスタとすることで、直接外部との信号入出力端子
を持たない回路ブロツク(2)だけをチエツクすること
ができる。このため、テスト信号としては一組の回路ブ
ロツク(2)だけをチエツクする信号でよいため短かい
簡単な信号でよく、チエツク時間を短かくできると共に
テスト信号の開発に手間がかからない。
なお、上述実施例では一組の回路ブロツク(2)の前
後に入力及び出力コンデイシヨンレジスタ(10),(1
1)を設けた場合についてのみ述べたが、他の回路ブロ
ツクにも同様にレジスタ(10),(11)を配置してテス
トが簡単に行なえるようにしてもよい。さらに、本発明
は上述実施例に限らず、本発明の要旨を逸脱することな
く、その他種々の構成が取り得ることは勿論である。
後に入力及び出力コンデイシヨンレジスタ(10),(1
1)を設けた場合についてのみ述べたが、他の回路ブロ
ツクにも同様にレジスタ(10),(11)を配置してテス
トが簡単に行なえるようにしてもよい。さらに、本発明
は上述実施例に限らず、本発明の要旨を逸脱することな
く、その他種々の構成が取り得ることは勿論である。
本発明のIC回路によると、所定の回路ブロツク(2)
の前段及び後段に入力コンデイシヨンレジスタ(10)及
び出力コンデイシヨンレジスタ(11)を接続したことに
より、この回路ブロツク(2)だけのテストが簡単に行
なえ、テスト時間の短縮及びテスト信号の簡易化が行な
える利益がある。特に本発明の場合には、入力コンディ
ションレジスタをシフトレジスタとしたときの作動状態
と、出力コンディションレジスタをシフトレジスタとし
たときの作動状態とを個別に制御することができ、良好
なタイミングでテスト動作を行うことができる。
の前段及び後段に入力コンデイシヨンレジスタ(10)及
び出力コンデイシヨンレジスタ(11)を接続したことに
より、この回路ブロツク(2)だけのテストが簡単に行
なえ、テスト時間の短縮及びテスト信号の簡易化が行な
える利益がある。特に本発明の場合には、入力コンディ
ションレジスタをシフトレジスタとしたときの作動状態
と、出力コンディションレジスタをシフトレジスタとし
たときの作動状態とを個別に制御することができ、良好
なタイミングでテスト動作を行うことができる。
第1図は本発明のIC回路の一実施例を示す構成図、第2
図は従来のIC回路の一例を示す構成図である。 (2),(3),(4),(5),(6),(7),
(8)は回路ブロツク、(9)はIC回路、(10)は入力
コンデイシヨンレジスタ、(11)は出力コンデイシヨン
レジスタである。
図は従来のIC回路の一例を示す構成図である。 (2),(3),(4),(5),(6),(7),
(8)は回路ブロツク、(9)はIC回路、(10)は入力
コンデイシヨンレジスタ、(11)は出力コンデイシヨン
レジスタである。
フロントページの続き (56)参考文献 特開 昭63−14445(JP,A) 特開 昭60−77518(JP,A) 特開 昭55−129772(JP,A)
Claims (1)
- 【請求項1】所定の回路ブロックの前段に、入力信号の
スルー状態とシフトレジスタとしての作動状態とが選択
できる入力コンディションレジスタを接続し、 上記所定の回路ブロックの後段に、入力信号のスルー状
態とシフトレジスタとしての作動状態とが選択できる出
力コンディションレジスタを接続し、 上記入力コンディションレジスタ及び出力コンディショ
ンレジスタへの、スルー信号入力端子から供給される信
号の状態により、スルー状態とシフトレジスタとしての
作動状態との選択をできるようにし、 上記スルー信号入力端子から供給される信号により、上
記入力コンディションレジスタ及び出力コンディション
レジスタでシフトレジスタとしての作動状態が選択され
たとき、 第1のシフトレジスタ動作信号入力端子に得られる信号
により、上記入力コンディションレジスタのシフトレジ
スタとしての動作を制御すると共に、 第2のシフトレジスタ動作信号入力端子に得られる信号
により、上記出力コンディションレジスタのシフトレジ
スタとしての動作を制御するようにしたIC回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61214908A JP2508427B2 (ja) | 1986-09-11 | 1986-09-11 | Ic回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61214908A JP2508427B2 (ja) | 1986-09-11 | 1986-09-11 | Ic回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS6370176A JPS6370176A (ja) | 1988-03-30 |
JP2508427B2 true JP2508427B2 (ja) | 1996-06-19 |
Family
ID=16663558
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP61214908A Expired - Fee Related JP2508427B2 (ja) | 1986-09-11 | 1986-09-11 | Ic回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2508427B2 (ja) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2608956B2 (ja) * | 1989-06-14 | 1997-05-14 | 松下電子工業株式会社 | 半導体集積回路 |
Family Cites Families (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE2902375C2 (de) * | 1979-01-23 | 1984-05-17 | Siemens AG, 1000 Berlin und 8000 München | Logikbaustein für integrierte Digitalschaltungen |
JPS6077518A (ja) * | 1983-10-05 | 1985-05-02 | Nec Corp | 集積回路 |
JPS6314445A (ja) * | 1986-07-04 | 1988-01-21 | Nec Corp | 集積回路 |
-
1986
- 1986-09-11 JP JP61214908A patent/JP2508427B2/ja not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
JPS6370176A (ja) | 1988-03-30 |
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