JP2012044108A - 半導体集積回路、該回路を備えるスイッチング電源及び該電源を備える制御システム - Google Patents

半導体集積回路、該回路を備えるスイッチング電源及び該電源を備える制御システム Download PDF

Info

Publication number
JP2012044108A
JP2012044108A JP2010186389A JP2010186389A JP2012044108A JP 2012044108 A JP2012044108 A JP 2012044108A JP 2010186389 A JP2010186389 A JP 2010186389A JP 2010186389 A JP2010186389 A JP 2010186389A JP 2012044108 A JP2012044108 A JP 2012044108A
Authority
JP
Japan
Prior art keywords
transistor
semiconductor integrated
integrated circuit
output
current
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP2010186389A
Other languages
English (en)
Inventor
Taketo Mishima
健人 三島
Tomiyuki Nagai
富幸 永井
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsumi Electric Co Ltd
Original Assignee
Mitsumi Electric Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Mitsumi Electric Co Ltd filed Critical Mitsumi Electric Co Ltd
Priority to JP2010186389A priority Critical patent/JP2012044108A/ja
Priority to CN2011102262772A priority patent/CN102377340A/zh
Priority to CN201510155020.0A priority patent/CN104851882B/zh
Priority to US13/188,744 priority patent/US8674677B2/en
Publication of JP2012044108A publication Critical patent/JP2012044108A/ja
Pending legal-status Critical Current

Links

Images

Classifications

    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/02—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers
    • H01L27/04—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body
    • H01L27/06—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including a plurality of individual components in a non-repetitive configuration
    • H01L27/0611—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including a plurality of individual components in a non-repetitive configuration integrated circuits having a two-dimensional layout of components without a common active region
    • H01L27/0617—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including a plurality of individual components in a non-repetitive configuration integrated circuits having a two-dimensional layout of components without a common active region comprising components of the field-effect type
    • H01L27/0623—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including a plurality of individual components in a non-repetitive configuration integrated circuits having a two-dimensional layout of components without a common active region comprising components of the field-effect type in combination with bipolar transistors
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/02—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers
    • H01L27/04—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body
    • H01L27/06—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including a plurality of individual components in a non-repetitive configuration
    • H01L27/0611—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including a plurality of individual components in a non-repetitive configuration integrated circuits having a two-dimensional layout of components without a common active region
    • H01L27/0617—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including a plurality of individual components in a non-repetitive configuration integrated circuits having a two-dimensional layout of components without a common active region comprising components of the field-effect type
    • H01L27/0635—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including a plurality of individual components in a non-repetitive configuration integrated circuits having a two-dimensional layout of components without a common active region comprising components of the field-effect type in combination with bipolar transistors and diodes, or resistors, or capacitors
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/02—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers
    • H01L27/04—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body
    • H01L27/08—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including only semiconductor components of a single kind
    • H01L27/082—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including only semiconductor components of a single kind including bipolar components only
    • H01L27/0823—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including only semiconductor components of a single kind including bipolar components only including vertical bipolar transistors only
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/02—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers
    • H01L27/04—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body
    • H01L27/08—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including only semiconductor components of a single kind
    • H01L27/085—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including only semiconductor components of a single kind including field-effect components only
    • H01L27/088—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including only semiconductor components of a single kind including field-effect components only the components being field-effect transistors with insulated gate
    • H01L27/092—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including only semiconductor components of a single kind including field-effect components only the components being field-effect transistors with insulated gate complementary MIS field-effect transistors
    • H01L27/0921—Means for preventing a bipolar, e.g. thyristor, action between the different transistor regions, e.g. Latchup prevention
    • H—ELECTRICITY
    • H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
    • H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
    • H02M3/00—Conversion of dc power input into dc power output
    • H02M3/02—Conversion of dc power input into dc power output without intermediate conversion into ac
    • H02M3/04—Conversion of dc power input into dc power output without intermediate conversion into ac by static converters
    • H02M3/10—Conversion of dc power input into dc power output without intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode
    • H02M3/145—Conversion of dc power input into dc power output without intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a triode or transistor type requiring continuous application of a control signal
    • H02M3/155—Conversion of dc power input into dc power output without intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a triode or transistor type requiring continuous application of a control signal using semiconductor devices only
    • H02M3/156—Conversion of dc power input into dc power output without intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a triode or transistor type requiring continuous application of a control signal using semiconductor devices only with automatic control of output voltage or current, e.g. switching regulators
    • H02M3/158—Conversion of dc power input into dc power output without intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a triode or transistor type requiring continuous application of a control signal using semiconductor devices only with automatic control of output voltage or current, e.g. switching regulators including plural semiconductor devices as final control devices for a single load
    • H—ELECTRICITY
    • H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
    • H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
    • H02M1/00—Details of apparatus for conversion
    • H02M1/0003—Details of control, feedback or regulation circuits
    • H02M1/0009—Devices or circuits for detecting current in a converter

Landscapes

  • Engineering & Computer Science (AREA)
  • Power Engineering (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Semiconductor Integrated Circuits (AREA)
  • Dc-Dc Converters (AREA)
  • Control Of Electrical Variables (AREA)

Abstract

【課題】寄生素子の動作を起因とする不安定動作を防ぐことができる、半導体集積回路を提供すること。
【解決手段】入出力を異なる電流値にする入出力比特性を有するカレントミラーを構成する一対のトランジスタ（６３，６５）と、前記カレントミラーの出力電流に応じて基準電圧を生成する出力トランジスタとを備える半導体集積回路であって、一対のトランジスタ（６３，６５）のうち前記電流値が小さい方のトランジスタ６３側のコレクタ領域８５Ａの総面積と一対のトランジスタ（６３，６５）のうち前記電流値が大きい方のトランジスタ６５側のコレクタ領域８２と８８とを合わせた総面積とが等しくなるように構成されたことを特徴とする、半導体集積回路。
【選択図】図６

Description

本発明は、入出力を異なる電流値にする入出力比特性を有するカレントミラーを構成する一対のトランジスタと、前記カレントミラーの出力電流に応じて基準電圧を出力する出力トランジスタとを備える半導体集積回路及びそれを備えるスイッチング電源、並びにそれらを備える制御システムに関する。
図１は、スイッチング電源の一例である降圧スイッチングレギュレータ１００の構成図である。降圧スイッチングレギュレータ１００は、一対の電源入力端子２，３に接続された外部電源１から供給される入力電圧ＶＢを降圧して、出力端子１０から出力される出力電圧ＶＯＵＴを所定の目標電圧にレギュレートするＤＣ−ＤＣコンバータである。降圧スイッチングレギュレータ１００は、入力電圧ＶＢを平滑する入力コンデンサ４と、ハイサイドの駆動トランジスタ２４とローサイドの駆動トランジスタ２５が形成された半導体集積回路２０と、駆動トランジスタ２４と駆動トランジスタ２５との接続点に一端が接続され出力端子１０に他端が接続されたインダクタ６と、インダクタ６に蓄積されたエネルギーが供給されて出力電圧ＶＯＵＴを平滑する出力コンデンサ９とを備える。駆動トランジスタ２４等の半導体スイッチング素子の具体例として、ＭＯＳＦＥＴ、バイポーラトランジスタが挙げられる。
半導体集積回路２０のＰＷＭ駆動回路２３は、周知の通り、発振器２２から出力される周期信号とエラーアンプ２６から出力される誤差増幅信号とに基づいて、インダクタ６を駆動する駆動トランジスタ２４，２５を同期整流方式でＰＷＭ駆動することによって、グランド端子２９基準で電源端子２７から供給される入力電圧ＶＢを所定の目標電圧に降圧調整された出力電圧ＶＯＵＴを出力端子１０から出力させる。エラーアンプ２６は、基準電圧ＶＲＥＦと帰還電圧ＶＦＢとの差分を増幅する。基準電圧ＶＲＥＦは、入力電圧ＶＢに基づいて基準電圧生成回路２１によって生成され、基準電圧端子２８に接続されたコンデンサ５によって平滑される。帰還電圧ＶＦＢは、出力電圧ＶＯＵＴが抵抗７，８によって分圧されて帰還端子３１から入力される電圧である。
図２は、駆動トランジスタ２５等が形成された半導体集積回路２０の構造を示した断面図である。Ｐ型半導体基板４１の表面にｎ型ウェル４２が形成されている。ｎ型ウェル４２内には、ｎ＋型のソース領域４４及びｎ＋型のドレイン領域４７が形成されている。ソース領域４４とドレイン領域４７との間には、ゲート酸化膜４５が形成されている。つまり、図２に示した半導体集積回路２０には、ソース領域４４に設けられたソース電極と、ドレイン領域４７に設けられたドレイン電極５３と、ゲート酸化膜４５に設けられたゲート電極５２とを有する、ＮチャネルＭＯＳＦＥＴが形成されている。
このＮチャネルＭＯＳＦＥＴが図１に示したローサイドの駆動トランジスタ２５であるとすると、ソース領域４４はグランドに接続され、ドレイン電極５３は図１に示したスイッチ端子３０に接続されている。つまり、ドレイン電極５３は、駆動トランジスタ２４と駆動トランジスタ２５との接続点に相当する。
このような構成の場合、ハイサイドの駆動トランジスタ２４がターンオフする際に、ドレイン電極５３の電位ＶＤＢは、図３に示されるように瞬間的に負電位に低下することになる。これにより、ｎ＋型のドレイン領域４７をエミッタとし、Ｐ型半導体基板４１をベースとし、駆動トランジスタ２４と同一の半導体集積回路２０のＰ型半導体基板４１上に形成される他素子のｎ＋領域４９をコレクタとした、ＮＰＮ型バイポーラトランジスタとして形成される寄生素子５６が、当該他の素子のｎ＋領域４９からＰ型半導体基板４１側に電流を引っ張る動作をする。
ところが、寄生素子５６のこのような動作によって、ｎ＋領域４９に設けられたドレイン電極５４の電位ＶＤＡも図３に示されるように低下するため、ｎ＋領域４９を使用する他の素子及び当該他の素子を含む他の回路が誤動作するおそれがある。このような誤動作を防止する手段として、寄生素子の動作を抑制するために、ガードリングを設ける技術が知られている（例えば、特許文献１を参照）。
特開２００１−７７６８２号公報 特開平１１−６５６９０号公報 特開２００６−３１３４３８号公報
このように、半導体集積回路の内部に形成される寄生素子の動作は、その半導体集積回路に形成される他の回路の動作を不安定にさせる要因になり得る。例えば、動作が不安定になり得る回路として、基準電圧生成回路が挙げられる。
図４は、基準電圧生成回路２１Ａの回路図である。基準電圧生成回路２１Ａは、図１に示した基準電圧生成回路２１の一例であって、その回路構成は例えば特許文献２，３に開示されたものである。基準電圧生成回路２１Ａは、入出力を異なる電流値にする入出力比特性を有するカレントミラーを構成する一対のトランジスタ（６３，６５）と、このカレントミラーの出力電流に応じて基準電圧ＶＲＥＦを生成する出力トランジスタ６７とを備えている。このカレントミラーが、トランジスタ６３のコレクタ電流に対してＮ倍のコレクタ電流をトランジスタ６５が流すように構成されている場合、トランジスタ６３のコレクタ領域をコレクタとする寄生トランジスタ６８に流れる電流がＩとすると、トランジスタ６５のコレクタ領域をコレクタとする寄生トランジスタ６９に流れる電流はＮ×Ｉとなる。このメカニズムについて、図５に従って説明する。
図５は、入出力を異なる電流値にする入出力比特性を有するカレントミラーを構成する一対のトランジスタ（６３，６５）が形成された従来の半導体集積回路の構造を示した断面及び上面視図である。図５は、トランジスタ６３のコレクタ電流に対して２倍（すなわち、Ｎ＝２）のコレクタ電流をトランジスタ６５が流すように構成されている場合を示している。ドレイン電極５３に接続されるトランジスタ（例えば、図１に示したハイサイドの駆動トランジスタ２４）の動作によって、ドレイン電極５３の電位ＶＤＢが負電位に低下すると、ＮＰＮ型バイポーラトランジスタとして形成される寄生素子９４が動作することによって寄生パス電流が流れる。つまり、トランジスタ６３のｎ＋型のコレクタ領域８５、Ｐ型半導体基板８１、ｎ＋型のドレイン領域４７の経路で、電流値Ｉの寄生パス電流が流れたとすると、トランジスタ６５のコレクタ領域８２と８８とを合わせた総面積はトランジスタ６３のコレクタ領域８５の面積の２倍なので、トランジスタ６５のコレクタ領域８２，８８、Ｐ型半導体基板８１、ドレイン領域４７の経路で、電流値（２×Ｉ）の寄生パス電流が流れる。
したがって、このような寄生パス電流が流れることによって、トランジスタ６３，６５によって構成されるカレントミラーの動作電流のバランスが崩れるため、図４に示される出力トランジスタ６７によって生成される基準電圧ＶＲＥＦが、所定の目標値（設計値）に対してずれてしまう。
このような基準電圧生成回路の不安定動作は、基準電圧生成回路によって生成される基準電圧ＶＲＥＦを利用するスイッチング電源の不安定動作（例えば、出力電圧ＶＯＵＴのずれ）を引き起こすおそれがあり、更にはそのスイッチング電源によって生成された出力電圧ＶＯＵＴを利用する制御システムの不安定動作（例えば、出力電圧ＶＯＵＴを異常と検出）をも引き起こすおそれがある。
そこで、本発明は、寄生素子の動作を起因とする不安定動作を防ぐことができる、基準電圧を生成する回路を有する半導体集積回路、該回路を備えるスイッチング電源及び該電源を備える制御システムの提供を目的とする。
上記目的を達成するため、本発明に係る半導体集積回路は、
入出力を異なる電流値にする入出力比特性を有するカレントミラーを構成する一対のトランジスタと、
前記カレントミラーの出力電流に応じて基準電圧を生成する出力トランジスタとを備える半導体集積回路であって、
前記一対のトランジスタのうち前記電流値が小さい方の第１のトランジスタ側のコレクタ領域の総面積と前記一対のトランジスタのうち前記電流値が大きい方の第２のトランジスタ側のコレクタ領域の総面積とが等しくなるように構成されたことを特徴とするものである。
また、上記目的を達成するため、本発明に係るスイッチング電源は、
該半導体集積回路と、
前記半導体集積回路の半導体基板に形成された駆動トランジスタによって駆動される誘導素子と、
前記誘導素子に蓄積されたエネルギーが供給される容量素子とを備え、
前記駆動トランジスタが、前記基準電圧と前記容量素子に生ずる出力電圧の帰還電圧とに基づいて、前記誘導素子を駆動することによって、前記出力電圧を一定にするものである。
また、上記目的を達成するため、本発明に係る制御システムは、
該スイッチング電源と、
前記出力電圧の異常を検出する異常検出部を有する制御装置とを備えるものである。
本発明によれば、寄生素子の動作を起因とする不安定動作を防ぐことができる。
スイッチング電源の一例である降圧スイッチングレギュレータ１００の構成図である。 駆動トランジスタ２５等が形成された半導体集積回路２０の構造を示した断面図である。 駆動トランジスタ２４のスイッチング時の波形図である。 基準電圧生成回路２１Ａの回路図である。 従来の半導体集積回路の構造を示した断面及び上面視図である。 本発明の第１の実施形態の半導体集積回路の構造を示した断面及び上面視図である。 基準電圧生成回路２１Ｂの回路図である。 本発明の第２の実施形態の半導体集積回路の構造を示した断面及び上面視図である。 負荷電流ＩＬと基準電圧ＶＲＥＦとの関係を示した図である。 スイッチング電源の一例である昇圧スイッチングレギュレータ２００の構成図である。 スイッチングレギュレータ１００（又は、２００）によって生成された出力電圧ＶＯＵＴを利用する制御装置３００を有する制御システム４００の構成図である。
以下、図面を参照して、本発明を実施するための形態の説明を行う。
実施例１の基準電圧生成回路の回路構成は、図４に示した基準電圧生成回路２１Ａと同じである。トランジスタ６３のコレクタとベースは、共通接続されると共に、抵抗６２を介して定電流源６１の下流側に接続されている。トランジスタ６３のエミッタは、接地されている。トランジスタ６５のコレクタは、トランジスタ６７のベースに接続されると共に、抵抗６４を介して定電流源６１の下流側に接続されている。トランジスタ６５のエミッタは、抵抗６６を介して接地されている。トランジスタ６７のコレクタは、定電流源６１の下流側に接続され、トランジスタ６７のエミッタは接地されている。定電流源６１の上流側は、入力電圧ＶＢに接続されている。この回路構成によって、トランジスタ６７のコレクタに一定の基準電圧ＶＲＥＦが生成される。
一対のトランジスタ（６３，６５）によって構成されるカレントミラーの入出力比特性は、１：Ｎ（Ｎは、１を除く正数）である。すなわち、入力側のトランジスタ６３のコレクタ電流（カレントミラーの入力電流）と出力側のトランジスタ６５のコレクタ電流（カレントミラーの出力電流）の電流比は、１：Ｎである。
図６は、Ｎ＝２の場合を示している。トランジスタ６３，６５のそれぞれは、一つのトランジスタ要素から構成されてもよいし、並列に接続された複数のトランジスタ要素から構成されてもよい。図６の場合、トランジスタ６３は、一つのトランジスタ要素から構成され、トランジスタ６５は、並列に接続された２つのトランジスタ要素から構成されている。トランジスタ６５のエミッタ領域８４と９０とを合わせた総面積は、トランジスタ６３のエミッタ領域８７の面積のＮ倍（すなわち、図６の場合、２倍）になるように形成されているため、入力側のトランジスタ６３のコレクタ電流（カレントミラーの入力電流）と出力側のトランジスタ６５のコレクタ電流（カレントミラーの出力電流）の電流比は、１：２である。
図６の場合、各トランジスタ要素のトランジスタとしての特性が同じになるように形成されている。例えば、図６に示されるように、各トランジスタ要素のｎ＋型のエミッタ領域８４，８７，９０の面積は互いに等しくなるように形成されている。また、各トランジスタ要素のＰ型のベース領域８３，８６，８９の面積は互いに等しくなるように形成されている。
また、一対のトランジスタ（６３，６５）のうちコレクタ電流が小さい方のトランジスタ６３側のコレクタ領域８５Ａの面積と一対のトランジスタ（６３，６５）のうちコレクタ電流が大きい方のトランジスタ６５側のコレクタ領域８２と８８とを合わせた総面積とが等しくなるように構成されている。このような構成であれば、ドレイン電極５３の電位ＶＤＢが負電位に低下することにより、ＮＰＮ型バイポーラトランジスタとして形成される寄生素子９４が動作しても、トランジスタ６３，６５によって構成されるカレントミラーの動作電流のバランスが崩れないので、寄生素子９４の動作を起因とする不安定動作を防ぐことができる。
なぜならば、ドレイン電極５３の電位ＶＤＢが負電位に低下することにより、トランジスタ６５のコレクタ領域８２，８８、Ｐ型半導体基板８１、ドレイン領域４７の経路で、電流値（２×Ｉ）の寄生パス電流が流れるとしても、トランジスタ６５のコレクタ領域８２と８８とを合わせた総面積はトランジスタ６３のコレクタ領域８５Ａの面積と同じなので、トランジスタ６３のｎ＋型のコレクタ領域８５Ａ、Ｐ型半導体基板８１、ｎ＋型のドレイン領域４７の経路で、（２×Ｉ）の同じ電流値の寄生パス電流が流れるからである。
つまり、カレントミラーを構成する一対のトランジスタにおいて、一方のトランジスタ（第１のトランジスタ）のコレクタ電流の電流値と他方のトランジスタ（第２のトランジスタ）のコレクタ電流の電流値との比が１：Ｎの場合であって、且つ、第２のトランジスタを構成する複数のトランジスタ要素のコレクタ領域の面積が互いに同じである場合、第１のトランジスタ側のコレクタ領域の総面積を、第２のトランジスタを構成する一のトランジスタ要素のコレクタ領域の面積をＮ倍したものに等しくなるように構成するとよい。これにより、第１のトランジスタ側に流れる寄生パス電流と第２のトランジスタ側に流れる寄生パス電流が同じ電流値（Ｎ×Ｉ）になるため、第１のトランジスタと第２のトランジスタとによって構成されるカレントミラーに流れる動作電流のバランスが崩れないので、寄生素子９４の動作を起因とする不安定動作を防ぐことができる。
図７は、実施例２の基準電圧生成回路２１Ｂの回路構成を示した図である。図４と同様の構成については、その説明を省略する。一対のトランジスタ（６３，６５）によって構成されるカレントミラーの入出力比特性は、１：Ｎ（Ｎは、１を除く正数）である。図７は、図４の回路構成に対して、（Ｎ−１）個のトランジスタ７０が追加された回路構成を示している。（Ｎ−１）個のトランジスタ７０のそれぞれのコレクタがトランジスタ６３のコレクタに接続されている。また、各トランジスタ７０が動作しないように、ベースとエミッタとコレクタとが互いに短絡されている。
このように構成されていることにより、トランジスタ６５のコレクタ領域をコレクタとする寄生トランジスタ７２に流れる電流がＮ×Ｉとすると、トランジスタ６３のコレクタ領域をコレクタとする寄生トランジスタ７１に流れる電流もＮ×Ｉとなる。なぜならば、トランジスタ７０の（Ｎ−１）個のコレクタ領域とトランジスタ６３の１個のコレクタ領域とを合わせたＮ個のコレクタ領域の総面積が、トランジスタ６５のＮ個のコレクタ領域の総面積に等しいからである。
図８は、Ｎ＝２の場合を示している。図６と同様の構成については、その説明を省略する。一対のトランジスタ（６３，６５）のうちコレクタ電流が小さい方のトランジスタ６３側のコレクタ領域８５と９５とを合わせた総面積と一対のトランジスタ（６３，６５）のうちコレクタ電流が大きい方のトランジスタ６５側のコレクタ領域８２と８８とを合わせた総面積とが等しくなるように構成されている。
このように構成であれば、実施例１と同様に、トランジスタ６５のコレクタ領域８２と８８とを合わせた総面積はトランジスタ６３のコレクタ領域８５と９５とを合わせた総面積とが同じなので、ドレイン電極５３の電位ＶＤＢが負電位に低下することにより、ＮＰＮ型バイポーラトランジスタとして形成される寄生素子９４が動作しても、（２×Ｉ）の同じ電流値の寄生パス電流がトランジスタ６３，６５によって構成されるカレントミラーの入力側と出力側の両方に流れるため、当該カレントミラーの動作電流のバランスが崩れず、寄生素子９４の動作を起因とする不安定動作を防ぐことができる。
図９は、従来の図５の構成と本発明の実施例である図８の構成の２つの場合について、図１の降圧スイッチングレギュレータ１００の出力端子１０に流れる負荷電流ＩＬと基準電圧ＶＲＥＦとの関係を示した図である。負荷電流ＩＬが増加するにつれてドレイン電極５３の電位ＶＤＢの負側への低下分が大きくなるので、基準電圧生成回路が不安定動作を起こしやすい。その結果、図５の構成では、負荷電流ＩＬが大きい領域で基準電圧ＶＲＥＦの持ち上がりが生じていたが、図８の構成では、そのような持ち上がりの発生を抑え、一定の基準電圧ＶＲＥＦが生成されることを維持することができる。
以上、本発明の好ましい実施例について詳説したが、本発明は、上述した実施例に制限されることはなく、本発明の範囲を逸脱することなく、上述した実施例に種々の変形及び置換を加えることができる。
例えば、図１において、駆動トランジスタ２５をダイオード１１に置き換え、又は駆動トランジスタ２４と駆動トランジスタ２５との接続点とインダクタ６との間にダイオード１１を追加して、ダイオード整流方式（非同期整流方式）で、インダクタ６を駆動する場合もある。また、Ｎチャネル型又はＮＰＮ型の駆動トランジスタ２４をＰチャネル型又はＰＮＰ型の駆動トランジスタに置き換えると共に駆動トランジスタ２５を削除して、ダイオード整流方式（非同期整流方式）で、インダクタ６を駆動する場合もある。
また、本発明の実施形態として、降圧スイッチングレギュレータ１００を図１に例示したが、昇圧スイッチングレギュレータでもよい。図１０は、昇圧スイッチングレギュレータ２００の構成図である。昇圧スイッチングレギュレータ２００の場合、インダクタ６を駆動する駆動トランジスタ２５のソース電極が接続されるグランドの電位が変動しやすいため、グランド電位を基準に生成される基準電圧ＶＲＥＦにずれが生じやすい。本発明は、このずれを効果的に抑えることができる。
また、基準電圧ＶＲＥＦを利用するスイッチング電源によって生成された出力電圧ＶＯＵＴを利用する制御装置を有する制御システムの不安定動作を防ぐことができる。図１１は、スイッチングレギュレータ１００（又は、２００）によって生成された出力電圧ＶＯＵＴを利用する制御装置３００を有する制御システム４００の構成図である。出力端子ＶＯＴは、制御装置３００の入力端子１２に入力される。
制御システム４００は、スイッチングレギュレータ１００（又は、２００）と、制御装置３００とを備える。制御装置３００は、出力電圧ＶＯＵＴの異常を検出する異常検出部３１０と、出力電圧ＶＯＵＴが電源電圧として入力される制御部３２０とを備える。制御装置３００がマイクロコンピュータの場合、制御部３２０の具体例として中央演算処理装置が挙げられる。上述の構成であれば、寄生素子の動作により出力電圧ＶＯＵＴが不安定にならないため、寄生素子の動作が実際に発生してもその動作を起因として異常検出部３１０が出力電圧ＶＯＵＴを異常と検出することを防ぐことができる。また、寄生素子の動作により出力電圧ＶＯＵＴが不安定にならないため、制御部３２０に不安定な出力電圧ＶＯＵＴが入力されることを防ぐことができる。
６ インダクタ（誘導素子）
９ 出力コンデンサ（容量素子）
２０ 半導体集積回路
２４，２５ 駆動トランジスタ
４１，８１ Ｐ型半導体基板
５６，６８，６９，７１，７２，９４ 寄生ＮＰＮ型バイポーラトランジスタ
１００ 降圧スイッチングレギュレータ
２００ 昇圧スイッチングレギュレータ
３００ 制御装置
４００ 制御システム

Claims (6)

  1. 入出力を異なる電流値にする入出力比特性を有するカレントミラーを構成する一対のトランジスタと、
    前記カレントミラーの出力電流に応じて基準電圧を生成する出力トランジスタとを備える半導体集積回路であって、
    前記一対のトランジスタのうち前記電流値が小さい方の第１のトランジスタ側のコレクタ領域の総面積と前記一対のトランジスタのうち前記電流値が大きい方の第２のトランジスタ側のコレクタ領域の総面積とが等しくなるように構成されたことを特徴とする、半導体集積回路。
  2. 前記第１のトランジスタのエミッタ領域の総面積と前記第２のトランジスタのエミッタ領域の総面積とが異なる、請求項１に記載の半導体集積回路。
  3. ベース領域とエミッタ領域とコレクタ領域とが互いに短絡され且つ該コレクタ領域が前記第１のトランジスタのコレクタ領域に短絡された第３のトランジスタを備え、
    前記第１のトランジスタ側のコレクタ領域は、前記第１のトランジスタのコレクタ領域と前記第３のトランジスタのコレクタ領域とを合わせた領域である、請求項１又は２に記載の半導体集積回路。
  4. 請求項１から３のいずれか一項に記載の半導体集積回路と、
    前記半導体集積回路の半導体基板に形成された駆動トランジスタによって駆動される誘導素子と、
    前記誘導素子に蓄積されたエネルギーが供給される容量素子とを備え、
    前記駆動トランジスタが、前記基準電圧と前記容量素子に生ずる出力電圧の帰還電圧とに基づいて、前記誘導素子を駆動することによって、前記出力電圧を一定にする、スイッチング電源。
  5. 請求項４に記載のスイッチング電源と、
    前記出力電圧の異常を検出する異常検出部を有する制御装置とを備える、制御システム。
  6. 前記制御装置が、マイクロコンピュータである、請求項５に記載の制御システム。
JP2010186389A 2010-08-23 2010-08-23 半導体集積回路、該回路を備えるスイッチング電源及び該電源を備える制御システム Pending JP2012044108A (ja)

Priority Applications (4)

Application Number Priority Date Filing Date Title
JP2010186389A JP2012044108A (ja) 2010-08-23 2010-08-23 半導体集積回路、該回路を備えるスイッチング電源及び該電源を備える制御システム
CN2011102262772A CN102377340A (zh) 2010-08-23 2011-07-18 半导体集成电路、包括该电路的开关电源以及包括该电源的控制系统
CN201510155020.0A CN104851882B (zh) 2010-08-23 2011-07-18 半导体集成电路、包括该电路的开关电源以及包括该电源的控制系统
US13/188,744 US8674677B2 (en) 2010-08-23 2011-07-22 Semiconductor integrated circuit, switching power supply, and control system

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2010186389A JP2012044108A (ja) 2010-08-23 2010-08-23 半導体集積回路、該回路を備えるスイッチング電源及び該電源を備える制御システム

Related Child Applications (1)

Application Number Title Priority Date Filing Date
JP2015012915A Division JP5962788B2 (ja) 2015-01-27 2015-01-27 半導体集積回路

Publications (1)

Publication Number Publication Date
JP2012044108A true JP2012044108A (ja) 2012-03-01

Family

ID=45593555

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2010186389A Pending JP2012044108A (ja) 2010-08-23 2010-08-23 半導体集積回路、該回路を備えるスイッチング電源及び該電源を備える制御システム

Country Status (3)

Country Link
US (1) US8674677B2 (ja)
JP (1) JP2012044108A (ja)
CN (2) CN104851882B (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2019041333A (ja) * 2017-08-28 2019-03-14 新日本無線株式会社 ノイズ誤動作防止回路

Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2002191171A (ja) * 2000-12-21 2002-07-05 Kenwood Corp 電源装置及び電力供給方法
JP2002315317A (ja) * 2001-04-18 2002-10-25 Fuji Electric Co Ltd Ｄｃ／ｄｃコンバータおよびそのスイッチングノイズ低減方法
JP2007311448A (ja) * 2006-05-17 2007-11-29 Renesas Technology Corp 半導体集積回路装置

Family Cites Families (16)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4857864A (en) * 1987-06-05 1989-08-15 Kabushiki Kaisha Toshiba Current mirror circuit
JP2888898B2 (ja) * 1990-02-23 1999-05-10 株式会社日立製作所 半導体集積回路
JPH07321306A (ja) * 1994-03-31 1995-12-08 Seiko Instr Inc 半導体装置およびその製造方法
JP3591107B2 (ja) * 1996-01-19 2004-11-17 富士通株式会社 電源降圧回路及び半導体装置
WO1999048210A1 (fr) * 1998-03-16 1999-09-23 Hitachi, Ltd. Circuit convertisseur n/a
JP3263334B2 (ja) * 1997-03-25 2002-03-04 株式会社東芝 電流源回路
JP3593858B2 (ja) 1997-08-13 2004-11-24 ミツミ電機株式会社 基準電圧源回路
JP4128700B2 (ja) 1999-09-08 2008-07-30 ローム株式会社 誘導性負荷駆動回路
JP2006313438A (ja) 2005-05-06 2006-11-16 Mitsumi Electric Co Ltd 基準電圧生成回路
US20090121770A1 (en) * 2007-03-29 2009-05-14 Linear Technology Corporation Method for clamping a semiconductor region at or near ground
JP2009004532A (ja) * 2007-06-21 2009-01-08 Toshiba Corp バンドギャップ基準電圧発生回路
JP2009128400A (ja) * 2007-11-20 2009-06-11 Sanyo Electric Co Ltd マルチチップパッケージの半導体装置
US8392779B2 (en) * 2008-04-25 2013-03-05 Qimonda Ag Interface voltage adjustment based on error detection
US7969135B2 (en) * 2008-08-14 2011-06-28 Infineon Technologies Ag Regulation circuit and a method for regulating an input voltage
US20120049829A1 (en) * 2009-05-19 2012-03-01 Rohm Co., Ltd. Power Supply Apparatus and Electronic Device Provided With Same
JP2010279138A (ja) * 2009-05-28 2010-12-09 Hitachi Ltd スイッチング昇圧型ｄｃ−ｄｃコンバータおよび半導体集積回路装置

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2002191171A (ja) * 2000-12-21 2002-07-05 Kenwood Corp 電源装置及び電力供給方法
JP2002315317A (ja) * 2001-04-18 2002-10-25 Fuji Electric Co Ltd Ｄｃ／ｄｃコンバータおよびそのスイッチングノイズ低減方法
JP2007311448A (ja) * 2006-05-17 2007-11-29 Renesas Technology Corp 半導体集積回路装置

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2019041333A (ja) * 2017-08-28 2019-03-14 新日本無線株式会社 ノイズ誤動作防止回路

Also Published As

Publication number Publication date
CN102377340A (zh) 2012-03-14
US20120043952A1 (en) 2012-02-23
CN104851882B (zh) 2018-05-29
US8674677B2 (en) 2014-03-18
CN104851882A (zh) 2015-08-19

Similar Documents

Publication Publication Date Title
JP4791132B2 (ja) 昇圧回路、昇圧回路を使用した定電圧回路及び昇圧回路を使用した定電流回路
US9966871B2 (en) Rectification device, alternator, and power conversion device
JP4690784B2 (ja) Ｄｃ−ｄｃコンバータ
JP2005333691A (ja) 過電流検出回路及びこれを有する電源装置
EP3361615A1 (en) Switching regulator and control device therefor
US9444445B2 (en) Power switch driving circuits and power converters thereof
JP5857680B2 (ja) 位相補償回路および半導体集積回路
US20150270774A1 (en) Power supply circuit
JP3100914B2 (ja) スイッチング電源
JP5703950B2 (ja) 電圧電流変換回路
US20160248329A1 (en) Buck power stage with multiple mosfet types
JP2008154419A (ja) スイッチングレギュレータ及びスイッチングレギュレータを構成する半導体装置
JP5636826B2 (ja) スイッチングレギュレータ
JP6805798B2 (ja) 過電流検出回路、半導体装置、及び、電源装置
US11258441B2 (en) Drive circuit
JP4745711B2 (ja) スイッチングレギュレータ
JP5421683B2 (ja) スイッチング電源装置
JP5962788B2 (ja) 半導体集積回路
JP4311683B2 (ja) 半導体装置、降圧チョッパレギュレータ、電子機器
JP2012044108A (ja) 半導体集積回路、該回路を備えるスイッチング電源及び該電源を備える制御システム
JP2018007307A (ja) 同期整流方式のスイッチングレギュレータ
JP2015220932A (ja) 半導体装置
JP2012027811A (ja) 電圧レギュレータを内蔵した半導体集積回路
JP2006287989A (ja) リップルフィルタ回路
JP2012016124A (ja) 半導体回路及びｄｃ−ｄｃコンバータ

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20130423

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20140213

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20140325

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20140507

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20141202

A02 Decision of refusal

Free format text: JAPANESE INTERMEDIATE CODE: A02

Effective date: 20150407