JP2010189693A - Cu膜の成膜方法および記憶媒体 - Google Patents

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Abstract

【課題】平滑で高品質のCVD−Cu膜を下地に対して高い密着性をもって成膜することができるCu膜の成膜方法を提供すること。
【解決手段】チャンバー1内にCVD−Ru膜を有するウエハWを収容し、チャンバー1内に、成膜中に発生する副生成物であるCu(hfac)の蒸気圧がその蒸気圧よりも低いCu錯体であるCu(hfac)TMVSからなる成膜原料を気相状態で導入して、ウエハWに形成されたCVD−Ru膜上にCVD−Cu膜を成膜するにあたり、チャンバー1内の圧力をCVD−Ru膜表面に吸着したCu(hfac)の脱離および拡散が進行する圧力に制御する。
【選択図】図4

Description

本発明は、半導体基板等の基板にCVDによりCu膜を成膜するCu膜の成膜方法および記憶媒体に関する。
近時、半導体デバイスの高速化、配線パターンの微細化等に呼応して、Alよりも導電性が高く、かつエレクトロマイグレーション耐性等も良好なCuが配線、Cuメッキのシード層、コンタクトプラグの材料として注目されている。
このCuの成膜方法としては、スパッタリングに代表される物理蒸着(PVD)法が多用されていたが、半導体デバイスの微細化にともなってステップカバレッジが悪いという欠点が顕在化している。
そこで、Cu膜の成膜方法として、Cuを含む原料ガスの熱分解反応や、当該原料ガスの還元性ガスによる還元反応にて基板上にCuを成膜する化学気相成長(CVD)法が用いられつつある。このようなCVD法により成膜されたCu膜(CVD−Cu膜)は、ステップカバレッジ(段差被覆性)が高く、細長く深いパターン内への成膜性に優れているため、微細なパターンへの追従性が高く、配線、Cuメッキのシード層、コンタクトプラグの形成には好適である。
このCVD法によりCu膜を成膜するにあたり、成膜原料(プリカーサー)にヘキサフルオロアセチルアセトナート・トリメチルビニルシラン銅(Cu(hfac)TMVS)等のCu錯体を用い、これを熱分解する技術が知られている(例えば特許文献1)。
一方、Cuの密着層やバリアメタルとして、CVD法によるRu膜(CVD−Ru膜)を用いる技術が知られている(特許文献2)。CVD−Ru膜は、ステップカバレッジが高く、Cu膜との密着性も高いため、Cuの密着層やバリアメタルに適している。
特開2000−282242号公報 特開平10−229084号公報
しかしながら、CVD−Cu膜の成膜原料として上述したCu(hfac)TMVSのような1価のジケトン系錯体を用いる場合には、CVD−Cu膜の成膜中に成膜原料よりも蒸気圧が低い副生成物が発生し、この副生成物が成膜表面に吸着する。このため、成膜表面であるRu膜表面は被毒により化学的活性が低下し、Cu原料の吸着阻害およびCu膜とRu膜との間の濡れ性低下が発生する。その結果、Cuの初期核密度が低下し、Cu膜の表面性状が悪化し(粗表面形状化)、Cu膜の品質低下が生じ、かつCu膜とRu膜との密着性が低下してしまう。このような問題は、成膜表面としてCVD−Ru膜以外の膜を用いた場合にも少なからず発生する。
本発明はかかる事情に鑑みてなされたものであって、平滑で高品質のCVD−Cu膜を下地に対して高い密着性をもって成膜することができるCu膜の成膜方法を提供することを目的とする。
また、そのような成膜方法を実行するためのプログラムを記憶した記憶媒体を提供することを目的とする。
本発明者らは、副生成物の蒸気圧がその蒸気圧よりも低い成膜原料を用いた場合に、副生成物の吸着によってCu原料の吸着阻害およびCu膜と下地膜との間の濡れ性低下が発生するメカニズムについて検討した。その結果、成膜原料よりも蒸気圧の低い副生成物は、基板に吸着しやすく、このような副生成物が基板表面に吸着することにより、Cu原料の吸着阻害およびCu膜とRu膜との間の濡れ性低下が発生することが判明した。このことを基にさらに検討を重ねた結果、副生成物の吸着と脱離は処理容器内の圧力と相関があり、圧力が高いほど吸着しやすく、圧力が低いほど脱離しやすくなるため、処理容器内の圧力を低下させて基板に吸着した前記副生成物の脱離および拡散が進行する圧力になるように制御することにより、副生成物が基板上に吸着することによるCu原料の吸着阻害およびCu膜とRu膜との間の濡れ性低下が抑制されることを見出し、本発明を完成するに至った。
すなわち、本発明は、処理容器内に基板を収容し、処理容器内に、成膜中に発生する副生成物の蒸気圧がその蒸気圧よりも低いCu錯体からなる成膜原料を気相状態で導入して、基板上にCVD法によりCu膜を成膜するにあたり、前記処理容器内の圧力を基板に吸着した前記副生成物の脱離および拡散が進行する圧力に制御することを特徴とするCu膜の成膜方法を提供する。
本発明において、前記基板として、表面にCVD法により成膜したRu膜を有するものを用い、そのRu膜の上にCu膜を成膜するようにすることができる。また、前記Cu錯体としては1価のβ−ジケトン錯体を用いることができる。その中ではヘキサフルオロアセチルアセトナート・トリメチルビニルシラン銅(Cu(hfac)TMVS)を好適なものとして挙げることができ、前記副生成物は、ヘキサフルオロアセチルアセトナート銅(Cu(hfac))である。この場合には、前記基板として、表面にCVD法により成膜したRu膜を有するものを用い、前記処理容器内の圧力を20Pa(0.15Torr)以下として、前記Ru膜の上にCu膜を成膜するようにすることができる。
前記Ru膜としては、成膜原料としてRu(CO)12を用いて成膜されたものが好適である。前記Ru膜は拡散防止膜の全部または一部として用いることができる。この場合に、前記拡散防止膜は、前記Ru膜の下層として、高融点材料膜を有するものとすることができる。前記高融点材料膜としては、Ta、TaN、Ti、W、TiN、WN、および酸化マンガンのいずれかからなるものを用いることができる。
得られたCu膜は、配線材として用いてもよいし、Cuメッキのシード膜として用いてもよい。
本発明はまた、コンピュータ上で動作し、成膜装置を制御するためのプログラムが記憶された記憶媒体であって、前記プログラムは、実行時に、上記成膜方法が行われるように、コンピュータに前記成膜装置を制御させることを特徴とする記憶媒体を提供する。
本発明によれば、基板上のRu膜への副生成物の吸着を抑制することができるので、Cu原料の吸着阻害およびCu膜とRu膜との間の濡れ性低下を抑制することができる。このため、CVD−Ru膜の上に平滑で高品質のCVD−Cu膜を高い密着性をもって成膜することができる。
本発明のCu膜の成膜方法を実施する成膜装置の構成の一例を示す略断面である。 本発明のCu膜の成膜方法が適用される基板である半導体ウエハの構造を示す断面図である。 副生成物による吸着阻害が生じた状態を説明するための模式図である。 本発明のCu膜の成膜方法におけるチャンバー内の状態を説明するための模式図である。 図2の構造の半導体ウエハに対してCVD−Cu膜を配線材として形成した状態を示す断面図である。 図2の構造の半導体ウエハに対してCVD−Cu膜をCuメッキのシード膜として形成した状態を示す断面図である。 図5の構造の半導体ウエハに対してCMPを行った状態を示す断面図である。 図6の構造の半導体ウエハに対してCuメッキを施した状態を示す断面図である。 図8の構造の半導体ウエハに対してCMPを行った状態を示す断面図である。 本発明のCu膜の成膜方法が適用される基板である半導体ウエハの他の構造を示す断面図である。 Cu(hfac)TMVSを成膜原料として用い、チャンバー内の圧力の圧力を変化させてCVD−Cu膜を成膜した際のCuの初期核の状態を示す走査型顕微鏡(SEM)写真である。
以下、添付図面を参照して、本発明の実施の形態について説明する。
<本発明の成膜方法を実施するための成膜装置の構成>
図1は、本発明の成膜方法を実施する成膜装置の構成の一例を示す略断面である。
この成膜装置100は、気密に構成された略円筒状のチャンバー1を有しており、その中には被処理基板である半導体ウエハWを水平に支持するためのサセプタ2がその中央下部に設けられた円筒状の支持部材3により支持された状態で配置されている。このサセプタ2はAlN等のセラミックスからなっている。また、サセプタ2にはヒーター5が埋め込まれており、このヒーター5にはヒーター電源6が接続されている。一方、サセプタ2の上面近傍には熱電対7が設けられており、熱電対7の信号はヒーターコントローラ8に伝送されるようになっている。そして、ヒーターコントローラ8は熱電対7の信号に応じてヒーター電源6に指令を送信し、ヒーター5の加熱を制御してウエハWを所定の温度に制御するようになっている。
チャンバー1の天壁1aには、円形の孔1bが形成されており、そこからチャンバー1内へ突出するようにシャワーヘッド10が嵌め込まれている。シャワーヘッド10は、後述するガス供給機構30から供給された成膜用のガスをチャンバー1内に吐出するためのものであり、その上部には、成膜原料ガスとして熱分解して生成される副生成物の蒸気圧がその蒸気圧よりも低いCu錯体、例えば1価のβ−ジケトン錯体であるヘキサフルオロアセチルアセトナート・トリメチルビニルシラン銅(Cu(hfac)TMVS)が導入される第1の導入路11と、チャンバー1内に希釈ガスが導入される第2の導入路12とを有している。この希釈ガスとしては、ArガスまたはHガスが用いられる。
シャワーヘッド10の内部には上下2段に空間13、14が設けられている。上側の空間13には第1の導入路11が繋がっており、この空間13から第1のガス吐出路15がシャワーヘッド10の底面まで延びている。下側の空間14には第2の導入路12が繋がっており、この空間14から第2のガス吐出路16がシャワーヘッド10の底面まで延びている。すなわち、シャワーヘッド10は、成膜原料としてのCu錯体ガスと希釈ガスとがそれぞれ独立して吐出路15および16から吐出するようになっている。
チャンバー1の底壁には、下方に向けて突出する排気室21が設けられている。排気室21の側面には排気管22が接続されており、この排気管22には真空ポンプや圧力制御バルブ等を有する排気装置23が接続されている。そしてこの排気装置23を作動させることによりチャンバー1内を所定の減圧状態とすることが可能となっている。また、圧力計24によりチャンバー1内の圧力が検出されるようになっており、この検出値に基づいて排気装置23の圧力制御バルブの開度が制御されチャンバー1内の圧力が制御される。本実施形態では、被処理基板であるウエハWの表面に吸着した副生成物の脱離および拡散が進行する圧力に制御される。
チャンバー1の側壁には、ウエハ搬送室(図示せず)との間でウエハWの搬入出を行うための搬入出口25と、この搬入出口25を開閉するゲートバルブGとが設けられている。また、チャンバー1の壁部には、ヒーター26が設けられてり、成膜処理の際にチャンバー1の内壁の温度を制御可能となっている。
ガス供給機構30は、熱分解して生成される副生成物の蒸気圧がその蒸気圧よりも低いCu錯体、例えば液体状の1価のβ−ジケトン錯体であるCu(hfac)TMVSを成膜原料として貯留する成膜原料タンク31を有している。成膜原料を構成するCu錯体としては、Cu(hfac)MHY、Cu(hfac)ATMS、Cu(hfac)DMDVS、Cu(hfac)TMOVS,Cu(hfac)COD等の他の1価のβ−ジケトン錯体を用いることができる。用いる1価のCu錯体が常温で固体である場合には、溶媒に溶かした状態で成膜原料タンク31に貯留することができる。
成膜原料タンク31には、上方からHeガス等の圧送ガスを供給するための圧送ガス配管32が挿入されており、圧送ガス配管32はバルブ33が介装されている。また、成膜原料タンク31内の成膜原料には原料送出配管34が上方から挿入されており、この原料送出配管34の他端には気化器37が接続されている。原料送出配管34にはバルブ35および液体マスフローコントローラ36が介装されている。そして、圧送ガス配管32を介して成膜原料タンク31内に圧送ガスを導入することで、成膜原料タンク31内のCu錯体、例えばCu(hfac)TMVSが液体のまま気化器37に供給される。このときの液体供給量は液体マスフローコントローラ36により制御される。気化器37には、キャリアガスとしてArまたはH等を供給するキャリアガス配管38が接続されている。キャリアガス配管38には、マスフローコントローラ39およびマスフローコントローラ39を挟んで2つのバルブ40が設けられている。また、気化器37には、気化されたCu錯体をシャワーヘッド10に向けて供給する成膜原料ガス供給配管41が接続されている。成膜原料ガス供給配管41にはバルブ42が介装されており、その他端はシャワーヘッド10の第1の導入路11に接続されている。そして、気化器37で気化したCu錯体がキャリアガスにキャリアされて成膜原料ガス供給配管41に送出され、第1の導入路11からシャワーヘッド10内に供給される。気化器37および成膜原料ガス供給配管41およびキャリアガス配管の下流側のバルブ40までの部分には、成膜原料ガスの凝縮防止のためのヒーター43が設けられている。ヒーター43にはヒーター電源(図示せず)から給電され、コントローラ(図示せず)により温度制御されるようになっている。
シャワーヘッド10の第2の導入路12には、希釈ガスを供給する希釈ガス供給配管44が接続されている。この希釈ガス供給配管44にはバルブ45が介装されている。そして、この希釈ガス供給配管44を介して第2の導入路12からシャワーヘッド10内に、希釈ガスとしてArガスまたはHガスが供給される。
成膜装置100は制御部50を有し、この制御部50により各構成部、例えばヒーター電源6、排気装置23(圧力制御バルブ、真空ポンプ)、マスフローコントローラ36,39、バルブ33,35,40,42,45等の制御やヒーターコントローラ8を介してのサセプタ2の温度制御等を行うようになっている。この制御部50は、マイクロプロセッサ(コンピュータ)を備えたプロセスコントローラ51と、ユーザーインターフェース52と、記憶部53とを有している。プロセスコントローラ51には成膜装置100の各構成部が電気的に接続されて制御される構成となっている。ユーザーインターフェース52は、プロセスコントローラ51に接続されており、オペレータが成膜装置100の各構成部を管理するためにコマンドの入力操作などを行うキーボードや、成膜装置100の各構成部の稼働状況を可視化して表示するディスプレイ等からなっている。記憶部53もプロセスコントローラ51に接続されており、この記憶部53には、成膜装置100で実行される各種処理をプロセスコントローラ51の制御にて実現するための制御プログラムや、処理条件に応じて成膜装置100の各構成部に所定の処理を実行させるための制御プログラムすなわち処理レシピや、各種データベース等が格納されている。処理レシピは記憶部53の中の記憶媒体(図示せず)に記憶されている。記憶媒体は、ハードディスク等の固定的に設けられているものであってもよいし、CDROM、DVD、フラッシュメモリ等の可搬性のものであってもよい。また、他の装置から、例えば専用回線を介してレシピを適宜伝送させるようにしてもよい。
そして、必要に応じて、ユーザーインターフェース52からの指示等にて所定の処理レシピを記憶部53から呼び出してプロセスコントローラ51に実行させることで、プロセスコントローラ51の制御下で、成膜装置100での所望の処理が行われる。
<本発明の実施形態に係るCu膜の成膜方法>
次に、以上のように構成された成膜装置を用いた本実施形態のCu膜の成膜方法について説明する。
ここでは、成膜中に発生する副生成物の蒸気圧がその蒸気圧よりも低くなる成膜原料としてCu(hfac)TMVSを用いた場合を例にとって説明する。
また、ここでは、CVD法により成膜されたRu膜(CVD−Ru膜)の上にCVD法によりCu膜(CVD−Cu膜)を成膜する。例えば、図2に示すように、CVD−Ru膜102を介して下層のCu配線層101が形成された下層の配線絶縁層103の上に、キャップ絶縁膜104を介して層間絶縁膜105が形成され、その上にハードマスク層106を介して上層の配線絶縁層107が形成され、ハードマスク層106、層間絶縁膜105、キャップ絶縁膜104を貫通し、下層のCu配線層101に達するビアホール108が形成され、上層配線絶縁層107に配線溝であるトレンチ109が形成され、さらにビアホール108とトレンチ109の内壁および上層の配線絶縁層107の上にバリア層(拡散防止層)としてCVD−Ru膜110が形成されたウエハWに対し、CVD−Cu膜を成膜する。
CVD−Ru膜は、成膜原料としてRu(CO)12を用いて成膜したものであることが好ましい。これにより、高純度のCVD−Ruを得られるため、清浄かつ強固なCuとRuの界面を形成することができる。CVD−Ru膜を成膜する装置としては、常温で固体であるRu(CO)12を加熱して発生した蒸気を供給するようにした以外は、図1の装置と同様に構成されたものを用いることができる。
Cu膜の成膜に際しては、まず、ゲートバルブGを開け、図示しない搬送装置により上記構成のウエハWをチャンバー1内に導入し、サセプタ2上に載置する。次いで、チャンバー1内を排気装置23により排気してチャンバー1内の圧力を1.33〜266.6Pa(10mTorr〜2Torr)とし、ヒーター5によりサセプタ2を150〜200℃に加熱し、キャリアガス配管38、気化器37、成膜原料ガス配管41、シャワーヘッド10を介してチャンバー1内に100〜1500mL/min(sccm)の流量でキャリアガスを供給し、さらに0〜1500mL/min(sccm)程度の希釈ガスを希釈ガス供給配管44、シャワーヘッド10を介してチャンバー1内に導入して安定化を行う。
安定化を所定時間行って条件が安定した時点で、キャリアガスおよび希釈ガスを供給した状態のまま、液体のCu(hfac)TMVSを50〜70℃の気化器37で気化させてチャンバー1内に導入しCu膜の成膜を開始する。このときの流量は、液体として100〜500mg/min程度とする。
成膜原料であるCu(hfac)TMVSは、サセプタ2のヒーター5により加熱された被処理基板であるウエハW上で以下の(1)式に示す反応により分解し、Ru膜の上にCu膜が成膜される。
2Cu(hfac)TMVS→Cu+Cu(hfac)+2TMVS…(1)
ところで、成膜原料であるCu(hfac)TMVSは気相中でも一部分解してCu(hfac)が生成される。Cu(hfac)は、蒸気圧が成膜原料であるCu(hfac)TMVSよりも低いため、吸着しやすく、図3に示すように、CVD−Ru膜110の表面には、成膜原料であるCu(hfac)TMVSよりも副生成物であるCu(hfac)が多く吸着することがある。
このようにCu(hfac)がCVD−Ru膜110の表面に吸着すると、Ru膜表面は被毒により化学的活性が低下し、Cu(hfac)TMVSの吸着阻害およびCu膜とRu膜との間の濡れ性低下が発生する。その結果、Cuの初期核密度が低下し、Cu膜の表面性状が悪化し(粗表面形状化)、Cu膜の品質低下が生じ、かつCu膜とRu膜との密着性が低下してしまう。
そこで、本実施形態では、チャンバー1内の圧力を制御することにより、副生成物であるCu(hfac)の吸着による不都合を解消する。すなわち、副生成物の吸着と脱離はチャンバー1内の圧力と相関があり、圧力が大きいほど吸着しやすく、圧力が小さいほど拡散係数が大きくなって脱離しやすくなるため、チャンバー1内の圧力を低下させて下地であるCVD−Ru膜に吸着したCu(hfac)の脱離および拡散が進行する圧力になるように制御する。この実施形態のように、副生成物がCu(hfac)で、下地膜がCVD−Ru膜の場合には、20Pa(0.15Torr)以下でCu(hfac)の脱離および拡散が十分に進行するようになる。
これにより、図4に示すように、CVD−Ru膜110に一旦Cu(hfac)が吸着しても、速やかにCu(hfac)がCVD−Ru膜110から脱離し、排気されるため、Cu(hfac)がCVD−Ru膜110に吸着することによるCu(hfac)TMVSの吸着阻害およびCu膜とRu膜との間の濡れ性低下が抑制される。このため、CVD−Ru膜110の上に平滑で高品質のCVD−Cu膜を高い密着性をもって成膜することができる。なお、20Pa(0.15Torr)は臨界的であり、20Pa(0.15Torr)を超えると、Cu(hfac)によるCu(hfac)TMVSの吸着阻害が生じ、Cuの初期核密度が低下してしまう。
このようにして成膜されるCVD−Cu膜は、配線材として用いることもできるし、Cuメッキのシード層として用いることもできる。CVD−Cu膜を配線材として用いる場合には、図5に示すように、ビアホール108およびトレンチ109をすべて埋まるまでCVD−Cu膜111を成膜して、配線およびプラグをすべてCVD−Cu膜111で形成する。また、Cuメッキのシード膜として用いる場合には、図6に示すように、CVD−Cu膜111をCVD−Ru膜110の表面に薄く形成する。
そして、このようにしてCu膜を成膜した後、パージ工程を行う。パージ工程では、Cu(hfac)TMVSの供給を停止した後、排気装置23の真空ポンプを引き切り状態とし、キャリアガスをパージガスとしてチャンバー1内に流してチャンバー1内をパージする。この場合に、できる限り迅速にチャンバー1内をパージする観点から、キャリアガスの供給は断続的に行うことが好ましい。
パージ工程が終了後、ゲートバルブGを開け、図示しない搬送装置により、搬入出口25を介してウエハWを搬出する。これにより、1枚のウエハWの一連の工程が終了する。
図5のように配線およびプラグをすべてCVD−Cu膜111で形成する場合には、その後、CMP(化学機械研磨)を行って余分なCu部分を除去し、図7に示すように、配線絶縁膜107とCVD−Cu膜111が面一となるようにする。また、図6のようにCVD−Cu膜111をCuメッキのシード膜として薄く形成する場合には、その後、図8に示すようにCuメッキ112を形成して配線およびプラグを形成し、その状態からCMP(化学機械研磨)を行って余分なCu部分を除去し、図9に示すように配線絶縁膜107とCuメッキ層112が面一となるようにする。
なお、上記例では、バリア層(拡散防止層)としてCVD−Ru膜110の単層を用いた例を示したが、図10に示すように、上層のCVD−Ru膜110と下層としての高融点材料膜113との積層構造であってもよい。この場合に、下層としては、Ta、TaN、Ti、W、TiN、WN、酸化マンガン等のいずれかを用いることができる。
<実施例>
次に、本発明の実施例について、比較例と比較しつつ説明する。
ここでは、Si基板上に厚さ100nmのSiO膜が形成され、その上にスパッタリングにより形成された厚さ2nmのTi膜と厚さ2nmのCVD−Ru膜からなるバリア層を形成したものを基板として用い、成膜原料としてCu(hfac)TMVSを用い、図1に示す装置にてCu膜を成膜した。成膜原料としてCu(hfac)TMVSを用い250mg/minの流量で供給するとともに、キャリアガスとしてHガスを400mL/min(sccm)の流量で供給し、サセプタ温度240℃とし、チャンバー1内の圧力を4.0Pa(0.03Torr)、6.65Pa(0.05Torr)、13.3Pa(0.1Torr)、20.0Pa(0.15Torr)、40.0Pa(0.3Torr)、66.5Pa(0.5Torr)、266Pa(2Torr)と変化させてCu膜の成膜を行った。その際の各圧力で成膜されたCu膜の初期核の状態を図11の10万倍の走査型顕微鏡(SEM)写真で示す。図11に示すように、チャンバー1内の圧力が20.0Pa(0.15Torr)以下では、Cuの初期核が密集していて核密度が高いことが確認される。一方、20.0Pa(0.15Torr)を超えると急激にCuの初期核がまばらとなり核密度が低くなることがわかる。この結果から、チャンバー1内の圧力を本発明に従って、下地表面に吸着した副生物の脱離および拡散が進行する圧力に制御することによりCu膜成膜の際の核密度を高くできることが確認された。
<本発明の他の適用>
なお、本発明は、上記実施の形態に限定されることなく種々変形可能である。例えば、上記実施の形態においては、熱分解して生成される副生成物の蒸気圧がその蒸気圧よりも低いCu錯体としてCu(hfac)TMVSを用いた場合について示したが、これに限るものではない。また、成膜の下地としてCVD−Ru膜を用いた場合について示したが、これに限るものではない。
また、上記実施の形態では、液体状のCu錯体を圧送して気化器に供給し、気化器で気化させたが、これに限らず、例えばバブリング等により気化させて供給する等、他の手法で気化させてもよい。
さらに、成膜装置についても上記実施の形態のものに限らず、例えば、成膜原料ガスの分解を促進するためにプラズマを形成する機構を設けたもの等、種々の装置を用いることができる。
さらにまた、被処理基板の構造は図2、図10のものに限るものではない。さらにまた、被処理基板として半導体ウエハを用いた場合を説明したが、これに限らず、フラットパネルディスプレイ(FPD)基板等の他の基板であってもよい。
1;チャンバー
2;サセプタ
3;支持部材
5;ヒーター
10;シャワーヘッド
23;排気装置
24;圧力センサー
30;ガス供給機構
31;成膜原料タンク
34;原料送出配管
37;気化器
38;キャリアガス供給配管
41;成膜原料ガス供給配管
50;制御部
51;プロセスコントローラ
52;ユーザーインターフェース
53;記憶部(記憶媒体)
W;半導体ウエハ

Claims (12)

  1. 処理容器内に基板を収容し、処理容器内に、成膜中に発生する副生成物の蒸気圧がその蒸気圧よりも低いCu錯体からなる成膜原料を気相状態で導入して、基板上にCVD法によりCu膜を成膜するにあたり、前記処理容器内の圧力を基板に吸着した前記副生成物の脱離および拡散が進行する圧力に制御することを特徴とするCu膜の成膜方法。
  2. 前記基板として、表面にCVD法により成膜したRu膜を有するものを用い、そのRu膜の上にCu膜を成膜することを特徴とする請求項1に記載のCu膜の成膜方法。
  3. 前記Cu錯体は1価のβ−ジケトン錯体であることを特徴とする請求項1に記載のCu膜の成膜方法。
  4. 前記Cu錯体は、ヘキサフルオロアセチルアセトナート・トリメチルビニルシラン銅(Cu(hfac)TMVS)であり、前記副生成物は、ヘキサフルオロアセチルアセトナート銅(Cu(hfac))であることを特徴とする請求項3に記載のCu膜の成膜方法。
  5. 前記基板として、表面にCVD法により成膜したRu膜を有するものを用い、前記処理容器内の圧力を20Pa(0.15Torr)以下として、前記Ru膜の上にCu膜を成膜することを特徴とする請求項4に記載のCu膜の成膜方法。
  6. 前記Ru膜は、成膜原料としてRu(CO)12を用いて成膜されたものであることを特徴とする請求項2または請求項5に記載のCu膜の成膜方法。
  7. 前記Ru膜は拡散防止膜の全部または一部として用いられることを特徴とする請求項2、請求項5および請求項6のいずれか1項に記載のCu膜の成膜方法。
  8. 前記拡散防止膜は、前記Ru膜の下層として、高融点材料膜を有することを特徴とする請求項7に記載のCu膜の成膜方法。
  9. 前記高融点材料膜は、Ta、TaN、Ti、W、TiN、WN、および酸化マンガンのいずれかからなることを特徴とする請求項8に記載のCu膜の成膜方法。
  10. 得られたCu膜を配線材として用いることを特徴とする請求項1から請求項9のいずれか1項に記載のCu膜の成膜方法。
  11. 得られたCu膜をCuメッキのシード膜として用いることを特徴とする請求項1から請求項9のいずれか1項に記載のCu膜の成膜方法。
  12. コンピュータ上で動作し、成膜装置を制御するためのプログラムが記憶された記憶媒体であって、前記プログラムは、実行時に、請求項1から請求項11のいずれかの成膜方法が行われるように、コンピュータに前記成膜装置を制御させることを特徴とする記憶媒体。
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* Cited by examiner, † Cited by third party
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CN104347482B (zh) * 2013-08-02 2018-02-06 中芯国际集成电路制造(上海)有限公司 一种半导体器件及其制造方法
JP6836959B2 (ja) * 2017-05-16 2021-03-03 東京エレクトロン株式会社 プラズマ処理装置、処理システム、及び、多孔質膜をエッチングする方法

Family Cites Families (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP3409831B2 (ja) * 1997-02-14 2003-05-26 日本電信電話株式会社 半導体装置の配線構造の製造方法
JP2000256856A (ja) * 1999-03-11 2000-09-19 Tokyo Electron Ltd 処理装置及び処理装置用真空排気システム及び減圧cvd装置及び減圧cvd装置用真空排気システム及びトラップ装置
JP4439030B2 (ja) 1999-04-01 2010-03-24 東京エレクトロン株式会社 気化器、処理装置、処理方法、及び半導体チップの製造方法
JP2004304167A (ja) * 2003-03-20 2004-10-28 Advanced Lcd Technologies Development Center Co Ltd 配線、表示装置及び、これらの形成方法
JP4889227B2 (ja) * 2005-03-23 2012-03-07 東京エレクトロン株式会社 基板処理方法および成膜方法
US7396766B2 (en) 2005-03-31 2008-07-08 Tokyo Electron Limited Low-temperature chemical vapor deposition of low-resistivity ruthenium layers
US7405153B2 (en) * 2006-01-17 2008-07-29 International Business Machines Corporation Method for direct electroplating of copper onto a non-copper plateable layer
JP4634977B2 (ja) * 2006-08-15 2011-02-16 Okiセミコンダクタ株式会社 半導体装置及び半導体装置の製造方法

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