JP2008042890A - パルス変調回路及びパルス変調方法 - Google Patents
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Abstract
【解決手段】制御信号生成部110は、送信データS11が「1」の場合に第1の制御信号を生成し、送信データS11が「0」の場合に第2の制御信号をし、第1の制御信号がオンとなる間、間欠動作回路120の発振器1200を所望の第1の発振信号を出力する発振状態に制御し、第2の制御信号がオンとなる間、発振器1200を第1の発振信号よりも低振幅の第2の発振信号を出力するアイドリング状態に制御する。
【選択図】図1
Description
図1に、本発明の実施の形態1に係るパルス変調回路の要部構成を示す。図1に示すパルス変調回路100は、制御信号生成部110と、間欠動作回路120とを備えている。
図9は本発明の実施の形態2におけるパルス変調回路の構成例を示すブロック図である。
実施の形態3における変調器は、実施の形態2における付加信号生成部2103に代えて、図12に示す付加信号生成部310を有する点が、実施の形態2と異なる。その他のパルス変調回路の全体構成は、実施の形態2と同様である。そこで、以下では、付加信号生成部310の構成を詳述する。
実施の形態4における制御信号生成部410は、実施の形態2における波形整形部2102及び付加信号生成部2103に代えて、図15に示す波形整形部411及び付加信号生成部412を有する点が、実施の形態2と異なる。その他のパルス変調回路の全体構成は、実施の形態2と同様である。そこで、以下では、波形整形部411及び付加信号生成部412の構成を中心に説明する。
110,110A,210 制御信号生成部
120 間欠動作回路
130 バッファアンプ
1101 送信データ判定部
1102,1105 遅延調整部
1103 振幅調整部
1104 合成部
1106,2101,3101 分岐回路
1107 論理(NOR)回路
1200 発振器
1201 共振器
1202,1222 トランジスタ
1203,1223 バイアス端子
1204,1224 DCカットコンデンサ
1210 スイッチ
1211 終端負荷
1220 逓倍器
1221−1,1221−2 整合回路
2102,411 波形整形部
2103,310,412 付加信号生成部
2104,2109,3102,3105 パルス変調部
2105 可変帯域制限回路
2106,4122 リミッタ回路
2107,3104 インバータ回路
2108、3103,3107 遅延回路
2110 インダクタンス
2111,3110 抵抗
2112 バラクタダイオード
3106 論理積(AND)回路
3108,3109 ダイオード
4111 波形合成回路
4121 帯域制限回路
Claims (19)
- 制御信号に応じて間欠的に送信信号を出力する間欠動作回路と、
送信データに応じて、前記間欠動作回路を、第1の送信信号を出力する送信状態と、前記第1の送信信号よりも低振幅または低周波数の第2の送信信号を出力するアイドリング状態とで切り換え制御する制御回路と、
を具備するパルス変調回路。 - 前記間欠動作回路は、発振器、逓倍器、増幅器のいずれか1つ以上を含む
請求項1に記載のパルス変調回路。 - 前記制御回路は、前記送信データが「1」の場合には前記間欠動作回路を送信状態に制御し、前記送信データが「0」の場合には前記間欠動作回路をアイドリング状態に制御すると共に、前記各アイドリング状態の期間が前記各送信状態の期間よりも短くなるように、前記間欠動作回路を制御する
請求項1に記載のパルス変調回路。 - 前記制御回路は、さらに、前記間欠動作回路を、前記送信状態と前記アイドリング状態との間で送信信号を出力しない停止状態に切り換え制御する
請求項1に記載のパルス変調回路。 - 前記制御回路は、前記間欠動作回路の寄生容量に応じて、前記アイドリング状態への切り換えタイミングを可変制御する
請求項1に記載のパルス変調回路。 - 前記制御回路は、前記間欠動作回路の寄生容量が大きいほど、前記アイドリング状態への切り換えタイミングを早くして、前記間欠動作回路のアイドリング状態期間を長くする
請求項5に記載のパルス変調回路。 - 前記制御回路は、前記間欠動作回路の寄生容量に応じて、前記アイドリング状態での前記第2の送信信号の振幅を可変制御する
請求項1に記載のパルス変調回路。 - 前記制御回路は、前記間欠動作回路の寄生容量が大きいほど、前記アイドリング状態での前記第2の送信信号の振幅を大きくする
請求項7に記載のパルス変調回路。 - 前記送信状態で出力された前記第1の送信信号を通過させる一方、前記アイドリング状態で出力された前記第2の送信信号を遮断する信号遮断手段を、さらに具備する
請求項1に記載のパルス変調回路。 - 前記信号遮断手段として逓倍器を用い、当該逓倍器の変換効率を制御することで、前記第1の送信信号を通過させると共に前記第2の送信信号を遮断する
請求項9に記載のパルス変調回路。 - 前記間欠動作回路によって形成された前記第1の送信信号の振幅または位相の少なくとも一方を、前記送信データに応じて変更する変調器、をさらに具備する
請求項1に記載のパルス変調回路。 - 前記制御回路は、直後の前記送信データが「1」になる場合にのみ、前記間欠動作回路をアイドリング状態に制御する
請求項3に記載のパルス変調回路。 - 第1のデータ信号列の既定配列部分を波形整形するための第2のデータ信号列を生成する付加信号生成部と、
前記第2のデータ信号列を用いて前記第1のデータ信号列を波形整形することで、オーバーシュート部を有する信号を生成する波形整形部と、
前記波形整形部によって波形整形された信号に基づいて回路容量を充電し、当該回路容量が所定値になったときに、送信信号を出力する間欠動作部と、
を具備するパルス変調回路。 - 前記間欠動作部は、発振器、逓倍器、増幅器のいずれか1つ以上を含む
請求項13に記載のパルス変調回路。 - 前記第1のデータ信号列がパルス信号の場合、前記既定配列は「0」の直後に「1」になるデータ信号列であり、
前記付加信号生成部は、前記第1のデータ信号列が「0」の直後に「1」になるタイミングで立ち上がるパルス信号を前記第2のデータ信号列として生成し、
前記波形整形部は、前記第2のデータ信号列に基づいて前記第1のデータ信号列が「0」の直後に「1」になる立ち上がり部分にリンギング信号を付加する
請求項13に記載のパルス変調回路。 - 前記波形整形部は、前記第1のデータ信号列に帯域制限を施す遮断周波数を、前記第2のデータ信号列に応じて可変する可変帯域制限部、を具備する
請求項15に記載のパルス変調回路。 - 前記付加信号生成部は、前記第2のデータ信号列に基づいて前記リンギング信号を生成し、
前記波形整形部は、前記第1のデータ信号列に前記リンギング信号を合成する
請求項15に記載のパルス変調回路。 - 前記リンギング信号は、前記間欠動作部の周波数と同一または略同一の周波数をもつ
請求項15に記載のパルス変調回路。 - 第1のデータ信号列の既定配列部分に波形整形するための第2のデータ信号列を生成するステップと、
前記第2のデータ信号列を用いて前記第1のデータ信号列を波形整形することで、オーバーシュート部を有する信号を生成するステップと、
波形整形された信号に基づいて回路容量を充電し、当該回路容量が所定値になったときに、送信信号を出力するステップと、
を含む、パルス変調方法。
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