JP2007043654A - 可変トランスコンダクタンス回路 - Google Patents
可変トランスコンダクタンス回路 Download PDFInfo
- Publication number
- JP2007043654A JP2007043654A JP2006110550A JP2006110550A JP2007043654A JP 2007043654 A JP2007043654 A JP 2007043654A JP 2006110550 A JP2006110550 A JP 2006110550A JP 2006110550 A JP2006110550 A JP 2006110550A JP 2007043654 A JP2007043654 A JP 2007043654A
- Authority
- JP
- Japan
- Prior art keywords
- current
- mos transistors
- circuit
- variable
- voltage
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Images
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03F—AMPLIFIERS
- H03F3/00—Amplifiers with only discharge tubes or only semiconductor devices as amplifying elements
- H03F3/45—Differential amplifiers
- H03F3/45071—Differential amplifiers with semiconductor devices only
- H03F3/45076—Differential amplifiers with semiconductor devices only characterised by the way of implementation of the active amplifying circuit in the differential amplifier
- H03F3/45179—Differential amplifiers with semiconductor devices only characterised by the way of implementation of the active amplifying circuit in the differential amplifier using MOSFET transistors as the active amplifying circuit
- H03F3/45197—Pl types
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03F—AMPLIFIERS
- H03F3/00—Amplifiers with only discharge tubes or only semiconductor devices as amplifying elements
- H03F3/45—Differential amplifiers
- H03F3/45071—Differential amplifiers with semiconductor devices only
- H03F3/45076—Differential amplifiers with semiconductor devices only characterised by the way of implementation of the active amplifying circuit in the differential amplifier
- H03F3/45179—Differential amplifiers with semiconductor devices only characterised by the way of implementation of the active amplifying circuit in the differential amplifier using MOSFET transistors as the active amplifying circuit
- H03F3/45197—Pl types
- H03F3/45201—Non-folded cascode stages
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03G—CONTROL OF AMPLIFICATION
- H03G1/00—Details of arrangements for controlling amplification
- H03G1/0005—Circuits characterised by the type of controlling devices operated by a controlling current or voltage signal
- H03G1/0017—Circuits characterised by the type of controlling devices operated by a controlling current or voltage signal the device being at least one of the amplifying solid state elements of the amplifier
- H03G1/0029—Circuits characterised by the type of controlling devices operated by a controlling current or voltage signal the device being at least one of the amplifying solid state elements of the amplifier using FETs
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03G—CONTROL OF AMPLIFICATION
- H03G7/00—Volume compression or expansion in amplifiers
- H03G7/001—Volume compression or expansion in amplifiers without controlling loop
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03F—AMPLIFIERS
- H03F2203/00—Indexing scheme relating to amplifiers with only discharge tubes or only semiconductor devices as amplifying elements covered by H03F3/00
- H03F2203/45—Indexing scheme relating to differential amplifiers
- H03F2203/45288—Differential amplifier with circuit arrangements to enhance the transconductance
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03F—AMPLIFIERS
- H03F2203/00—Indexing scheme relating to amplifiers with only discharge tubes or only semiconductor devices as amplifying elements covered by H03F3/00
- H03F2203/45—Indexing scheme relating to differential amplifiers
- H03F2203/45356—Indexing scheme relating to differential amplifiers the AAC comprising one or more op-amps, e.g. IC-blocks
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03F—AMPLIFIERS
- H03F2203/00—Indexing scheme relating to amplifiers with only discharge tubes or only semiconductor devices as amplifying elements covered by H03F3/00
- H03F2203/45—Indexing scheme relating to differential amplifiers
- H03F2203/45471—Indexing scheme relating to differential amplifiers the CSC comprising one or more extra current sources
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03F—AMPLIFIERS
- H03F2203/00—Indexing scheme relating to amplifiers with only discharge tubes or only semiconductor devices as amplifying elements covered by H03F3/00
- H03F2203/45—Indexing scheme relating to differential amplifiers
- H03F2203/45652—Indexing scheme relating to differential amplifiers the LC comprising one or more further dif amp stages, either identical to the dif amp or not, in cascade
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03F—AMPLIFIERS
- H03F2203/00—Indexing scheme relating to amplifiers with only discharge tubes or only semiconductor devices as amplifying elements covered by H03F3/00
- H03F2203/45—Indexing scheme relating to differential amplifiers
- H03F2203/45668—Indexing scheme relating to differential amplifiers the LC comprising a level shifter circuit, which does not comprise diodes
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Amplifiers (AREA)
- Control Of Amplification And Gain Control (AREA)
Abstract
【解決手段】入力電圧信号(Vi)に対して線形な電流信号を出力する電圧―電流変換回路と、前記電流信号を入力して平方根圧縮された電圧信号に変換する第1および第2のMOSトランジスタ(M1,M2)と、前記平方根圧縮された電圧信号を線形電流信号に変換する第3および第4のMOSトランジスタ(M3,M4)とを有する可変gm回路において、第1および第2のMOSトランジスタ(M1,M2)のバイアス電流(Ia)と第3および第4のMOSトランジスタ(M3,M4)のバイアス電流(Ib)をそれぞれ変化させてgmを制御することで、1つの回路で20倍程度の可変が3V程度の低電源電圧で実現でき、前述の課題が解決できる。
【選択図】図1
Description
β=電荷移動度×ゲート酸化膜容量/2、
k=(MOSトランジスタM60,M61のトランジスタサイズ)/(MOSトランジスタM58,M59のトランジスタサイズ)、
Vth=トランジスタの閾値電圧、
とする。
図1は第1の実施形態による可変トランスコンダクタンス回路である。線形電圧電流変換部は従来技術で記載したものであり、入力電圧信号ViはMOSトランジスタM5,M6のソース間抵抗Rで電流変換され、それぞれMOSトランジスタM1,M2のドレイン電流となる。このときMOSトランジスタM1,M2ゲート電圧差は数4のようになる。
図2は第2の実施形態による可変トランスコンダクタンス回路である。図1の可変トランスコンダクタンス回路では、MOSトランジスタM4,M3のゲート電圧は、それぞれ、MOSトランジスタM1とM7、MOSトランジスタM2とM8のゲート−ソース間電圧で自動的に決定されるため、MOSトランジスタM3,M4を飽和領域で動作させるためには自動的に出力ダイナミックレンジが決定され、設計自由度が制限される。これを解決するために図2では、MOSトランジスタM1のゲートとMOSトランジスタM4のゲートとの間およびMOSトランジスタM2のゲートとMOSトランジスタM3のゲートとの間のそれぞれをレベルシフト回路4を介して接続している。このレベルシフト回路4のDCレベルシフト量を適切に設定することで出力ダイナミックレンジの設計自由度を向上させている。レベルシフト回路4は入力インピーダンスが十分に高ければ図1のMOSトランジスタM5のドレインとMOSトランジスタM4のゲートとの間およびMOSトランジスタM6のドレインとMOSトランジスタM3のゲートとの間にそれぞれ挿入してもよい。
図1、図2の構成ではMOSトランジスタM1,M5,M7またはMOSトランジスタM2,M6,M8で負帰還ループを形成しており、そのユニティゲイン周波数f0とIaは数8の関係があり、gmに応じて回路の周波数特性が変化する。
図5は、図1〜図3に示した平方根展開部11の変形例である。図1〜図3の可変トランスコンダクタンス回路のgmは、数7に示すように、MOSトランジスタM1,M2とMOSトランジスタM3,M4のトランジスタサイズ比率k3に依存する。図5では、MOSトランジスタM3,M4の代わりに、複数のMOSトランジスタを並列接続して制御信号φ1〜φ3で切り替える。これによりk3を変化させることができるのでgmを可変できる。なお、図5では、MOSトランジスタM3,M4を並列接続のMOSトランジスタに置き換えているが、MOSトランジスタM1,M2を並列接続のMOSトランジスタに置き換えてもよい。
図6は、図1〜3に示した可変トランスコンダクタンス回路111にトランスコンダクタンス制御回路16を設けた例を示す。ここでは、まず、図6(b)に示すトランスコンダクタンス制御回路16に含まれる2乗回路20の動作を図7を参照しながら説明する。
図12は第5の実施形態による光ディスク装置を示している。この光ディスク装置は、スピンドルモータ101と、光ピックアップ102と、アドレス信号生成回路103と、アドレスデコーダ104と、サーボコントローラ105と、サーボエラー信号生成回路106と、データ信号生成回路107と、デコーダ108と、CPU109とを備えている。
2 可変電流源2
3 可変電流源3
4 レベルシフト回路
5 電源電圧
6 電圧信号入力端子
7 電流信号出力端子
8 平方根圧縮信号出力
9 バイアス電流源
10 平方根圧縮部
11 平方根展開部
16 トランスコンダクタンス制御回路
20 2乗回路
100 光ディスクメディア
102 光ピックアップ
103 アドレス信号生成回路
104 アドレスデコーダー
105 サーボコントローラ
106 サーボエラー信号生成回路
107 データ信号生成回路
108 デコーダ
109 CPU
110 レーザパワー制御回路
111 本発明の可変トランスコンダクタンス回路
Claims (9)
- 入力電圧信号(Vi)に対して線形な電流信号を出力する電圧―電流変換回路と、
前記電流信号を入力して平方根圧縮された電圧信号に変換する第1および第2のMOSトランジスタ(M1,M2)と、
前記平方根圧縮された電圧信号を線形電流信号に変換する第3および第4のMOSトランジスタ(M3,M4)とを備え、
前記第1および第2のMOSトランジスタ(M1,M2)のバイアス電流(Ia)と前記第3および第4のMOSトランジスタ(M3,M4)のバイアス電流(Ib)をそれぞれ変化させてトランスコンダクタンスを制御する、
ことを特徴とする可変トランスコンダクタンス回路。 - 請求項1において、
前記電圧−電流変換回路は、
前記入力電圧信号(Vi)が入力される2つのオペアンプと、
前記2つのオペアンプの出力間に挿入された抵抗(R)とを含み、
前記2つのオペアンプの出力段の各々は第1の電流源(1)または第2の電流源(2)でバイアスされるソースフォロワであり、前記ソースフォロワのドレインから電流信号を取り出すものであり、
前記第1および第2のMOSトランジスタ(M1,M2)のゲートは所定のバイアス電圧により接地され、ソースには前記電圧−電流変換回路からの出力電流信号がそれぞれ入力され、
前記第3および第4のMOSトランジスタ(M3,M4)のソースは共通接続されており、この共通接続されたソースには第3の電流源(3)が接続され、前記第3のMOSトランジスタ(M3)のゲートは第1および第2のMOSトランジスタ(M1,M2)の一方のソースに接続され、前記第4のMOSトランジスタ(M4)のゲートは前記第1および第2のMOSトランジスタ(M1,M2)の他方のソースに接続され、
前記可変トランスコンダクタンス回路は、
前記第3および第4のMOSトランジスタ(M3,M4)のドレインを電流出力とし、
前記第1および第2の電流源(1,2)の電流(Ia)と前記第3の電流源(3)の電流(Ib)とをそれぞれ変化させてトランスコンダクタンスを制御する、
ことを特徴とする可変トランスコンダクタンス回路。 - 請求項1において、
前記電圧−電流変換回路は、
前記入力電圧信号(Vi)が入力される入力差動対を構成する第5および第6のMOSトランジスタ(M5,M6)と、
前記第5および第6のMOSトランジスタ(M5,M6)のソース間に挿入された抵抗(R)とを含み、
前記第5および第6のMOSトランジスタ(M5,M6)の各々は、ドレインに接続された第1の電流源(1)または第2の電流源(2)でバイアスされ、
前記第5のMOSトランジスタ(M5)のソースには前記第1および第2のMOSトランジスタ(M1,M2)の一方のドレインが接続され、前記第6のMOSトランジスタ(M6)のソースには前記第1および第2のMOSトランジスタ(M1,M2)の他方のドレインが接続され、
前記第1および第2のMOSトランジスタ(M1,M2)の各々は、ドレインに接続された前記第5のMOSトランジスタ(M5)または第6のMOSトランジスタ(M6)のドレイン電圧によりゲート電圧が駆動され、
前記第3および第4のMOSトランジスタ(M3,M4)のソースは共通接続されており、この共通接続されたソースには第3の電流源(3)が接続され、前記第3のMOSトランジスタ(M3)のゲート電圧は前記第5および第6のMOSトランジスタ(M5,M6)の一方のドレイン電圧により駆動され、前記第4のMOSトランジスタ(M4)のゲート電圧は前記第5および第6のMOSトランジスタ(M5,M6)の他方のドレイン電圧により駆動され、
前記可変トランスコンダクタンス回路は、
前記第3および第4のMOSトランジスタ(M3,M4)のドレインを電流出力とし、
前記第1および第2の電流源(1,2)の電流(Ia)と前記第3の電流源(3)の電流(Ib)とをそれぞれ変化させてトランスコンダクタンスを制御する、
ことを特徴とする可変トランスコンダクタンス回路。 - 請求項1〜3のいずれか1つにおいて、
前記第1および第2のMOSトランジスタ(M1,M2)、または、前記第3および第4のMOSトランジスタ(M3,M4)を、並列接続された複数のMOSトランジスタで構成し、切り替えることでトランスコンダクタンスを制御する、
ことを特徴とする可変トランスコンダクタンス回路。 - 請求項1において、
前記バイアス電流(Ia,Ib)を生成するトランスコンダクタンス制御回路をさらに備え、
前記トランスコンダクタンス制御回路は、
ゲートとドレインを接続し縦続接続した第7および第8のMOSトランジスタ(M101,M102)と、ゲートを前記第8のMOSトランジスタ(M102)のゲートに接続した第9のMOSトランジスタ(M103)と、ゲートを第9のMOSトランジスタ(M103)のソースに接続した第10のMOSトランジスタ(M104)で構成されるトランスリニアループ回路において、前記第9のMOSトランジスタ(M103)と前記第10のMOSトランジスタ(M104)それぞれに流れる電流を数倍して前記第7および第8のMOSトランジスタ(M101,M102)に供給する手段を備え、前記第8のMOSトランジスタ(M102)のドレインを電流入力とし、前記第9および第10のMOSトランジスタ(M103,M104)のいずれか一方を第4の電流源(13)と接続し、他方に流れる電流をカレントミラー出力する2乗回路(20)を含み、
前記カレントミラー出力が前記バイアス電流(IaまたはIb)となる、
ことを特徴とする可変トランスコンダクタンス回路。 - 請求項5において、
前記供給手段は、
前記第9および第10のMOSトランジスタ(M103,M104)に流れる電流を数倍して前記第7および第8のMOSトランジスタ(M101,M102)に供給するカレントミラーを含む、
ことを特徴とする可変トランスコンダクタンス回路。 - 請求項5において、
前記カレントミラー出力のミラー比が可変である、
ことを特徴とする可変トランスコンダクタンス回路。 - 請求項5において、
前記第4の電流源(13)の電流値が可変である、
ことを特徴とする可変トランスコンダクタンス回路。 - 請求項1〜8のいずれか1つに記載の可変トランスコンダクタンス回路と容量素子で形成されるフィルタ、または、請求項1〜8のいずれか1つに記載の可変トランスコンダクタンス回路と抵抗素子とで形成される可変ゲインアンプを信号処理経路に設けた、
ことを特徴とする光ディスク装置。
Priority Applications (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2006110550A JP4217247B2 (ja) | 2005-07-07 | 2006-04-13 | 可変トランスコンダクタンス回路 |
US11/481,861 US7486139B2 (en) | 2005-07-07 | 2006-07-07 | Variable transconductance circuit |
US12/195,059 US7911274B2 (en) | 2005-07-07 | 2008-08-20 | Variable transconductance circuit |
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2005198623 | 2005-07-07 | ||
JP2006110550A JP4217247B2 (ja) | 2005-07-07 | 2006-04-13 | 可変トランスコンダクタンス回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2007043654A true JP2007043654A (ja) | 2007-02-15 |
JP4217247B2 JP4217247B2 (ja) | 2009-01-28 |
Family
ID=37678506
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2006110550A Expired - Fee Related JP4217247B2 (ja) | 2005-07-07 | 2006-04-13 | 可変トランスコンダクタンス回路 |
Country Status (2)
Country | Link |
---|---|
US (2) | US7486139B2 (ja) |
JP (1) | JP4217247B2 (ja) |
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2008270891A (ja) * | 2007-04-16 | 2008-11-06 | Nec Electronics Corp | 可変利得回路 |
JP2008283555A (ja) * | 2007-05-11 | 2008-11-20 | Matsushita Electric Ind Co Ltd | 可変トランスコンダクタ、可変ゲインアンプ、及びフィルタ回路 |
US7705678B2 (en) | 2008-05-30 | 2010-04-27 | Fujitsu Limited | Amplifier using impedance circuit for canceling cutoff |
US7982506B2 (en) | 2007-06-05 | 2011-07-19 | Nec Corporation | Voltage-current converter and filter circuit using same |
WO2015145919A1 (ja) * | 2014-03-28 | 2015-10-01 | 株式会社ソシオネクスト | 低雑音増幅器 |
Families Citing this family (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2011048796A1 (ja) * | 2009-10-19 | 2011-04-28 | パナソニック株式会社 | Dc-dcコンバータ |
CN102843101B (zh) * | 2011-06-20 | 2015-06-10 | 苏州科山微电子科技有限公司 | 可变增益低噪声放大器 |
US9236840B1 (en) * | 2014-09-04 | 2016-01-12 | Linear Technology Corporation | Linear broadband PNP amplifier |
JP6467924B2 (ja) * | 2015-01-06 | 2019-02-13 | 富士通株式会社 | 増幅回路 |
US10734958B2 (en) * | 2016-08-09 | 2020-08-04 | Mediatek Inc. | Low-voltage high-speed receiver |
US10523165B2 (en) * | 2017-01-26 | 2019-12-31 | Analog Devices, Inc. | Common mode feedback circuit with backgate control |
US10345353B2 (en) | 2017-11-13 | 2019-07-09 | Texas Instruments Incorporated | Fully differential current sensing |
US11114986B2 (en) * | 2019-08-12 | 2021-09-07 | Omni Design Technologies Inc. | Constant level-shift buffer amplifier circuits |
Family Cites Families (16)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS6274168A (ja) | 1985-09-27 | 1987-04-04 | Toshiba Corp | 二乗演算回路 |
JPH01317009A (ja) | 1988-06-17 | 1989-12-21 | Toshiba Corp | 可変利得制御回路 |
JPH0666597B2 (ja) | 1989-08-30 | 1994-08-24 | 東光株式会社 | 可変トランスコンダクタンス増幅回路 |
JP3333239B2 (ja) * | 1991-12-05 | 2002-10-15 | 株式会社東芝 | 可変利得回路 |
US5451901A (en) * | 1994-07-01 | 1995-09-19 | Cirrus Logic Inc. | Transconductance amplifiers and exponential variable gain amplifiers using the same |
US5672961A (en) * | 1995-12-29 | 1997-09-30 | Maxim Integrated Products, Inc. | Temperature stabilized constant fraction voltage controlled current source |
KR100246757B1 (ko) | 1997-05-09 | 2000-03-15 | 윤종용 | 트랜스컨덕턴스 가변방법 및 회로와 그를 이용한 가변 대역 필터 및 가변 이득 증폭기 |
JPH1168477A (ja) | 1997-08-12 | 1999-03-09 | Nec Corp | チューナブルcmos演算トランスコンダクタンス増幅器 |
JP3535357B2 (ja) | 1997-10-09 | 2004-06-07 | 株式会社東芝 | 低電圧トランスリニア回路 |
US6118340A (en) * | 1999-07-26 | 2000-09-12 | Burr-Brown Corporation | Low noise differential input, differential output amplifier and method |
JP3425426B2 (ja) | 2000-01-31 | 2003-07-14 | 松下電器産業株式会社 | トランスコンダクタおよびフィルタ回路 |
JP3841652B2 (ja) * | 2001-03-14 | 2006-11-01 | 富士通株式会社 | 増幅回路 |
JP2003179447A (ja) | 2001-12-10 | 2003-06-27 | Nec Electronics Corp | 可変利得回路 |
DE10164382C1 (de) | 2001-12-28 | 2003-08-21 | Xignal Technologies Ag | Integrierte Schaltungsanordnung mit einem Transkonduktanzverstärker |
JP3953009B2 (ja) | 2003-09-12 | 2007-08-01 | ソニー株式会社 | トランスコンダクタンス調整回路 |
KR100664305B1 (ko) * | 2005-02-04 | 2007-01-04 | 삼성전자주식회사 | 전류모드 트랜스컨덕터 튜닝 장치 |
-
2006
- 2006-04-13 JP JP2006110550A patent/JP4217247B2/ja not_active Expired - Fee Related
- 2006-07-07 US US11/481,861 patent/US7486139B2/en active Active
-
2008
- 2008-08-20 US US12/195,059 patent/US7911274B2/en active Active
Cited By (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2008270891A (ja) * | 2007-04-16 | 2008-11-06 | Nec Electronics Corp | 可変利得回路 |
JP2008283555A (ja) * | 2007-05-11 | 2008-11-20 | Matsushita Electric Ind Co Ltd | 可変トランスコンダクタ、可変ゲインアンプ、及びフィルタ回路 |
US7982506B2 (en) | 2007-06-05 | 2011-07-19 | Nec Corporation | Voltage-current converter and filter circuit using same |
US7705678B2 (en) | 2008-05-30 | 2010-04-27 | Fujitsu Limited | Amplifier using impedance circuit for canceling cutoff |
WO2015145919A1 (ja) * | 2014-03-28 | 2015-10-01 | 株式会社ソシオネクスト | 低雑音増幅器 |
CN106134074A (zh) * | 2014-03-28 | 2016-11-16 | 株式会社索思未来 | 低噪声放大器 |
JPWO2015145919A1 (ja) * | 2014-03-28 | 2017-04-13 | 株式会社ソシオネクスト | 低雑音増幅器 |
US9847758B2 (en) | 2014-03-28 | 2017-12-19 | Socionext Inc. | Low noise amplifier |
CN106134074B (zh) * | 2014-03-28 | 2019-03-22 | 株式会社索思未来 | 低噪声放大器 |
Also Published As
Publication number | Publication date |
---|---|
US20070018725A1 (en) | 2007-01-25 |
US7911274B2 (en) | 2011-03-22 |
JP4217247B2 (ja) | 2009-01-28 |
US7486139B2 (en) | 2009-02-03 |
US20090015330A1 (en) | 2009-01-15 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP4217247B2 (ja) | 可変トランスコンダクタンス回路 | |
CN100574094C (zh) | 可变跨导电路 | |
JP5635506B2 (ja) | フィルタ回路及びこれを備えた光ディスク装置 | |
EP1417752A2 (en) | High-bandwidth low-voltage gain cell and voltage follower having an enhanced transconductance | |
US20130099825A1 (en) | Voltage comparator | |
US6472932B2 (en) | Transconductor and filter circuit | |
Sharma et al. | Design and simulation of pseudo-resistor with extremely high linearity for an improved neural signal recording | |
JP3953009B2 (ja) | トランスコンダクタンス調整回路 | |
JPH10303664A (ja) | 可変利得増幅器 | |
JP2004062424A (ja) | 半導体集積回路装置 | |
US7068090B2 (en) | Amplifier circuit | |
JP5543059B2 (ja) | 差動増幅回路 | |
US7768349B2 (en) | Transconductance amplifier | |
CN115459727A (zh) | 伪电阻电路、rc滤波电路、电流镜电路及芯片 | |
JP4721928B2 (ja) | 可変トランスコンダクタ | |
JP2000252768A (ja) | 演算増幅器 | |
JP6964880B2 (ja) | コンダクタンスアンプ | |
JPH11317019A (ja) | Rf信号用ゲイン調整回路 | |
JP4695621B2 (ja) | 半導体回路 | |
JP2005354172A (ja) | コモンモードフィードバック回路、相互コンダクタンス増幅器及びgmCフィルタ | |
Singh et al. | Design and Analysis of DTMOS based Operational Transconductance Amplifier | |
JP4030277B2 (ja) | 増幅回路 | |
JP6000884B2 (ja) | 演算増幅回路 | |
JP2003249827A (ja) | 演算増幅器 | |
JP2006079471A (ja) | 電流制御回路,半導体装置及び撮像装置 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20080728 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20080805 |
|
A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20080918 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20081014 |
|
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20081107 |
|
R150 | Certificate of patent or registration of utility model |
Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20111114 Year of fee payment: 3 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20111114 Year of fee payment: 3 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20121114 Year of fee payment: 4 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20121114 Year of fee payment: 4 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20131114 Year of fee payment: 5 |
|
LAPS | Cancellation because of no payment of annual fees |