JP2004004492A - 配線基板の接続構造、および表示装置 - Google Patents
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Abstract
【解決手段】TFT基板11およびソースGS基板5が、それぞれの基板に形成されたソースバスライン16およびソース出力配線57に対して、絶縁膜を介して該ソースバスライン16およびソース出力配線57と交差するように設けられたパネル側予備配線17およびドライバ側予備配線58を有しており、基板接続部では、上記ソースバスライン16およびソース出力配線57の接続と共に、パネル側予備配線17およびドライバ側予備配線58の接続もとられる。
【選択図】 図1
Description
【発明の属する技術分野】
本発明は、液晶表示装置、有機EL表示装置および無機EL表示装置等のアクティブマトリクス型表示装置において、表示パネルに駆動回路基板を実装する際に用いられる配線基板の接続構造に関するものである。
【0002】
【従来の技術】
現在、液晶表示装置等のアクティブマトリクス型表示装置における表示パネルとこれを駆動する駆動回路との接続は、TCP(Tape Carrier Package)方式、COG(Chip on Glass)方式、低温多結晶シリコン技術を使用したモノリシック方式等が用いられている。
【0003】
TCP方式は、図11に示すように、表示パネル101に対して、ゲート信号線駆動回路となるゲートIC(Integrated Circuit)102を搭載したゲートTCP103およびソース信号線駆動回路となるソースIC104を搭載したソースTCP105が複数接続されている。さらに、上記ゲートTCP103およびソースTCP105は、これらのTCPに信号を入力するためのゲートPWB(Printed Wire Bonding)106およびソースPWB107と接続されている。これらのPWBは、FPC(Flexible Printed Circuit)108によって外部回路基板と接続されている。
【0004】
COG方式は、図12に示すように、表示パネル111にゲート信号線駆動回路となる複数のゲートIC112およびソース信号線駆動回路となる複数のソースIC113が搭載されており、これらのゲートIC112およびソースIC113は、信号を入力するためのゲートFPC114およびソースFPC115と接続され、該ゲートFPC114およびソースFPC115によって外部回路基板と接続される。
【0005】
TCP方式、COG方式は、量産化の実績が長く、製品の品質、信頼性面で有利であるが、部品点数が多く、材料費と実装加工費が高くつくといった問題もある。
【0006】
また、モノリシック方式は、上記COG方式におけるゲートICおよびソースICを低温多結晶技術を応用して表示パネルに作りこんでしまう方式である。この方式は、TCP方式やCOG方式に比べて部品点数を少なくすることができるため、材料費、実装加工費を低減することができる。しかしながら、表示パネル側の設計が複雑になり、このためのコストがアップする。また、表示パネルの大型化には不利であり、使用範囲が限定される。
【0007】
以上の3方式に対して、材料コスト面でモノリシック方式と同等以下で、且つ、表示パネルにTCP方式やCOG方式と同じアモルファスシリコンを使用したGOG(Glass on Glass)方式が、例えば特開平04−283727号公報において考案されている。上記GOG方式では、図13に示すように、FPC124から入力された信号が、表示パネル121上の配線を経由して、駆動回路となるICを搭載したゲートGS(Glass Stick)122およびソースGS123に入力され、表示パネル121を駆動する。
【0008】
上記GOG方式は、モノリシック方式における良品率低下の原因となる駆動回路部分をゲートGS122およびソースGS123として別工程で作成することができるため、歩留まりの低下による表示パネル121のコストアップが低減され、かつTCP方式やCOG方式に比べて部品点数が削減されている。
【0009】
【発明が解決しようとする課題】
ところが、上記従来の構成では、特にTCP方式およびGOG方式において、表示パネルの形成されている基板(以下、表示パネル側基板と称する)と駆動回路となるICの形成されている基板(以下、駆動回路側基板と称する)との接続部に異物かみ込み等の接続異常によるオープン症状やリーク症状が発生する場合がある。そして、このような場合の修正方法においては、以下に示すような問題が生じる。
【0010】
TCP方式における上記接続異常箇所の修正方法では、表示パネル側基板と駆動回路側基板との接続不具合が生じた箇所のTCPを一旦剥離し、パネル表面に残った接続用樹脂の残渣を清掃し、再度、新たなTCPあるいはICを接続する、といった作業が行われる。しかしながら、このような修正方法は、修正作業にかかる工程が多く存在し、作業効率が悪いといった問題がある。
【0011】
また、GOG方式における異物かみ込み等の基板間の接続異常によるオープン症状やリーク症状に対しては、TCP方式と同様の修正方法を適用した場合、作業効率の問題以外に以下のような問題も生じる。すなわち、GOG方式はコスト面で他の方式に比べて有利であるが、GOG接続の異物かみ込みによる不良発生率の増加、および、接続不良が発生した場合のGS交換の難しさが、大きな問題となる。
【0012】
まず、GOG方式における基板接続箇所の異物かみ込みによる不良発生率の増加であるが、図14(a),(b)および図15(a),(b)に基いてこれを説明する。図14(a)は図11のA−A’断面図であり、接続される基板間に異物がかみ込んだ場合を示す。図15(a)は図13のB−B’断面図であり、接続される基板間に異物がかみ込んだ場合を示す。
【0013】
TCP方式の場合は、図14(a)に示すように、異物131がかみ込んだ場所の表示パネル側基板の端子109と駆動回路側基板の端子110は離れてしまっているが、TCP側基板にフレキシブル性があるため、異物131をかみ込んだ端子に隣接した端子では端子同士の接続が確保されている。また、図14(b)に示すように、接続される端子が比較的長い接続領域を有する場合には、異物131をかみ込んだ端子であっても、該異物131から離れた領域では端子間の接続が得られる。
【0014】
これに対し、GOG方式の場合では、図15(a)に示すように、駆動回路側基板にフレキシブル性が無いため、異物131をかみ込んだ箇所で表示パネル側基板の端子125と駆動回路側基板の端子126とがオープン状態となるばかりでなく、隣接した端子もオープン状態となりやすい。また、図15(b)に示すように、接続される端子が比較的長い接続領域を有する場合であっても、異物131から離れた領域でも端子間の接続が得られない。
【0015】
また、GOG方式の場合は、駆動回路側基板の基材となるGSガラス上の配線は薄膜で形成されており、その厚みは1μm以下となる。このため、両基板の接続材料となる異方性導電膜(ACF)中の導電粒子(φ5〜10μm)は、端子部のみでなく端子間スペースにも凝集し、導電粒子の連結によるリーク症状が発生しやすい。これに対し、TCP方式では、TCP上の配線の厚みは10〜30μm程度と、GSガラス上の薄膜で形成された配線厚みに対して十分に大きく、端子間に粒子の凝集は発生しにくい。
【0016】
次に、基板同士の接続部で配線の接続不良が発生した場合の駆動回路交換の難しさであるが、GOG方式を大型機種に適用した場合、駆動回路側基板のサイズが大きくなるため(15”クラスのモジュールに適用した場合、基板の長辺の長さは300mm程度となる)、駆動回路側基板の剥離中に駆動回路側基板あるいは表示パネル側基板が割れるなどの不具合が生じやすい。
【0017】
また、接続不良個所が1箇所であっても、駆動回路側基板全体を交換する必要があり、TCP方式のように、個別のTCPを交換するという作業にはならない。
【0018】
尚、異物かみ込みによる接続不良の修正方法として、異物に対するレーザー照射による分断という方法も考えられるが、導電性の異物には通常数十μmの厚みがあり、電極端子を傷つけずにガラス基板を通して異物のみ分断することは技術的に困難である。
【0019】
以上のように、特にGOG方式においては、接続不良発生率の増加、修正作業の難しさにより、修正ミスによる表示パネルの破壊、作業工数の増加、修理部材費の増加、修正時の2次不良の発生、品質の低下等が問題となる。
【0020】
本発明は、上記の問題点を解決するためになされたもので、その目的は、アクティブマトリクス型の表示装置における表示パネル側基板と駆動回路側基板との接続部等において、接続される配線基板間の配線の接続不良を、容易に、かつ2次不良の発生を抑制して修正可能とする配線基板の接続構造を提供することにある。
【0021】
【課題を解決するための手段】
本発明の配線基板の接続構造は、上記の課題を解決するために、基板接続部にて接続される各基板に設けられた複数の接続配線同士が電気的に接続されるように、2枚の配線基板同士を接続する際の配線基板の接続構造において、上記各配線基板は、それぞれの配線基板に形成された接続配線に対して絶縁膜を介して該接続配線と交差するように設けられた少なくとも1本の予備配線を有しており、上記基板接続部では、上記接続配線と共に、各配線基板に形成された予備配線同士も接続されていることを特徴としている。
【0022】
あるいは、本発明の配線基板の接続構造は、上記の課題を解決するために、一対の配線基板の一方に設けられた複数の接続配線と他方に設けられた複数の接続配線とが基板接続部で電気的に接続される配線基板の接続構造において、上記各配線基板は、絶縁膜を介して上記接続配線と交差するように設けられた少なくとも1本の予備配線をそれぞれに有しており、上記基板接続部では、上記一方の配線基板の予備配線と上記他方の配線基板の予備配線とが電気的に接続されていることを特徴としている。
【0023】
上記の構成によれば、上記配線基板の接続部において異物のかみ込みなどによる接続配線間の接続不良が発生した場合、接続不良の発生した接続配線と予備配線とを短絡させることにより修正が可能となる。例えば、基板接続部において接続配線のオープン症状が発生した場合、該オープン症状が発生した接続配線と予備配線との交差部にレーザー照射することによって該接続配線と予備配線とを短絡し、予備配線を通して接続配線に信号または電圧を供給することができる。また、接続不良がリーク症状の場合には、リーク箇所付近の接続配線をレーザー照射によって切断し、接続配線からリーク箇所を分断した後、該接続配線と予備配線とを短絡して、予備配線を通して接続配線に信号または電圧を供給することができる。
【0024】
これにより、接続不良の発生した基板の接続において、基板の剥離、清掃、再接続といった、従来の修正方法における煩雑な工程が必要なく、レーザー照射のみによる容易な修正が可能となる。また、基板の剥離時における基板割れといった2次不良も抑制できる。
【0025】
本発明の表示装置は、上記の課題を解決するために、表示パネル側基板と駆動回路側基板との基板接続部にて接続される各基板に設けられた複数の接続配線同士が電気的に接続されるように、表示パネル側基板と駆動回路側基板とが接続される表示装置において、上記表示パネル側基板および駆動回路側基板は、それぞれの基板に形成された接続配線に対して絶縁膜を介して該接続配線と交差するように設けられた少なくとも1本の予備配線を有しており、上記基板接続部では、上記接続配線と共に、上記表示パネル側基板および駆動回路側基板のそれぞれに形成された予備配線同士が接続されて、基板接続部修正用予備配線を構成していることを特徴としている。
【0026】
あるいは、本発明の表示装置は、上記の課題を解決するために、表示領域を備えた表示パネル側基板と駆動回路を備えた駆動回路側基板とを有し、該表示パネル側基板に設けられた複数の接続配線と該駆動回路側基板に設けられた複数の接続配線とが該表示領域外の基板接続部で電気的に接続される表示装置において、上記表示パネル側基板および駆動回路側基板は、絶縁膜を介して上記接続配線と交差するように設けられた少なくとも1本の予備配線をそれぞれに有しており、上記基板接続部では、上記表示パネル側基板の予備配線と上記駆動回路側基板の予備配線とが電気的に接続されて、基板接続部修正用予備配線を構成していることを特徴としている。
【0027】
上記の構成によれば、例えば液晶表示装置等のアクティブマトリクス型の表示装置において、表示パネルと駆動回路(ゲートドライバやソースドライバ等)を異なる基板上に作成し、これらの基板を接続して表示装置を構成する場合に、表示パネル側基板と駆動回路側基板との接続に上述の配線基板の接続構造を使用できる。
【0028】
これにより、接続不良の発生した基板の接続において、基板の剥離、清掃、再接続といった、従来の修正方法における煩雑な工程が必要なく、レーザー照射のみによる容易な修正が可能となる。また、基板の剥離時における基板割れといった2次不良も抑制できる。
【0029】
また、上記表示装置は、上記駆動回路側基板は並列して設けられた複数の駆動回路を備え、上記複数の接続配線は互いに隣接する複数本ずつのグループに区分けされており、上記駆動回路の各々は上記グループの各々に属する接続配線および予備配線と電気的に接続されている構成とすることができる。
【0030】
また、上記表示装置は、さらに、上記表示パネル側基板における接続配線の断線を修正するための接続配線修正用予備配線を有し、上記接続配線修正用予備配線が上記基板接続部修正用予備配線に接続されている構成、あるいは、さらに接続配線修正用予備配線を有しており、上記表示パネル側基板の接続配線は、表示領域外に設けられた接続配線延在部まで延在されており、上記接続配線修正用予備配線は、上記接続配線延在部で表示パネル側基板の接続配線と電気的に接続されているとともに、上記基板接続部修正用予備配線と電気的に接続されている構成とすることができる。
【0031】
上記の構成によれば、上記接続配線修正用予備配線を設けることによって、基板接続部における接続不良の修正に加えて、表示パネル側基板における接続配線の断線(ゲートバスラインやソースバスラインの断線)をも修正できる。
【0032】
また、上記表示装置では、上記接続配線修正用予備配線は、上記基板接続部修正用予備配線を形成する駆動回路側基板の予備配線から少なくとも1つの駆動回路側基板を介して接続されている構成、あるいは、上記接続配線修正用予備配線は、駆動回路側基板の予備配線から少なくとも1つの駆動回路側基板の接続配線と交差しない領域を経由して設けられている構成とすることが好ましい。
【0033】
上記接続配線修正用予備配線と基板接続部修正用予備配線との接続は、上述のように駆動回路側基板を介して接続される以外に、表示パネル側基板内の配線のみによって接続される構成とすることも考えられる。しかしながら、この場合には、上記接続配線修正用予備配線を介して接続配線に信号を供給する際に、該接続配線修正用予備配線と接続配線との交差箇所が多くなり、接続配線修正用予備配線に発生する寄生容量が増大する。
【0034】
これに対し、上記の構成によれば、上記接続配線修正用予備配線は、上記基板接続部修正用予備配線を形成する駆動回路側基板の予備配線から少なくとも1つの駆動回路側基板の接続配線と交差しない領域を経由して設けられているため、接続配線修正用予備配線と接続配線との交差箇所を減らすことができ、接続配線修正用予備配線に発生する寄生容量を低減することができる。
【0035】
また、上記表示装置では、上記基板接続部修正用予備配線は、上記表示パネル側基板および駆動回路側基板のそれぞれに形成された予備配線同士が、これらの予備配線と交差する接続配線の配置方向の両側を経由して、表示パネル側基板および駆動回路側基板の間で接続される構成とすることができる。
【0036】
上記の構成によれば、上記基板接続部修正用予備配線が、接続配線の配置方向の両側を経由しているため、接続配線との交差箇所の間で該基板接続部修正用予備配線を分断することによって、1本の基板接続部修正用予備配線によって、2本の接続配線に対して冗長配線を与えることができる。すなわち、n本の基板接続部修正用予備配線が設けられている場合、2n箇所のオープン症状、もしくは2n+1箇所のリーク症状を修正できる。
【0037】
これにより、基板接続部修正用予備配線の配置領域の増大を最小限として、修正不良可能数を増やすことができる。
【0038】
また、上記表示装置では、上記基板接続部修正用予備配線は、上記表示パネル側基板および駆動回路側基板のそれぞれに形成された予備配線の配線幅が、これらの予備配線と交差する接続配線の線幅よりも太くなるように設定されている構成とすることが好ましい。
【0039】
上記基板接続部修正用予備配線による接続不良の修正時、該基板接続部修正用予備配線を伝搬する信号は、該基板接続部修正用予備配線によって迂回した経路を取るため、修正の加えられない接続配線を伝播する信号に比べてその伝播経路が長くなる。
【0040】
上記の構成によれば、上記基板接続部修正用予備配線の線幅を太くすることで、基板接続部修正用予備配線を伝搬する信号電圧に対する抵抗を、接続配線の抵抗と同程度に抑制することができる。これにより、接続配線間の配線抵抗のばらつきにより発生する表示ムラを抑制することができ、表示品位の向上を図ることができる。
【0041】
【発明の実施の形態】
本発明の実施の一形態について図1ないし図10に基づいて説明すれば、以下の通りである。尚、本実施の形態では、本発明を液晶表示装置に適用した場合に基づいて説明する。また、上記液晶表示装置では、表示パネル側基板と駆動回路側基板とをGOG方式によって接続した場合を例示する。
【0042】
上記液晶表示装置は、図1に示すように、表示パネル1と駆動回路側基板であるゲートGS基板3およびソースGS基板5とによって液晶パネルが形成されている。また、上記液晶パネルはFPC7によって外部回路基板と接続されており、該液晶パネルへの駆動信号は該FPC7を介して外部回路より与えられる。
【0043】
上記表示パネル1は、図2に示すように、ガラス基板11a上に各種配線および画素等からなる配線層11bの形成された表示パネル側基板であるTFT基板11と、ガラス基板上に顔料分散型のアクリル系樹脂からなるカラーフィルタおよびITO(Indium Tin Oxide)のような透明導電膜からなる対向電極を形成したカラーフィルタ基板12とをシール剤13によって貼り合わせた後、両ガラス基板間に、表示に拘わる状態が電圧に応じて変化する表示媒体層としての液晶14を注入することによって形成される。
【0044】
また、上記表示パネル1におけるTFT基板11では、例えば、横300mm×縦222mmのサイズで、0.7mm厚のアルミノホウケイ酸ガラス基板が用いられる。そして、上記ガラス基板上に、Al(アルミ)薄膜からなる各種配線、画素電極、およびスイッチング素子となるTFT(Thin Film Transistor)が形成される。
【0045】
上記表示パネル1に形成される配線としては、複数のソースバスライン(ソース配線)、複数のゲートバスライン(ゲート配線)、さらに、画素電極の形成領域の周縁部に、ゲートバスラインと同層かつ同一の工程で形成されるパネル予備配線、端子部側の予備配線、非端子部側の予備配線、パネル内配線が形成される。但し、これらの予備配線は必ずしもゲートバスラインと同層に形成されるとは限らず、別層に形成されるものであってもよい。これらの配線構造については後述する。
【0046】
また、TFTは、ソースバスラインとゲートバスラインとの交差部の近傍に設けられ、例えばアモルファスシリコンを半導体層に用いて形成される。画素電極は、ITOのような透明導電膜から形成され、上記TFTを介してソースバスラインおよびゲートバスラインと接続される。
【0047】
次に、上記液晶表示装置に用いられるゲートGS基板3およびソースGS基板5について、ソースGS基板5を例にとって説明する。
【0048】
ソースGS基板5は、図2に示すように、例えば、ガラス基板51として縦4.5mm×横260mmのサイズの0.5mm厚のアルミノホウケイ酸ガラスを用い、該ガラス基板51上に、表示パネルのソースバスラインを駆動するための駆動回路52、駆動回路に接続されるソース出力配線、引き回し配線、予備配線等の各種配線からなる配線層53が形成されている。配線材料としては、例えばアルミが用いられが、上記各種配線の構成については後述する。上記駆動回路は、例えば、多結晶シリコンを半導体層として用いたTFTによって構成できる。また、ゲートGS基板3についても、ソースGS基板5とほぼ同様の構成である。
【0049】
以上の構造のソースGS基板5およびゲートGS基板3を、表示パネル1におけるTFT基板11のソース端子部領域およびゲート端子部領域において、ACF(Anisotropic Conductive Film)4を介して電気的に接続する。ここで、上記接続はACP(Anisotropic Conductive Paste)等を使用してもよく、接続される配線(または端子)同士の直接の接触が得られるのであれば、NCP(Non Conductive Resin Paste)を使用してもよい。
【0050】
次に、上記TFT基板11およびソースGS基板5における配線構造と、その接続関係とについて図3に基づいて説明する。尚、ゲートGS基板3における配線構造と、TFT基板11およびゲートGS基板3における配線の接続関係とについては、ソースGS基板5とほぼ同様であるため詳細な説明については省略する。
【0051】
上記TFT基板11において形成される各種配線としては、ゲートバスライン15、ソースバスライン16、パネル側予備配線17、非端子側予備配線18、端子側予備配線19、パネル内配線20がある。ゲートバスライン15およびソースバスライン16は、画素電極およびTFTとともに表示領域21を構成するが、表示領域21内における配線は図3において図示を省略している。
【0052】
パネル側予備配線17は、TFT基板11とソースGS基板5との接続部(基板接続部)よりTFT基板側(すなわち、パネル側)でソースバスライン16と交差して設けられている。パネル側予備配線17とソースバスライン16との間には窒化シリコン膜等からなる絶縁膜が設けられており、パネル側予備配線17とソースバスライン16とは電気的に接続されていない。また、パネル側予備配線17は、ソースバスライン16と交差しない部分でソースGS基板5との接続領域まで延設されている。
【0053】
非端子側予備配線18は、TFT基板11におけるソースGS基板5の接続されている側と反対側に設けられており、表示領域を通じて横切るように配設されたソースバスライン17と交差して設けられている。この非端子側予備配線18とソースバスライン17との交差部分が接続配線延在部となる。非端子側予備配線18とソースバスライン16との間には窒化シリコン膜等からなる絶縁膜が設けられており、非端子側予備配線18とソースバスライン16とは電気的に接続されていない。また、非端子側予備配線18は、ソースバスライン16と交差しない部分でゲートGS基板3との接続領域まで延設されている。
【0054】
端子側予備配線19は、ゲートGS基板3に形成されている後述するゲート基板内予備配線とソースGS基板5に形成されている後述するソース基板内予備配線54とを接続するための配線として形成されている。
【0055】
パネル内配線20は、ゲートGS基板3上のゲートドライバ32およびソースGS基板5上のソースドライバ55への駆動信号および電源電圧(すなわち、駆動電圧)を供給するための配線を、FPC7とゲートGS基板3およびソースGS基板5との間で接続するためにTFT基板11内に形成されている配線である。
【0056】
一方、上記ソースGS基板5において形成される各種配線としては、ソース基板内予備配線54、ソース入力配線56、ソース出力配線57、ドライバ側予備配線58がある。
【0057】
ソース入力配線56は、FPC7から入力される駆動信号および駆動電圧をソースドライバ55へ入力するための配線であり、このため、TFT基板11におけるパネル内配線20を介しての信号入力配線71と接続されている。上記FPC7では、例えば、ポリイミド基材上に銅(Cu)箔が複数の配線にパターニングされることにより信号入力配線71が形成される。
【0058】
ソース出力配線57は、ソースドライバ55で生成されたソース信号をTFT基板11上のソースバスライン16に出力するための配線であり、ソース出力配線57とソースバスライン16とが基板接続部において1対1に接続される。
【0059】
ドライバ側予備配線58は、TFT基板11とソースGS基板5との接続部(基板接続部)よりGS基板側(すなわち、ドライバ側)でソース出力配線57と交差して設けられている。ドライバ側予備配線58とソース出力配線57との間には窒化シリコン膜等からなる絶縁膜が設けられており、ドライバ側予備配線58とソース出力配線57とは電気的に接続されていない。また、ドライバ側予備配線58は、ソース出力配線57と交差しない部分でTFT基板11との接続領域まで延設されている。
【0060】
ソース基板内予備配線54は、ソースGS基板5におけるドライバ側予備配線58とTFT基板11における非端子側予備配線18とを電気的に接続するための接続配線の一部となる配線である。すなわち、ドライバ側予備配線58と非端子側予備配線18とは、ソース基板内予備配線54、端子側予備配線19、およびゲート基板内予備配線31を介して電気的に接続されている。
【0061】
このように、上記液晶表示装置では、パネル側予備配線17、ドライバ側予備配線58、ソース基板内予備配線54、端子側予備配線19、ゲート基板内予備配線31、および非端子側予備配線18が接続されることによって、図1に示す予備配線8が構成される。尚、上記予備配線8においては、パネル側予備配線17およびドライバ側予備配線58によって基板接続部修正用予備配線が構成され、ドライバ側予備配線58、ソース基板内予備配線54、端子側予備配線19、ゲート基板内予備配線31、および非端子側予備配線18によって接続配線修正用予備配線が構成される。
【0062】
また、図1の構成では予備配線8の本数は2本であり。図3の構成では3本であるが、本発明において上記予備配線8の配線本数は必要な修正可能数により決定されるものであり、特に限定されるものではない(1本のみでもよいし複数配線してもよい)。
【0063】
尚、上記予備配線8を複数本配設する場合、異なる予備配線同士は電気的に接続されない。このため、異なる予備配線同士が交差する箇所では、間に絶縁膜を設けて多層構造にて予備配線が配設される。その結果、予備配線の一部が最上層よりも下層に形成されることがある。しかしながら、上記予備配線を基板接続部において他の基板に形成されている予備配線と接続するためには、少なくとも基板接続部においては上記予備配線が最上層に形成されている必要がある。このような場合、少なくとも基板接続部においては全ての予備配線が最上層に位置するように形成し、これと接続されるべき同一の予備配線がより下層に形成される場合は、その交差箇所においてコンタクトホールを設けて異なる層に形成された予備配線同士を電気的に接続することができる。もちろんこれ以外に、設計の都合上、同一の予備配線を異なる層に形成する場合には、コンタクトホールによる接続が利用される。
【0064】
ここで、本実施の形態に係る液晶表示装置の製造方法についてその一例を説明する。
【0065】
表示パネル1を構成するTFT基板11については、まず0.7mm厚のガラス基板上にスパッタ法を用いてチタニウム膜、アルミニウム膜、窒化チタニウム膜を順次積層し、フォトリソグラフ・ドライエッチング技術を用いて、ゲートバスライン15、ゲート電極(図示せず)、ゲート側接続端子(図示せず)、パネル側予備配線17、端子側予備配線19、パネル内配線20およびソース側接続端子(図示せず)を形成する。
【0066】
次に、プラズマCVD法を用いて、ゲート絶縁膜となる窒化シリコン膜、半導体層となる真性アモルファスシリコン層、ソース電極コンタクト層およびドレイン電極コンタクト層となるn+アモルファスシリコン層を順次積層した後、フォトリソグラフ・ドライエッチング技術を用いて、窒化シリコン膜のゲート側接続端子及びソース側接続端子上となる部位にコンタクトホール(図示せず)を形成するとともに、n+アモルファスシリコン層と真性アモルファスシリコン層を島状にパターニングする。
【0067】
次に、スパッタ法を用いて、透明導電膜であるITO膜、タンタル膜、窒化タンタル膜を順次積層し、フォトリソグラフ・エッチング技術を用いて、ソースバスライン16、ソース電極(図示せず)およびドレイン電極(図示せず)を形成する。このとき、ソースバスライン16とソース側接続端子は、ゲート絶縁膜である窒化シリコン膜に設けられたコンタクトホールを介して電気的に接続される。
【0068】
また、ソース電極とドレイン電極とは、n+アモルファスシリコン層と真性アモルファスシリコン層からなる島状パターンの上で分離されるように形成されている。
【0069】
更に、n+アモルファスシリコン層と真性アモルファスシリコン層をエッチングすることによって、ソース電極コンタクト層(図示せず)、ドレイン電極コンタクト層(図示せず)およびチャネル領域(図示せず)を形成してTFTを構成する。
【0070】
次いでプラズマCVD法により保護層となる窒化シリコン膜を成膜し、そのドレイン電極上となる部位に、画素電極と電気的に接続する為のコンタクトホールをパターニングした後、スパッタ法により透明導電膜であるITO膜を成膜・パターニングして画素電極(図示せず)を形成する。
【0071】
そして、上記で得られた基板上にポリイミド系樹脂からなる配向膜を形成し、これをラビング法によって配向処理する。以上の工程を経て、表示パネル1を構成するTFT基板11を得ることができる。
【0072】
なお、以上の工程を経てTFT基板11が形成されるにあたり、ゲート側接続端子およびソース側接続端子は、外部と電気的に接続が可能となるように導電層が露出されることはいうまでもない。
【0073】
次に、表示パネル1を構成するカラーフィルタ基板12については、まず0.7mm厚のガラス基板上にアクリル系樹脂を基材とする顔料分散型のカラーフィルタを形成し、その上に、スパッタ法により、対向電極として透明導電膜であるITO膜を形成する。更に、ポリイミド系樹脂からなる配向膜を形成し、これをラビング法によって配向処理する。以上の工程をもって、表示パネル1を構成するカラーフィルタ基板12を得ることができる。
【0074】
次に、カラーフィルタ基板12上にスクリーン印刷法を用いてシール剤を塗布し、TFT基板11上に乾式散布法を用いてスペーサ材を散布する。そしてカラーフィルタ基板12とマトリクス基板11とを互いの配向膜の形成面が一定の間隙をもって対向するようにして貼り合わせる。更に、カラーフィルタ基板12とTFT基板11との間に、液晶を注入することによって、表示パネル1が形成される。
【0075】
次に、ソースGS基板5の形成方法について説明する(ゲートGS基板3も同様の方法で形成される)。
【0076】
表示パネル1におけるTFT基板11と同様の製法を用いて、アルミノホウケイ酸からなるガラス基板上に、ポリシリコンからなる薄膜トランジスタを使ったソースドライバ55、該ソースドライバ55と接続されるソース出力配線57、接続端子を形成する。
【0077】
次に、表示パネル1におけるTFT基板11とソースGS基板5との接続方法について説明する(TFT基板11とゲートGS基板3も同様の方法で接続される)。
【0078】
これは、ソースGS基板5におけるソースドライバ55の形成面側が、TFT基板11のソース側端子部領域に対向するように、ソースGS基板5とTFT基板11との接続端子同士をACFを介して重畳させた後、300℃に加熱されたツールを重畳した箇所に押し当てることによって行なわれる。このとき、ツールは、合金工具鋼鋼材からなる。
【0079】
次に、TFT基板11とFPC7との接続方法について説明する。
【0080】
FPC7の接続端子とTFT基板11の接続端子とを、ACFを介して対向するように重畳させた後、重畳した個所に300℃に加熱されたツールを押し当てることによって、接続される。
【0081】
以上のようにして、本実施の形態に係る液晶表示装置が形成される。
【0082】
上記液晶表示装置において、電源電圧の劣化を防止するため、ソースバスライン16が互いに隣接する複数本ずつのグループに区分けされ、各グループ毎のソースバスライン16に対して異なるソースドライバ55により駆動する分割駆動が一般に行われている。このような場合、上記予備配線8におけるパネル側予備配線17およびドライバ側予備配線58は、各ソースドライバ55毎に設けられる。しかしながら、ソース基板内予備配線54、端子側予備配線19、ゲート基板内予備配線31、および非端子側予備配線18は、各ソースドライバ55毎に別個に設けても良いし、あるいは複数のソースドライバ55毎に共通して設けても良い(尚、全てのソースドライバ55で共通とは限らない)。ソース基板内予備配線54、端子側予備配線19、ゲート基板内予備配線31、および非端子側予備配線18を、各ソースドライバ55毎に別個に設ける構成を図4(a)に示し、複数のソースドライバ55毎に共通して設ける構成を図4(b)に示す。
【0083】
尚、上記説明では、ソース側においての予備配線構成を示したが、ゲート側においても同様の設計にて予備配線を設けることが可能である。
【0084】
上記構成の液晶表示装置における各配線のピッチおよび配線幅の具体的な構成例は以下の通りである。但し、以下の各寸法は、配線全体にかかるものとは限らず、少なくとも基板接続部の接続端子における寸法を示すものである。
・FPC7−TFT基板11接続部:
配線ピッチ0.3mm;信号入力配線71の幅(FPC端子幅)0.1mm;パネル内配線20の幅(TFTパネル端子幅)0.2mm
・TFT基板11−ゲートGS基板3またはソースGS基板5接続部(駆動回路駆動用の信号・電源伝送配線/予備配線(伝送部分)):
配線ピッチ0.3mm;非端子側予備配線18および端子側予備配線19の幅(TFTパネル端子幅)0.2mm;ゲート基板内予備配線31,ソース基板内予備配線54,ゲート入力配線およびソース入力配線56の幅(GS基板端子幅)0.1mm
・TFT基板11−ゲートGS基板3またはソースGS基板5接続部(パネル絵素部への出力信号接続部):
配線ピッチ0.07mm;ソースバスライン16の幅(TFTパネル端子幅)0.04mm;ソース出力配線57(GS基板端子幅)0.04mm(ソース側)
配線ピッチ0.1mm;パネル側予備配線17の幅(TFTパネル端子幅)0.07mm;ドライバ側予備配線58(GS基板端子幅)0.04mm(ソース側予備配線)
配線ピッチ0.2mm;ゲートバスライン15の幅(TFTパネル端子幅)0.1mm;ゲート出力配線(GS基板端子幅)0.1mm(ゲート側)
上記構成の液晶表示装置においては、表示パネル側基板であるTFT基板11と駆動回路側基板であるソースGS基板5(またはゲートGS基板3)との接続部に発生した接続不良を修正する予備配線を搭載することにより、従来は駆動回路基板を取り替えることにより修正を行っていた修理作業をレーザー修正で行うことができる。このため、修理にかかる工程数を大幅に低減でき、人件費の低減およびスループットの向上を図ることができる。
【0085】
また、接続不良の生じた駆動回路側基板を廃棄する必要が無く、材料費が低減できる。
【0086】
さらに、修理で発生する2次不良の発生を抑制することができる。同時に、2次不良が発生しにくいため信頼性の高いモジュールを提供できる。
【0087】
また、回路基板の交換修理で発生する、表示パネルの破壊(接続端子の断線など)を防止できる。
【0088】
次に、上記構造の予備配線を備えた液晶表示装置において、基板接続部にて接続不良が生じた場合の修正方法を説明する。
【0089】
図5(a)は、基板接続部に導電性の異物9aが混入することにより発生したリーク症状の第1の修正方法を示す。尚、図5(a)では、ソース信号XおよびYを出力する隣接した2本のソースバスラインが異物9aによってリークした状態を示している。
【0090】
導電性の異物9aには通常数10μmの厚みがあり、ガラス基板を通してレーザー等で分断することは困難であり、予備配線による修正が必要となる。このため、信号XおよびYを出力する信号線、すなわち、ソースバスライン16およびソース出力配線57は、パネル側予備配線17およびソース出力配線57の内側にて合計4箇所がレーザーにより分断され(図中、×印で示す)、電気的に絶縁される。ここで、ソースバスライン16およびソース出力配線57の膜厚は約3000Åであり、これらの配線はエキシマレーザーによる分断が可能である。
【0091】
次に、信号XおよびYを出力するソースバスライン16とパネル側予備配線17とのクロス部分、およびソース出力配線57とドライバ側予備配線58とのクロス部分(交差部分)をレーザーにより合計4箇所短絡する(図中、黒丸で示す)。
【0092】
以上の作業により、信号XおよびYは各々固有の信号を、上記リーク部分を迂回し、予備配線を介して表示パネル部へと出力することができる(図中、信号XおよびYの流れを太線で示す)。
【0093】
また、図5(b)は、図5(a)の場合と同様に接続部に導電性9aの異物が混入することにより発生したリーク症状の第2の修正方法を示す。
【0094】
図5(b)の構成では、異物9aにより信号XおよびYを出力する信号線がリーク症状となっているのは図5(a)の場合と同じであるが、上記リーク箇所を迂回するための信号線の分断、および信号線と予備配線との短絡箇所が信号Xに対応した部分のみとなっている。この結果、信号Xは予備配線を迂回した信号の流れとなるが、信号Yは予備配線を迂回しないで、ソースドライバ55からソース出力配線57およびソースバスライン16を介して表示パネルへと信号が流れている。この修正方法によっても、図5(a)に示した方法と同様の効果を得ることができる。
【0095】
次に、図5(c)は、基板接続部に浮き9bが生じオープン状態(絶縁性の異物や気泡によって、ACFによる接続端子間の電気的な接続が得られない接続不良)となった症状の修正方法を示す。
【0096】
この場合は、信号XおよびYを出力する信号線と予備配線とのクロス部分をレーザーにより合計4箇所短絡する。この結果、ソースドライバ55から出力された信号XおよびYは、上記オープン部分を迂回し、予備配線を介して表示パネル部へと伝達される(図中、信号XおよびYの流れを太線で示す)。
【0097】
以上の修正方法は、リーク症状およびオープン症状のそれぞれの場合の修正方法を示したものであるが、リーク症状およびオープン症状が組み合わされた接続不良の場合でも、上記の方法を組み合わせることにより修正が可能である。この時、不良発生の傾向を把握し、予備配線本数を設計段階で調整することが重要である。
【0098】
上記図5の説明では、基板接続部における接続不良を予備配線にて修正する場合を示したが、本実施の形態に係る液晶表示装置は、ソースバスライン(もしくはゲートバスライン)の断線不良が生じた場合にも予備配線を用いた修正が可能である。
【0099】
図6にソース断線が生じた液晶表示装置の例を示す。図6の例では、図中、■印で示す箇所にソースバスライン16の断線が生じているものとする。このとき、特に修正を行わなければ、ソースバスライン55から出力される信号は、上記断線の生じているソースバスライン16で断線箇所より先の信号供給が途切れることとなる。
【0100】
この場合の修正方法としては、断線の生じているソースバスライン16において、該ソースバスライン16に繋がるソース出力配線57とドライバ側予備配線58とのクロス部分(交差部分)をレーザーにより短絡し、さらに、表示エリアの外まで延びた該ソースバスライン16と非端子側予備配線18とのクロス部分(交差部分)をレーザーにより短絡する。ここで、上記短絡箇所を含むドライバ側予備配線58と非端子側予備配線18とは同一の予備配線8に属するものである。
【0101】
これにより、断線の生じているソースバスライン16において、断線箇所より端子側(すなわち、ソースGS基板5と接続されている側)では、ソース出力配線57およびソースバスライン16を介して信号が供給される一方、非端子側(すなわち、ソースGS基板5と接続されていない側)では、ドライバ側予備配線58、ソース基板内予備配線54、端子側予備配線19、ゲート基板内予備配線31、および非端子側予備配線18を介して信号が供給される。
【0102】
また、上記図6の構成においては、ソースGS基板5上のドライバ側予備配線58とTFT基板11の非端子側予備配線18との接続が、ゲートGS基板3およびソースGS基板5上の予備配線を介して行なわれる。このため、ソースバスライン16の断線修正時において、予備配線8を介して非端子側から供給される信号は、ソースバスライン16とパネル側予備配線17との絶縁膜を介した交差部を通過しないため、寄生容量の発生を抑え、ソース信号電圧のなまりを防止することができる。さらに、このことは、ゲートバスラインの冗長についても同様の構造を持てば、同様の効果を得ることができる。
【0103】
また、本実施の形態においては、パネル側予備配線17とドライバ側予備配線58とは、ソースバスライン16またはゲートバスライン15よりも線幅が太く形成されることが好ましい。これにより、冗長配線を伝搬する信号電圧に対する抵抗をバスラインの抵抗と同程度に抑制することができる。
【0104】
予備配線の配線幅、および、接続端子部の幅を広く設定することにより、修正ラインのバスライン抵抗と修正のない場所のバスライン抵抗とをほぼ均一にすることができる。これにより、バスライン間の配線抵抗のばらつきにより発生する表示ムラを抑制することができ、表示品位の向上を図ることができる。
【0105】
尚、上記説明における構成はあくまで一例であり、本発明はこれに限定されるものではなく、種々の変形例を取ることが可能である。例えば、基板接続部における予備配線の変形例を図7に示す。
【0106】
図7に示す構成では、パネル側予備配線17およびドライバ側予備配線58は、同一のソースドライバ55にて駆動される複数のソースバスライン16の両側を迂回するように配置されている。これにより、上記予備配線(すなわち、パネル側予備配線17およびドライバ側予備配線58)がソースバスライン16とソース出力配線57との接続領域を囲むようにして配置される。なお、図7では、上記予備配線が2本の場合の構成を示しているが、この本数は特に限定されない。
【0107】
ここで、上記図7の構成における基板接続部での修正方法を説明する。先ず、基板接続部においてオープン不良が発生した場合の修正方法を図7(a)に示す。例えば、オープン不良箇所9cの発生している信号線(ここでは、4本)について、うち左から2本目と3本目との間において、パネル側予備配線17およびドライバ側予備配線58をレーザーにより分断する(図中、×印で示す)。これにより、接続領域を囲むようにして配置された2本の予備配線が4本の独立した予備配線として使用できる。
【0108】
さらに、修正される4本の信号線のうち、ソースバスライン16とパネル側予備配線17との交差部分をレーザーによって短絡し、ソース出力配線57とドライバ側予備配線58との交差部分をレーザーによって短絡する。この時の短絡箇所は、図中黒丸で示されるようになり、修正される4本の信号線について外側の2本は外側の予備配線によって接続され、内側の2本は内側の予備配線によって接続される。この方法によれば、(予備配線本数×2)本の信号線についてまで、オープン症状の修正が可能である。
【0109】
次に、基板接続部においてリーク不良が発生した場合の修正方法を図7(b)に示す。例えば、リーク不良箇所9dの発生している信号線(ここでは、5本)について、うち左から2本目と3本目との間において、パネル側予備配線17およびドライバ側予備配線58をレーザーにより分断する(図中、×印で示す)。これにより、接続領域を囲むようにして配置された2本の予備配線が4本の独立した予備配線として使用できる。また、リーク不良箇所9dの発生している5本の信号線うち、左から1〜4本目の信号線について、予備配線の内側でリーク不良箇所9dと分断される(図中、×印で示す)。
【0110】
さらに、修正される5本の信号線のうち、左から1〜4本目の信号線について、ソースバスライン16とパネル側予備配線17との交差部分をレーザーによって短絡し、ソース出力配線57とドライバ側予備配線58との交差部分をレーザーによって短絡する。この時の短絡箇所は、図中黒丸で示されるようになり、修正される4本の信号線について外側の2本は外側の予備配線によって接続され、内側の2本は内側の予備配線によって接続される。また、リーク不良箇所9dの発生している5本の信号線のうち、最も右側の信号線は他の4本の信号線の分断によって独立する。この方法によれば、(予備配線本数×2+1)本の信号線についてまで、リーク症状の修正が可能である。
【0111】
また、上記図7の構成において、不良発生箇所が予備配線による修正可能数よりも少ない場合には、修正に用いられる予備配線と交差する信号線の本数が少なくなるようにすることで、予備配線に生ずる寄生容量を低減できる。
【0112】
また、ドライバ側予備配線58とソース基板内予備配線54との接続構成における変形例を図8ないし図10に示す。
【0113】
図1に示す構成では、パネル側予備配線17、ドライバ側予備配線58、およびソース基板内予備配線54がS字形状(パネル側予備配線17とドライバ側予備配線58の接続箇所と、ドライバ側予備配線58とソース基板内予備配線54の接続箇所が、ソースバスライン16およびソース出力配線57の配設領域を挟み、両側に別れて配置されている)に配置されているが、図8に示す構成では、パネル側予備配線17、ドライバ側予備配線58、およびソース基板内予備配線54がF字形状(パネル側予備配線17とドライバ側予備配線58の接続箇所と、ドライバ側予備配線58とソース基板内予備配線54の接続箇所がソースバスライン16およびソース出力配線57の配設領域の片側に共に配置されている)に配置されている。
【0114】
また、図9に示す構成では、パネル側予備配線17、ドライバ側予備配線58、およびソース基板内予備配線54が8字形状(パネル側予備配線17とドライバ側予備配線58の接続箇所と、ドライバ側予備配線58とソース基板内予備配線54の接続箇所が、ソースバスライン16およびソース出力配線57の配設領域を挟み、両側にそれぞれ配置されている)に形成されている。この構成によれば、ソースバスライン16の断線が生じた場合の修正において、断線が生じたソースバスラインの位置に応じて、修正に用いられるドライバ側予備配線58と交差するソース出力配線57の本数が少なくなるようにすることで、ドライバ側予備配線58に生ずる寄生容量を低減できる。
【0115】
更に上記によれば、パネル側予備配線17とドライバ側予備配線58がソースバスライン16およびソース出力配線57の配設領域を挟み、両側で接続されているので、仮に一方のパネル側予備配線17とドライバ側予備配線58との接続においてオープン症状が発生したとしても、もう一方のパネル側予備配線17とドライバ側予備配線58との接続を利用して修正を行うことができる。
【0116】
また、図10に示す構成では、2つのソースドライバ55のブロックをひとかたまりとして、予備配線を配置している。すなわち、パネル側予備配線17およびドライバ側予備配線58が、2つ分のソースドライバ55によって駆動される複数のソースバスライン16およびソース出力配線57にわたって配置され、ソース基板内予備配線54は、上記ドライバ側予備配線58の中央部(2つのソースドライバ55の間)で該ドライバ側予備配線58と接続される。さらに、図10の構成では、非端子側予備配線18へのソース信号の取り出しは、2つのブロックで2本となっている。
【0117】
また、ドライバ側予備配線58と非端子側予備配線18との接続については、上記説明では、ゲートGS基板3およびソースGS基板5を介した予備配線によって接続がなされている。しかしながら、ドライバ側予備配線58と非端子側予備配線18との接続は、TFT基板11内のみで行うことも可能である。この場合は、非端子側予備配線18は、パネル側予備配線17と接続される構成とすればよい。
【0118】
しかしながら、ドライバ側予備配線58と非端子側予備配線18とをTFT基板11内のみで接続する構成では、ソースバスライン16との交差箇所が多くなり、予備配線に発生する寄生容量が増大するため、ドライバ側予備配線58と非端子側予備配線18との接続をゲートGS基板3およびソースGS基板5を介した予備配線によって接続する構成が好ましい。また、上記説明では、ドライバ側予備配線58と非端子側予備配線18との接続は、ゲートGS基板3およびソースGS基板5の2つの駆動回路側基板を介して接続されているが、1つの駆動回路側基板(ドライバ側予備配線58と非端子側予備配線18との接続についてはソースGS基板5)を介して接続されるものであってもよい。
【0119】
尚、本実施の形態においては、本発明を液晶表示装置に適用する場合について、説明したが、これに限定されるものではなく、プラズマ表示装置、有機EL表示装置等、端子部を持つ表示装置であれば本発明の適用が可能である。
【0120】
また本発明では、液晶表示装置のようなアクティブマトリクス型における表示パネル側基板と駆動回路側基板との接続についての使用に限定されるものではない。すなわち、複数の配線を有する回路基板同士の接続において、その基板接続部にて配線同士も接続されるような構成であれば、その基板接続部の構造において本発明を適用することが可能であり、これらの回路基板の使用目的は特に限定されない。
【0121】
【発明の効果】
本発明の配線基板の接続構造は、以上のように、基板接続部にて接続される各基板に設けられた複数の接続配線同士が電気的に接続されるように、2枚の配線基板同士を接続する際の配線基板の接続構造において、上記各配線基板は、それぞれの配線基板に形成された接続配線に対して絶縁膜を介して該接続配線と交差するように設けられた少なくとも1本の予備配線を有しており、上記基板接続部では、上記接続配線と共に、各配線基板に形成された予備配線同士も接続されている構成である。
【0122】
それゆえ、上記配線基板の接続部において異物のかみ込みなどによる接続配線間の接続不良が発生した場合、基板の剥離、清掃、再接続といった、従来の修正方法における煩雑な工程が必要なく、レーザー照射のみによる容易な修正が可能となるといった効果を奏する。また、基板の剥離時における2次不良を抑制できるといった効果を併せて奏する。
【0123】
本発明の表示装置は、以上のように、表示パネル側基板と駆動回路側基板との基板接続部にて接続される各基板に設けられた複数の接続配線同士が電気的に接続されるように、表示パネル側基板と駆動回路側基板とが接続される表示装置において、上記表示パネル側基板および駆動回路側基板は、それぞれの基板に形成された接続配線に対して絶縁膜を介して該接続配線と交差するように設けられた少なくとも1本の予備配線を有しており、上記基板接続部では、上記接続配線と共に、上記表示パネル側基板および駆動回路側基板のそれぞれに形成された予備配線同士が接続されて、基板接続部修正用予備配線を構成している。
【0124】
それゆえ、例えば液晶表示装置等のアクティブマトリクス型の表示装置において、表示パネルと駆動回路(ゲートドライバやソースドライバ等)を異なる基板上に作成し、これらの基板を接続して表示装置を構成する場合に、表示パネル側基板と駆動回路側基板との接続に上述の配線基板の接続構造を使用することで、接続不良の発生した基板の接続において、レーザー照射のみによる容易な修正が可能となるといった効果を奏する。また、基板の剥離時における2次不良を抑制できるといった効果を併せて奏する。
【0125】
また、上記表示装置は、さらに、上記表示パネル側基板における接続配線の断線を修正するための接続配線修正用予備配線を有し、上記接続配線修正用予備配線が上記基板接続部修正用予備配線に接続されている構成とすることができる。
【0126】
それゆえ、上記接続配線修正用予備配線を設けることによって、基板接続部における接続不良の修正に加えて、表示パネル側基板における接続配線の断線(ゲートバスラインやソースバスラインの断線)をも修正できる。このとき、駆動回路から接続配線修正用予備配線および基板接続部修正用予備配線に信号を出力するための出力端子を低減でき、基板の小型化が図れるといった効果を奏する。
【0127】
また、上記表示装置では、上記接続配線修正用予備配線は、上記基板接続部修正用予備配線を形成する駆動回路側基板の予備配線から少なくとも1つの駆動回路側基板の接続配線と交差しない領域を経由して設けられている構成とすることが好ましい。
【0128】
それゆえ、上記接続配線修正用予備配線と接続配線との交差箇所を減らすことができ、接続配線修正用予備配線に発生する寄生容量を低減することができるといった効果を奏する。
【0129】
また、上記表示装置では、上記基板接続部修正用予備配線は、上記表示パネル側基板および駆動回路側基板のそれぞれに形成された予備配線同士が、これらの予備配線と交差する接続配線の配置方向の両側を経由して、表示パネル側基板および駆動回路側基板の間で接続される構成とすることができる。
【0130】
それゆえ、上記基板接続部修正用予備配線が、接続配線の配置方向の両側を経由しているため、接続配線との交差箇所の間で該基板接続部修正用予備配線を分断することによって、1本の基板接続部修正用予備配線によって、2本の接続配線に対して冗長配線を与えることができる。これにより、基板接続部修正用予備配線の配置領域の増大を最小限として、修正不良可能数を増やすことができるといった効果を奏する。
【0131】
また、上記表示装置では、上記基板接続部修正用予備配線は、上記表示パネル側基板および駆動回路側基板のそれぞれに形成された予備配線の配線幅が、これらの予備配線と交差する接続配線の線幅よりも太くなるように設定されている構成とすることが好ましい。
【0132】
それゆえ、上記基板接続部修正用予備配線の線幅を太くすることで、基板接続部修正用予備配線を伝搬する信号電圧に対する抵抗を、接続配線の抵抗と同程度に抑制することができる。これにより、接続配線間の配線抵抗のばらつきにより発生する表示ムラを抑制することができ、表示品位の向上を図ることができるといった効果を奏する。
【図面の簡単な説明】
【図1】本発明の一実施形態を示すものであり、液晶表示装置の全体構成を示す平面図である。
【図2】図1のA−A断面を示すものであり、上記液晶表示装置の接続部の構成を示す断面図である。
【図3】上記液晶表示装置の詳細な配線構造を示す平面図である。
【図4】上記液晶表示装置におけるドライバ側予備配線とソース基板内予備配線との接続例を示す図であり、図4(a)はソース基板内予備配線を共有しない場合の平面図、図4(b)はソース基板内予備配線を共有する場合の平面図である。
【図5】上記液晶表示装置における基板接続部の接続不良の修正例を示すものであり、図5(a)はリーク症状の修正における第1の例を示す平面図、図5(b)はリーク症状の修正における第2の例を示す平面図、図5(c)はオープン症状の修正における例を示す平面図である。
【図6】上記液晶表示装置におけるソースバスラインの断線の修正例を示す平面図である。
【図7】上記液晶表示装置における基板接続部の接続不良の修正例を示すものであり、図7(a)はオープン症状の修正における例を示す平面図、図7(b)はリーク症状の修正における例を示す平面図である。
【図8】上記液晶表示装置におけるドライバ側予備配線とソース基板内予備配線との図1とは異なる接続例を示す平面図である。
【図9】上記液晶表示装置におけるパネル側予備配線とドライバ側予備配線との接続構成における変形例を示す平面図である。
【図10】上記液晶表示装置におけるパネル側予備配線とドライバ側予備配線との接続構成における変形例を示す平面図である。
【図11】従来のTCP方式による表示装置の概略平面図である。
【図12】従来のCOG方式による表示装置の概略平面図である。
【図13】従来のGOG方式による表示装置の概略平面図である。
【図14】TCP方式の基板接続における不良発生箇所の状態を示す図であり、図14(a)は図11のA−A’断面図、図14(b)は図14(a)のAY−AY’断面図である。
【図15】GOG方式の基板接続における不良発生箇所の状態を示す図であり、図15(a)は図13のB−B’断面図、図15(b)は図15(a)のBY−BY’断面図である。
【符号の説明】
1 表示パネル
3 ゲートGS基板
5 ソースGS基板(配線基板、駆動回路側基板)
11 TFT基板(配線基板、表示パネル側基板)
15 ゲートバスライン
16 ソースバスライン(接続配線)
17 パネル側予備配線(予備配線、基板接続部修正用予備配線)
18 非端子側予備配線(接続配線修正用予備配線)
19 端子側予備配線(接続配線修正用予備配線)
31 ゲート基板内予備配線(接続配線修正用予備配線)
54 ソース基板内予備配線(接続配線修正用予備配線)
55 ソースドライバ(駆動回路)
57 ソース出力配線(接続配線)
58 ドライバ側予備配線(予備配線、基板接続部修正用予備配線、接続配線
修正用予備配線)
Claims (11)
- 基板接続部にて接続される各基板に設けられた複数の接続配線同士が電気的に接続されるように、2枚の配線基板同士を接続する際の配線基板の接続構造において、
上記各配線基板は、それぞれの配線基板に形成された接続配線に対して絶縁膜を介して該接続配線と交差するように設けられた少なくとも1本の予備配線を有しており、
上記基板接続部では、上記接続配線と共に、各配線基板に形成された予備配線同士も接続されていることを特徴とする配線基板の接続構造。 - 一対の配線基板の一方に設けられた複数の接続配線と他方に設けられた複数の接続配線とが基板接続部で電気的に接続される配線基板の接続構造において、
上記各配線基板は、絶縁膜を介して上記接続配線と交差するように設けられた少なくとも1本の予備配線をそれぞれに有しており、
上記基板接続部では、上記一方の配線基板の予備配線と上記他方の配線基板の予備配線とが電気的に接続されていることを特徴とする配線基板の接続構造。 - 表示パネル側基板と駆動回路側基板との基板接続部にて接続される各基板に設けられた複数の接続配線同士が電気的に接続されるように、表示パネル側基板と駆動回路側基板とが接続される表示装置において、
上記表示パネル側基板および駆動回路側基板は、それぞれの基板に形成された接続配線に対して絶縁膜を介して該接続配線と交差するように設けられた少なくとも1本の予備配線を有しており、
上記基板接続部では、上記接続配線と共に、上記表示パネル側基板および駆動回路側基板のそれぞれに形成された予備配線同士が接続されて、基板接続部修正用予備配線を構成していることを特徴とする表示装置。 - 表示領域を備えた表示パネル側基板と駆動回路を備えた駆動回路側基板とを有し、該表示パネル側基板に設けられた複数の接続配線と該駆動回路側基板に設けられた複数の接続配線とが該表示領域外の基板接続部で電気的に接続される表示装置において、
上記表示パネル側基板および駆動回路側基板は、絶縁膜を介して上記接続配線と交差するように設けられた少なくとも1本の予備配線をそれぞれに有しており、
上記基板接続部では、上記表示パネル側基板の予備配線と上記駆動回路側基板の予備配線とが電気的に接続されて、基板接続部修正用予備配線を構成していることを特徴とする表示装置。 - 上記駆動回路側基板は並列して設けられた複数の駆動回路を備え、
上記複数の接続配線は互いに隣接する複数本ずつのグループに区分けされており、
上記駆動回路の各々は上記グループの各々に属する接続配線および予備配線と電気的に接続されていることを特徴とする請求項3または4に記載の表示装置。 - さらに、上記表示パネル側基板における接続配線の断線を修正するための接続配線修正用予備配線を有しており、
上記接続配線修正用予備配線は、上記基板接続部修正用予備配線に接続されていることを特徴とする請求項3ないし5の何れかに記載の表示装置。 - さらに接続配線修正用予備配線を有しており、
上記表示パネル側基板の接続配線は、表示領域外に設けられた接続配線延在部まで延在されており、
上記接続配線修正用予備配線は、上記接続配線延在部で表示パネル側基板の接続配線と電気的に接続されているとともに、上記基板接続部修正用予備配線と電気的に接続されていることを特徴とする請求項3ないし5の何れかに記載の表示装置。 - 上記接続配線修正用予備配線は、上記基板接続部修正用予備配線を形成する駆動回路側基板の予備配線から少なくとも1つの駆動回路側基板を介して接続されていることを特徴とする請求項6または7に記載の表示装置。
- 上記接続配線修正用予備配線は、駆動回路側基板の予備配線から少なくとも1つの駆動回路側基板の接続配線と交差しない領域を経由して設けられていることを特徴とする請求項6または7の何れかに記載の表示装置。
- 上記基板接続部修正用予備配線は、上記表示パネル側基板および駆動回路側基板のそれぞれに形成された予備配線同士が、これらの予備配線と交差する接続配線の配置方向の両側を経由して、表示パネル側基板および駆動回路側基板の間で接続されることを特徴とする請求項2ないし9の何れかに記載の表示装置。
- 上記基板接続部修正用予備配線は、上記表示パネル側基板および駆動回路側基板のそれぞれに形成された予備配線の配線幅が、これらの予備配線と交差する接続配線の線幅よりも太くなるように設定されていることを特徴とする請求項2ないし10の何れかに記載の表示装置。
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Cited By (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2010041361A1 (ja) * | 2008-10-07 | 2010-04-15 | シャープ株式会社 | 表示装置及びその製造方法、並びにアクティブマトリクス基板 |
KR20130081473A (ko) * | 2012-01-09 | 2013-07-17 | 삼성디스플레이 주식회사 | 유기 발광 표시 장치 및 유기 발광 표시 장치의 리페어 방법 |
JP2013160965A (ja) * | 2012-02-07 | 2013-08-19 | Sharp Corp | アクティブマトリクス基板及びそれを備えた表示パネル |
WO2016103475A1 (ja) * | 2014-12-26 | 2016-06-30 | 堺ディスプレイプロダクト株式会社 | 表示装置及び表示装置の製造方法 |
JP2017073395A (ja) * | 2004-09-17 | 2017-04-13 | 株式会社半導体エネルギー研究所 | アクティブマトリクス型パネル |
US10372001B2 (en) | 2014-12-24 | 2019-08-06 | Sakai Display Products Corporation | Display apparatus and method of manufacturing display apparatus |
Families Citing this family (21)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6754108B2 (en) * | 2001-08-30 | 2004-06-22 | Micron Technology, Inc. | DRAM cells with repressed floating gate memory, low tunnel barrier interpoly insulators |
JP2003084721A (ja) * | 2001-09-12 | 2003-03-19 | Fujitsu Display Technologies Corp | 表示装置用駆動回路装置とそれを利用した表示装置 |
JP2003202846A (ja) * | 2001-10-30 | 2003-07-18 | Sharp Corp | 表示装置およびその駆動方法 |
TW200535758A (en) * | 2004-04-23 | 2005-11-01 | Innolux Display Corp | A low temperature poly-silicon driver circuit display panel and fabricating method thereof |
US20050278381A1 (en) * | 2004-05-26 | 2005-12-15 | Yixin Diao | Method and apparatus for online sample interval determination |
KR101133762B1 (ko) * | 2005-02-07 | 2012-04-09 | 삼성전자주식회사 | 표시 장치용 표시판 및 이를 포함하는 표시 장치 |
KR100636502B1 (ko) * | 2005-08-31 | 2006-10-18 | 삼성에스디아이 주식회사 | 원장단위 검사가 가능한 유기 전계발광표시장치 및 그검사방법 |
CN100371778C (zh) * | 2005-09-12 | 2008-02-27 | 友达光电股份有限公司 | 显示装置 |
TWI285767B (en) * | 2005-11-14 | 2007-08-21 | Au Optronics Corp | Repair line framework of liquid crystal device |
KR100754140B1 (ko) * | 2005-12-21 | 2007-08-31 | 삼성에스디아이 주식회사 | 원장단위 검사가 가능한 유기 발광 표시장치 및 모기판과그 검사방법 |
CN102221752A (zh) * | 2010-04-19 | 2011-10-19 | 北京京东方光电科技有限公司 | 液晶面板及其制造方法、维修该液晶面板的方法 |
CN102073158B (zh) * | 2010-11-30 | 2014-04-23 | 深圳莱宝高科技股份有限公司 | 面板装置及电子设备 |
TWI574092B (zh) | 2011-11-30 | 2017-03-11 | 友達光電股份有限公司 | 裸眼式立體顯示器 |
TW201421304A (zh) * | 2012-11-22 | 2014-06-01 | Ibm | 修補觸控面板之方法、修補組件、及觸控面板 |
CN103091920B (zh) * | 2013-01-25 | 2016-03-23 | 北京京东方光电科技有限公司 | 一种阵列基板及其驱动方法、显示装置 |
CN105378553B (zh) * | 2013-07-19 | 2019-12-17 | 堺显示器制品株式会社 | 显示面板以及显示装置 |
US9853062B2 (en) | 2013-07-19 | 2017-12-26 | Sakai Display Products Corporation | Display panel and display apparatus |
CN107251130A (zh) | 2015-02-16 | 2017-10-13 | 堺显示器制品株式会社 | 电路装置以及显示装置 |
JP2019086575A (ja) * | 2017-11-02 | 2019-06-06 | シャープ株式会社 | 表示装置 |
KR20200091060A (ko) * | 2019-01-21 | 2020-07-30 | 삼성디스플레이 주식회사 | 표시 장치 |
TWI742519B (zh) * | 2019-07-26 | 2021-10-11 | 友達光電股份有限公司 | 可撓性顯示裝置及其製造方法 |
Family Cites Families (20)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4688896A (en) * | 1985-03-04 | 1987-08-25 | General Electric Company | Information conversion device with auxiliary address lines for enhancing manufacturing yield |
JPH0766253B2 (ja) * | 1986-06-20 | 1995-07-19 | 松下電器産業株式会社 | マトリクス型画像表示装置 |
US4840459A (en) * | 1987-11-03 | 1989-06-20 | General Electric Co. | Matrix addressed flat panel liquid crystal display device with dual ended auxiliary repair lines for address line repair |
US5268678A (en) * | 1989-06-20 | 1993-12-07 | Sharp Kabushiki Kaisha | Matrix-type display device |
JPH04217229A (ja) | 1990-12-19 | 1992-08-07 | Fujitsu Ltd | マトリクス型液晶表示パネル |
JPH04283727A (ja) | 1991-03-12 | 1992-10-08 | Ricoh Co Ltd | 液晶表示装置 |
JP2894039B2 (ja) * | 1991-10-08 | 1999-05-24 | 日本電気株式会社 | 表示装置 |
JPH05303109A (ja) | 1992-04-27 | 1993-11-16 | Sanyo Electric Co Ltd | 液晶表示装置 |
JPH0618910A (ja) * | 1992-06-30 | 1994-01-28 | Matsushita Electric Ind Co Ltd | 液晶表示デバイス |
JP2968139B2 (ja) | 1992-12-28 | 1999-10-25 | シャープ株式会社 | パネルの実装構造 |
JPH06222377A (ja) | 1993-01-22 | 1994-08-12 | Matsushita Electric Ind Co Ltd | 平面型表示装置 |
JP2865968B2 (ja) | 1993-02-08 | 1999-03-08 | シャープ株式会社 | パネルの実装構造および実装方法 |
JP2911082B2 (ja) | 1993-01-27 | 1999-06-23 | シャープ株式会社 | パネルの実装構造および実装方法 |
KR0144283B1 (ko) | 1993-10-28 | 1998-07-15 | 쯔지 하루오 | 리워킹이 용이한 소형경량 표시장치 및 그 실장방법 |
JP3264103B2 (ja) | 1994-06-17 | 2002-03-11 | カシオ計算機株式会社 | 液晶表示装置 |
JPH08304845A (ja) | 1995-04-27 | 1996-11-22 | Nec Corp | 液晶表示装置 |
US5608245A (en) * | 1995-12-21 | 1997-03-04 | Xerox Corporation | Array on substrate with repair line crossing lines in the array |
JPH09244045A (ja) | 1996-03-13 | 1997-09-19 | Canon Inc | 液晶表示装置およびその製造方法 |
KR100260611B1 (ko) * | 1997-04-03 | 2000-07-01 | 윤종용 | 배선을 수리하기 위한 평판 표시 장치용 기판 |
KR100242943B1 (ko) * | 1997-05-30 | 2000-02-01 | 윤종용 | 수리선이 형성된 액정표시장치 |
-
2002
- 2002-11-22 JP JP2002340076A patent/JP4255683B2/ja not_active Expired - Fee Related
-
2003
- 2003-02-12 US US10/364,340 patent/US7027043B2/en not_active Expired - Lifetime
- 2003-03-10 CN CN03119879.1A patent/CN1247055C/zh not_active Expired - Fee Related
Cited By (15)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US10622580B2 (en) | 2004-09-17 | 2020-04-14 | Semiconductor Energy Laboratory Co., Ltd. | Light-emitting device |
US11711936B2 (en) | 2004-09-17 | 2023-07-25 | Semiconductor Energy Laboratory Co., Ltd. | Light-emitting device |
US11417856B2 (en) | 2004-09-17 | 2022-08-16 | Semiconductor Energy Laboratory Co., Ltd. | Light-emitting device |
JP2017073395A (ja) * | 2004-09-17 | 2017-04-13 | 株式会社半導体エネルギー研究所 | アクティブマトリクス型パネル |
US10971697B2 (en) | 2004-09-17 | 2021-04-06 | Semiconductor Energy Laboratory Co., Ltd. | Light-emitting device |
US10673011B2 (en) | 2004-09-17 | 2020-06-02 | Semiconductor Energy Laboratory Co., Ltd. | Light-emitting device |
JP4916578B2 (ja) * | 2008-10-07 | 2012-04-11 | シャープ株式会社 | 表示装置及びその製造方法、並びにアクティブマトリクス基板 |
US8390606B2 (en) | 2008-10-07 | 2013-03-05 | Sharp Kabushiki Kaisha | Display device, method for manufacturing same, and active matrix substrate |
WO2010041361A1 (ja) * | 2008-10-07 | 2010-04-15 | シャープ株式会社 | 表示装置及びその製造方法、並びにアクティブマトリクス基板 |
KR20130081473A (ko) * | 2012-01-09 | 2013-07-17 | 삼성디스플레이 주식회사 | 유기 발광 표시 장치 및 유기 발광 표시 장치의 리페어 방법 |
KR101878333B1 (ko) * | 2012-01-09 | 2018-07-16 | 삼성디스플레이 주식회사 | 유기 발광 표시 장치 및 유기 발광 표시 장치의 리페어 방법 |
JP2013160965A (ja) * | 2012-02-07 | 2013-08-19 | Sharp Corp | アクティブマトリクス基板及びそれを備えた表示パネル |
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