JP2001517367A - 導電層をエッチングする方法 - Google Patents
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Abstract
Description
Claims (1)
- 【特許請求の範囲】 1.基板加工チャンバ内において、半導体基板の上に配置された導電層を貫いて エッチングすることによって導電機構を形成する方法であって、 前記導電機構の頂部を形成するために、第1のエッチ・レシピを使用して前記 導電層を少なくとも部分的に貫いてエッチングする工程と、 その後、前記導電機構の底部を形成するために、前記第1のエッチ・レシピと は異なる第2のエッチ・レシピを使用して前記導電層の残りの厚さを少なくとも 部分的に貫いてエッチングする工程と を有し、前記底部は前記頂部の下に配置され、傾斜エッチ・フットを前記導電機 構の底部内に形成すべく前記第2のエッチ・レシピは調製されている方法。 2.請求項1に記載の方法において、前記第1のエッチ・レシピは前記第2のエ ッチ・レシピで達成されるエッチ速度より高いエッチ速度を前記導電層全体にわ たって達成すべく調製されている方法。 3.請求項2に記載の方法において、前記第1のエッチ・レシピはエッチ速度を 前記導電層全体にわたって最大にすべく調製されている方法。 4.請求項1に記載の方法において、前記基板加工チャンバはプラズマ加工チャ ンバに相当する方法。 5.請求項4に記載の方法において、前記プラズマ加工チャンバはトランスフォ ーマ・カップルド・プラズマ・エッチ・チャンバに相当する方法。 6.請求項5に記載の方法において、前記導電機構は塩素化学を使用してエッチ ングする方法。 7.請求項5に記載の方法において、前記導電機構はフッ素化学を使用してエッ チングする方法。 8.請求項5に記載の方法において、前記トランスフォーマ・カップルド・プラ ズマ・エッチ・チャンバは前記基板の下に配置された下側電極を有し、前記導電 機構の底部をエッチングする間における前記下側電極のDCバイアスは、前記導 電機構の頂部を形成する間における前記下側電極のDCバイアスより高い方法。 9.請求項1に記載の方法において、前記導電機構の底部をエッチングする間に おける前記基板の温度は、前記導電機構の頂部を形成する間における前記基板の 温度より低く維持される方法。 10.請求項1に記載の方法において、前記導電機構は前記導電層の下に配置し た絶縁層内のビアの上に配置され、前記導電機構の頂部は前記ビアの直径より狭 い幅を有し、前記導電機構の底部及び前記ビアの間の界面における前記導電機構 の底部の幅は、少なくとも前記ビアの直径と同じ大きさである方法。 11.請求項1に記載の方法において、前記ビアは導電プラグをその中に有し、 前記導電プラグはチタンを含む方法。 12.請求項11に記載の方法において、前記導電プラグ及び前記ビアの内壁の 間に配置された層を前記ビアは有する方法。 13.請求項12に記載の方法において、前記導電プラグは下に横たわる導電機 構へ電気的に接触しており、前記下に横たわる導電機構は前記絶縁層の下に位置 する方法。 14.請求項13に記載の方法において、前記半導体基板は集積回路の製造に使 用する半導体基板に相当する方法。 15.半導体基板上に設けられた部品を有する集積回路であって、 前記半導体基板の上に配置された第1の導電層からエッチングによって形成さ れた第1の導電機構と、 前記第1の導電機構の上に配置され、かつ、ビアを内部に有する絶縁層と、 前記ビア内に配置され、かつ、前記第1の導電機構へ電気的に接続されている 導電プラグと、 前記絶縁層の上に配置された第2の導電層からエッチングによって形成され、 かつ、前記ビアの上に配置された第2の導電機構と を有し、前記第2の導電機構は、前記ビア内に配置された導電プラグへ電気的に 接続され、かつ、 第1のエッチ・プロフィール及び第1の幅を有する頂部と、 前記第1のエッチ・プロフィールとは異なる第2のエッチ・プロフィール及 び前記第1の幅より広い第2の幅を備え、かつ、前記頂部の下に配置された底部 と を有する集積回路。 16.請求項15に記載の集積回路において、前記導電プラグはタングステンを 含む集積回路。 17.請求項16に記載の集積回路において、前記第1のエッチ・プロフィール は前記第2のエッチ・プロフィールより異方性が高い集積回路。 18.請求項15に記載の集積回路において、前記第2の幅は前記ビアの直径よ り広い集積回路。 19.請求項18に記載の集積回路において、前記第1の幅は前記ビアの直径よ り狭い集積回路。 20.請求項18に記載の集積回路において、前記導電プラグ及び前記ビアの内 壁の間に配置された層をさらに有する集積回路。 21.プラズマ加工チャンバ内において、上に横たわる導電層から上に横たわる 導電機構を形成する間、下に横たわる導電機構への損傷を防止する方法であって 、前記上に横たわる導電層は絶縁層によって前記下に横たわる導電機構から分離 されており、前記絶縁層はビア内に配置された導電プラグを有し、前記導電プラ グは前記上に横たわる導電機構及び前記下に横たわる導電層を前記絶縁層を貫い て互いに接続している方法において、 第1の幅を有する頂部を形成するために、第1のエッチ・レシピを使用して前 記上に横たわる導電層を少なくとも部分的に貫いてエッチングする工程と、 前記第1の幅及び前記ビアの直径のいずれよりも大きい第2の幅を有する前記 上に横たわる導電機構の底部を形成するために、前記第1のエッチ・レシピとは 異なる第2のエッチ・レシピを使用して前記上に横たわる導電層の残りの厚さを 少なくとも部分的に貫いてエッチングする工程と を含む方法。 22.請求項21に記載の方法において、前記第1のエッチ・レシピは前記第2 のエッチ・レシピより高い速度でエッチングすべく調製されている方法。 23.請求項21に記載の方法において、前記頂部は前記底部より異方性が高い 方法。 24.請求項21に記載の方法において、前記第1のエッチ・レシピ及び第2の エッチ・レシピとは異なる第3のエッチ・レシピを使用することによって、前記 導電層のバリア層を貫いてエッチングする工程をさらに含む方法。 25.請求項24に記載の方法において、前記上に横たわる導電層の前記残りの 厚さを貫いてエッチングした後、オーバーエッチを実施する工程を含む方法。
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