DE4002037A1 - Kondensator und spannungsmultiplizierer unter verwendung des kondensators - Google Patents
Kondensator und spannungsmultiplizierer unter verwendung des kondensatorsInfo
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- 239000003990 capacitor Substances 0.000 title claims description 82
- 229910021420 polycrystalline silicon Inorganic materials 0.000 claims description 53
- 229920005591 polysilicon Polymers 0.000 claims description 52
- 150000004767 nitrides Chemical class 0.000 claims description 23
- 239000004020 conductor Substances 0.000 claims description 20
- 239000000758 substrate Substances 0.000 claims description 15
- 238000009413 insulation Methods 0.000 claims description 14
- 229910052581 Si3N4 Inorganic materials 0.000 claims description 4
- 229910052751 metal Inorganic materials 0.000 claims description 4
- 239000002184 metal Substances 0.000 claims description 4
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 claims description 3
- 239000004744 fabric Substances 0.000 claims 1
- 238000000034 method Methods 0.000 description 8
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 7
- 230000003071 parasitic effect Effects 0.000 description 5
- 239000012535 impurity Substances 0.000 description 4
- 238000005530 etching Methods 0.000 description 3
- 230000003647 oxidation Effects 0.000 description 3
- 238000007254 oxidation reaction Methods 0.000 description 3
- 235000012239 silicon dioxide Nutrition 0.000 description 3
- 239000000377 silicon dioxide Substances 0.000 description 3
- 230000015556 catabolic process Effects 0.000 description 2
- 238000005229 chemical vapour deposition Methods 0.000 description 2
- 230000006870 function Effects 0.000 description 2
- 238000004519 manufacturing process Methods 0.000 description 2
- 239000000463 material Substances 0.000 description 2
- 238000001465 metallisation Methods 0.000 description 2
- 241000158147 Sator Species 0.000 description 1
- 229910052785 arsenic Inorganic materials 0.000 description 1
- RQNWIZPPADIBDY-UHFFFAOYSA-N arsenic atom Chemical compound [As] RQNWIZPPADIBDY-UHFFFAOYSA-N 0.000 description 1
- 229910052681 coesite Inorganic materials 0.000 description 1
- 238000010276 construction Methods 0.000 description 1
- 238000007796 conventional method Methods 0.000 description 1
- 229910052906 cristobalite Inorganic materials 0.000 description 1
- 239000003989 dielectric material Substances 0.000 description 1
- 238000009792 diffusion process Methods 0.000 description 1
- 230000005684 electric field Effects 0.000 description 1
- BHEPBYXIRTUNPN-UHFFFAOYSA-N hydridophosphorus(.) (triplet) Chemical compound [PH] BHEPBYXIRTUNPN-UHFFFAOYSA-N 0.000 description 1
- 238000002955 isolation Methods 0.000 description 1
- 239000010410 layer Substances 0.000 description 1
- 238000004518 low pressure chemical vapour deposition Methods 0.000 description 1
- 230000000873 masking effect Effects 0.000 description 1
- 230000015654 memory Effects 0.000 description 1
- 238000004377 microelectronic Methods 0.000 description 1
- 239000000203 mixture Substances 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
- 238000000926 separation method Methods 0.000 description 1
- 229910052682 stishovite Inorganic materials 0.000 description 1
- 229910052905 tridymite Inorganic materials 0.000 description 1
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-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L27/00—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
- H01L27/02—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers
- H01L27/04—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body
- H01L27/08—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including only semiconductor components of a single kind
- H01L27/0805—Capacitors only
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L28/00—Passive two-terminal components without a potential-jump or surface barrier for integrated circuits; Details thereof; Multistep manufacturing processes therefor
- H01L28/40—Capacitors
-
- H—ELECTRICITY
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/86—Types of semiconductor device ; Multistep manufacturing processes therefor controllable only by variation of the electric current supplied, or only the electric potential applied, to one or more of the electrodes carrying the current to be rectified, amplified, oscillated or switched
- H01L29/92—Capacitors having potential barriers
- H01L29/94—Metal-insulator-semiconductors, e.g. MOS
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- Engineering & Computer Science (AREA)
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- Computer Hardware Design (AREA)
- Physics & Mathematics (AREA)
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- General Physics & Mathematics (AREA)
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Description
Die Erfindung betrifft Kondensatoren, insbesondere vielschichtige
Polysilizium-Kondensatoren, die besonders für den Einsatz in Span
nungsmultiplizierern oder in Schaltungen, welche Spannungsmulti
plizierer benötigen, ausgelegt sind.
In der mikroelektronischen Industrie wird es häufig gewünscht, nur
eine einzige externe Spannungsversorgung (z.B. 5 Volt) zu verwen
den, um den gesamten Energiebedarf einer Mikroschaltung zu decken.
Darüber hinaus ist es wünschenswert, einen Chip-integrierten
Spannungsmultiplizierer herzustellen, der eine Spannung abgibt,
welche höher als die externe Versorgungsspannung ist, um zum
Beispiel ein Gate eines NMOS-Transistors so anzusteuern, daß
ein höherer Ausgangsstromdurchsatz erreicht wird, oder um höhere
Lösch- und Schreib-Spannungen für elektrisch löschbare program
mierbare Lesespeicher (EEPROMs) zu erhalten.
Fig. 1 zeigt schematisch einen beispielhaften Spannungsverdopp
ler, der in eine integrierte Schaltung eingesetzt werden kann.
Der Spannungsverdoppler 10 nach Fig. 1 verwendet die über den in
Serie liegenden Kondensatoren C 1 und C 2 liegende Spannung als
Ausgangsspannung. Die übrigen Schaltungsteile des Spannungsver
dopplers 10 laden die beiden Kondensatoren C 1 und C 2 jeweils
individuell auf die Versorgungsspannung V cc , wenn die Rechteck
wellen-Signale 12 und 14 180° Phasendifferenz zueinander aufweisen
und beide mit der Amplitude der Versorgungsspannung V cc an den
Eingangsanschlüssen des Spannungsverdopplers 10 anliegen. Somit
laden die beiden Signale 12 und 14 die beiden Kondensatoren C 1
und C 2 auf die Spitzenspannung V cc von beispielsweise 5 Volt auf,
so daß die Spannung über den in Serie liegenden Kondensatoren C 1
und C 2 etwa das doppelte der Amplitude der Signale 12 und 14 - in
diesem Fall 10 Volt - beträgt. Wird ein Spannungsverdreifacher
benötigt, sind drei nicht miteinander in Phase liegende Signale
erforderlich, welche drei in Serie zueinander liegende Kondensa
toren auf die Versorgungsspannung aufladen, um die Versorgungs
spannung über den Kondensatoren etwa zu verdreifachen.
Bei herkömmlichen Spannungsmultiplizierern umfaßt ein jeder der
Kondensatoren eine hochleitfähige Polysilizium-Schicht auf und
isoliert von einem hochleitenden diffundierten Gebiet (vgl. Fig.
2). Gemäß Fig. 2 stellen die Polysilizium-Schichten 20 und 22
die oberen Platten der Kondensatoren C 1 und C 2 dar, während die
diffundierten Gebiete 24 und 26 die unteren Platten der Kondensa
toren bilden. Elektroden 28, 30, 32 und 34 bilden die geeigneten
Verbindungen zu den diffundierten Gebieten und den oberen Poly
silizium-Platten. Werden größere Spannungsmultiplikatoren ge
wünscht, sind immer mehr Kondensatoren erforderlich, was in mehr
Materialverbrauch resultiert, der erforderlich ist, um die nötige
Anzahl von Kondensatoren zu erhalten. Darüber hinaus ist jeder
einzelne Kondensator mit parasitären Kapazitäten zwischen den
diffundierten Gebieten und dem Substrat behaftet.
Die JP-PS 59-89 450 (Miyamoto) zeigt einen vielschichtigen Konden
sator mit großer Kapazität, bei dem ein diffundiertes Gebiet in
einem Substrat die untere Platte eines ersten Kondensators bildet.
Auf dem diffundierten Gebiet ist eine isolierende Schicht ausge
bildet, die wiederum eine erste Polysilizium-Schicht darauf trägt,
wobei letztere eine obere Platte des ersten Kondensators und eine
obere Platte eines zweiten Kondensators darstellt. Auf und iso
liert von der ersten Polysilizium-Schicht ist eine zweite Poly
silizium-Schicht ausgebildet, welche eine untere Platte des zwei
ten Kondensators und eine untere Platte eines dritten Kondensators
darstellt. Auf der zweiten Polysilizium-Schicht ist eine davon
isolierte dritte Polysilizium-Schicht ausgebildet, welche die
obere Platte des dritten Kondensators und eine obere Platte eines
vierten Kondensators bildet. Eine vierte Polysilizium-Schicht
stellt die untere Platte des vierten Kondensators dar. Das diffun
dierte Gebiet, die zweite Polysilizium-Schicht und die vierte
Polysilizium-Schicht sind mittels einer ersten Elektrode miteinan
der verbunden, während die erste Polysilizium-Schicht und die
dritte Polysilizium-Schicht miteinander über eine zweite Elektrode
verbunden sind. Dieser Aufbau ist vier parallelliegenden Kondensa
toren äquivalent, wobei der dadurch entstehende große Kondensator
nur zwei Anschlüsse zum Verbinden mit der übrigen Schaltung auf
weist. Dieser Typ Kondensator kann nicht in einem Spannungsmulti
plizierer verwendet werden, um die Kondensatoren C 1 und C 2 nach
Fig. 1 zu bilden, weil die Kondensatoren C 1 und C 2 in Serie
liegen müssen.
Kein herkömmlicher Spannungsmultiplizierer verwendet vielfache
Polysilizium-Schichten in der Anordnung als serielle Kondensato
ren. Ferner konnte kein Stand der Technik gefunden werden, der
Mehrfach-Polysilizium-Schichten in der Form einzelner diskreter
Kondensatoren offenbart, welche geschichtet aufgebaut sind.
Gemäß der Erfindung wird eine vielschichtige Polysilizium-Struktur
ausgebildet, wobei die verschiedenen Polysilizium-Schichten und
ein leitendes diffundiertes Gebiet die Platten eines geschichteten
Kondensators bilden. Es werden individuelle Elektroden für die
Verbindungen zu den verschiedenen Platten der Kondensatoren ver
wendet, so daß die Kondensatoren als seriell miteinander ver
schaltete Kondensatoren zur Verwendung in einem Spannungsmulti
plizierer eingesetzt werden können. Bei diesem Aufbau des Konden
sators ist der Plattenzwischenbereich, das Erschöpfungsgebiet
durch das Stapeln von Kondensatoren geschützt.
Ein weiterer Vorteil dieses Aufbaus liegt darin, daß nur zwischen
dem leitenden diffundierten Gebiet und dem Substrat eine parasi
täre Kapazität auftritt. Die übrigen darüberliegenden Kondensa
toren sind nicht mit parasitären Kapazitäten behaftet, weil die
leitenden Polysiliziun-Schichten jeweils als abschirmende Platten
wirken.
Kapazitätswerte können in einfacher Weise durch Vorgeben der
Dicke einer dielektrischen Schicht zwischen den jeweiligen leiten
den Kondensatorplatten und/oder durch Vorgeben der Fläche einer
Kondensatorplatte eingestellt werden. Es kann bevorzugt aus
schließlich Oxyd als Dielektrikum verwendet werden; jedoch kann
die Durchschlagspannung durch Verwendung von Nitrid als Isola
tionsschicht oder durch Verwendung von Nitrid in Verbindung mit
Oxyd als Isolationsschicht gesteigert werden. In einigen Fällen
kann es wünschenswert sein, mehrschichtige Dielektrika wie bei
spielsweise Oxyd/Nitrid/Oxyd auszubilden. Da Nitride eine relativ
hohe
Dielektrizitätskonstante im Vergleich mit Siliziumdioxyd haben,
bewirkt die Verwendung von Nitrid in der Isolationsschicht ferner,
daß die Kapazität bei gegebener Dicke des Dielektrikums steigt.
Gemäß einem Ausführungsbeispiel eines Verfahrens zum Herstellen
dieser Kondensatoren wird jeweils die ausgebildete Polysilizium-
Kondensatorplatte als Maske während des Ätzens des darunterlie
genden Dielektrikums verwendet.
Im folgenden ist die Erfindung anhand eines bevorzugten Ausfüh
rungsbeispiels unter Bezugnahme auf die Zeichnungen mit weiteren
Einzelheiten näher erläutert.
Es zeigen:
Fig. 1 schematisch einen Spannungsmultiplizierer mit
einer Serienschaltung von Kondensatoren;
Fig. 2 einen Schnitt durch einen herkömmlichen Mehrfach-
Kondensator;
Fig. 3 ein Ausführungsbeispiel des erfindungsgemäßen
stapelförmigen Kondensators und
Fig. 4 bis 6 Verfahrensschritte beim Herstellen des Ausfüh
rungsbeispiels nach Fig. 3.
Fig. 3 zeigt ein Ausführungsbeispiel der Erfindung mit einem p⁻-
Substrat 40, wobei darin eine n⁺-diffundiertes Gebiet 42 ausgebil
det ist. Das n⁺-diffundierte Gebiet 42 ist hochleitend und fun
giert als untere Platte eines ersten Kondensators C 1 (gestrichelt
dargestellt). Das Substrat 40 und das hochleitende diffundierte
Gebiet 42 können vom n⁻- und vom p⁻-Typ sein, falls gewünscht.
Über dem n⁺-Gebiet 42 ist eine Gate-Oxyd-Schicht 44 und darüber
eine Nitrid-Schicht (Si3N4) 46 ausgebildet.
Eine erste Polysilizium-Schicht 48 ist über der Nitrid-Schicht 46
ausgebildet und stellt die obere Platte des Kondensators C 1 und
die untere Platte eines Kondensators C 2 dar. Eine Oxyd-Schicht 50
ist dann über der Polysilizium-Schicht 48 ausgebildet. Über der
Oxyd-Schicht 50 liegt eine Nitrid-Schicht 52.
Über der Nitrid-Schicht 52 ist eine zweite Polysilizium-Schicht
54 ausgebildet, welche die obere Platte des Kondensators C 2 bil
det. Auf der Oberfläche der Struktur liegt eine Feldoxyd-Schicht
56. In die Feldoxyd-Schicht 56 sind Kontaktöffnungen geätzt.
Metallelektroden 58, 60 und 62 dienen als Kontakte für den diffun
dierten Bereich 42, die erste Polysilizium-Schicht 48 und die
zweite Polysilizium-Schicht 54.
Die Schichten 48 und 54 können auch in Form von Schichten aus
Polycid (metallisiertes Polysilizium) oder Metall, wie Ti, TiW,
oder SiCr gebildet sein.
Durch Vorgeben der Flächen der verschiedenen Kondensatorplatten
und der Dicken der Elektrika dazwischen können die Kondensatoren
C 1 und C 2 gemäß der folgenden Gleichung (1) wie gewünscht einge
stellt werden.
C = AK ε₀/t (1)
mit
C Kapazität,
ε₀ Dielektrizitätskonstante des leeren Raumes (8,85 × 10-12 As/Vm),
K relative Dielektrizitätskonstante (3,9 für SiO₂; 7,0 für Si₃N₄),
A Plattenfläche und
t Dicke des Dielektrikums.
ε₀ Dielektrizitätskonstante des leeren Raumes (8,85 × 10-12 As/Vm),
K relative Dielektrizitätskonstante (3,9 für SiO₂; 7,0 für Si₃N₄),
A Plattenfläche und
t Dicke des Dielektrikums.
Die Nitrid-auf-Oxyd-Redundanz verbessert die Ausbeute. Da ferner
Nitrid eine höhere relative dielektrische Konstante als Silizium
dioxyd hat, ermöglicht die Verwendung von nitridischen dielek
trischen Schichten eine hohe Kapazität zwischen den Platten bei
gegebener Dicke des Dielektrikums sowie eine Steigerung der Durch
schlagspannung. Die Steigerung der Durchschlagspannung wird bei
Hochspannungsanwendungen sehr wichtig.
Der Aufbau gemäß Fig. 3 kann beispielsweise bei einem Spannungs
multiplizierer nach Fig. 1 Verwendung finden. Es können zusätz
liche dielektrische und Polysilizium-Schichten mit Verbindungen
dazu ausgebildet sein, um jede Anzahl von seriell verschalteten
Kondensatoren zu realisieren. Darüber hinaus können die Polysili
zium-Schichten mittels eines Metallisierungsschrittes miteinander
verbunden werden, um jedwede Kombination von seriell- oder paral
lel verschalteten Kondensatoren auszubilden, wie sie für den
Spannungsmultiplizierer erforderlich sind.
Ein weiteres Merkmal des Aufbaus nach Fig. 3 besteht darin, daß
nur zwischen dem n⁺-Gebiet 42 und dem p⁻-Substrat 40 eine parasi
täre Kapazität auftritt. Diese ist auf das Erschöpfungsgebiet an
der Verbindung zwischen dem n⁺-Gebiet 42 und dem p⁻-Substrat 40
zurückzuführen. Somit ist die parasitäre Kapazität minimiert.
Nach einem anderen Ausführungsbeispiel der Erfindung kann das n⁺-
Gebiet 42 eliminiert werden, so daß die erste Polysilizium-Schicht
48 als untere Platte eines ersten Kondensators fungiert. In diesem
Fall ist eine zusätzliche, dritte Polysilizium-Schicht erforder
lich, um zwei geschichtete Kondensatoren auszubilden. Auf diese
Weise sind parasitäre Kapazitäten eliminert.
Nach einer weiteren Ausführungsform der Erfindung können die
Polysilizium-Schichten 48 oder 50 zusätzlich als Feldabschirmung
verwendet werden, indem sie so erstreckt werden, daß sie ein
entfernt liegendes Gebiet von diesem isoliert überdecken, um das
diffundierte Gebiet von externen elektrischen Feldern abzuschir
men, welche von Spannungen durch nahe an dem entfernten diffun
dierten Gebiet angeordnete Verbindungsleitungen hervorgerufen
werden.
Ein beispielhaftes Verfahren zum Ausbilden des geschichteten Kon
densatoraufbaus nach Fig. 3 ist in den Fig. 4 bis 6 gezeigt.
Gemäß Fig. 4 weist das p⁻-Substrat 40 durch Diffusion oder Im
plantierung erzeugte n⁻-Typ-Verunreinigungen, wie etwa Arsen oder
Phosphor auf und bildet das n⁺-Gebiet 42. Es kann jede Anzahl
bekannter Prozesse zum Maskieren, Ätzen und Diffundieren oder
Implantieren verwendet werden. Die Verunreinigungskonzentration
in dem n⁺-Gebiet 42 beträgt nach einem Ausführungsbeispiel etwa
2E19/cm3, um die notwendige hohe Leitfähigkeit des n⁺-Gebiets 42
zu erreichen.
Gemäß Fig. 5 wird dann ein Gate-Oxyd 44 über dem n⁺-Gebiet 42
mit einer Dicke von etwa 200 bis 800 Å durch thermische Oxydation
oder andere bekannte Verfahren ausgebildet. Die Gate-Oxyd-Schicht
44 kann dieselbe Dicke wie ein Gate-Oxyd irgendwo auf dem Sub
strat zur Verwendung als Gate-Oxyd in einem MOS-Transistor haben.
Als nächstes wird die Nitrid-Schicht (Si3N4) 46 über dem Gate-
Oxyd 44 aufgebracht, wozu beispielsweise chemisches Niederdruck-
Aufdampfen (CVD) erfolgen kann, um die hohe dielektrische Stärke
und die hohe Kapazität zwischen einer nachfolgend ausgebildeten
Polysilizium-Schicht und dem n⁺-Gebiet 42 zu erreichen. Die Ni
trid-Schicht 46 kann zwischen 0 Å und 1000 Å dick sein, abhängig
von den gewünschten dielektrischen Eigenschaften.
Als nächstes wird die erste Polysilizium-Schicht 48 über der
Nitrid-Schicht 46 ausgebildet, wobei herkömmliche Verfahren ange
wendet werden. Die erste Polysilizium-Schicht 48 wird geätzt, um
die gewünschte effektive Kondensatorplattenfläche zu erhalten.
Danach kann sogenanntes Maskenätzen vorgenommen werden, um die
Nitrid-Schicht 46 unter Verwendung der Polysilizium-Schicht 48
als Maske zu ätzen.
Die erste Polysilizium-Schicht 48 muß eine ausreichend hohe Kon
zentration von Verunreinigungen aufweisen, damit sie hochleitend
ist. Die erste Polysilizium-Schicht 48 kann unter Verwendung
bekannter Techniken dotiert werden, entweder während sie aufge
bracht wird oder nachdem sie aufgebracht worden ist.
Gemäß Fig. 6 ist die Struktur nach Fig. 5 gewachsen. Über ihr
wird die Oxyd-Schicht 50 unter Verwendung beispielsweise von
thermaler Oxydation und über der Oxyd-Schicht 50 die Nitrid-
Schicht 52 unter Verwendung von beispielsweise eines Niederdruck-
CVD-Verfahrens aufgebracht. Die Dicken der Oxyd-Schicht 50 und
der Nitrid-Schicht 52 können sich von den Dicken des Gate-Oxyds
44 und der Nitrid-Schicht 46 unterscheiden, was von den ge
wünschten Charakteristika der dielektrischen Trennung der ersten
Polysilizium-Schicht 48 von der zweiten Polysilizium-Schicht 54
abhängt. Die zweite Polysilizium-Schicht 54 wird dann über der
Oberfläche des Wafer aufgebracht und geätzt, so daß sie die ge
wünschte effektive Kondensatorplattenfläche aufweist. Die zweite
Polysilizium-Schicht 54 wird unter Verwendung bekannter Techniken
so dotiert, daß sie eine große Verunreinigungskonzentration auf
weist. Die Oberfläche des Wafer wird dann unter Verwendung der
zweiten Polysilizium-Schicht 54 als Maske geätzt, um die Nitrid-
Schicht 52 zu entfernen, so daß nur noch unter der zweiten Poly
silizium-Schicht 54 Nitrid verbleibt. In einigen Fällen kann es
sachdienlich sein, Nitrid-Schicht 52 über der gesamten Wafer-
Fläche zu belassen, wobei jedoch Kontaktöffnungen durch diese
zusätzliche Schicht geätzt werden müssen.
Wie in Fig. 3 gezeigt, wird dann das Feldoxyd 56 über der Wafer
oberfläche unter Verwendung thermischer Oxydation ausgebildet und
es werden Kontaktöffnungen geätzt, um die gewünschten Kontakte zu
dem n⁺-Gebiet 42, der ersten Polysilizium-Schicht 48 und der
zweiten Polysilizium-Schicht 54 herzustellen. Unter Verwendung
eines standardisierten Metallisierungsverfahrens werden dann Elek
troden 58, 60 und 62 ausgebildet, welche die Kontaktöffnungen
füllen.
Nach einer anderen Ausführungsform der Erfindung bildet nur Sili
ziumnitrid oder Siliziumdioxyd das gesamte Dielektrikum
zwischen den Polysilizium-Schichten 48 und 54 und zwischen dem
n⁺-Gebiet 42 und der ersten Polysilizium-Schicht 48 in der Struk
tur nach Fig. 3.
Der erfindungsgemäße geschichtete Kondensator-Aufbau ist nicht
auf zwei Polysilizium-Schichten beschränkt, sondern kann insofern
ausgeweitet werden, daß er geschichtete Kondensatoren mit jed
weder Anzahl von Polysilizium-Schichten umfaßt. Wenn auch nur
Nitrid-auf-Oxyd gezeigt worden ist, können auch andere dielek
trische Werkstoffe, Zusammensetzungen oder Schichtungen verwendet
werden, die die gewünschten Eigenschaften aufweisen.
Veränderungen und Modifizierungen der in den Zeichnungen darge
stellten und in der vorstehenden Beschreibung erläuterten Ausfüh
rungsbeispiele können aus vielerlei Gründen von Fachleuten vorge
nommen werden, ohne daß dies den Rahmen des Erfindungsgedankens
verließe.
Die in der vorstehenden Beschreibung, den Ansprüchen sowie der
Zeichnung offenbarten Merkmale der Erfindung können sowohl einzeln
als auch in beliebiger Kombination für die Verwirklichung der
Erfindung in ihren verschiedenen Ausführungsformen wesentlich
sein.
Claims (15)
1. Kondensator, gekennzeichnet durch
- a) ein hochleitendes diffundiertes Gebiet (42) innerhalb eines Substrates (40), wobei das diffun dierte Gebiet (42) und das Substrat (40) einander entgegengesetzter Leitungstypen sind;
- b) eine erste Isolationsschicht (44, 46) über dem diffundierten Gebiet (42);
- c) eine erste Schicht (48) aus hochleitendem Werk stoff über der ersten Isolationsschicht (44, 46);
- d) eine oder mehrere über der ersten Schicht (48) aus hochleitendem Werkstoff aufgebrachte Kombinations schicht(en) (50, 52, 54), die jeweils eine zweite Isolationsschicht (50, 52) mit einer darüberlie genden zweiten Schicht (54) aus hochleitendem Werkstoff umfaßt/umfassen; und
- e) Elektroden (58, 60, 62), welche das diffundierte Gebiet (42) , die erste Schicht (48) aus hoch leitendem Werkstoff bzw. die/jede zweite Schicht (54) aus hochleitendem Werkstoff der Kombinationsschicht(en) (50, 52, 54) kontaktieren, wobei die Elektroden (58, 60, 62) in dem Fall, daß mehrere Kombinationsschichten vorhanden sind, keine zweiten Schichten (54) aus hochleitendem Werkstoff miteinander verbinden.
2. Kondensator nach Anspruch 1, dadurch gekennzeichnet,
daß die erste Isolationsschicht (44, 46) eine Gate-
Oxyd-Schicht (44) und eine Siliziumnitrid-Schicht (46)
über der Gate-Oxyd-Schicht (44) umfaßt.
3. Kondensator nach Anspruch 1 oder 2, dadurch gekenn
zeichnet, daß die zweite Isolationsschicht (50, 52) der
Kombinationsschicht(en) (50, 52, 54) jeweils eine Oxyd-
Schicht (50) und eine über der Oxyd-Schicht (50) lie
gende Siliziumnitrid-Schicht (52) umfaßt.
4. Kondensator nach einem der vorangehenden Ansprüche,
dadurch gekennzeichnet, daß die mindestens eine Isola
tionsschicht (44, 46; 50, 52) einen vielschichtigen Aufbau
in der Art von Oxyd/Nitrid/Oxyd aufweist.
5. Kondensator nach einem der vorangehenden Ansprüche,
dadurch gekennzeichnet, daß der hochleitende Werkstoff
dotiertes Polysilizium umfaßt.
6. Kondensator nach einem der Ansprüche 1 bis 4, dadurch
gekennzeichnet, daß der hochleitende Werkstoff Metall
umfaßt.
7. Kondensator nach einem der Ansprüche 1 bis 4, dadurch
gekennzeichnet, daß der hochleitende Werkstoff Polycid
(metallisiertes Polysilizium) umfaßt.
8. Monolytischer Spannungsmultiplizierer, gekennzeichnet
durch
- a) eine serielle Kombination geschichteter Kondensa toren mit jeweils einer oberen und einer unteren Kondensatorplatte, wobei die oberen und unteren Kondensatorplatten mit Elektroden (58, 60, 62) in Verbindung stehen; und
- b) Mittel zum Aufladen jedes Kondensators der seriellen Kombination geschichteter Kondensa toren auf eine Versorgungsspannung derart, daß die Spannung über der seriellen Kombination geschich teter Kondensatoren ein vielfaches der Versor gungsspannung beträgt,
wobei die serielle Kombination geschichteter Kondensatoren
folgendes umfaßt:
- c) ein hochleitendes diffundiertes Gebiet (42) inner halb eines Substrates (40), wobei das diffundier te Gebiet (42) und das Substrat (40) gegensätz licher Leitungstypen sind;
- d) eine erste Isolationsschicht (44, 46) über dem diffundierten Gebiet (42);
- e) eine erste Schicht (48) aus hochleitendem Werk stoff auf der ersten Isolationsschicht (44, 46); und
- f) mindestens eine Kombinationsschicht (50, 52, 54) auf der ersten Schicht (48) aus hochleitendem Werk stoff, wobei die Kombinationsschicht(en jeweils) eine zweite Isolationsschicht (50, 52) mit einer über dieser liegenden zweiten Schicht (54) aus hochleitendem Werkstoff umfaßt/umfassen und wobei die Elektroden (58, 60, 62) das diffundierte Gebiet (42), die erste Schicht (48) aus hochleitendem Werkstoff bzw. die zweite(n) Schicht(en) (54) aus hochleitendem Werkstoff in der/den Kombinations schicht(en) (50, 52, 54) kontaktieren;
- g) wobei die Elektroden (58, 60, 62) keine der unteren und oberen Kondensatorplatten miteinander verbin den.
9. Monolytischer Spannungsmultiplizierer, dadurch gekenn
zeichnet, daß er die Merkmale a) bis f) des monoly
tischen Spannungsmultiplizierers nach Anspruch 8 auf
weist und dadurch, daß die Elektroden (58, 60, 62) in
dem Fall, daß mehrere Kombinationsschichten (50, 52, 54)
vorgesehen sind, eine Kombination oberer und unterer
Kondensatorplatten miteinander verbinden, um die ge
wünschten Spannungsverhältnisse in dem Spannungsmulti
plizierer zu erzeugen.
10. Monolytischer Spannungsmultiplizierer, gekennzeichnet
durch
- a) eine serielle Kombination geschichteter Kondensa toren mit jeweils einer oberen und einer unteren Kondensatorplatte, wobei die oberen und unteren Kondensatorplatten jeweils mit einer Elektrode (58, 60, 62) in Verbindung stehen und die Elektroden keine der oberen und unteren Kondensatorplatten miteinander verbinden; und
- b) Mittel zum Aufladen der Kondensatoren der seri ellen Kombination geschichteter Kondensatoren auf eine Versorgungsspannung derart, daß die Spannung über der seriellen Kombination der ge schichtenen Kondensatoren ein Vielfaches der Versorgungsspannung beträgt,
wobei die serielle Kombination der beschichteten Kondensa
toren folgendes umfaßt:
- c) ein Substrat (40);
- d) eine erste Isolationsschicht (44, 46) auf dem Substrat (40);
- e) eine erste Schicht (48) aus hochleitendem Werk stoff auf der ersten Isolationsschicht (44, 46); und
- f) mehrere Kombinationsschichten (50, 52, 54) über der ersten Schicht (48) aus hochleitendem Werkstoff, wobei jede der Kombinationsschichten (50, 52, 54) eine Isolationsschicht (50, 52) und eine darüber liegende zweite Schicht (54) aus hochleitendem Werkstoff umfaßt und wobei die Elektroden (58, 60, 62) die erste Schicht (48) aus hochleiten dem Werkstoff und jede zweite Schicht (54) aus hochleitendem Werkstoff innerhalb der Kombina tionsschichten (50, 52, 54) kontaktieren.
11. Spannungsmultiplizierer nach einem der Ansprüche 8 bis
10, dadurch gekennzeichnet, daß der hochleitende Werk
stoff dotiertes Polysilizium umfaßt.
12. Spannungsmultiplizierer nach einem der Ansprüche 8 bis
10, dadurch gekennzeichnet, daß der hochleitende Werk
stoff ein Metall umfaßt.
13. Spannungsmultiplizierer nach einem der Ansprüche 8 bis
10, dadurch gekennzeichnet, daß der hochleitende Werk
stoff Polycid (metallisiertes Polysilizium) umfaßt.
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US07/306,375 US4914546A (en) | 1989-02-03 | 1989-02-03 | Stacked multi-polysilicon layer capacitor |
Publications (1)
Publication Number | Publication Date |
---|---|
DE4002037A1 true DE4002037A1 (de) | 1990-08-09 |
Family
ID=23185013
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE4002037A Withdrawn DE4002037A1 (de) | 1989-02-03 | 1990-01-24 | Kondensator und spannungsmultiplizierer unter verwendung des kondensators |
Country Status (3)
Country | Link |
---|---|
US (1) | US4914546A (de) |
JP (1) | JP2826149B2 (de) |
DE (1) | DE4002037A1 (de) |
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1989
- 1989-02-03 US US07/306,375 patent/US4914546A/en not_active Expired - Lifetime
-
1990
- 1990-01-24 DE DE4002037A patent/DE4002037A1/de not_active Withdrawn
- 1990-02-02 JP JP2024308A patent/JP2826149B2/ja not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
JPH02246261A (ja) | 1990-10-02 |
JP2826149B2 (ja) | 1998-11-18 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
8110 | Request for examination paragraph 44 | ||
8130 | Withdrawal |