DE3147535A1 - Verfahren zum herstellen einer halbleitervorrichtung - Google Patents
Verfahren zum herstellen einer halbleitervorrichtungInfo
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ILUMBÄCH · WESER · BERGEN · KRAMER
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VERFAHREN ZUM HERSTELLEN EINER HALBLEITERVORRICHTUNG
Die Erfindung bezieht sich auf ein Verfahren gemäß dem Oberbegriff
des Anspruchs 1.
Herkömmliehe Haibleitervorrichtungen mit einem pn-übergang
lassen sich nach einem anhand von Fig. 1 veranschaulichten
Verfahren herstellen. Wie hieraus hervorgeht, wird ein Schiffchen mit einer Anzahl von darauf befestigten, n-leitenden
Halbleitersubstraten 1 in eine Diffusionskammer 3
eingesetzt. In der Diffusionskammer 3 befindet sich ferner
eine Gallium- oder Gallium-Germanium-Diffusionquelle 4, damit
in der geschlossenen Kammer 3 eine abgekapselte Diffusion
unter Bildung einer Gallium-dotierten, p-leitenden Zone
in jedem Halbleitersubstrat 1 erfolgt.
Bei diesem Herstellungsverfahren für die Halbleitervorrichtung
muß die in das Halbleitersubstrat 1 diffundierte
(GaI 1 i urrO-Dot i erstof fmenge aufgrund des Gewichtes der Diffusionsquelle
^ gesteuert werden. Bei dieser Steuerung ist es jedoch schwierig, p-Zonen mit gewünschtem Schichtwiderstand
und Übergangstiefe zu erzielen. Ferner treten von einer
Charge zur anderen Charge der Diffusionskammer 3 Eigenschaftsänderungen der p-Zonen auf. Ein weiteres, in der japanischen
Patentschrift 763 613 vorgeschlagenes Verfahren geht dahin,
eine Dotierungszone dadurch zu bilden, daß mittels der Ionenimplantationsmethode
ein Dotierstoff in das Halbleitersubstrat
München: R. Kramer Dipl.-Ing. . W. Weser Dipl.-Phys. Dr. rer. nat. · E. Hoffmann Dipl.-Ing.
Wiesbaden: P. G. Blumbach Dipl.-Ing. · P. Bergen Prof. Dr.jur. Dipl.-Ing., Pat.-Ass., Pat.-Anw.bis 1979 - G. Zwirner Dipl.-Ing. Dip!.-W.-Ing.
implantiert wird, und zwar nicht in einem geschlossenen Behandlungsraum,
sondern in einer offenatmosphärischen Umgebung.
Falls bei diesem Verfahren als Dotierstoff Gallium
vorgesehen wird, diffundieren jedoch die implantierten Galliumionen
auf die Außenseite des Halbleitersubstrates und einer
darauf aufgebrachten Schutzschicht, so daß sich die Herstellung
der gewünschten Dotierungszqne als schwierig darstellt.
Die Aufgabe der Erfindung besteht darin, ein Verfahren zum Herstellen einer Halbleitervorrichtung zu schaffen, bei welchem
sich eine Dotierungszone mit gewünschtem Schichtwiderstand
und gewünschter Übergangstiefe bei ausgezeichneter Reproduzierbarkeit
und Steuerbarkeit in einem Halbleiter—
substrat herstellen läßt.
Diese Aufgabe wird erfindungsgemäß durch die kennzeichnenden
Merkmale des Anspruchs 1 gelöst.
Vorteilhafte Ausgestaltungen und Weiterbildungen des Vet—
fahrens nach Anspruch 1 ergeben sich aus den Unteransprüchen.
Die Erfindung wird anhand der Zeichnungen näher erläutert. Es zeigt:
Fig. 1 eine schematische Darstellung eines herkömmlichen
Verfahrens zum Herstellen einer Halbleitervorrichtung;
Fign. 2A Querschnitte durch die bei den einzelnen Schritten IS des erfindungsgemäßen Verfahrens hergestellten
Körper, und
Fig. 3 eine graphische Darstellung zur Veranschaulichung
der statistischen Verteilung der Träger 1ebensdauer
in der Dotierungszone.
3H7535
Ein Ausführungsbeispiel des erfindungsgemäßen Verfahrens
soll nunmehr anhand der Fign. 2A bis 2C erläutert werden.
Wie aus Flg. 2A hervorgeht, wird auf der gesamten Oberfläche eines η-leitenden Silizium-Halbleitersubstrates 10
mit einem Planindex von 0,1,1) und einem Schichtwiderstand
von 50 Ohm · cm mittels thermischer Oxidation eine erste Dünnschicht 11 aus Siliziumdioxid in einer Dicke von etwa
1,5 [Jm aufgebracht. Anschließend wird auf der gesamten Ober—
fläche der ersten Dünnschicht 11 eine zweite Dünnschicht 12 aus Siliziumnitrid in einer Dicke von etwa 300 Angström
aufgebracht. Anstelle von Siliziumdioxid lassen sich für
die erste Dünnschicht 11 auch Si1iζiumoxiηitrid oder polykristallines
Silizium verwenden. Weiterhin kann anstelle von Siliziumnitrid als Material für die zweite Dünnschicht 12
auch Aluminiumoxid, Siliziumkarbid oder Si1iζiumoxiηitrid
vorgesehen werden. Die zweite Dünnschicht 12 dient zur Vet—
hinderung einer "Ausdiffusion" des Dotierstoffes, welcher
im anschließenden Verfahrensschritt mittels Ionenimplantation
implantiert wird. Die Dicke der zweiten Dünnschicht 12 liegt vorzugsweise bei 50 Angström oder derüber.
Im nächsten Verfahrensschritt wird, wie aus Fig. 2B hervor—
geht, ein Dotierstoff, wie beispielsweise Gallium, über die
zweite Dünnschicht 12 in die erste Dünnschicht 11 mittels Ionenimplantation bei einer Beschleunigungsspannung von 50 keV
1 4
und einer Dosis von 5 · 10 Ionen/cm2 eingebracht. Unter dieser Ionenimplatantionsbedingung sind mehr als 99 % der Galliumionen in der ersten Dünnschicht 11 und/oder der zweiten Dünnschicht 12 vorhanden, wenn man hierfür die sogenannte LSS-Theorie zugrunde legt. Gemäß dieser Theorie bestimmt sich die Verteilung der in einen Gegenstand zu implantierenden Impl ant i erungs ionen aufgrund des Leitungstyps des implantierten Elementes, der Beschleunigungsspannung für die Ionenimplan-
und einer Dosis von 5 · 10 Ionen/cm2 eingebracht. Unter dieser Ionenimplatantionsbedingung sind mehr als 99 % der Galliumionen in der ersten Dünnschicht 11 und/oder der zweiten Dünnschicht 12 vorhanden, wenn man hierfür die sogenannte LSS-Theorie zugrunde legt. Gemäß dieser Theorie bestimmt sich die Verteilung der in einen Gegenstand zu implantierenden Impl ant i erungs ionen aufgrund des Leitungstyps des implantierten Elementes, der Beschleunigungsspannung für die Ionenimplan-
tation und der Art des für die Implantierung vorgesehenen
Gegenstandes.
In einem weiteren Verfahrensschritt wird, wie anhand von
Fig. 2C veranschaulicht ist, der gesamte, bis dahin hergestelle
Körper beispielsweise in einer Stickstoffatmosphäre
bei 1200 C getempert, um eine Diffusion der implantierten
Galliumionen aus der ersten Dünnschicht 11 in das Halbleitersubstrat
10 zu erzielen. Auf diese Weise läßt sich eine Halbleitervorrichtung 14 herstellen, deren p-leitende Dotierungszone
13 einen Schichtwiderstand von etwa 80 Ohm/cm2 und eine Übergangstiefe von etwa 30 Um im Halbleitersubstrat
10 aufwei st.
Bei dem vorstehend betrachteten Ausführungsbeispiel werdenals
Dotierstoffe für die ionenimplantation Gallium-Ionen verwendet.
Anstelle von Gallium-Ionen lassen sich ebensogut auch
Aluminium-Ionen verwenden.
Die erste Dünnschicht 11 besitzt nach ihrer Ausbildung auf der Oberfläche des Halbleitersubstrates 10 einen Diffusionskoeffizienten, welcher größer als der Diffusionskoeffizient
des Substrates 10 ist. Die auf der ersten Dünnschicht 11 aufgebrachte zweite Dünnschicht 12 besitzt einen Diffusionskoeffizienten, welcher kleiner als der Diffusionskoeffizient
der ersten Dünnschicht 11 in der erwähnten Größenordnung ist. Infolge dieser Festlegung der Diffusionskoeffizienten läßt
sich bei der Ionenimplantation des gewünschten Dotierstoffes
in das Halbleitersubstrat 10 über die Dünnschichten 11 und
12 das Ausdiffundieren der implantierten Ionen speziell in
der zweiten Dünnschicht 12 verhindern, mit dem Ergebnis, daß die implantierten Ionen in die erste Dünnschicht 11 oder
das Halbleitersubstrat 10 diffundiert werden. Da ferner der
diffundierte Dotierstoff in der ersten Dünnschicht 11 oder
dem Halbleitersubstrat 10 infolge der Temperung auf eine
vorbestimmte Tiefe diffundiert wird, läßt sich die Dotierungszone 13 mit einer vorbestimmten Übergangstiefe auch einfache
Weise ausbilden. Zusätzlich hierzu kann die Dosis der zu implantierenden Ionen genau festgelegt werden, wobei die Ober—
fläche der zweiten Dünnschicht 12 nicht einer Atmosphäre ausgesetzt wird, welche den Dotierstoff in hohen Konzentrationen
wie bei dem herkömmlichen Verfahren enthält. Infolge
dessen läßt sich die Dotierstoffkonzentrat ion an der Oberfläche
der zweiten Dünnschicht 12 nach der Temperung auf einem extrem niedrigen Wert halten. Damit läßt sich auch die
Bildung von Gitterfehlstellen in der Dotierungszone 13 vet—
meiden, mit dem weiteren Erfolg, daß die Träger 1ebensdauer in der Dotierungszone 13 erhöht und die Eigenschaften und Zuverlässigkeit
der gesamten Halbleitervorrichtung verbessert
werden.
Im Ergebnis läßt sich die Dotierungszone 13 in dem Halbleitersubstrat
10 auf einfache Weise mit dem gewünschten Schichtwiderstand und der gewünschten Übergangstiefe bei guter Reproduzierbarkeit
und Steuerbarkeit herstellen.
Der dargelegte technische Fortschritt läßt sich beispielhaft
daran aufzeigen, daß die Träger lebensdauer bei einem Halbleitersubstrat 10 mit einer erfindungsgemäß hergestellten
Dotierungszone und die Trägerlebensdauer eines Halbleiter—
substrates mit einer nach einem herkömmlichen, in Fig. 1 dar—
gestellten Verfahren hergestel 1 ten Dotierungszone miteinander
verglichen werden. Die dabei gewonnenen Ergebnisse sind in dem Diagramm nach Fig. 3 veranschaulicht. Wie hieraus hervorgeht,
repräsentiert das Symbol CO die Trägerlebensdauerverteilung
bei einer nach dem erfindungsgemäßen Verfahren.hergestel1 ten
Dotierungszone, wohingegen das Symbol ClO die Trägerlebensdauerverteilung
in einer nach dem herkömmlichen Verfahren
hergestellten Dotierungszone repräsentiert. Der Schichtwiderstand
der erfindungsgemäß hergestellten Dotierungszone 13
betrug 150 Ohm/cm2, während die Übergangstiefe ^O (im betrug.
Claims (3)
- PATENTANSPRÜCHEVerfahren zum Herstellen einer Halbleitervorrichtung, gekennzeichnet durch folgende Verfahrensschritte:a) Auf der gesamten Oberfläche eines Halbleitersubstrates (10) eines ersten Leitungstyps wird eine erste Dünnschicht (11) ausgebildet, deren Diffusionskoeffizient größer als der Diffusionskoeffizient des Halbleitersubstrates (10) ist;b) auf der gesamten Oberfläche der ersten Dünnschicht (11) wird eine zweite Dünnschicht (12) ausgebildet, deren Diffusionskoeffizient kleiner als der Diffusionskoeffizient der ersten Dünnschicht (11) ist;c) durch die zweite Dünnschicht (12) wird mittels Ionenimplantation ein Dotierstoff in die erste Dünnschicht (11) unter Bildung einer Dotierungszone eingebracht, wobei der Dotierstoff einen gegenüber dem Substrat (10) entgegengesetzten Leitungstyp besitzt, undd) der so gebildete Körper wird getempert, derart, daß die Tiefe des pn-Übergangs der Dotierungszone einen vorbestimmten Wert erreicht.
- 2. Verfahren nach Anspruch 1, dadurch gekennzeichnet, daß die erste Dünnschicht C1O aus einer S Π izi umd iox idschicht, einer Si1iziumoxinitridschicht und einer polykristallinen Siliziumschicht besteht und daß die zweite Dünnschicht C12) aus einer eine Siliziumnitridschicht, eine Aluminiumoxidschicht, eine Siliziumkarbidschicht und eine Si1iziumoxinitridschicht umfassende Schichtengruppe ausgewählt ist.
- 3. Verfahren nach Anspruch 1 oder 2, dadurch gekennzeichnet, daß als Dotierstoff Gallium oder Aluminium vorgesehen ist.
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Families Citing this family (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4804634A (en) * | 1981-04-24 | 1989-02-14 | National Semiconductor Corporation | Integrated circuit lateral transistor structure |
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JPS5935425A (ja) * | 1982-08-23 | 1984-02-27 | Toshiba Corp | 半導体装置の製造方法 |
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JPS6427458A (en) * | 1987-07-22 | 1989-01-30 | Cubic Eng Kk | Healthy drink |
US6352940B1 (en) * | 1998-06-26 | 2002-03-05 | Intel Corporation | Semiconductor passivation deposition process for interfacial adhesion |
Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS513613A (en) * | 1974-06-05 | 1976-01-13 | Idn Invention Dev Novelties | Teepukasetsutooyobi sonoruijibutsunotameno horudaa |
JPS5272162A (en) * | 1975-12-12 | 1977-06-16 | Toshiba Corp | Production of semiconductor device |
JPS55128828A (en) * | 1979-03-28 | 1980-10-06 | Matsushita Electronics Corp | Manufacture of semiconductor device |
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1980
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- 1981-12-01 DE DE19813147535 patent/DE3147535A1/de active Granted
- 1981-12-03 US US06/327,190 patent/US4426234A/en not_active Expired - Lifetime
Patent Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS513613A (en) * | 1974-06-05 | 1976-01-13 | Idn Invention Dev Novelties | Teepukasetsutooyobi sonoruijibutsunotameno horudaa |
JPS5272162A (en) * | 1975-12-12 | 1977-06-16 | Toshiba Corp | Production of semiconductor device |
JPS55128828A (en) * | 1979-03-28 | 1980-10-06 | Matsushita Electronics Corp | Manufacture of semiconductor device |
Non-Patent Citations (7)
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---|
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JP 55-128 828 A in: Patents Abstr. of Japan, Bd. 4, Nr. 185, 1980, E-38 |
Patents Abstr of Japan & JP 52-072162 A * |
Patents Abstr. of Japan, Bd. 4, Nr. 185, 1980, E-38 & JP 55-128 828 A * |
US-Z.: J. Appl. Phys., Bd. 48, Nr. 5, 1977, S. 1815-1821 * |
US-Z.: Solid-State Electronics, Bd. 18, Nr. 12-D, 1975, S. 1085-1088 * |
US-Z.: Solid-State Eletronics, Bd. 20, Nr. 3-D, 1977, S. 213-217 * |
Also Published As
Publication number | Publication date |
---|---|
JPS5795625A (en) | 1982-06-14 |
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DE3147535C2 (de) | 1988-07-28 |
US4426234A (en) | 1984-01-17 |
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