DE1166938B - Verfahren zur Herstellung einer Halbleiteranordnung - Google Patents
Verfahren zur Herstellung einer HalbleiteranordnungInfo
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- 239000004065 semiconductor Substances 0.000 title claims description 55
- 238000000034 method Methods 0.000 title claims description 29
- 238000004519 manufacturing process Methods 0.000 title claims description 7
- 229910045601 alloy Inorganic materials 0.000 claims description 38
- 239000000956 alloy Substances 0.000 claims description 38
- 229910052732 germanium Inorganic materials 0.000 claims description 35
- GNPVGFCGXDBREM-UHFFFAOYSA-N germanium atom Chemical compound [Ge] GNPVGFCGXDBREM-UHFFFAOYSA-N 0.000 claims description 34
- 229910052710 silicon Inorganic materials 0.000 claims description 26
- 239000010703 silicon Substances 0.000 claims description 26
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 claims description 24
- 239000000463 material Substances 0.000 claims description 22
- 238000002844 melting Methods 0.000 claims description 19
- 230000008018 melting Effects 0.000 claims description 18
- LEVVHYCKPQWKOP-UHFFFAOYSA-N [Si].[Ge] Chemical compound [Si].[Ge] LEVVHYCKPQWKOP-UHFFFAOYSA-N 0.000 claims description 12
- 238000000151 deposition Methods 0.000 claims description 10
- 229910000676 Si alloy Inorganic materials 0.000 claims description 8
- 239000007789 gas Substances 0.000 claims description 7
- 238000010438 heat treatment Methods 0.000 claims description 7
- 239000000203 mixture Substances 0.000 claims description 7
- 238000005275 alloying Methods 0.000 claims description 6
- 238000005496 tempering Methods 0.000 claims description 6
- 230000008021 deposition Effects 0.000 claims description 5
- 238000001556 precipitation Methods 0.000 claims description 4
- 239000012495 reaction gas Substances 0.000 claims description 3
- 239000000126 substance Substances 0.000 claims description 3
- 238000005979 thermal decomposition reaction Methods 0.000 claims description 3
- 150000001875 compounds Chemical class 0.000 claims description 2
- 239000002019 doping agent Substances 0.000 claims 1
- 239000010410 layer Substances 0.000 description 59
- 230000015572 biosynthetic process Effects 0.000 description 7
- 239000013078 crystal Substances 0.000 description 6
- UFHFLCQGNIYNRP-UHFFFAOYSA-N Hydrogen Chemical compound [H][H] UFHFLCQGNIYNRP-UHFFFAOYSA-N 0.000 description 5
- 239000000969 carrier Substances 0.000 description 5
- 239000001257 hydrogen Substances 0.000 description 5
- 229910052739 hydrogen Inorganic materials 0.000 description 5
- 239000002800 charge carrier Substances 0.000 description 4
- 229910000577 Silicon-germanium Inorganic materials 0.000 description 3
- 239000012535 impurity Substances 0.000 description 3
- 238000002347 injection Methods 0.000 description 3
- 239000007924 injection Substances 0.000 description 3
- 229910021421 monocrystalline silicon Inorganic materials 0.000 description 3
- -1 silicon halide Chemical class 0.000 description 3
- 239000000758 substrate Substances 0.000 description 3
- KRHYYFGTRYWZRS-UHFFFAOYSA-N Fluorane Chemical compound F KRHYYFGTRYWZRS-UHFFFAOYSA-N 0.000 description 2
- 230000004913 activation Effects 0.000 description 2
- 229910002056 binary alloy Inorganic materials 0.000 description 2
- 238000006243 chemical reaction Methods 0.000 description 2
- 238000005530 etching Methods 0.000 description 2
- PCHJSUWPFVWCPO-UHFFFAOYSA-N gold Chemical compound [Au] PCHJSUWPFVWCPO-UHFFFAOYSA-N 0.000 description 2
- 239000011541 reaction mixture Substances 0.000 description 2
- 238000007711 solidification Methods 0.000 description 2
- 230000008023 solidification Effects 0.000 description 2
- IEXRMSFAVATTJX-UHFFFAOYSA-N tetrachlorogermane Chemical compound Cl[Ge](Cl)(Cl)Cl IEXRMSFAVATTJX-UHFFFAOYSA-N 0.000 description 2
- 235000012431 wafers Nutrition 0.000 description 2
- VXEGSRKPIUDPQT-UHFFFAOYSA-N 4-[4-(4-methoxyphenyl)piperazin-1-yl]aniline Chemical compound C1=CC(OC)=CC=C1N1CCN(C=2C=CC(N)=CC=2)CC1 VXEGSRKPIUDPQT-UHFFFAOYSA-N 0.000 description 1
- ZOXJGFHDIHLPTG-UHFFFAOYSA-N Boron Chemical compound [B] ZOXJGFHDIHLPTG-UHFFFAOYSA-N 0.000 description 1
- GRYLNZFGIOXLOG-UHFFFAOYSA-N Nitric acid Chemical compound O[N+]([O-])=O GRYLNZFGIOXLOG-UHFFFAOYSA-N 0.000 description 1
- 229910001295 No alloy Inorganic materials 0.000 description 1
- 229910001245 Sb alloy Inorganic materials 0.000 description 1
- KAPYVWKEUSXLKC-UHFFFAOYSA-N [Sb].[Au] Chemical compound [Sb].[Au] KAPYVWKEUSXLKC-UHFFFAOYSA-N 0.000 description 1
- 239000000654 additive Substances 0.000 description 1
- 230000000996 additive effect Effects 0.000 description 1
- 229910052782 aluminium Inorganic materials 0.000 description 1
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 description 1
- 229910052787 antimony Inorganic materials 0.000 description 1
- 239000002140 antimony alloy Substances 0.000 description 1
- WATWJIUSRGPENY-UHFFFAOYSA-N antimony atom Chemical compound [Sb] WATWJIUSRGPENY-UHFFFAOYSA-N 0.000 description 1
- 230000000903 blocking effect Effects 0.000 description 1
- 229910052796 boron Inorganic materials 0.000 description 1
- DKOJHZHTCQNTQJ-UHFFFAOYSA-N chloroform;germanium Chemical compound [Ge].ClC(Cl)Cl DKOJHZHTCQNTQJ-UHFFFAOYSA-N 0.000 description 1
- RTCGUJFWSLMVSH-UHFFFAOYSA-N chloroform;silicon Chemical compound [Si].ClC(Cl)Cl RTCGUJFWSLMVSH-UHFFFAOYSA-N 0.000 description 1
- 239000003245 coal Substances 0.000 description 1
- 239000011248 coating agent Substances 0.000 description 1
- 238000000576 coating method Methods 0.000 description 1
- 239000004020 conductor Substances 0.000 description 1
- 238000010586 diagram Methods 0.000 description 1
- 230000005611 electricity Effects 0.000 description 1
- 150000002291 germanium compounds Chemical class 0.000 description 1
- 239000010931 gold Substances 0.000 description 1
- 229910052737 gold Inorganic materials 0.000 description 1
- 238000010348 incorporation Methods 0.000 description 1
- 239000011229 interlayer Substances 0.000 description 1
- 229910052751 metal Inorganic materials 0.000 description 1
- 239000002184 metal Substances 0.000 description 1
- 229910017604 nitric acid Inorganic materials 0.000 description 1
- 230000035515 penetration Effects 0.000 description 1
- 239000006187 pill Substances 0.000 description 1
- 239000010453 quartz Substances 0.000 description 1
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N silicon dioxide Inorganic materials O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 1
- 239000005049 silicon tetrachloride Substances 0.000 description 1
- 239000000243 solution Substances 0.000 description 1
- 230000007704 transition Effects 0.000 description 1
- 238000002604 ultrasonography Methods 0.000 description 1
- 238000009736 wetting Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02104—Forming layers
- H01L21/02365—Forming inorganic semiconducting materials on a substrate
- H01L21/02518—Deposited layers
- H01L21/02521—Materials
- H01L21/02524—Group 14 semiconducting materials
- H01L21/02532—Silicon, silicon germanium, germanium
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02104—Forming layers
- H01L21/02365—Forming inorganic semiconducting materials on a substrate
- H01L21/02367—Substrates
- H01L21/0237—Materials
- H01L21/02373—Group 14 semiconducting materials
- H01L21/02381—Silicon, silicon germanium, germanium
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02104—Forming layers
- H01L21/02365—Forming inorganic semiconducting materials on a substrate
- H01L21/02436—Intermediate layers between substrates and deposited layers
- H01L21/02439—Materials
- H01L21/02441—Group 14 semiconducting materials
- H01L21/0245—Silicon, silicon germanium, germanium
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02104—Forming layers
- H01L21/02365—Forming inorganic semiconducting materials on a substrate
- H01L21/02518—Deposited layers
- H01L21/0257—Doping during depositing
- H01L21/02573—Conductivity type
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02104—Forming layers
- H01L21/02365—Forming inorganic semiconducting materials on a substrate
- H01L21/02612—Formation types
- H01L21/02617—Deposition types
- H01L21/0262—Reduction or decomposition of gaseous compounds, e.g. CVD
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/185—Joining of semiconductor bodies for junction formation
-
- H—ELECTRICITY
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
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- Engineering & Computer Science (AREA)
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- Physics & Mathematics (AREA)
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- Bipolar Transistors (AREA)
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Description
BUNDESREPUBLIK DEUTSCHLAND
DEUTSCHES
PATENTAMT
AUSLEGESCHRIFT
Internat. KL: HOIl
Deutsche KL: 21g-11/02
Nummer: 1 166 938
Aktenzeichen: S 69202 VIII c / 21 g
Anmeldetag: 1. Juli 1960
Auslegetag: 2. April 1964
Die Erfindung betrifft ein Verfahren zum Herstellen einer Halbleiteranordnung mit wenigstens
einer aus einer Legierung zweier Halbleitermaterialien bestehenden einkristallinen Halbleiterschicht.
Zur Lösung dieser Aufgabe wird bei dem Verfahren nach der Erfindung auf einem aus dem Halbleitermaterial
höheren Schmelzpunktes bestehenden, gleichmäßig erhitzten, einkristallinen Träger durch thermisches
Zersetzen einer gasförmigen Verbindung des Halbleitermaterials niedrigeren Schmelzpunktes eine
Schicht dieses Halbleitermaterials niedergeschlagen, gleichzeitig oder danach wird der Träger auf eine für
die gewünschte Legierungszusammensetzung erforderliche Temperatur erhitzt, anschließend die Temperatur
des Trägers auf eine unterhalb des Schmelzpunktes der gebildeten Legierung liegende Temperatur
abgesenkt und die Legierung getempert, und dann wird auf der einkristallinen Legierungsschicht
wenigstens eine weitere Halbleiterschicht abgeschieden.
Es ist bereits bekannt, auf einem aus Germanium bzw. Silizium bestehenden Halbleiterkörper eine aus
Germanium bzw. Silizium bestehende Schicht, die durch thermische Zersetzung eines gasförmigen Germanium-
bzw. Siliziumhalogenids gewonnen wird, niederzuschlagen. Auf diese Weise können Germaniumkörper,
die eine Folge von Schichten unterschiedlichen Leitungstyps oder unterschiedlicher Leitfähigkeit
aufweisen, bzw. Körper, die aus Silizium bestehen und eine solche Schichtenfolge aufweisen, hergestellt
werden. Demgegenüber wird bei dem vorliegenden Verfahren ein Träger verwendet, der aus
einem von dem abzuscheidenden Halbleiterstoff verschiedenen Halbleitermaterial besteht. Darüber hinaus
wird gleichzeitig oder nach dem Niederschlagen der halbleitenden Schicht aus dem Halbleiterstoff
niedrigeren Schmelzpunktes auf einem als Träger dienenden Halbleiterkörper höheren Schmelzpunktes,
die Temperatur dieses Trägers so eingestellt, daß eine Legierungsbildung zwischen den beiden Halbleiterstoffen
erfolgt, und dann wird durch eine spezielle Temperaturführung vom Träger her die für die
Einkristallbildung und das Niederschlagen einer oder mehrerer halbleitender Schichten notwendige Wärme
zugeführt.
Weiter ist ein Verfahren zum Herstellen von Halbleiteranordnungen bekannt, bei dem zwei aus Silizium
verschiedener Leitfähigkeit und/oder verschiedenen Leitungstyps bestehende Halbleiterkörper mit
einer Schicht aus Germanium überzogen werden und durch Erwärmen auf eine zwischen dem
Schmelzpunkt von Germanium und Silizium liegende Verfahren zur Herstellung einer
Halbleiteranordnung
Halbleiteranordnung
Anmelder:
Siemens & Halske Aktiengesellschaft,
Berlin und München,
München 2, Witteisbacherplatz 2
Als Erfinder benannt:
Dipl.-Phys. Dr. Josef Grabmaier,
Dr. Theodor Rummel, München
Dipl.-Phys. Dr. Josef Grabmaier,
Dr. Theodor Rummel, München
Temperatur zusammenlegiert werden. Das bekannte Verfahren dient dazu, zwei Halbleiterkörper miteinander
zu verbinden, wobei die Schichtenfolge der hergestellten Halbleiteranordnung durch die Wahl
so der zu verschweißenden Scheiben bestimmt ist, also
nur diese Scheiben, die einzelne Zonen der Halbleiteranordnung darstellen. Demgegenüber ist es die
der vorliegenden Erfindung zugrunde liegende Aufgabe, eine Halbleiteranordnung herzustellen, die
as wenigstens eine einkristalline, aus der Legierung
zweier Halbleiterstoffe bestehende Schicht aufweist. Dabei ist es wesentlich, daß ein ebener Übergang
zwischen der Legierungsschicht und der an diese angrenzende weitere Halbleiterschicht erreicht wird.
Um dies zu gewährleisten, ist es bei dem bekannten Verfahren notwendig, beide Siliziumkörper an ihrer
Oberfläche mit einem Überzug aus dem niederschmelzenden Halbleiterstoff zu versehen, da sonst
beim Erwärmen keine gleichmäßige Benetzung des Siliziumkörpers durch das Germanium und damit
auch kein gleichmäßiges Eindringen der Legierungsfront erfolgt. Demgegenüber ist das Verfahren gemäß
der Erfindung, bei dem auf der einkristallinen Legierungsschicht wenigstens eine weitere, gegebenen-
do falls dotierte Halbleiterschicht aus der Gasphase abgeschieden
wird, wesentlich vereinfacht, da das Überziehen eines zweiten Halbleiterkörpers entfällt
und trotzdem ebene pn-Übergänge erhalten werden. Beim Verfahren gemäß der Erfindung wird außerdem
die Temperatur der Schicht vom Träger her eingestellt. Dadurch ist eine definierte Regelung
dieser Temperatur möglich.
Die weitere Halbleiterschicht, die sich an die Legierungsschicht anschließt, wird bei einer Ausführungsform
des Verfahrens gemäß der Erfindung anschließend an die Temperung unter weiterer Absenkung
der Temperatur des Trägers abgeschieden.
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Es können natürlich auch abwechselnd mehrere Legierungsschichten und p-, n- oder eigenleitende
Halbleiterschichten, die nur aus einem Halbleiterstoff bestehen, niedergeschlagen werden.
Die einzelnen Schichten können dabei z. B. während des Niederschiagens aus der Gasphase in gewünschter
Weise dotiert werden. Die Legierungsschicht wird zweckmäßig während des Legierungsvorgangs durch die im Träger und/oder in der auf
diesem niedergeschlagenen Schicht enthaltenen Stoffe dotiert.
Das Verfahren gemäß der Erfindung ist besonders dann mit Vorteil anwendbar, wenn in das Gitter
eines Halbleiters kleinen Bandabstandes ein Halbleiter großen Bandabstandes eingebaut und dadurch
eine Aufweitung des Bandabstandes im ersten Halbleitermaterial erzielt werden soll.
Bei einem in Flußrichtung gepolten Emitter-pn-Übergang setzt sich der Gesamtstrom am pn-übergang
zwischen Emitter- und Basiszone aus Minoritätsträgern, die vom Emitter in die Basiszone, und
aus Minoritätsträgern, die von der Basiszone in die Emitterzone injiziert werden, also aus Ladungsträgern
beiderlei Vorzeichens, zusammen. Die Stromverstärkung einer derartigen Halbleiteranordnung,
ζ. B. eines Transistors, ist der Emitterergiebigkeit, d. h. dem Verhältnis des Stroms, der von den vom
Emitter in die Basis injizierten Minoritätsträgern getragen wird, zum Gesamtstrom proportional. Um
einen großen Stromverstärkungsfaktor zu erzielen, ist es deshalb wichtig, daß das Verhältnis von den vom
Emitter in die Basis injizierten Minoritätsträgern zum gesamten Strom möglichst nahe 1 liegt bzw. daß der
sogenannte Injektionsverlust, das ist derjenige Anteil des Stroms, der von den von der Basis in den Emitter
injizierten Minoritätsträgern getragen wird, möglichst klein ist.
Es ist bereits bekannt, daß man den Injektionsverlust um mehrere Größenordnungen herabsetzen
kann, wenn man als Emitter einen Halbleiter verwendet, der einen größeren Bandabstand als der
Basishalbleiter hat. Die Aktivierungsenergie für Ladungsträger, die von der Basis in den Emitter injiziert
werden, ist dann größer als die Aktivierungsenergie für Ladungsträger, die vom Emitter in die
Basis fließen. Der Injektionsverlust wird dann proportional dem Faktor e~AEIkT herabgesetzt, wobei
JE die Differenz der Bandabstände des Emitter- und Basishalbleiters darstellt.
Halbleiter mit verschieden großem Bandabstand sind z. B. Silizium und Germanium. Zur näheren Erläuterung
der Erfindung wird im folgenden als Ausführungsbeispiel ein Verfahren beschrieben, das es
ermöglicht, Silizium über eine Silizium-Germanium-Legierung in das Germaniumgitter einzubauen und
dadurch eine Aufweitung des Bandabstandes im Germaniumkristall zu erzielen. Weiter wird im folgenden
die Herstellung eines Germaniumtransistors mit dem erfindungsgemäßen Verfahren beschrieben,
dessen Emitter aus einer Germanium-Silizium-Legierung besteht. Außerdem wird die Herstellung eines
Siliziumtransistors beschrieben, der aus zwei äußeren Schichten gleichen Leitungstyps und einer einkristallinen
Zwischenschicht aus einer Germanium-Silizium-Legierung entgegengesetzten Leitungstyps besteht.
In F i g. 1 ist eine Anordnung zur Durchführung
des Verfahrens dargestellt. In einem z. B. aus Quarz bestehenden Gefäß 2 befindet sich auf einer Unterlage
5 der Träger 6, z. B. ein einkristallines Siliziumscheibchen. Die Unterlage 5 besteht aus einem
Material, aus dem während des Verfahrens keine die Halbleitereigenschaften störenden Verunreinigungen
in den Trägerkörper eindiffundieren, also z. B. aus silizierter Kohle, oder aus hochreinem Halbleitermaterial,
ζ. B. ebenfalls aus Silizium. Im Ausführungsbeispiel wird die Erhitzung auf die jeweilige
Arbeitstemperatur induktiv durch eine Hochfrequenzspule 3 vorgenommen. Die Unterlage 5 kann aber
auch als Heizleiter dienen, der z. B. durch direkten Stromdurchgang erhitzt wird und die Wärme auf den
Träger 6 überträgt. Es kann auch der Träger mit Stromzuführungen versehen sein und durch direkten
Stromdurchgang erhitzt werden. Die Spule 3 kann dann z. B. auch zur Vorerwärmung dienen und als
Heizspule, wie sie zur Widerstandsheizung verwendet wird, ausgebildet sein. Die Oberfläche des einkristallinen
Trägers 6 muß hochrein sein. Deshalb wird vor Aufbringen des Trägers auf die Unterlage 5 dieser in
eine Ätzlösung, die z. B. konzentrierte Salpetersäure und konzentrierte Flußsäure im Verhältnis 1:1 enthält,
eingetaucht und abgeätzt, dann auf die Unterlage aufgebracht und im Wasserstoffstrom bei etwa
1230° C geglüht. Durch die Gaszuführung 1 wird dann das Reaktionsgasgemisch, das z. B. aus Wasserstoff
und einem Germaniumhalogenid, z. B. Germaniumtetrachlorid oder Germaniumchloroform, besteht,
eingeleitet und auf dem erhitzten Träger thermisch zersetzt. Dabei kann die Oberflächentemperatur
des Trägers entweder oberhalb des Schmelzpunktes des Germaniums bei der für die gewünschte
Legierungszusammensetzung erforderlichen Schmelzbzw. Erstarrungstemperatur liegen, so daß gleichzeitig
mit dem Niederschlagen des Germaniums auf dem Siliziumträger die Legierungsbildung einsetzt, oder
sie kann unterhalb des Schmelzpunktes des Germaniums liegen, bei der Verwendung von Germaniumtetrachlorid
z. B. bei 600 bis 900° C, so daß während des Niederschiagens keine Legierungsbildung
stattfindet.
Liegt die Oberflächentemperatur des Träger unterhalb des Schmelzpunktes des Germaniums, so wird
nach dem Abscheiden einer Germaniumschicht gleichmäßiger Dicke der Siliziumträger 6 in reiner
Wasserstoffatmosphäre langsam auf die für die gewünschte Legierungszusammensetzung erforderliche
Schmelz- bzw. Erstarrungstemperatur, die aus dem Zweistoffdiagramm Germanium-Silizium entnommen
werden kann, hochgeheizt und auf dieser Temperatur gehalten, bis sich das dieser Temperatur entsprechende
Gleichgewicht des binären Systems eingestellt hat. Man erhält z. B. bei einer Temperatur von etwa
11500C eine Germanium-Silizium-Legierung, die
sich aus etwa 60 Atomprozent Silizium und etwa 40 Atomprozent Germanium zusammensetzt. Wenn
sich das Gleichgewicht des binären Systems eingestellt hat, wird die Temperatur des Trägers so lange
langsam und stetig erniedrigt, bis das niedergeschlagene Halbleitermaterial kleinen Bandabstandes vollkommen
zur Legierungsbildung verbraucht worden ist. Durch die Menge des abgeschiedenen Germaniums
ist die Dicke der unlegiert zurückbleibenden Trägerschicht und die Dicke der Legierungsschicht
bestimmt.
Nach der Legierungsbildung wird die Oberflächentemperatur des Trägers auf eine etwa 20 bis 200° C
unterhalb der Schmelztemperatur der Legierung
liegende Temperatur abgesenkt und die Anordnung in reinem Wasserstoffstrom getempert. Diese Temperung
dient zur Einstellung eines gewünschten Konzentrationsgefälles innerhalb der Legierungsschicht
und außerdem zur Einkristallbildung, bei der der einkristalline Siliziumträger als Keim wirksam ist. Nach
dieser Temperung wird die Temperatur des Trägers weiter abgesenkt und bei einer Temperatur, die
unterhalb des Schmelzpunktes des Germaniums, z. B. wieder bei 600 bis 9000C, liegt, das Reaktionsgemisch
erneut in den Reaktionsraum eingeleitet und die gasförmige Germaniumverbindung auf dem
Träger thermisch zersetzt, so daß sich auf der einkristallinen Legierungsschicht eine einkristalline
Germaniumschicht abscheidet.
Die Dotierung der einzelnen Schichten kann z. B. aus der Gasphase durch die Zugabe dotierender Substanzen
zum Reaktionsgemisch erfolgen. Die Dotierung der Legierungsschicht kann aber auch durch
Einbau von Störstellen aus dem entsprechend dotier- ao ten Träger 6 erzielt werden. Verwendet man z. B.
einen η-dotierten Träger und legiert in diesen nach dem erfindungsgemäßen Verfahren hochreines Germanium
ein, so erhält man eine η-dotierte Legierungsschicht. Diese η-Dotierung der Legierungsschicht
kann aber auch durch Verwendung eines η-dotierten Trägers und Niederschlagen einer
η-dotierten Germaniumschicht auf diesem erfolgen. Außerdem kann auch auf einen hochreinen Siliziumträger η-dotiertes Germanium aus der Gasphase
niedergeschlagen werden und beim Legieren die Störstellen aus der Germaniumschicht in die Legierungsschicht eingebaut werden.
Durch Niederschlagen einer weiteren gegebenenfalls dotierten Germaniumschicht erhält man dann
eine Halbleiteranordnung, wie sie in F i g. 2 dargestellt ist. Das noch verbliebene Silizium des Trägers 7
und gegebenenfalls auch Teile der Germanium-Silizium-Legierungsschicht 8 können nun in bekannter
Weise durch Sägen, Läppen oder Ätzen entfernt werden. Je nach Größe der Halbleiterschicht können
diese z. B. durch Sägen mit Ultraschall in kleinere Anordnungen aufgeteilt werden.
In F i g. 3 ist ein Germaniumtransistor dargestellt,
dessen Emitter- und Basiszone nach dem erfindungsgemäßen Verfahren hergestellt wurden. Die Basisschicht
12 besteht aus p-dotiertem Germanium und die Emitterschicht 13 aus einer η-dotierten Germanium-Silizium-Legierung.
In die Basiszone 12 ist z. B. eine Pille 11, die aus einer Gold-Antimon-Legierung
besteht, einlegiert, die mit der Basisschicht den Kollektor-pn-Übergang 20 bildet. Die Kollektorschicht
kann aber z. B. auch durch Niederschlagen einer weiteren η-dotierten Germaniumschicht auf der
p-dotierten Germaniumschicht gebildet sein. Die Emitterschicht ist z. B. mit einer Goldelektrode mit
Antimonzusatz 15 sperrfrei kontaktiert. Die Basiskontakte 14 und 16 sind durch Einlegieren eines
dreiwertigen Metalls, z. B. durch Aluminiumstifte, oder durch Einlegieren eines Goldringes mit Borzusatz,
gebildet.
Nach der Temperung zur Einkristallbildung der Legierungsschicht kann aber auch beispielsweise ein
Reaktionsgasgemisch, das aus einem Siliziumhalogenid, z. B. Siliziumtetrachlorid oder Siliziumchloroform,
und Wasserstoff besteht, in das Reaktionsgefäß eingeführt und auf dem Träger unter Bildung
einer einkristallinen Siliziumschicht thermisch zersetzt werden. Die Abscheidetemperatur liegt in
diesem Fall etwa ebenso hoch wie die Temperungstemperatur.
Man erhält dann eine Halbleiteranordnung, wie sie in F i g. 4 dargestellt ist. Der z. B.
p-dotierte Träger 17 braucht bei dieser Anordnung nicht entfernt zu werden, sondern bildet eine Zone,
z. B. die eines Flächentransistors. Die Siliziumschicht wird beim Niederschlagen aus der Gasphase z. B.
p-dotiert, während die Legierungsschicht 18 durch Niederschlagen einer η-dotierten Germaniumschicht
und Einlegieren dieser Schicht η-dotiert ist. Beim Niederschlagen des Germaniums muß dann das Angebot
an η-dotierenden Störstellen so groß sein, daß beim Einlegieren des Germaniums in den p-dotierten
Siliziumträger 17 die η-Dotierung überwiegt.
Die drei Schichten können in bekannter Weise sperrfrei kontaktiert werden und als Emitter-, Basis-
und Kollektorschicht eines Transistors dienen. Dabei kann die Basisschicht mit dem erfindungsgemäßen
Verfahren sehr dünn ausgebildet werden, und außerdem
erhält man ebene großflächige pn-Übergänge. In Germanium-Silizium-Legierungen mit nicht zu hohem
Siliziumgehalt ist die Lebensdauer der Ladungsträger größer als die bisher bei Silizium erzielten
Werte. Ein Siliziumtransistor mit einer Silizium-Germanium-Legierung als Basiszone hat daher bessere
elektrische Eigenschaften als ein Transistor, bei dem alle drei Zonen aus Silizium bestehen.
Auf diese Weise können auch andere Halbleiteranordnungen, z. B. Dioden, insbesondere Vierschichtdioden,
bei denen eine große Emitterergiebigkeit erwünscht ist, hergestellt werden.
Claims (11)
1. Verfahren zum Herstellen einer Halbleiteranordnung mit wenigstens einer aus einer Legierung
zweier Halbleitermaterialien bestehenden einkristallinen Halbleiterschicht, dadurch gekennzeichnet,
daß auf einem aus dem Halbleitermaterial höheren Schmelzpunktes bestehenden gleichmäßig erhitzten einkristallinen Träger
durch thermisches Zersetzen einer gasförmigen Verbindung des Halbleitermaterials niedrigeren
Schmelzpunktes eine Schicht dieses Halbleitermaterials niedergeschlagen, gleichzeitig oder danach
der Träger auf eine für die gewünschte Legierangszusammensetzung erforderliche Temperatur
erhitzt, anschließend die Temperatur des Trägers auf eine unterhalb des Schmelzpunktes
der gebildeten Legierung liegende Temperatur abgesenkt und die Legierung getempert wird
und daß dann auf der einkristallinen Legierungsschicht wenigstens eine weitere Halbleiterschicht
abgeschieden wird.
2. Verfahren nach Anspruch 1, dadurch gekennzeichnet, daß während des Niederschiagens
des Halbleitermaterials niedrigeren Schmelzpunktes die Temperatur des Trägers unterhalb
des Schmelzpunktes des niedergeschlagenen Halbleitermaterials gehalten wird.
3. Verfahren nach Anspruch 1 oder 2, dadurch gekennzeichnet, daß die weitere Halbleiterschicht
anschließend an die Temperung, unter weiterer Absenkung der Temperatur des Trägers, abgeschieden
wird.
4. Verfahren nach einem der Ansprüche 1 bis 3, dadurch gekennzeichnet, daß die abge-
schiedenen Schichten aus der Gasphase während ihrer Abscheidung durch Zugabe dotierender
Substanzen zum Reaktionsgasgemisch dotiert werden.
5. Verfahren nach einem der Ansprüche 1 bis 4, dadurch gekennzeichnet, daß nach Beendigung
des Abscheidungsvorgangs der Träger und gegebenenfalls Teile der Legierungsschicht mechanisch
und/oder chemisch entfernt werden.
6. Verfahren nach einem der Ansprüche 1 bis 5, dadurch gekennzeichnet, daß die Legierungsschicht
während des Legierungsvorgangs durch im Träger und/oder in der auf diesem niedergeschlagenen Schicht enthaltene Dotierungsstoffe
dotiert wird.
7. Verfahren nach einem der Ansprüche 1 bis 6, dadurch gekennzeichnet, daß der Träger auf
einer Unterlage aufgebracht wird und durch Erhitzen dieser Unterlage aufgeheizt wird.
8. Verfahren nach einem der Ansprüche 1 bis 7, dadurch gekennzeichnet, daß die Legierungsschicht
aus Halbleitermaterialien verschieden großen Bandabstandes gebildet wird.
9. Verfahren nach einem der Ansprüche 1 bis 8, dadurch gekennzeichnet, daß auf einem
aus Silizium bestehenden Träger eine Germaniumschicht niedergeschlagen wird.
10. Siliziumtransistor, hergestellt nach einem Verfahren nach einem der Ansprüche 1 bis 9,
dadurch gekennzeichnet, daß die Emitter- und die Kollektorzone aus Silizium und die Basiszone aus
einer Germanium-Silizium-Legierung bestehen.
11. Germaniumtransistor, hergestellt nach einem Verfahren nach einem der Ansprüche 1
bis 9, dadurch gekennzeichnet, daß die Emitterzone aus einer Germanium-Silizium-Legierung
und die Basiszone sowie die Kollektorzone aus Germanium bestehen.
In Betracht gezogene Druckschriften:
Deutsche Patentschrift Nr. 865 160;
deutsche Auslegeschrift Nr. 1 046 196;
USA.-Patentschrift Nr. 2695 852;
britische Patentschriften Nr. 843 407, 682 105;
französische Patentschrift Nr. 1123 706.
Deutsche Patentschrift Nr. 865 160;
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britische Patentschriften Nr. 843 407, 682 105;
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Hierzu 1 Blatt Zeichnungen
409 557/365 3.64 ® Bundesdruckerei Berlin
Priority Applications (6)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
NL266513D NL266513A (de) | 1960-07-01 | ||
DES69202A DE1166938B (de) | 1960-07-01 | 1960-07-01 | Verfahren zur Herstellung einer Halbleiteranordnung |
CH647261A CH391111A (de) | 1960-07-01 | 1961-06-02 | Verfahren zur Herstellung einer Halbleiteranordnung |
US117401A US3242018A (en) | 1960-07-01 | 1961-06-15 | Semiconductor device and method of producing it |
FR866499A FR1293869A (fr) | 1960-07-01 | 1961-06-29 | Procédé de fabrication d'un dispositif à semi-conducteur |
GB23567/61A GB918889A (en) | 1960-07-01 | 1961-06-29 | Improvements in or relating to semi-conductor arrangements and to methods of making such arrangements |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DES69202A DE1166938B (de) | 1960-07-01 | 1960-07-01 | Verfahren zur Herstellung einer Halbleiteranordnung |
Publications (2)
Publication Number | Publication Date |
---|---|
DE1166938B true DE1166938B (de) | 1964-04-02 |
DE1166938C2 DE1166938C2 (de) | 1964-10-08 |
Family
ID=7500812
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DES69202A Granted DE1166938B (de) | 1960-07-01 | 1960-07-01 | Verfahren zur Herstellung einer Halbleiteranordnung |
Country Status (6)
Country | Link |
---|---|
US (1) | US3242018A (de) |
CH (1) | CH391111A (de) |
DE (1) | DE1166938B (de) |
FR (1) | FR1293869A (de) |
GB (1) | GB918889A (de) |
NL (1) | NL266513A (de) |
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