DE112010005681B4 - Leistungshalbleiterbauteil - Google Patents
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- 239000004065 semiconductor Substances 0.000 title claims abstract description 114
- 239000000758 substrate Substances 0.000 claims abstract description 26
- 230000000149 penetrating effect Effects 0.000 claims abstract description 10
- 229910010271 silicon carbide Inorganic materials 0.000 claims description 50
- HBMJWWWQQXIZIP-UHFFFAOYSA-N silicon carbide Chemical compound [Si+]#[C-] HBMJWWWQQXIZIP-UHFFFAOYSA-N 0.000 claims description 49
- 239000010410 layer Substances 0.000 description 135
- 239000000523 sample Substances 0.000 description 20
- 239000012535 impurity Substances 0.000 description 16
- 239000011229 interlayer Substances 0.000 description 14
- 238000004519 manufacturing process Methods 0.000 description 14
- 238000000034 method Methods 0.000 description 14
- 238000006073 displacement reaction Methods 0.000 description 13
- 229910052751 metal Inorganic materials 0.000 description 12
- 239000002184 metal Substances 0.000 description 12
- 230000002093 peripheral effect Effects 0.000 description 11
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 8
- 238000001514 detection method Methods 0.000 description 8
- 230000005684 electric field Effects 0.000 description 8
- 238000005468 ion implantation Methods 0.000 description 8
- 239000000463 material Substances 0.000 description 7
- 238000000206 photolithography Methods 0.000 description 6
- 229910021332 silicide Inorganic materials 0.000 description 6
- FVBUAEGBCNSCDD-UHFFFAOYSA-N silicide(4-) Chemical compound [Si-4] FVBUAEGBCNSCDD-UHFFFAOYSA-N 0.000 description 6
- 238000000137 annealing Methods 0.000 description 5
- 238000005229 chemical vapour deposition Methods 0.000 description 5
- 230000000694 effects Effects 0.000 description 5
- 238000009413 insulation Methods 0.000 description 5
- 230000004888 barrier function Effects 0.000 description 4
- 229910021420 polycrystalline silicon Inorganic materials 0.000 description 4
- 229920005591 polysilicon Polymers 0.000 description 4
- 239000000377 silicon dioxide Substances 0.000 description 4
- 235000012239 silicon dioxide Nutrition 0.000 description 4
- IJGRMHOSHXDMSA-UHFFFAOYSA-N Atomic nitrogen Chemical compound N#N IJGRMHOSHXDMSA-UHFFFAOYSA-N 0.000 description 3
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 3
- 230000015556 catabolic process Effects 0.000 description 3
- 238000010438 heat treatment Methods 0.000 description 3
- 230000003647 oxidation Effects 0.000 description 3
- 238000007254 oxidation reaction Methods 0.000 description 3
- XKRFYHLGVUSROY-UHFFFAOYSA-N Argon Chemical compound [Ar] XKRFYHLGVUSROY-UHFFFAOYSA-N 0.000 description 2
- OKTJSMMVPCPJKN-UHFFFAOYSA-N Carbon Chemical compound [C] OKTJSMMVPCPJKN-UHFFFAOYSA-N 0.000 description 2
- 108091006146 Channels Proteins 0.000 description 2
- VEXZGXHMUGYJMC-UHFFFAOYSA-N Hydrochloric acid Chemical compound Cl VEXZGXHMUGYJMC-UHFFFAOYSA-N 0.000 description 2
- QAOWNCQODCNURD-UHFFFAOYSA-N Sulfuric acid Chemical compound OS(O)(=O)=O QAOWNCQODCNURD-UHFFFAOYSA-N 0.000 description 2
- 230000015572 biosynthetic process Effects 0.000 description 2
- 229910052799 carbon Inorganic materials 0.000 description 2
- 238000000151 deposition Methods 0.000 description 2
- 238000010586 diagram Methods 0.000 description 2
- 238000001312 dry etching Methods 0.000 description 2
- 230000003071 parasitic effect Effects 0.000 description 2
- 238000005070 sampling Methods 0.000 description 2
- 229910052710 silicon Inorganic materials 0.000 description 2
- 239000010703 silicon Substances 0.000 description 2
- 238000004544 sputter deposition Methods 0.000 description 2
- ZOXJGFHDIHLPTG-UHFFFAOYSA-N Boron Chemical compound [B] ZOXJGFHDIHLPTG-UHFFFAOYSA-N 0.000 description 1
- MHAJPDPJQMAIIY-UHFFFAOYSA-N Hydrogen peroxide Chemical compound OO MHAJPDPJQMAIIY-UHFFFAOYSA-N 0.000 description 1
- 102000004129 N-Type Calcium Channels Human genes 0.000 description 1
- 108090000699 N-Type Calcium Channels Proteins 0.000 description 1
- GRYLNZFGIOXLOG-UHFFFAOYSA-N Nitric acid Chemical compound O[N+]([O-])=O GRYLNZFGIOXLOG-UHFFFAOYSA-N 0.000 description 1
- OAICVXFJPJFONN-UHFFFAOYSA-N Phosphorus Chemical compound [P] OAICVXFJPJFONN-UHFFFAOYSA-N 0.000 description 1
- 239000002253 acid Substances 0.000 description 1
- 150000007513 acids Chemical class 0.000 description 1
- 229910052782 aluminium Inorganic materials 0.000 description 1
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 description 1
- 229910052786 argon Inorganic materials 0.000 description 1
- QVGXLLKOCUKJST-UHFFFAOYSA-N atomic oxygen Chemical compound [O] QVGXLLKOCUKJST-UHFFFAOYSA-N 0.000 description 1
- 210000000746 body region Anatomy 0.000 description 1
- 229910052796 boron Inorganic materials 0.000 description 1
- 150000001875 compounds Chemical class 0.000 description 1
- 239000013078 crystal Substances 0.000 description 1
- 229910001873 dinitrogen Inorganic materials 0.000 description 1
- 238000005530 etching Methods 0.000 description 1
- 230000005669 field effect Effects 0.000 description 1
- 239000007789 gas Substances 0.000 description 1
- 239000011261 inert gas Substances 0.000 description 1
- 229910044991 metal oxide Inorganic materials 0.000 description 1
- 150000004706 metal oxides Chemical class 0.000 description 1
- 239000000203 mixture Substances 0.000 description 1
- 238000012544 monitoring process Methods 0.000 description 1
- 229910017604 nitric acid Inorganic materials 0.000 description 1
- 229910052757 nitrogen Inorganic materials 0.000 description 1
- 239000001301 oxygen Substances 0.000 description 1
- 229910052760 oxygen Inorganic materials 0.000 description 1
- 238000004091 panning Methods 0.000 description 1
- 229910052698 phosphorus Inorganic materials 0.000 description 1
- 239000011574 phosphorus Substances 0.000 description 1
- 238000007740 vapor deposition Methods 0.000 description 1
- 238000001039 wet etching Methods 0.000 description 1
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- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
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- H01L27/04—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having at least one potential-jump barrier or surface barrier; including integrated passive circuit elements with at least one potential-jump barrier or surface barrier the substrate being a semiconductor body
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/77—Manufacture or treatment of devices consisting of a plurality of solid state components or integrated circuits formed in, or on, a common substrate
- H01L21/78—Manufacture or treatment of devices consisting of a plurality of solid state components or integrated circuits formed in, or on, a common substrate with subsequent division of the substrate into plural individual devices
- H01L21/82—Manufacture or treatment of devices consisting of a plurality of solid state components or integrated circuits formed in, or on, a common substrate with subsequent division of the substrate into plural individual devices to produce devices, e.g. integrated circuits, each consisting of a plurality of components
- H01L21/822—Manufacture or treatment of devices consisting of a plurality of solid state components or integrated circuits formed in, or on, a common substrate with subsequent division of the substrate into plural individual devices to produce devices, e.g. integrated circuits, each consisting of a plurality of components the substrate being a semiconductor, using silicon technology
- H01L21/8232—Field-effect technology
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- H01L27/04—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having at least one potential-jump barrier or surface barrier; including integrated passive circuit elements with at least one potential-jump barrier or surface barrier the substrate being a semiconductor body
- H01L27/08—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having at least one potential-jump barrier or surface barrier; including integrated passive circuit elements with at least one potential-jump barrier or surface barrier the substrate being a semiconductor body including only semiconductor components of a single kind
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- H01L27/088—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having at least one potential-jump barrier or surface barrier; including integrated passive circuit elements with at least one potential-jump barrier or surface barrier the substrate being a semiconductor body including only semiconductor components of a single kind including field-effect components only the components being field-effect transistors with insulated gate
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- H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
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Abstract
Leistungshalbleiterbauteil, Folgendes aufweisend:
ein Halbleitersubstrat eines ersten Leitfähigkeitstyps;
eine Drift-Schicht des ersten Leitfähigkeitstyps, die auf einer ersten Hauptflächenseite des Halbleitersubstrats ausgebildet ist;
mehrere Hauptzellenwannenzonen eines zweiten Leitfähigkeitstyps, die Seite an Seite in Oberflächenabschnitten der Drift-Schicht ausgebildet sind;
mehrere Abtastzellenwannenzonen des zweiten Leitfähigkeitstyps, die abseits von den Hauptzellenwannenzonen Seite an Seite in Oberflächenabschnitten der Drift-Schicht ausgebildet sind;
eine Abtastkontaktfleckwannenzone des zweiten Leitfähigkeitstyps, die so ausgebildet ist, dass sie abseits von den Abtastzellenwannenzonen und den Hauptzellenwannenzonen die Abtastzellenwannenzonen umgibt und eine Fläche hat, die größer ist als die jeweiligen Hauptzellenwannenzonen und Abtastzellenwannenzonen;
eine Gate-Isolierschicht, die auf den Abtastzellenwannenzonen und den Hauptzellenwannenzonen ausgebildet ist;
eine Feldisolierschicht, die auf der Abtastkontaktfleckwannenzone dicker als die Gate-Isolierschicht ausgebildet ist;
einen Source-Kontaktfleck, der die Abtastkontaktfleckwannenzone und die Hauptzellenwannenzonen über Abtastkontaktfleckwannenkontaktöffnungen, die auf der Abtastkontaktfleckwannenzone, die Feldisolierschicht durchdringend ausgebildet sind, und Source-Kontaktöffnungen elektrisch anschließt, die auf den Hauptzellenwannenzonen, die Gate-Isolierschicht durchdringend ausgebildet sind;
einen Abtastkontaktfleck, der über Abtast-Source-Kontaktöffnungen, die auf den Abtastzellenwannenzonen, die Gate-Isolierschicht durchdringend ausgebildet sind, elektrisch an die Abtastzellenwannenzonen angeschlossen ist;
Gate-Elektroden, die in Kontakt mit der Gate-Isolierschicht über den Hauptzellenwannenzonen und den Abtastzellenwannenzonen ausgebildet sind;
einen Gate-Kontaktfleck, der elektrisch an die Gate-Elektroden angeschlossen ist; und
eine Drain-Elektrode, die auf einer zweiten Hauptflächenseite des Halbleitersubstrats, die der ersten Hauptfläche entgegengesetzt ist, ausgebildet ist,
wobei die Feldisolierschicht die Abtastkontaktfleckwannenzone vollständig abdeckt, bis auf Stellen, an denen Kontaktöffnungen in der Feldschicht angeordnet sind.
ein Halbleitersubstrat eines ersten Leitfähigkeitstyps;
eine Drift-Schicht des ersten Leitfähigkeitstyps, die auf einer ersten Hauptflächenseite des Halbleitersubstrats ausgebildet ist;
mehrere Hauptzellenwannenzonen eines zweiten Leitfähigkeitstyps, die Seite an Seite in Oberflächenabschnitten der Drift-Schicht ausgebildet sind;
mehrere Abtastzellenwannenzonen des zweiten Leitfähigkeitstyps, die abseits von den Hauptzellenwannenzonen Seite an Seite in Oberflächenabschnitten der Drift-Schicht ausgebildet sind;
eine Abtastkontaktfleckwannenzone des zweiten Leitfähigkeitstyps, die so ausgebildet ist, dass sie abseits von den Abtastzellenwannenzonen und den Hauptzellenwannenzonen die Abtastzellenwannenzonen umgibt und eine Fläche hat, die größer ist als die jeweiligen Hauptzellenwannenzonen und Abtastzellenwannenzonen;
eine Gate-Isolierschicht, die auf den Abtastzellenwannenzonen und den Hauptzellenwannenzonen ausgebildet ist;
eine Feldisolierschicht, die auf der Abtastkontaktfleckwannenzone dicker als die Gate-Isolierschicht ausgebildet ist;
einen Source-Kontaktfleck, der die Abtastkontaktfleckwannenzone und die Hauptzellenwannenzonen über Abtastkontaktfleckwannenkontaktöffnungen, die auf der Abtastkontaktfleckwannenzone, die Feldisolierschicht durchdringend ausgebildet sind, und Source-Kontaktöffnungen elektrisch anschließt, die auf den Hauptzellenwannenzonen, die Gate-Isolierschicht durchdringend ausgebildet sind;
einen Abtastkontaktfleck, der über Abtast-Source-Kontaktöffnungen, die auf den Abtastzellenwannenzonen, die Gate-Isolierschicht durchdringend ausgebildet sind, elektrisch an die Abtastzellenwannenzonen angeschlossen ist;
Gate-Elektroden, die in Kontakt mit der Gate-Isolierschicht über den Hauptzellenwannenzonen und den Abtastzellenwannenzonen ausgebildet sind;
einen Gate-Kontaktfleck, der elektrisch an die Gate-Elektroden angeschlossen ist; und
eine Drain-Elektrode, die auf einer zweiten Hauptflächenseite des Halbleitersubstrats, die der ersten Hauptfläche entgegengesetzt ist, ausgebildet ist,
wobei die Feldisolierschicht die Abtastkontaktfleckwannenzone vollständig abdeckt, bis auf Stellen, an denen Kontaktöffnungen in der Feldschicht angeordnet sind.
Description
- Geänderte Beschreibung (im Korrekturmodus)
- Technisches Gebiet
- Diese Erfindung bezieht sich auf Leistungshalbleiterbauteile wie etwa einen Siliciumcarbidhalbleiter.
- Stand der Technik
- Bei einem Leistungshalbleiterbauteil hat das Leistungshalbleiterbauteil bekanntlich eine Struktur, in der ein Stromerfassungselement auf demselben Substrat vorgesehen ist, so dass das Bauteil im Ansprechen auf eine Überstromerfassung isoliert werden kann, um das Bauteil zu schützen (z.B. Patentschrift 1). Patentschrift 1 beschreibt eine Struktur eines Halbleiterbauteils wie etwa eines IGBTs (Isolierschicht-Bipolartransistor), bei dem ein Stromerfassungselement für das Halbleiterbauteil auf demselben Substrat vorgesehen ist, und eine Zone des p-Typs ähnlich einer Basiszone unter einem Stromerfassungskontaktierungsfleck für das Stromerfassungselement ausgebildet ist.
- Patentschrift 2 beschreibt ein Leistungshalbleiterbauteil, das mit einem Vertikalleistungs-MOSFET (Metalloxidhalbleiter-Feldeffekttransistor) und Dioden ausgeführt ist; und
1 und2 zeigen in dem Schriftstück, dass mindestens eine Reihe Dioden im Umfeld einer MOSFET-Zellenzone, d.h. in einer Zone angrenzend an einen Gate-Kontaktfleck angeordnet ist. Wenn der MOSFET von einem Einzustand zu einem Auszustand umschaltet, nimmt jede der Dioden Defektelektronen auf, die bei Vorwärts-Vorspannung aus einer P-Wanne und einer P-Basis, die in2 des Dokuments gezeigt sind, zu einer Halbleiterschicht des N-Typs auf einer Drain-Seite injiziert werden. Deshalb kann die in dem Schriftstück beschriebene Struktur beim Umschalten des MOSFETs von einer Vorwärts- zu einer Rückwärtsvorspannung verhindern, dass ein in3 des Schriftstücks gezeigter parasitärer Transistor einschaltet. -
2 des Dokuments zeigt, dass in der oben erwähnten Struktur die P-Basis, bei der es sich um die P-Wanne des MOSFETs handelt, über ein hinteres Gate elektrisch auf eine Source-Elektrode aufgeschaltet ist. - Des Weiteren wird in Patentschrift 3 ein Halbleiterbauteil beschrieben, in welchem inaktive Zellen rechteckförmig um eine Messzelle angeordnet sind. In Patentschrift 4 wird ein Leistungshalbleiterbauteil beschrieben, das eine Stromerfassung ermöglicht. Ferner wird in Patentschrift 5 ein Halbleiterbauteil offenbart, das eine Driftschicht aus einem ersten Leitfähigkeitstyp und einem an die Driftschicht angrenzenden Körperbereich aufweist.
- Schriftstücke aus dem Stand der Technik
- Patentschriften
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- Patentschrift 1 Japanisches Patent mit der Offenlegungsnummer
JP H08- 46 193 A 19 bis20 ) - Patentschrift 2 Japanisches Patent mit der Offenlegungsnummer
JP H05- 198 816 A 1 bis3 ) - Patentschrift 3
JP 2000-323 707 A - Patentschrift 4
US 5 410 171 A - Patentschrift 5
US 2010/0 090 271 A1 - Zusammenfassung der Erfindung
- Problem, das durch die Erfindung gelöst werden soll
- Die durch die vorliegende Erfindung zu lösenden Probleme werden nachstehend hauptsächlich mit Bezug auf
2 der Patentschrift 2 erläutert. - Wenn ein MOSFET eines in Patentschrift 2 beschriebenen Leistungshalbleiterbauteils von einem Ein- zu einem Auszustand umgeschaltet wird, steigt eine Drain-Spannung des MOSFETs, d.h. die Spannung der Drain-Elektrode in manchen Fällen rasch an und erreicht mehrere hundert Volt. Dieser Drain-Spannungsanstieg erzeugt durch eine Sperrschichtkapazitanz, die im Auszustand zwischen einer P-Wanne und einer N--Drain-Schicht auftritt, Verschiebungsströme auf einer Drain-Elektroden- und einer Source-Elektrodenseite. Falls P-Wannen oder Abschnitte vorhanden sind, in denen Zonen des P-Typs genauso wie P-Wannen in der N--Drain-Schicht vorgesehen sind, entsteht dieser Verschiebungsstrom nicht nur in den P-Wannen des MOSFETs, sondern auch in den Dioden.
- Diese wie vorstehend entstandenen Verschiebungsströme fließen so, dass der auf der Drain-Elektrodenseite entstandene Strom direkt in die Drain-Elektrode fließt, und der auf der Source-Elektrodenseite entstandene Strom durch die P-Wannen oder die Zonen des P-Typs in die Source-Elektrode fließt.
- Im Falle des in Patentschrift 2 beschriebenen Leistungshalbleiterbauteils sind dessen Source-Elektrode und Feldplatte auf eine im Stand der Technik des Schriftstücks beschriebene Weise elektrisch angeschlossen; somit fließt beispielsweise in einem in
2(C) gezeigten Abschnitt ein Verschiebungsstrom, nachdem er in eine P-Wanne unter einem Gate-Kontaktfleck geflossen ist, in der P-Wanne unter dem Gate-Kontaktfleck in einer Richtung aus einer MOSFET-Zellenrichtung zu einer an die Feldplatte angeschlossenen Kontaktöffnung und dann durch die Feldplatte in die Source-Elektrode. - Eine P-Wannenfläche unter dem Gate-Kontaktfleck ist sehr viel größer als die Flächen von P-Wannen der MOSFET-Zelle und einer Diodenzelle; deshalb erzeugt der in der P-Wanne unter dem Gate-Kontaktfleck fließende Verschiebungsstrom in der P-Wanne eine nicht unerhebliche Spannung, weil die P-Wanne selbst mit der großen Fläche und die Kontaktöffnung ziemlich große Widerstände haben. Dies führt dazu, dass ein relativ hohes elektrisches Potential an einer Stelle in der P-Wanne erzeugt wird, die in einer Ebenenrichtung von einem Abschnitt (einer Kontaktöffnung) weit weg ist, an der eine P-Wanne über die Feldplatte elektrisch an eine Source-Elektrode (typischerweise auf ein Massepotential) angeschlossen ist.
- Dieses elektrische Potential nimmt bei zunehmendem Verschiebungsstrom und bei Zunahme einer Veränderung dV/dt in der Drain-Spannung V im Hinblick auf Zeit t zu.
- Dieses elektrische Potential entsteht nicht nur in der P-Wanne unter dem Gate-Kontaktfleck, sondern auch in einer P-Wanne unter einem Kontaktfleck mit einer großen Fläche, wie etwa einem Stromerfassungskontaktierungsfleck, der in der Patentschrift 1 an ein Stromerfassungselement angeschlossen ist.
- Zusammenfassung der Erfindung
- Ein Leistungshalbleiterbauteil gemäß der vorliegenden Erfindung weist auf: ein Halbleitersubstrat eines ersten Leitfähigkeitstyps; eine Drift-Schicht des ersten Leitfähigkeitstyps, die auf einer ersten Hauptflächenseite des Halbleitersubstrats ausgebildet ist; mehrere Hauptzellenwannenzonen eines zweiten Leitfähigkeitstyps, die Seite an Seite in Oberflächenabschnitten der Drift-Schicht ausgebildet sind; mehrere Abtastzellenwannenzonen des zweiten Leitfähigkeitstyps, die abseits von den Hauptzellenwannenzonen Seite an Seite in Oberflächenabschnitten der Drift-Schicht ausgebildet sind; eine Abtastkontaktfleckwannenzone des zweiten Leitfähigkeitstyps, die so ausgebildet ist, dass sie abseits von den Abtastzellenwannenzonen und den Hauptzellenwannenzonen die Abtastzellenwannenzonen umgibt und eine Fläche hat, die größer ist als die jeweiligen Hauptzellenwannenzonen und Abtastzellenwannenzonen; eine Gate-Isolierschicht, die auf den Abtastzellenwannenzonen und den Hauptzellenwannenzonen ausgebildet ist; eine Feldisolierschicht, die auf der Abtastkontaktfleckwannenzone dicker als die Gate-Isolierschicht ausgebildet ist; einen Source-Kontaktfleck, der die Abtastkontaktfleckwannenzone und die Hauptzellenwannenzonen über Abtastkontaktfleckwannenkontaktöffnungen, die auf der Abtastkontaktfleckwannenzone, die Feldisolierschicht durchdringend ausgebildet sind, und Source-Kontaktöffnungen elektrisch anschließt, die auf den Hauptzellenwannenzonen, die Gate-Isolierschicht durchdringend ausgebildet sind; einen Abtastkontaktfleck, der über Abtast-Source-Kontaktöffnungen, die auf den Abtastzellenwannenzonen, die Gate-Isolierschicht durchdringend ausgebildet sind, elektrisch an die Abtastzellenwannenzonen angeschlossen ist; Gate-Elektroden, die in Kontakt mit der Gate-Isolierschicht über den Hauptzellenwannenzonen und den Abtastzellenwannenzonen ausgebildet sind; einen Gate-Kontaktfleck, der elektrisch an die Gate-Elektroden angeschlossen ist; und eine Drain-Elektrode, die auf einer zweiten Hauptflächenseite des Halbleitersubstrats, die der ersten Hauptfläche entgegengesetzt ist, ausgebildet ist, wobei die Feldisolierschicht die Abtastkontaktfleckwannenzone vollständig abdeckt, bis auf Stellen, an denen Kontaktöffnungen in der Feldschicht angeordnet sind.
- Wirkung der Erfindung
- Gemäß einem Leistungshalbleiterbauteil der vorliegenden Erfindung wird selbst dann, wenn das Leistungshalbleiterbauteil, das einen Sensor wie etwa einen Stromsensor zur Überwachung eines Stromwerts o. dgl. umfasst, mit einem Sensorkontaktfleck versehen ist und mit hoher Geschwindigkeit angesteuert wird, kein starkes elektrisches Feld an seine Gate-Isolierschichten angelegt, so dass die Gate-Isolierschichten vor einem dielektrischen Durchbruch bewahrt werden können. Dies kann dem Leistungshalbleiterbauteil eine höhere Zuverlässigkeit verleihen.
- Figurenliste
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1 ist eine schematische Draufsicht auf ein Leistungshalbleiterbauteil gemäß Ausführungsform 1 der vorliegenden Erfindung; -
2 ist eine andere schematische Draufsicht auf ein Leistungshalbleiterbauteil gemäß Ausführungsform 1 der vorliegenden Erfindung; -
3 ist eine Querschnittsansicht, die schematisch einen Querschnitt eines Teils des Leistungshalbleiterbauteils gemäß Ausführungsform 1 der vorliegenden Erfindung darstellt; -
4 ist eine Querschnittsansicht, die schematisch einen Querschnitt eines anderen Teils des Leistungshalbleiterbauteils gemäß Ausführungsform 1 der vorliegenden Erfindung darstellt; -
5 enthält Querschnittsansichten, die schematisch einen Teil des Leistungshalbleiterbauteils gemäß Ausführungsform 1 der vorliegenden Erfindung darstellen, um Herstellungsschritte für das Leistungshalbleiterbauteil zu erklären; -
6 enthält Querschnittsansichten, die schematisch einen anderen Teil des Leistungshalbleiterbauteils gemäß Ausführungsform 1 der vorliegenden Erfindung darstellen, um Herstellungsschritte für das Leistungshalbleiterbauteil zu erklären; -
7 ist ein Schaltungsschema zur Erläuterung eines Ersatzschaltungsmodells des Leistungshalbleiterbauteils gemäß Ausführungsform 1 der vorliegenden Erfindung; -
8 ist eine schematische Teilquerschnittsansicht eines Aspekts des Leistungshalbleiterbauteils gemäß Ausführungsform 1 der vorliegenden Erfindung; -
9 ist eine schematische Draufsicht eines anderen Aspekts des Leistungshalbleiterbauteils gemäß Ausführungsform 1 der vorliegenden Erfindung; -
10 ist eine schematische Draufsicht eines anderen Aspekts des Leistungshalbleiterbauteils gemäß Ausführungsform 1 der vorliegenden Erfindung; -
11 ist eine schematische Draufsicht eines anderen Aspekts des Leistungshalbleiterbauteils gemäß Ausführungsform 1 der vorliegenden Erfindung; -
12 ist eine schematische Draufsicht eines anderen Aspekts des Leistungshalbleiterbauteils gemäß Ausführungsform 1 der vorliegenden Erfindung; -
13 ist eine schematische Draufsicht auf ein Leistungshalbleiterbauteil gemäß Ausführungsform 2 der vorliegenden Erfindung; und -
14 ist eine schematische Teilquerschnittsansicht des Leistungshalbleiterbauteils gemäß Ausführungsform 2 der vorliegenden Erfindung. - Arten und Weisen zur Umsetzung der Erfindung
- Ausführungsform 1
- In der Ausführungsform 1 der vorliegenden Erfindung erfolgt eine Erläuterung unter Verwendung eines Bauteils, das hauptsächlich aus vertikalen n-Typ-Kanal-Siliciumcarbid-MOSFETs als Beispiel eines Leistungshalbleiterbauteils besteht, das einen Stromsensor umfasst. In den nachstehend beschriebenen Ausführungsformen erfolgt die Erläuterung unter der Annahme, dass ein „erster Leitfähigkeitstyp“ dem n-Typ und ein „zweiter Leitfähigkeitstyp“ dem p-Typ entspricht; jedoch kann, was die Halbleiterleitfähigkeitstypen betrifft, die Entsprechung auch umgekehrt sein.
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1 ist eine schematische Draufsicht auf ein Leitungshalbleiterbauteil gemäß Ausführungsform 1 der vorliegenden Erfindung, bei dem hauptsächlich Siliciumcarbid-MOSFETs verwendet sind. In1 ist ein Source-Kontaktfleck10 in einem zentralen Abschnitt der Oberseite des Leistungshalbleiterbauteils ausgebildet. Wenn der Source-Kontaktfleck10 von oberhalb seiner Oberseite angesehen wird, ist ein Gate-Kontaktfleck11 auf einer Seite des Bauteils ausgebildet. Eine Gate-Verdrahtung12 ist sich vom Gate-Kontaktfleck11 erstreckend so ausgebildet, dass sie den Source-Kontaktfleck10 umgibt. In einem Abschnitt innerhalb des Source-Kontaktflecks10 ist ein Abtastkontaktfleck13 ausgebildet. - Der Source-Kontaktfleck
10 ist elektrisch an Quellen von MOSFETs in mehreren Hauptzellen angeschlossen, die unter dem Source-Kontaktfleck10 vorgesehen sind; der Abtastkontaktfleck13 ist elektrisch an Quellen von MOSFETs in mehreren Abtastzellen angeschlossen, die unter dem Abtastkontaktfleck13 vorgesehen sind. Der Gate-Kontaktfleck11 und die Gate-Verdrahtung12 sind elektrisch an Gatter der MOSFETs in den Hauptzellen und den Abtastzellen angeschlossen, um an Gate-Elektroden eine Gate-Spannung anzulegen, die von einer externen Steuerschaltung zugeführt wird. -
2 ist eine Draufsicht auf das Leistungshalbleiterbauteil gemäß der Ausführungsform, in der eine darunter liegende Schicht von oben durch eine Schicht zu sehen ist, die den Source-Kontaktfleck10 , den Gate-Kontaktfleck11 u. dgl. umfasst, die in1 gezeigt sind. In2 sind mehrere Öffnungen, die Abtast-Source-Kontaktöffnungen62 genannt werden, unter dem in1 gezeigten Abtastkontaktfleck13 so ausgebildet, dass sie eine Isolierschicht wie etwa eine (in der Figur nicht gezeigte) Zwischenlagenisolierschicht durchdringen. In einer Siliciumcarbidschicht unter den Abtast-Source-Kontaktöffnungen62 sind jeweilige Abtastzellenwannenzonen42 aus Siliciumcarbid des p-Typs ausgebildet. - In der Draufsicht sind eine Abtastzellenumfangswannenzone
43 und Abtastzellenumfangswannenkontaktöffnungen63 die mehreren Abtast-Source-Kontaktöffnungen62 und die Abtastzellenwannenzonen42 umgebend ausgebildet. Die Abtastzellenumfangswannenkontaktöffnungen63 sind so ausgebildet, dass sie eine Isolierschicht wie etwa eine Zwischenlagenisolierschicht durchdringen, und die Abtastzellenumfangswannenzone43 ist in der unter den Abtastzellenumfangswannenkontaktöffnungen63 angeordneten Siliciumcarbidschicht ausgebildet, um eine Eigenschaft des p-Typs an den Tag zu legen. - In der Draufsicht sind eine Abtastkontaktfleckwannenzone
44 und Abtastkontaktfleckwannenkontaktöffnungen64 unter dem Abtastkontaktfleck13 und außerhalb der Abtastzellenumfangswannenzone43 und der Abtastzellenumfangswannenkontaktöffnungen63 ausgebildet. Die Abtastkontaktfleckwannenkontaktöffnungen64 sind so ausgebildet, dass sie eine Isolierschicht wie etwa eine Zwischenlagenisolierschicht durchdringen, und die Abtastkontaktfleckwannenzone44 ist in der Siliciumcarbidschicht ausgebildet, um eine Eigenschaft des p-Typs an den Tag zu legen. - In der Draufsicht sind eine Abtastkontaktfleckgrenzwannenzone
45 und Abtastkontaktfleckgrenzwannenkontaktöffnungen65 innerhalb und unter dem Source-Kontaktfleck10 entlang der Grenze zwischen dem Source-Kontaktfleck10 und dem Abtastkontaktfleck13 , die Abtastkontaktfleckwannenzone44 und die Abtastkontaktfleckwannenkontaktöffnungen64 umgebend ausgebildet. Abtastkontaktfleckgrenzwannenkontaktöffnungen65 sind so ausgebildet, dass sie eine Isolierschicht wie etwa eine Zwischenlagenisolierschicht durchdringen, und die Abtastkontaktfleckgrenzwannenzone44 ist in der Siliciumcarbidschicht ausgebildet, um eine Eigenschaft des p-Typs an den Tag zu legen. - In der Draufsicht sind die vielen Hauptzellen unter dem Source-Kontaktfleck
10 , die Abtastkontaktfleckgrenzwannenzone45 und die Abtastkontaktfleckgrenzwannenkontaktöffnungen65 umgebend ausgebildet. In jeder der Hauptzellen ist eine Hauptzellenwannenzone41 aus Siliciumcarbid des p-Typs in der Siliciumcarbidschicht ausgebildet, die unter einer Source-Kontaktöffnung61 angeordnet ist, die durch Durchdringen der Isolierschicht wie etwa der Zwischenlagenisolierschicht gebildet ist. - In der Draufsicht sind eine Umfangsgrenzwannenzone
47 und Umfangsgrenzwannenkontaktöffnungen67 unter dem Umfang des Source-Kontaktflecks10 , die vielen Hauptzellen umgebend ausgebildet; außerhalb des Umfangs sind eine Umfangswannenzone46 und Umfangswannenkontaktöffnungen66 ausgebildet. Die Umfangsgrenzwannenzone47 und die Umfangswannenzone46 sind aus Siliciumcarbid des p-Typs hergestellt, und die Umfangsgrenzwannenkontaktöffnungen67 und die Umfangswannenkontaktöffnungen66 sind so ausgebildet, dass sie die Isolierschicht wie etwa die Zwischenlagenisolierschicht durchdringen. - Die Umfangswannenzone
46 erstreckt sich zu einem Bereich unter dem Gate-Kontaktfleck11 ; die Gate-Verdrahtung12 , die in1 erläutert wurde, ist über der Umfangswannenzone46 ausgebildet, die als Umfangsabschnitt dient. - In einer Zone, bei der es sich um einen Abschnitt des Siliciumcarbids handelt, und die außerhalb der Umfangswannenzone
46 liegt, ist eine Sperrschichtabschlusserweiterungszone (JTE-Zone)40 des p-Typs ausgebildet. - Gate-Isolierschichten (die in der Figur nicht gezeigt sind) sind auf Oberseiten von Siliciumcarbidzonen ausgebildet wie etwa den Hauptzellenwannenzonen
41 , den Abtastzellenwannenzonen42 , der Abtastzellenumfangswannenzone43 , der Abtastkontaktfleckgrenzwannenzone45 , der Umfangsgrenzwannenzone47 und einigen Abschnitten einer Drift-Schicht21 ; Feldisolierschichten (die in der Figur nicht gezeigt sind), die dicker sind als die Gate-Isolierschichten, sind auf Oberseiten von Siliciumcarbidzonen ausgebildet, wie etwa der Abtastkontaktfleckwannenzone44 , der Umfangswannenzone46 und einigen Abschnitten der Drift-Schicht21 . In der Draufsicht von2 handelt es sich bei Gate-Isolierschicht-/Feldisolierschichtgrenzen33 um Grenzen zwischen den Gate-Isolierschichten und den Feldisolierschichten. -
3 und4 sind schematische Teilquerschnittsansichten des Leistungshalbleiterbauteils gemäß der vorliegenden Erfindung entlang A-A' bzw. B-B' in der Draufsicht von2 . -
3 und4 zeigen, dass die Drift-Schicht21 aus Siliciumcarbid des n-Typs auf der Oberfläche des über einen geringen Widerstand verfügenden Substrats20 aus Siliciumcarbid des n-Typs ausgebildet ist. In einigen Oberflächenzonen der Drift-Schicht21 sind unter dem Abtastkontaktfleck13 mehrere Abtastzellenwannenzonen42 aus Siliciumcarbid des p-Typs ausgebildet. In einem vorbestimmten Abstand in einer seitlichen Richtung entlang des Querschnitts ist abseits von einer der Abtastzellenwannenzonen42 die Abtastzellenumfangswannenzone43 aus Siliciumcarbid des p-Typs in einer Oberflächenzone der Drift-Schicht21 ausgebildet. In einem vorbestimmten Abstand in der seitlichen Richtung entlang des Querschnitts ist abseits von der Abtastzellenumfangswannenzone43 die Abtastkontaktfleckwannenzone44 aus Siliciumcarbid des p-Typs in einer Oberflächenzone der Drift-Schicht21 ausgebildet. In einem vorbestimmten Abstand ist abseits von der Abtastkontaktfleckwannenzone44 die Abtastkontaktfleckgrenzwannenzone45 in einer Oberflächenzone der Drift-Schicht21 ausgebildet. - In einem vorbestimmten Abstand in der seitlichen Richtung entlang des Querschnitts sind abseits von der Abtastkontaktfleckgrenzwannenzone
45 eine Anzahl der Hauptzellenwannenzonen41 aus Siliciumcarbid des p-Typs in Oberflächenzonen der Drift-Schicht21 ausgebildet. - In einer Oberflächenzone der Drift-Schicht
21 (der rechten Seite von4 ), die sich außerhalb der Hauptzellenzone erstreckt, in der die vielen Hauptzellenwannenzonen41 von der Oberseite des Leistungshalbleiterbauteils der vorliegenden Erfindung gesehen ausgebildet sind, ist die Umfangsgrenzwannenzone47 aus Siliciumcarbid des p-Typs in einem vorbestimmten Abstand abseits von den äußersten Hauptzellenwannenzonen41 ausgebildet. In einer weiteren äußeren Oberflächenzone der Drift-Schicht21 (der rechten Seite von4 ), die sich außerhalb der Umfangsgrenzwannenzone47 erstreckt, ist die Umfangswannenzone46 aus Siliciumcarbid des p-Typs in einem vorbestimmten Abstand abseits von der Umfangsgrenzwannenzone47 ausgebildet. In einer weiteren äußeren Oberflächenzone der Drift-Schicht21 (der rechten Seite von4 ), die sich außerhalb der Umfangswannenzone46 erstreckt, ist die JTE-Zone40 aus dem Siliciumcarbid des p-Typs ausgebildet. Obwohl in2 nicht dargestellt, ist eine Feldstoppzone83 aus Siliciumcarbid des n-Typs außerhalb der JTE-Zone40 (der rechten Seite von4 ) in einem vorbestimmten Abstand gesondert ausgebildet. - Auf der Innenseite in einer seitlichen Querschnittsrichtung einer Oberflächenzone jeder Hauptzellenwannenzone
41 ist eine Haupt-Source-Zone81 des n-Typs ausgebildet; und auf der weiteren Innenseite der ausgebildeten Zone befindet sich eine über geringen Widerstand verfügende Kontaktzone91 des p-Typs. Auf dieselbe Weise ist auf der Innenseite in einer seitlichen Querschnittsrichtung einer Oberflächenzone jeder der Abtastzellenwannenzonen42 eine Abtast-Source-Zone82 des n-Typs ausgebildet; und auf der weiteren Innenseite der ausgebildeten Zone befindet sich eine über geringen Widerstand verfügende Kontaktzone92 des p-Typs. - Feldisolierschichten
31 sind auf der Abtastkontaktfleckwannenzone44 , der Umfangswannenzone46 und der JTE-Zone40 ausgebildet; Gate-Isolierschichten30 sind auf den Hauptzellenwannenzonen41 , den Abtastzellenwannenzonen42 , der Abtastzellenumfangswannenzone43 , der Abtastkontaktfleckgrenzwannenzone45 und der Umfangsgrenzwannenzone47 ausgebildet. - Gate-Elektroden
50 sind teilweise auf den Gate-Isolierschichten30 und den Feldisolierschichten31 ausgebildet; eine Zwischenlagenisolierschicht32 ist auf den Gate-Isolierschichten30 , den Feldisolierschichten31 und den Gate-Elektroden50 ausgebildet. Wie in2 erläutert wurde, sind an vorbestimmten Stellen in den Gate-Isolierschichten30 , den Feldisolierschichten31 und der Zwischenlagenisolierschicht32 die Source-Kontaktöffnungen61 , die Abtast-Source-Kontaktöffnungen62 , die Abtastzellenumfangswannenkontaktöffnungen63 , die Abtastkontaktfleckwannenkontaktöffnungen64 , die Abtastkontaktfleckgrenzwannenkontaktöffnungen65 , die Umfangswannenkontaktöffnungen66 und die Umfangsgrenzwannenkontaktöffnungen67 ausgebildet. Kontaktzonen91 bis97 aus Siliciumcarbid des p-Typs mit geringem Widerstand sind unter den Source-Kontaktöffnungen61 , den Abtast-Source-Kontaktöffnungen62 , den Abtastzellenumfangswannenkontaktöffnungen63 , den Abtastkontaktfleckwannenkontaktöffnungen64 , den Abtastkontaktfleckgrenzwannenkontaktöffnungen65 , den Umfangswannenkontaktöffnungen66 bzw. den Umfangsgrenzwannenkontaktöffnungen67 ausgebildet. - Der Abtastkontaktfleck
13 ist so ausgebildet, dass er die Abtast-Source-Kontaktöffnungen62 mit den Abtastzellenumfangswannenkontaktöffnungen63 verbindet. Der Source-Kontaktfleck10 ist so ausgebildet, dass er die Source-Kontaktöffnungen61 , die Abtastkontaktfleckwannenkontaktöffnungen64 , die Abtastkontaktfleckgrenzwannenkontaktöffnungen65 , die Umfangsgrenzwannenkontaktöffnungen67 und die Umfangswannenkontaktöffnungen66 verbindet. - Um den Widerstand zwischen jeweils den Wannenzonen
41 bis47 und dem Source-Kontaktfleck10 oder dem Abtastkontaktfleck13 zu senken, ist eine ohmsche Elektrode71 auf dem Grund jeder der Source-Kontaktöffnungen61 , der Abtast-Source-Kontaktöffnungen62 , der Abtastzellenumfangswannenkontaktöffnungen63 , der Abtastkontaktfleckwannenkontaktöffnungen64 , der Abtastkontaktfleckgrenzwannenkontaktöffnungen65 , der Umfangswannenkontaktöffnungen66 bzw. der Umfangsgrenzwannenkontaktöffnungen67 ausgebildet. Eine Drain-Elektrode14 ist auf der entgegengesetzten Seite des Substrats20 ausgebildet, wobei eine hintere ohmsche Elektrode72 dazwischen eingesetzt ist. - Gate-Kontaktöffnungen
68 sind die Zwischenlagenisolierschicht32 durchdringend ausgebildet, um eine Verbindung zwischen den Gate-Elektroden50 auf der Feldisolierschicht31 und der Gate-Verdrahtung12 oder dem Gate-Kontaktfleck11 herzustellen. - Bei der vorstehenden Auslegung ist eine p-n-Diode zwischen der Drift-Schicht
21 des n-Typs und jeder der Wannenzonen (41 bis47 ) des p-Typs in dem Leistungshalbleiterbauteil gemäß der Ausführungsform vorgesehen. Das heißt, es sind eine Haupt-MOS-Diode (D1 ) für jede Hauptzellenwannenzone41 , eine Abtast-MOS-Diode (D2 ) für jede Abtastzellenwannenzone42 , eine Abtastzellenumfangsdiode (D3 ) für die Abtastzellenumfangswannenzone43 , eine Abtastkontaktfleckdiode (D4 ) für die Abtastkontaktfleckwannenzone44 , und eine Abtastkontaktfleckgrenzdiode (D5 ) für die Abtastkontaktfleckgrenzwannenzone45 ausgebildet. Es sind auch eine Umfangswannendiode (D6 ) zwischen der Umfangswannenzone46 und der Drift-Schicht21 , und eine Umfangsgrenzwannendiode (D7 ) zwischen der Umfangsgrenzwannenzone47 und der Drift-Schicht21 ausgebildet. Eine Diode zwischen der JTE-Zone40 und der Drift-Schicht21 ist an die Umfangswannendiode (D6 ) angeschlossen; deshalb wird die Diode als ein Teil der Umfangswannendiode (D6 ) erachtet. - Ein Verfahren zum Herstellen eines Leistungshalbleiterbauteils gemäß der Ausführungsform wird anhand von
5 und6 erläutert.5 und6 sind schematische Teilquerschnittsansichten des Leistungshalbleiterbauteils zur Erläuterung von Herstellungsschritten für das Leistungshalbleiterbauteil gemäß der Ausführungsform; in5 und6 entspricht jede der Ansichten ,(a)' einer Querschnittsansicht entlangA-A' von2 , und jede der Ansichten ,(b)' entspricht einer Querschnittsansicht entlangB-B' von2 . - Das Verfahren zum Herstellen des Leistungshalbleiterbauteils gemäß der Ausführungsform wird nachstehend der Reihe nach erläutert.
- Zuerst wird durch ein chemisches Abscheidungsverfahren aus der Dampfphase (CVD-Verfahren) die Drift-Schicht
21 aus Siliciumcarbid auf einer Oberfläche (erste Hauptfläche) des über einen geringen Widerstand verfügenden Siliciumcarbid-Halbleitersubstrats20 des n-Typs epitaktisch so aufgezogen, dass die Drift-Schicht eine Fremdstoffkonzentration des n-Typs von 1 × 1013 cm-3 bis 1 × 1018 cm-3 und eine Dicke von 4 bis 200 µm hat. Als das Siliciumcarbid-Halbleitersubstrat20 wird ein Siliciumcarbid-Halbleitersubstrat des 4H-Polytpys verwendet, dessen Flächenorientierung um 8 Grad oder weniger aus der C-Achse an der (0001)-Fläche geneigt ist. Jedoch können auch andere Flächenorientierungen, Polytypen und Neigungswinkel verwendet werden, und die Flächenorientierung kann auch nicht geneigt sein. - Als Nächstes werden, wie in
5 gezeigt, die Hauptzellenwannenzonen41 des p-Typs, die Abtastzellenwannenzonen42 des p-Typs, die Abtastzellenumfangswannenzone43 des p-Typs, die Abtastkontaktfleckwannenzone44 des p-Typs, die Abtastkontaktfleckgrenzwannenzone45 des p-Typs, die Umfangswannenzone46 des p-Typs, die Umfangsgrenzwannenzone47 des p-Typs, die JTE-Zone40 des p-Typs, die Haupt-Source-Zonen81 des n-Typs, die Abtast-Source-Zonen82 des n-Typs, die Feldstoppzone83 des n-Typs und die Kontaktzonen91 bis97 des p-Typs an vorbestimmten Stellen in der Oberfläche der Drift-Schicht21 durch ein Ionenimplantationsverfahren ausgebildet. Als Fremdstoffe des p-Typs eignet sich für die Ionenimplantation Al (Aluminium) oder B (Bor); als Fremdstoffe des n-Typs eignet sich für die Ionenimplantation N (Stickstoff) oder P (Phosphor). Während der Ionenimplantation kann das Substrat20 nicht positiv erwärmt werden oder kann auf 200 bis 800 Grad C erwärmt werden. - Es ist notwendig, die Tiefen der Wannenzonen
41 bis47 und der JTE-Zone40 nicht tiefer anzusetzen als die Grundfläche der Drift-Schicht21 , d.h. der epitaktischen Kristallwachstumsschicht; die Tiefen werden beispielsweise in einem Bereich von 0,3 bis 2 µm angesetzt. Die Fremdstoffkonzentrationen des p-Typs der Wannenzonen41 bis47 werden in einer höheren Konzentration als die Fremdstoffkonzentration der Drift-Schicht21 und in einem Bereich zwischen 1 x 1015 cm-3 und 1 × 1019 cm-3 angesetzt. Der Herstellungsprozess lässt sich vereinfachen, indem dieselbe Tiefe und Fremdstoffkonzentration für die Wannenzonen41 bis47 angesetzt wird. Indem alternativ die Fremdstoffkonzentrationen der Abtastkontaktfleckwannenzone44 und der Umfangswannenzone46 , die über große Flächen verfügen, höher angesetzt werden als diejenigen der übrigen Wannenzonen, kann eine Spannung, die durch einen später noch zu beschreibenden Verschiebungsstrom erzeugt wird, gesenkt werden. - Bei den Haupt-Source-Zonen
81 und den Abtast-Source-Zonen82 werden deren Tiefen so angesetzt, dass deren Unterseiten nicht tiefer sind als diejenigen der Hauptzellenwannenzonen41 und der Abtastzellenwannenzonen42 , und deren Fremdstoffkonzentrationen des n-Typs werden in einer höheren Konzentration als diejenigen der Fremdstoffkonzentrationen des p-Typs der Hauptzellenwannenzonen41 und der Abtastzellenwannenzonen42 und in einem Bereich zwischen 1 × 1017 cm-3 und 1 × 1021 cm-3 angesetzt. Die Feldstoppzone83 wird unter derselben Bedingung ausgebildet wie die Haupt-Source-Zonen81 und die Abtast-Source-Zonen82 . - Jedoch können in der Oberseitennachbarschaft der Drift-Schicht
21 die jeweiligen Fremdstoffkonzentrationen des p-Typs der Wannenzonen41 bis47 niedriger sein als die Fremdstoffkonzentration der Drift-Schicht21 , um die Leitfähigkeit der MOSFET-Kanalzonen zu erhöhen. - Die Kontaktzonen
91 bis97 werden so vorgesehen, dass die ohmschen Elektroden71 sandwichartig zwischen den Kontaktzonen und den jeweiligen Wannenzonen41 bis47 eingeschlossen sind, um einen guten elektrischen Kontakt zwischen den Wannenzonen und dem Source-Kontaktfleck10 oder dem Abtastkontaktfleck13 zu erzielen; es ist gewünscht, dass die Fremdstoffkonzentrationen der Kontaktzonen höher angesetzt werden als diejenigen der jeweiligen Fremdstoffkonzentrationen des p-Typs der Wannenzonen41 bis47 . Außerdem ist es beim Durchführen einer hoch fremdstoffhaltigen Ionenimplantation gewünscht, dass das Substrat20 für die Ionenimplantation auf 150°C oder mehr erwärmt wird, damit die Kontaktzonen91 bis97 einen geringen Widerstand haben. - Danach erfolgt ein Tempervorgang in einer Inertgasatmosphäre wie etwa Argon-(Ar)-Gas oder Stickstoffgas oder in einem Vakuum bei einer Temperatur in einem Bereich von 1500 bis 2200°C für 0,5 bis 60 Minuten, um die durch die Ionenimplantation eingeschleppten Fremdstoffe elektrisch zu aktivieren. Beim Durchführen des Tempervorgangs können das Substrat
20 und darauf gebildete Schichten unter einer Bedingung getempert werden, dass sie mit einer Kohlenstoffschicht abgedeckt sind. Das Kohlenstoffschichtabdeckungstempern kann verhindern, dass die Oberfläche des Siliciumcarbids durch Restfeuchtigkeit oder Restsauerstoff aufgeraut wird, die/der in einer Vorrichtung während des Temperns erzeugt wird. - Als Nächstes wird die ionenimplantierte Oberfläche der Drift-Schicht
21 opferoxidiert, um eine thermische Oxidationsschicht zu bilden, und dann wird, indem die thermische Oxidationsschicht entfernt wird, die veränderte Schicht in der Oberfläche der ionenimplantierten Drift-Schicht21 entfernt, um eine saubere Fläche freizulegen. Danach werden unter Verwendung eines CVD-Verfahrens, einer Fotolithografietechnik o. dgl. Siliciumdioxidschichten, die als die Feldisolierschichten31 bezeichnet werden und eine Schichtdicke von ca. 0,5 bis 2 µm haben, an Stellen mit Ausnahme von denen ausgebildet, die in etwa der vorstehend erwähnten Hauptzellenzone und Abtastzellenzone entsprechen. - Hierbei wird beispielsweise eine Feldisolierschicht
31 über der Oberfläche ausgebildet, dann Fotolithografie, Ätzen o. dgl. an Abschnitten der Feldisolierschicht31 durchgeführt, die in etwa beiden Zellenzonen entsprechend angeordnet sind. Außerdem werden vorab die Abschnitte der Feldisolierschicht31 entfernt, in denen die Kontaktöffnungen ausgebildet werden sollen, indem sie die Feldisolierschicht31 durchdringen. - Als Nächstes werden, wie in den Querschnittsansichten in
6 gezeigt, die aus einer Siliciumdioxidschicht bestehenden Gate-Isolierschichten30 unter Verwendung eines thermischen Oxidationsverfahrens oder eines Abscheidungsverfahrens über aktiven Zonen wie etwa den Hauptzellenwannenzonen41 und den Abtastzellenwannenzonen42 so ausgebildet, dass sie eine dünnere Dicke als die Feldisolierschichten31 , beispielsweise ca. ein Zehntel der Dicke der Feldisolierschichten31 haben. - Es reicht aus, dass die Gate-Isolierschichten
30 eine Schichtdicke von 30 nm bis 300 nm, oder bevorzugter von 50 nm bis 150 nm haben. Außerdem hängt diese Schichtdicke von den Pegeln der Gate-Spannung und dem elektrischen Gate-Feld zum Ansteuern (Schalten) von MOSFETs ab; somit reicht es vorzugsweise aus, dass das elektrische Gate-Feld (das an die Gate-Isolierschichten30 angelegte elektrische Feld) 3 MV/cm oder weniger beträgt. - Als Nächstes werden, wie in
6 gezeigt, Gate-Elektroden50 aus Polysiliciummaterial an vorbestimmten Stellen auf den Gate-Isolierschichten30 und den Feldisolierschichten31 unter Verwendung eines CVD-Verfahrens, einer Fotolithografietechnik o. dgl. ausgebildet. Es ist vorzuziehen, dass das für die Gate-Elektroden50 verwendete Polysilicium „P “ oder „B “ enthält, damit es einen geringen Widerstand hat. „P “ oder „B “ kann während der Polysiliciumschichtausbildung eingebracht werden oder nach der Schichtausbildung durch ein Ionenimplantationsverfahren eingebracht werden. - Als Nächstes wird auf den Gate-Elektroden
50 u. dgl. die aus einer Siliciumdioxidschicht bestehende Zwischenlagenisolierschicht32 durch ein Abscheidungsverfahren wie etwa ein CVD-Verfahren ausgebildet. Unter Verwendung einer Fotolithografietechnik und einer Trockenätztechnik werden als Nächstes Abschnitte der Zwischenlagenisolierschicht32 entfernt, in denen die Source-Kontaktöffnungen61 , die Abtast-Source-Kontaktöffnungen62 , die Abtastzellenumfangswannenkontaktöffnungen63 , die Abtastkontaktfleckwannenkontaktöffnungen64 , die Abtastkontaktfleckgrenzwannenkontaktöffnungen65 , die Umfangsgrenzwannenkontaktöffnungen67 und die Umfangswannenkontaktöffnungen66 ausgebildet werden sollen. Dabei können zur selben Zeit die Gate-Kontaktöffnungen68 ausgebildet werden, wie später noch beschrieben wird, um die Herstellungsschritte zu vereinfachen. - Als Nächstes werden Metallschichten, deren Hauptbestandteil Ni ist, durch ein Sputter-Verfahren o. dgl. ausgebildet; und dann erfolgt eine Wärmebehandlung bei einer Temperatur zwischen 600 und 1100°C, so dass die Metallschichten, deren Hauptbestandteil Ni ist, mit der Siliciumcarbidschicht reagieren, um Silicid zwischen der Siliciumcarbidschicht und den Metallschichten zu bilden. Als Nächstes werden Metallschichtabschnitte mit Ausnahme des Silicids, die nicht umgesetzt auf der Zwischenlagenisolierschicht
32 verbleiben, durch Nassätzen mit Schwefelsäure, Salpetersäure oder Salzsäure oder mit einem Wasserstoffperoxidlösungsgemisch mit einer der Säuren entfernt. - Die Silicidabschnitte, die sich wie vorstehend in den Source-Kontaktöffnungen
61 , den Abtast-Source-Kontaktöffnungen62 , den Abtastzellenumfangswannenkontaktöffnungen63 , den Abtastkontaktfleckwannenkontaktöffnungen64 , den Abtastkontaktfleckgrenzwannenkontaktöffnungen65 , den Umfangsgrenzwannenkontaktöffnungen67 und den Umfangswannenkontaktöffnungen66 gebildet haben, dienen als die in3 und4 gezeigten ohmschen Elektroden71 zur ohmschen Verbindung mit beiden Siliciumcarbidzonen des n-Typs wie etwa den Haupt-Source-Zonen81 , und den Siliciumcarbidzonen des p-Typs wie etwa den Hauptzellenwannenzonen41 . - Darüber hinaus werden Abschnitte der Zwischenlagenisolierschicht
32 , in denen die Gate-Kontaktöffnungen68 ausgebildet werden sollen, unter Verwendung einer Fotolithografietechnik und einer Trockenätztechnik entfernt. Als Nächstes wird ein Metallabschnitt, dessen Hauptbestandteil Ni ist, auf der Rückseite (zweiten Hauptfläche) des Substrats20 ausgebildet und dann erwärmt, um die hintere ohmsche Elektrode72 auf der Rückseite des Substrats20 auszubilden. - Danach wird ein Verdrahtungsmetall wie etwa „AI“ durch ein Sputter-Verfahren oder ein Dampfabscheidungsverfahren auf dem Substrat
20 ausgebildet, nachdem dieses wie vorstehend bearbeitet wurde, und dann wird das Verdrahtungsmetall durch eine Fotolithografietechnik zu vorbestimmten Formen verarbeitet, um den Source-Kontaktfleck10 , den Gate-Kontaktfleck11 , die Gate-Verdrahtung12 und den Abtastkontaktfleck13 auszubilden. Darüber hinaus wird die Drain-Elektrode14 ausgebildet, indem eine Metallschicht auf der Oberfläche der hinteren ohmschen Elektrode72 auf der Rückseite des Substrats ausgebildet wird, wodurch die Herstellung des Leistungshalbleiterbauteils abgeschlossen wird, dessen Querschnittsansichten in3 und4 gezeigt sind. - Als Nächstes wird ein elektrischer Schaltungsaufbau des Leistungshalbleiterbauteils gemäß der Ausführungsform erläutert.
7 ist ein Ersatzschaltungsschema, das den Aufbau des Leistungshalbleiterbauteils gemäß der Ausführungsform erläutert. - In dem wie in
7 gezeigten Leistungshalbleiterbauteil gemäß der Ausführungsform umfasst ein Haupt-MOSFET (ein MOSFET „M1“ in der Hauptzelle) eine Haupt-MOS-Diode (eine Körperdiode „D1“), und ein Abtast-MOSFET (ein MOSFET „M2 “ in der Abtastzelle) umfasst eine Abtast-MOS-Diode (eine Körperdiode „D2“). Die Gates des Haupt-MOSFETs (M1 ) und des Abtast-MOSFETs (M2 ) sind an den Gate-Kontaktfleck11 oder die Gate-Verdrahtung12 angeschlossen. Die Sources des Haupt-MOSFETs (M1 ) und des Abtast-MOSFETs (M2 ) sind an den Source-Kontaktfleck10 bzw. den Abtastkontaktfleck13 angeschlossen. - Wie in
3 und4 erläutert wurde, sind die p-n-Dioden (D1 bis D7) zwischen der Drift-Schicht21 des n-Typs und den jeweiligen Wannenzonen des p-Typs (41 - 47) ausgebildet, und die Kathode jeder der Dioden ist an die Drain-Elektrode14 angeschlossen. Die Anoden der Haupt-MOS-Diode (D1 ), der Abtastkontaktfleckdiode (D4 ), der Abtastkontaktfleckgrenzdiode (D5 ), der Umfangswannendiode (D6 ) und der Umfangsgrenzwannendiode (D7 ) sind an den Source-Kontaktfleck10 angeschlossen; die Anoden der Abtast-MOS-Diode (D2 ) und der Abtastzellenumfangsdiode (D3 ) sind an den Abtastkontaktfleck13 angeschlossen. - Als Nächstes werden die Funktionsabläufe des Leistungshalbleiterbauteils gemäß der Ausführungsform erklärt. Wenn Spannung an den Gate-Kontaktfleck
11 (die Gate-Verdrahtung12 ) des Ersatzschaltungsschemas in7 angelegt wird, so dass der Haupt-MOSFET (M1 ) und der Abtast-MOSFET (M2 ) vom Ein- zum Auszustand umschalten, steigt die Drain-Spannung des Haupt-MOSFETs (M1 ) und des Abtast-MOSFETs (M2 ) an, d.h. die Spannung der Drain-Elektrode14 steigt rasch von ungefähr null Volt auf mehrere hundert Volt an. Dann bewegen sich elektrische Ladungen, die in der Haupt-MOS-Diode (D1 ), der Abtast-MOS-Diode (D2 ), der Abtastzellenumfangsdiode (D3 ), der Abtastkontaktfleckdiode (D4 ), der Abtastkontaktfleckgrenzdiode (D5 ), der Umfangswannendiode (D6 ) und der Umfangsgrenzwannendiode (D7 ) gespeichert sind, auf eine Weise, dass sich kathodenseitige elektrische Ladungen von der Drift-Schicht21 durch das Substrat20 zur Drain-Elektrode14 begeben, und anodenseitige elektrische Ladungen sich von den Wannenzonen41 bis47 und der JTE-Zone40 durch die jeweiligen Kontaktöffnungen zum Source-Kontaktfleck10 oder dem Abtastkontaktfleck13 begeben. Hier werden diese elektrischen Ladungsbewegungen zu Verschiebungsströmen. - Dabei erzeugt der anodenseitig fließende Verschiebungsstrom eine Spannung, die durch den Verschiebungsstromwert und einen Widerstandswert von Zonen, in denen der Verschiebungsstrom fließt, einschließlich von Kontaktwiderständen in der unmittelbaren Umgebung der Kontaktöffnung bestimmt ist. Weil die Hauptzellenwannenzonen
41 und die Abtastzellenwannenzonen42 jeweils in eine einzelne Einheitszelle unterteilt sind und keine großen Flächen haben, um über geringe innere parasitäre Widerstände zu verfügen, bleibt die erzeugte Spannung innerhalb eines bestimmten Pegels, auch wenn der Strom einen großen Wert hat. Weil andererseits die Abtastkontaktfleckwannenzone44 und eine Zone des p-Typs, die die Umfangswannenzone46 und die daran angeschlossene JTE-Zone40 enthält, große Flächen und fern von den Kontaktöffnungen befindliche Wannenzonen haben, um über relativ große Widerstände der Stromwege zu verfügen, entstehen große Spannungen in der unmittelbaren Umgebung der Kontaktöffnungen. - Je größer außerdem eine Veränderung dV/dt bei der Drain-Spannung
V im Hinblick auf Zeit ist, umso größer sind auch die Spannungen, die in der unmittelbaren Umgebung der Kontaktöffnungen entstehen. - Wenn die Gate-Elektroden
50 auf den Gate-Isolierschichten30 ausgebildet sind, die sich auf Wannenzonen befinden, in denen ein solch großes elektrisches Potential entsteht, tritt manchmal ein dielektrischer Durchbruch in einem Abschnitt der Gate-Isolierschichten30 zwischen den Gate-Elektroden50 von MOSFETs, die sich in einem Auszustand von ungefähr null Volt befinden, und einem Abschnitt auf, in dem das große elektrische Potential entsteht. - Bei dem Leistungshalbleiterbauteil gemäß der Ausführungsform ist die über eine große Fläche verfügende Abtastkontaktfleckwannenzone
44 mit der Feldisolierschicht31 bedeckt, die dicker ist als die Gate-Isolierschichten30 , und die Gate-Elektroden50 sind auf der Feldisolierschicht31 ausgebildet. Deshalb kann selbst in einem Fall, bei dem ein Betrieb unter einer Bedingung mit hohem dV/dt eine große Spannung in der Abtastkontaktfleckwannenzone44 erzeugt, die durch einen Verschiebungsstrom verursacht wird, die Stärke eines in den Gate-Isolierschichten30 erzeugten elektrischen Felds gesenkt werden, was dem Leistungshalbleiterbauteil eine hohe Zuverlässigkeit verleiht. - Hier erfolgt erneut eine Erklärung zu einem Hochgeschwindigkeitsansteuerbetrieb, d.h. einem Ansteuerbetrieb bei hohem dV/dt, eines MOSFETs, der aus einem Halbleitermaterial mit breitem Bandabstand wie etwa Siliciumcarbid hergestellt ist.
- Ein herkömmlicher Si-MOSFET, d.h. ein Unipolarbauteil, in dem Si (Silicium) verwendet wird, wird mit einer relativ hohen Geschwindigkeit von 20 V/nsec oder darüber betrieben; weil bei einem Betrieb bei einer Spannung von ca. 1 kV oder darüber Leitungsverluste stark zunehmen, wurde die Betriebsspannung auf einen Bereich von mehreren zehn Volt bis mehreren hundert Volt begrenzt. Somit wurde in einem hohen Spannungsbereich von ca. 1 kV oder darüber, ausschließlich ein Si-IGBT (Isolierschicht-Bipolartransistor) verwendet. Weil es sich jedoch bei dem IGBT um ein bipolares Bauteil handelt, war es wegen der Minoritätsladungsträgerwirkung schwierig, eine Hochgeschwindigkeitsschalteigenschaft wie bei einem unipolaren Bauteil zu erhalten. Weil im Spezielleren die Zunahme bei dV/dt den Schaltverlust nicht stark verringern kann, wurde er höchstens bei einer Betriebsgeschwindigkeit von ca. mehreren Volt pro Nanosekunde verwendet.
- Hingegen kann ein MOSFET, bei dem ein Halbleitermaterial mit weitem Bandabstand wie etwa Siliciumcarbid verwendet wird, einen geringen Leitungsverlust in einem hohen Spannungsbereich von über 1 kV aufweisen. Darüber hinaus ist der MOSFET ein unipolares Bauteil, das mit einer hohen Geschwindigkeit betrieben werden kann, und sein Hochgeschwindigkeitsschaltbetrieb kann seinen Schaltverlust mindern. Deshalb können die Verluste beim Betrieb als Wechselrichter weiter gemindert werden.
- In einer solchen Betriebsumgebung erzeugt beispielsweise ein Hochgeschwindigkeitsschaltbetrieb bei 10 V/nsec oder schneller in einem hohen Spannungsbereich von 1 kV oder darüber, in dem das herkömmliche Si-Bauteil nicht verwendet wurde, ein während des Schaltens erzeugter Verschiebungsstrom, wie in der Beschreibung der Patentschrift 1 beschrieben, eine auffälligere Spannung in den P-Wannen.
- Darüber hinaus kommen in einem Fall, in dem ein MOSFET aus einem Siliciumcarbidhalbleitermaterial gebildet ist, keine Fremdstoffelemente des p-Typs in einer ausreichend geringen Tiefe im Siliciumcarbidbandabstand vor; somit kann kein Siliciumcarbid des p-Typs mit einem geringen spezifischen elektrischen Widerstand bei Raumtemperatur erhalten werden, und der Kontaktwiderstand zwischen dem Siliciumcarbid des p-Typs und Metall wird groß. Deshalb wird in dem Fall, in dem ein MOSFET-Leistungshalbleiterbauteil aus Siliciumcarbid aufgebaut ist, der Kontaktwiderstandswert zwischen Metall und aus Siliciumcarbid des p-Typs aufgebauten P-Wannen groß, so dass eine große Spannung durch den Verschiebungsstrom erzeugt wird.
- Dies sind die Gründe, warum ein Ansteuerbetrieb bei hohem dV/dt eines MOSFET-Leistungshalbleiterbauteils mit einem Halbleitermaterial weiten Bandabstands, insbesondere mit Siliciumcarbid, eine sehr hohe Spannung durch Verschiebungsstrom während des Schaltens erzeugt.
- Andererseits kann bei dem aus einem Halbleitermaterial mit weitem Bandabstand aufgebauten Leistungshalbleiterbauteil gemäß der Ausführungsform ein Betrieb selbst unter einer Bedingung mit hohem dV/dt wie etwa 10 V/nsec das elektrische Feld, das an eine Siliciumdioxidschicht, d.h. die Gate-Isolierschichten
30 , angelegt wird, auf ca. 3 MV/cm oder darunter reduzieren; somit lässt sich ein hoch zuverlässiges Leistungshalbleiterbauteil erzielen. - Darüber hinaus werden gemäß dem Herstellungsverfahren für das in der Ausführungsform erläuterte Leistungshalbleiterbauteil Abschnitte in den Feldisolierschichten
31 , die von den Kontaktöffnungen durchdrungen werden, auf dieselbe Weise bearbeitet wie Abschnitte, in denen die Gate-Isolierschichten30 ausgebildet werden, wodurch sich das Leistungshalbleiterbauteil gemäß der Ausführungsform herstellen lässt, ohne die Herstellungsschritte im Vergleich zu denjenigen bei herkömmlichen Herstellungsverfahren für ein Leistungshalbleiterbauteil zu vermehren. - Außerdem hat bei dem Leistungshalbleiterbauteil gemäß der Ausführungsform die Feldisolierschicht
31 eine Größe, um die Abtastkontaktfleckwannenzone44 abzudecken; allerdings kann die Feldisolierschicht31 auch eine größere Fläche als diejenige der Abtastkontaktfleckwannenzone44 abdecken und kann sich, wie in einer Querschnittsansicht von8 gezeigt ist, zu den Oberseiten der Abtastzellenumfangswannenzone43 und der Abtastkontaktfleckgrenzwannenzone45 erstrecken. - Eine in der Querschnittsansicht von
8 gezeigte Struktur kann von der Spannung ausgehende Einflüsse mindern, die durch Verschiebungsstrom an Endabschnitten der Feldisolierschicht31 erzeugt wird. - Darüber hinaus können die Abtastkontaktfleckgrenzwannenzone
45 und die Umfangsgrenzwannenzone47 so ausgebildet sein, dass sie aneinander angeschlossen sind.9 ist eine Draufsicht, die hauptsächlich eine Siliciumcarbidschicht eines Leistungshalbleiterbauteils zeigt, bei dem der Abtastkontaktfleck13 angrenzend an die Gate-Verdrahtung12 ausgebildet ist.9 zeigt, dass die Abtastkontaktfleckgrenzwannenzone45 und die Umfangsgrenzwannenzone47 einen gemeinsamen Bereich haben. - Darüber hinaus können, wenn der Abtastkontaktfleck
13 und die Gate-Verdrahtung12 getrennt sind und der Abtastkontaktfleck13 eine kleinere Fläche hat als der Gate-Kontaktfleck11 , die Feldisolierschichten31 unter dem Abtastkontaktfleck13 und der Gate-Verdrahtung12 aneinander angeschlossen sein, wie in einer perspektivischen Draufsicht in10 gezeigt ist. - Zusätzlich sind die Formen des Source-Kontaktflecks
10 , des Gate-Kontaktflecks11 , des Abtastkontaktflecks13 u. dgl. nicht auf die in der Ausführungsform gezeigten beschränkt und es sind auch andere Formen zulässig. Beispielsweise wurde die Form des Abtastkontaktflecks13 als Rechteck gezeigt; jedoch kann seine Form, wie in seiner Oberseitenansicht in11 gezeigt, auch einen Abschnitt umfassen, der von einem rechteckigen Abschnitt vorsteht, und Abtastzellen (Abtastzellenwannenzonen42 ) können unter dem vorstehenden Abschnitt ausgebildet sein. Eine Ausbildung der Abtastzellen unter dem vorstehenden Abschnitt kann Einflüsse auf die Eigenschaften der Abtastzellen selbst dann minimieren, wenn ein Drahtkontaktierungsabschnitt auf dem Hauptabschnitt (dem rechteckigen Abschnitt) des Abtastkontaktflecks13 ausgebildet ist. - Darüber hinaus können die Umfangswannenzone
46 und die die Umfangsgrenzwannenzone47 so ausgebildet sein, dass sie aneinander angeschlossen sind, wie in einer perspektivischen Draufsicht in12 gezeigt ist. - Das Leistungshalbleiterbauteil gemäß der Ausführungsform ist aus Siliciumcarbidhalbleitern aufgebaut; deshalb ist in dem Bereich außerhalb der Gate-Verdrahtung
12 keine Feldring genannte Verdrahtung, keine an die Feldstoppzone83 angeschlossene Verdrahtung und keine Feldplatte genannte Verdrahtung eines Massepotentials vorgesehen, die im Allgemeinen in Siliciumhalbleitern verwendet werden. Und zwar deswegen, weil Siliciumcarbidhalbleiter selbst ein großes dielektrisches elektrisches Durchbruchsfeld haben. - Darüber hinaus können die Abstände zwischen benachbarten Wannen gleich oder verschieden sein. Beispielsweise ist es vorzuziehen, dass die Abstände zwischen der Abtastzellenumfangswannenzone
43 und der Abtastkontaktfleckwannenzone44 , der Abstand zwischen der Abtastkontaktfleckwannenzone44 und der Abtastkontaktfleckgrenzwannenzone45 , und der Abstand zwischen der Umfangswannenzone46 und Umfangsgrenzwannenzone47 enger sind als der Abstand zwischen benachbarten Hauptzellen, weil die Feldisolierschichten31 ganz oder teilweise über diesen Abständen ausgebildet sind. Ein übermäßig weiter Abstand zwischen den Wannenzonen erhöht das elektrische Feld, das über den Abstand an eine Isolierschicht wie etwa die Feldisolierschichten31 angelegt wird, was manchmal die Zuverlässigkeit des Leistungshalbleiterbauteils senkt. - Zusätzlich können der hintere ohmsche Kontakt
72 und der ohmsche Kontakt71 zur selben Zeit durch Tempern ausgebildet werden. Ein Material wie etwa eine Intermetallverbindung für die ohmschen Elektroden71 kann je nach den Kontaktöffnungen dasselbe oder verschieden sein. Die ohmschen Elektroden71 , die für die Source-Kontaktöffnungen61 u. dgl. verwendet werden, müssen mit sowohl Siliciumcarbid des n-Typs als auch Siliciumcarbid des p-Typs in ohmschem Kontakt stehen; allerdings reicht es aus, dass die ohmschen Elektroden71 , die für die jeweiligen Wannenkontaktöffnungen verwendet werden, mit den Siliciumcarbiden des p-Typs in ohmschem Kontakt stehen. Deshalb werden die ohmschen Elektroden in Abhängigkeit von ihrem Zweck geeignet ausgewählt. - Darüber hinaus kann, wenn eine Wärmebehandlung zum Ausbilden von Silicid für die ohmschen Elektroden
71 erfolgt, eine Wiedererwärmungsbehandlung erfolgen, nachdem Metallschichten entfernt wurden, die auf der Zwischenlagenisolierschicht32 zurückblieben. Die Wiedererwärmungsbehandlung bei einer höheren Temperatur kann ohmsche Kontakte mit einem geringeren Widerstand erzeugen. Darüber hinaus bildet sich, wenn die Wärmebehandlung zum Ausbilden von Silicid für die ohmschen Elektroden71 erfolgt, wenn die Gate-Kontaktöffnungen ausgebildet sind, Silicid aus den Polysilicium-Gate-Elektroden50 und einer Metallschicht, was bewirkt, dass die Gate-Kontakte einen geringen Widerstand haben. - Zusätzlich sind bei dem Leistungshalbleiterbauteil gemäß der Ausführungsform die elektrischen Potentiale von großflächigen Wannenzonen wie etwa der Abtastkontaktfleckwannenzone
44 und der Umfangswannenzone46 feststehend. Deshalb ist es nicht notwendig, eine Struktur wie etwa eine Feldplatte vorzusehen, wodurch das Bauteil minimiert wird. - Ausführungsform 2
-
13 ist eine perspektivische Draufsicht auf ein Leistungshalbleiterbauteil gemäß Ausführungsform2 der vorliegenden Erfindung von oben gesehen.14 ist eine schematische Teilquerschnittsansicht des Leistungshalbleiterbauteils gemäß der Ausführungsform entlangC-C' in der in13 gezeigten Draufsicht. -
13 und14 zeigen, dass bei dem Leistungshalbleiterbauteil gemäß dieser Ausführungsform die Abtastkontaktfleckwannenzone44 des p-Typs und die Abtastkontaktfleckgrenzwannenzone45 des p-Typs des Leistungshalbleiterbauteils gemäß Ausführungsform1 so ausgebildet sind, dass sie aneinander angeschlossen sind, und die Abtastkontaktfleckwannenkontaktöffnungen64 nahe an den Abtastkontaktfleckgrenzwannenkontaktöffnungen65 ausgebildet sind. Die Abtastkontaktfleckwannenzone44 ist elektrisch an den Source-Kontaktfleck10 angeschlossen. Die anderen Bestandteile sind dieselben wie die in Ausführungsform1 erläuterten, und deshalb werden deren Erläuterungen weggelassen. - Auch in dieser Ausführungsform ist die über eine große Fläche verfügende Abtastkontaktfleckwannenzone
44 mit der Feldisolierschicht31 bedeckt; deshalb kann selbst in einem Fall, bei dem ein Betrieb unter einer Bedingung mit hohem dV/dt einen Verschiebungsstrom in der Abtastkontaktfleckwannenzone44 erzeugt, der eine große Spannung hervorruft, das in den Gate-Isolierschichten30 entstehende elektrische Feld unterdrückt werden, was dem Leistungshalbleiterbauteil ein hohe Zuverlässigkeit verleiht. - Darüber hinaus können ähnlich dem Leistungshalbleiterbauteil gemäß Ausführungsform
1 die Umfangswannenzone46 und die Umfangsgrenzwannenzone47 so ausgebildet sein, dass sie miteinander verbunden sind. - In den vorstehend beschriebenen Ausführungsformen
1 und2 sind Fälle offenbart, bei denen es sich bei Halbleiterbauteilen, die in den Zellenzonen ausgebildet sind, um Vertikal-MOSFETs handelt. Jedoch wird selbst dann, wenn ein Halbleiterbauteil mit IGBT-Zellenzonen so aufgebaut ist, dass beispielsweise eine Kollektorschicht des zweiten Leitfähigkeitstyps zwischen dem Substrat20 und der hinteren ohmschen Elektrode72 auf der in3 gezeigten Rückflächenseite vorgesehen ist, dem Halbleiterbauteil mit IGBT-Zellenzonen dieselbe wie vorstehend beschriebene Wirkung der Erfindung verliehen. Deshalb umfasst die Reichweite der durch die vorliegende Erfindung erbrachten Wirkung ein Halbleiterelement wie etwa einen MOSFET und einen IGBT, die eine MOS-Struktur haben, um als Schaltelement zu dienen. Zusätzlich entspricht in einem Fall, in dem es sich bei einem solchen Halbleiterbauteil um einen IGBT handelt, der Drain des MOSFETs einem Kollektor und die Source des MOSFETs einem Emitter. - Darüber hinaus kann bei einem MOSFET der Grabenbauart, bei dem Kanalzonen von Hauptzellen und Abtastzellen senkrecht zur Oberfläche eines Substrats
20 ausgebildet sind, indem Feldisolierschichten31 durchdringende Abtastkontaktfleckwannenkontaktöffnungen64 so unter einem Abtastkontaktfleck13 vorgesehen werden, dass eine Verbindung zu einer Abtastkontaktfleckwannenzone44 hergestellt ist, eine Spannung, die ein Verschiebungsstrom an/um Gate-Isolierschichten30 in unmittelbarer Umgebung eines über eine große Fläche verfügenden Abtastkontaktflecks erzeugt, selbst im Falle eines Hochgeschwindigkeitsausschaltens gesenkt werden, wodurch die Stärke des in den Gate-Isolierschichten30 induzierten elektrischen Felds reduziert wird. - Zusätzlich hängt die Wirkung der vorliegenden Erfindung, wenn ein Leistungshalbleiterbauteil mit der in den Ausführungsformen 1 und 2 beschriebenen Leistungshalbleiterbauteilstruktur versehen ist, nicht von Herstellungsverfahren ab; deshalb kann dem Leistungshalbleiterbauteil auch dann eine hohe Zuverlässigkeit verliehen werden, wenn es durch ein anderes als das in Ausführungsform 1 beschriebene Herstellungsverfahren hergestellt wird.
- Darüber hinaus sind in der vorliegenden Erfindung Halbleiterbauteile, die selbst eine in den Ausführungsformen 1 und 2 beschriebene MOSFET-Struktur haben, als „Halbleiterbauteile“ in einem engen Sinn definiert; in einem weiten Sinn wird beispielsweise auch ein Leistungsbaustein mit eingebundenem Halbleiterbauteil selbst als „Halbleiterbauteil“ definiert, wie etwa ein Wechselrichterbaustein, der an einem Kontaktrahmen angebracht und mit einem Halbleiterbauteil mit der MOSFET-Struktur versiegelt ist, eine Freilaufdiode, die in einer umgekehrten Richtung parallel an das Halbleiterbauteil angeschlossen ist, eine Steuerschaltung zum Erzeugen einer an das Gate des Leistungshalbleiterbauteils anzulegenden Spannung, u. dgl.
- Bezugszeichenliste
-
- 10
- Source-Kontaktfleck
- 11
- Gate-Kontaktfleck
- 12
- Gate-Verdrahtung
- 13
- Abtastkontaktfleck
- 14
- Drain-Elektrode
- 20
- Substrat
- 21
- Drift-Schicht
- 30
- Gate-Isolierschicht
- 31
- Feldisolierschicht
- 32
- Zwischenlagenisolierschicht
- 33
- Gate-Isolierschicht-/Feldisolierschichtgrenze
- 40
- JTE-Zone
- 41
- Hauptzellenwannenzone
- 42
- Abtastzellenwannenzone
- 43
- Abtastzellenumfangswannenzone
- 44
- Abtastkontaktfleckwannenzone
- 45
- Abtastkontaktfleckgrenzwannenzone
- 46
- Umfangswannenzone
- 47
- Umfangsgrenzwannenzone
- 50
- Gate-Elektrode
- 61
- Source-Kontaktöffnung
- 62
- Abtast-Source-Kontaktöffnung
- 63
- Abtastzellenumfangswannenkontaktöffnung
- 64
- Abtastkontaktfleckwannenkontaktöffnung
- 65
- Abtastkontaktfleckgrenzwannenkontaktöffnung
- 66
- Umfangswannenkontaktöffnung
- 67
- Umfangsgrenzwannenkontaktöffnung
- 68
- Gate-Kontaktöffnung
- 71
- ohmsche Elektrode
- 72
- hintere ohmsche Elektrode
- 81
- Haupt-Source-Zone
- 82
- Abtast-Source-Zone
- 83
- Feldstoppzone
- 91 - 97
- Kontaktzone
- D1
- Haupt-MOS-Diode
- D2
- Abtast-MOS-Diode
- D3
- Abtastzellenumfangsdiode
- D4
- Abtastkontaktfleckdiode
- D5
- Abtastkontaktfleckgrenzdiode
- D6
- Umfangswannendiode
- D7
- Umfangswannengrenzdiode
- M1
- Haupt-MOSFET
- M2
- Abtast-MOSFET
Claims (6)
- Leistungshalbleiterbauteil, Folgendes aufweisend: ein Halbleitersubstrat eines ersten Leitfähigkeitstyps; eine Drift-Schicht des ersten Leitfähigkeitstyps, die auf einer ersten Hauptflächenseite des Halbleitersubstrats ausgebildet ist; mehrere Hauptzellenwannenzonen eines zweiten Leitfähigkeitstyps, die Seite an Seite in Oberflächenabschnitten der Drift-Schicht ausgebildet sind; mehrere Abtastzellenwannenzonen des zweiten Leitfähigkeitstyps, die abseits von den Hauptzellenwannenzonen Seite an Seite in Oberflächenabschnitten der Drift-Schicht ausgebildet sind; eine Abtastkontaktfleckwannenzone des zweiten Leitfähigkeitstyps, die so ausgebildet ist, dass sie abseits von den Abtastzellenwannenzonen und den Hauptzellenwannenzonen die Abtastzellenwannenzonen umgibt und eine Fläche hat, die größer ist als die jeweiligen Hauptzellenwannenzonen und Abtastzellenwannenzonen; eine Gate-Isolierschicht, die auf den Abtastzellenwannenzonen und den Hauptzellenwannenzonen ausgebildet ist; eine Feldisolierschicht, die auf der Abtastkontaktfleckwannenzone dicker als die Gate-Isolierschicht ausgebildet ist; einen Source-Kontaktfleck, der die Abtastkontaktfleckwannenzone und die Hauptzellenwannenzonen über Abtastkontaktfleckwannenkontaktöffnungen, die auf der Abtastkontaktfleckwannenzone, die Feldisolierschicht durchdringend ausgebildet sind, und Source-Kontaktöffnungen elektrisch anschließt, die auf den Hauptzellenwannenzonen, die Gate-Isolierschicht durchdringend ausgebildet sind; einen Abtastkontaktfleck, der über Abtast-Source-Kontaktöffnungen, die auf den Abtastzellenwannenzonen, die Gate-Isolierschicht durchdringend ausgebildet sind, elektrisch an die Abtastzellenwannenzonen angeschlossen ist; Gate-Elektroden, die in Kontakt mit der Gate-Isolierschicht über den Hauptzellenwannenzonen und den Abtastzellenwannenzonen ausgebildet sind; einen Gate-Kontaktfleck, der elektrisch an die Gate-Elektroden angeschlossen ist; und eine Drain-Elektrode, die auf einer zweiten Hauptflächenseite des Halbleitersubstrats, die der ersten Hauptfläche entgegengesetzt ist, ausgebildet ist, wobei die Feldisolierschicht die Abtastkontaktfleckwannenzone vollständig abdeckt, bis auf Stellen, an denen Kontaktöffnungen in der Feldschicht angeordnet sind.
- Leistungshalbleiterbauteil nach
Anspruch 1 , darüber hinaus aufweisend: eine Abtastzellenumfangswannenzone des zweiten Leitfähigkeitstyps, die zwischen den mehreren Abtastzellenwannenzonen und der Abtastkontaktfleckwannenzone abseits von den Abtastzellenwannenzonen und der Abtastkontaktfleckwannenzone ausgebildet ist; und Abtastzellenumfangswannenkontaktöffnungen, die auf der Abtastzellumfangswannenzone ausgebildet sind, um den Abtastkontaktfleck elektrisch an die Abtastzellumfangswannenzone anzuschließen. - Leistungshalbleiterbauteil nach
Anspruch 1 , darüber hinaus aufweisend: eine Abtastkontaktfleckgrenzwannenzone des zweiten Leitfähigkeitstyps, die die Abtastkontaktfleckwannenzone umgebend ausgebildet ist; und Abtastkontaktfleckgrenzwannenkontaktöffnungen, die auf der Abtastkontaktfleckgrenzwannenzone ausgebildet sind, um den Source-Kontaktfleck elektrisch an die Abtastkontaktfleckgrenzwannenzone anzuschließen. - Leistungshalbleiterbauteil nach
Anspruch 3 , wobei die Abtastkontaktfleckwannenzone und die Abtastkontaktfleckgrenzwannenzone in der Drift-Schicht verbunden sind. - Leistungshalbleiterbauteil nach einem der
Ansprüche 1 bis4 , darüber hinaus aufweisend: eine Umfangswannenzone des zweiten Leitfähigkeitstyps, die in der Drift-Schicht, die mehreren Hauptzellenwannenzonen umgebend ausgebildet ist; und Umfangswannenkontaktöffnungen, die auf der Umfangswannenzone, die Feldisolierschicht durchdringend ausgebildet sind, um die Umfangswannenzone elektrisch an den Source-Kontaktfleck anzuschließen. - Leistungshalbleiterbauteil nach einem der
Ansprüche 1 bis5 , wobei die Drift-Schicht aus Siliciumcarbid hergestellt ist.
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
PCT/JP2010/004193 WO2011161721A1 (ja) | 2010-06-24 | 2010-06-24 | 電力用半導体装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
DE112010005681T5 DE112010005681T5 (de) | 2013-05-16 |
DE112010005681B4 true DE112010005681B4 (de) | 2019-11-14 |
Family
ID=45370939
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE112010005681.1T Active DE112010005681B4 (de) | 2010-06-24 | 2010-06-24 | Leistungshalbleiterbauteil |
Country Status (6)
Country | Link |
---|---|
US (1) | US9293572B2 (de) |
JP (1) | JP5606529B2 (de) |
KR (1) | KR101527270B1 (de) |
CN (1) | CN102947934B (de) |
DE (1) | DE112010005681B4 (de) |
WO (1) | WO2011161721A1 (de) |
Families Citing this family (22)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE112011104322T5 (de) | 2010-12-10 | 2013-10-02 | Mitsubishi Electric Corporation | Halbleitervorrichtung und Verfahren zur Herstellung einer Halbleitervorrichtung |
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KR101481878B1 (ko) | 2010-04-06 | 2015-01-12 | 미쓰비시덴키 가부시키가이샤 | 전력용 반도체 장치, 파워 모듈 및 전력용 반도체 장치의 제조 방법 |
-
2010
- 2010-06-24 WO PCT/JP2010/004193 patent/WO2011161721A1/ja active Application Filing
- 2010-06-24 CN CN201080067692.1A patent/CN102947934B/zh active Active
- 2010-06-24 KR KR1020127033412A patent/KR101527270B1/ko active IP Right Grant
- 2010-06-24 US US13/806,534 patent/US9293572B2/en active Active
- 2010-06-24 DE DE112010005681.1T patent/DE112010005681B4/de active Active
- 2010-06-24 JP JP2012521167A patent/JP5606529B2/ja active Active
Patent Citations (5)
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Also Published As
Publication number | Publication date |
---|---|
KR101527270B1 (ko) | 2015-06-09 |
DE112010005681T5 (de) | 2013-05-16 |
KR20130023278A (ko) | 2013-03-07 |
JPWO2011161721A1 (ja) | 2013-08-19 |
JP5606529B2 (ja) | 2014-10-15 |
US20130168700A1 (en) | 2013-07-04 |
CN102947934A (zh) | 2013-02-27 |
CN102947934B (zh) | 2015-12-02 |
WO2011161721A1 (ja) | 2011-12-29 |
US9293572B2 (en) | 2016-03-22 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
R012 | Request for examination validly filed | ||
R079 | Amendment of ipc main class |
Free format text: PREVIOUS MAIN CLASS: H01L0027040000 Ipc: H01L0023620000 |
|
R079 | Amendment of ipc main class |
Free format text: PREVIOUS MAIN CLASS: H01L0027040000 Ipc: H01L0023620000 Effective date: 20140725 |
|
R084 | Declaration of willingness to licence | ||
R016 | Response to examination communication | ||
R016 | Response to examination communication | ||
R018 | Grant decision by examination section/examining division | ||
R020 | Patent grant now final |