DE102020117547A1 - Packages mit abwechselnd gestapelten dicken rdls und dünnen rdls - Google Patents
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- H01L2224/13—Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
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- H01L2224/131—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
- H01L2224/13101—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of less than 400°C
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- H01L2224/15—Structure, shape, material or disposition of the bump connectors after the connecting process
- H01L2224/16—Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
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- H01L2224/16151—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/16221—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/16225—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
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- H01L2224/15—Structure, shape, material or disposition of the bump connectors after the connecting process
- H01L2224/16—Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
- H01L2224/161—Disposition
- H01L2224/16151—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/16221—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/16225—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
- H01L2224/16227—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation the bump connector connecting to a bond pad of the item
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- H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L2224/31—Structure, shape, material or disposition of the layer connectors after the connecting process
- H01L2224/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
- H01L2224/321—Disposition
- H01L2224/32151—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/32221—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/32225—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
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- H01L2224/732—Location after the connecting process
- H01L2224/73201—Location after the connecting process on the same surface
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- H01L2224/732—Location after the connecting process
- H01L2224/73251—Location after the connecting process on different surfaces
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- H01L2224/81—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
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- H01L2224/9212—Sequential connecting processes
- H01L2224/92122—Sequential connecting processes the first connecting process involving a bump connector
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- H01L2224/9222—Sequential connecting processes
- H01L2224/92242—Sequential connecting processes the first connecting process involving a layer connector
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- H01L2225/04—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers
- H01L2225/065—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers the devices being of a type provided for in group H01L27/00
- H01L2225/06503—Stacked arrangements of devices
- H01L2225/06524—Electrical connections formed on device or on substrate, e.g. a deposited or grown layer
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- H01L2225/03—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00
- H01L2225/04—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers
- H01L2225/065—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers the devices being of a type provided for in group H01L27/00
- H01L2225/06503—Stacked arrangements of devices
- H01L2225/06527—Special adaptation of electrical connections, e.g. rewiring, engineering changes, pressure contacts, layout
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- H01L2225/00—Details relating to assemblies covered by the group H01L25/00 but not provided for in its subgroups
- H01L2225/03—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00
- H01L2225/04—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers
- H01L2225/065—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers the devices being of a type provided for in group H01L27/00
- H01L2225/06503—Stacked arrangements of devices
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- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/498—Leads, i.e. metallisations or lead-frames on insulating substrates, e.g. chip carriers
- H01L23/49811—Additional leads joined to the metallisation on the insulating substrate, e.g. pins, bumps, wires, flat leads
- H01L23/49816—Spherical bumps on the substrate for external connection, e.g. ball grid arrays [BGA]
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- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/498—Leads, i.e. metallisations or lead-frames on insulating substrates, e.g. chip carriers
- H01L23/49838—Geometry or layout
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- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/498—Leads, i.e. metallisations or lead-frames on insulating substrates, e.g. chip carriers
- H01L23/49866—Leads, i.e. metallisations or lead-frames on insulating substrates, e.g. chip carriers characterised by the materials
- H01L23/49894—Materials of the insulating layers or coatings
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- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/10—Bump connectors ; Manufacturing methods related thereto
- H01L24/15—Structure, shape, material or disposition of the bump connectors after the connecting process
- H01L24/16—Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
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- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L24/31—Structure, shape, material or disposition of the layer connectors after the connecting process
- H01L24/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
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Abstract
Ein Verfahren umfasst das Bilden mehrerer dielektrischer Schichten, wobei die Prozesse das Bilden mehrerer erster dielektrischer Schichten, die erste Dicken aufweisen, und das Bilden mehrerer zweiter dielektrischer Schichten, die zweite Dicken aufweisen, die kleiner als die ersten Dicken sind, umfassen. Die mehreren ersten dielektrischen Schichten und die mehreren zweiten dielektrischen Schichten werden abwechselnd angeordnet. Das Verfahren umfasst des Weiteren das Bilden mehrerer Umverteilungsleitungen, die verbunden sind, um einen leitfähigen Pfad zu bilden, wobei die Prozesse das Bilden mehrerer erster Umverteilungsleitungen, die sich jeweils in einer der mehreren ersten dielektrischen Schichten befinden, und das Bilden mehrerer zweiter Umverteilungsleitungen, die sich jeweils in einer der mehreren zweiten dielektrischen Schichten befinden, umfassen.
Description
- QUERVERWEIS AUF VERWANDTE ANMELDUNG
- Diese Anmeldung bezieht sich auf die am 18. Oktober 2019 eingereichte, gemeinsam abgetretene
US-Patentanmeldung Nr. 16/656,642 - HINTERGRUND
- Im Zuge der Entwicklung der Halbleitertechnologie werden einige Halbleiterchips/-dies immer kleiner. Demgegenüber müssen mehr Funktionen in die Halbleiter-Dies integriert werden, was auch dazu führt, dass andere Halbleiter-Dies und die resultierenden Packages immer größer werden.
- Umverteilungsleitungen werden in den Package-Substraten gebildet, um Strom und Signale in Packages zu routen. Da die Packages immer größer werden, um mehr Funktionen wie zum Beispiel Anwendungen der künstlichen Intelligenz (KI) unterzubringen, werden die Umverteilungsleitungen sehr lang und erreichen mitunter Längen von mehreren zehn Millimetern. Die langen Umverteilungsleitungen weisen hohe Widerstandswerte auf und verursachen einen erheblichen Einfügeverlust, insbesondere bei Hochgeschwindigkeitssignalen.
- Figurenliste
- Aspekte der vorliegenden Offenbarung werden am besten anhand der folgenden detaillierten Beschreibung verstanden, wenn sie in Verbindung mit den beiliegenden Figuren gelesen wird. Es ist anzumerken, dass gemäß der gängigen Praxis in der Industrie verschiedene Merkmale nicht maßstabsgetreu gezeichnet sind. Die Abmessungen der verschiedenen Merkmale können vielmehr im Interesse der Übersichtlichkeit der Besprechung nach Bedarf vergrößert oder verkleinert werden.
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1 bis22 veranschaulichen die Querschnittsansichten von Zwischenstufen bei der Bildung von Packages gemäß einigen Ausführungsformen. -
23 veranschaulicht eine Draufsicht beispielhafter Layouts benachbarter dicker RDLs und dünner RDLs gemäß einigen Ausführungsformen. -
24 und25 veranschaulichen die Querschnittsansichten einiger Packages gemäß einigen Ausführungsformen. -
26 veranschaulicht eine vergrößerte Ansicht einer Region in einem Package gemäß einigen Ausführungsformen. -
27 veranschaulicht einen Prozessfluss zum Bilden eines Package gemäß einigen Ausführungsformen. - DETAILLIERTE BESCHREIBUNG
- Die folgende Offenbarung stellt viele verschiedene Ausführungsformen oder Beispiele zum Implementieren verschiedener Merkmale der Erfindung bereit. Im Folgenden werden konkrete Beispiele von Komponenten und Anordnungen beschrieben, um die vorliegende Offenbarung zu vereinfachen. Diese sind natürlich nur Beispiele und dienen nicht der Einschränkung. Zum Beispiel kann das Bilden eines ersten Merkmals über oder auf einem zweiten Merkmal in der folgenden Beschreibung Ausführungsformen umfassen, bei denen das erste und das zweite Merkmal in direktem Kontakt ausgebildet sind, und kann auch Ausführungsformen umfassen, bei denen zusätzliche Merkmale zwischen dem ersten und dem zweiten Merkmal ausgebildet sein können, so dass das erste und das zweite Merkmal nicht unbedingt in direktem Kontakt stehen. Darüber hinaus kann die vorliegende Offenbarung Bezugszahlen und/oder - buchstaben in den verschiedenen Beispielen wiederholen. Diese Wiederholung dient dem Zweck der Einfachheit und Klarheit und schafft nicht automatisch eine Beziehung zwischen den verschiedenen besprochenen Ausführungsformen und/oder Konfigurationen.
- Des Weiteren können räumlich relative Begriffe, wie zum Beispiel „darunterliegend“, „unter“, „unterer“, „darüberliegend“, „oberer“ und dergleichen, im vorliegenden Text zur Vereinfachung der Beschreibung verwendet werden, um die Beziehung eines Elements oder Merkmals zu einem oder mehreren anderen Elementen oder Merkmalen, wie in den Figuren veranschaulicht, zu beschreiben. Die räumlich relativen Begriffe sollen auch andere Ausrichtungen der Vorrichtung im Gebrauch oder Betrieb neben der in den Figuren gezeigten Ausrichtung umfassen. Die Vorrichtung kann auch anders ausgerichtet sein (um 90 Grad gedreht, oder sonstige Ausrichtungen), und die im vorliegenden Text verwendeten räumlich relativen Deskriptoren können gleichermaßen entsprechend interpretiert werden.
- Ein Package mit dicken dielektrischen Schichten und dicken Umverteilungsleitungen (Redistribution Lines, RDLs), die abwechselnd mit dünnen dielektrischen Schichten und dünnen RDLs angeordnet sind, sowie die Verfahren zu ihrer Herstellung werden gemäß einigen Ausführungsformen bereitgestellt. Auch die Zwischenstufen im Bildungsprozess werden veranschaulicht. Die im vorliegenden Text besprochenen Ausführungsformen sollen Beispiele geben, um die Herstellung oder Verwendung des Gegenstandes dieser Offenbarung zu ermöglichen. Dem Durchschnittsfachmann fallen sofort Modifizierungen ein, die vorgenommen werden können, ohne die vorgesehenen Geltungsbereiche verschiedener Ausführungsformen zu verlassen. In den verschiedenen Ansichten und veranschaulichenden Ausführungsformen werden gleiche Bezugszahlen verwendet, um gleiche Elemente zu bezeichnen. Obwohl Verfahrensausführungsformen als in einer bestimmten Reihenfolge ausgeführt besprochen werden können, können andere Verfahrensausführungsformen in jeder beliebigen logischen Reihenfolge ausgeführt werden.
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1 bis22 veranschaulichen die Querschnittsansichten von Zwischenstufen bei der Bildung eines Package gemäß einigen Ausführungsformen. Die entsprechenden Prozesse sind ebenfalls in dem in27 gezeigten Prozessfluss200 schematisch widergespiegelt. Unter Bezug auf1 wird ein Träger20 bereitgestellt, und ein Trennfilm22 wird auf den Träger20 aufbeschichtet. Der Träger20 wird aus einem transparenten Material gebildet und kann ein Glasträger, ein Keramikträger, ein organischer Träger oder dergleichen sein. Der Trennfilm22 steht in physischem Kontakt mit der Oberseite des Trägers20 . Der Trennfilm22 kann aus einem Licht-zu-Wärme-Umwandlungs-Beschichtungsmaterial (Light-To-Heat-Conversion, LTHC) gebildet werden, das durch Beschichtung auf den Träger20 aufgebracht wird. Gemäß einigen Ausführungsformen der vorliegenden Offenbarung kann sich das LTHC-Beschichtungsmaterial unter der Wärme von Licht/Strahlung (wie zum Beispiel Laser) zersetzen, und folglich kann sich der Träger20 von der darauf gebildeten Struktur lösen. Gemäß einigen Ausführungsformen, wie ebenfalls in1 gezeigt, wird eine dielektrische Pufferschicht24 auf dem LTHC-Beschichtungsmaterial22 gebildet. Gemäß einigen Ausführungsformen wird die dielektrische Pufferschicht24 aus einem Material auf Polymerbasis gebildet. Zum Beispiel kann die dielektrische Pufferschicht24 aus Polybenzoxazol (PBO), Polyimid, Benzocyclobuten (BCB) oder anderen geeigneten Polymeren gebildet werden. - Die
2 und3 veranschaulichen Teile der Prozesse bei der Bildung von Umverteilungsleitungen (RDLs)26 auf der dielektrischen Pufferschicht24 . Der jeweilige Prozess ist als Prozess202 in dem in27 gezeigten Prozessfluss200 veranschaulicht. Unter Bezug auf2 wird die Metallkeimschicht26A gebildet. Die Metallkeimschicht26A wird als eine Deckschicht ausgebildet, die gemäß einigen Ausführungsformen eine Haftschicht und eine kupferhaltige Schicht enthalten kann. Die Haftschicht kann aus Titan, Titannitrid, Tantal, Tantalnitrid oder dergleichen gebildet werden. Die kupferhaltige Schicht kann aus im Wesentlichen reinem Kupfer oder einer Kupferlegierung gebildet werden. Zu den Bildungsverfahren der Metallkeimschicht26A können physikalische Aufdampfung (Physical Vapor Deposition, PVD), plasmaverstärkte chemische Aufdampfung (Plasma Enhanced Chemical Vapor Deposition, PECVD), Atomschichtabscheidung (Atomic Layer Deposition, ALD) oder dergleichen gehören. Dann wird über der Metallkeimschicht26A eine strukturierte Plattierungsmaske28 gebildet, die aus Photoresist oder einem anderen geeigneten Material gebildet werden kann. Öffnungen30 werden gebildet, um einige Abschnitte der Metallkeimschicht26A freizulegen. Als Nächstes werden in den Öffnungen30 Metallregionen (RDLs)26B zum Beispiel durch elektrochemische Plattierung gebildet. Die RDLs26B können aus Kupfer oder einer Kupferlegierung, Aluminium, Nickel, Palladium, Legierungen davon oder Mehrfachschichten davon gebildet werden. Nach der Bildung von RDLs26B wird die Plattierungsmaske28 entfernt, wodurch die darunter liegenden Abschnitte der Metallkeimschicht26A freigelegt werden. Die resultierende Struktur ist in3 gezeigt. -
4 bis6 veranschaulichen die Querschnittsansichten der Zwischenstufen bei der Bildung von Durchkontaktierungen32 gemäß einigen Ausführungsformen der vorliegenden Offenbarung. Der jeweilige Prozess ist als Prozess204 in dem in27 gezeigten Prozessfluss200 veranschaulicht. Bei der Bildung von Durchkontaktierungen32 kann dieselbe Metallkeimschicht26A gemeinsam genutzt werden, oder sie kann unter Verwendung einer anderen Metallkeimschicht durchgeführt werden. Wenn eine andere Metallkeimschicht verwendet werden soll, so werden die freiliegenden Abschnitte der Metallkeimschicht26A , die nicht durch die plattierten RDLs26B bedeckt sind, geätzt, gefolgt von der Bildung einer weiteren Metallkeimschicht (nicht gezeigt), deren Bildungsverfahren und Material aus denselben Gruppen von in Frage kommenden Verfahren und in Frage kommenden Materialien der in2 gezeigten Metallkeimschicht26A ausgewählt werden können. Die neu gebildete metallische Keimschicht bedeckt die Oberseiten und die Seitenwände der RDLs26B und erstreckt sich auf die Oberseite der dielektrischen Pufferschicht24 . -
4 veranschaulicht die Ausführungsformen, in denen die Metallkeimschicht26A nicht geätzt wird und als die Metallkeimschicht für die Bildung von Durchkontaktierungen verwendet wird. Es wird eine strukturierte Plattierungsmaske34 gebildet, die aus Photoresist gebildet sein kann, mit Öffnungen36 , die in der Plattierungsmaske34 gebildet sind und einige Abschnitte der RDLs26 überlappen. - Als Nächstes werden, wie in
5 gezeigt, Durchkontaktierungen32 in Öffnungen36 zum Beispiel durch Plattieren gebildet. Die Durchkontaktierungen32 können aus Kupfer, Nickel, deren Legierungen oder dergleichen gebildet werden. Die Durchkontaktierungen32 und RDLs26B können aus dem gleichen Material oder aus verschiedenen Materialien gebildet werden, und die Grenzflächen zwischen den Durchkontaktierungen32 und RDLs26B können gegebenenfalls unterscheidbar sein. Nach der Bildung der Durchkontaktierungen32 wird die Plattierungsmaske34 entfernt, wodurch die darunter liegenden Abschnitte der RDLs26B und der Metallkeimschicht26A freigelegt werden. Als Nächstes werden die freigelegten Abschnitte der Metallkeimschicht26A geätzt, und die verbleibenden Abschnitte werden ebenfalls als26A bezeichnet. Die resultierende Struktur ist in6 gezeigt. Die verbleibenden Abschnitte der Metallkeimschicht26A werden als Teile von RDLs angesehen, und RDLs26B und die verbleibenden Abschnitte der Metallkeimschicht26A werden im Folgenden gemeinsam als RDLs26 bezeichnet. Aufgrund des Plattierungsprozesses sind die Ränder von Durchkontaktierungen32 im Wesentlichen vertikal und gerade, zum Beispiel mit einem Neigungswinkel α im Bereich zwischen etwa 85 Grad und 90 Grad, und können im Bereich zwischen etwa 88 Grad und 90 Grad liegen. - Unter Bezug auf
7 wird die dielektrische Schicht38 so gebildet, dass sowohl die RDLs26 als auch die Durchkontaktierungen32 darin zu verkapseln. Der jeweilige Prozess ist als Prozess206 in dem in27 gezeigten Prozessfluss200 veranschaulicht. Die dielektrische Schicht38 wird bis zu einem Niveau gefüllt, das höher ist als die Oberseiten der Durchkontaktierungen32 , und dann ausgehärtet. Gemäß einigen Ausführungsformen umfasst - oder ist - die dielektrische Schicht38 eine Vergussmasse, eine Vergussunterfüllung, ein Epoxidharz und/oder ein Harz. Die Oberseite der dielektrischen Schicht38 ist nach dem Abscheiden höher als die oberen Enden der Durchkontaktierungen. Wenn die dielektrische Schicht38 aus Vergussmasse oder Vergussunterfüllung gebildet wird, so kann sie ein Basismaterial, das ein Polymer, ein Harz, ein Epoxid oder dergleichen sein kann, und Füllstoffpartikel (nicht gezeigt, siehe26 ) in dem Basismaterial enthalten. Die Füllstoffpartikel können dielektrische Partikel aus Si02, Al2O3, Siliziumdioxid oder dergleichen sein, die kugelförmig sein können. Außerdem können die kugelförmigen Füllstoffpartikel mehrere verschiedene Durchmesser haben. Da die dielektrische Schicht38 verschiedene Materialien wie zum Beispiel das Basismaterial und die Füllstoffpartikel enthalten kann, wird die dielektrische Schicht38 als aus einem oder mehreren heterogenen Materialien gebildet bezeichnet. - Gemäß alternativen Ausführungsformen wird die dielektrische Schicht
38 aus einem homogenen Material gebildet. Das homogene Material kann ein lichtempfindliches Material oder ein nicht-lichtempfindliches Material sein. Zum Beispiel kann das homogene Material PBO, Polyimid, ein Harz, ein Epoxid oder dergleichen sein oder umfassen. Der Bildungsprozess kann das Abscheiden der homogenen dielektrischen Schicht38 in fließfähiger Form und das Aushärten der dielektrischen Schicht38 umfassen. Die dielektrische Schicht38 kann auch aus einem anorganischen Material wie zum Beispiel Siliziumoxid, Siliziumnitrid oder dergleichen gebildet werden, das durch chemische Aufdampfung (CVD), plasmaverstärkte chemische Aufdampfung (PECVD), Atomschichtabscheidung (ALD) oder dergleichen gebildet werden kann. - In einem anschließenden Prozess, wie in
8 gezeigt, wird ein Planarisierungsprozess wie zum Beispiel ein chemisch-mechanischer Polierprozess (Chemical Mechanical Polish, CMP) oder ein mechanischer Schleifprozess durchgeführt, um die dielektrische Schicht38 zu planarisieren, bis die Durchkontaktierungen32 frei liegen. Aufgrund des Planarisierungsprozesses sind die oberen Enden der Durchkontaktierungen32 im Wesentlichen mit der Oberseite der dielektrischen Schicht38 bündig (koplanar). -
9 veranschaulicht die Bildung von RDLs40 ., die die Metallkeimschicht40A und die plattierte Metallregion (RDLs)40B aufweisen können. Der jeweilige Prozess ist als Prozess208 in dem in27 gezeigten Prozessfluss200 veranschaulicht. Gemäß einigen Ausführungsformen der vorliegenden Offenbarung kann die Bildung von RDLs40 das Abscheiden einer flächendeckend aufgebrachten Metallkeimschicht, das Bilden einer strukturierten Plattierungsmaske über der flächendeckend aufgebrachten Metallkeimschicht, das Plattieren der Metallregionen40B , das Entfernen der Plattierungsmaske, und das Ätzen der freiliegenden Abschnitte der Metallkeimschicht umfassen. Das Material der RDLs40 kann aus derselben Gruppe von in Frage kommenden Materialien für die Bildung von RDLs26 ausgewählt werden und wird hier nicht wiederholt. -
10 veranschaulicht die Beschichtung und die Strukturierung der dielektrischen Schicht42 . Der jeweilige Prozess ist als Prozess210 in dem in27 gezeigten Prozessfluss200 veranschaulicht. Gemäß einigen Ausführungsformen wird die dielektrische Schicht42 aus einem lichtempfindlichen Material gebildet oder umfasst dieses, und/oder kann aus einem Polymer gebildet werden oder dieses umfassen, das aus Polyimid, PBO oder dergleichen gebildet ist oder dieses umfasst. Die dielektrische Schicht42 kann in fließfähiger Form abgeschieden werden und wird dann ausgehärtet. Aufgrund des Beschichtungsprozesses braucht kein Planarisierungsprozess zur Planarisierung der Oberseite der dielektrischen Schicht42 ausgeführt zu werden. Dementsprechend ist die dielektrische Schicht42 insgesamt planar, und die Oberseiten der Abschnitte der dielektrischen Schicht42 direkt über den RDLs40 können geringfügig höher sein als die Oberseiten der Abschnitte der dielektrischen Schicht42 neben den RDLs40 . Die Bildungsprozesse umfassen das Aufbeschichten der dielektrischen Schicht42 , das Ausführen eines Belichtungsprozesses auf der dielektrischen Schicht42 (zum Beispiel unter Verwendung einer strukturierten Photolithografiemaske), und das Entwickeln der dielektrischen Schicht42 . Einige Abschnitte der dielektrischen Schicht42 werden in dem Entwicklungsprozess entfernt, um Öffnungen44 zu bilden. Aufgrund des Bildungsprozesses können die Ränder der Öffnungen44 schräg und gerade sein. - Wie in
11 veranschaulicht, wird die Metallkeimschicht46A abgeschieden, und Metallregionen46B werden auf die Metallkeimschicht46A plattiert. Der jeweilige Prozess ist als Prozess212 in dem in27 gezeigten Prozessfluss200 veranschaulicht. Die Metallkeimschicht26A erstreckt sich in die Öffnungen44 (10 ). Dann wird eine strukturierte Plattierungsmaske (nicht abgebildet) über der Metallkeimschicht46A gebildet, und Metallregionen46B werden in den Öffnungen in der strukturierten Plattierungsmaske plattiert. Die Plattierungsmaske wird dann zum Beispiel durch einen Ashing-Prozess entfernt. Die Abschnitte der Metallkeimschicht46A , die zuvor von der Plattierungsmaske bedeckt waren, können als die Metallkeimschicht zur Bildung von Durchkontaktierungen darauf verbleiben, oder können zu diesem Zeitpunkt geätzt werden. Das Material der plattierten Metallregionen46B kann aus derselben Gruppe von in Frage kommenden Materialien ausgewählt werden, die zur Bildung der plattierten Metallregionen26B verwendet werden, und wird hier nicht wiederholt. -
12 veranschaulicht die Bildung von Durchkontaktierungen50 , die unter Verwendung der Metallkeimschicht46A als ihre Keimschicht plattiert werden können oder unter Verwendung einer separaten Metallkeimschicht gebildet werden können. Der jeweilige Prozess ist als Prozess214 in dem in27 gezeigten Prozessfluss200 veranschaulicht. Gemäß einigen Ausführungsformen umfassen die Bildungsprozesse zur Bildung von Durchkontaktierungen50 das Bilden einer strukturierten Plattierungsmaske (nicht gezeigt), das Plattieren von Durchkontaktierungen50 , das Entfernen der Plattierungsmaske, und das Ätzen der freiliegenden Abschnitte der Metallkeimschicht (46A , oder der zusätzlich gebildeten Metallkeimschicht). Das Material der Durchkontaktierungen50 kann aus derselben Gruppe von in Frage kommenden Materialien (wie zum Beispiel Kupfer, Nickel oder deren Legierungen) ausgewählt werden, die für die Bildung von Durchkontaktierungen32 verwendet werden, und wird daher hier nicht wiederholt. Die Durchkontaktierungen50 und die plattierten Metallregionen46B können aus dem gleichen Material oder aus verschiedenen Materialien gebildet werden, und die Grenzflächen zwischen den Durchkontaktierungen50 und den plattierten Metallregionen46B können gegebenenfalls unterscheidbar sein. In der gesamten Beschreibung werden die plattierten Metallregionen46B (11 ) und die verbleibenden Abschnitte der Metallkeimschicht46A gemeinsam als RDLs46 bezeichnet. - Wie in
12 gezeigt, enthalten die RDLs46 Leitungsabschnitte46L , die über der dielektrischen Schicht42 liegen, und Durchkontaktierungsabschnitte46V , die sich in die dielektrische Schicht42 erstrecken. Gemäß einigen Ausführungsformen der vorliegenden Offenbarung können einige Abschnitte der Oberseiten der RDLs46 direkt über den Durchkontaktierungen46V aufgrund der Topologie, die durch die Öffnungen44 verursacht wird, ausgespart sein. Die ausgesparten Oberseiten der RDLs46 werden durch Strichlinien47 gemäß einigen beispielhaften Ausführungen veranschaulicht. Gemäß anderen Ausführungsformen wird der Plattierungsprozess so justiert, dass die Oberseiten der Leitungsabschnitte46L direkt über den Durchkontaktierungsabschnitten46V bündig sind oder auch höher liegen als die Oberseiten der Abschnitte der Leitungsabschnitte46L , die die dielektrische Schicht42 überlappen. Aufgrund des Bildungsprozesses sind die Ränder der Durchkontaktierungen46V schräg, zum Beispiel mit einem Neigungswinkel β von kleiner als etwa 85 Grad oder kleiner als etwa 80 Grad oder etwa 75 Grad. - Da die dielektrische Schicht
42 aus einem homogenen Material bestehen kann, ist es, wie in den10 und11 gezeigt, möglich, die dielektrische Schicht42 (wie in10 gezeigt) so zu strukturieren, dass Öffnungen44 entstehen. Leitungsabschnitte46L und Durchkontaktierungsabschnitte46V können so im selben Prozess gebildet werden. Da die dielektrische Schicht38 heterogen sein kann und das Basismaterial und die darin enthaltenen Füllstoffpartikel unterschiedliche Ätzraten aufweisen, ist es im Vergleich dazu schwierig, die dielektrische Schicht38 zu ätzen. Dementsprechend können die Durchkontaktierungen32 und RDLs40 in getrennten Prozessen gebildet werden, was zu einer Erhöhung der Herstellungskosten führt. Die höheren Kosten werden jedoch durch den Vorteil kompensiert, dass die Dicke der dielektrischen Schicht38 auf einen gewünschten Wert justiert werden kann, der größer als 15 µm sein kann und im Bereich zwischen etwa 150 µm und etwa 80 µm liegen kann. Im Vergleich dazu ist, wenn die dielektrische Schicht42 aus einem lichtempfindlichen Material gebildet wird, die Dicke der dielektrischen Schicht42 aufgrund der durch die Belichtung auferlegten Beschränkungen beispielsweise auf weniger als etwa 15 µm begrenzt. - Als Nächstes wird, wie ebenfalls in
12 gezeigt, die dielektrische Schicht52 so gebildet, dass sie die RDL-Leitungsabschnitte46L und Durchkontaktierungen50 darin verkapselt. Der jeweilige Prozess ist als Prozess216 in dem in27 gezeigten Prozessfluss200 veranschaulicht. Die dielektrische Schicht52 kann aus einem Material gebildet werden, das aus den gleichen in Frage kommenden Materialien für die Bildung der dielektrischen Schicht38 ausgewählt wird, und kann aus einer Vergussmasse, einer Vergussunterfüllung, einem Epoxid, einem Harz, einem anorganischen dielektrischen Material oder dergleichen gebildet werden oder dieses umfassen. Dann wird ein Planarisierungsprozess wie zum Beispiel ein CMP-Prozess oder ein mechanischer Schleifprozess durchgeführt, um die dielektrische Schicht52 zu planarisieren, bis die Durchkontaktierungen50 frei liegen. Der jeweilige Prozess ist auch als Prozess216 in dem in27 gezeigten Prozessfluss200 veranschaulicht. Aufgrund des Planarisierungsprozesses sind die oberen Enden der Durchkontaktierungen50 mit der Oberseite der dielektrischen Schicht52 bündig (koplanar) oder im Wesentlichen bündig. -
13 veranschaulicht die Bildung weiterer darüberliegender Merkmale, einschließlich RDLs56 und60 , Durchkontaktierungen62 und dielektrischer Schichten58 und64 . Der jeweilige Prozess ist als Prozess218 in dem in27 gezeigten Prozessfluss200 veranschaulicht. Einige der darüberliegenden Schichten, die durch Punkte dargestellt sind, können die Schichtstruktur ähnlich der Struktur darstellen, die die dielektrischen Schichten42 und52 und die leitfähigen Merkmale40 ,46 und50 enthalten. Die leitfähigen Merkmale in den darüberliegenden Strukturen können auch die Strukturen von RDLs40 und46 und Durchkontaktierungen50 annehmen. - Gemäß einigen Ausführungsformen nehmen die dielektrischen Schichten
38 ,42 ,52 ,58 und64 sowie die dielektrischen Schichten zwischen den dielektrischen Schichten52 und58 gemeinsam ein abwechselndes Layout an, wobei einige der Schichten aus homogenen Materialien gebildet sind und dünner - mit Dicken T2 - sind und andere Schichten aus heterogenen Materialien gebildet sind und dicker - mit Dicken T1 - sind, die größer als die Dicken T2 sind. Jede aus einem homogenen Material gebildete Schicht kann zwischen zwei aus heterogenen Materialien gebildete Schichten eingefügt werden und diese kontaktieren, und jede aus einem heterogenen Material gebildete Schicht kann zwischen zwei aus homogenen Materialien gebildete Schichten eingefügt werden und diese kontaktieren. Zum Beispiel können die Schichten42 und58 aus homogenen Materialien gebildet werden, während die Schichten38 ,52 und64 aus heterogenen Materialien gebildet werden können. Die dielektrischen Schichten38 ,52 und64 können aus dem gleichen Material wie die dielektrischen Schichten42 und58 oder aus anderen Materialien gebildet werden. Zum Beispiel können die dielektrischen Schichten38 ,42 ,52 ,58 und64 alle aus Vergussmasse oder Vergussunterfüllung gebildet sein oder diese umfassen, oder können alle aus Polyimid, PBO oder dergleichen gebildet sein oder dieses umfassen. Alternativ können die dielektrischen Schichten38 ,52 und64 aus Vergussmasse, Vergussunterfüllung oder dergleichen gebildet werden, während die dielektrischen Schichten42 und58 aus PBO, Polyimid oder dergleichen gebildet werden können. - Gemäß einigen Ausführungsformen ist das Verhältnis T1/T2, das heißt, das Verhältnis der Dicke der dickeren dielektrischen Schichten zur Dicke der dünneren dielektrischen Schichten, größer als etwa 1,5 und kann im Bereich zwischen etwa 1,5 und 10 liegen, und kann des Weiteren im Bereich zwischen etwa 2 und 5 liegen. Zum Beispiel kann die Dicke T1 der dickeren dielektrischen Schichten
38 ,52 und64 usw. im Bereich zwischen etwa 10 µm und etwa 80 µm liegen, und die Dicke T2 der dünneren dielektrischen Schichten24 ,42 und58 kann im Bereich zwischen etwa 4 µm und etwa 25 µm liegen. - Die Dicke T3 der RDLs (wie zum Beispiel 26, 46L und 60L) in den dickeren dielektrischen Schichten
38 ,52 und64 ist größer als die Dicke T4 der RDLs (wie zum Beispiel 40 und 56) in den dünneren dielektrischen Schichten (wie zum Beispiel 42 und58 ). Gemäß einigen Ausführungsformen ist das Verhältnis T3/T4 größer als etwa 1,5 und kann im Bereich zwischen etwa 1,5 und etwa 10 liegen, und kann des Weiteren im Bereich zwischen etwa 2 und etwa 5 liegen. Zum Beispiel kann die Dicke T3 im Bereich zwischen etwa 5 µm und etwa40 µm liegen, und die Dicke T4 kann im Bereich zwischen etwa 1 µm und etwa 10 µm liegen. In der gesamten Beschreibung werden alle Umverteilungsleitungen und Dummy-Metallpads auf derselben Ebene gemeinsam als eine Umverteilungsschicht oder RDL-Schicht bezeichnet. - Darüber hinaus sind die Höhen H1 der Durchkontaktierungen (zum Beispiel 32, 50 und 62) in den dickeren dielektrischen Schichten
38 ,52 und64 größer als die Dicke H2 der Durchkontaktierungen (zum Beispiel 46V und 60V) in den dünneren dielektrischen Schichten (zum Beispiel 42 und 58). Gemäß einigen Ausführungsformen ist das Verhältnis H1/H2 größer als etwa 1,5 und kann im Bereich zwischen etwa 1,5 und 10 liegen, und kann des Weiteren im Bereich zwischen etwa 2 und 5 liegen. Zum Beispiel kann die Höhe H1 im Bereich zwischen etwa 5 µm und etwa40 µm liegen, und die Höhe H2 kann im Bereich zwischen etwa 3 µm und etwa 15 µm liegen. - In der gesamten Beschreibung werden die Merkmale über dem Trennfilm
22 zusammen als eine Interconnect-Struktur67 bezeichnet. Gemäß einigen Ausführungsformen wird ein Sondierungsprozess durchgeführt, um die Funktion der Interconnect-Struktur67 zu sondieren. Die Interconnect-Struktur67 weist mehrere identische Teile (Dies) auf, die in anschließenden Prozessen auseinandergesägt werden können (21 ). Diese Dies können zum Beispiel mittels einer Sondierungskarte sondiert werden, und die elektrischen Verbindungen in der Interconnect-Struktur67 werden gemessen, um zu bestimmen, ob die Dies defekt sind oder nicht. Die defekten Dies werden nicht für den anschließenden Bondungsprozess verwendet, und es werden keine Vorrichtungs-Dies direkt auf die defekten Dies platziert. -
14 und15 veranschaulichen die Bildung von RDLs66 (die ebenfalls Metallpads sind) und von Metallpfosten68 über, und in elektrischer Verbindung mit, der Interconnect-Struktur67 . Der jeweilige Prozess ist als Prozess220 in dem in27 gezeigten Prozessfluss200 veranschaulicht. Der Prozess kann das Abscheiden der Metallkeimschicht66A , das Bilden einer ersten Plattierungsmaske (nicht gezeigt) zum Plattieren von RDLs66B , das Entfernen der ersten Plattierungsmaske, das Bilden einer zweiten Plattierungsmaske (nicht gezeigt), das Plattieren von Metallpfosten68 , das Entfernen der zweiten Plattierungsmaske, und das Ablösen der nicht von RDLs66B bedeckten Abschnitte der Metallkeimschicht66A umfassen. Die plattierten RDLs66B und die verbleibenden Abschnitte der Metallkeimschicht66A werden im Folgenden gemeinsam als RDLs66 bezeichnet, die in15 gezeigt sind. - Als Nächstes werden, unter Bezug auf
16 , Package-Komponenten72 auf der dielektrischen Schicht64 zum Beispiel durch den Die-Attach-Film70 (ein Klebefilm) angebracht. Der jeweilige Prozess ist als Prozess222 in dem in27 gezeigten Prozessfluss200 veranschaulicht. Die veranschaulichte Package-Komponente72 stellt mehrere Package-Komponenten dar, wie zum Beispiel in den24 und25 veranschaulicht. Zu den gebondeten Package-Komponenten gehören zum Beispiel Brücken-Dies, Logik-Dies, passive Vorrichtungen , ein integrierter Spannungsregler (Integrated Voltage Regulator, IVR) und dergleichen. Die Brücken-Dies können zwei oder mehr Package-Komponenten84 miteinander verbinden (22 ). Die passiven Vorrichtungen können IPDs sein, die Kondensatoren, Induktivitäten, Widerstände und/oder dergleichen enthalten können, und können Vorrichtungs-Dies oder Packages, die die Vorrichtungs-Dies enthalten, sein. - Als Nächstes wird, wie ebenfalls in
16 gezeigt, ein Verkapselungsmittel74 abgeschieden und dann ausgehärtet, um Metallpfosten68 und Package-Komponenten72 darin zu verkapseln. Der jeweilige Prozess ist als Prozess224 in dem in27 gezeigten Prozessfluss200 veranschaulicht. Das Verkapselungsmittel74 kann eine Vergussmasse, eine Vergussunterfüllung, ein Harz, ein Epoxidharz und/oder dergleichen sein. Gemäß einigen Ausführungsformen enthält das Verkapselungsmittel74 ein Basismaterial wie zum Beispiel ein Polymer, ein Epoxid, ein Harz oder dergleichen sowie Füllstoffpartikel in dem Basismaterial. - Unter Bezug auf
17 wird nach dem Abscheiden und Aushärten des Verkapselungsmittels74 ein Planarisierungsprozess wie zum Beispiel ein CMP-Prozess oder ein mechanischer Schleifprozess durchgeführt, um überschüssiges Material zu entfernen, bis die Metallpfosten68 und die leitfähigen Oberflächenmerkmale (wie zum Beispiel Metallpfosten) der Package-Komponenten72 frei liegen. Die Metallpfosten68 werden im Folgenden alternativ auch als Durchkontaktierungen (through-vias) bezeichnet. -
18 veranschaulicht die Bildung der Umverteilungsstruktur75 , die mehrere dielektrische Schichten wie zum Beispiel die Schichten76 und80 und mehrere RDLs wie zum Beispiel 78 und 82 aufweist. Der jeweilige Prozess ist als Prozess226 in dem in27 gezeigten Prozessfluss200 veranschaulicht. Gemäß einigen Ausführungsformen werden alle dielektrischen Schichten und alle RDLs in der Umverteilungsstruktur75 mittels der Verfahren gebildet, die den Verfahren zum Bilden der dielektrischen Schicht42 und der RDLs46 ähneln. Gemäß alternativen Ausführungsformen nimmt auch die Umverteilungsstruktur75 ein abwechselndes Layout mit dickeren dielektrischen Schichten und dünneren dielektrischen Schichten (und den entsprechenden dickeren und dünneren Umverteilungsleitungen) an. Auf den RDLs82 können Metallhöcker gebildet werden. - Unter Bezug auf
19 werden die Package-Komponenten84 durch die Lötregionen85 an die Umverteilungsstruktur75 gebondet. Der jeweilige Prozess ist als Prozess228 in dem in27 gezeigten Prozessfluss200 veranschaulicht. Anschließend wird eine Unterfüllung87 abgeschieden und ausgehärtet. Die veranschaulichten Package-Komponenten84 stellen mehrere Package-Komponenten dar, wie in den24 und25 gezeigt. Zu den gebondeten Package-Komponenten gehören beispielsweise Kernvorrichtungen enthaltende Packages (wie zum Beispiel System-on-Chip-Packages (SoC-Packages)), Speicher-Dies oder Speicher-Packages (wie zum Beispiel High-Bandwidth Memory (HBM)-Würfel) und dergleichen. Gemäß einigen Ausführungsformen der vorliegenden Offenbarung enthält jedes der SoC-Packages einen einzelnen Vorrichtungs-Die oder mehrere Vorrichtungs-Dies, die miteinander zu einem System verbondet sind. Die Vorrichtungs-Dies in den SoC-Packages können Kernvorrichtungs-Dies wie zum Beispiel Central Processing Unit-Dies (CPU-Dies), Graphic Processing Unit-Dies (GPU-Dies), Application Specific Integrated Circuit-Dies (ASIC-Dies), Field Programmable Gate Array-Dies (FPGA-Dies) oder dergleichen oder Kombinationen davon enthalten. Die Speicher-Packages können gestapelte Speicher-Dies wie zum Beispiel Dynamic Random Access Memory-Dies (DRAM-Dies), Static Random Access Memory-Dies (SRAM-Dies), Magnetoresistive Random Access Memory-Dies (MRAM-Dies), Resistive Random Access Memory-Dies (RRAM-Dies) oder andere Arten von Speicher-Dies enthalten. In der gesamten Beschreibung wird die Struktur über dem Trennfilm22 als „rekonstruierter Wafer“ 100 bezeichnet. - Als Nächstes wird, unter Bezug auf
20 , der rekonstruierte Wafer100 auf das Band88 gelegt, das an dem Rahmen90 angebracht ist. Gemäß einigen Ausführungsformen der vorliegenden Offenbarung stehen die Package-Komponenten84 in Kontakt mit dem Band88 . Als Nächstes wird der rekonstruierte Wafer100 von dem Träger20 (19 ) durch Projizieren von Licht auf das LTHC-Beschichtungsmaterial22 entbondet. Der jeweilige Prozess ist als Prozess230 in dem in27 gezeigten Prozessfluss200 veranschaulicht. Infolge der Belichtung (zum Beispiel durch Laser-Scannen) wird der Trennfilm22 zersetzt, so dass der Träger20 von der dielektrischen Pufferschicht24 abgehoben werden kann und somit der rekonstruierte Wafer100 von dem Träger20 entbondet (demontiert) wird. - Unter Bezug auf
21 werden in der dielektrischen Pufferschicht24 Öffnungen92 gebildet, und somit werden RDLs26 freigelegt. Gemäß einigen Ausführungsformen der vorliegenden Offenbarung werden die Öffnungen92 durch Laserbohren gebildet. Der jeweilige Prozess ist als Prozess232 in dem in27 gezeigten Prozessfluss200 veranschaulicht. Auf die freiliegenden Abschnitte der RDLs26 können Vorlötregionen (nicht gezeigt) aufgebracht werden. - Anschließend wird, unter weiterem Bezug auf
21 , ein Vereinzelungsprozess (Die-Säge-Prozess) durchgeführt, um den rekonstruierten Wafer100 in einzelne Packages100' zu trennen, die einander identisch sind. Der jeweilige Prozess ist als Prozess234 in dem in27 gezeigten Prozessfluss200 veranschaulicht. Die Vereinzelung kann mittels eines Sägeblattes ausgeführt werden, oder kann mittels eines Laserstrahls ausgeführt werden, um ein Vorritzen durchzuführen, so dass Rillen gebildet werden, und dann ein Sägeblatt verwendet wird, um die Rillen zu durchtrennen. -
22 gezeigt das Verbonden eines vereinzelten Packages100' mit Sockets96 und Verbindern98 durch elektrische Verbinder94 , dergestalt, dass dass das Package102 gebildet wird. Der jeweilige Prozess ist als Prozess236 in dem in27 gezeigten Prozessfluss200 veranschaulicht. Die Sockets96 und die Verbinder98 können für die Strom- und Signalroutung zwischen Packages100' und externen Vorrichtungen verwendet werden. -
23 gezeigt ein beispielhaftes Routungsregime und beispielhafte Layouts von dicken RDLs (wie zum Beispiel 26, 46L und 60L in22 ) und dünnen RDLs (wie zum Beispiel 40 und 56 in22 ). Die dünne RDL-Schicht, die als dünn-1 gekennzeichnet ist, ist eine Zusammenstellung aller dünnen RDLs und Dummy-Pads in derselben Schicht. Jede der dicken RDL-Schichten, die als dick-i und dick-2 gekennzeichnet sind, ist eine Zusammenstellung aller dicken RDLs und Dummy-Pads in derselben Schicht. Die dünne RDL-Schicht dünn-1 wird zwischen den dicken RDL-Schichten dick-i und dick-2 angeordnet, wobei die dicke RDL-Schicht dick-i höher oder niedriger als die dicke RDL-Schicht dick-2 sein kann. Gemäß einigen Ausführungsformen werden dünne RDL-Schichten, wie zum Beispiel dünn-1, hauptsächlich zum Bereitstellen einer Electromagnetic Interface-Abschirmung (EMI-Abschirmung) verwendet, um Interferenzen der Signalroutungsleitungen zwischen verschiedenen Routungsschichten, wie zum Beispiel den Schichten dick-i und dick-2, zu reduzieren. Die dünnen RDL-Schichten weisen Metallpads auf, die dafür verwendet werden, die Routungsleitungen in ihren darüberliegenden und darunterliegenden RDL-Schichten miteinander zu verbinden. Die Metallpads (wie zum Beispiel 108A) in den dünnen RDL-Schichten sind kurz, und daher werden die Metallpads in den dünnen RDL-Schichten nicht zum Zweck seitlicher Routungen verwendet. Die Dummy-Pads (wie zum Beispiel das Dummy-Pad108B) werden in den dünnen RDL-Schichten ausgebildet und können zum Zweck der EMI-Abschirmung mit elektrischer Erde verbunden werden. Die Dummy-Pads108 können Öffnungen109 enthalten, um den Strukturladungseffekt zu reduzieren. - Die dicken RDL-Schichten enthalten Metallpads und Routungsleitungen für das seitliche Routen. Die RDLs in der dicken RDL-Schicht sind länger als die Metallpads/Leitungen in den dünnen RDL-Schichten. Die Metallpads in den dicken RDL-Schichten sind dick, und daher ist der Reihenwiderstand gering, so dass die RDLs in den dicken RDL-Schichten für den Zweck des lateralen Routens geeignet sind. Dummy-Pads (wie zum Beispiel die Dummy-Pads
106B und110B) werden ebenfalls in dicken RDL-Schichten gebildet, um die EMI-Abschirmung zwischen benachbarten RDLs weiter zu verbessern. Die Dummy-Pads106B und108B können zum Zweck der EMI-Abschirmung elektrisch geerdet werden. Die Dummy-Pads106B und108B können auch Öffnungen109 enthalten, um den Strukturladungseffekt zu reduzieren. - Gemäß einigen Ausführungsformen ist unter der Annahme, dass die durchschnittliche Länge der RDLs in der dicken RDL-Schicht L1 ist und die durchschnittliche Länge der RDLs in den dünnen RDL-Schichten L2 ist, das Verhältnis L1/L2 größer als 1,0, und kann größer als etwa 50.000 sein. Das Verhältnis L1/L2 kann auch im Bereich zwischen etwa 1 und etwa 1.000 liegen. Außerdem können alle RDL-Leitungen und Pads in den dünnen RDL-Schichten eine maximale Länge von etwa 300.000 µm (300 mm) haben. Andererseits sind wenigstens einige, und eventuell alle, RDLs in den dicken RDL-Schichten länger als die maximale Länge der RDLs in den dünnen RDLs. Die Länge der RDLs in den dicken RDL-Schichten kann 2-, 5-, 10- oder 100-mal länger sein als die maximale Länge der RDLs in den dünnen RDLs. Dementsprechend sind alle langen seitlichen Routungen (zum Beispiel mit Distanzen von mehr als etwa 300.000 µm (300 mm)) in den dicken RDLs angeordnet. Die langen RDLs 106A' und 108A' sind ebenfalls veranschaulicht, um die langen Routungsleitungen zu veranschaulichen, die durch die Dummy-Metallpads
106B bzw.108B voneinander abgeschirmt sind. -
23 veranschaulicht ein beispielhaftes Signal-/Strom-Routungsregime. Ein Signal oder Strom wird über eine lange Distanz seitlich durch die RDL106A (in der dicken RDL dick-1) geleitet und wird dann über eine Durchkontaktierung (nicht gezeigt) zu dem Metallpad108A in der dünnen RDL-Schicht dünn-1 geleitet. Das Signal oder der Strom wird dann in der dicken RDL-Schicht dick-2 durch eine weitere Durchkontaktierung (nicht abgebildet) zu der RDL110A in der dünnen RDL-Schicht dick-2 geleitet. Das Metallpad108A wird für die Verbindung zwischen den RDL-Leitungen106A und110A verwendet und wird nicht zum Zweck der seitliche Routung verwendet. Die RDL110A in der dicken RDL-Schicht dick-2 kann ebenfalls lang sein. - Das in den
22 und23 gezeigte Routungsregime kann zur Bildung von Hochgeschwindigkeits-Übertragungsleitungen (wie zum Beispiel Differentialübertragungsleitungen) verwendet werden, und kann für große Packages verwendet werden, in denen die Übertragungsleitungen lang sind und somit der Einfügeverlust hoch ist. Um den Einfügeverlust zu verringern, werden die Leitungsbreiten der Übertragungsleitungen in den dicken RDLs vorzugsweise vergrößert (zum Beispiel auf mehr als etwa 15 µm oder etwa 20 µm), so dass der Widerstand der Übertragungsleitungen verringert werden kann. Die Zunahme der Breite der Übertragungsleitungen führt jedoch dazu, dass die Impedanz der Übertragungsleitungen nachteilig reduziert wird, was zu einer Fehlanpassung der Impedanzwerte zwischen verschiedenen Teilen des Packages führt. Gemäß einigen Ausführungsformen der vorliegenden Offenbarung wird die Höhe H1 (22 ) zwischen der Übertragungsleitung und einer der benachbarten dünnen RDL-Schichten (EMI-Abschirmung) erhöht, so dass bei einer Erhöhung der Leitungsbreite der Übertragungsleitungen in den dicken RDL-Schichten die Impedanz nicht verringert wird und auf einem gewünschten Wert (zum Beispiel 100 Ohm) gehalten werden kann. Daher reduziert das Abwechseln von dickeren dielektrischen Schichten und dünneren dielektrischen Schichten nicht nur den Einfügeverlust der langen horizontalen Übertragungsleitungen, sondern gleicht auch die Anforderung des Beibehaltens der Impedanz der Übertragungsleitungen aus. -
24 veranschaulicht ein Package102 gemäß einigen Ausführungsformen, wobei einige weitere Details nicht gezeigt sind, die in22 veranschaulicht sind. Gemäß einigen Ausführungsformen weisen die gebondeten Package-Komponenten84 die SoC-Packages 84A und 84C und den HBM84B auf. Die Package-Komponenten72A können Brücken-Dies sein, die zur Verbindung der Package-Komponenten84A und84B verwendet und zur Verbindung der Package-Komponenten84B und84C miteinander verwendet werden. Der IVR-Die72B und die IPD72C sind ebenfalls veranschaulicht. -
25 veranschaulicht das Package102 gemäß einer alternativen Ausführungsform. In diesen Ausführungsformen sind mehrere Gruppen von Package-Komponenten84 veranschaulicht, die jeweils durch die Interconnect-Struktur75 und die Brücken-Dies in den Package-Komponenten72 miteinander verbunden werden können. -
26 veranschaulicht eine vergrößerte Ansicht der Region97 in22 , die einen Teil der dickeren dielektrischen Schicht38 , einen Teil der dünneren dielektrischen Schicht42 und einen Teil der RDL40 veranschaulicht. Wie oben erwähnt, kann die dielektrische Schicht38 Basismaterial38A , wie zum Beispiel ein Epoxid, ein Harz, ein Polymer oder dergleichen, und kugelförmige Partikel38B enthalten. Aufgrund des Planarisierungsprozesses können die oberen Teile einiger kugelförmiger Partikel38B entfernt werden, um Teilpartikel zu bilden, die planare Oberseiten haben, die mit der planaren Oberseite des Basismaterials38A koplanar sind. Die Unterseite der dielektrischen Schicht42 berührt die planaren Oberseiten der Teilpartikel38B und des Basismaterials38A . Die dielektrische Schicht42 hingegen kann aus einem homogenen Material gebildet sein und braucht keine Partikel zu enthalten. - In den oben veranschaulichten Ausführungsformen werden einige Prozesse und Merkmale gemäß einigen Ausführungsformen der vorliegenden Offenbarung besprochen, um ein dreidimensionales Package (3D-Package) zu bilden. Andere Merkmale und Prozesse können ebenfalls enthalten sein. So können zum Beispiel Teststrukturen enthalten sein, die bei Verifizierungstests der 3D-Verkapselung oder der 3DIC-Vorrichtungen helfen. Die Teststrukturen können zum Beispiel Testpads aufweisen, die in einer Umverteilungsschicht oder auf einem Substrat ausgebildet sind, was das Testen der 3D-Verkapselung oder der 3DIC, die Verwendung von Sonden und/oder Sondenkarten und dergleichen ermöglicht. Die Verifizierungstests können sowohl an Zwischenstrukturen als auch an der fertigen Struktur ausgeführt werden. Darüber hinaus können die im vorliegenden Text offenbarten Strukturen und Verfahren in Verbindung mit Testmethodologien verwendet werden, die eine Zwischenverifizierung bekannter guter Dies umfassen, um die Produktionsausbeute zu erhöhen und die Kosten zu senken.
- Die Ausführungsformen der vorliegenden Offenbarung zeichnen sich durch einige vorteilhafte Merkmale aus. Durch die Reduzierung der Dicke der dünnen dielektrischen Schichten und der dünnen RDL-Schichten kann die Gesamtzahl der RDL-Schichten (einschließlich dicker RDLs und dünner RDL-Schichten) erhöht werden, und die Routungsfähigkeit kann verbessert werden. Das Verziehen des resultierenden Package und des rekonstruierten Wafers wird jedoch nicht erhöht, da die Gesamtdicke aller dielektrischen Schichten nicht erhöht wird. Die Produktionsausbeute des entsprechenden Prozesses ist hoch, da die Funktion der Routungsschichten vor dem Bonden der Vorrichtungs-Dies getestet werden kann.
- Gemäß einigen Ausführungsformen der vorliegenden Offenbarung umfasst ein Verfahren: Bilden mehrerer dielektrischer Schichten, was das Bilden mehrerer erster dielektrischer Schichten mit ersten Dicken umfasst; Bilden mehrerer zweiter dielektrischer Schichten, die zweite Dicken aufweisen, die kleiner sind als die ersten Dicken, wobei die mehreren ersten dielektrischen Schichten und die mehreren zweiten dielektrischen Schichten abwechselnd angeordnet sind; und Bilden mehrerer Umverteilungsleitungen, die verbunden sind, um einen leitfähigen Pfad zu bilden, wobei das Bilden der mehreren Umverteilungsleitungen das Bilden mehrerer erster Umverteilungsleitungen umfasst, die sich jeweils in einer der mehreren ersten dielektrischen Schichten befinden; und Bilden mehrerer zweiter Umverteilungsleitungen, die sich jeweils in einer der mehreren zweiten dielektrischen Schichten befinden. In einer Ausführungsform sind die mehreren ersten dielektrischen Schichten aus Vergussmassen gebildet, und die mehreren zweiten dielektrischen Schichten sind aus lichtempfindlichen Polymeren gebildet. In einer Ausführungsform umfasst das Verfahren des Weiteren das Bilden mehrerer Durchkontaktierungen, und das Verfahren umfasst: Abscheiden einer der mehreren ersten dielektrischen Schichten, um eine der mehreren Durchkontaktierungen einzubetten; und Ausführen eines Planarisierungsprozesses auf der einen der mehreren ersten dielektrischen Schichten und der einen der mehreren Durchkontaktierungen. In einer Ausführungsform umfasst das Verfahren des Weiteren das Bilden mehrerer Durchkontaktierungen, jede in einer der mehreren ersten dielektrischen Schichten, wobei jede der mehreren Durchkontaktierungen und eine jeweilige darunter liegende der mehreren ersten Umverteilungsleitungen plattiert werden und dabei eine selbe Metallkeimschicht gemeinsam nutzen. In einer Ausführungsform umfasst das Verfahren des Weiteren: Bilden eines Metallpads über einer oberen dielektrischen Schicht in den mehreren dielektrischen Schichten; Bilden eines Metallpfostens über und in Kontakt mit dem Metallpad; Anbringen eines Vorrichtungs-Dies an der oberen dielektrischen Schicht; und Verkapseln des Metalls. In einer Ausführungsform sind die Verhältnisse der ersten Dicken zu den zweiten Dicken größer als etwa 1,5. In einer Ausführungsform haben die mehreren ersten Umverteilungsleitungen dritte Dicken, und die mehreren zweiten Umverteilungsleitungen haben vierte Dicken, die kleiner als die dritten Dicken sind. In einer Ausführungsform umfasst jede der mehreren ersten dielektrischen Schichten ein Basismaterial und Füllstoffpartikel in dem Basismaterial, und jede der mehreren zweiten dielektrischen Schichten ist aus einem homogenen Material gebildet.
- Gemäß einigen Ausführungsformen der vorliegenden Offenbarung umfasst ein Verfahren: Bilden mehrerer Polymerschichten; Bilden mehrerer Vergussmassenschichten, wobei die mehreren Polymerschichten und die mehreren Polymerschichten abwechselnd angeordnet sind, und wobei jede der mehreren Vergussmassenschichten durch Prozesse gebildet wird, die das Abscheiden einer Vergussmasse umfassen; und Durchführen eines Planarisierungsprozesses, um eine Oberseite der Vergussmasse zu nivellieren; Bilden mehrerer erster Umverteilungsschichten, jede in einer der mehreren Polymerschichten, wobei die mehreren ersten Umverteilungsschichten elektromagnetische Abschirmungsschichten sind; und Bilden mehrerer zweiter Umverteilungsschichten, jede in einer der mehreren Vergussmassenschichten, wobei die mehreren zweiten Umverteilungsschichten horizontale Routungsschichten sind. In einer Ausführungsform ist eine der mehreren Vergussmassenschichten dicker als sowohl eine erste Polymerschicht als auch eine zweite Polymerschicht in den mehreren Polymerschichten, wobei die erste Polymerschicht über, und in Kontakt mit, der einen der mehreren Vergussmassenschichten liegt und die zweite Polymerschicht unter, und in Kontakt mit, der einen der mehreren Vergussmassenschichten liegt. In einer Ausführungsform werden die mehreren Polymerschichten nicht durch Planarisierungsprozesse planarisiert. In einer Ausführungsform umfasst das Package des Weiteren das Bilden mehrerer Durchkontaktierungen, jede in einer der mehreren Vergussmassenschichten, wobei jede der mehreren Durchkontaktierungen und eine entsprechende darunterliegende Umverteilungsleitung in separaten Plattierungsprozessen gebildet werden. In einer Ausführungsform wird jede der mehreren Durchkontaktierungen durch einen entsprechenden Planarisierungsprozess planarisiert. In einer Ausführungsform werden jede der mehreren Durchkontaktierungen und eine entsprechende darunterliegende der mehreren zweiten Umverteilungsschichten durch gemeinsame Nutzung einer selben Metallkeimschicht gebildet.
- Gemäß einigen Ausführungsformen der vorliegenden Offenbarung umfasst ein Package: mehrere Polymerschichten, wobei die mehreren Polymerschichten erste Dicken aufweisen; mehrere Vergussmassenschichten, wobei die mehreren Polymerschichten und die mehreren Vergussmassenschichten abwechselnd angeordnet sind, und wobei die mehreren Vergussmassenschichten zweite Dicken aufweisen, die größer als die ersten Dicken sind; mehrere erste Umverteilungsschichten, jede in einer der mehreren Polymerschichten, wobei die mehreren ersten Umverteilungsschichten elektromagnetische Abschirmungsschichten sind; und mehrere zweite Umverteilungsschichten, jede in einer der mehreren Vergussmassenschichten, wobei die mehreren zweiten Umverteilungsschichten horizontale Routungsschichten sind. In einer Ausführungsform sind die mehreren ersten Umverteilungsschichten dünner als die mehreren zweiten Umverteilungsschichten. In einer Ausführungsform umfassen die mehreren ersten Umverteilungsschichten erste Umverteilungsleitungen mit einer maximalen Länge, und die mehreren zweiten Umverteilungsschichten umfassen zweite Umverteilungsleitungen, die länger als die maximale Länge sind. In einer Ausführungsform haben die mehreren ersten Umverteilungsschichten dritte Dicken, und die mehreren zweiten Umverteilungsschichten haben vierte Dicken, die größer als die dritten Dicken sind. In einer Ausführungsform sind die Verhältnisse der zweiten Dicken zu den ersten Dicken größer als etwa 1,5. In einer Ausführungsform umfasst jede der mehreren Vergussmassenschichten ein Basismaterial und Füllstoffpartikel in dem Basismaterial, und die mehreren Polymerschichten sind aus homogenen Materialien gebildet.
- Das oben Dargelegte umreißt Merkmale verschiedener Ausführungsformen, so dass der Fachmann die Aspekte der vorliegenden Offenbarung besser verstehen kann. Dem Fachmann ist klar, dass er die vorliegende Offenbarung ohne Weiteres als Basis für das Entwerfen oder Modifizieren anderer Prozesse und Strukturen verwenden kann, um die gleichen Zwecke und/oder die gleichen Vorteile wie bei den im vorliegenden Text vorgestellten Ausführungsformen zu erreichen. Dem Fachmann sollte auch klar sein, dass solche äquivalenten Bauformen nicht das Wesen und den Schutzumfang der vorliegenden Offenbarung verlassen, und dass er verschiedene Änderungen, Substituierungen und Modifizierungen an der vorliegenden Erfindung vornehmen kann, ohne vom Wesen und Schutzumfang der vorliegenden Offenbarung abzuweichen.
- ZITATE ENTHALTEN IN DER BESCHREIBUNG
- Diese Liste der vom Anmelder aufgeführten Dokumente wurde automatisiert erzeugt und ist ausschließlich zur besseren Information des Lesers aufgenommen. Die Liste ist nicht Bestandteil der deutschen Patent- bzw. Gebrauchsmusteranmeldung. Das DPMA übernimmt keinerlei Haftung für etwaige Fehler oder Auslassungen.
- Zitierte Patentliteratur
-
- US 16656642 [0001]
Claims (20)
- Verfahren, das umfasst: Bilden mehrerer dielektrischer Schichten, was umfasst: Bilden mehrerer erster dielektrischer Schichten, die erste Dicken aufweisen; Bilden mehrerer zweiter dielektrischer Schichten, die zweite Dicken aufweisen, die kleiner sind als die ersten Dicken, wobei die mehreren ersten dielektrischen Schichten und die mehreren zweiten dielektrischen Schichten abwechselnd angeordnet sind; und Bilden mehrerer Umverteilungsleitungen, die verbunden sind, um einen leitfähigen Pfad zu bilden, wobei das Bilden der mehreren Umverteilungsleitungen umfasst: Bilden mehrerer erster Umverteilungsleitungen, von denen sich jede in einer der mehreren ersten dielektrischen Schichten befindet; und Bilden mehrerer zweiter Umverteilungsleitungen, die sich jeweils in einer der mehreren zweiten dielektrischen Schichten befinden.
- Verfahren nach
Anspruch 1 , wobei die mehreren ersten dielektrischen Schichten aus Vergussmassen gebildet sind, und die mehreren zweiten dielektrischen Schichten sind aus lichtempfindlichen Polymeren gebildet sind. - Verfahren nach
Anspruch 1 oder2 , das des Weiteren das Bilden mehrerer Durchkontaktierungen umfasst, und wobei das Verfahren umfasst: Abscheiden einer der mehreren ersten dielektrischen Schichten, um eine der mehreren Durchkontaktierungen einzubetten; und Ausführen eines Planarisierungsprozesses auf der einen der mehreren ersten dielektrischen Schichten und der einen der mehreren Durchkontaktierungen. - Verfahren nach einem der vorangehenden Ansprüche, das des Weiteren das Bilden mehrerer Durchkontaktierungen umfasst, jede in einer der mehreren ersten dielektrischen Schichten, wobei jede der mehreren Durchkontaktierungen und eine jeweilige darunterliegende der mehreren ersten Umverteilungsleitungen plattiert werden und dabei eine selbe Metallkeimschicht gemeinsam nutzen.
- Verfahren nach einem der vorangehenden Ansprüche, das des Weiteren umfasst: Bilden eines Metallpads über einer oberen dielektrischen Schicht in den mehreren dielektrischen Schichten; Bilden eines Metallpfostens über und in Kontakt mit dem Metallpad; Anbringen eines Vorrichtungs-Dies an der oberen dielektrischen Schicht; und Verkapseln des Metallpads, des Metallpfostens und des Vorrichtungs-Dies in einem Verkapselungsmittel.
- Verfahren nach einem der vorangehenden Ansprüche, wobei die Verhältnisse der ersten Dicken zu den zweiten Dicken größer als etwa 1,5 sind.
- Verfahren nach einem der vorangehenden Ansprüche, wobei die mehreren ersten Umverteilungsleitungen dritte Dicken haben, und die mehreren zweiten Umverteilungsleitungen vierte Dicken haben, die kleiner als die dritten Dicken sind.
- Verfahren nach einem der vorangehenden Ansprüche, wobei jede der mehreren ersten dielektrischen Schichten ein Basismaterial und Füllstoffpartikel in dem Basismaterial umfasst, und jede der mehreren zweiten dielektrischen Schichten aus einem homogenen Material gebildet ist.
- Verfahren, das umfasst: Bilden mehrerer Polymerschichten; Bilden mehrerer Vergussmassenschichten, wobei die mehreren Polymerschichten und die mehreren Vergussmassenschichten abwechselnd angeordnet sind, und wobei jede der mehreren Vergussmassenschichten durch Prozesse gebildet wird, die umfassen: Abscheiden einer Vergussmasse; und Durchführen eines Planarisierungsprozesses, um eine Oberseite der Vergussmasse zu nivellieren; Bilden mehrerer erster Umverteilungsschichten, jede in einer der mehreren Polymerschichten, wobei die mehreren ersten Umverteilungsschichten elektromagnetische Abschirmungsschichten sind; und Bilden mehrerer zweiter Umverteilungsschichten, jede in einer der mehreren Vergussmassenschichten, wobei die mehreren zweiten Umverteilungsschichten horizontale Routungsschichten sind.
- Verfahren nach
Anspruch 9 , wobei eine der mehreren Vergussmassenschichten dicker als sowohl eine erste Polymerschicht als auch eine zweite Polymerschicht in den mehreren Polymerschichten ist, wobei die erste Polymerschicht über, und in Kontakt mit, der einen der mehreren Vergussmassenschichten liegt und die zweite Polymerschicht unter, und in Kontakt mit, der einen der mehreren Vergussmassenschichten liegt. - Verfahren nach
Anspruch 9 oder10 , wobei die mehreren Polymerschichten nicht durch Planarisierungsprozesse planarisiert werden. - Verfahren nach einem der vorangehenden
Ansprüche 9 bis11 , das des Weiteren das Bilden mehrerer Durchkontaktierungen umfasst, jede in einer der mehreren Vergussmassenschichten, wobei jede der mehreren Durchkontaktierungen und eine entsprechende darunterliegende Umverteilungsleitung in getrennten Plattierungsprozessen gebildet werden. - Verfahren nach
Anspruch 12 , wobei jede der mehreren Durchkontaktierungen durch einen entsprechenden Planarisierungsprozess planarisiert wird. - Verfahren nach
Anspruch 12 oder13 , wobei jede jede der mehreren Durchkontaktierungen und eine entsprechende darunterliegende der mehreren zweiten Umverteilungsschichten durch gemeinsame Nutzung einer selben Metallkeimschicht gebildet werden. - Package, das umfasst: mehrere Polymerschichten, wobei die mehreren Polymerschichten erste Dicken aufweisen; mehrere Vergussmassenschichten, wobei die mehreren Polymerschichten und die mehreren Vergussmassenschichten abwechselnd angeordnet sind, und wobei die mehreren Vergussmassenschichten zweite Dicken aufweisen, die größer als die ersten Dicken sind; mehrere erste Umverteilungsschichten, jede in einer der mehreren Polymerschichten, wobei die mehreren ersten Umverteilungsschichten elektromagnetische Abschirmungsschichten sind; und mehrere zweite Umverteilungsschichten, jede in einer der mehreren Vergussmassenschichten, wobei die mehreren zweiten Umverteilungsschichten horizontale Routungsschichten sind.
- Package nach
Anspruch 15 , wobei die mehreren ersten Umverteilungsschichten dünner sind als die mehreren zweiten Umverteilungsschichten. - Package nach
Anspruch 15 oder16 , wobei die mehreren ersten Umverteilungsschichten erste Umverteilungsleitungen mit einer maximalen Länge umfassen, und die mehreren zweiten Umverteilungsschichten zweite Umverteilungsleitungen umfassen, die länger als die maximale Länge sind. - Package nach einem der vorangehenden
Ansprüche 15 bis17 , wobei die mehreren ersten Umverteilungsleitungen dritte Dicken haben, und die mehreren zweiten Umverteilungsleitungen vierte Dicken haben, die kleiner als die dritten Dicken sind. - Package nach einem der vorangehenden
Ansprüche 15 bis18 , wobei die Verhältnisse der zweiten Dicken zu den ersten Dicken größer als etwa 1,5 sind. - Package nach einem der vorangehenden
Ansprüche 15 bis19 , wobei jede der mehreren Vergussmassenschichten ein Basismaterial und Füllstoffpartikel in dem Basismaterial umfasst, und die mehreren Polymerschichten aus homogenen Materialien gebildet sind.
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