DE102015100963B4 - Verfahren mit selektivem Wachstum für Metallfüllung mit hohem Seitenverhältnis - Google Patents
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- H01L21/28088—Making conductor-insulator-semiconductor electrodes the insulator being formed after the semiconductor body, the semiconductor being silicon characterised by the conductor the final conductor layer next to the insulator being a composite, e.g. TiN
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- H01L21/28—Manufacture of electrodes on semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/268
- H01L21/283—Deposition of conductive or insulating materials for electrodes conducting electric current
- H01L21/285—Deposition of conductive or insulating materials for electrodes conducting electric current from a gas or vapour, e.g. condensation
- H01L21/28506—Deposition of conductive or insulating materials for electrodes conducting electric current from a gas or vapour, e.g. condensation of conductive layers
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- H01L21/285—Deposition of conductive or insulating materials for electrodes conducting electric current from a gas or vapour, e.g. condensation
- H01L21/28506—Deposition of conductive or insulating materials for electrodes conducting electric current from a gas or vapour, e.g. condensation of conductive layers
- H01L21/28512—Deposition of conductive or insulating materials for electrodes conducting electric current from a gas or vapour, e.g. condensation of conductive layers on semiconductor bodies comprising elements of Group IV of the Periodic Table
- H01L21/28556—Deposition of conductive or insulating materials for electrodes conducting electric current from a gas or vapour, e.g. condensation of conductive layers on semiconductor bodies comprising elements of Group IV of the Periodic Table by chemical means, e.g. CVD, LPCVD, PECVD, laser CVD
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- H01L21/31—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
- H01L21/3205—Deposition of non-insulating-, e.g. conductive- or resistive-, layers on insulating layers; After-treatment of these layers
- H01L21/321—After treatment
- H01L21/32115—Planarisation
- H01L21/3212—Planarisation by chemical mechanical polishing [CMP]
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- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/31—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
- H01L21/3205—Deposition of non-insulating-, e.g. conductive- or resistive-, layers on insulating layers; After-treatment of these layers
- H01L21/321—After treatment
- H01L21/3213—Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer
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- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76801—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing
- H01L21/76802—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing by forming openings in dielectrics
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- H01L21/76801—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing
- H01L21/76829—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing characterised by the formation of thin functional dielectric layers, e.g. dielectric etch-stop, barrier, capping or liner layers
- H01L21/76831—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing characterised by the formation of thin functional dielectric layers, e.g. dielectric etch-stop, barrier, capping or liner layers in via holes or trenches, e.g. non-conductive sidewall liners
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- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76838—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
- H01L21/7684—Smoothing; Planarisation
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- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76838—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
- H01L21/76841—Barrier, adhesion or liner layers
- H01L21/76843—Barrier, adhesion or liner layers formed in openings in a dielectric
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- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76838—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
- H01L21/76841—Barrier, adhesion or liner layers
- H01L21/76843—Barrier, adhesion or liner layers formed in openings in a dielectric
- H01L21/76844—Bottomless liners
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- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
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- H01L21/76838—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
- H01L21/76877—Filling of holes, grooves or trenches, e.g. vias, with conductive material
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- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76838—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
- H01L21/76877—Filling of holes, grooves or trenches, e.g. vias, with conductive material
- H01L21/76879—Filling of holes, grooves or trenches, e.g. vias, with conductive material by selective deposition of conductive material in the vias, e.g. selective C.V.D. on semiconductor material, plating
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- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/482—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of lead-in layers inseparably applied to the semiconductor body
- H01L23/485—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of lead-in layers inseparably applied to the semiconductor body consisting of layered constructions comprising conductive layers and insulating layers, e.g. planar contacts
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- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/40—Electrodes ; Multistep manufacturing processes therefor
- H01L29/41—Electrodes ; Multistep manufacturing processes therefor characterised by their shape, relative sizes or dispositions
- H01L29/417—Electrodes ; Multistep manufacturing processes therefor characterised by their shape, relative sizes or dispositions carrying the current to be rectified, amplified or switched
- H01L29/41725—Source or drain electrodes for field effect devices
- H01L29/41791—Source or drain electrodes for field effect devices for transistors with a horizontal current flow in a vertical sidewall, e.g. FinFET, MuGFET
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- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/40—Electrodes ; Multistep manufacturing processes therefor
- H01L29/41—Electrodes ; Multistep manufacturing processes therefor characterised by their shape, relative sizes or dispositions
- H01L29/423—Electrodes ; Multistep manufacturing processes therefor characterised by their shape, relative sizes or dispositions not carrying the current to be rectified, amplified or switched
- H01L29/42312—Gate electrodes for field effect devices
- H01L29/42316—Gate electrodes for field effect devices for field-effect transistors
- H01L29/4232—Gate electrodes for field effect devices for field-effect transistors with insulated gate
- H01L29/42372—Gate electrodes for field effect devices for field-effect transistors with insulated gate characterised by the conducting layer, e.g. the length, the sectional shape or the lay-out
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- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/40—Electrodes ; Multistep manufacturing processes therefor
- H01L29/43—Electrodes ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
- H01L29/49—Metal-insulator-semiconductor electrodes, e.g. gates of MOSFET
- H01L29/4966—Metal-insulator-semiconductor electrodes, e.g. gates of MOSFET the conductor material next to the insulator being a composite material, e.g. organic material, TiN, MoSi2
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- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/40—Electrodes ; Multistep manufacturing processes therefor
- H01L29/43—Electrodes ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
- H01L29/49—Metal-insulator-semiconductor electrodes, e.g. gates of MOSFET
- H01L29/51—Insulating materials associated therewith
- H01L29/517—Insulating materials associated therewith the insulating material comprising a metallic compound, e.g. metal oxide, metal silicate
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- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/66007—Multistep manufacturing processes
- H01L29/66075—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials
- H01L29/66227—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials the devices being controllable only by the electric current supplied or the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched, e.g. three-terminal devices
- H01L29/66409—Unipolar field-effect transistors
- H01L29/66477—Unipolar field-effect transistors with an insulated gate, i.e. MISFET
- H01L29/66545—Unipolar field-effect transistors with an insulated gate, i.e. MISFET using a dummy, i.e. replacement gate in a process wherein at least a part of the final gate is self aligned to the dummy gate
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- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
- H01L29/76—Unipolar devices, e.g. field effect transistors
- H01L29/772—Field effect transistors
- H01L29/78—Field effect transistors with field effect produced by an insulated gate
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- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
- H01L29/76—Unipolar devices, e.g. field effect transistors
- H01L29/772—Field effect transistors
- H01L29/78—Field effect transistors with field effect produced by an insulated gate
- H01L29/7831—Field effect transistors with field effect produced by an insulated gate with multiple gate structure
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- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
- H01L29/76—Unipolar devices, e.g. field effect transistors
- H01L29/772—Field effect transistors
- H01L29/78—Field effect transistors with field effect produced by an insulated gate
- H01L29/785—Field effect transistors with field effect produced by an insulated gate having a channel with a horizontal current flow in a vertical sidewall of a semiconductor body, e.g. FinFET, MuGFET
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- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
- H01L29/76—Unipolar devices, e.g. field effect transistors
- H01L29/772—Field effect transistors
- H01L29/78—Field effect transistors with field effect produced by an insulated gate
- H01L29/785—Field effect transistors with field effect produced by an insulated gate having a channel with a horizontal current flow in a vertical sidewall of a semiconductor body, e.g. FinFET, MuGFET
- H01L29/7855—Field effect transistors with field effect produced by an insulated gate having a channel with a horizontal current flow in a vertical sidewall of a semiconductor body, e.g. FinFET, MuGFET with at least two independent gates
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- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/52—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames
- H01L23/522—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames including external interconnections consisting of a multilayer structure of conductive and insulating layers inseparably formed on the semiconductor body
- H01L23/532—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames including external interconnections consisting of a multilayer structure of conductive and insulating layers inseparably formed on the semiconductor body characterised by the materials
- H01L23/53204—Conductive materials
- H01L23/53209—Conductive materials based on metals, e.g. alloys, metal silicides
- H01L23/53214—Conductive materials based on metals, e.g. alloys, metal silicides the principal metal being aluminium
- H01L23/53223—Additional layers associated with aluminium layers, e.g. adhesion, barrier, cladding layers
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- H01L23/52—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames
- H01L23/522—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames including external interconnections consisting of a multilayer structure of conductive and insulating layers inseparably formed on the semiconductor body
- H01L23/532—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames including external interconnections consisting of a multilayer structure of conductive and insulating layers inseparably formed on the semiconductor body characterised by the materials
- H01L23/53204—Conductive materials
- H01L23/53209—Conductive materials based on metals, e.g. alloys, metal silicides
- H01L23/53257—Conductive materials based on metals, e.g. alloys, metal silicides the principal metal being a refractory metal
- H01L23/53266—Additional layers associated with refractory-metal layers, e.g. adhesion, barrier, cladding layers
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- H01L29/40—Electrodes ; Multistep manufacturing processes therefor
- H01L29/43—Electrodes ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
- H01L29/49—Metal-insulator-semiconductor electrodes, e.g. gates of MOSFET
- H01L29/51—Insulating materials associated therewith
- H01L29/511—Insulating materials associated therewith with a compositional variation, e.g. multilayer structures
- H01L29/513—Insulating materials associated therewith with a compositional variation, e.g. multilayer structures the variation being perpendicular to the channel plane
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Abstract
Verfahren, das Folgendes umfasst:
Empfangen (302) eines Substrats (102), auf dem eine Gate-Struktur (212) angeordnet ist, wobei die Gate-Struktur einen Opferabschnitt (402) enthält;
Entfernen (304) des Opferabschnitts, um einen Graben (404) innerhalb der Gate-Struktur zu definieren, wobei der Graben gegenüberliegende Seitenflächen (414) und eine darauf definierte Bodenfläche (416) hat;
selektives Ausbilden (314) einer Materialschicht (412) auf oberen Abschnitten der gegenüberliegenden Seitenflächen, wobei untere Abschnitte der gegenüberliegenden Seitenflächen und die Bodenfläche frei von der Materialschicht sind; und
Abscheiden (316) eines Füllmaterials (418) einer Gate-Elektrode (220) auf der Materialschicht, auf den unteren Abschnitten der gegenüberliegenden Seitenflächen und auf der Bodenfläche innerhalb des Grabens.
Empfangen (302) eines Substrats (102), auf dem eine Gate-Struktur (212) angeordnet ist, wobei die Gate-Struktur einen Opferabschnitt (402) enthält;
Entfernen (304) des Opferabschnitts, um einen Graben (404) innerhalb der Gate-Struktur zu definieren, wobei der Graben gegenüberliegende Seitenflächen (414) und eine darauf definierte Bodenfläche (416) hat;
selektives Ausbilden (314) einer Materialschicht (412) auf oberen Abschnitten der gegenüberliegenden Seitenflächen, wobei untere Abschnitte der gegenüberliegenden Seitenflächen und die Bodenfläche frei von der Materialschicht sind; und
Abscheiden (316) eines Füllmaterials (418) einer Gate-Elektrode (220) auf der Materialschicht, auf den unteren Abschnitten der gegenüberliegenden Seitenflächen und auf der Bodenfläche innerhalb des Grabens.
Description
- HINTERGRUND
- Die Halbleiterindustrie hat sich in dem Bemühen um eine höhere Bauelementdichte, höhere Leistung und geringere Kosten in Nanometertechnologie-Verarbeitungsknoten hinein entwickelt. Trotz bahnbrechender Fortschritte bei Werkstoffen und Fertigung hat sich das Skalieren planarer Bauelemente, wie zum Beispiel des herkömmlichen MOSFET, als eine Herausforderung erwiesen. Beispielsweise funktionieren Abscheidungstechniken, Ätztechniken und andere Prozesse, die Flüssigkeiten, Gase oder Plasmas über Bauelementstrukturen zirkulieren, allgemein gut, wenn die Strukturelemente weit voneinander beabstandet sind und für die umgebenden Reaktionsteilnehmer leicht erreichbar sind. Jedoch beschränken schmale Gräben und Hohlräume mit hohem Seitenverhältnis die Zirkulation und reduzieren die Menge der
Reaktionsteilnehmer, die innerhalb des Grabens verfügbar sind. Dies kann ein ungleichmäßiges Abscheiden oder Ätzen innerhalb des Grabens hervorrufen. - Um die Technologie weiter zu entwickeln, suchen Schaltkreisdesigner derzeit nach neuartigen Strukturen, um die Leistung zu steigern. Eine Forschungsrichtung ist die Entwicklung dreidimensionaler Designs, wie zum Beispiel eines rippenartigen Feldeffekttransistors (Fin-like Field Effect Transistor, FinFET). Einen FinFET kann man sich als ein typisches planares Bauelement vorstellen, das aus einem Substrat heraus und in das Gate hinein extrudiert wurde. Ein typischer FinFET wird mit einer dünnen „Rippe“ (oder Rippenstruktur) hergestellt, die sich von einem Substrat aufwärts erstreckt. Der Kanal des FET wird in dieser vertikalen Rippe ausgebildet, und ein Gate wird über der Kanalregion der Rippe ausgebildet (zum Beispiel um sie herum gelegt). Das Herumlegen des Gates um die Rippe vergrößert die Kontaktfläche zwischen der Kanalregion und dem Gate und erlaubt es dem Gate, den Kanal von mehreren Seiten zu steuern. Dies kann auf verschiedene Weise synergistisch ausgenutzt werden, und in einigen Anwendungen ermöglichen FinFETs reduzierte Kurzkanaleffekte, reduzierte Kriechströme und einen höheren Stromfluss. Oder anders ausgedrückt: Sie können schneller, kleiner und effizienter als planare Bauelemente sein.
- Jedoch haben FinFETs und andere nicht-planare Bauelemente noch kompliziertere Geometrien und können mehr Gräben mit hohem Seitenverhältnis haben, die auszufüllen sind. Dementsprechend waren herkömmliche Techniken zur Bauelementfertigung zwar in gewisser Hinsicht ausreichend, in anderer Hinsicht hingegen weniger zufriedenstellend. Um die stetig zunehmenden Designanforderungen zu erfüllen, werden weitere Fortschritte in der Bauelementfertigung und anderen Bereichen benötigt. Die vorliegende Offenbarung stellt Verbesserungen bereit, die sich auf die Fertigung planarer Bauelemente sowie FinFETs und anderer nicht-planarer Bauelemente beziehen. Der diesbezüglich nächstkommende Stand der Technik wird beispielsweise durch die
US 2012 / 0 256 238 A1 WO 2013 / 095 433 A1 US 2010 / 0 255 669 A1 US 2014 / 0 103 404 A1 - Figurenliste
- Die vorliegende Offenbarung wird am besten anhand der folgenden detaillierten Beschreibung verstanden, wenn sie in Verbindung mit den beiliegenden Figuren gelesen wird. Es wird darauf hingewiesen, dass gemäß der gängigen Praxis in der Industrie verschiedene Strukturelemente nicht maßstabsgetreu gezeichnet sind und allein für Veranschaulichungszwecke verwendet werden. Die Abmessungen der verschiedenen Strukturelemente können im Interesse der Übersichtlichkeit der Besprechung nach Bedarf vergrößert oder verkleinert werden. Des Weiteren sind verschiedene Elemente und Merkmale in den Figuren gezeigt, von denen im Interesse der Übersichtlichkeit nicht alle mit einer Bezugszahl versehen sind. Es versteht sich jedoch, dass symmetrische Strukturelemente und Dinge ähnlich angeordnet sind.
-
1 ist eine Querschnittsansicht eines Halbleiterbauelements gemäß Ausführungsformen der vorliegenden Offenbarung. -
2A ist eine perspektivische Ansicht eines nicht-planaren Halbleiterbauelements gemäß Ausführungsformen der vorliegenden Offenbarung. -
2B ist eine Querschnittsansicht des nicht-planaren Halbleiterbauelements, wobei der Querschnitt durch eine Kanalregion vorgenommen wurde, gemäß Ausführungsformen der vorliegenden Offenbarung. -
2C ist eine Querschnittsansicht des nicht-planaren Halbleiterbauelements, wobei der Querschnitt durch eine Source/Drain-Region vorgenommen wurde, gemäß Ausführungsformen der vorliegenden Offenbarung. -
3 ist ein Flussdiagramm eines Verfahrens zum Herstellen einer Gate-Elektrode gemäß Ausführungsformen der vorliegenden Offenbarung. - Die
4-11 sind Querschnittsansichten eines Abschnitts eines nicht-planaren Bauelements, das dem Verfahren zum Herstellen einer Gate-Elektrode unterzogen wird, gemäß Ausführungsformen der vorliegenden Offenbarung. - Die
12-19 sind Querschnittsansichten eines Abschnitts eines planaren Bauelements, das dem Verfahren zum Herstellen einer Gate-Elektrode unterzogen wird, gemäß Ausführungsformen der vorliegenden Offenbarung. -
20 ist ein Flussdiagramm eines Verfahrens zum Ausbilden eines Kontakts oder Durchkontakts gemäß Ausführungsformen der vorliegenden Offenbarung. - Die
21-26B sind Querschnittsansichten eines Abschnitts eines planaren Bauelements, das dem Verfahren zum Ausbilden eines Kontakts unterzogen wird, gemäß Ausführungsformen der vorliegenden Offenbarung. - Die
27A und27B sind Querschnittsansichten einer Source/Drain-Region eines nicht-planaren Bauelements, das dem Verfahren zum Herstellen eines Kontakts unterzogen wird, gemäß Ausführungsformen der vorliegenden Offenbarung. - Die
28A und28B sind Querschnittsansichten einer Kanalregion eines nicht-planaren Bauelements, das dem Verfahren zum Herstellen eines Kontakts unterzogen wird, gemäß Ausführungsformen der vorliegenden Offenbarung. - Die
29A und29B sind Querschnittsansichten eines Halbleiterbauelements, das dem Verfahren zum Herstellen eines Durchkontakts unterzogen wird, gemäß Ausführungsformen der vorliegenden Offenbarung. - DETAILLIERTE BESCHREIBUNG
- Die vorliegende Offenbarung betrifft allgemein die Herstellung von IC-Bauelementen, und betrifft insbesondere das Ausbilden leitfähiger Strukturelemente wie zum Beispiel Gates, Kontakte und Durchkontakte von Bauelementen.
- Es versteht sich, dass die folgende Offenbarung viele verschiedene Ausführungsformen oder Beispiele zum Implementieren verschiedener Merkmale verschiedener Ausführungsformen bereitstellt. Konkrete Beispiele von Komponenten und Anordnungen werden unten beschrieben, um die vorliegende Offenbarung zu vereinfachen. Dies sind natürlich lediglich Beispiele, und sie sollen nicht einschränkend sein. Darüber hinaus kann die vorliegende Offenbarung Bezugszahlen und/oder -buchstaben in den verschiedenen Beispielen wiederholen. Diese Wiederholung dient dem Zweck der Einfachheit und Klarheit und schafft nicht automatisch eine Beziehung zwischen den verschiedenen besprochenen Ausführungsformen und/oder Konfigurationen. Darüber hinaus kann die Ausbildung eines ersten Merkmals über oder auf einem zweiten Merkmal in der folgenden Beschreibung Ausführungsformen enthalten, bei denen die ersten und zweiten Merkmale in direktem Kontakt ausgebildet werden, und können auch Ausführungsformen enthalten, bei denen weitere Merkmale zwischen den ersten und zweiten Merkmalen ausgebildet sein können, so dass die ersten und zweiten Merkmale möglicherweise nicht in direktem Kontakt stehen.
- Des Weiteren können räumlich relative Begriffe, wie zum Beispiel „unterhalb“, „unter“, „unterer“, „oberhalb“, „oberer“ und dergleichen, im vorliegenden Text verwendet werden, um die Beschreibung zu vereinfachen, um die Beziehung eines Elements oder Strukturelements zu einem oder mehreren anderen Elementen oder Strukturelementen zu beschreiben, wie in den Figuren veranschaulicht. Die räumlich relativen Begriffe sollen neben der in den Figuren gezeigten Ausrichtung noch weitere Ausrichtungen der Vorrichtung während des Gebrauchs oder Betriebes umfassen. Wenn zum Beispiel das Bauelement in den Figuren umgedreht wird, so wären Elemente, die als „unter“ oder „unterhalb“ anderer Elemente oder Strukturelemente beschrieben sind, dann „über“ den anderen Elementen oder Strukturelementen ausgerichtet sein. Das heißt, der beispielhafte Begriff „darunter“ kann eine Ausrichtung sowohl darüber als auch darunter umfassen. Die Vorrichtung kann auch anders ausgerichtet (90 Grad gedreht oder anders ausgerichtet) sein, und die im vorliegenden Text verwendeten räumlich relativen Deskriptoren können gleichermaßen entsprechend interpretiert werden.
- Es wird ein Prozess zum Herstellen leitfähiger Strukturelemente beschrieben, der ein verbessertes Ausfüllen von Spalten in Gräben mit hohem Seitenverhältnis ermöglicht. Die Technik reduziert (und beseitigt sogar) Verengungen, Leerstellen und Diskontinuitäten, die bei anderen Abscheidungstechniken auftreten können, und ist nützlich zum Ausbilden von Gates, Kontakten, Durchkontakten und anderen Strukturen von Bauelementen. Als Kontext veranschaulichen
1 und die2A-2C planare und nicht-planare Halbleiterbauelemente, und einige ihrer Strukturelemente können durch die Prozesse der vorliegenden Offenbarung gebildet werden. Natürlich sind diese Strukturelemente lediglich beispielhaft, und die Technik kann dafür verwendet werden, jedes geeignete Strukturelement in jeder beliebigen Art von Bauelementen zu bilden. - Wenden wir uns zuerst
1 zu, die eine Querschnittsansicht eines Halbleiterbauelements100 gemäß Ausführungsformen der vorliegenden Offenbarung veranschaulicht.1 wurde im Interesse einer besseren Übersichtlichkeit und zu besseren Veranschaulichung des Konzepts der vorliegenden Offenbarung vereinfacht. Das Halbleiterbauelement100 ist für einen planaren MOSFET typisch und ist sowohl für Metalloxidhalbleiter-Transistorbauelemente vom n-Typ (als NMOS-Bauelemente bezeichnet) als auch für Metalloxidhalbleiter-Transistorbauelemente vom p-Typ (als PMOS-Bauelemente bezeichnet) beispielhaft. Das Bauelement100 wird auf einem Substrat102 gebildet, wie zum Beispiel einem Volumensiliziumsubstrat. Alternativ kann das Substrat102 einen elementaren (aus einem einzigen Element bestehenden) Halbleiter, wie zum Beispiel Silizium oder Germanium in einer kristallinen Struktur; einen Verbundhalbleiter, wie zum Beispiel Silizium-Germanium, Siliziumcarbid, Gallium-Arsen, Gallium-Phosphid, Indium-Phosphid, Indium-Arsenid und/oder Indium-Antimonid; und/oder Kombinationen davon umfassen. Zu möglichen Substraten102 gehört auch ein Silizium-auf-Isolator (SOI)-Substrat. SOI-Substrate werden mittels Trennung durch Implantierung von Sauerstoff (SIMOX), Waferbondung und/oder andere geeignete Verfahren hergestellt. In anderen Beispielen kann das Substrat102 eine mehrschichtige Halbleiterstruktur enthalten. - Das Substrat
102 kann verschiedene dotierte Regionen (zum Beispiel Mulden vom p-Typ oder Mulden vom n-Typ) enthalten, wie zum Beispiel die veranschaulichten Source/Drain-Regionen104 . Die dotierten Regionen können in Abhängigkeit von den Designanforderungen mit Dotanden vom p-Typ, wie zum Beispiel Phosphor oder Arsen, und/oder mit Dotanden vom n-Typ, wie zum Beispiel Bor oder BF2, dotiert sein. Die dotierten Regionen können direkt auf dem Substrat, in einer P-Muldenstruktur, in einer N-Muldenstruktur, in einer Doppelmuldenstruktur oder mittels einer erhabenen Struktur gebildet werden. Dotierte Regionen können durch Implantierung von Dotandenatomen, in-situdotiertes epitaxiales Wachstum und/oder andere geeignete Techniken gebildet werden. In einigen Ausführungsformen enthalten die dotierten Regionen Halo- oder Taschenregionen, die Kurzkanaleffekte (zum Beispiel Durchstoßeffekte) reduzieren können, und können durch Neigungswinkel-Ionenimplantierung oder eine andere geeignete Technik gebildet werden. - Das Halbleiterbauelement
100 kann eine Gate-Struktur106 enthalten, die auf dem Substrat zwischen den Source/Drain-Regionen104 angeordnet ist. Der Fluss von Trägern (Elektronen für ein n-Kanal-Bauelement und Löcher für ein p-Kanal-Bauelement) durch eine Kanalregion zwischen den Source/Drain-Regionen104 wird durch eine Spannung gesteuert, die an die Gate-Struktur106 angelegt wird. Zu geeigneten Gate-Strukturen106 gehören sowohl Polysilizium- als auch Metall-Gates. In einer Ausführungsform, die einen Gate-first-Prozess verwendet, ist die Gate-Struktur106 ein funktionales Gate. Umgekehrt kann in einer Ausführungsform, die einen Gate-last-Prozess verwendet, die Gate-Struktur106 ein funktionales Gate oder ein Opfer- oder Dummy-Gate sein. In dem beispielhaften Gate-last-Prozess wird ein Abschnitt einer Opfer-Gate-Struktur entfernt und durch ein funktionales Gate-Material, wie zum Beispiel ein Metall, ersetzt, um eine funktionale Gate-Struktur106 zu bilden. Die Gate-Struktur106 kann mehrere Schichten enthalten, und in der veranschaulichten Ausführungsform enthält die Gate-Struktur106 eine Grenzschicht (Interfacial Layer, IL)108 , eine Dielektrikumschicht110 , eine Deckschicht112 und eine Gate-Elektrode114 . In einigen Ausführungsformen werden Seitenwand-Abstandshalter116 an einer oder mehreren Seitenflächen der Gate-Struktur gebildet. - Um diese Merkmale ausführlicher zu beschreiben, ist die Grenzschicht
108 auf dem Substrat102 angeordnet und kann ein Grenzflächenmaterial wie zum Beispiel ein Siliziumoxid, ein Siliziumnitrid, ein Siliziumoxynitrid, andere Halbleiteroxide, andere geeignete Grenzflächematerialien und/oder Kombinationen davon enthalten. Die Grenzschicht108 kann unter Verwendung eines beliebigen geeigneten Prozesses, wie zum Beispiel thermisches Wachstum, Atomschichtabscheidung (ALD), chemisches Aufdampfen (CVD), CVD mit hoch-dichtem Plasma (HDP-CVD), physikalisches Aufdampfen (PVD), Aufschleudern und/oder andere geeignete Abscheidungsprozesse, auf jede geeignete Dicke ausgebildet werden. - Die Gate-Dielektrikumschicht
110 ist auf der Grenzschicht108 angeordnet und kann ein oder mehrere dielektrische Materialien umfassen, die gemeinhin durch ihre Dielektrizitätskonstante relativ zu Siliziumdioxid gekennzeichnet sind. Das heißt, die Gate-Dielektrikumschicht110 kann ein dielektrisches Material mit hohem K-Wert, wie zum Beispiel HfO2, HfSiO, HfSiON, HfTaO, HfTiO, HfZrO, Zirkonoxid, Aluminiumoxid, Hafniumdioxid-Aluminiumoxid (HfO2-Al2O3)-Legierung, andere geeignete dielektrische Materialien mit hohem K-Wert und/oder Kombinationen davon enthalten. Außerdem oder alternativ kann die Gate-Dielektrikumschicht110 andere Dielektrika, wie zum Beispiel Siliziumoxid, Siliziumnitrid, Siliziumoxynitrid, Siliziumcarbid, amorpher Kohlenstoff, Tetraethylorthosilikat (TEOS), anderes geeignetes dielektrisches Material und/oder Kombinationen davon enthalten. Die Gate-Dielektrikumschicht110 kann unter Verwendung eines beliebigen geeigneten Prozesses, wie zum Beispiel ALD, CVD, HDP-CVD, PVD, Aufschleudern und/oder andere geeignete Abscheidungsprozesse, auf jede geeignete Dicke ausgebildet werden. - Die beispielhafte Gate-Struktur
106 kann eine Deckschicht112 enthalten, die auf der Gate-Dielektrikumschicht110 angeordnet ist. Die Deckschicht112 kann Siliziumoxid, Siliziumnitrid, Siliziumoxynitrid, andere Halbleiteroxide, andere Halbleiternitride, andere geeignete Materialien und/oder Kombinationen davon enthalten. - Eine Gate-Elektrode
114 ist über der Gate-Dielektrikumschicht110 und der Deckschicht112 , sofern vorhanden, angeordnet. Ungeachtet der Benennungskonventionen, wie zum Beispiel MOSFET, enthält das Halbleiterbauelement100 auch Ausführungsformen mit Polysilizium-haltigen Gate-Elektroden114 sowie metallhaltigen Elektroden114 . Die Gate-Elektrode114 kann eine mehrschichtige Struktur aufweisen, die eines oder mehrere von Folgendem enthält: eine Adhäsionsschicht, eine Benetzungsschicht, eine Auskleidungsschicht, und eine metallische Füllschicht. Dementsprechend kann die Gate-Elektrode114 jedes geeignete Material enthalten, wie zum Beispiel Polysilizium, Aluminium, Kupfer, Titan, Tantal, Wolfram, Molybdän, Tantalnitrid, Nickelsilicid, Cobaltsilicid, TiN, WN, TiAl, TiAlN, TaCN, TaC, TaSiN, Metalllegierungen, andere geeignete Materialien und/oder Kombinationen davon. - In einigen Ausführungsformen, die einen Gate-last-Prozess verwenden, enthält die Gate-Elektrode
114 einen Opfer- oder Dummy-Abschnitt, der Polysilizium, ein Dielektrikum, ein Maskierungsmaterial und/oder andere geeignete Materialien enthält. In solchen Ausführungsformen kann der Opferabschnitt ganz oder teilweise durch einen geeigneten Nass- und/oder Trockenätzprozess entfernt und durch eine andere Gate-Elektrode, wie zum Beispiel eine metallhaltige Gate-Elektrode114 , ersetzt werden. Wie unten ausführlicher beschrieben, eignet sich die Abscheidungstechnik der vorliegenden Offenbarung zur Verwendung beim Ausbilden eines metallischen Gates in einer Ausnehmung, die durch das Entfernen eines Opfer-Gate-Abschnitts entstanden ist, selbst wenn das hohe Seitenverhältnis (Verhältnis von Tiefe zu Breite) der Ausnehmung Schwierigkeiten für herkömmliche Abscheidungsprozesse mit sich bringen kann. - In einigen Ausführungsformen werden Gate-Abstandshalter
116 oder Seitenwand-Abstandshalter auf jeder Seite der Gate-Struktur106 (an den Seitenwänden der Gate-Struktur106 ) gebildet. Die Gate-Abstandshalter116 können dafür verwendet werden, die Source/Drain-Regionen104 auszurichten, und können eine steife Oberfläche bereitstellen, um ein Zusammenbrechen der Gräben während eines Gate-Ersetzungsprozesses zu verhindern. Die Gate-Abstandshalter116 können jedes geeignete dielektrische Material, wie zum Beispiel ein Halbleiteroxid, ein Halbleiternitrid, ein Halbleitercarbid, ein Halbleiteroxynitrid, andere geeignete Materialien und/oder Kombinationen davon enthalten. - Um das Halbleiterbauelement
100 in einen Schaltkreis zu integrieren, kann eine Interconnect-Struktur auf dem Bauelement100 gebildet werden. In der veranschaulichten Ausführungsform enthält die Interconnect-Struktur eine Anzahl von Leiterbahnen118 , die zwischen Schichten eines Zwischenebenen-Dielektrikums (Inter-level Dielectric, ILD)120 eingefügt sind. Das ILD120 kann jedes geeignete dielektrische Material umfassen, wie zum Beispiel ein Halbleiteroxid, ein Halbleiternitrid, ein Halbleiteroxynitrid, ein Halbleitercarbid, TEOS-Oxid, Phosphosilikatglas (PSG), Borphosphosilikatglas (BPSG), fluoriertes Siliciumdioxidglas (FSG), kohlenstoffdotiertes Siliziumoxid, Black Diamond®, Xerogel, Aerogel, amorpher fluorierter Kohlenstoff, Parylen, BCB (bis-Benzocyclobuten), SiLK (Dow Chemical, Midland, Michigan), Polyimid, andere geeignete Materialien und/oder Kombinationen davon. Die ILD120 -Schichten fungieren als ein Isolator, der die Leiterbahnen118 stützt und isoliert. Durchkontakte122 erstrecken sich durch die ILD 120-Schichten, um Leiterbahnen118 an verschiedenen horizontalen Positionen zu verbinden, und Kontakte124 erstrecken sich durch die ILD 120-Schichten, um mit Source/Drain-Regionen104 , Gate-Strukturen106 und anderen Strukturelementen am oder nahe dem Substrat102 verbunden zu werden. Wie gezeigt werden wird, eignet sich die Technik der vorliegenden Offenbarung zum Ausbilden von Kontakten124 und Durchkontakten122 . Natürlich sind die Kontakte124 , Durchkontakte122 und die oben angesprochene Gate-Elektrode114 lediglich einige Beispiele von Strukturelementen von Bauelementen, die durch diese Technik gebildet werden können. - Während
1 beispielhafte Strukturelemente planarer Bauelemente hervorhebt, die durch die hier besprochene Technik gebildet werden können, veranschaulichen2A-2C beispielhafte Strukturelemente eines nicht-planaren Bauelements, die durch die hier besprochene Technik gebildet werden können.2A ist eine perspektivische Ansicht eines nicht-planaren Halbleiterbauelements200 gemäß Ausführungsformen der vorliegenden Offenbarung.2B ist eine Querschnittsansicht eines Abschnitts des Halbleiterbauelements200 , wobei der Querschnitt durch eine Kanalregion (entlang Ebene202 ) verläuft, gemäß Ausführungsformen der vorliegenden Offenbarung.2C ist eine Querschnittansicht eines Abschnitts des Halbleiterbauelements200 , wobei der Querschnitt durch eine Source/Drain-Region (entlang Ebene204 ) vorgenommen wurde, gemäß Ausführungsformen der vorliegenden Offenbarung. Die2A-2C wurden im Interesse einer besseren Übersichtlichkeit und zur besseren Veranschaulichung des Konzepts der vorliegenden Offenbarung vereinfacht. - Wir wenden uns den
2A-2C zu. Das Halbleiterbauelement200 enthält ein Substrat102 oder einen Wafer mit einer oder mehreren darauf ausgebildeten Rippenstrukturen206 . Die Rippenstrukturen206 sind repräsentativ für alle erhabenen Strukturelemente, und obgleich die veranschaulichten Ausführungsformen FinFET-Rippenstrukturen206 enthalten, enthalten weitere Ausführungsformen andere erhabene aktive und passive Bauelemente, die auf dem Substrat102 ausgebildet sind. Die veranschaulichten Rippenstrukturen206 umfassen jeweils ein Paar gegenüberliegender Source/Drain-Regionen208 , die verschiedene dotierte Halbleitermaterialien enthalten können, und eine Kanalregion210 , die zwischen den Source/Drain-Regionen208 angeordnet ist. Der Fluss von Trägern durch die Kanalregion210 wird durch eine Spannung gesteuert, die an eine Gate-Struktur212 angelegt wird, die sich neben der Kanalregion210 befindet und um diese herum gelegt ist. Eine der Gate-Strukturen212 ist durchscheinend gezeigt, um die darunterliegende Kanalregion210 besser zu veranschaulichen. In der veranschaulichten Ausführungsform erhebt sich die Kanalregion210 über die Ebene des Substrats102 , auf dem sie ausgebildet ist, und dementsprechend kann die Rippenstruktur206 als ein „nicht-planares“ Bauelement bezeichnet werden. Die erhabene Kanalregion210 stellt eine größere Oberfläche nahe der Gate-Struktur212 bereit als in vergleichbaren planaren Bauelemente. Dies verstärkt die Wechselwirkungen elektromagnetischer Felder zwischen der Gate-Struktur212 und der Kanalregion210 , wodurch Kriechströme und Kurzkanaleffekte, die bei kleineren Bauelementen entstehen, reduziert werden können. Auf diese Weise erbringen in vielen Ausführungsformen FinFETs und andere nicht-planare Bauelemente eine bessere Leistung auf einer kleineren Grundfläche als ihre planaren Gegenstücke. - Die Elemente des Halbleiterbauelements
200 werden nun noch etwas ausführlicher beschrieben. Das Substrat102 kann im Wesentlichen dem Substrat102 von1 ähneln und kann jedes geeignete Halbleiter- und/oder Nicht-Halbleitermaterial enthalten. Zum Beispiel kann das Substrat102 eine oder mehrere Schichten eines elementaren Halbleiters, wie zum Beispiel Silizium oder Germanium; einen Verbundhalbleiter, wie zum Beispiel Silizium-Germanium, Siliziumcarbid, Gallium-Arsen, Gallium-Phosphid, Indium-Phosphid, Indium-Arsenid und/oder Indium-Antimonid; ein Nicht-Halbleitermaterial, wie zum Beispiel Kalknatronglas, Kieselglas, Quarzglas, Kalziumfluorid (CaF2); andere geeignete Materialien; und/oder Kombinationen davon enthalten. - Die Rippenstrukturen
206 werden auf dem Substrat102 gebildet, indem umgebende Abschnitte des Substrats102 ausgespart werden und die Rippenstrukturen206 übrig bleiben, und/oder indem Material abgeschieden wird, um die Rippenstrukturen206 auf dem Substrat102 aufwachsen zu lassen. Nachdem eine Gate-Struktur212 gebildet wurde, um die Kanalregionen210 der Rippenstrukturen zu schützen, kann zusätzliches Halbleitermaterial zu den Source/Drain-Regionen208 der Rippenstruktur206 hinzugefügt werden. In vielen Ausführungsformen wird das zusätzliche Material durch einen oder mehrere Epitaxie- oder Epitaxial (epi)-Prozesse abgeschieden, wodurch Si-Strukturelemente, SiGe-Strukturelemente und/oder andere geeignete Strukturelemente in einem kristallinen Zustand auf der Rippenstruktur206 gezüchtet werden. Zu geeigneten Epitaxie-Prozessen gehören CVD-Abscheidungstechniken (zum Beispiel Dampfphasenepitaxie (VPE) und/oder Ultrahochvakuum-CVD (UHV-CVD)), Molekularstrahlepitaxie und/oder andere geeignete Prozesse. Das Material der Source/Drain-Regionen208 kann während des Epitaxie-Prozesses in-situ dotiert werden, indem Dotierungsspezies eingearbeitet werden, die Dotanden vom p-Typ, wie zum Beispiel Bor oder BF2; Dotanden vom n-Typ, wie zum Beispiel Phosphor oder Arsen; und/oder andere geeignete Dotanden, einschließlich Kombinationen davon, enthalten. Wenn die Source/Drain-Regionen208 nicht in-situ dotiert werden, so wird ein Implantierungsprozess (d. h. ein Grenzschicht-Implantierungsprozess) ausgeführt, um die Regionen208 zu dotieren. - Die Gate-Struktur
212 wird auf einer oder mehreren der Rippenstrukturen206 gebildet und kann eine Grenzschicht214 , eine Gate-Dielektrikumschicht216 , eine Deckschicht218 und eine Gate-Elektrode220 enthalten, die auf der Kanalregion210 der Rippenstrukturen206 angeordnet und um diese herum gelegt ist. Jedes dieser Elemente kann in seiner Zusammensetzung im Wesentlichen seinen planaren Bauelement-Gegenstücken ähneln. Zum Beispiel kann die Grenzschicht214 ein Oxid, HfSiO, ein Nitrid, ein Oxynitrid und/oder ein anderes geeignetes Material enthalten und kann durch ein beliebiges geeignetes Verfahren abgeschieden werden, wie zum Beispiel thermische Oxidation, ALD, CVD, Ozonoxidation usw. Die Gate-Dielektrikumschicht216 kann jedes geeignete Dielektrikum enthalten, wie zum Beispiel ein dielektrisches Material mit hohem K-Wert, einschließlich: LaO, AlO, ZrO, TiO, Ta2O5, Y2O3, SrTiO3 (STO), BaTiO3 (BTO), BaZrO, HfZrO, HfLaO, HfSiO, LaSiO, AlSiO, HfTaO, HfTiO, (Ba,Sr)TiO3 (BST), Al2O3, Si3N4, Oxynitride (SiON) und/oder andere geeignete Materialien. Die Deckschicht218 kann Siliziumoxid, Siliziumnitrid, Siliziumoxynitrid, andere Halbleiteroxide, andere Halbleiternitride, andere geeignete Materialien und/oder Kombinationen davon umfassen. - Die Gate-Elektrode
220 ist auf der Gate-Dielektrikumschicht216 und auf der Deckschicht218 , sofern vorhanden, angeordnet und enthält in verschiedenen Beispielen Polysilizium, Metalle, Metalllegierungen, Metallverbindungen und/oder nicht-metallische Leiter. Zu geeigneten Metallen gehören W, Al, Cu, Ti, Ag, TiAlN, TaC, TaCN, TaSiN, Mn, Zr, TiN, TaN, Ru, Mo, WN und/oder sonstige andere geeignete Materialien. In einigen Ausführungsformen werden verschiedene Gate-Materialien für nMOS- und pMOS-Bauelemente verwendet. Die Gate-Elektrode220 kann eine mehrschichtige Struktur haben, die eines oder mehrere von Folgendem enthält: eine Adhäsionsschicht, eine Benetzungsschicht, eine Auskleidungsschicht und eine metallische Füllschicht. Wie bei dem planaren Bauelement kann die Technik der vorliegenden Offenbarung dafür verwendet werden, die Gate-Elektrode220 als Teil eines Gate-Ersetzungsprozesses oder einer anderen Gate-Bildungstechnik zu bilden. - Die Gate-Struktur
212 kann ebenfalls eine oder mehrere Seitenwandbeabstandungsschichten222 enthalten, von denen zwei gezeigt sind. Zu geeigneten Materialien für die Seitenwandbeabstandungsschichten222 gehören Dielektrika, wie zum Beispiel Halbleiteroxide, Halbleiternitride, Halbleiteroxynitride, Halbleitercarbide und/oder andere Dielektrika. In einigen Beispielen enthalten die Seitenwandbeabstandungsschichten222 abwechselnde Schichten verschiedener Dielektrika, wie zum Beispiel eine erste Halbleiteroxid-Beabstandungsschicht und eine zweite Halbleiternitrid-Beabstandungsschicht. Es kann eine beliebige aus einer Anzahl von Techniken verwendet werden, um die Seitenwandbeabstandungsschichten222 zu bilden, wie zum Beispiel CVD, PVD, ALD und/oder andere geeignete Abscheidungstechniken. - Ähnlich dem beispielhaften planaren Bauelement wird eine Interconnect-Struktur auf dem Substrat
102 und auf der Gate-Struktur212 angeordnet, die eine Anzahl von Leiterbahnen118 enthält, die zwischen Schichten eines Zwischenebenen-Dielektrikums (ILD)120 angeordnet sind. Der besseren Übersichtlichkeit wegen ist die Interconnect-Struktur nicht in2A veranschaulicht, damit andere Strukturelemente nicht in den Hintergrund treten. Wie in dem planaren Beispiel von1 eignet sich die Technik der vorliegenden Offenbarung zum Herstellen von Kontakten124 und Durchkontakten122 innerhalb der Interconnect-Struktur des nicht-planaren Bauelements200 . - Eine Anwendung, die sich der hier besprochenen Technik bedient, um eine Gate-Elektrode zu bilden, wird mit Bezug auf die
3-11 beschrieben.3 ist ein Flussdiagramm des Verfahrens300 zum Bilden einer Gate-Elektrode gemäß Ausführungsformen der vorliegenden Offenbarung. Es versteht sich, dass zusätzliche Schritte vor, während und nach dem Verfahren300 bereitgestellt werden können und dass einige der beschriebenen Schritte in anderen Ausführungsformen des Verfahrens300 ersetzt oder weggelassen werden können. Die4-11 sind Querschnittsansichten eines Abschnitts eines nicht-planaren Bauelements200 , das dem Verfahren300 zum Bilden der Gate-Elektrode unterzogen wird, gemäß Ausführungsformen der vorliegenden Offenbarung. Beispiele, die das Verfahren300 auf ein planares Bauelement anwenden, werden mit Bezug auf spätere Figuren beschrieben. - Wir wenden uns Block
302 von3 sowie4 zu, wo ein Substrat102 empfangen wird, das ein Halbleiterbauelement200 enthält. Das Substrat102 und das Halbleiterbauelement200 können jeweils im Wesentlichen denen der2A-2C ähneln, und im Interesse der Kürze werden ähnliche Elemente davon nicht erneut beschrieben. In der Ausführungsform von4 enthält das Halbleiterbauelement200 einen Abschnitt einer Gate-Struktur212 im Wesentlichen ähnlich der von2A . Die Gate-Struktur enthält eine Opfer-Gate-Elektrode402 , die Polysilizium, ein Dielektrikum, ein Maskierungsmaterial und/oder ein anderes geeignetes Material enthalten kann. Wir wenden uns Block304 von3 sowie5 zu, wo die Opfer-Gate-Elektrode402 entfernt wird, wodurch ein Graben404 zurückbleibt, der durch die Seitenwandbeabstandungsschichten222 definiert wird. Teilweise aufgrund der Geometrie des Grabens404 kann sich das Ausbilden von Schichten innerhalb des Grabens404 als eine Herausforderung erweisen. Zum Beispiel kann der Graben404 ein hohes Seitenverhältnis und/oder schmale innere Hohlräume haben, wo die Abscheidungsreaktionsteilnehmer nicht gut zirkulieren. - Eine Gate-Dielektrikumschicht
216 der Gate-Struktur212 kann entweder vor oder nach dem Entfernen der Opfer-Gate-Elektrode402 gebildet werden. In dem Beispiel von Block306 von3 und6 wird die Gate-Dielektrikumschicht216 innerhalb des Grabens404 gebildet, nachdem die Opfer-Gate-Elektrode402 entfernt wurde. In der veranschaulichten Ausführungsform wird die Gate-Dielektrikumschicht216 auf der Grenzschicht214 in dem Graben404 gebildet und erstreckt sich außerdem entlang der vertikalen Oberflächen der Seitenwandbeabstandungsschichten222 dergestalt, dass sich die Abschnitte der Gate-Dielektrikumschicht216 auf den vertikalen Oberflächen über den Abschnitten der Gate-Dielektrikumschicht216 auf der Grenzschicht214 erstrecken. Dadurch entsteht eine U-förmige Struktur. In einigen Ausführungsformen wird eine hochkonforme Abscheidungstechnik, wie zum Beispiel CVD oder ALD, verwendet, um die Gate-Dielektrikumschicht216 in der U-förmigen Konfiguration abzuscheiden, obgleich auch nicht-konforme Abscheidungstechniken verwendet werden können. In diesen und anderen Ausführungsformen gehören zu geeigneten Abscheidungsprozessen CVD, CVD mit hoch-dichtem Plasma (HDP-CVD), ALD, PVD, Aufschleudern und/oder andere geeignete Abscheidungsprozesse. Die Gate-Dielektrikumschicht216 kann eine ähnliche Zusammensetzung haben wie die in den1-2C . - Eine Austrittsarbeitsschicht
406 der Gate-Struktur212 kann ebenfalls entweder vor oder nach dem Entfernen der Opfer-Gate-Elektrode402 ausgebildet werden. In dem Beispiel von Block308 von3 und6 wird die Austrittsarbeitsschicht406 auf der Gate-Dielektrikumschicht216 innerhalb des Grabens404 ausgebildet, nachdem die Opfer-Gate-Elektrode402 entfernt wurde. Die Austrittsarbeitsschicht406 kann dafür verwendet werden, die Schwellenspannung des resultierenden Halbleiterbauelement abzustimmen, und kann zu diesem Zweck ein Material enthalten, das für die Art des herzustellenden Bauelements200 spezifisch ist (zum Beispiel Austrittsarbeitsmaterial vom n-Typ für ein Bauelement vom n-Typ, Austrittsarbeitsmaterial vom p-Typ für ein Bauelement vom p-Typ). Zu beispielhaften Austrittsarbeitsmetallen vom p-Typ gehören TiN, TaN, Ru, Mo, Al, WN, ZrSi2, MoSi2, TaSi2, NiSi2, WN, andere geeignete Austrittsarbeitsmaterialien vom p-Typ und/oder Kombinationen davon. Zu beispielhaften Austrittsarbeitsmetallen vom n-Typ gehören Ti, Ag, TaAl, TaAlC, TiAlN, TaC, TaCN, TaSiN, Mn, Zr, andere geeignete Austrittsarbeitsmaterialien vom n-Typ und/oder Kombinationen davon. Die Austrittsarbeitsschicht406 kann mehrere Schichten enthalten und kann durch CVD, PVD und/oder andere geeignete Prozesse auf jede geeignete Dicke abgeschieden werden. In der veranschaulichten Ausführungsform erstreckt sich die Austrittsarbeitsschicht406 entlang der vertikalen Oberflächen der Gate-Dielektrikumschicht216 , um eine U-förmige Struktur zu bilden. - Wir wenden uns Block
310 von3 sowie7 zu. Eine Benetzungsschicht408 kann auf der Gate-Dielektrikumschicht216 und/oder der Austrittsarbeitsschicht406 abgeschieden werden. Die Benetzungsschicht408 verstärkt die Bondung zwischen den Schichten und kann eine gleichmäßige Abscheidung der anschließenden Schichten unterstützen. In verschiedenen Beispielen enthält die Benetzungsschicht408 Ti, Ta, Ni, Co, andere Metalle und/oder Kombinationen davon. Die Benetzungsschicht408 kann innerhalb des Grabens404 unter Verwendung jeder geeigneten Abscheidungstechnik ausgebildet werden, wie zum Beispiel ALD, CVD und/oder Sputtern, und kann auf jede geeignete Dicke ausgebildet werden. - Wir wenden uns Block
310 von3 sowie8 zu. Eine Sperrschicht410 kann auf der Benetzungsschicht408 abgeschieden werden. Die Sperrschicht410 kann strukturiert werden, um zu verhindern, dass anschließende Abscheidungsprozesse andere Schichten des Bauelements200 degradieren. Zum Beispiel neigen einige Metalle dazu, während der Abscheidung und selbst nach vollendeter Fertigung in Silizium-haltige Schichten hinein zu diffundieren. Dementsprechend kann die Sperrschicht410 TiN, TaN und/oder andere geeignete Metalle, Metalloxide und/oder Metallnitride enthalten. Ähnlich der Benetzungsschicht408 kann die Sperrschicht410 innerhalb des Grabens404 unter Verwendung jedes geeigneten Prozesses abgeschieden werden, wie zum Beispiel ALD, CVD und/oder Sputtern, und kann auf jede geeignete Dicke abgeschieden werden. In einigen Ausführungsformen scheidet ein einziger Abscheidungsschritt ein Metall ab, das sowohl der Benetzungsschicht408 als auch der Sperrschicht410 gemein ist. Das Metall der Sperrschicht410 kann dann einer Oxidation, Nitridierung oder sonstigen Prozessen unterzogen werden, um ein Oxid, Nitrid und/oder eine sonstige Metallverbindung in der Sperrschicht410 zu bilden. - Obgleich ein Füllmaterial direkt auf der Sperrschicht
410 abgeschieden werden kann, ist festgestellt worden, dass, wenn das Seitenverhältnis des Grabens404 größer wird, selbst konforme Abscheidungsprozesse dazu neigen, Material nahe dem oberen Ende des Grabens404 schneller abzuscheiden. Das kann dazu führen, dass sich der oberste Abschnitt des Grabens404 schließt, während immer noch Leerstellen im unteren Abschnitt des Grabens404 vorhanden sind. Diese Tendenz zum Entstehen von Leerstellen wird besonders akut, wenn die Graben-Seitenverhältnisse sich 10:1 (Tiefe:Breite) nähern oder überschreiten, obgleich dies auch bei viel kleineren Seitenverhältnissen zu beobachten ist. Dementsprechend wird in einigen Ausführungsformen eine Wachstumssteuerungsschicht412 auf den gegenüberliegender Grabenseitenflächen414 ausgebildet, aber nicht unbedingt auf dem Grabenboden416 . Dies ist in Block314 von3 und in den9A und9B gezeigt. Die Wachstumssteuerungsschicht412 beeinflusst die Abscheidungsrate der Technik, die zum anschließenden Abscheiden des Füllmaterials verwendet wird. In einer beispielhaften Ausführungsform reduziert die Wachstumssteuerungsschicht412 die Abscheidungsrate auf den Grabenseitenflächen414 relativ zur Rate auf dem Grabenboden416 dergestalt, dass eine ansonsten konforme Abscheidungstechnik den Boden des Grabens404 schneller füllt als den oberen Abschnitt. Oder anders ausgedrückt: Die Wachstumssteuerungsschicht412 bewirkt, dass ein ALD-, CVD-, Sputter- und/oder ein sonstiger konformer Abscheidungsprozess den Graben404 vom Boden aus aufwärts füllt. - Die Wachstumssteuerungsschicht
412 kann jedes geeignete Metall, Metalloxid, Metallcarbid, Metallnitrid und/oder Kombinationen davon enthalten und kann sich in der Zusammensetzung beispielsweise von der Sperrschicht410 unterscheiden. In verschiedenen Ausführungsformen enthält die Wachstumssteuerungsschicht412 WC, WN, A1C, A1N und/oder andere geeignete Materialien. In einigen Ausführungsformen werden ein oder mehrere Metallbestandteile der Wachstumssteuerungsschicht412 so ausgewählt, dass sie mit den Metallkomponenten des anschließend abgeschiedenen Füllmaterials418 übereinstimmen. In einigen solchen Ausführungsformen wird WC oder WN für die Wachstumssteuerungsschicht412 auf der Basis eines W-haltigen Füllmaterials418 ausgewählt. In weiteren solchen Ausführungsformen wird AlC oder AlN für die Wachstumssteuerungsschicht412 auf der Grundlage eines Al-haltigen Füllmaterials418 ausgewählt. - Die Wachstumssteuerungsschicht
412 kann auf jede beliebige Dicke (senkrecht zu den Seitenflächen414 gemessen) abgeschieden werden, obgleich für Materialien mit geringerer Leitfähigkeit die Wachstumssteuerungsschicht412 recht dünn sein kann (zum Beispiel zwischen etwa 0,1 nm (1 Å) und maximal etwa 2nm (20 Ä)). Die Wachstumssteuerungsschicht412 erstreckt sich mindestens entlang der oberen Abschnitte der Seitenflächen414 und kann sich den gesamten Weg bis zur Bodenfläche416 erstrecken, wie in9B gezeigt. Aufgrund der Wachstumssteuerungsschicht412 hat die Bodenfläche416 des Grabens404 eine andere Zusammensetzung als die Grabenseitenwände, die durch die Wachstumssteuerungsschicht412 definiert werden. Dieser Unterschied kann dafür verwendet werden, anschließende Abscheidungsprozesse abzustimmen. - Jede geeignete konforme oder nicht-konforme Abscheidung kann dafür verwendet werden, die Wachstumssteuerungsschicht
412 zu bilden. In verschiedenen Ausführungsformen werden ALD, CVD, Sputtern und/oder andere geeignete Techniken verwendet, um die Wachstumssteuerungsschicht412 auf den Seitenflächen414 zu bilden. In einer solchen Ausführungsform wird eine metallische Komponente der Wachstumssteuerungsschicht412 mittels ALD abgeschieden, und eine anschließende Plasmabehandlung wird mittels eines Stickstoff-haltigen und/oder Kohlenstoff-haltigen Gases ausgeführt, um ein Metallnitrid und/oder Metallcarbid zu bilden. Auch wenn einige dieser Abscheidungstechniken in den meisten Anwendungen konform sind, kann in solchen Ausführungsformen die Geometrie des Grabens404 verhindern, dass die Reaktionsteilnehmer den Boden des Grabens404 erreichen. Das heißt, diese Techniken können Material auf den Seitenflächen414 schneller abscheiden als auf der Bodenfläche416 , wodurch die Schwierigkeit des Ausfüllens des Grabenbodens416 zu einem Vorteil wird. Auf die Abscheidung kann ein anisotroper Ätzprozess folgen, um alles abgeschiedene Material von der Bodenfläche416 des Grabens404 zu entfernen. Zum Beispiel wird in einer Ausführungsform die Wachstumssteuerungsschicht412 durch Sputtern abgeschieden, gefolgt von einem anisotropen Trockenätzen, das auf abgeschiedenes Material auf der Bodenfläche416 zielt. - Wir wenden uns Block
316 von3 sowie den10 und11 zu. Ein Füllmaterial418 der Gate-Elektrode220 kann innerhalb des Grabens404 auf der Wachstumssteuerungsschicht412 abgeschieden werden.10 entspricht den Ausführungsformen von9A , wo sich die Wachstumssteuerungsschicht412 nicht bis zur Bodenfläche416 erstreckt, während11 den Ausführungsformen von9B entspricht, wo sich die Wachstumssteuerungsschicht412 bis zur Bodenfläche416 erstreckt. Das Füllmaterial418 kann jeden geeigneten Leiter enthalten, wie zum Beispiel W, Al, Cu, Ti, Ag, Ru, Mo, andere geeignete Metalle und Legierungen davon. Das Füllmaterial418 kann unter Verwendung jeder geeigneten Technik ausgebildet werden, wie zum Beispiel ALD, CVD und/oder Sputtern. Teilweise aufgrund der Wachstumssteuerungsschicht412 kann das Füllmaterial418 auf der Bodenfläche416 des Grabens404 schneller abgeschieden werden, als es auf den Seitenflächen414 abgeschieden wird. In einer konkreten Anwendung reduziert eine Metallcarbid-Wachstumssteuerungsschicht412 die Abscheidungsrate auf den Seitenflächen414 um einen Faktor von 10. Anhand von Experimenten und Analysen wurde festgestellt, dass das Ausfüllen von Gräben mit hohem Seitenverhältnis404 in dieser Weise deutlich das Auftreten von Leerstellen und anderen Defekten in dem Füllmaterial418 reduziert. - Wir wenden uns Block
318 von3 zu. Eine Planarisierungstechnik wie zum Beispiel chemisch-mechanisches Planarisieren oder Polieren (CMP) kann auf dem Halbleiterbauelement200 ausgeführt werden, um überschüssiges Material zu entfernen, das sich über den Graben404 hinaus erstreckt. Wie in Block320 von3 zu sehen, kann das Bauelement200 einer Weiterverarbeitung zugeführt werden. - Das Verfahren
300 kann ebenfalls verwendet werden, um eine Gate-Elektrode in einem planaren Bauelement zu bilden, wie mit Bezug auf die3 und die12-19 beschrieben ist. Die12-19 sind Querschnittsansichten eines Abschnitts eines planaren Bauelements100 , das dem Verfahren300 des Bildens einer Gate-Elektrode unterzogen wird, gemäß Ausführungsformen der vorliegenden Offenbarung. - Wir wenden uns Block
302 von3 sowie12 zu, wo ein Substrat102 empfangen wird, das ein Halbleiterbauelement100 enthält. Das Substrat102 und das Halbleiterbauelement100 können jeweils im Wesentlichen jenen von1 ähneln, und im Interesse der Kürze werden ähnliche Elemente davon nicht erneut beschrieben. In der Ausführungsform von12 enthält das Halbleiterbauelement100 einen Abschnitt einer Gate-Struktur116 im Wesentlichen ähnlich der von1 , die eine Opfer-Gate-Elektrode402 enthält. Die Opfer-Gate-Elektrode402 kann Polysilizium, ein Dielektrikum, ein Maskierungsmaterial und/oder andere geeignete Materialien enthalten. Wir wenden uns Block304 von3 sowie13 zu. Die Opfer-Gate-Elektrode402 wird entfernt, und ein Graben404 bleibt zurück, der durch die Seitenwand-Abstandshalter116 definiert wird. Teilweise aufgrund der Geometrie des Grabens404 kann das Ausbilden von Schichten darin zu einer Herausforderung werden. Zum Beispiel kann der Graben404 ein hohes Seitenverhältnis und/oder schmale innere Hohlräume haben, wo die Abscheidungsreaktionsteilnehmer nicht gut zirkulieren. - Eine Gate-Dielektrikumschicht
110 kann entweder vor oder nach dem Entfernen der Opfer-Gate-Elektrode402 ausgebildet werden. Dementsprechend wird in Block306 von3 und14 die Gate-Dielektrikumschicht110 innerhalb des Grabens404 ausgebildet, nachdem die Opfer-Gate-Elektrode402 entfernt wurde. In der veranschaulichten Ausführungsform wird die Gate-Dielektrikumschicht110 auf der Grenzschicht108 in dem Graben404 ausgebildet und erstreckt sich auch entlang der vertikalen Oberflächen der Seitenwand-Abstandshalter116 , um eine U-förmige Schicht zu bilden. Zu geeigneten Abscheidungsprozessen gehören CVD, CVD mit hoch-dichtem Plasma (HDPCVD), ALD, PVD, Aufschleudern und/oder andere geeignete Abscheidungsprozesse, und die Gate-Dielektrikumschicht110 kann in ihrer Zusammensetzung jenen der1-2C ähneln. - Eine Austrittsarbeitsschicht
406 kann ebenfalls entweder vor oder nach dem Entfernen der Opfer-Gate-Elektrode402 ausgebildet werden. In dem Beispiel von Block308 von3 und14 wird die Austrittsarbeitsschicht406 auf der Gate-Dielektrikumschicht110 innerhalb des Grabens404 ausgebildet, nachdem die Opfer-Gate-Elektrode402 entfernt wurde. Die Austrittsarbeitsschicht406 kann ein Material enthalten, das auf die jeweilige Art des ausgebildeten Bauelements100 abgestimmt ist, und kann in ihrer Zusammensetzung der Austrittsarbeitsschicht406 von4 ähneln. In der veranschaulichten Ausführungsform erstreckt sich die Austrittsarbeitsschicht406 entlang der vertikalen Oberflächen der Gate-Dielektrikumschicht110 , um eine U-Form zu bilden. Die Austrittsarbeitsschicht406 kann mehrere Schichten enthalten und kann durch CVD, PVD und/oder andere geeignete Prozesse auf jede geeignete Dicke abgeschieden werden. - Wir wenden uns Block
310 von3 sowie15 zu. Eine Benetzungsschicht408 kann auf der Gate-Dielektrikumschicht110 und/oder der Austrittsarbeitsschicht406 abgeschieden werden. Die Benetzungsschicht408 kann Ti, Ta, Ni, Co, andere Metalle und/oder Kombinationen davon enthalten und kann durch jede geeignete Technik ausgebildet werden, wie zum Beispiel ALD, CVD oder Sputtern. Die Benetzungsschicht408 kann innerhalb des Grabens404 unter Verwendung einer geeigneten Abscheidungstechnik ausgebildet werden, wie zum Beispiel ALD, CVD und/oder Sputtern, und kann auf jede geeignete Dicke ausgebildet werden. - Wir wenden uns Block
312 von3 sowie16 zu. Eine Sperrschicht410 kann auf der Benetzungsschicht408 abgeschieden werden. Die Sperrschicht410 kann TiN, TaN und/oder andere geeignete Metalle, Metalloxide und/oder Metallnitride enthalten und kann durch jede geeignete Technik abgeschieden werden, wie zum Beispiel ALD, CVD und/oder Sputtern. In einigen Ausführungsformen scheidet ein einziger Abscheidungsschritt ein Metall ab, das sowohl der Benetzungsschicht408 als auch der Sperrschicht410 gemein ist. Das Metall der Sperrschicht410 kann dann einer Oxidation, Nitridierung oder sonstigen Prozessen unterzogen werden, um ein Oxid, Nitrid und/oder eine sonstige Metallverbindung in der Sperrschicht410 zu bilden. - Wir wenden uns Block
314 von3 und den17A und17B . Eine Wachstumssteuerungsschicht412 wird auf den Grabensseitenflächen414 ausgebildet, aber nicht unbedingt auf dem Grabenboden416 . Die Wachstumssteuerungsschicht412 beeinflusst die Abscheidungsrate der Technik, die verwendet wird, um anschließend das Füllmaterial abzuscheiden. Dementsprechend kann die Wachstumssteuerungsschicht412 jedes geeignete Metall, Metalloxid, Metallcarbid, Metallnitrid und/oder Kombinationen davon enthalten. Zum Beispiel kann die Wachstumssteuerungsschicht412 WC, WN, AlC, AlN und/oder andere geeignete Materialien enthalten. In einigen Ausführungsformen werden ein oder mehrere Metallbestandteile der Wachstumssteuerungsschicht412 so ausgewählt, dass sie mit Metallkomponenten des anschließend abgeschiedenen Füllmaterials418 übereinstimmen. - Die Wachstumssteuerungsschicht
412 kann auf jede beliebige Dicke (senkrecht zu den Seitenflächen414 gemessen) abgeschieden werden, und für Material mit geringerer Leitfähigkeit kann die Wachstumssteuerungsschicht412 recht dünn sein (zum Beispiel zwischen etwa 0,1 nm (1 Ä) und maximal etwa 2 nm (20 Ä)). Die Wachstumssteuerungsschicht412 erstreckt sich mindestens entlang den oberen Abschnitten der Seitenflächen414 und kann sich den ganzen Weg bis zur Bodenfläche416 erstrecken, wie in17B gezeigt. Aufgrund der Wachstumssteuerungsschicht412 hat die Bodenfläche416 des Grabens404 eine andere Zusammensetzung als die Grabenseitenwände, die durch die Wachstumssteuerungsschicht412 definiert werden. Dieser Unterschied kann dafür verwendet werden, anschließende Abscheidungsprozesse abzustimmen. - Jede geeignete konforme oder nicht-konforme Abscheidung kann dafür verwendet werden, die Wachstumssteuerungsschicht
412 zu bilden. In verschiedenen Ausführungsformen werden ALD, CVD, Sputtern und/oder andere geeignete Techniken verwendet, um die Wachstumssteuerungsschicht412 auf den Seitenflächen414 zu bilden. In einer solchen Ausführungsform wird eine Metallkomponente der Wachstumssteuerungsschicht412 mittels ALD abgeschieden, und eine anschließende Plasmabehandlung wird mittels eines Stickstoff-haltigen und/oder Kohlenstoff-haltigen Gases ausgeführt, um ein Metallnitrid und/oder Metallcarbid zu bilden. In einigen Anwendungen stützen sich konforme Abscheidungstechniken auf die Geometrie des Grabens404 , um zu verhindern, dass Reaktionsteilnehmer den Boden416 des Grabens404 erreichen. Auf die Abscheidung kann ein anisotroper Ätzprozess folgen, um alles abgeschiedene Material von der Bodenfläche416 des Grabens404 zu entfernen. Zum Beispiel wird in einer Ausführungsform die Wachstumssteuerungsschicht412 durch Sputtern abgeschieden, gefolgt von einem anisotropen Trockenätzen, das auf abgeschiedenes Material auf der Bodenfläche416 zielt. - Wir wenden uns Block
316 von3 sowie den18 und19 zu. Ein Füllmaterial418 der Gate-Elektrode116 kann innerhalb des Grabens404 auf der Wachstumssteuerungsschicht412 abgeschieden werden.18 entspricht den Ausführungsformen von17A , wo sich die Wachstumssteuerungsschicht412 nicht bis zur Bodenfläche416 erstreckt, während19 den Ausführungsformen von17B entspricht, wo sich die Wachstumssteuerungsschicht412 bis zur Bodenfläche416 erstreckt. Das Füllmaterial418 kann jeden geeigneten Leiter enthalten, wie zum Beispiel W, Al, Cu, Ti, Ag, Ru, Mo, andere geeignete Metalle und Legierungen davon. Das Füllmaterial418 kann unter Verwendung jeder geeigneten Technik ausgebildet werden, wie zum Beispiel ALD, CVD und/oder Sputtern. Teilweise aufgrund der Wachstumssteuerungsschicht412 kann das Füllmaterial418 auf der Bodenfläche416 des Grabens404 schneller abgeschieden werden als auf den Seitenflächen414 . Es wurde festgestellt, dass das Ausfüllen von Gräben mit hohem Seitenverhältnis404 in dieser Weise deutlich das Auftreten von Leerstellen und anderen Defekten in dem Füllmaterial418 reduziert. - Wir wenden uns Block
318 von3 zu. Eine Planarisierungstechnik, wie zum Beispiel chemisch-mechanisches Planarisieren oder Polieren (CMP), kann auf dem Halbleiterbauelement100 ausgeführt werden, um überschüssiges Material zu entfernen, das sich über den Graben404 hinaus erstreckt. Wie in Block320 von3 zu sehen, kann das Bauelement100 zur Weiterverarbeitung bereitgestellt werden. - Wie oben beschrieben, können die Techniken der vorliegenden Offenbarung auch dafür verwendet werden, Kontakte und Durchkontakte zu bilden. Beispiele davon werden mit Bezug auf die
20-29B beschrieben.20 ist ein Flussdiagramm des Verfahrens2000 zum Ausbilden eines Kontakts oder Durchkontakts gemäß Ausführungsformen der vorliegenden Offenbarung. Es versteht sich, dass zusätzliche Schritte vor, während und nach dem Verfahren2000 bereitgestellt werden können und dass einige der beschriebenen Schritte für andere Ausführungsformen des Verfahrens2000 ersetzt oder weggelassen werden können. Die21-26 sind Querschnittsansichten eines Abschnitts eines Bauelements100 , das dem Verfahren2000 zum Ausbilden einen Kontakts oder Durchkontakts unterzogen wird, gemäß Ausführungsformen der vorliegenden Offenbarung. Die27A und27B sind Querschnittsansichten einer Source/Drain-Region eines nicht-planaren Bauelements200 , das dem Verfahren2000 unterzogen wurde, gemäß Ausführungsformen der vorliegenden Offenbarung. Die28A und28B sind Querschnittsansichten einer Kanalregion eines nicht-planaren Bauelements200 , das dem Verfahren2000 unterzogen wurde, gemäß Ausführungsformen der vorliegenden Offenbarung. Die29A und29B sind Querschnittsansichten eines Halbleiterbauelements2900 , das dem Verfahren unterzogen wurde, gemäß Ausführungsformen der vorliegenden Offenbarung. - Wir wenden uns Block
2002 von20 sowie21 zu, wo ein Substrat102 empfangen wird, das ein Halbleiterbauelement100 enthält. Das Substrat102 und das Halbleiterbauelement100 können jeweils im Wesentlichen jenen von1 ähneln, und im Interesse der Kürze werden ähnliche Elemente davon nicht erneut beschrieben. In der veranschaulichten Ausführungsform enthält das Halbleiterbauelement100 eine oder mehrere Schichten einer ILD120 , die auf der Source/Drain-Regionen104 und auf der Gate-Struktur116 angeordnet ist. Wir wenden uns Block2004 von20 zu und bleiben bei21 . Eine strukturierte Schicht2102 , wie zum Beispiel eine Photoresistschicht, wird auf der ILD120 ausgebildet und strukturiert, um Kontakt- oder Durchkontaktregionen frei zu legen. In der Ausführungsform von21 entsprechen die frei liegenden Kontakt- oder Durchkontaktregionen Kontaktregionen. Die strukturierte Schicht2102 kann durch Direktschreibe-, Photolithografie- und/oder andere geeignete Prozesse strukturiert werden, und in einer beispielhaften Ausführungsform werden ausgewählte Regionen der strukturierten Schicht2102 mit photolithografischer Strahlung belichtet, wodurch bewirkt wird, dass eine photoaktive Chemikalie in der strukturierten Schicht2102 eine chemische Reaktion durchläuft. Ein Entwicklungsprozess wird ausgeführt, der sich auf das Ergebnis der chemischen Reaktion stützt, um belichtete oder unbelichtete Regionen der strukturierten Schicht2102 selektiv zu entfernen. - Wir wenden uns Block
2006 von20 sowie22 zu. Die eine oder die mehreren ILD-Schichten120 werden unter Verwendung der strukturierten Schicht2102 geätzt, um selektiv die Kontakt- oder Durchkontakt-Aussparungen zu ätzen, wie zum Beispiel die Kontakt-Aussparungen2202 von22 . Das Ätzen der ILD-Schicht120 kann jede geeignete Ätztechnik enthalten, wie zum Beispiel Nassätzen, Trockenätzen, reaktives Ionenätzen (RIE) usw., und kann jede geeignete chemische Ätzzusammensetzung oder Kombination davon verwenden. In einer beispielhaften Ausführungsform enthält das Ätzen von Block2006 einen ersten Ätzvorgang, der eine direktionale oder anisotrope Ätztechnik verwendet, um eine vertikale Ausnehmung zu bilden, und einen zweiten Ätzvorgang, der eine nicht-direktionale oder isotrope Ätztechnik verwendet, um die Ausnehmung zu verbreitern. Die verbleibende strukturierte Schicht2102 kann entfernt werden, nachdem die eine oder die mehreren ILD-Schichten120 geätzt wurden. - Wir wenden uns Block
2008 von20 sowie23 zu. Eine Adhäsionsschicht2302 wird auf der ILD und innerhalb der geätzten Abschnitte der strukturierten Schicht2102 ausgebildet. Wie schon der Name nahelegt, kann die Adhäsionsschicht2302 dafür verwendet werden, die Qualität der Grenzfläche zwischen den bestehenden Materialien zu verbessern, einschließlich der ILD-Schichten120 , der Source/Drain-Regionen104 und der Gate-Struktur116 und anschließend abgeschiedener Materialien, wie zum Beispiel ein Füllmaterial der Kontakte oder Durchkontakte. Dementsprechend kann die Adhäsionsschicht2302 eine oder mehrere Schichten aus leitfähigen Materialien enthalten, wie zum Beispiel Metalle (zum Beispiel Ti, Ta, W, Al, Ni, Cu, Co usw.) und Metallnitride, die mittels ALD, CVD, EP CVD, PEALD, PVD und/oder anderer geeigneter Abscheidungsprozesse abgeschieden werden können. In der vorliegenden Ausführungsform enthält die Adhäsionsschicht2302 mehrere abgeschiedene Schichten von Ti und TiN. In anderen Ausführungsformen werden eine oder mehrere zusätzliche Schichten hinzugefügt, wie zum Beispiel Sperrschichten. - Obgleich die Kontakte
124 durch Abscheiden eines Füllmaterials direkt auf die Adhäsionsschicht2302 ausgebildet werden können, ist festgestellt worden, dass, wenn das Seitenverhältnis der Kontakt- oder Durchkontakt-Ausnehmung größer wird, Leerstellen und Diskontinuitäten auftreten können, die denen ähneln, die im Kontext von Metall-Gate-Fülltechniken beschrieben wurden. Dementsprechend wird, wie in Block2010 von20 und in den24A und24B gezeigt, in einigen Ausführungsformen eine Wachstumssteuerungsschicht2402 auf den Seitenflächen2404 der Ausnehmung ausgebildet, aber nicht unbedingt auf der Bodenfläche2406 . Die Wachstumssteuerungsschicht2402 braucht nur den obersten Abschnitt der Seitenflächen2404 zu bedecken, wie in24A gezeigt, oder kann sich bis zur Bodenfläche2406 erstrecken, wie in24B gezeigt. Die Wachstumssteuerungsschicht2402 beeinflusst die Abscheidungsrate der Technik, die verwendet wird, um anschließend das Füllmaterial abzuscheiden, und kann die Abscheidungsrate auf den ausgenommenen Seitenflächen2404 reduzieren, so dass eine ansonsten konforme Abscheidungstechnik den Boden der Ausnehmung schneller füllt als den oberen Abschnitt. - Die Wachstumssteuerungsschicht
2402 kann jedes geeignete Metall, Metalloxid, Metallcarbid, Metallnitrid und/oder Kombinationen davon enthalten und kann sich zum Beispiel in ihrer Zusammensetzung von der Adhäsionsschicht2303 unterscheiden. In verschiedenen Ausführungsformen enthält die Wachstumssteuerungsschicht2402 WC, WN, AlC, AlN und/oder andere geeignete Materialien. In einigen Ausführungsformen werden ein oder mehrere Metallbestandteile der Wachstumssteuerungsschicht2402 so ausgewählt, dass sie mit Metallkomponenten des anschließend abgeschiedenen Füllmaterials übereinstimmen. In einigen solchen Ausführungsformen wird WC oder WN für die Wachstumssteuerungsschicht2402 auf der Basis eines W-haltigen Füllmaterials ausgewählt. In weiteren solchen Ausführungsformen wird AlC oder AlN für die Wachstumssteuerungsschicht2402 auf der Grundlage eines Al-haltigen Füllmaterials ausgewählt. - Die Wachstumssteuerungsschicht
2402 kann auf jede beliebige Dicke (senkrecht zu den Seitenflächen2404 gemessen) abgeschieden werden, obgleich für Material mit geringerer Leitfähigkeit die Wachstumssteuerungsschicht2402 recht dünn sein kann (zum Beispiel zwischen etwa 0,1 nm (1 Ä) und maximal etwa 2 nm (20 Ä)). Im Ergebnis der Wachstumssteuerungsschicht2402 hat die Bodenfläche2406 der Ausnehmung eine andere Zusammensetzung als die ausgenommenen Seitenwände, die durch die Wachstumssteuerungsschicht2402 definiert werden. Dieser Unterschied kann dafür verwendet werden, anschließende Abscheidungsprozesse abzustimmen. - Jede geeignete konforme oder nicht-konforme Abscheidung kann dafür verwendet werden, die Wachstumssteuerungsschicht
2402 zu bilden. In verschiedenen Ausführungsformen werden ALD, CVD, Sputtern und/oder andere geeignete Techniken verwendet, um die Wachstumssteuerungsschicht2402 auf den Seitenflächen2404 zu bilden. In einer solchen Ausführungsform wird eine Metallkomponente der Wachstumssteuerungsschicht2402 mittels ALD abgeschieden, und eine anschließende Plasmabehandlung wird mittels eines Stickstoff-haltigen und/oder Kohlenstoff-haltigen Gases ausgeführt, um ein Metallnitrid und/oder Metallcarbid zu bilden. Auf die Abscheidung kann ein anisotroper Ätzprozess folgen, um alles abgeschiedene Material von der Bodenfläche2406 der Ausnehmung2202 zu entfernen. Zum Beispiel wird in einer Ausführungsform die Wachstumssteuerungsschicht2402 durch Sputtern abgeschieden, gefolgt von anisotropem Trockenätzen, das auf das abgeschiedene Material auf der Bodenfläche2406 zielt. - Wir wenden uns Block
2012 von20 sowie25 zu. Ein Füllmaterial2502 des Kontakts oder Durchkontakts kann innerhalb der Ausnehmung auf die Wachstumssteuerungsschicht2402 abgeschieden werden. Das Füllmaterial2502 kann jeden geeigneten Leiter enthalten, wie zum Beispiel Metalle (zum Beispiel W, Al, Ta, Ti, Ni, Cu usw.), Metalloxide, Metallnitride und/oder Kombinationen davon. Das Kontaktfüllmaterial kann durch jede geeignete Technik abgeschieden werden, wie zum Beispiel PVD (zum Beispiel Sputtern), CVD, EP CVD, ALD, PEALD und/oder Kombinationen davon. Teilweise aufgrund der Wachstumssteuerungsschicht2402 kann das Füllmaterial2502 auf der Bodenfläche2406 der Ausnehmung2202 schneller abgeschieden werden als auf den Seitenflächen2404 . Anhand von Experimenten und Analysen ist festgestellt worden, dass das Ausfüllen von Aussparungen mit hohem Seitenverhältnis in dieser Weise deutlich das Auftreten von Leerstellen und anderen Defekten in dem Füllmaterial2502 reduziert. - Wir wenden uns Block
2014 von20 und den26A und26B zu. Eine Planarisierungstechnik, wie zum Beispiel chemisch-mechanisches Planarisieren oder Polieren (CMP), kann auf dem Halbleiterbauelement100 ausgeführt werden, um überschüssige Materialien zu entfernen, die sich über die Aussparungen hinaus erstrecken.26A entspricht den Ausführungsformen von24A , wo sich die Wachstumssteuerungsschicht2402 nicht bis zur Bodenfläche2406 erstreckt, während26B den Ausführungsformen von24B entspricht, wo sich die Wachstumssteuerungsschicht2402 bis zur Bodenfläche2406 erstreckt. Wie in Block2016 von20 zu sehen, kann das Bauelement100 zur Weiterverarbeitung bereitgestellt werden. - Weitere Beispiele von Kontakten und Durchkontakten, die durch das Verfahren
2000 ausgebildet werden können, sind in den27A-29B gezeigt. Wenden wir und zuerst den27A und27B zu, wo beispielhafte Kontakte124 zu Source/Drain-Regionen208 eines nicht-planaren Bauelements200 , die durch die hier besprochenen Techniken ausgebildet werden, offenbart sind. In vielen Aspekten ist das nicht-planare Bauelement200 im Wesentlichen den2A-2C ähnlich, und im Interesse der Kürze kann auf eine Wiederholung ähnlicher Strukturen verzichtet werden. - In der veranschaulichten Ausführungsform erstrecken sich die Kontakte
124 in das ILD120 in der vertikalen Richtung und spannen sich über eine oder mehrere Source/Drain-Regionen208 in der horizontalen Richtung. Dementsprechend wird eine Adhäsionsschicht2302 der Kontakte124 , im Wesentlichen ähnlich der von23 , auf mindestens einer Oberfläche mindestens einer Source/Drain-Region208 mittels einer Technik wie zum Beispiel der von Block2008 von20 angeordnet. Die Adhäsionsschicht2302 kann ebenfalls auf dem Substrat102 zwischen den Source/Drain-Regionen208 angeordnet werden. - Der Kontakt
124 enthält des Weiteren eine Wachstumssteuerungsschicht2402 , die durch einen Prozess wie zum Beispiel den von Block2010 von20 ausgebildet wird. Die Wachstumssteuerungsschicht2402 wird auf den Seitenflächen2404 des Grabens angeordnet, aber nicht unbedingt auf dem Substrat102 bis zur Bodenfläche2406 . In Abhängigkeit von der Anwendung kann die Wachstumssteuerungsschicht2402 auf den Source/Drain-Regionen208 angeordnet, wie in27A gezeigt, oder kann in diesen Regionen weggelassen werden, wie in27B gezeigt. Ein Füllmaterial2502 , wie zum Beispiel das Füllmaterial2502 von25 , wird auf der Wachstumssteuerungsschicht2402 angeordnet, um den Kontakt124 zu vollenden. - Wir wenden uns den
28A und28B zu, wo beispielhafte Kontakte124 zu einer Gate-Struktur212 eines nicht-planaren Bauelements200 , die durch die hier besprochenen Techniken ausgebildet werden, offenbart sind. In vielen Aspekten ähnelt das nicht-planare Bauelement200 im Wesentlichen dem der2A-2C , und im Interesse der Kürze kann auf eine Widerholung ähnlicher Strukturen verzichtet werden. Die Kontakte124 enthalten eine Adhäsionsschicht2302 im Wesentlichen ähnlich der von23 . Die Adhäsionsschicht2302 wird innerhalb einer Ausnehmung, die in dem ILD120 über der Gate-Struktur212 angeordnet ist, mittels einer Technik wie zum Beispiel der von Block2008 von20 ausgebildet wird. - Der Kontakt
124 enthält außerdem eine Wachstumssteuerungsschicht2402 , die durch einen Prozess wie zum Beispiel den von Block2010 von20 ausgebildet wird. Die Wachstumssteuerungsschicht2402 wird auf den Seitenflächen2404 des Grabens, aber nicht unbedingt auf dem Grabenboden angeordnet, so dass die andere Zusammensetzung von resultierenden Seitenwänden dafür verwendet werden kann, anschließende Abscheidungsprozesse abzustimmen. In Abhängigkeit von der Anwendung erstreckt sich die Wachstumssteuerungsschicht2402 mindestens entlang der oberen Abschnitte der Seitenflächen2404 , wie in28A gezeigt, und kann sich den ganzen Weg bis zu den Bodenflächen (zum Beispiel der Adhäsionsschicht2302 auf der Gate-Struktur212 ) erstrecken, wie in28B gezeigt. Ein Füllmaterial2502 , wie zum Beispiel das Füllmaterial2502 von25 , wird auf der Wachstumssteuerungsschicht2402 angeordnet, um den Kontakt124 zu vollenden. - Und schließlich kann, wie in den
29A und29B gezeigt, das Verfahren2000 dafür verwendet werden, Durchkontakte122 zu bilden. Die29A und29B sind Querschnittsschaubilder einer Interconnect-Struktur eines Halbleiterbauelements2900 , wie zum Beispiel eines planaren oder nicht-planaren Halbleiterbauelements, gemäß Ausführungsformen der vorliegenden Offenbarung. Ähnlich den Kontakten124 können die Durchkontakte122 eine Adhäsionsschicht2302 im Wesentlichen ähnlich der von23 enthalten. Die Adhäsionsschicht2302 wird innerhalb einer Ausnehmung, die in dem ILD120 angeordnet ist, mittels einer Technik wie zum Beispiel der von Block2008 von20 ausgebildet. Die Adhäsionsschicht2302 kann eine darunterliegende Leiterbahn118 berühren. - Die Durchkontakte
122 enthalten eine Wachstumssteuerungsschicht2402 , die durch einen Prozess wie zum Beispiel den von Block2010 von20 ausgebildet wird. Die Wachstumssteuerungsschicht2402 wird auf den Seitenflächen2404 der Ausnehmung, aber nicht unbedingt auf der Bodenfläche2406 angeordnet, so dass die andere Zusammensetzung der resultierenden Seitenwänden dafür verwendet werden kann, anschließende Abscheidungsprozesse abzustimmen. In Abhängigkeit von der Anwendung erstreckt sich die Wachstumssteuerungsschicht2402 mindestens entlang der oberen Abschnitte der Seitenflächen2404 , wie in29A gezeigt, und kann sich den ganzen Weg bis zur Adhäsionsschicht2302 auf der Gate-Struktur212 erstrecken, wie in29B gezeigt. Ein Füllmaterial2502 , wie zum Beispiel das Füllmaterial2502 von25 , wird auf der Wachstumssteuerungsschicht2402 angeordnet, um den Durchkontakt122 zu vervollständigen und - in einigen Ausführungsformen - um Leiterbahnen118 zu bilden. - Dementsprechend wird eine Technik zum Ausbilden leitfähiger Strukturelemente bereitgestellt, und es werden die durch die Technik erzeugten Strukturen offenbart. In einigen Ausführungsformen enthält das Verfahren das Empfangen eines Substrats mit einer Gate-Struktur. Die Gate-Struktur enthält einen Opferabschnitt, der entfernt wird, um einen Graben innerhalb der Gate-Struktur zu definieren. Der Graben hat gegenüberliegende Seitenflächen und eine darauf definierte Bodenfläche. Eine Materialschicht wird selektiv auf den gegenüberliegenden Seitenflächen ausgebildet, dergestalt, dass die Bodenfläche frei von der Materialschicht ist. Ein Füllmaterial einer Gate-Elektrode wird auf der Materialschicht und auf der Bodenfläche innerhalb des Grabens abgeschieden. In einigen solchen Ausführungsformen enthält das Ausbilden der Materialschicht das Abscheiden eines Metalls unter Verwendung von Atomschichtabscheidung (ALD) und das Ausführen einer Plasmabehandlung des Metalls mittels eines Kohlenstoff-haltigen Gases. In einigen solchen Ausführungsformen enthält das Ausbilden der Materialschicht einen Abscheidungsprozesses und einen Ätzprozess, der dafür konfiguriert ist, abgeschiedenes Material von der Bodenfläche zu entfernen.
- In weiteren Ausführungsformen enthält das Verfahren das Empfangen eines Substrats mit einer Ausnehmung, die durch mindestens zwei gegenüberliegende Seitenwänden und eine Bodenfläche definiert wird. Ein Wachstumssteuerungsmaterial wird innerhalb der Ausnehmung und auf den mindestens zwei gegenüberliegenden Seitenwänden dergestalt abgeschieden, dass die Bodenfläche frei von Wachstumssteuerungsmaterial ist. Eine Füllmaterialschicht wird innerhalb der Ausnehmung dergestalt abgeschieden, dass sich das Füllmaterial auf dem Wachstumssteuerungsmaterial und auf der Bodenfläche befindet. In einigen solchen Ausführungsformen enthält das Wachstumssteuerungsmaterial ein Metallnitrid und/oder ein Metallcarbid. In einigen solchen Ausführungsformen enthalten das Wachstumssteuerungsmaterial und die Füllmaterialschicht mindestens ein gemeinsames Metall.
- In weiteren Ausführungsformen umfasst das Halbleiterbauelement ein Substrat, auf dem eine Gate-Struktur ausgebildet ist. Die Gate-Struktur enthält eine Gate-Dielektrikumschicht, die auf dem Substrat angeordnet ist, ein Wachstumssteuerungsmaterial, das auf einer Seitenfläche der Gate-Struktur angeordnet ist, und ein Gate-Elektroden-Füllmaterial, das auf dem Wachstumssteuerungsmaterial und auf einer Bodenfläche angeordnet ist, die frei von dem Wachstumssteuerungsmaterial ist. In einigen Ausführungsformen enthält die Gate-Struktur des Weiteren eine Sperrschicht, die zwischen dem Wachstumssteuerungsmaterial und der Gate-Dielektrikumschicht und zwischen dem Gate-Elektroden-Füllmaterial und der Gate-Dielektrikumschicht angeordnet ist. In einigen dieser Ausführungsformen unterscheidet sich die Sperrschicht in ihrer Zusammensetzung von dem Wachstumssteuerungsmaterial. In einigen Ausführungsformen berührt das Gate-Elektroden-Füllmaterial eine erste Oberfläche und eine zweite Oberfläche, die in ihrer Zusammensetzung verschieden sind.
Claims (15)
- Verfahren, das Folgendes umfasst: Empfangen (302) eines Substrats (102), auf dem eine Gate-Struktur (212) angeordnet ist, wobei die Gate-Struktur einen Opferabschnitt (402) enthält; Entfernen (304) des Opferabschnitts, um einen Graben (404) innerhalb der Gate-Struktur zu definieren, wobei der Graben gegenüberliegende Seitenflächen (414) und eine darauf definierte Bodenfläche (416) hat; selektives Ausbilden (314) einer Materialschicht (412) auf oberen Abschnitten der gegenüberliegenden Seitenflächen, wobei untere Abschnitte der gegenüberliegenden Seitenflächen und die Bodenfläche frei von der Materialschicht sind; und Abscheiden (316) eines Füllmaterials (418) einer Gate-Elektrode (220) auf der Materialschicht, auf den unteren Abschnitten der gegenüberliegenden Seitenflächen und auf der Bodenfläche innerhalb des Grabens.
- Verfahren nach
Anspruch 1 , wobei das Ausbilden (314) der Materialschicht das Abscheiden eines Metalls unter Verwendung von Atomschichtabscheidung (ALD) und das Ausführen einer Plasmabehandlung des Metalls mittels eines Kohlenstoff-haltigen Gases enthält. - Verfahren nach
Anspruch 1 , wobei das Ausbilden (314) der Materialschicht einen Abscheidungsprozess und einen Ätzprozess, der dafür konfiguriert ist, abgeschiedenes Material von der Bodenfläche zu entfernen, enthält. - Verfahren nach einem der vorangehenden Ansprüche, wobei die Materialschicht (412) mit einer Dicke von weniger als etwa 2nm (20 Ä) ausgebildet wird.
- Verfahren nach einem der vorangehenden Ansprüche, das des Weiteren Folgendes umfasst: Ausbilden einer Sperrschicht (410) auf den gegenüberliegenden Seitenflächen und auf der Bodenfläche innerhalb des Grabens vor dem Ausbilden (314) der Materialschicht, wobei die Sperrschicht eine andere Zusammensetzung als die Materialschicht hat.
- Verfahren nach einem der vorangehenden Ansprüche, wobei die Materialschicht (412) ein Metallcarbid enthält.
- Verfahren nach einem der vorangehenden
Ansprüche 1 bis5 , wobei die Materialschicht (412) ein Metallnitrid enthält. - Verfahren nach einem der vorangehenden Ansprüche, wobei die Materialschicht (412) und das Füllmaterial (418) ein gemeinsames Metall enthalten.
- Verfahren nach einem der vorangehenden Ansprüche, das des Weiteren Folgendes umfasst: Ausbilden (306) einer Gate-Dielektrikumschicht (216) innerhalb des Grabens vor dem Ausbilden (314) der Materialschicht.
- Verfahren zur Halbleiterfertigung, wobei das Verfahren Folgendes umfasst: Empfangen eines Substrats (102), in dem eine Ausnehmung (404) definiert ist, wobei die Ausnehmung mindestens zwei gegenüberliegende Seitenwände (414) und eine Bodenfläche (416) hat; Abscheiden eines Wachstumssteuerungsmaterials (414) innerhalb der Ausnehmung und auf oberen Abschnitten der mindestens zwei gegenüberliegenden Seitenwänden dergestalt, dass untere Abschnitte der mindestens zwei gegenüberliegenden Seitenwände und die Bodenfläche frei von dem Wachstumssteuerungsmaterial sind; und Anordnen einer Füllmaterialschicht (418) innerhalb der Ausnehmung dergestalt, dass das Füllmaterial auf dem Wachstumssteuerungsmaterial, auf den unteren Abschnitten der mindestens zwei gegenüberliegenden Seitenwänden und auf der Bodenfläche angeordnet wird.
- Verfahren nach
Anspruch 10 , wobei das Wachstumssteuerungsmaterial (412) ein Metallnitrid und/oder ein Metallcarbid enthält. - Verfahren nach
Anspruch 11 , wobei das Wachstumssteuerungsmaterial (412) und die Füllmaterialschicht (418) mindestens ein Metall gemeinsam enthalten. - Verfahren nach
Anspruch 11 oder12 , wobei das Abscheiden des Wachstumssteuerungsmaterials Folgendes enthält: Abscheiden eines Metalls des Wachstumssteuerungsmaterials, und Ausführen einer Plasmabehandlung des Metalls unter Verwendung eines Stickstoff-haltigen Gases oder eines Kohlenstoff-haltigen Gases. - Verfahren nach einem der
Ansprüche 10 bis13 , wobei das Ausbilden des Wachstumssteuerungsmaterials einen Abscheidungsprozesses und einen Ätzprozess enthält, der dafür konfiguriert ist, abgeschiedenes Material von der Bodenfläche (416) zu entfernen. - Verfahren nach einem der
Ansprüche 10 bis14 , wobei das Wachstumssteuerungsmaterial (412) mit einer Dicke von weniger als etwa 2 nm (20 Ä) ausgebildet wird.
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