CN107767806A - 双向移位寄存器及具有双向移位寄存器的显示驱动系统 - Google Patents

双向移位寄存器及具有双向移位寄存器的显示驱动系统 Download PDF

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Abstract

本发明提供一种双向移位寄存器提供扫描信号给扫描线。双向移位寄存器接收时序控制器输出的四个时钟信号。四个时钟信号按照排列顺序依次移位。双向移位寄存器可选择地在正向扫描方式和反向扫描方式之间切换。双向移位寄存器包括多个级联连接的移位寄存单元。每个移位寄存单元对应一条扫描线,且受控于两个不相邻的时钟信号,且两个时钟信号之间间隔一个时钟周期。移位寄存单元包括上拉晶体管、下拉晶体管及下拉模块。移位寄存单元可在一帧图像显示时间内进行重置。下拉模块在移位寄存单元重置后控制下拉晶体管导通,以防止移位寄存单元的输出错误信号。本发明还提供了一种具有双向移位寄存器的显示驱动系统。

Description

双向移位寄存器及具有双向移位寄存器的显示驱动系统
技术领域
本发明涉及一种双向移位寄存器及具有双向移位寄存器的显示驱动系统。
背景技术
随着电子技术的不断发展,手机、便携式计算机、个人数字助理(PDA)、平板计算机、媒体播放器等消费性电子产品大多都采用显示器作为输入输出设备,以使产品具有更友好的人机交互方式。通常显示器包括显示面板和用于驱动显示面板显示图像的显示驱动电路。显示面板包括多条数据线和多条扫描线,驱动电路包括时序控制器、栅极驱动器以及数据驱动电路。栅极驱动器输出扫描驱动信号给显示面板进行逐行扫描。栅极驱动器包括多级移位寄存器单元。每一级移位寄存单元对应一条扫描线。现有技术中,栅极驱动器只能实现从上到下一个方向对扫描线进行逐行扫描,缺少灵活性。
发明内容
有鉴于此,有必要提供一种提高灵活性的双向移位寄存器。
还有必要提供一种提高灵活性的显示驱动系统。
本发明提供一种双向移位寄存器提供扫描信号给扫描线。双向移位寄存器接收时序控制器输出的四个时钟信号。四个时钟信号按照排列顺序依次移位。双向移位寄存器可选择地在正向扫描方式和反向扫描方式之间切换。双向移位寄存器包括多个级联连接的移位寄存单元。每个移位寄存单元对应连接一条扫描线。每个移位寄存单元受控于两个不相邻的时钟信号,且两个时钟信号之间间隔一个时钟周期。移位寄存单元包括上拉晶体管、下拉晶体管及下拉模块。移位寄存单元可在一帧图像显示时间内进行重置。下拉模块在移位寄存单元重置后控制下拉晶体管导通,以防止移位寄存单元的输出错误信号。
还提供一种显示驱动系统,包括时序控制器、数据驱动电路以及扫描驱动电路。扫描驱动电路包括双向移位寄存器。双向移位寄存器提供扫描信号给扫描线。双向移位寄存器接收时序控制器输出的四个时钟信号。四个时钟信号按照排列顺序依次移位。双向移位寄存器可选择地在正向扫描方式和反向扫描方式之间切换。双向移位寄存器包括多个级联连接的移位寄存单元。每个移位寄存单元对应连接一条扫描线。每个移位寄存单元受控于两个不相邻的时钟信号,且两个时钟信号之间间隔一个时钟周期。移位寄存单元包括上拉晶体管、下拉晶体管及下拉模块。移位寄存单元可在一帧图像显示时间内进行重置。在重置阶段,下拉模块控制下拉晶体管导通,以防止移位寄存单元的输出错误信号。
上述基于上述结构的双向移位寄存器可选择地在正向扫描方式和反向扫描方式之间切换,提高双向移位寄存器的灵活性。在一帧时间内通过四个时钟信号控制扫描驱动电路,可降低功耗。同时,通过设置下拉模块,可在重置后避免移位寄存单元输出错误信号。
附图说明
图1为一种较佳实施方式之显示驱动系统的模块示意图。
图2为图1所示的显示驱动系统的双向移位寄存器的第一实施例的模块示意图。
图3为图2所示的双向移位寄存器的第N-2级移位寄存单元的等效电路图。
图4为图3所示的双向移位寄存器的第N-2级移位寄存单元接收的初始信号、第一时钟信号、第二时钟信号、前面第两级输出信号、前面第一级输出信号、输出信号、后面第一级输出信号及后面第两级输出信号的时序示意图。
图5为图1所示的显示驱动系统的双向移位寄存器的第二实施例的模块示意图。
图6为图5所示的双向移位寄存器的第N-1级移位寄存单元的等效电路图。
图7为图5所示的双向移位寄存器的第N-1级移位寄存单元接收的初始信号、第一时钟信号、第二时钟信号、前面第两级输出信号、前面第一级输出信号、输出信号、后面第一级输出信号及后面第两级输出信号的时序示意图。
主要元件符号说明
显示驱动系统 100
扫描驱动电路 110
数据驱动电路 120
时序控制器 130
显示区域 101
非显示区域 103
扫描线 S1-Sn
数据线 D1-Dm
像素单元 20
双向移位寄存器 111,211
移位寄存器单元 SR1-SRn
输入端 IN1-IN(n)
启动信号 STV
输出端 Gout1-Gout(n)
时钟信号 CKV1-CKV4
上拉晶体管 M1
下拉晶体管 M2
第一开关晶体管 M3
第二开关晶体管 M4
第三开关晶体管 M5
第四开关晶体管 M6
第五开关晶体管 M7
第六开关晶体管 M8
第七开关晶体管 M9
第一结点 N1
第二结点 N2
第一电容 C1
第二电容 C2
下拉模块 30
第一阶段 T1
第二阶段 T2
第三阶段 T3
第四阶段 T4
第五阶段 T5
第六阶段 T6
如下具体实施方式将结合上述附图进一步说明本发明。
具体实施方式
本发明提供一种可选择地在正向扫描方式和反向扫描方式之间切换的扫描驱动电路,同时设置下拉模块,在重置后控制下拉晶体管导通,以避免移位寄存单元输出错误信号,提高了扫描驱动电路的灵活性。
请参阅图1,图1是本发明一实施例的用于驱动显示装置的显示驱动系统100的等效模块示意图。所述显示驱动系统100设置于围绕显示区域101设置的非显示区域103内。显示区域101内包括多条扫描线S1-Sn以及多条数据线D1-Dm。其中,n,m为正整数。多条扫描线S1-Sn沿第一方向X延伸且相互平行设置,多条的数据线D1-Dm沿第二方向Y延伸且相互平行设置,多条扫描线S1-Sn与多条数据线D1-Dm相互绝缘并呈网格交叉设置,定义出多个呈矩阵排列的像素单元20。
显示驱动系统100包括扫描驱动电路110、数据驱动电路120以及时序控制器130。每一列像素单元20通过一条扫描线Sn与扫描驱动电路110电性连接,每一行像素单元20通过一条数据线Dm与数据驱动电路120电性连接。时序控制器130分别与扫描驱动电路110以及数据驱动电路120电性连接。时序控制器130产生多个同步控制信号给扫描驱动电路110以及数据驱动电路120。多个同步控制信号可包括周期性的同步控制信号和非周期性的同步控制信号。多个同步控制信号包括垂直同步信号(Vertical synchronization,Vsync)、水平同步信号(Horizontal synchronization,Hsync)以及数据使能信号(Data Enable,DE)。在本实施方式中,时序控制器130提供4个时钟信号CKV1-CKV4给扫描驱动电路110。其中,第一时钟信号CKV1、第二时钟信号CKV2、第三时钟信号CKV3及第四时钟信号CKV4按照排列顺序依次移位。扫描驱动电路110提供扫描信号至多条扫描线S1-Sn以扫描像素单元20。数据驱动电路120用于提供图像信号给多条数据线D1-Dm以显示图像。在本实施方式中,扫描驱动电路110设置于显示区域的上方,数据驱动电路120设置于显示区域的左侧。
扫描驱动电路110包括双向移位寄存器111。请参阅图2,其为第一实施方式的双向移位寄存器11的模块示意图。双向移位寄存器111可选择地在正向扫描方式和反向扫描方式之间切换。其中,正向扫描方式为双向移位寄存器111控制扫描线S1-Sn依据编号依次从第一条S1至最后一条Sn加载扫描信号;反向扫描方式为双向移位寄存器111控制扫描线S1-Sn依据编号依次从最后一条Sn至第一条S1加载扫描信号。双向移位寄存器111包括多个级联连接的移位寄存单元SR1-SRn。每一级移位寄存单元SR1-SRn与其中一条扫描线S1-Sn电性连接。每个移位寄存单元SR1-SRn通过一个输出端Gout1-Gout(n)与其中一条扫描线S1-Sn电性连接。每个移位寄存单元SR1-SRn接收时序控制器130输出的两个不相邻的时钟信号。其中,奇数级的移位寄存单元SR2,SR4,…SRn接收第一时钟信号CKV1和第三时钟信号CKV3;偶数级的移位寄存单元SR1,SR3,…SR(n-1)接收第二时钟信号CKV2和第四时钟信号CKV4。第一级移位寄存单元SR1的输入端IN1接收启动信号STV,其他任意一级移位寄存单元SR(n-2)的输出信号提供给后面两级的移位寄存单元SR(n-1)的输入端IN(n-1)及移位寄存单元SRn的输入端INn作为预充电信号,并接收前面两级的移位寄存单元SR(n-3)及移位寄存单元SR(n-4)输出信号作为复位信号。可以理解,第二级移位寄存单元SR2仅接收前面一级的移位寄存单元SR1的输出信号作为复位信号。每一级移位寄存单元SR1-SRn具有相同的结构。每一级移位寄存单元SR1-SRn包括上拉晶体管M1、下拉晶体管M2、第一开关晶体管M3、第二开关晶体管M4、第三开关晶体管M5、第四开关晶体管M6、第五开关晶体管M7、第六开关晶体管M8、第七开关晶体管M9、第一电容C1以及第二电容C2,以形成9个晶体管和2个电容组成的9T2C架构。下面以第N-2级的移位寄存单元SR(n-2)为例说明移位寄存单元的结构。
请参阅图3,其为双向移位寄存器111的第N-2级的移位寄存单元SR(n-2)的等效电路图。上拉晶体管M1的源极接收第三时钟信号CKV3,第七晶体管M9的栅极接收第一时钟信号CKV1。下拉晶体管M2、第五开关晶体管M7、第六开关晶体管M8以及第七开关晶体管M9的漏极接收参考电压VGL。上拉晶体管M1的漏极和下拉晶体管M2的源极电性连接,且移位寄存单元SR(n-2)的输出端Gout(n-2)电性连接于上拉晶体管M1的漏极和下拉晶体管M2的源极之间。第一开关晶体管M3和第二开关晶体管M4的漏极相互电性连接,并通过第一结点N1与上拉晶体管M1的栅极电性连接。第三开关晶体管M5和第四开关晶体管M6的漏极相互电性连接,并通过第二结点N2与下拉晶体管M2的栅极电性连接。第一开关晶体管M3和第五开关晶体管M7的栅极与第N-3级的移位寄存单元SR(n-3)的输出端Gout(n-3)电性连接。第二开关晶体管M4和第六开关晶体管M8的栅极与第N-1级的移位寄存单元SR(n-1)的输出端Gout(n-1)电性连接。第三开关晶体管M5的栅极与第N-4级的移位寄存单元SR(n-4)的输出端Gout(n-4)电性连接。第四开关晶体管M6的栅极与第N级的移位寄存单元SRn的输出端Gout(n)电性连接。第一开关晶体管M3的源极与栅极电性连接。第二开关晶体管M4的源极与栅极电性连接。第三开关晶体管M5的源极与栅极电性连接。第四开关晶体管M6的源极与栅极电性连接。第五开关晶体管M7的源极与栅极电性连接,并与第二结点N2电性连接。第六开关晶体管M8的源极与栅极电性连接,并与第二结点N2电性连接。第一电容C1并联连接于上拉晶体管M1的栅极和漏极。第二电容C2并联连接于下拉晶体管M2的栅极和漏极。在本实施方式中,上拉晶体管M1、下拉晶体管M2、第一开关晶体管M3、第二开关晶体管M4、第三开关晶体管M5、第四开关晶体管M6、第五开关晶体管M7、第六开关晶体管M8、第七开关晶体管M9为N型金属氧化物半导体(Metal OxideSemiconductor,MOS)晶体管。在本实施方式中,参考电压为低电平电位,例如0伏。
其中,第一开关晶体管M3用于在反向扫描时对第一电容C1进行预充电。第二开关晶体管M4用于在正向扫描时对第一电容C1进行预充电。
其中,第三开关晶体管M5和第四开关晶体管M6组成一个下拉模块30。下拉模块30用于在移位寄存单元SR(n-2)重置后控制下拉晶体管M2导通,以防止移位寄存单元SR(n-2)的输出端Gout(n-2)输出错误信号。第三开关晶体管M5用于在反向扫描且在移位寄存单元SR(n-2)重置后控制下拉晶体管M2导通。第四开关晶体管M6用于在正向扫描且在移位寄存单元SR(n-2)重置后控制下拉晶体管M2导通。
其中,第五开关晶体管M7用于在反向扫描时控制第二电容C2的放电以重置移位寄存单元SR(n-2)。第六开关晶体管M8用于在正向扫描时控制第二电容C2的放电以重置移位寄存单元SR(n-2)
请一并参阅图4,其为第N-2级的移位寄存单元SR(n-2)工作在正向扫描方式的时序图。在一帧图像显示时间(1frame)包括第一阶段T1、第二阶段T2、第三阶段T3(预充电阶段)、第四阶段T4、第五阶段T5(重置阶段)以及第六阶段T6。
在第一阶段T1为初始阶段,第一时钟信号CKV1和第三时钟信号CKV3在第一阶段T1内同时处于高电平,以使得第N-2级的移位寄存单元SR(n-2)的处于初始阶段。
在第二阶段T2,第一时钟信号CKV1处于高电平,第三时钟信号CKV3处于低电平,第N-4级的移位寄存单元SR(n-4)的输出端Gout(n-4)输出高电平,第N-3级的移位寄存单元SR(n-3)的输出端Gout(n-3)、第N-1级的移位寄存单元SR(n-1)的输出端Gout(n-1)及第N级的移位寄存单元SRn的输出端Gout(n)输出低电平。第三开关晶体管M5及第七开关晶体管M9导通,使得下拉晶体管M2截止,下拉晶体管M2导通。第一开关晶体管M3、第二开关晶体管M4、第四开关晶体管M6、第五开关晶体管M7及第六开关晶体管M8均截止。
在第三阶段T3(预充电阶段),第一时钟信号CKV1和第三时钟信号CKV3处于低电平,第N-4级的移位寄存单元SR(n-4)的输出端Gout(n-4)、第N-1级的移位寄存单元SR(n-1)的输出端Gout(n-1)及第N级的移位寄存单元SRn的输出端Gout(n)输出低电平,第N-3级的移位寄存单元SR(n-3)的输出端Gout(n-3)输出高电平。第一开关晶体管M3和第五开关晶体管M7导通,第一电容C1充电,上拉晶体管M1导通,下拉晶体管M2截止,使得第N-2级的移位寄存单元SR(n-2)的输出端Gout(n-2)根据第三时钟信号CKV3输出低电平。同时,第二开关晶体管M4、第三开关晶体管M5、第四开关晶体管M6、第六开关晶体管M8以及第七开关晶体管M9截止。
在第四阶段T4,第一时钟信号CKV1处于低电平,第三时钟信号CKV3处于高电平,第N-4级的移位寄存单元SR(n-4)的输出端Gout(n-4)、第N-3级的移位寄存单元SR(n-3)的输出端Gout(n-3)、第N-1级的移位寄存单元SR(n-1)的输出端Gout(n-1)及第N级的移位寄存单元SRn的输出端Gout(n)输出低电平。上拉晶体管M1根据第一电容C1存储的电势导通,使得第N-2级的移位寄存单元SR(n-2)的输出端Gout(n-2)根据第三时钟信号CKV3输出高电平,以使得对应的扫描线S(n-2)加载扫描信号。同时,第一开关晶体管M3、第二开关晶体管M4、第三开关晶体管M5、第四开关晶体管M6、第五开关晶体管M7、第六开关晶体管M8以及第七开关晶体管M9截止。
在第五阶段T5(重置阶段),第一时钟信号CKV1和第三时钟信号CKV3处于低电平,第N-4级的移位寄存单元SR(n-4)的输出端Gout(n-4)、第N-3级的移位寄存单元SR(n-3)的输出端Gout(n-3)及第N级的移位寄存单元SRn的输出端Gout(n)输出低电平,第N-1级的移位寄存单元SR(n-1)的输出端Gout(n-1)输出高电平。第二开关晶体管M4导通,使得上拉晶体管M1导通,使得第N-2级的移位寄存单元SR(n-2)的输出端Gout(n-2)根据第三时钟信号CKV3输出低电平,以重置第N-2级的移位寄存单元SR(n-2)。第六开关晶体管M8导通,使得下拉晶体管M2截止。同时,第一开关晶体管M3、第三开关晶体管M5、第四开关晶体管M6、第五开关晶体管M7以及第七开关晶体管M9截止。
在第六阶段T6,第一时钟信号CKV1处于高电平,第三时钟信号CKV3处于低电平,第N-4级的移位寄存单元SR(n-4)的输出端Gout(n-4)输出高电平,第N-3级的移位寄存单元SR(n-3)的输出端Gout(n-3)及第N-1级的移位寄存单元SR(n-1)的输出端Gout(n-1),第N级的移位寄存单元SRn的输出端Gout(n)输出高电平。上拉晶体管M1、第一开关晶体管M3、第二开关晶体管M4、第三开关晶体管M5、第五开关晶体管M7、第六开关晶体管M8及第七开关晶体管M9截止,第四开关晶体管M6导通,使得下拉晶体管M2导通,进一步第N-2级的移位寄存单元SR(n-2)的输出端Gout(n-2)输出低电平,以避免第N-2级的移位寄存单元SR(n-2)的输出端Gout(n-2)输出错误信号。
基于上述结构的双向移位寄存器,双向移位寄存器可选择地在正向扫描方式和反向扫描方式之间切换,提高双向移位寄存器的灵活性。在一帧时间内通过四个时钟信号控制扫描驱动电路,可降低功耗。同时,通过设置下拉模块,可在重置后控制下拉晶体管导通,以避免移位寄存单元输出错误信号。
请参阅图5,其为本发明第二实施例的双向移位寄存器211的模块示意图。双向移位寄存器211可选择地在正向扫描方式和反向扫描方式之间切换。其中,正向扫描方式为双向移位寄存器211控制扫描线S1-Sn依据编号依次从第一条扫描线S1至最后一条扫描线Sn加载扫描信号;反向扫描方式为双向移位寄存器111控制扫描线S1-Sn依据编号依次从最后一条扫描线Sn至第一条扫描线S1加载扫描信号。双向移位寄存器111包括多个移位寄存单元SR1-SRn。每一级移位寄存单元SR1-SRn与其中一条扫描线S1-Sn电性连接。多个移位寄存单元SR1-SRn级联连接。每个移位寄存单元SR1-SRn通过一个输出端Gout1-Gout(n)与其中一条扫描线S1-Sn电性连接。每个移位寄存单元SR1-SRn接收时序控制器130输出的两个时钟信号。其中,奇数级的移位寄存单元SR1,SR3,…SR(n-1)接收第一时钟信号CKV1和第三时钟信号CKV3;偶数级的移位寄存单元SR2,SR4,…SRn接收第二时钟信号CKV2和第四时钟信号CKV4。第一级移位寄存单元SR1接收启动信号STV,其他任意一级移位寄存单元SR(n-1)的输出信号提供给后一级的移位寄存单元SRn的输入端IN(n)作为预充电信号,并接收前一级的移位寄存单元SR(n-2)输出信号作为复位信号。每一级移位寄存单元SR1-SRn具有相同的结构。每一级移位寄存单元SR1-SRn包括上拉晶体管M1、下拉晶体管M2,、第一开关晶体管M3、第二开关晶体管M4、第三开关晶体管M5、第四开关晶体管M6、第五开关晶体管M7、第六开关晶体管M8及第一电容C1,以形成8个晶体管和1个电容组成的8T1C架构。下面以第N-1级的移位寄存单元SR(n-1)为例说明移位寄存单元的结构。
请参阅图6,其为双向移位寄存器211的第N-1级的移位寄存单元SR(n-1)的等效电路图。上拉晶体管M1的源极接收第二时钟信号CKV2,第六晶体管M8的栅极接收第四时钟信号CKV4。下拉晶体管M2、第四开关晶体管M6、第五开关晶体管M7以及第六开关晶体管M8的漏极接收参考电压VGL。上拉晶体管M1的漏极和下拉晶体管M2的源极电性连接,且移位寄存单元SR(n-1)的输出端Gout(n-1)电性连接于上拉晶体管M1的漏极和下拉晶体管M2的源极之间。第一开关晶体管M3和第二开关晶体管M4的漏极相互电性连接,并通过第一结点N1与上拉晶体管M1的栅极电性连接。第三开关晶体管M5的漏极通过第二结点N2与下拉晶体管M2的栅极电性连接。第一开关晶体管M3和第四开关晶体管M6的栅极与第N-2级的移位寄存单元SR(n-2)的输出端Gout(n-2)电性连接。第二开关晶体管M4和第五开关晶体管M7的栅极与第N级的移位寄存单元SRn的输出端Gout(n)电性连接。第三开关晶体管M5的栅极与第四时钟信号CKV4电性连接。第一开关晶体管M3的源极与栅极电性连接。第二开关晶体管M4的源极与栅极电性连接。第三开关晶体管M5的源极与栅极电性连接。第四开关晶体管M6的源极与栅极电性连接并与第二结点N2电性连接。第五开关晶体管M7的源极与栅极电性连接,并与第二结点N2电性连接。第六开关晶体管M8的源极与第一结点N1电性连接。第一电容C1并联连接于上拉晶体管M1的栅极和漏极。在本实施方式中,上拉晶体管M1、下拉晶体管M2、第一开关晶体管M3、第二开关晶体管M4、第三开关晶体管M5、第四开关晶体管M6、第五开关晶体管M7、第六开关晶体管M8、第七开关晶体管M9为N型金属氧化物半导体(Metal Oxide Semiconductor,MOS)晶体管。在本实施方式中,参考电压为低电平电位,例如0伏。
其中,第一开关晶体管M3用于在反向扫描时对第一电容C1进行预充电。第二开关晶体管M4用于在正向扫描时对第一电容C1进行预充电。
其中,第三开关晶体管M5构成下拉模块30。下拉模块30受控于第四时钟信号CKV4。下拉模块30用于在移位寄存单元SR(n-1)重置后控制下拉晶体管M2导通,以防止移位寄存单元SR(n-1)的输出端Gout(n-1)输出错误信号。
其中,第四开关晶体管M6用于在反向扫描时控制第二电容C2的放电以重置移位寄存单元SR(n-1)。第五开关晶体管M7在正向扫描时控制第二电容C2的放电以重置移位寄存单元SR(n-1)
请一并参阅图7,其为第N-1级的移位寄存单元SR(n-1)工作在正向扫描方式的时序图。一帧图像显示时间(1frame)包括第一阶段T1、第二阶段T2、第三阶段T3、第四阶段T4及第五阶段T5。
在第一阶段T1为初始阶段,第二时钟信号CKV2和第四时钟信号CKV4在第一阶段T1内同时处于高电平,以使得第N-1级的移位寄存单元SR(n-1)的处于初始阶段。
在第二阶段T2(预充电阶段),第二时钟信号CKV2处于低电平,第四时钟信号CKV4处于低电平,第N-2级的移位寄存单元SR(n-2)的输出端Gout(n-2)输出高电平,第N级的移位寄存单元SRn的输出端Gout(n)输出低电平。第一开关晶体管M3导通,第一电容C1充电。上拉晶体管M1导通,使得第N-1级的移位寄存单元SR(n-1)的输出端Gout(n-1)根据第二时钟信号CKV2输出低电平。
在第三阶段T3,第二时钟信号CKV2处于高电平,第四时钟信号CKV4处于低电平,第N-2级的移位寄存单元SR(n-2)的输出端Gout(n-2)输出低电平,第N级的移位寄存单元SRn的输出端Gout(n)输出低电平。上拉晶体管M1导通,以使得第N-1级的移位寄存单元SR(n-1)的输出端Gout(n-1)根据第二时钟信号CKV2输出高电平。
在第四阶段T4(重置阶段),第二时钟信号CKV2处于低电平,第四时钟信号CKV4处于低电平,第N-2级的移位寄存单元SR(n-2)的输出端Gout(n-2)输出低电平,第N级的移位寄存单元SRn的输出端Gout(n)输出高电平。第二开关晶体管M4及第五开关晶体管M7导通,使得上拉晶体管M1导通,进而第N-1级的移位寄存单元SR(n-1)的输出端Gout(n-1)根据第二时钟信号CKV2输出低电平,以重置移位寄存单元SR(n-1)。同时,下拉晶体管M2、第一开关晶体管M3、第三开关晶体管M5、第四开关晶体管M6及第六开关晶体管M8截止。
在第四阶段T5,第二时钟信号CKV2处于低电平,第四时钟信号CKV4处于高电平,第N-2级的移位寄存单元SR(n-2)的输出端Gout(n-2)输出低电平,第N级的移位寄存单元SRn的输出端Gout(n)输出低电平。第三开关晶体管M5和第六开关晶体管M8导通,上拉晶体管M1截止,下拉晶体管M2导通,以使得第N-1级的移位寄存单元SR(n-1)的输出端Gout(n-1)输出低电平,以避免第N-1级的移位寄存单元SR(n-1)的输出端Gout(n-1)输出错误信号。第一开关晶体管M3、第二开关晶体管M4、及第五开关晶体管M7截止导通,上拉晶体管M1、第一开关晶体管M3、第二开关晶体管M4、第四开关晶体管M6及第五开关晶体管M7截止。
基于上述结构的双向移位寄存器,双向移位寄存器可选择地在正向扫描方式和反向扫描方式之间切换,提高双向移位寄存器的灵活性。在一帧时间内通过四个时钟信号控制扫描驱动电路,可降低功耗。同时,通过设置下拉模块,可在重置后控制下拉晶体管导通,避免移位寄存单元输出错误信号。
本技术领域的普通技术人员应当认识到,以上的实施方式仅是用来说明本发明,而并非用作为对本发明的限定,只要在本发明的实质精神范围之内,对以上实施例所作的适当改变和变化都落在本发明要求保护的范围之内。

Claims (10)

1.一种双向移位寄存器,用于提供扫描信号给扫描线;所述双向移位寄存器接收时序控制器输出的四个时钟信号;所述四个时钟信号按照排列顺序依次移位;其特征在于:所述双向移位寄存器可选择地在正向扫描方式和反向扫描方式之间切换;所述双向移位寄存器包括多个级联连接的移位寄存单元;每个所述移位寄存单元对应连接一条所述扫描线;每个所述移位寄存单元受控于两个不相邻的时钟信号,且所述两个时钟信号之间间隔一个时钟周期;所述移位寄存单元包括上拉晶体管、下拉晶体管及下拉模块;所述移位寄存单元可在一帧图像显示时间内进行重置;所述下拉模块在所述移位寄存单元重置后控制所述下拉晶体管导通,以防止所述移位寄存单元的输出错误信号。
2.如权利要求1所述的双向移位寄存器,其特征在于:每个所述移位寄存单元接收前面两级所述移位寄存单元输出的信号作为复位信号,并输出信号给后面两级所述移位寄存单元作为预充电信号。
3.如权利要求2所述的双向移位寄存器,其特征在于:所述移位寄存单元还包括第一开关晶体管、第二开关晶体管、第三开关晶体管、第四开关晶体管、第五开关晶体管、第六开关晶体管、第七开关晶体管、第一电容及第二电容;在所述移位寄存器进行反向扫描时,所述第一开关晶体管根据接收到的信号对第一电容进行预充电;所述第三开关晶体管在所述重置阶段控制所述下拉晶体管导通,以防止所述移位寄存单元输出错误信号;所述第五开关晶体管在所述重置阶段根据后一级移位寄存单元的信号重置移位寄存单元;所述第一开关晶体管的栅极接收所述前面一级移位寄存单元电性连接,所述第一开关晶体管的漏极与上拉晶体管的栅极电性连接,所述第一开关晶体管的源极与栅极电性连接;所述第三开关晶体管的栅极与前面第二级移位寄存单元电性连接,所述第三开关晶体管的漏极与所述下拉晶体管的栅极电性连接,所述第三开关晶体管的源极与栅极电性连接;所述第五开关晶体管的栅极与前面一级移位寄存单元电性连接,所述第五开关晶体管的漏极接地,所述第五开关晶体管的源极与所述下拉晶体管的栅极电性连接。
4.如权利要求3所述的双向移位寄存器,其特征在于:在所述移位寄存器进行正向扫描时,所述第二开关晶体管根据接收到的信号对第一电容进行预充电;所述第四开关晶体管在所述重置阶段控制所述下拉晶体管导通,以防止所述移位寄存单元输出错误信号;所述第六开关晶体管在所述重置阶段根据后一级移位寄存单元的信号进行重置;所述第二开关晶体管的栅极接收所述后面一级移位寄存单元电性连接,所述第一开关晶体管的漏极与上拉晶体管的栅极电性连接,所述第一开关晶体管的源极与栅极电性连接;所述第三开关晶体管的栅极与后面第二级移位寄存单元电性连接,所述第三开关晶体管的漏极与所述下拉晶体管的栅极电性连接,所述第三开关晶体管的源极与栅极电性连接;所述第五开关晶体管的栅极与后面一级移位寄存单元电性连接,所述第五开关晶体管的漏极接地,所述第五开关晶体管的源极与所述下拉晶体管的栅极电性连接。
5.如权利要求3所述的双向移位寄存器,其特征在于:所述第三开关晶体管和第四开关晶体管组成所述下拉模块;所述第三开关晶体管受控于位于所述移位寄存单元前面两级的移位寄存单元;所述第四开关晶体管受控于位于所述移位寄存单元后面两级的移位寄存单元。
6.如权利要求1所述的双向移位寄存器,其特征在于:每个所述移位寄存单元接收与前面一级所述移位寄存单元输出的信号作为复位信号,并输出信号给后面一级所述移位寄存单元作为预充电信号。
7.如权利要求6所述的双向移位寄存器,其特征在于:所述移位寄存单元还包括第一开关晶体管、第二开关晶体管、第三开关晶体管、第四开关晶体管、第五开关晶体管、第六开关晶体管及第一电容;在所述移位寄存器进行反向扫描时,所述第一开关晶体管根据接收到的信号对第一电容进行预充电;所述第三开关晶体管在所述重置阶段控制所述下拉晶体管导通;所述第四开关晶体管在所述重置阶段根据前面一级移位寄存单元的信号进行重置,以防止所述移位寄存单元输出错误信号;所述第一开关晶体管的栅极与前一级移位寄存单元电性连接,所述第一开关晶体管的漏极与所述上拉晶体管的栅极电性连接,所述第一开关晶体管的源极与栅极电性连接;所述第三开关晶体管的栅极接收其中一个所述时钟信号;所述第三开关晶体管的漏极与所述下拉晶体管的栅极电性连接,所述第三开关晶体管的源极与所述第三开关晶体管的栅极电性连接;所述第四开关晶体管的栅极与所述前面一级移位寄存单元电性连接,所述第四开关晶体管的漏极接地,所述第四开关晶体管的源极与所述下拉晶体管的栅极电性连接。
8.如权利要求7所述的双向移位寄存器,其特征在于:在所述移位寄存器进行正向扫描时,所述第二开关晶体管根据接收到的信号对第一电容进行预充电;所述第三开关晶体管在所述重置阶段所述下拉晶体管导通,以防止所述移位寄存单元输出错误信号;所述第五开关晶体管在所述重置阶段根据后面一级移位寄存单元的信号进行重置;所述第二开关晶体管的栅极与所述后面一级移位寄存单元电性连接,所述第二开关晶体管的漏极与所述上拉晶体管的栅极电性连接,所述第二开关晶体管的源极与栅极电性连接;所述第五开关晶体管的栅极与所述后面一级移位寄存单元电性连接,所述第五开关晶体管的漏极接地,所述第五开关晶体管的源极与所述下拉晶体管的栅极电性连接。
9.如权利要求7所述的双向移位寄存器,其特征在于:所述第三开关晶体管与所述第六晶体管受控于相同的时钟信号;所述第六晶体管的栅极接收其中一个所述时钟信号,所述第六晶体管的漏极接地,所述第六晶体管的源极与所述上拉晶体管的栅极电性连接。
10.一种显示驱动系统,包括时序控制器、数据驱动电路以及扫描驱动电路,所述扫描驱动电路包括双向移位寄存器;其特征在于:所述双向移位寄存器采用权利要求1-9项任意一项所述的双向移位寄存器。
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