CN104617151B - 低温多晶硅薄膜晶体管及制作方法、阵列基板及显示装置 - Google Patents
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Abstract
本发明提供了一种低温多晶硅薄膜晶体管及制作方法、阵列基板及显示装置,属于显示技术领域。其中,低温多晶硅薄膜晶体管的制作方法包括:利用低温多晶硅薄膜形成包括源区和漏区的有源层,所述源区用于与薄膜晶体管的源电极相接触,所述漏区用于与薄膜晶体管的漏电极相接触;在所述源区和漏区的低温多晶硅薄膜表面形成非晶硅层;对表面形成有所述非晶硅层的低温多晶硅薄膜进行离子注入。本发明的技术方案能够减少沟道效应、使得离子注入的深度均匀性较佳,薄膜晶体管的阈值电压的均匀性较好,并实现源漏超浅结。
Description
技术领域
本发明涉及显示技术领域,特别是指一种低温多晶硅薄膜晶体管及制作方法、阵列基板及显示装置。
背景技术
有机发光显示器(OLED)由于具有自主发光、快速响应、轻薄、低功耗并可实现柔性显示等诸多优点而备受关注,被认为是下一代的平板显示技术。目前,OLED技术已逐步应用于各种电子产品中,其中有源矩阵有机发光显示屏(AMOLED)凭借高画质、移动图像响应时间短、低功耗、宽视角及超轻超薄等优点而成为OLED发展的主要趋势。
目前AMOLED背板技术中多采用多晶硅薄膜晶体管,多晶硅薄膜晶体管具有消耗功率小且电子迁移率大等优点。早期的多晶硅薄膜晶体管的制程温度高达摄氏1000℃,因此基板材质的选择受到大幅的限制,近来由于激光的发展,制程温度可降至摄氏600℃以下,利用此种制程方式所得的多晶硅薄膜晶体管又被称为低温多晶硅薄膜晶体管(LTPS TFT)。
在现有低温多晶硅薄膜晶体管的制程中,其中一个步骤是在基板上形成一层多晶硅薄膜,后续制程会基于该多晶硅薄膜形成薄膜晶体管的源区/漏区与沟道区,为了提高薄膜晶体管的性能,需要对源区/漏区的多晶硅薄膜进行离子注入,如图1和图2所示,现有对多晶硅薄膜进行离子注入时,离子直接注入多晶硅薄膜表面,由于多晶硅中晶格原子的排列是规则的,因此会存在沟道效应,导致离子注入的深度不均匀,进而引起薄膜晶体管的阈值电压(Vth)的均匀性较差,且不能实现源漏超浅结。
发明内容
本发明要解决的技术问题是提供一种低温多晶硅薄膜晶体管及制作方法、阵列基板及显示装置,能够减少沟道效应、使得离子注入的深度均匀性较佳,进而使薄膜晶体管的阈值电压的均匀性较好,并实现源漏超浅结。
为解决上述技术问题,本发明的实施例提供技术方案如下:
一方面,提供一种低温多晶硅薄膜晶体管的制作方法,包括:
利用低温多晶硅薄膜形成包括源区和漏区的有源层,所述源区用于与薄膜晶体管的源电极相接触,所述漏区用于与薄膜晶体管的漏电极相接触;
在所述源区和漏区的低温多晶硅薄膜表面形成非晶硅层;
对表面形成有所述非晶硅层的低温多晶硅薄膜进行离子注入。
进一步地,所述在所述源区和漏区的低温多晶硅薄膜表面形成非晶硅层包括:
对所述源区和漏区的低温多晶硅薄膜的表面进行非晶化处理,在所述低温多晶硅薄膜表面形成所述非晶硅层。
进一步地,对所述低温多晶硅薄膜的表面进行非晶化处理包括:
向所述低温多晶硅薄膜表面注入非晶化材料,使得所述低温多晶硅薄膜表面的多晶硅处于非晶化状态,形成所述非晶硅层。
进一步地,所述非晶化材料为Si,Ge,C或Ar。
进一步地,所述对表面形成有所述非晶硅层的低温多晶硅薄膜进行离子注入包括:
以薄膜晶体管的栅电极为掩膜板,对表面形成有所述非晶硅层的低温多晶硅薄膜进行离子注入。
进一步地,所述对表面形成有所述非晶硅层的低温多晶硅薄膜进行离子注入之后还包括:
去除所述源区和漏区的非晶硅层。
进一步地,所述非晶硅层的厚度为
本发明实施例还提供了一种低温多晶硅薄膜晶体管,为采用上述的方法制作。
本发明实施例还提供了一种阵列基板,包括形成在衬底基板上的上述的低温多晶硅薄膜晶体管。
本发明实施例还提供了一种显示装置,包括上述的阵列基板。
本发明的实施例具有以下有益效果:
上述方案中,在对源区和漏区的低温多晶硅薄膜进行离子注入之前,在低温多晶硅薄膜表面形成非晶硅层,由于非晶硅中的晶格原子排列是不规则的,因此在之后对表面形成有非晶硅层的低温多晶硅薄膜进行离子注入时,能够有效地减少沟道效应、使得离子注入的深度均匀性较佳,进而使薄膜晶体管的阈值电压的均匀性较好,并实现源漏超浅结。
附图说明
图1为现有技术对低温多晶硅薄膜进行离子注入的示意图;
图2为现有技术掺杂原子在低温多晶硅薄膜中的分布示意图;
图3为本发明实施例对低温多晶硅薄膜进行离子注入的示意图;
图4为本发明实施例掺杂原子在低温多晶硅薄膜中的分布示意图。
附图标记
1衬底基板 2缓冲层 3低温多晶硅薄膜
4栅绝缘层 5非晶硅层
具体实施方式
为使本发明的实施例要解决的技术问题、技术方案和优点更加清楚,下面将结合附图及具体实施例进行详细描述。
本发明的实施例提供一种低温多晶硅薄膜晶体管及制作方法、阵列基板及显示装置,能够减少沟道效应、使得离子注入的深度均匀性较佳,进而使薄膜晶体管的阈值电压的均匀性较好,并实现源漏超浅结。
实施例一
本实施例提供了一种低温多晶硅薄膜晶体管的制作方法,包括:
利用低温多晶硅薄膜形成包括源区和漏区的有源层,所述源区用于与薄膜晶体管的源电极相接触,所述漏区用于与薄膜晶体管的漏电极相接触;
在所述源区和漏区的低温多晶硅薄膜表面形成非晶硅层;
对表面形成有所述非晶硅层的低温多晶硅薄膜进行离子注入。
本实施例在对源区和漏区的低温多晶硅薄膜进行离子注入之前,在低温多晶硅薄膜表面形成非晶硅层,由于非晶硅中的晶格原子排列是不规则的,因此在之后对表面形成有非晶硅层的低温多晶硅薄膜进行离子注入时,能够有效地减少沟道效应、使得离子注入的深度均匀性较佳,进而使薄膜晶体管的阈值电压的均匀性较好,并实现源漏超浅结。
进一步地,所述在所述源区和漏区的低温多晶硅薄膜表面形成非晶硅层包括:
对所述源区和漏区的低温多晶硅薄膜的表面进行非晶化处理,在所述低温多晶硅薄膜表面形成所述非晶硅层。具体地,所述非晶硅层的厚度可以为
进一步地,对所述低温多晶硅薄膜的表面进行非晶化处理包括:
向所述低温多晶硅薄膜表面注入非晶化材料,使得所述低温多晶硅薄膜表面的多晶硅处于非晶化状态,形成所述非晶硅层。具体地,所述非晶化材料可以为Si,Ge,C或Ar。
进一步地,所述对表面形成有所述非晶硅层的低温多晶硅薄膜进行离子注入包括:
以薄膜晶体管的栅电极为掩膜板,对表面形成有所述非晶硅层的低温多晶硅薄膜进行离子注入,注入的离子可以为硼离子也可以为磷离子,离子注入到多晶硅有源层后,使得多晶硅半导体层变为导体层。
由于非晶硅的导电性能没有多晶硅好,因此,为了保证薄膜晶体管的性能,还需要去除源区和漏区的非晶硅层,进一步地,所述对表面形成有所述非晶硅层的低温多晶硅薄膜进行离子注入之后还包括:
去除所述源区和漏区的非晶硅层。
实施例二
本实施例还提供了一种低温多晶硅薄膜晶体管,为采用上述的方法制得。
本实施例的低温多晶硅薄膜晶体管中,有源层的源区/漏区离子注入的深度均匀性较佳,薄膜晶体管的阈值电压的均匀性较好,并能够实现源漏超浅结。
实施例三
本发明实施例还提供了一种阵列基板,包括形成在衬底基板上的如上所述的低温多晶硅薄膜晶体管。
实施例四
本发明实施例还提供了一种显示装置,包括如上所述的阵列基板。所述显示装置可以为:液晶面板、液晶电视、液晶显示器、OLED显示面板、OLED显示器、数码相框、手机、平板电脑等任何具有显示功能的产品或部件。
实施例五
如图1所示,现有顶栅型的低温多晶硅薄膜晶体管的制作过程中,先提供一衬底基板1,在衬底基板1上依次形成缓冲层2、低温多晶硅薄膜3、栅绝缘层4,对低温多晶硅薄膜3进行构图,形成包括源区、漏区和沟道区的有源层,为了提高薄膜晶体管的性能,需要对源区、漏区进行离子注入。在进行离子注入时,如图2所示,由于多晶硅中的晶格原子排列是规则的,因此会产生沟道效应,即不在晶格原子排列方向上的掺杂原子被晶格原子所阻挡,注入的深度较小;而另外一些掺杂原子将沿着晶格原子的排列方向前进,不会被晶格原子阻挡,注入的深度较大,导致离子注入的深度不均匀,进而引起薄膜晶体管的阈值电压的均匀性较差,且不能实现源漏超浅结。
为了解决上述问题,本实施例提供了一种低温多晶硅薄膜晶体管的制作方法,包括:
步骤1、提供一衬底基板1,在衬底基板1上形成一缓冲层2;
其中,衬底基板1可以为玻璃基板或石英基板;缓冲层2可以为单层结构或者双层结构,在缓冲层为双层结构时,缓冲层的上层为SiO2薄膜,缓冲层的下层为SiNx薄膜,其中SiNx薄膜的厚度可以为SiO2薄膜的厚度可以为在缓冲层为单层结构时,缓冲层为SiNx薄膜或SiO2薄膜,其中SiNx薄膜的厚度可以为SiO2薄膜的厚度可以为
步骤2、在缓冲层2上形成低温多晶硅薄膜3;
具体地,可以在缓冲层2上沉积一层非晶硅材料层,非晶硅材料层的厚度优选为其厚度亦可根据需要设置为其它值,工艺条件具体可以为:反应气体流量比为SiH4/H2=100~250sccm/500~1250sccm,射频功率为80~120W,沉积腔内压强为1800~2200mtorr及温度为380~400℃。
之后对经过上述步骤的衬底基板进行准分子激光退火,完成非晶硅至多晶硅的晶化过程,其中激光脉冲频率可以为500Hz,激光能量密度可以为350-450mJ/cm2。
步骤3、对低温多晶硅薄膜3进行构图,形成包括源区、漏区和沟道区的有源层;
在低温多晶硅薄膜3表面涂覆光刻胶,采用掩膜板对光刻胶进行曝光,使光刻胶形成光刻胶未保留区域和光刻胶保留区域,其中,光刻胶保留区域对应于源区、漏区和沟道区的图形所在区域,光刻胶未保留区域对应于上述图形以外的区域;进行显影处理,光刻胶未保留区域的光刻胶被完全去除,光刻胶保留区域的光刻胶厚度保持不变,通过刻蚀工艺完全刻蚀掉光刻胶未保留区域的低温多晶硅薄膜3,剥离剩余的光刻胶,形成包括源区、漏区和沟道区的有源层,源区用于与薄膜晶体管的源电极相接触,漏区用于与薄膜晶体管的漏电极相接触。
步骤4、在形成有有源层的衬底基板上形成栅绝缘层4,并在栅绝缘层4上形成栅电极;
具体地,可以在沟道区上方沉积厚度约为的栅绝缘层4,栅绝缘层4包括有对应源区和漏区的过孔。其中,栅绝缘层材料可以选用氧化物、氮化物或者氮氧化物,栅绝缘层可以为单层、双层或多层结构。具体地,栅绝缘层可以是SiNx,SiOx或Si(ON)x。
之后在栅绝缘层4上沉积一层厚度为的栅金属层,栅金属层可以是Cu,Al,Ag,Mo,Cr,Nd,Ni,Mn,Ti,Ta,W等金属以及这些金属的合金,栅金属层可以为单层结构或者多层结构,多层结构比如Cu\Mo,Ti\Cu\Ti,Mo\Al\Mo等。在栅金属层上涂覆一层光刻胶,采用掩膜板对光刻胶进行曝光,使光刻胶形成光刻胶未保留区域和光刻胶保留区域,其中,光刻胶保留区域对应于栅电极的图形所在区域,光刻胶未保留区域对应于上述图形以外的区域;进行显影处理,光刻胶未保留区域的光刻胶被完全去除,光刻胶保留区域的光刻胶厚度保持不变;通过刻蚀工艺完全刻蚀掉光刻胶未保留区域的栅金属薄膜,剥离剩余的光刻胶,形成栅电极的图形。
步骤5、如图3a所示,在源区和漏区的低温多晶硅薄膜3表面形成非晶硅层5;
具体地,可以通过栅绝缘层的过孔向源区和漏区的低温多晶硅薄膜3表面注入低剂量低能量的非晶化材料,非晶化材料可以为Si,Ge,C或Ar,使得源区和漏区的低温多晶硅薄膜3表面的多晶硅处于非晶化状态,形成非晶硅层5,非晶硅层5的厚度可以为
步骤6、如图3b所示,对表面形成有非晶硅层5的低温多晶硅薄膜3进行离子注入,之后去除非晶硅层5;
如图4所示,非晶硅层5中的晶格原子排列是不规则的,因此在对表面形成有非晶硅层5的低温多晶硅薄膜3进行离子注入时,由于晶格原子没有固定的排列方向,绝大部分掺杂原子将被晶格原子所阻挡,使得离子注入的深度均匀性较佳。在离子注入过程中以栅电极为掩膜板,离子注入到多晶硅有源层后,使得多晶硅半导体层变为导体层。注入的离子可以为硼(B)离子,反应气体可以为浓度为1-10%的B2H6,当然,根据薄膜晶体管类型的需要,注入的离子也可以为磷(P)离子,在此不做限定,本发明实施例可采用现有已知的任一源漏区掺杂工艺。
由于非晶硅的导电性能没有多晶硅好,因此,为了保证薄膜晶体管的性能,还需要去除源区和漏区的非晶硅层,在离子注入后通过刻蚀工艺去除低温多晶硅薄膜3表面的非晶硅层5。
步骤7、在栅电极上方形成层间绝缘层,并在层间绝缘层上形成源电极和漏电极。
具体地,可以在栅电极上方沉积SiNx或SiO2形成层间绝缘层,层间绝缘层包括有对应源区和漏区的过孔,之后在层间绝缘层上沉积一层厚度约为的源漏金属层,源漏金属层可以是Cu,Al,Ag,Mo,Cr,Nd,Ni,Mn,Ti,Ta,W等金属以及这些金属的合金。源漏金属层可以是单层结构或者多层结构,多层结构比如Cu\Mo,Ti\Al\Ti,Ti/TiN/Al/TiN,Mo\Al\Mo等。在源漏金属层上涂覆一层光刻胶,采用掩膜板对光刻胶进行曝光,使光刻胶形成光刻胶未保留区域和光刻胶保留区域,其中,光刻胶保留区域对应于源电极、漏电极的图形所在区域,光刻胶未保留区域对应于上述图形以外的区域;进行显影处理,光刻胶未保留区域的光刻胶被完全去除,光刻胶保留区域的光刻胶厚度保持不变;通过刻蚀工艺完全刻蚀掉光刻胶未保留区域的源漏金属薄膜,剥离剩余的光刻胶,形成源电极、漏电极的图形,源电极通过贯穿栅绝缘层和层间绝缘层的过孔与源区的有源层连接,漏电极通过贯穿栅绝缘层和层间绝缘层的过孔与漏区的有源层连接。
通过上述步骤形成了顶栅型的低温多晶硅薄膜晶体管,本实施例在对源区和漏区的低温多晶硅薄膜进行离子注入之前,在源区和漏区的低温多晶硅薄膜表面形成非晶硅层,由于非晶硅中的晶格原子排列是不规则的,因此在之后对表面形成有非晶硅层的低温多晶硅薄膜进行离子注入时,能够有效地减少沟道效应、使得离子注入的深度均匀性较佳,进而使薄膜晶体管的阈值电压的均匀性较好,并实现源漏超浅结。
在本发明各方法实施例中,所述各步骤的序号并不能用于限定各步骤的先后顺序,对于本领域普通技术人员来讲,在不付出创造性劳动的前提下,对各步骤的先后变化也在本发明的保护范围之内。
以上所述是本发明的优选实施方式,应当指出,对于本技术领域的普通技术人员来说,在不脱离本发明所述原理的前提下,还可以作出若干改进和润饰,这些改进和润饰也应视为本发明的保护范围。
Claims (8)
1.一种低温多晶硅薄膜晶体管的制作方法,其特征在于,包括:
利用低温多晶硅薄膜形成包括源区和漏区的有源层,所述源区用于与薄膜晶体管的源电极相接触,所述漏区用于与薄膜晶体管的漏电极相接触;
在所述源区和漏区的低温多晶硅薄膜表面形成非晶硅层;
以薄膜晶体管的栅电极为掩膜板,对表面形成有所述非晶硅层的低温多晶硅薄膜进行离子注入;
所述对表面形成有所述非晶硅层的低温多晶硅薄膜进行离子注入之后还包括:
去除所述源区和漏区的非晶硅层。
2.根据权利要求1所述的低温多晶硅薄膜晶体管的制作方法,其特征在于,所述在所述源区和漏区的低温多晶硅薄膜表面形成非晶硅层包括:
对所述源区和漏区的低温多晶硅薄膜的表面进行非晶化处理,在所述低温多晶硅薄膜表面形成所述非晶硅层。
3.根据权利要求2所述的低温多晶硅薄膜晶体管的制作方法,其特征在于,对所述低温多晶硅薄膜的表面进行非晶化处理包括:
向所述低温多晶硅薄膜表面注入非晶化材料,使得所述低温多晶硅薄膜表面的多晶硅处于非晶化状态,形成所述非晶硅层。
4.根据权利要求3所述的低温多晶硅薄膜晶体管的制作方法,其特征在于,所述非晶化材料为Si,Ge,C或Ar。
5.根据权利要求1-4中任一项所述的低温多晶硅薄膜晶体管的制作方法,其特征在于,所述非晶硅层的厚度为
6.一种低温多晶硅薄膜晶体管,其特征在于,为采用如权利要求1-5中任一项所述的方法制作。
7.一种阵列基板,其特征在于,包括形成在衬底基板上的如权利要求6所述的低温多晶硅薄膜晶体管。
8.一种显示装置,其特征在于,包括如权利要求7所述的阵列基板。
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CN102403210A (zh) * | 2011-11-29 | 2012-04-04 | 无锡中微晶园电子有限公司 | 预非晶化注入的高温Ti自对准硅化物工艺 |
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