WO2020259574A1 - 阵列基板行驱动电路单元与其驱动电路及液晶显示面板 - Google Patents

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Definitions

  • the voltage dividing module 40 is electrically connected to the pull-up module 20, and is configured to connect the pull-up control signal Q(N) with the current-level array substrate row drive circuit unit in the pull-down module 30 When the row scan signal G(N) is pulled down to the low level at the same time, the falling edge of the pull down is increased.
  • the pull-up module 20 is electrically connected to the pull-up control module 10, and receives the pull-up control signal Q(N) and the clock signal HCK output by the pull-up control module 10, and outputs according to the pull-up control signal Q(N) and the clock signal HCK
  • the gate is electrically connected to the pull-up control signal Q(N) output by the current-stage pull-up control module 10, and the drain of the sixth field effect transistor T6 outputs the row scan signal G(N) of the current-stage array substrate row drive circuit unit. ).
  • the array substrate row driving circuit unit includes two pull-down modules 30, and both pull-down modules 30 are connected to the pull-up control module 10 and the The pull-up module 20 is electrically connected.

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Abstract

一种阵列基板行驱动电路单元与其驱动电路及液晶显示面板，其中，阵列基板行驱动电路单元包括：上拉控制模块（10）；上拉模块（20）；下拉模块（30），下拉模块（30）与上拉控制模块（10）、上拉模块（20）连接，设置为在接收行扫描信号（G(N)）时，根据直流低压信号（VSS）将上拉控制信号（Q(N)）与当前级的阵列基板行驱动电路单元的行扫描信号（G(N)）同时下拉至低电平；分压模块（40），分压模块（40）与上拉模块（20）电性连接，设置为在下拉模块（30）将上拉控制信号（Q(N)）与当前级阵列基板行驱动电路单元的行扫描信号（G(N)）同时下拉至低电平时，增加下拉时的下降沿。

Description

阵列基板行驱动电路单元与其驱动电路及液晶显示面板
本申请要求：2019年06月27日申请的、申请号为201910573179.2、名称为“阵列基板行驱动电路单元与其驱动电路及液晶显示面板”的中国专利申请的优先权，在此将其引入作为参考。
技术领域
本申请涉及显示技术领域，特别涉及一种阵列基板行驱动电路单元与其驱动电路及液晶显示面板。
背景技术
上述陈述仅提供与本申请有关的信息，而不必然地构成现有技术。
GOA技术(Gate Driver on Array)即阵列基板行驱动技术，是运用液晶显示面板的原有阵列制程将水平扫描线的驱动电路制作在显示区周围的基板上，使之能替代外接集成电路板(Integrated Circuit，IC)来完成水平扫描线的驱动；GOA技术能减少外接IC的焊接(bonding)工序，并能有机会提升产能并降低产品成本，而且可以使液晶显示面板更适合制作窄边框或无边框的显示产品。
相关技术中的部分设置为栅极驱动的外接集成电路(Gate IC)能够输出具有两个下降沿的输出信号波形，以降低馈通电压，但对于GOA电路并不适用；相关技术中的GOA电路，只能输出具有一个下降沿的输出信号，TFT(Thin Film Transistor，场效应晶体管)的栅极关闭前后由恒压高电位(VGH)直接降低至恒压低电位(VGL)，且液晶显示面板的像素充电时的馈通电压不能降低，不利于提升液晶面板的显示均一性。
发明概述
技术问题
问题的解决方案
技术解决方案
本申请提出的一种阵列基板行驱动电路单元，其中，阵列基板行驱动电路由多级阵列基板行驱动电路单元级联构成，所述阵列基板行驱动电路单元包括：
上拉控制模块，设置为接收直流高压信号与级传信号，并输出上拉控制信号；
上拉模块，所述上拉模块与所述上拉控制模块电性连接，设置为接收所述上拉控制信号及高频时钟信号，并输出当前级的阵列基板行驱动电路单元的行扫描信号；
下拉模块，所述下拉模块与所述上拉控制模块、所述上拉模块连接，设置为接收行扫描信号，并根据直流低压信号将所述上拉控制信号与当前级的阵列基板行驱动电路单元的行扫描信号下拉至低电平；以及
分压模块，所述分压模块与所述上拉模块电性连接，设置为在所述下拉模块将所述上拉控制信号与所述当前级阵列基板行驱动电路单元的行扫描信号同时下拉至低电平时，增加下拉时的下降沿。
本申请还提出一种阵列基板行驱动电路，所述阵列基板行驱动电路包括多级阵列基板行驱动电路单元，多级所述阵列基板行驱动电路单元级联构成所述阵列基板行驱动电路，每一所述阵列基板行驱动电路单元对显示区域内的对应级的水平扫描线充电，该每一所述阵列基板行驱动电路单元包括：
上拉控制模块，设置为在接收到直流高压信号与级传信号时，输出上拉控制信号；
上拉模块，所述上拉模块与所述上拉控制模块电性连接，设置为在接收到所述上拉控制信号及时钟信号时，输出当前级的阵列基板行驱动电路单元的行扫描信号；
多个下拉模块，每个下拉模块分别与低频信号、所述上拉控制模块、所述上拉模块以及直流低压信号连接，所述多个下拉模块设置为在接收行扫描信号时，根据直流低压信号将所述上拉控制信号与当前级的阵列基板行驱动电路单元的行扫描信号同时下拉至低电平；以及
分压模块，所述分压模块与所述上拉模块电性连接，设置为在所述下拉模块将所述上拉控制信号与所述当前级阵列基板行驱动电路单元的行扫描信号同时下拉至低电平时，增加下拉时的下降沿。
本申请还提出一种液晶显示面板，所述液晶显示面板包括集成电路以及如上所述的阵列基板行驱动电路，所述集成电路的输出端与所述阵列基板行驱动电路 的电路单元中的第一场效应晶体管的栅极电性连接，所述阵列基板行驱动电路包括多级阵列基板行驱动电路单元，多级所述阵列基板行驱动电路单元级联构成阵列基板行驱动电路，所述阵列基板行驱动电路单元对显示区域内的对应级别的水平扫描线充电，所述阵列基板行驱动电路单元包括：
上拉控制模块，设置为在接收到直流高压信号与级传信号时，输出上拉控制信号；
上拉模块，所述上拉模块与所述上拉控制模块电性连接，设置为在接收到所述上拉控制信号及高频时钟信号时，输出当前级的阵列基板行驱动电路单元的行扫描信号；
多个下拉模块，每个下拉模块分别与低频信号、所述上拉控制模块、所述上拉模块以及直流低压信号，设置为在接收行扫描信号时，根据直流低压信号将所述上拉控制信号与当前级的阵列基板行驱动电路单元的行扫描信号同时下拉至低电平；以及
分压模块，所述分压模块与所述上拉模块电性连接，设置为在所述下拉模块将所述上拉控制信号与所述当前级阵列基板行驱动电路单元的行扫描信号同时下拉至低电平时，增加下拉时的下降沿。
本申请技术方案中下拉模块在接收行扫描信号，根据直流低压信号将上拉控制信号与当前级的阵列基板行驱动电路单元的行扫描信号同时下拉至低电平，在下拉的过程中，增加分压模块，通过分压模块分压功能，以使下拉模块将上拉控制信号与当前级阵列基板行驱动电路单元的行扫描信号同时下拉至低电平时，增加下降沿的数目，使所述行扫描信号呈阶梯状下降，进而当前级阵列基板行驱动电路单元输出的波形具有两个下降沿，以降低高电位与低电位之间的差值，以降低画素的馈通电压，从而改善液晶显示面板的均一性。
发明的有益效果
对附图的简要说明
附图说明
为了更清楚地说明本申请实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的 附图仅仅是本申请的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图示出的结构获得其他的附图。
图1为本申请阵列基板行驱动电路单元的模块示意图；
图2为本申请阵列基板行驱动电路单元的电路示意图；
图3为本申请阵列基板行驱动电路单元的时序图。
本申请目的的实现、功能特点及优点将结合实施例，参照附图做进一步说明。
发明实施例
本发明的实施方式
下面将结合本申请实施例中的附图，对本申请实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本申请的一部分实施例，而不是全部的实施例。基于本申请中的实施例，本领域普通技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本申请保护的范围。
需要说明，若本申请实施例中有涉及方向性指示(诸如上、下、左、右、前、后......)，则该方向性指示仅用于解释在某一特定姿态(如附图所示)下各部件之间的相对位置关系、运动情况等，如果该特定姿态发生改变时，则该方向性指示也相应地随之改变。
另外，若本申请实施例中有涉及“第一”、“第二”等的描述，则该“第一”、“第二”等的描述仅用于描述目的，而不能理解为指示或暗示其相对重要性或者隐含指明所指示的技术特征的数量。由此，限定有“第一”、“第二”的特征可以明示或者隐含地包括至少一个该特征。另外，各个实施例之间的技术方案可以相互结合，但是必须是以本领域普通技术人员能够实现为基础，当技术方案的结合出现相互矛盾或无法实现时应当认为这种技术方案的结合不存在，也不在本申请要求的保护范围之内。
请结合图1-3，本申请提出一种阵列基板行驱动电路单元，其中，阵列基板行驱动电路由多级阵列基板行驱动电路单元级联构成，所述阵列基板行驱动电路单元包括：
上拉控制模块10，设置为在接收到直流高压信号Vdd与级传信号时，输出上拉控制信号Q(N)；
上拉模块20，所述上拉模块20与所述上拉控制模块10电性连接，设置为在接收到所述上拉控制信号Q(N)及时钟信号HCK时，输出当前级的阵列基板行驱动电路单元的行扫描信号G(N)；
下拉模块30，所述下拉模块30分别与所述上拉控制模块10、所述上拉模块20电性连接，设置为在接收行扫描信号G(N)时，根据直流低压信号VSS将所述上拉控制信号Q(N)与当前级的阵列基板行驱动电路单元的行扫描信号G(N)同时下拉至低电平；以及
分压模块40，所述分压模块40与所述上拉模块20电性连接，设置为在所述下拉模块30将所述上拉控制信号Q(N)与当前级阵列基板行驱动电路单元的行扫描信号G(N)同时下拉至低电平时，增加下拉时的下降沿。
由于阵列基板行驱动电路由多级阵列基板行驱动电路单元级联构成，其中，当前级阵列基板行驱动电路单元对显示区域内的对应级别的水平扫描线充电；如图1和图3所示，上拉控制模块10包括第五场效应晶体管T5，第五场效应晶体管T5的源极与第一阵列基板行驱动电路单元的行扫描信号G(N)Q(N-4)连接，第五场效应晶体管T5的栅极与第一阵列基板行驱动电路单元的级传信号ST(N-4)连接，第五场效应晶体管T5的漏极输出当前级阵列基板行驱动电路单元的上拉控制信号Q(N)。需要注意的是，级传信号是级联的多级阵列基板行驱动电路逐级传递用以开启该阵列基板行驱动电路的信号，从而实现栅极的逐级扫描。在本实施例中，该级传信号是指上一级阵列基板行驱动电路单元传递到当前级陈列基板行驱动电路单元的信号。若当前级阵列基板行驱动电路单元为首级阵列基板行驱动电路单元，则第五场效应晶体管T5的栅极接收初始信号STV，并由该初始信号STV以及其他信号生成第一时钟信号CKV信号、第二时钟信号CKVB，以及改进后STV信号即STVP信号，并输出上拉控制信号Q(N)，参考图3，初始信号STV负责启动首级阵列基板行驱动电路单元；若当前级阵列基板行驱动电路单元不是首级阵列基板行驱动电路单元，则第五场效应晶体管T5的栅极接收第一阵列基板行驱动电路单元的级传信号ST(N-4)，并根据接收的第一阵列基板行驱动电路单元的级传信号ST(N-4)及直流高压信号Vdd，输出当前级阵列基板行驱动电路单元的上拉控制信号Q(N)，当前级阵列基板行驱动电路单元由第一阵列基 板行驱动电路单元的行扫描信号G(N)Q(N-4)及第一阵列基板行驱动电路单元的级传信号ST(N-4)启动，从而实现逐级打开阵列基板行驱动电路，实现行扫描驱动，以使水平扫描线可以被逐级充电。
上拉模块20与上拉控制模块10电性连接，并接收上拉控制模块10输出的上拉控制信号Q(N)与时钟信号HCK，根据上拉控制信号Q(N)与时钟信号HCK输出当前级阵列基板行驱动电路单元的行扫描信号G(N)；上拉模块20包括第六场效应晶体管T6，第六场效应晶体管T6的源极与时钟信号HCK连接，第六场效应晶体管T6的栅极与当前级上拉控制模块10输出的上拉控制信号Q(N)电性连接，第六场效应晶体管T6的漏极输出当前级阵列基板行驱动电路单元的行扫描信号G(N)。
如图1所示，阵列基板行驱动电路单元还包括级传模块60，级传模块60与上拉控制模块10电性连接，级传模块60包括第七场效应晶体管T7，其中，第七场效应晶体管T7的源极连接时钟信号HCK，第七场效应晶体管T7的栅极与上拉模块20的第六场效应晶体管T6相互连接，并同时接入上拉控制模块10输出的上拉控制信号Q(N)，第七场效应晶体管T7的漏极设置为输出当前级阵列基板行驱动电路单元的级传信号ST(N)，第七场效应晶体管T7根据当前级的上拉控制信号Q(N)，将接收的该时钟信号HCK输出成与当前级阵列基板行驱动电路单元的行扫描信号G(N)同步的当前级阵列基板行驱动电路单元的级传信号ST(N)。
下拉模块30分别与上拉控制模块10及上拉模块20电性连接，当下拉模块30接收到第二阵列基板行驱动电路单元Q(N-2)输出的行扫描信号G(N)时，根据直流低压信号VSS将上拉控制模块10输出的上拉控制信号Q(N)与当前级阵列基板行驱动电路单元的行扫描信号G(N)同时下拉至低电平，以使上拉控制模块10输出的上拉控制信号Q(N)与当前级阵列基板行驱动电路单元的行扫描信号G(N)维持在关闭状态；下拉模块30包括第二场效应晶体管T2、第三场效应晶体管T3以及第四场效应晶体管T4，第二场效应晶体管T2的源极、第三场效应晶体管T3的源极以及第四场效应晶体管T4的源极分别连接直流低压信号VSS，第二场效应晶体管T2的栅极、第三场效应晶体管T3的栅极以及第四场效应晶体管T4的栅极相互电性连接，第二场效应晶体管T2的漏极与上拉模块20的输出当前级阵列基板行驱动电路单元的行扫描信号G(N)的一端电性连接，第三场效应晶体管T3的漏极与当 前级的级传模块60输出的级传信号电性连接，第四场效应晶体管T4的漏极与所述上拉控制模块10输出上拉控制信号Q(N)的一端电性连接。
分压模块40与上拉模块20电性连接并与直流低压信号VSS连接，设置为根据下降沿产生信号KF，在下拉模块30将上拉控制信号Q(N)与当前级阵列基板行驱动电路单元的行扫描信号G(N)同时下拉至低电平时，增加下拉行扫描信号时的下降沿的数目，使行扫描信号呈阶梯状下降。图3示例出一种4CLK结构的GOA，输出4行扫描信号，本申请也可以是8CLK结构的GOA，当然也可以应用其他结构的GOA。在本实施例中，其输出的四路行扫描信号1-4均具有两个下降沿，其下降方式呈阶梯状，相较于相关的GOA技术中只含有一个下降沿相比增加了下降沿的个数，该阶梯状的下降方式进一步降低了VGH与VGL之间的差值，以降低画素的馈通电压，从而改善液晶显示面板的均一性；其中，分压模块40包括电子元件与分压元件，该分压元件可为二极管元件；其中该电子元件的第一端设置为接收下降沿产生信号KF，该电子元件的第二端设置为与所述上拉模块20电性连接，以使所述上拉模块20输出的行扫描信号的下降沿增加。该电子元件的第三端设置为经所述分压元件接收直流低压信号VSS，需要说明的是，下降沿产生信号KF为集成电路输出的控制下降沿产生的信号。
需要说明的是，所述第二阵列基板行驱动电路单元为位于所述当前级阵列基板行驱动电路单元上一级的阵列基板行驱动电路单元，所述第一阵列基板行驱动电路单元为位于所述第二阵列基板行驱动电路单元上一级的阵列基板行驱动电路单元。
本实施例技术方案中下拉模块30在接收行扫描信号G(N)，根据直流低压信号VSS将上拉控制信号Q(N)与当前级的阵列基板行驱动电路单元的行扫描信号G(N)同时下拉至低电平，在下拉的过程中，增加分压模块40，通过分压模块40分压功能，以使下拉模块30将上拉控制信号Q(N)与当前级阵列基板行驱动电路单元的行扫描信号G(N)同时下拉至低电平时，增加下降沿的数目，进而当前级阵列基板行驱动电路单元输出的波形具有两个下降沿，以降低高电位与低电位之间的差值，以降低画素的馈通电压，从而改善液晶显示面板的均一性。
在一实施例中，所述电子元件为第一场效应晶体管T1，所述第一场效应晶体管 T1的栅极设置为接收下降沿产生信号KF，所述第一场效应晶体管T1的漏极设置为经所述分压元件接收直流低压信号VSS，所述第一场效应晶体管T1的源极设置为与所述上拉模块20电性连接，以增加所述上拉模块20输出的行扫描信号G(N)的下降沿的数目。
第一场效应晶体管T1在接收到下降沿产生信号KF时，根据下降沿产生信号KF，在下拉模块30将上拉控制信号Q(N)与当前级阵列基板行驱动电路单元的行扫描信号G(N)同时下拉至低电平时，增加下拉时行扫描信号的下降沿的数目；需要说明的是，第一场效应晶体管T1也可为薄膜晶体管，分压元件为二极管，分压元件的正极与第一场效应晶体管T1的漏极连接，所述分压元件的负极接入直流低压信号VSS；由于二极管具有只允许电流有单一方向流过的，若反向是则阻断的技术特点，当输入的下降沿产生信号KF为高电平时，从第一场效应晶体管T1输出的信号为高电平，分压元件才能将第一场效应晶体管T1输出的信号导通输入直流低压信号VSS，而当输入的下降沿产生信号KF为低电平时，第一场效应晶体管T1输出的信号为低电平，二极管无法导通。
在一实施例中，如图1-2所示，所述阵列基板行驱动电路单元包括两个所述下拉模块30，两个所述下拉模块30均与所述上拉控制模块10及所述上拉模块20电性连接。
为了增加元件的使用寿命，通过轮流驱动两个下拉模块30，以减缓元件的受损程度，增加元件的使用寿命；其中，两个下拉模块30内元件的连接数量以及连接方式相同，其连接的不同的是，两个下拉模块30连接的低频信号不同，两个下拉模块30分为第一下拉模块31与第二下拉模块32，第一下拉模块31与第一低频信号LC1连接，且第一下拉模块31同时与上拉控制模块10、上拉模块20以及直流低压信号VSS连接，根据第一低频信号LC1与直流低压信号VSS将上拉控制信号Q(N)与当前级的行扫描信号G(N)维持在关闭状态，第二下拉模块32与第二低频信号LC2连接，且第二下拉模块32同时与上拉控制模块10、上拉模块20以及直流低压信号VSS连接，根据第二低频信号LC2与直流低压信号VSS将上拉控制信号Q(N)与当前级的行扫描信号G(N)维持在关闭状态。
需要说明的是，在第一下拉模块31中，第一低频信号LC1接入时，需流经第九 场效应晶体管T9与第八场效应晶体管体T8，其中，第八场效应晶体管体T8的漏极与所述第二场效应晶体管T2的栅极、所述第三场效应晶体管T3的栅极以及所述第四场效应晶体管T4的栅极相互连接，第九场效应晶体管T9的源极和栅极以及第八场效应晶体管体T8的源极同时接入第一低频信号LC1，第九场效应晶体管T9的漏极与第八场效应晶体管体T8的栅极连接；第二下拉模块32的电路连接方式与第一下拉模块31的电路连接方式相同。
在一实施例中，如图1-2所示，第一下拉模块31还包括第十场效应晶体管T10、第十一场效应晶体管T11、第十二场效应晶体管T12以及第十三场效应晶体管T13，第十场效应晶体管T10的源极、第十一场效应晶体管T11的源极、第十二场效应晶体管T12的源极以及第十三场效应晶体管T13的源极同时连接直流低压信号VSS，第十场效应晶体管T10的栅极与第十一场效应晶体管T11的栅极相互连接，且接入当前级上拉控制单元输出的上拉控制信号Q(N)，第十场效应晶体管T10的漏极与第八场效应晶体管体T8的漏极同时与所述第二场效应晶体管T2的栅极、所述第三场效应晶体管T3的栅极以及所述第四场效应晶体管T4的栅极相互连接，第十一场效应晶体管T11的漏极与第九场效应晶体管T9的漏极连接，第十二场效应晶体管T12的栅极与第十三场效应晶体管T13的栅极相互连接，且接入第二阵列基板行驱动电路单元的上拉控制模块10输出的上拉控制信号Q(N-2)，第十二场效应晶体管T12的漏极与十场效应晶体管的漏极及第八场效应晶体管体T8的漏极相连，第十三场效应晶体管T13的漏极与第十一场效应晶体管T11的漏极及第九场效应晶体管T9的漏极相连。
在一实施例中，所述阵列基板行驱动电路单元还包括：下拉维持模块50，所述下拉维持模块50与所述上拉模块20及所述上拉控制模块10电性连接。
如图1-2所示，下拉维持模块50与上拉控制模块10、上拉模块20以及直流低压信号VSS连接，在接收到第三阵列基板行驱动电路单元的上拉模块输出的行扫描信号G(N+4)时，根据第三阵列基板行驱动电路单元的上拉模块输出的行扫描信号G(N+4)与直流低压信号VSS将当前级的上拉控制信号Q(N)与当前级的行扫描信号G(N)维持在关闭状态。
在一实施例中，下拉维持模块包括第十四场效应晶体管T14与第十五场效应晶 体管T15，第十四场效应晶体管T14的栅极与第十五场效应晶体管T15的栅极相互连接，并接入第三阵列基板行驱动电路单元的上拉模块输出的行扫描信号G(N+4)，第十四场效应晶体管T14的源极与第十五场效应晶体管T15的源极同时接入直流低压信号VSS，第十四场效应晶体管T14的漏极与当前级上拉控制模块10输出的上拉控制信号Q(N)连接，第十五场效应晶体管T15的漏极与当前级上拉模块20输出的行扫描信号G(N)连接。
需要说明的是，第三阵列基板行驱动电路单元为位于当前级阵列基板行驱动电路单元的下一级的阵列基板行驱动电路单元。在一实施例中，如图1-2所示，所述阵列基板行驱动电路单元还包括自举模块70，所述自举模块70的一端与所述上拉控制模块10输出所述上拉控制信号Q(N)的一端电性连接，所述自举模块70的另一端与所述上拉模块20的输出当前级阵列基板行驱动电路电路单元的行扫描信号G(N)的一端电性连接。
自举模块70包括自举电容，自举电容的一端与上拉控制模块10输出所述上拉控制信号Q(N)的一端电性连接，自举电容的另一端与上拉模块20的输出的当前级阵列基板行驱动电路电路单元的行扫描信号G(N)的一端电性连接，自举电容主要设置为维持第六场效应晶体管T6的栅极与源极之间的电压，以稳定第六场效应晶体管T6的输出。
综上所述，本申请提供的阵列基板行驱动电路单元，多级阵列基板行驱动电路单元构成阵列基板行驱动电路，每一阵列基板行驱动电路单元包括：
上拉控制模块，设置为接收直流高压信号与级传信号，及输出上拉控制信号。
上拉模块，所述上拉模块与所述上拉控制模块电性连接，设置为接收所述上拉控制信号与高频时钟信号，及输出行扫描信号；
下拉模块，所述下拉模块分别与所述上拉控制模块、所述上拉模块连接，设置为接收所述行扫描信号，根据直流低压信号将所述上拉控制信号与所述行扫描信号下拉至低电平；以及
分压模块，所述分压模块与所述上拉模块电性连接，设置为在所述下拉模块将所述上拉控制信号与所述行扫描信号下拉至低电平时，增加拉下时的下降沿。
本申请还提出一种阵列基板行驱动电路，所述阵列基板行驱动电路包括多级如 上所述的阵列基板行驱动电路单元，该阵列基板行驱动电路单元的具体电路参照上述实施例，由于本阵列基板行驱动电路采用了上述所有实施例的全部技术方案，因此至少具有上述实施例的技术方案所带来的所有有益效果，在此不再一一赘述，多级所述阵列基板行驱动电路单元级联构成所述阵列基板行驱动电路，相较于相关技术中只有一个下降沿相比，增加了输出的扫描信号下降沿的数目，降低了输出的行扫描信号的高电位VGH与低电位VGL之间的差值，以降低画素的馈通电压，从而改善液晶显示面板的均一性，有利于窄边框的液晶显示面板显示。
请再次结合图1-3，本申请还一种液晶显示面板，所述液晶显示面板包括集成电路以及如上所述的阵列基板行驱动电路，该阵列基板行驱动电路的具体电路参照上述实施例，由于本液晶显示面板采用了上述所有实施例的全部技术方案，因此至少具有上述实施例的技术方案所带来的所有有益效果，在此不再一一赘述，所述集成电路的输出端与所述阵列基板行驱动电路的电路单元中的第一场效应晶体管T1的栅极电性连接。集成电路输出的控制下降沿产生的信号，第一场效应晶体管T1根据接收的下降沿产生信号KF，决定阵列基板行驱动电路的电路单元中的二极管是否导通，且第一场效应晶体管T1在接收到下降沿产生信号KF时，根据下降沿产生信号KF，在下拉模块30将上拉控制信号Q(N)与当前级阵列基板行驱动电路单元的行扫描信号G(N)同时下拉至低电平时，增加行扫描信号的下降沿的数目，进而当前级阵列基板行驱动电路单元输出的波形具有两个下降沿，以降低高电位VGH与低电位VGL之间的差值，以降低画素的馈通电压，从而改善液晶显示面板的均一性，有利于窄边框的液晶显示面板显示。
以上所述仅为本申请的优选实施例，并非因此限制本申请的专利范围，凡是在本申请的构思下，利用本申请说明书及附图内容所作的等效结构变换，或直接/间接运用在其他相关的技术领域均包括在本申请的专利保护范围内。

Claims (17)

  1. 一种阵列基板行驱动电路单元，其中，阵列基板行驱动电路由多级阵列基板行驱动电路单元级联构成，其特征在于，所述阵列基板行驱动电路单元包括：
    上拉控制模块，设置为在接收到直流高压信号与级传信号时，输出上拉控制信号；
    上拉模块，所述上拉模块与所述上拉控制模块电性连接，设置为在接收到所述上拉控制信号及高频时钟信号时，输出当前级的阵列基板行驱动电路单元的行扫描信号；
    下拉模块，所述下拉模块与所述上拉控制模块、所述上拉模块连接，设置为在接收行扫描信号时，根据直流低压信号将所述上拉控制信号与当前级的阵列基板行驱动电路单元的行扫描信号同时下拉至低电平；
    分压模块，所述分压模块与所述上拉模块电性连接，设置为在所述下拉模块将所述上拉控制信号与所述当前级阵列基板行驱动电路单元的行扫描信号同时下拉至低电平时，增加下拉时的下降沿。
  2. 如权利要求1所述的阵列基板行驱动电路单元，其特征在于，所述分压模块包括电子元件和分压元件；
    所述电子元件的第一端设置为接收下降沿产生信号，所述电子元件的第二端与所述上拉模块连接以接收所述上拉模块输出的行扫描信号，所述电子元件的第三端经所述分压元件接收直流低压信号。
  3. 如权利要求2所述的阵列基板行驱动电路单元，其特征在于，所述电子元件为第一场效应晶体管，所述第一场效应晶体管的栅极设置为接收下降沿产生信号，所述第一场效应晶体管的源极与所述上拉模块电性连接，以接收所述上拉模块输出的行扫描信号，所述第一场效应晶体管的漏极经所述分压元件接收直流低压信号。
  4. 如权利要求1所述的阵列基板行驱动电路单元，其特征在于，所述阵列基板行驱动电路单元包括两个所述下拉模块，两个所述下拉模块均与所述上拉控制模块及所述上拉模块电性连接。
  5. 如权利要求1所述的阵列基板行驱动电路单元，其特征在于，所述阵列基板行驱动电路单元还包括：
    下拉维持模块，所述下拉维持模块与所述上拉模块及所述上拉控制模块电性连接。
  6. 如权利要求1所述的阵列基板行驱动电路单元，其特征在于，所述阵列基板行驱动电路单元还包括自举模块，所述自举模块的一端与所述上拉控制模块输出所述上拉控制信号的一端电性连接连接，所述自举模块的另一端与所述上拉模块的输出的当前级阵列基板行驱动电路电路单元的行扫描信号的一端电性连接。
  7. 如权利要求1所述的阵列基板行驱动电路单元，其特征在于，所述阵列基板行驱动电路单元还包括级传模块，所述级传模块与所述上拉控制模块电性连接。
  8. 如权利要求7所述的阵列基板行驱动电路单元，其特征在于，所述下拉模块包括第二场效应晶体管、第三场效应晶体管以及第四场效应晶体管，所述第二场效应晶体管的源极、所述第三场效应晶体管的源极以及所述第四场效应晶体管的源极分别连接直流低压信号，所述第二场效应晶体管的栅极、所述第三场效应晶体管的栅极以及所述第四场效应晶体管的栅极相互电性连接，所述第二场效应晶体管的漏极与所述上拉模块的输出当前级阵列基板行驱动电路电路单元的行扫描信号的一端电性电性连接，所述第三场效应晶体管的漏极与所述级传模块输出的级传信号电性连接，所述第四场效应晶体管的漏极与所述上拉控制模块输出所述上拉控制信号的一端电性连接。
  9. 一种阵列基板行驱动电路，所述阵列基板行驱动电路包括多级阵列基板行驱动电路单元，多级所述阵列基板行驱动电路单元级联 构成所述阵列基板行驱动电路，其中，每一所述阵列基板行驱动电路单元对显示区域内的对应级的水平扫描线充电，每一所述阵列基板行驱动电路单元包括：
    上拉控制模块，设置为在接收到直流高压信号与级传信号时，输出上拉控制信号；
    上拉模块，所述上拉模块与所述上拉控制模块电性连接，设置为在接收到所述上拉控制信号及时钟信号时，输出当前级的阵列基板行驱动电路单元的行扫描信号；
    多个下拉模块，每个下拉模块分别与低频信号、所述上拉控制模块、所述上拉模块以及直流低压信号连接，所述多个下拉模块设置为在接收行扫描信号时，根据直流低压信号将所述上拉控制信号与当前级的阵列基板行驱动电路单元的行扫描信号同时下拉至低电平；以及
    分压模块，所述分压模块与所述上拉模块电性连接，设置为在所述下拉模块将所述上拉控制信号与所述当前级阵列基板行驱动电路单元的行扫描信号同时下拉至低电平时，增加下拉时的下降沿。
  10. 如权利要求9所述的阵列基板行驱动电路，其中，所述阵列基板行驱动电路单元还包括级传模块，所述级传模块与所述上拉控制模块电性连接。
  11. 如权利要求10所述的阵列基板行驱动电路，其中，所述下拉模块包括第二场效应晶体管、第三场效应晶体管以及第四场效应晶体管，所述第二场效应晶体管的源极、所述第三场效应晶体管的源极以及所述第四场效应晶体管的源极分别连接直流低压信号，所述第二场效应晶体管的栅极、所述第三场效应晶体管的栅极以及所述第四场效应晶体管的栅极相互电性连接，所述第二场效应晶体管的漏极与所述上拉模块的输出当前级阵列基板行驱动电路电路单元的行扫描信号的一端电性电性连接，所述第三场效应晶体 管的漏极与所述级传模块输出的级传信号电性连接，所述第四场效应晶体管的漏极与所述上拉控制模块输出所述上拉控制信号的一端电性连接。
  12. 如权利要求11所述的阵列基板行驱动电路，其中，所述上拉控制模块包括第五场效应晶体管，所述第五场效应晶体管的源极与第一阵列基板行驱动电路单元的行扫描信号连接，第五场效应晶体管的栅极与第一阵列基板行驱动电路单元的级传信号连接，第五场效应晶体管的漏极输出当前级阵列基板行驱动电路单元的上拉控制信号。
  13. 如权利要求12所述的阵列基板行驱动电路，其中，所述上拉模块包括第六场效应晶体管，第六场效应晶体管的源极与时钟信号连接，第六场效应晶体管的栅极与当前级上拉控制模块输出的上拉控制信号电性连接，第六场效应晶体管的漏极输出所述行扫描信号。
  14. 如权利要求13所述的阵列基板行驱动电路，其中，所述级传模块包括第七场效应晶体管，其中，所述第七场效应晶体管的源极连接时钟信号，所述第七场效应晶体管的栅极与所述上拉模块的所述第六场效应晶体管相互连接，并接入所述上拉控制模块输出的所述上拉控制信号，所述第七场效应晶体管的漏极设置为输出当前级阵列基板行驱动电路单元的级传信号，所述第七场效应晶体管根据当前级的所述上拉控制信号，将接收的所述时钟信号输出成与当前级阵列基板行驱动电路单元的行扫描信号同步的当前级阵列基板行驱动电路单元的级传信号。
  15. 一种液晶显示面板，其中，所述液晶显示面板包括集成电路以及阵列基板行驱动电路，所述集成电路的输出端与所述阵列基板行驱动电路电性连接，所述阵列基板行驱动电路包括多级阵列基板行驱动电路单元，多级所述阵列基板行驱动电路单元级联构成阵列基板行驱动电路，其中，所述阵列基板行驱动电路单元对显示 区域内的对应级别的水平扫描线充电，所述阵列基板行驱动电路单元包括：
    上拉控制模块，设置为在接收到直流高压信号与级传信号时，输出上拉控制信号；
    上拉模块，所述上拉模块与所述上拉控制模块电性连接，设置为在接收到所述上拉控制信号及高频时钟信号时，输出当前级的阵列基板行驱动电路单元的行扫描信号；
    多个下拉模块，每个下拉模块分别与低频信号、所述上拉控制模块、所述上拉模块以及直流低压信号，设置为在接收行扫描信号时，根据直流低压信号将所述上拉控制信号与当前级的阵列基板行驱动电路单元的行扫描信号同时下拉至低电平；以及
    分压模块，所述分压模块与所述上拉模块电性连接，设置为在所述下拉模块将所述上拉控制信号与所述当前级阵列基板行驱动电路单元的行扫描信号同时下拉至低电平时，增加下拉时的下降沿。
  16. 如权利要求15所述的液晶显示面板，其中，所述分压模块包括电子元件和分压元件；
    所述电子元件的第一端设置为接收下降沿产生信号，所述电子元件的第二端与所述上拉模块连接以接收所述上拉模块输出的行扫描信号，所述电子元件的第三端经所述分压元件接收直流低压信号。
  17. 如权利要求16所述的液晶显示面板，其中，所述电子元件为薄膜晶体管，所述薄膜晶体管的栅极设置为接收下降沿产生信号，所述薄膜晶体管的源极与所述上拉模块电性连接，以接收所述上拉模块输出的行扫描信号，所述薄膜晶体管的漏极设置为经所述分压元件接收直流低压信号，其中，所述分压元件为二极管元件。
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