WO2010013366A1 - フレックスリジッド配線板及びその製造方法 - Google Patents

フレックスリジッド配線板及びその製造方法 Download PDF

Info

Publication number
WO2010013366A1
WO2010013366A1 PCT/JP2008/073258 JP2008073258W WO2010013366A1 WO 2010013366 A1 WO2010013366 A1 WO 2010013366A1 JP 2008073258 W JP2008073258 W JP 2008073258W WO 2010013366 A1 WO2010013366 A1 WO 2010013366A1
Authority
WO
WIPO (PCT)
Prior art keywords
rigid
substrate
flex
wiring board
flexible substrate
Prior art date
Application number
PCT/JP2008/073258
Other languages
English (en)
French (fr)
Inventor
通昌 高橋
Original Assignee
イビデン株式会社
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by イビデン株式会社 filed Critical イビデン株式会社
Priority to JP2010522587A priority Critical patent/JPWO2010013366A1/ja
Priority to CN2008801305616A priority patent/CN102106197A/zh
Publication of WO2010013366A1 publication Critical patent/WO2010013366A1/ja

Links

Images

Classifications

    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/46Manufacturing multilayer circuits
    • H05K3/4697Manufacturing multilayer circuits having cavities, e.g. for mounting components
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K1/00Printed circuits
    • H05K1/18Printed circuits structurally associated with non-printed electric components
    • H05K1/182Printed circuits structurally associated with non-printed electric components associated with components mounted in the printed circuit board, e.g. insert mounted components [IMC]
    • H05K1/183Components mounted in and supported by recessed areas of the printed circuit board
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/46Manufacturing multilayer circuits
    • H05K3/4688Composite multilayer circuits, i.e. comprising insulating layers having different properties
    • H05K3/4691Rigid-flexible multilayer circuits comprising rigid and flexible layers, e.g. having in the bending regions only flexible layers
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/0554External layer
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/0554External layer
    • H01L2224/0556Disposition
    • H01L2224/05568Disposition the whole external layer protruding from the surface
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/0554External layer
    • H01L2224/05573Single external layer
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/15Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L2224/16Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
    • H01L2224/161Disposition
    • H01L2224/16151Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/16221Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/16225Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/31Structure, shape, material or disposition of the layer connectors after the connecting process
    • H01L2224/32Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
    • H01L2224/321Disposition
    • H01L2224/32151Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/32221Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/32225Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48225Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • H01L2224/48227Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation connecting the wire to a bond pad of the item
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/73Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
    • H01L2224/732Location after the connecting process
    • H01L2224/73201Location after the connecting process on the same surface
    • H01L2224/73203Bump and layer connectors
    • H01L2224/73204Bump and layer connectors the bump connector being embedded into the layer connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/0001Technical content checked by a classifier
    • H01L2924/00014Technical content checked by a classifier the subject-matter covered by the group, the symbol of which is combined with the symbol of this group, being disclosed without further technical details
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/30Technical effects
    • H01L2924/301Electrical effects
    • H01L2924/3025Electromagnetic shielding
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K1/00Printed circuits
    • H05K1/02Details
    • H05K1/0213Electrical arrangements not otherwise provided for
    • H05K1/0216Reduction of cross-talk, noise or electromagnetic interference
    • H05K1/0218Reduction of cross-talk, noise or electromagnetic interference by printed shielding conductors, ground planes or power plane
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K2201/00Indexing scheme relating to printed circuits covered by H05K1/00
    • H05K2201/01Dielectrics
    • H05K2201/0183Dielectric layers
    • H05K2201/0187Dielectric layers with regions of different dielectrics in the same layer, e.g. in a printed capacitor for locally changing the dielectric properties
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K2201/00Indexing scheme relating to printed circuits covered by H05K1/00
    • H05K2201/07Electric details
    • H05K2201/0707Shielding
    • H05K2201/0715Shielding provided by an outer layer of PCB
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K2201/00Indexing scheme relating to printed circuits covered by H05K1/00
    • H05K2201/09Shape and layout
    • H05K2201/09009Substrate related
    • H05K2201/09127PCB or component having an integral separable or breakable part
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K2201/00Indexing scheme relating to printed circuits covered by H05K1/00
    • H05K2201/09Shape and layout
    • H05K2201/09209Shape and layout details of conductors
    • H05K2201/095Conductive through-holes or vias
    • H05K2201/09509Blind vias, i.e. vias having one side closed
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K2201/00Indexing scheme relating to printed circuits covered by H05K1/00
    • H05K2201/09Shape and layout
    • H05K2201/09209Shape and layout details of conductors
    • H05K2201/095Conductive through-holes or vias
    • H05K2201/09536Buried plated through-holes, i.e. plated through-holes formed in a core before lamination
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K2203/00Indexing scheme relating to apparatus or processes for manufacturing printed circuits covered by H05K3/00
    • H05K2203/30Details of processes not otherwise provided for in H05K2203/01 - H05K2203/17
    • H05K2203/308Sacrificial means, e.g. for temporarily filling a space for making a via or a cavity or for making rigid-flexible PCBs
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/46Manufacturing multilayer circuits
    • H05K3/4602Manufacturing multilayer circuits characterized by a special circuit board as base or central core whereon additional circuit layers are built or additional circuit boards are laminated
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/46Manufacturing multilayer circuits
    • H05K3/4644Manufacturing multilayer circuits by building the multilayer layer by layer, i.e. build-up multilayer circuits
    • H05K3/4652Adding a circuit layer by laminating a metal foil or a preformed metal foil pattern
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/46Manufacturing multilayer circuits
    • H05K3/4644Manufacturing multilayer circuits by building the multilayer layer by layer, i.e. build-up multilayer circuits
    • H05K3/4664Adding a circuit layer by thick film methods, e.g. printing techniques or by other techniques for making conductive patterns by using pastes, inks or powders
    • YGENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y10TECHNICAL SUBJECTS COVERED BY FORMER USPC
    • Y10TTECHNICAL SUBJECTS COVERED BY FORMER US CLASSIFICATION
    • Y10T29/00Metal working
    • Y10T29/49Method of mechanical manufacture
    • Y10T29/49002Electrical device making
    • Y10T29/49117Conductor or circuit manufacturing
    • Y10T29/49124On flat or curved insulated base, e.g., printed circuit, etc.
    • YGENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y10TECHNICAL SUBJECTS COVERED BY FORMER USPC
    • Y10TTECHNICAL SUBJECTS COVERED BY FORMER US CLASSIFICATION
    • Y10T29/00Metal working
    • Y10T29/49Method of mechanical manufacture
    • Y10T29/49002Electrical device making
    • Y10T29/49117Conductor or circuit manufacturing
    • Y10T29/49124On flat or curved insulated base, e.g., printed circuit, etc.
    • Y10T29/49155Manufacturing circuit on or in base
    • Y10T29/49158Manufacturing circuit on or in base with molding of insulated base

Definitions

  • the present invention relates to a bendable flex-rigid wiring board partially composed of a flexible substrate and a method for manufacturing the same.
  • Patent Document 1 discloses a rigid core substrate, a flexible substrate disposed adjacent to the core substrate in the horizontal direction, a flexible adhesive layer laminated on the core substrate and the flexible substrate, and a rigid portion.
  • a flex-rigid wiring board having a wiring pattern formed on a flexible adhesive layer positioned and blind vias and / or through-holes connecting the wiring patterns formed in each layer is disclosed.
  • Patent Document 1 In the apparatus described in Patent Document 1, there is a concern that it will not be possible to cope with further downsizing and thinning of electronic devices (such as mobile phones).
  • the present invention has been made in view of such circumstances, and an object thereof is to provide a flex-rigid wiring board that can be easily reduced in thickness and a method for manufacturing the same. Another object of the present invention is to provide a flex-rigid wiring board that can more effectively utilize the space on the surface of the rigid board and a method for manufacturing the same.
  • a flex-rigid wiring board includes a rigid substrate having at least one conductor and a flexible substrate having at least one conductor, and at least one recess is formed on the surface of the rigid substrate. And at least one of the conductors of the flexible board and at least one of the conductors of the rigid board are electrically connected.
  • At least a part of the flexible substrate is embedded in the rigid substrate, and at least one of the conductors of the flexible substrate is electrically connected to at least one of the conductors of the rigid substrate in the embedded portion. It is good also as a composition.
  • a configuration may be adopted in which a plurality of insulating layers are stacked on at least one of the rigid substrates.
  • the configuration may be such that at least one connection terminal for mounting an electronic component is formed in at least one of the recesses.
  • the electronic device may be mounted on the connection terminal formed in at least one of the recesses.
  • the electronic component may be mounted on the connection terminal by flip chip connection.
  • the flexible substrate has a conductor pattern
  • the rigid substrate is disposed in a horizontal direction of the flexible substrate, covers the flexible substrate and the rigid substrate, and has an insulating layer exposing at least a part of the flexible substrate.
  • the conductor pattern may be formed on the insulating layer, and the conductor pattern of the flexible substrate and the conductor pattern on the insulating layer may be connected by a plating film.
  • a flex-rigid wiring board includes a rigid board having at least one conductor and a flexible board having at least one conductor, and the plurality of rigid boards sandwich the flexible board. At least one pair of opposed rigid substrates arranged to face each other, and at least one concave portion is formed on a surface of at least one rigid substrate constituting the opposed rigid substrate, and at least one conductor of the flexible substrate, It is characterized in that at least one of the conductors of the rigid substrate is electrically connected.
  • At least one recess may be formed on one main surface or both front and back surfaces of one substrate.
  • At least one concave portion may be formed on one main surface or both front and back surfaces of the other substrate facing the one substrate.
  • At least one recess may be formed on each of the front and back surfaces of one substrate.
  • At least one concave portion may be formed on each of the front and back surfaces of the other substrate facing the one substrate.
  • At least a part of the flexible substrate is embedded in the rigid substrate, and at least one of the conductors of the flexible substrate is electrically connected to at least one of the conductors of the rigid substrate in the embedded portion. It is good also as a composition.
  • a configuration may be adopted in which a plurality of insulating layers are stacked on at least one of the rigid substrates.
  • the configuration may be such that at least one connection terminal for mounting an electronic component is formed in at least one of the recesses.
  • the electronic device may be mounted on the connection terminal formed in at least one of the recesses.
  • the electronic component may be mounted on the connection terminal by flip chip connection.
  • the flexible substrate has a conductor pattern, and the opposing rigid substrate is disposed in a horizontal direction of the flexible substrate, covers the flexible substrate and the rigid substrate, and exposes at least a part of the flexible substrate.
  • the conductor pattern may be formed on the insulating layer, and the conductor pattern of the flexible substrate and the conductor pattern on the insulating layer may be connected by a plating film.
  • a flex-rigid wiring board includes a rigid board having at least one conductor and a flexible board having at least one conductor, and the plurality of rigid boards sandwich the flexible board. At least two sets of opposed rigid substrates arranged opposite to each other are formed, and at least one concave portion is formed on a surface of at least one rigid substrate constituting the opposed rigid substrate, and at least one conductor of the flexible substrate, It is characterized in that at least one of the conductors of the rigid substrate is electrically connected.
  • At least one recess may be formed on one main surface or both front and back surfaces of one substrate.
  • At least one concave portion is formed on one main surface or both front and back surfaces of at least one other substrate facing the one substrate. It is good also as a structure.
  • At least one recess may be formed on each of the front and back surfaces of one substrate.
  • At least one recess is formed on each of the front and back surfaces of at least one other substrate facing the one substrate. Good.
  • the at least two pairs of opposed rigid substrates may be configured such that at least two rigid substrates are respectively disposed opposite to a common rigid substrate with the flexible substrate interposed therebetween.
  • At least a part of the flexible substrate is embedded in the rigid substrate, and at least one of the conductors of the flexible substrate is electrically connected to at least one of the conductors of the rigid substrate in the embedded portion. It is good also as a composition.
  • a configuration may be adopted in which a plurality of insulating layers are stacked on at least one of the rigid substrates.
  • the configuration may be such that at least one connection terminal for mounting an electronic component is formed in at least one of the recesses.
  • the electronic device may be mounted on the connection terminal formed in at least one of the recesses.
  • the electronic component may be mounted on the connection terminal by flip chip connection.
  • the flexible substrate has a conductor pattern, and at least one set of the opposed rigid substrates is disposed in a horizontal direction of the flexible substrate, covers the flexible substrate and the rigid substrate, and covers at least a part of the flexible substrate.
  • An exposed insulating layer is provided, a conductor pattern is formed on the insulating layer, and the conductor pattern of the flexible substrate and the conductor pattern on the insulating layer may be connected by a plating film. .
  • a manufacturing method of a flex-rigid wiring board is a manufacturing method of a flex-rigid wiring board including a rigid substrate on which insulating layers are laminated, and the insulating layer is provided with a separator provided. It is characterized by comprising a step of forming a recess having a shape corresponding to the shape of the separator on the surface of the rigid substrate by laminating and removing the separator together with the upper insulating layer after the lamination.
  • a cut may be formed in a predetermined portion of the upper insulating layer, and the separator may be separated from other portions by the cut together with the upper insulating layer.
  • a flex-rigid wiring board that can be easily reduced in thickness and a method for manufacturing the same.
  • a flex-rigid wiring board that can more effectively use the space on the surface of the rigid substrate and a method for manufacturing the same.
  • FIG. 1A is a side view of a flex-rigid wiring board according to an embodiment of the present invention.
  • FIG. 1B is a plan view of a flex-rigid wiring board according to an embodiment of the present invention.
  • FIG. 2 is a cross-sectional view of the flexible substrate.
  • FIG. 3 is a cross-sectional view of a flex-rigid wiring board.
  • FIG. 4 is a partially enlarged view of FIG. 1A.
  • FIG. 5 is a diagram for explaining a process of cutting out a flexible substrate from a wafer common to a plurality of products.
  • FIG. 6 is a diagram for explaining a process of cutting out the first and second insulating layers from a wafer common to a plurality of products.
  • FIG. 1A is a side view of a flex-rigid wiring board according to an embodiment of the present invention.
  • FIG. 2 is a cross-sectional view of the flexible substrate.
  • FIG. 3 is a cross-
  • FIG. 7 is a diagram for explaining a process of cutting a separator from a wafer common to a plurality of products.
  • FIG. 8 is a diagram for explaining a process of manufacturing a core of a rigid substrate.
  • FIG. 9A is a diagram for explaining a step of forming the first layer.
  • FIG. 9B is a diagram for explaining a step of forming the first layer.
  • FIG. 9C is a diagram for explaining a step of forming the first layer.
  • FIG. 9D is a diagram for explaining a step of forming the first layer.
  • FIG. 9E is a diagram for explaining a step of forming the first layer.
  • FIG. 9F is a diagram for explaining a step of forming the first layer.
  • FIG. 9A is a diagram for explaining a step of forming the first layer.
  • FIG. 9B is a diagram for explaining a step of forming the first layer.
  • FIG. 9C is a diagram for explaining a step of forming the first layer
  • FIG. 10A is a diagram for explaining a step of forming the second layer.
  • FIG. 10B is a diagram for explaining a process of forming the second layer.
  • FIG. 10C is a diagram for explaining a step of forming the second layer.
  • FIG. 10D is a diagram for explaining a step of forming the second layer.
  • FIG. 11 is a diagram for explaining a process of cutting out the third and fourth upper insulating layers from a wafer common to a plurality of products.
  • FIG. 12 is a diagram for explaining a process of cutting a separator from a wafer common to a plurality of products.
  • FIG. 13A is a diagram for explaining a step of forming the third layer.
  • FIG. 13B is a diagram for explaining a step of forming the third layer.
  • FIG. 13C is a diagram for explaining a step of forming the third layer.
  • FIG. 13D is a diagram for explaining a step of forming the third layer.
  • FIG. 14A is a diagram for explaining a step of forming the fourth layer.
  • FIG. 14B is a diagram for explaining a step of forming the fourth layer.
  • FIG. 14C is a diagram for explaining a step of forming the fourth layer.
  • FIG. 14D is a diagram for explaining a step of forming the fourth layer.
  • FIG. 14E is a diagram for explaining a step of forming the fourth layer.
  • FIG. 15A is a diagram for explaining a step of forming a recess.
  • FIG. 15B is a diagram illustrating a state after forming the recess.
  • FIG. 15A is a diagram for explaining a step of forming a recess.
  • FIG. 15B is a diagram illustrating a state after forming the recess.
  • FIG. 15A is
  • FIG. 15C is a diagram illustrating a state after removing the copper remaining when the recess is formed.
  • FIG. 16 is a diagram for explaining a modification of the flex-rigid wiring board.
  • FIG. 17 is a diagram showing a flex-rigid wiring board in which electronic components are arranged in the recesses.
  • FIG. 18A is a diagram illustrating a modification of the mounting mode of the electronic component.
  • FIG. 18B is a diagram illustrating a modified example of the mounting mode of the electronic component.
  • FIG. 19A is a diagram for explaining a modification of the flex-rigid wiring board.
  • FIG. 19B is a diagram for explaining a modification of the flex-rigid wiring board.
  • 19C is a diagram for explaining a modification of the flex-rigid wiring board.
  • FIG. 20 is a view for explaining a modification of the flex-rigid wiring board.
  • FIG. 21A is a diagram for explaining a modification of the flex-rigid wiring board.
  • FIG. 21B is a diagram for explaining a modification of the flex-rigid wiring board.
  • the flex-rigid wiring board 10 is mainly composed of a first rigid board 11, a second rigid board 12, and a flexible board 13.
  • the one rigid substrate 11 and the second rigid substrate 12 are disposed to face each other with the flexible substrate 13 interposed therebetween.
  • the first and second rigid substrates 11 and 12 are arranged in the horizontal direction of the flexible substrate 13.
  • Arbitrary circuit patterns are formed on the first and second rigid substrates 11 and 12, respectively. Further, for example, an electronic component such as a semiconductor chip is connected as necessary.
  • the flexible substrate 13 is formed with a stripe-shaped wiring pattern 13 a for connecting the circuit pattern of the first rigid substrate 11 and the circuit pattern of the second rigid substrate 12. The wiring pattern 13a connects the circuit patterns of the rigid substrates 11 and 12 to each other.
  • the flexible substrate 13 includes a base material 131, conductor layers 132 and 133, insulating layers 134 and 135, shield layers 136 and 137, and cover lays 138 and 139. It has a laminated structure.
  • the substrate 131 is made of an insulating flexible sheet, for example, a polyimide sheet having a thickness of “20 to 50 ⁇ m”, preferably about “30 ⁇ m”.
  • the conductor layers 132 and 133 are made of, for example, a copper pattern having a thickness of about “5 to 15 ⁇ m”, and are formed on the front and back surfaces of the base material 131 to constitute the above-described stripe-shaped wiring pattern 13a (FIG. 1B). .
  • the insulating layers 134 and 135 are made of a polyimide film having a thickness of about “5 to 15 ⁇ m” and the like, and insulate the conductor layers 132 and 133 from the outside.
  • the shield layers 136 and 137 are made of a conductive layer, for example, a hardened film of silver paste, and shield electromagnetic noise from the outside to the conductor layers 132 and 133 and electromagnetic noise from the conductor layers 132 and 133 to the outside.
  • the coverlays 138 and 139 are formed of an insulating film such as polyimide having a thickness of about “5 to 15 ⁇ m”, and insulate and protect the entire flexible substrate 13 from the outside.
  • the rigid substrates 11 and 12, respectively, as shown in FIG. 3, are a rigid base 112, first and second insulating layers 111 and 113, first and second upper insulating layers 144 and 114, The third and fourth upper insulating layers 145 and 115 and the fifth and sixth upper insulating layers 172 and 173 are laminated.
  • the rigid base 112 gives rigidity to the rigid substrates 11 and 12, and is made of a rigid insulating material such as a glass epoxy resin.
  • the rigid base material 112 is spaced apart from the flexible substrate 13 in the horizontal direction.
  • the rigid base 112 has substantially the same thickness as the flexible substrate 13.
  • conductor patterns 112a and 112b made of, for example, copper are formed on the front and back of the rigid base 112, respectively. These conductor patterns 112a and 112b are electrically connected to higher-layer conductors (wirings) at predetermined locations, respectively.
  • the first and second insulating layers 111 and 113 are formed by curing a prepreg.
  • the first and second insulating layers 111 and 113 each have a thickness of about “50 to 100 ⁇ m”, preferably about “50 ⁇ m”.
  • resin it is desirable for resin to have a low flow characteristic.
  • Such a prepreg can be prepared by impregnating a glass cloth with an epoxy resin and then thermosetting the resin to advance the degree of curing in advance.
  • the rigid base 112 and the first and second insulating layers 111 and 113 constitute the core of the rigid substrates 11 and 12, support the rigid substrates 11 and 12, and support and fix by sandwiching one end of the flexible substrate 13. To do. Specifically, as shown in FIG. 4 in which the region R11 in FIG. 1A (the joined portion of the first rigid substrate 11 and the flexible substrate 13) is enlarged, the first and second insulating layers 111 and 113 are formed. The rigid base 112 and the flexible substrate 13 are covered from both the front and back sides, and a part of the flexible substrate 13 is exposed. These first and second insulating layers 111 and 113 are superposed with coverlays 138 and 139 provided on the surface of the flexible substrate 13.
  • substrate 12 and the flexible substrate 13 is the same as the structure (FIG. 4) of the connection part of the rigid board
  • the resin 125 is filled in the space (the space between the members) defined by the rigid base 112, the flexible substrate 13, and the first and second insulating layers 111 and 113.
  • the resin 125 oozes out from the low-flow prepreg constituting the first and second insulating layers 111 and 113 at the time of manufacture, for example, and is cured integrally with the first and second insulating layers 111 and 113. Yes.
  • Vias (contact holes) 141 and 116 are formed in the portions of the first and second insulating layers 111 and 113 facing the connection pads 13b of the conductor layers 132 and 133 of the flexible substrate 13, respectively.
  • the portions facing the vias 141 and 116 are formed by the shield layers 136 and 137 and the cover lays 138 and 139 of the flexible substrate 13.
  • the vias 141 and 116 pass through the insulating layers 134 and 135 of the flexible substrate 13 to expose the connection pads 13b including the conductor layers 132 and 133, respectively.
  • wiring patterns (conductor layers) 142 and 117 respectively formed by copper plating or the like are formed on the inner surfaces of the vias 141 and 116.
  • the plating films of the wiring patterns 142 and 117 are connected to the connection pads 13b of the conductor layers 132 and 133 of the flexible substrate 13, respectively.
  • the vias 141 and 116 are filled with resin, respectively.
  • the resin in the vias 141 and 116 is filled by, for example, pressing the resin of the upper insulating layer (upper insulating layers 144 and 114) by pressing.
  • lead patterns 143 and 118 connected to the wiring patterns 142 and 117 are formed on the upper surfaces of the first and second insulating layers 111 and 113, respectively.
  • lead patterns 143 and 118 are each composed of, for example, a copper plating layer. Also, each flexible substrate 13 side end of the first and second insulating layers 111 and 113, that is, a position closer to the flexible substrate 13 than the boundary between the flexible substrate 13 and the rigid base 112, is insulated from each other. Conductor patterns 151 and 124 are arranged. The conductor patterns 151 and 124 can effectively dissipate heat generated in the rigid substrate 11.
  • the rigid substrates 11 and 12 and the flexible substrate 13 are electrically connected regardless of the connector. That is, when the flexible substrate 13 enters (embeds) each of the rigid substrates 11 and 12, the flexible substrate 13 is electrically connected to each rigid substrate at the portion (embedded portion). (See FIG. 4). For this reason, even when an impact is caused by dropping or the like, the connector does not come off and contact failure does not occur.
  • the rigid board is bonded and reinforced on both the front and back sides of the place where the flexible board and the rigid board are electrically connected. Even if the device is impacted by a drop, or when the temperature environment changes and stress is generated due to the difference in CTE (thermal expansion coefficient) between the rigid substrate and the flexible substrate, the electrical connection between the flexible substrate and the rigid substrate is ensured. it can.
  • CTE thermal expansion coefficient
  • the flex-rigid wiring board 10 has a more reliable electrical connection than a connector-connected board.
  • the conductive layers 132 and 133 of the flexible substrate 13 and the wiring patterns 142 and 117 of the rigid substrates 11 and 12 are connected by tapered vias, so that they are connected by through holes extending in a direction perpendicular to the substrate surface. As compared with, stress is dispersed when subjected to an impact, and cracks and the like are less likely to occur.
  • the conductor layers 132 and 133 and the wiring patterns 142 and 117 are connected by a plating film, the reliability of the connection portion is high. Furthermore, the reliability of connection is improved by filling the vias 141 and 116 with resin.
  • First and second upper insulating layers 144 and 114 are laminated on the upper surfaces of the first and second insulating layers 111 and 113, respectively.
  • the first and second upper insulating layers 144 and 114 are configured by curing a prepreg in which a glass cloth or the like is impregnated with a resin, for example.
  • Third and fourth upper insulating layers 145 and 115 are laminated on the upper surfaces of the first and second upper insulating layers 144 and 114, respectively.
  • the third and fourth upper insulating layers 145 and 115 are also configured by curing a prepreg in which, for example, a glass cloth or the like is impregnated with a resin.
  • Vias (second upper layer vias) 147 and 121 connected to the vias 146 and 119 are formed in the third and fourth upper insulating layers 145 and 115, respectively.
  • the vias 147 and 121 are filled with conductors 149 and 122 made of, for example, copper, and the conductors 149 and 122 are electrically connected to the conductors 148 and 120, respectively.
  • a filled buildup via is formed by the vias 146 and 147 and 119 and 121.
  • Conductor patterns (circuit patterns) 150 and 123 are formed on the upper surfaces of the third and fourth upper insulating layers 145 and 115, respectively. Vias 147 and 121 are connected to predetermined portions of the conductor patterns 150 and 123, respectively, so that the conductor layer 133 and the conductor pattern 123 are connected via the wiring pattern 117, the lead pattern 118, the conductor 120, and the conductor 122. In addition, the conductor layer 132 and the conductor pattern 150 are electrically connected to each other through the wiring pattern 142, the lead pattern 143, the conductor 148, and the conductor 149, respectively.
  • fifth and sixth upper insulating layers 172 and 173 are stacked on the upper surfaces of the third and fourth upper insulating layers 145 and 115, respectively. These fifth and sixth upper insulating layers 172 and 173 are also configured by curing a prepreg in which, for example, a glass cloth or the like is impregnated with a resin.
  • conductor patterns 176 and 177 made of, for example, copper are formed on the front and back of the substrate including the vias 174 and 175, respectively. These conductor patterns 176 and 177 are electrically connected to the conductors 149 and 122, respectively.
  • patterned solder resists 298 and 299 are provided on the front and back sides of the substrate, respectively, and electrodes 178 and 179 are formed at predetermined positions of the conductor patterns 176 and 177 by, for example, chemical gold plating.
  • the surface of the flex-rigid wiring board 10, particularly the surface of the rigid substrate 12, can store electronic components such as predetermined dimensions (length, width, and depth), for example, an IC (integrated circuit) chip.
  • a recess (cavity) 300 having dimensions is formed.
  • a freely usable space is generated in the recess 300.
  • a component electrically connected to the flex-rigid wiring board 10 or a component electrically connected to another substrate can be arranged.
  • the usage of the space in the recess 300 is arbitrary, and may be used for another usage such as positioning using a step.
  • a flexible substrate 13 (FIG. 2) is manufactured. Specifically, a copper film is formed on both surfaces of the polyimide base material 131 processed into a predetermined size. Subsequently, by patterning the copper film, conductor layers 132 and 133 including the wiring pattern 13a and the connection pads 13b are formed. Then, insulating layers 134 and 135 made of polyimide, for example, are formed on the surfaces of the conductor layers 132 and 133 in a stacked manner. Further, a silver paste is applied to these insulating layers 134 and 135 except for the end portion of the flexible substrate 13, and the applied silver paste is cured to form shield layers 136 and 137. Subsequently, coverlays 138 and 139 are formed so as to cover the surfaces of the shield layers 136 and 137. The shield layers 136 and 137 and the coverlays 138 and 139 are formed so as to avoid the connection pads 13b.
  • the wafer having the laminated structure shown in FIG. 2 is completed.
  • This wafer is used as a material common to a plurality of products. That is, as shown in FIG. 5, the flexible substrate 13 having a predetermined size is obtained by cutting (cutting) the wafer into a predetermined size with, for example, a laser.
  • the flexible substrate 13 thus manufactured and the first and second rigid substrates 11 and 12 are bonded to each other.
  • a wafer common to a plurality of products is cut by, for example, a laser to prepare first and second insulating layers 111 and 113 having a predetermined size.
  • a wafer common to a plurality of products is cut by, for example, a laser, and a separator 291 having a predetermined size is prepared.
  • the rigid base 112 serving as the core of the rigid substrates 11 and 12 is also produced from a wafer 110 common to a plurality of products, for example, as shown in FIG. That is, conductor films 110a and 110b made of, for example, copper are formed on the front and back surfaces of the wafer 110, respectively, and then subjected to, for example, a predetermined lithography process (pretreatment, lamination, exposure, development, etching, film removal, inner layer inspection, etc.). Thus, the conductor films 110a and 110b are respectively patterned to form conductor patterns 112a and 112b. Subsequently, a predetermined portion of the wafer 110 is removed by, for example, a laser to obtain the rigid base material 112 of the rigid substrates 11 and 12. Then, the roughened surface is formed by processing the conductor pattern surface of the rigid base material 112 thus manufactured.
  • a predetermined lithography process pretreatment, lamination, exposure, development, etching, film removal, inner layer inspection, etc.
  • the rigid base 112 is made of a glass epoxy base having a thickness of, for example, “50 to 150 ⁇ m”, desirably “100 ⁇ m”, and the first and second insulating layers 111 and 113 are, for example, “20 to 150 ⁇ m”. It is composed of a prepreg having a thickness of “50 ⁇ m”.
  • the separator 291 is made of, for example, a cured prepreg or a polyimide film.
  • the thicknesses of the first and second insulating layers 111 and 113 are set to the same thickness so that, for example, the rigid substrates 11 and 12 have a contrasting structure on both sides.
  • the thickness of the separator 291 is set to be approximately the same as the thickness of the second insulating layer 113.
  • the thickness of the rigid base 112 and the thickness of the flexible substrate 13 are substantially the same.
  • the gap between the rigid base 112 and the coverlays 138 and 139 is filled with the resin 125 so that the flexible substrate 13 and the rigid base 112 can be bonded more reliably. become.
  • first and second insulating layers 111 and 113, the rigid base material 112, and the flexible substrate 13 cut in the steps of FIGS. 5, 6, and 8 are aligned, for example, as shown in FIG. 9A. Arrange as follows. At this time, each end portion of the flexible substrate 13 is sandwiched between the first and second insulating layers 111 and 113 and aligned.
  • the separator 291 cut in the step of FIG. 7 is second insulated on one surface (for example, the upper side) of the flexible substrate 13 exposed between the rigid substrate 11 and the rigid substrate 12.
  • conductor films 161 and 162 made of, for example, copper are arranged on the outer side (respectively on the front and back sides).
  • the separator 291 is fixed with an adhesive, for example.
  • this structure is pressure-pressed as shown in FIG. 9C, for example.
  • the resin 125 is extruded from the prepregs constituting the first and second insulating layers 111 and 113, and as shown in FIG. The space between is filled.
  • the resin 125 is filled in the gap, so that the flexible substrate 13 and the rigid base material 112 are securely bonded.
  • Such a pressure press is performed using, for example, a hydro press apparatus under conditions of a temperature of “200 degrees Celsius”, a pressure of “40 kgf”, and a pressurization time of “3 hours”.
  • the prepreg and the resin 125 constituting the first and second insulating layers 111 and 113 are cured and integrated by heating the whole.
  • the coverlays 138 and 139 (FIG. 4) of the flexible substrate 13 and the resins of the first and second insulating layers 111 and 113 are polymerized. Since the resin of the insulating layers 111 and 113 is polymerized, the periphery of the vias 141 and 116 (formed in a later process) is fixed with the resin, and each connecting portion of the via 141 and the conductor layer 132 (or the via 116 and the conductor layer 133) is fixed. Connection reliability is improved.
  • a CO 2 laser is irradiated from, for example, a CO 2 laser processing apparatus, thereby forming a through hole 163 as shown in FIG. 9D.
  • vias 116 and 141 for example, IVH (Interstitial Via Hole) for connecting the conductor layers 132 and 133 of the flexible substrate 13 (FIG. 4) and the rigid substrates 11 and 12 are also formed.
  • PN plating for example, chemical copper plating and electrolytic copper plating
  • PN plating for example, chemical copper plating and electrolytic copper plating
  • Copper formed by this copper plating and the existing conductor films 161 and 162 are integrated, and a copper film 171 is formed on the entire surface of the substrate including the vias 116 and 141 and the through holes 163.
  • the flexible substrate 13 is covered with the conductor films 161 and 162 and does not directly touch the plating solution. Therefore, the flexible substrate 13 is not damaged by the plating solution.
  • the copper film 171 on the substrate surface is patterned as shown in FIG. 9F, for example, through a predetermined lithography process (pretreatment, lamination, exposure, development, etching, peeling film, inner layer inspection, etc.).
  • predetermined lithography process pretreatment, lamination, exposure, development, etching, peeling film, inner layer inspection, etc.
  • the wiring patterns 142 and 117 and the lead patterns 143 and 118 connected to the conductor layers 132 and 133 of the flexible substrate 13 (FIG. 4), and the conductor patterns 151 and 124, respectively, are formed.
  • copper foil is left at the end portions of the first and second insulating layers 111 and 113 on the flexible substrate 13 side.
  • the roughened surface is formed by treating the copper foil surface.
  • first and second upper insulating layers 144 and 114 are respectively arranged on the front and back of the resultant product, and further, conductor films 114a and 144a made of copper, for example, are provided on the outer side. Deploy. Subsequently, as shown in FIG. 10B, this structure is pressed. At this time, the vias 116 and 141 are filled with resin from the prepregs constituting the first and second upper insulating layers 114 and 144. Thereafter, the resin in the prepreg and the via is cured by, for example, heat treatment, and the first and second upper insulating layers 144 and 114 are solidified.
  • the conductor films 114a and 144a are thinned to a predetermined thickness, for example, by half etching.
  • vias 146 are formed in the first upper insulating layer 144 and vias 119 and cut lines 292 are formed in the second upper insulating layer 114 by, for example, laser, and desmear (smear removal) is performed.
  • a conductor is formed in the vias 146 and 119 and in the cut line 292 by performing PN plating (for example, chemical copper plating and electrolytic copper plating) as shown in FIG. 10C, for example. To do.
  • This conductor can also be formed by printing a conductive paste (for example, a thermosetting resin containing conductive particles) by, for example, a screen printing method.
  • the conductor film on the substrate surface is thinned to a predetermined thickness by, for example, half etching, and then subjected to, for example, a predetermined lithography process (pretreatment, lamination, exposure, development, etching, peeling film, inner layer inspection, etc.).
  • a predetermined lithography process pretreatment, lamination, exposure, development, etching, peeling film, inner layer inspection, etc.
  • the conductor film on the substrate surface is patterned.
  • the conductors 148 and 120 are formed.
  • the conductor in the cut line 292 is removed by etching.
  • the conductor surface is treated to form a roughened surface.
  • a wafer common to a plurality of products is cut by, for example, a laser or the like to form third and fourth upper insulating layers 145 and 115 having a predetermined size. Form it.
  • a wafer having a predetermined size is formed as shown in FIG. 12 by cutting a wafer common to a plurality of products with, for example, a laser.
  • the separator 293 is made of, for example, a cured prepreg, a polyimide film, or the like.
  • the third and fourth upper insulating layers 145 and 115 are each formed of a normal prepreg configured by impregnating a glass cloth with a resin, for example.
  • the conductor films 145a and 115a are thinned to a predetermined thickness, for example, by half etching.
  • vias 147 and 121 are formed in the third and fourth upper insulating layers 145 and 115, respectively, by laser, for example, and after desmear (smear removal) and soft etching are performed, for example, FIG.
  • the vias 147 and 121 are filled with a conductor by PN plating (for example, chemical copper plating and electrolytic copper plating).
  • This conductor can also be formed by printing a conductive paste (for example, a thermosetting resin containing conductive particles) by, for example, a screen printing method.
  • a conductive paste for example, a thermosetting resin containing conductive particles
  • the conductive film on the substrate surface is thinned to a predetermined thickness by, for example, half etching, and then, for example, a predetermined lithography process (pretreatment, lamination, exposure, development, etching, stripping,
  • a predetermined lithography process pretreatment, lamination, exposure, development, etching, stripping
  • the copper film on the substrate surface is patterned by going through an inner layer inspection and the like. Thereby, the conductors 149 and 122 and the conductor patterns 150 and 123 are formed. Thereafter, the resulting product is blackened.
  • fifth and sixth upper insulating layers 172 and 173 are arranged on the front and back of the resultant, and conductor films 172a and 173a made of copper, for example, are arranged on the outer sides (respectively on the front and back). Place.
  • the fifth and sixth upper insulating layers 172 and 173 are each formed of a prepreg configured by impregnating a glass cloth with a resin, for example.
  • the conductor films 172a and 173a are thinned to a predetermined thickness, for example, by half etching.
  • vias 174 and 175 are formed in the fifth and sixth upper insulating layers 172 and 173 by laser light or the like, respectively, and as shown in FIG. Insulating layers of each part, that is, end portions of the separator 291 (boundary portion of the second insulating layer 113 and the separator 291) and end portions of the separator 293 (boundary portion of the fourth upper insulating layer 115 and the separator 293)
  • the insulating layer is removed to form cut lines (cuts) 294a to 294c, 295a, and 295b.
  • the cut lines 294a to 294c are formed (cut) using, for example, the conductor patterns 151 and 124 as stoppers.
  • the cut lines 295a and 295b are formed using, for example, the conductor pattern 123 as a stopper.
  • the energy or irradiation time can be adjusted so that the conductor patterns 123, 124, and 151 used as stoppers are cut to some extent.
  • PN plating for example, chemical copper plating and electrolytic copper plating
  • a conductor is formed on the entire surface of the substrate including the vias 174 and 175.
  • the conductive film on the surface of the substrate is thinned to a predetermined thickness by, for example, half-etching, and then the substrate is subjected to, for example, a predetermined lithography process (pretreatment, lamination, exposure, development, etching, stripping, etc.)
  • the surface copper foil is patterned.
  • conductor patterns 176 and 177 are formed as shown in FIG. 14D. Then, after the pattern is formed, the pattern is inspected.
  • solder resist is formed on the entire surface of the substrate by, for example, screen printing, and the solder resist is patterned through a predetermined lithography process as shown in FIG. 14E. Thereafter, the patterned solder resists 298 and 299 are cured by heating, for example.
  • the structural bodies 301 to 303 are mounted on the flexible substrate 13 as shown in FIG. 15A. Remove it by tearing it off. At this time, since the separators 291 and 293 are arranged, the separation is easy. Further, when the structures 301 to 303 are separated (removed) from other portions, the conductor pattern 151 is merely pressed against the cover lays 138 and 139 of the flexible substrate 13 by a press and is not fixed ( For this reason, a part of the conductor pattern 151 (portion in contact with the flexible substrate 13) is also removed together with the structures 301 to 303.
  • a concave portion (cavity) 300 is formed in a portion (region R3) of the separator 293 on the surface of the flex-rigid wiring board 10, particularly the surface of the rigid substrate 12.
  • the concave portion 300 can be used for storing electronic components, for example.
  • Conductor patterns 124 and 151 and a conductor pattern 123 remain at the tip of each insulating layer facing the removed portions (regions R1 to R3), for example, as indicated by a broken line in FIG. 15B. As shown in FIG. 15C, the remaining copper is removed, for example, by mask etching (pretreatment, lamination, exposure, development, etching, stripping, etc.) as necessary.
  • the electrodes 178 and 179 are formed by, for example, chemical gold plating, and then, after undergoing outline processing, warping correction, energization inspection, appearance inspection, and final inspection, the flex-rigid wiring board 10 shown in FIG. Complete.
  • the end portion of the flexible substrate 13 is sandwiched between the core portions (first and second insulating layers 111 and 113) of the rigid substrates 11 and 12, and Each of the lands of the rigid substrates 11 and 12 and each of the connection pads of the flexible substrate 13 are connected by a plating film.
  • a recess 300 is formed on the surface of the flex-rigid wiring board 10.
  • connection terminal 180 for mounting an electronic component in the recess 300, the mounting of the electronic component is facilitated.
  • the connection terminal 180 is formed together with the conductor 120 in the process shown in FIGS. 10C and 10D, for example.
  • an electronic component 500 (IC chip) is mounted by so-called flip chip connection.
  • the Au bump 502 provided on the electrode 501 of the electronic component 500 and the connection terminal 180 are electrically connected by a conductive adhesive 503, and the connection portion is covered with an insulating resin 504.
  • the electrodes and wiring materials for mounting such electronic components are arbitrary.
  • the electronic component 500 and the connection terminal 180 may be electrically connected using an ACF (AnisotropicnisConductive Film) containing conductive particles 503a.
  • ACF AnaisotropicnisConductive Film
  • Such an ACF connection can facilitate alignment.
  • electronic components may be mounted by Au-Au connection. With such an Au—Au connection, a connection portion resistant to corrosion can be formed.
  • connection method is not limited to flip chip connection, and is arbitrary.
  • an electronic component may be mounted by wire bonding via a wire 503b.
  • an electronic component may be mounted via a spring 503c. Or you may make it mount an electronic component with a connector.
  • a recess 300 a may be formed not only on the surface of the rigid substrate 12 but also on the surface of the rigid substrate 11.
  • the concave portions 300 and 300b are formed on the front and back surfaces (both end surfaces in the laminating direction of the insulating layer) of the rigid substrate 12, respectively. May be formed.
  • recesses 300a and 300c may be formed on the front and back of the rigid substrate 11, respectively.
  • the concave portion (recess) may be formed by removing a portion (region R3) corresponding to the space by selective etching or the like without depending on the method using the separator 293 described above. However, by using the separator 293, deep recesses (dents) can be easily formed.
  • each layer can be arbitrarily changed.
  • RCF Resin Coated Cupper Foil
  • the rigid substrate 11 may have a conductor (wiring layer) on only one of the front and back sides of the core (the same applies to the rigid substrate 12).
  • three or more rigid substrates may be connected by a flexible substrate.
  • an opposing rigid substrate 1001 composed of a rigid substrate 101 and a rigid substrate 102 as a set of rigid substrates (opposed rigid substrates) opposed to each other with the flexible substrates 104 and 105 interposed therebetween.
  • a structure including an opposing rigid substrate 1002 including the rigid substrate 101 and the rigid substrate 103 may be employed.
  • the rigid substrates 102 and 103 are disposed so as to face the common rigid substrate 101.
  • the opposing rigid substrate 1001 and the opposing rigid substrate 1002 are arranged at an angle of “90 °” with respect to each other.
  • FIG. 21A the opposing rigid substrate 1001 and the opposing rigid substrate 1002 are arranged at an angle of “90 °” with respect to each other.
  • the opposing rigid substrate 1001 and the opposing rigid substrate 1002 are disposed at an angle of “180 °” with respect to each other. Also in the flex-rigid wiring board having such a structure, by providing at least one recess on one main surface or both front and back surfaces of at least one of the three rigid substrates 101 to 103, an effect similar to the above effect Can be obtained. Moreover, it is good also as a structure provided with 3 or more sets of opposing rigid boards.
  • the present invention can be applied to a bendable flex-rigid wiring board partially composed of a flexible substrate.

Landscapes

  • Engineering & Computer Science (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Manufacturing & Machinery (AREA)
  • Production Of Multi-Layered Print Wiring Board (AREA)

Abstract

 フレックスリジッド配線板として、導体を有するリジッド基板(11、12)と、導体を有するフレキシブル基板(13)とを備える。そして、リジッド基板の表面には、凹部(300)が形成されており、フレキシブル基板の導体の少なくとも1つと、リジッド基板の導体の少なくとも1つとは、電気的に接続されている。

Description

フレックスリジッド配線板及びその製造方法
 本発明は、一部がフレキシブル基板から構成された折り曲げ可能なフレックスリジッド配線板及びその製造方法に関する。
 特許文献1には、リジッド部のコア基板と、コア基板の水平方向に隣接して配置されたフレキシブル基板と、コア基板とフレキシブル基板の上に積層された柔軟性接着剤層と、リジッド部に位置する柔軟性接着剤層上に形成された配線パターンと、各層に形成された配線パターン間を接続するブラインドヴィア及び/又はスルーホールと、を有するフレックスリジッド配線板が開示されている。
日本国特許公開2006-140213号公報
 特許文献1に記載される装置では、現在よりもさらに電子デバイス(携帯電話等)の小型化や薄型化が進んだ場合に、対応することができなくなることが懸念される。
 本発明は、こうした実情に鑑みてなされたものであり、容易に薄型化を図ることができるフレックスリジッド配線板及びその製造方法を提供することを目的とする。また、本発明は、リジッド基板の表面のスペースをより有効に利用することのできるフレックスリジッド配線板及びその製造方法を提供することを他の目的とする。
 本発明の第1の観点に係るフレックスリジッド配線板は、少なくとも1つの導体を有するリジッド基板と、少なくとも1つの導体を有するフレキシブル基板とを備え、前記リジッド基板の表面に、少なくとも1つの凹部が形成され、前記フレキシブル基板の導体の少なくとも1つと、前記リジッド基板の導体の少なくとも1つとが電気的に接続されている、ことを特徴とする。
 前記フレキシブル基板の少なくとも一部が、前記リジッド基板に埋め込まれており、該埋め込まれた部分で、前記フレキシブル基板の導体の少なくとも1つと前記リジッド基板の導体の少なくとも1つとが電気的に接続されている、構成としてもよい。
 前記リジッド基板のうち、少なくとも1つの基板には、複数の絶縁層が積層されて形成されている、構成としてもよい。
 前記凹部の少なくとも1つには、電子部品を実装するための接続端子が少なくとも1つ形成されている、構成としてもよい。
 前記凹部の少なくとも1つに形成された前記接続端子には、電子部品が実装されている、構成としてもよい。
 前記電子部品は、フリップチップ接続により、前記接続端子に実装されている、構成としてもよい。
 前記フレキシブル基板は導体パターンを有し、前記リジッド基板は、前記フレキシブル基板の水平方向に配置され、前記フレキシブル基板と前記リジッド基板とを被覆し、前記フレキシブル基板の少なくとも一部を露出する絶縁層を備え、該絶縁層上には、導体パターンが形成されており、前記フレキシブル基板の導体パターンと前記絶縁層上の導体パターンとはめっき皮膜により接続されている、構成としてもよい。
 本発明の第2の観点に係るフレックスリジッド配線板は、少なくとも1つの導体を有するリジッド基板と、少なくとも1つの導体を有するフレキシブル基板とを備え、複数の前記リジッド基板は、前記フレキシブル基板を挟んで対向配置される対向リジッド基板を少なくとも1組構成し、前記対向リジッド基板を構成する少なくとも1つのリジッド基板の表面には、少なくとも1つの凹部が形成され、前記フレキシブル基板の導体の少なくとも1つと、前記リジッド基板の導体の少なくとも1つとが電気的に接続されている、ことを特徴とする。
 前記対向リジッド基板を構成するリジッド基板のうち、一の基板の一方の主面又は表裏両面には、少なくとも1つの凹部が形成されている、構成としてもよい。
 前記対向リジッド基板を構成するリジッド基板のうち、前記一の基板に対向する他の基板の一方の主面又は表裏両面には、少なくとも1つの凹部が形成されている、構成としてもよい。
 前記対向リジッド基板を構成するリジッド基板のうち、一の基板の表裏各面には、それぞれ少なくとも1つの凹部が形成されている、構成としてもよい。
 前記対向リジッド基板を構成するリジッド基板のうち、前記一の基板に対向する他の基板の表裏各面には、それぞれ少なくとも1つの凹部が形成されている、構成としてもよい。
 前記フレキシブル基板の少なくとも一部が、前記リジッド基板に埋め込まれており、該埋め込まれた部分で、前記フレキシブル基板の導体の少なくとも1つと前記リジッド基板の導体の少なくとも1つとが電気的に接続されている、構成としてもよい。
 前記リジッド基板のうち、少なくとも1つの基板には、複数の絶縁層が積層されて形成されている、構成としてもよい。
 前記凹部の少なくとも1つには、電子部品を実装するための接続端子が少なくとも1つ形成されている、構成としてもよい。
 前記凹部の少なくとも1つに形成された前記接続端子には、電子部品が実装されている、構成としてもよい。
 前記電子部品は、フリップチップ接続により、前記接続端子に実装されている、構成としてもよい。
 前記フレキシブル基板は導体パターンを有し、前記対向リジッド基板は、前記フレキシブル基板の水平方向に配置され、前記フレキシブル基板と前記リジッド基板とを被覆し、前記フレキシブル基板の少なくとも一部を露出する絶縁層を備え、該絶縁層上には、導体パターンが形成されており、前記フレキシブル基板の導体パターンと前記絶縁層上の導体パターンとはめっき皮膜により接続されている、構成としてもよい。
 本発明の第3の観点に係るフレックスリジッド配線板は、少なくとも1つの導体を有するリジッド基板と、少なくとも1つの導体を有するフレキシブル基板とを備え、複数の前記リジッド基板は、前記フレキシブル基板を挟んで対向配置される対向リジッド基板を少なくとも2組構成し、前記対向リジッド基板を構成する少なくとも1つのリジッド基板の表面には、少なくとも1つの凹部が形成され、前記フレキシブル基板の導体の少なくとも1つと、前記リジッド基板の導体の少なくとも1つとが電気的に接続されている、ことを特徴とする。
 前記対向リジッド基板の少なくとも1つを構成するリジッド基板のうち、一の基板の一方の主面又は表裏両面には、少なくとも1つの凹部が形成されている、構成としてもよい。
 前記対向リジッド基板の少なくとも1つを構成するリジッド基板のうち、前記一の基板に対向する少なくとも1つの他の基板の一方の主面又は表裏両面には、少なくとも1つの凹部が形成されている、構成としてもよい。
 前記対向リジッド基板の少なくとも1つを構成するリジッド基板のうち、一の基板の表裏各面には、それぞれ少なくとも1つの凹部が形成されている、構成としてもよい。
 前記対向リジッド基板の少なくとも1つを構成するリジッド基板のうち、前記一の基板に対向する少なくとも1つの他の基板の表裏各面には、それぞれ少なくとも1つの凹部が形成されている、構成としてもよい。
 前記少なくとも2組の対向リジッド基板は、少なくとも2つのリジッド基板が、それぞれ前記フレキシブル基板を挟んで、共通のリジッド基板に対向配置されてなる、構成としてもよい。
 前記フレキシブル基板の少なくとも一部が、前記リジッド基板に埋め込まれており、該埋め込まれた部分で、前記フレキシブル基板の導体の少なくとも1つと前記リジッド基板の導体の少なくとも1つとが電気的に接続されている、構成としてもよい。
 前記リジッド基板のうち、少なくとも1つの基板には、複数の絶縁層が積層されて形成されている、構成としてもよい。
 前記凹部の少なくとも1つには、電子部品を実装するための接続端子が少なくとも1つ形成されている、構成としてもよい。
 前記凹部の少なくとも1つに形成された前記接続端子には、電子部品が実装されている、構成としてもよい。
 前記電子部品は、フリップチップ接続により、前記接続端子に実装されている、構成としてもよい。
 前記フレキシブル基板は導体パターンを有し、前記対向リジッド基板の少なくとも1組は、前記フレキシブル基板の水平方向に配置され、前記フレキシブル基板と前記リジッド基板とを被覆し、前記フレキシブル基板の少なくとも一部を露出する絶縁層を備え、該絶縁層上には、導体パターンが形成されており、前記フレキシブル基板の導体パターンと前記絶縁層上の導体パターンとはめっき皮膜により接続されている、構成としてもよい。
 本発明の第4の観点に係るフレックスリジッド配線板の製造方法は、絶縁層が積層されてなるリジッド基板を備えるフレックスリジッド配線板の製造方法であって、セパレータを設けた状態で前記絶縁層を積層し、その積層の後、上層の絶縁層ごとセパレータを除去することにより、該リジッド基板の表面に、前記セパレータの形状に対応した形状の凹部を形成する工程を備える、ことを特徴とする。
 前記セパレータの除去に際しては、前記上層の絶縁層の所定部位に切り目を形成し、その切り目により、該上層の絶縁層ごと前記セパレータを他の部分から分離させ、除去する、ようにしてもよい。
 本発明によれば、容易に薄型化を図ることができるフレックスリジッド配線板及びその製造方法を提供することができる。また、本発明によれば、リジッド基板の表面のスペースをより有効に利用することのできるフレックスリジッド配線板及びその製造方法を提供することができる場合もある。
図1Aは、本発明の一実施形態に係るフレックスリジッド配線板の側面図である。 図1Bは、本発明の一実施形態に係るフレックスリジッド配線板の平面図である。 図2は、フレキシブル基板の断面図である。 図3は、フレックスリジッド配線板の断面図である。 図4は、図1Aの一部拡大図である。 図5は、複数の製品に共通するウェーハから、フレキシブル基板を切り出す工程を説明するための図である。 図6は、複数の製品に共通するウェーハから、第1及び第2の絶縁層を切り出す工程を説明するための図である。 図7は、複数の製品に共通するウェーハから、セパレータを切り出す工程を説明するための図である。 図8は、リジッド基板のコアを作製する工程を説明するための図である。 図9Aは、第1層を形成する工程を説明するための図である。 図9Bは、第1層を形成する工程を説明するための図である。 図9Cは、第1層を形成する工程を説明するための図である。 図9Dは、第1層を形成する工程を説明するための図である。 図9Eは、第1層を形成する工程を説明するための図である。 図9Fは、第1層を形成する工程を説明するための図である。 図10Aは、第2層を形成する工程を説明するための図である。 図10Bは、第2層を形成する工程を説明するための図である。 図10Cは、第2層を形成する工程を説明するための図である。 図10Dは、第2層を形成する工程を説明するための図である。 図11は、複数の製品に共通するウェーハから、第3及び第4の上層絶縁層を切り出す工程を説明するための図である。 図12は、複数の製品に共通するウェーハから、セパレータを切り出す工程を説明するための図である。 図13Aは、第3層を形成する工程を説明するための図である。 図13Bは、第3層を形成する工程を説明するための図である。 図13Cは、第3層を形成する工程を説明するための図である。 図13Dは、第3層を形成する工程を説明するための図である。 図14Aは、第4層を形成する工程を説明するための図である。 図14Bは、第4層を形成する工程を説明するための図である。 図14Cは、第4層を形成する工程を説明するための図である。 図14Dは、第4層を形成する工程を説明するための図である。 図14Eは、第4層を形成する工程を説明するための図である。 図15Aは、凹部を形成する工程を説明するための図である。 図15Bは、凹部形成後の状態を示す図である。 図15Cは、凹部形成時に残存した銅を取り除いた後の状態を示す図である。 図16は、フレックスリジッド配線板の変形例を説明するための図である。 図17は、凹部に電子部品の配置されたフレックスリジッド配線板を示す図である。 図18Aは、電子部品の実装態様の変形例を示す図である。 図18Bは、電子部品の実装態様の変形例を示す図である。 図19Aは、フレックスリジッド配線板の変形例を説明するための図である。 図19Bは、フレックスリジッド配線板の変形例を説明するための図である。 図19Cは、フレックスリジッド配線板の変形例を説明するための図である。 図20は、フレックスリジッド配線板の変形例を説明するための図である。 図21Aは、フレックスリジッド配線板の変形例を説明するための図である。 図21Bは、フレックスリジッド配線板の変形例を説明するための図である。
符号の説明
 10 フレックスリジッド配線板
 11、12、101乃至103 リジッド基板
 13、104、105 フレキシブル基板
 111、113 絶縁層
 114、115、144、145、172、173 上層絶縁層
 116、119、121、141、146、147、174、175 ヴィア
 117、142 配線パターン
 118、143 引き出しパターン
 120、122、148、149 導体
 123、124、150、151、176、177 導体パターン
 125 樹脂
 131 基材
 132、133 導体層
 134、135 絶縁層
 136、137 シールド層
 138、139 カバーレイ
 180 接続端子
 291、293 セパレータ
 292、294a乃至294c、295a、295b カットライン(切り目)
 300、300a乃至300c 凹部(キャビティ)
 500 電子部品
 1001、1002 対向リジッド基板
 以下、本発明の一実施形態に係るフレックスリジッド配線板及びその製造方法について説明する。
 本実施形態に係るフレックスリジッド配線板10は、図1A及び図1Bに示すように、大きくは、第1のリジッド基板11及び第2のリジッド基板12と、フレキシブル基板13と、から構成され、第1のリジッド基板11と第2のリジッド基板12とは、フレキシブル基板13を挟んで対向配置されている。詳しくは、第1及び第2のリジッド基板11及び12は、フレキシブル基板13の水平方向に配置されている。
 第1及び第2のリジッド基板11、12には、それぞれ任意の回路パターンが形成されている。また、必要に応じて、例えば、半導体チップなどの電子部品などが接続される。一方、フレキシブル基板13には、第1のリジッド基板11の回路パターンと第2のリジッド基板12の回路パターンとを接続するためのストライプ状の配線パターン13aが形成されている。配線パターン13aは、リジッド基板11、12の回路パターン同士を接続する。
 フレキシブル基板13は、図2にその詳細構造を示すように、基材131と、導体層132及び133と、絶縁層134及び135と、シールド層136及び137と、カバーレイ138及び139と、が積層された構造を有する。
 基材131は、絶縁性フレキシブルシート、例えば厚さ「20~50μm」、望ましくは「30μm」程度の厚さのポリイミドシートから構成される。
 導体層132及び133は、例えば厚さ「5~15μm」程度の銅パターンからなり、基材131の表裏にそれぞれ形成されることにより、上述のストライプ状の配線パターン13a(図1B)を構成する。
 絶縁層134及び135は、厚さ「5~15μm」程度のポリイミド膜などから構成され、導体層132及び133を外部から絶縁する。
 シールド層136及び137は、導電層、例えば銀ペーストの硬化被膜から構成され、外部から導体層132及び133への電磁ノイズ及び導体層132、133から外部への電磁ノイズをシールドする。
 カバーレイ138及び139は、厚さ「5~15μm」程度の、ポリイミド等の絶縁膜から形成され、フレキシブル基板13全体を外部から絶縁すると共に保護する。
 一方、リジッド基板11及び12は、それぞれ図3に示すように、リジッド基材112と、第1及び第2の絶縁層111及び113と、第1及び第2の上層絶縁層144及び114と、第3及び第4の上層絶縁層145及び115と、第5及び第6の上層絶縁層172及び173と、が積層されて構成されている。
 リジッド基材112は、リジッド基板11及び12に剛性を与えるものであり、ガラスエポキシ樹脂等のリジッド絶縁材料から構成される。リジッド基材112は、フレキシブル基板13と水平方向に離間して配置されている。リジッド基材112は、フレキシブル基板13とほぼ同一の厚さを有する。また、リジッド基材112の表裏には、それぞれ例えば銅からなる導体パターン112a、112bが形成されている。これら導体パターン112a及び112bは、それぞれ所定の箇所で、より上層の導体(配線)と電気的に接続されている。
 第1及び第2の絶縁層111及び113は、プリプレグを硬化して構成されている。第1及び第2の絶縁層111及び113は、それぞれ「50~100μm」、望ましくは「50μm」程度の厚さを有する。なお、プリプレグは、樹脂がローフロー特性を有することが望ましい。このようなプリプレグは、エポキシ樹脂をガラスクロスに含侵させた後、樹脂を熱硬化させ、予め硬化度を進めておくことで作成することができる。もっとも、ガラスクロスに粘度の高い樹脂を含侵させたり、ガラスクロスに無機フィラー(例えばシリカフィラー)を含む樹脂を含侵させたり、ガラスクロスの樹脂含侵量を減らしたりすることによっても、プリプレグを作成することは可能である。
 リジッド基材112、並びに第1及び第2の絶縁層111及び113は、リジッド基板11及び12のコアを構成し、リジッド基板11及び12を支持すると共にフレキシブル基板13の一端を挟み込んで支持及び固定する。具体的には、図4に図1A中の領域R11(第1のリジッド基板11とフレキシブル基板13との接合部分)を拡大して示すように、第1及び第2の絶縁層111及び113が、リジッド基材112とフレキシブル基板13とを表裏両側から被覆するとともに、フレキシブル基板13の一部を露出している。これら第1及び第2の絶縁層111及び113は、フレキシブル基板13の表面に設けられたカバーレイ138及び139と重合している。
 なお、リジッド基板12とフレキシブル基板13との接続部分の構造は、リジッド基板11とフレキシブル基板13との接続部分の構造(図4)と同様であるため、ここでは、リジッド基板12の接続部分についてはその詳細の説明を割愛する。
 リジッド基材112と、フレキシブル基板13と、第1及び第2の絶縁層111及び113と、により区画される空間(それら部材間の空隙)には、図4に示すように、樹脂125が充填されている。樹脂125は、例えば製造時に、第1及び第2の絶縁層111及び113を構成するローフロープリプレグからしみだしたものであり、第1及び第2の絶縁層111及び113と一体に硬化されている。
 第1及び第2の絶縁層111及び113の、フレキシブル基板13の導体層132及び133の接続パッド13bにそれぞれ対向する各部分には、ヴィア(コンタクトホール)141、116が形成されている。フレキシブル基板13のうち、ヴィア141及び116にそれぞれ対向する各部分(図1Bに示す接続パッド13bが形成されている部分)は、フレキシブル基板13のシールド層136及び137、並びにカバーレイ138及び139が除去されている。ヴィア141及び116は、フレキシブル基板13の絶縁層134及び135をそれぞれ貫通して、導体層132、133からなる各接続パッド13bを露出している。
 ヴィア141及び116の各内面には、それぞれ銅めっき等で形成された配線パターン(導体層)142、117が形成されている。これら配線パターン142及び117のめっき皮膜は、それぞれフレキシブル基板13の導体層132、133の各接続パッド13bに接続されている。また、ヴィア141及び116には、それぞれ樹脂が充填されている。これらヴィア141及び116内の樹脂は、例えばプレスにより上層絶縁層(上層絶縁層144、114)の樹脂が押し出されることにより充填される。さらに、第1及び第2の絶縁層111及び113の各上面には、それぞれ配線パターン142、117に接続された引き出しパターン143、118が形成されている。これら引き出しパターン143及び118は、それぞれ例えば銅めっき層から構成される。また、第1及び第2の絶縁層111及び113の各フレキシブル基板13側端部、すなわちフレキシブル基板13とリジッド基材112との境界よりもフレキシブル基板13側の位置には、それぞれ他から絶縁された導体パターン151、124が配置されている。これら導体パターン151及び124により、リジッド基板11内で発生した熱を、効果的に放熱することができる。
 このように、本実施形態に係るフレックスリジッド配線板10では、リジッド基板11、12とフレキシブル基板13とが、コネクタによらず、電気的に接続されている。すなわち、フレキシブル基板13がリジッド基板11、12の各々に入り込む(埋め込まれる)ことにより、その入り込んだ部分(埋め込まれた部分)で、フレキシブル基板13が、各リジッド基板にそれぞれ電気的に接続されている(図4参照)。このため、落下等により衝撃を受けた場合でも、コネクタが抜けて接触不良が生じることはない。
 また、フレキシブル基板の一部がリジッド基板に埋め込まれているため、フレキシブル基板とリジッド基板が電気的に接続されている箇所の表裏両面を、リジッド基板が接着、補強しており、フレックスリジッド配線板が落下に衝撃を受けた場合、あるいは温度環境が変化してリジッド基板とフレキシブル基板のCTE(熱線膨張率)の差によって応力が発生した場合でも、フレキシブル基板とリジッド基板の電気的な接続が確保できる。
 この意味で、フレックスリジッド配線板10は、コネクタ接続の基板に比べて、より信頼性の高い電気的接続を有する。
 また、フレキシブル基板13の導体層132、133とリジッド基板11、12の配線パターン142、117とは、テーパ状のヴィアにより接続されていることで、基板表面に直交する方向に延びるスルーホールによる接続に比べて、衝撃を受けたときに応力が分散され、クラック等が発生しにくい。しかも、これら導体層132、133と配線パターン142、117とは、めっき皮膜により接続されていることで、接続部分の信頼性が高い。さらに、ヴィア141及び116内にそれぞれ樹脂が充填されることで、接続信頼性が高められている。
 第1及び第2の絶縁層111及び113の各上面には、それぞれ第1、第2の上層絶縁層144、114が積層されている。第1、第2の上層絶縁層144、114には、引き出しパターン143、118にそれぞれ接続されるヴィア(第1の上層ヴィア)146、119が、それぞれ形成されている。さらに、これらヴィア146、119には、それぞれ例えば銅からなる導体148、120が充填されている。なお、第1及び第2の上層絶縁層144及び114は、それぞれ例えば樹脂をガラスクロス等に含浸したプリプレグを硬化して構成される。
 第1及び第2の上層絶縁層144及び114の各上面には、それぞれ第3、第4の上層絶縁層145、115が積層されている。これら第3及び第4の上層絶縁層145及び115も、それぞれ例えば樹脂をガラスクロス等に含浸したプリプレグを硬化して構成される。第3、第4の上層絶縁層145、115には、ヴィア146、119にそれぞれ接続するヴィア(第2の上層ヴィア)147、121が、それぞれ形成されている。これらヴィア147、121には、それぞれ例えば銅からなる導体149、122が充填されており、これら導体149、122は、それぞれ導体148、120と電気的に接続されている。こうして、ヴィア146及び147、並びに119及び121により、フィルド・ビルドアップ・ヴィアが形成されている。
 第3及び第4の上層絶縁層145及び115の各上面には、それぞれ導体パターン(回路パターン)150、123が形成されている。そして、この導体パターン150、123の所定箇所に、それぞれヴィア147、121が接続されることにより、配線パターン117、引き出しパターン118、導体120、及び導体122を介して、導体層133と導体パターン123とが、また、配線パターン142、引き出しパターン143、導体148、及び導体149を介して、導体層132と導体パターン150とが、それぞれ電気的に接続されている。
 第3及び第4の上層絶縁層145及び115の各上面には、さらに図3に示すように、それぞれ第5、第6の上層絶縁層172、173が積層されている。これら第5及び第6の上層絶縁層172及び173も、それぞれ例えば樹脂をガラスクロス等に含浸したプリプレグを硬化して構成される。
 第5、第6の上層絶縁層172、173には、ヴィア147、121にそれぞれ接続するヴィア174、175がそれぞれ形成されている。そして、これらヴィア174、175内を含めて、基板の表裏に、例えば銅からなる導体パターン176、177がそれぞれ形成されている。これら導体パターン176、177は、それぞれ導体149、122と電気的に接続されている。さらに、基板表裏には、それぞれパターニングされたソルダレジスト298、299が設けられており、導体パターン176、177の所定箇所に、それぞれ例えば化学金めっきにより電極178、179が形成されている。
 加えて、フレックスリジッド配線板10の表面、特にリジッド基板12の表面には、所定の寸法(長さ・幅及び深さ)、例えばIC(集積回路)チップ等の電子部品を収納可能な程度の寸法を有する凹部(キャビティ)300が形成されている。こうした凹部300を基板表面に形成することで、凹部300内に、自由に使用可能なスペースが生成される。このスペースには、例えばフレックスリジッド配線板10に電気的に接続される部品、あるいは他の基板に電気的に接続される部品などを配置することができる。このため、フレックスリジッド配線板10を、例えば携帯電話の基板として用いた場合には、電話機本体の薄型化や多機能化に貢献することができる。もっとも、凹部300内のスペースの用途は任意であり、例えば段差を利用して位置決めをするなど、別の用途で用いるようにしてもよい。
 こうしたフレックスリジッド配線板10の製造に際しては、まず、フレキシブル基板13(図2)を製造する。具体的には、所定サイズに加工したポリイミド基材131の両面に銅膜を形成する。続けて、銅膜をパターニングすることにより、配線パターン13a及び接続パッド13bを備える導体層132及び133を形成する。そして、導体層132、133の各表面に、それぞれ積層するかたちで、例えばポリイミドからなる絶縁層134、135を形成する。さらに、これら絶縁層134及び135には、フレキシブル基板13の端部を除いて銀ペーストを塗布し、その塗布した銀ペーストを硬化して、シールド層136、137を形成する。続けて、それらシールド層136、137の各表面を覆うように、カバーレイ138及び139を形成する。なお、シールド層136、137とカバーレイ138、139とは、接続パッド13bを避けて形成される。
 こうした一連の工程を経て、先の図2に示した積層構造を有するウェーハが完成する。このウェーハは、複数の製品に共通する材料として用いられる。すなわち、図5に示すように、このウェーハを、例えばレーザ等により所定の大きさに切断(カット)することにより、所定の大きさのフレキシブル基板13が得られる。
 次に、こうして作製されたフレキシブル基板13と、第1及び第2のリジッド基板11及び12の各リジッド基板とを接合する。この接合にあたっては、例えば図6に示すように、複数の製品に共通するウェーハを、例えばレーザ等により切断して、所定の大きさの、第1及び第2の絶縁層111及び113を用意しておく。また、例えば図7に示すように、複数の製品に共通するウェーハを、例えばレーザ等により切断して、所定の大きさのセパレータ291を用意しておく。
 また、リジッド基板11及び12のコアとなるリジッド基材112も、例えば図8に示すように、複数の製品に共通するウェーハ110から作製する。すなわち、ウェーハ110の表裏に、それぞれ例えば銅からなる導体膜110a、110bを形成した後、例えば所定のリソグラフィ工程(前処理、ラミネート、露光、現像、エッチング、剥膜、内層検査等)を経ることによりそれら導体膜110a、110bをそれぞれパターニングして、導体パターン112a、112bを形成する。続けて、例えばレーザ等により、ウェーハ110の所定の部分を除去して、リジッド基板11及び12のリジッド基材112を得る。その後、こうして作製されたリジッド基材112の導体パターン表面を処理して粗化面を形成する。
 なお、リジッド基材112は、例えば「50~150μm」、望ましくは「100μm」程度の厚さのガラスエポキシ基材から構成され、第1及び第2の絶縁層111及び113は、例えば「20~50μm」の厚さのプリプレグから構成される。また、セパレータ291は、例えば硬化したプリプレグ、又はポリイミドフィルム等から構成される。第1及び第2の絶縁層111及び113の厚さは、例えばリジッド基板11及び12をその表裏で対照的な構造とすべく、同程度の厚さに設定する。セパレータ291の厚さは、第2の絶縁層113の厚さと同程度に設定する。また、リジッド基材112の厚さと、フレキシブル基板13の厚さとは、概ね同じであることが望ましい。こうすることで、リジッド基材112とカバーレイ138及び139との間に存在する空隙に、樹脂125が充填され、フレキシブル基板13とリジッド基材112とを、より確実に接合することができるようになる。
 続けて、図5、図6、及び図8の工程にてカットした第1及び第2の絶縁層111及び113、リジッド基材112、並びにフレキシブル基板13を位置合わせして、例えば図9Aに示すように配置する。このとき、フレキシブル基板13の各端部は、第1及び第2の絶縁層111及び113の間に挟み込んで位置合わせする。
 さらに、例えば図9Bに示すように、図7の工程にてカットしたセパレータ291を、リジッド基板11とリジッド基板12との間に露出するフレキシブル基板13の片面(例えば上方)に、第2の絶縁層113と並べて配置し、その外側に(表裏にそれぞれ)、例えば銅からなる導体膜161、162を配置する。セパレータ291は、例えば接着剤により固定する。こうした構造であれば、セパレータ291が導体膜162を支持するため、フレキシブル基板13と導体膜162との間の空隙にめっき液が滲入して銅箔が破れるなどの問題を防止又は抑制することができる。
 次に、こうして位置合わせした状態(図9B)で、この構造体を、例えば図9Cに示すように、加圧プレスする。このとき、第1及び第2の絶縁層111及び113を構成する各プリプレグからそれぞれ樹脂125が押し出され、先の図4に示したように、この樹脂125により、リジッド基材112とフレキシブル基板13との間の空隙が充填される。このように、樹脂125が空隙に充填されることで、フレキシブル基板13とリジッド基材112とが確実に接着される。こうした加圧プレスは、例えばハイドロプレス装置を用いて、温度摂氏「200度」、圧力「40kgf」、加圧時間「3hr」程度の条件で行う。
 続けて、全体を加熱する等して、第1及び第2の絶縁層111及び113を構成するプリプレグ及び樹脂125を硬化し、一体化する。このとき、フレキシブル基板13のカバーレイ138及び139(図4)と、第1及び第2の絶縁層111及び113の樹脂とは重合する。絶縁層111及び113の樹脂が重合することで、ヴィア141及び116(後工程で形成)の周囲が樹脂で固定され、ヴィア141と導体層132(又はヴィア116と導体層133)の各接続部位の接続信頼性が向上する。
 次に、例えば所定の前処理の後、例えばCOレーザ加工装置からCOレーザを照射することにより、図9Dに示すように、貫通孔163を形成する。このとき、フレキシブル基板13(図4)の導体層132、133とリジッド基板11、12とをそれぞれ接続するためのヴィア116、141(例えばIVH(Interstitial Via Hole))も形成する。
 続けて、デスミア(スミア除去)、ソフトエッチをした後、例えば図9Eに示すように、PNめっき(例えば化学銅めっき及び電気銅めっき)をすることにより、構造体全体の表面に銅めっきを施す。この銅めっきによる銅と既存の導体膜161、162とが一体になって、ヴィア116及び141内並びに貫通孔163内も含め、基板全体の表面に銅膜171が形成される。このとき、フレキシブル基板13は、導体膜161及び162で覆われており、めっき液に直接触れない。したがって、フレキシブル基板13がめっき液によってダメージを受けることはない。
 続けて、例えば所定のリソグラフィ工程(前処理、ラミネート、露光、現像、エッチング、剥膜、内層検査等)を経ることにより、図9Fに示すように、基板表面の銅膜171をパターニングする。これにより、フレキシブル基板13(図4)の導体層132、133にそれぞれ接続される配線パターン142、117及び引き出しパターン143、118、さらには導体パターン151、124が形成される。この際、第1及び第2の絶縁層111及び113の各フレキシブル基板13側端部には、それぞれ銅箔を残存させる。そしてその後、銅箔表面を処理して粗化面を形成する。
 続けて、例えば図10Aに示すように、その結果物の表裏に、それぞれ第1、第2の上層絶縁層144、114を配置し、さらにその外側に、例えば銅からなる導体膜114a、144aを配置する。続けて、図10Bに示すように、この構造体を加圧プレスする。このとき、第1及び第2の上層絶縁層114及び144を構成する各プリプレグからの樹脂によりヴィア116及び141が充填される。そしてその後、例えば加熱処理等により、プリプレグ及びヴィア内の樹脂を硬化して、第1及び第2の上層絶縁層144及び114を固化する。
 続けて、例えばハーフエッチにより、所定の厚さまで導体膜114a及び144aをそれぞれ薄膜化する。そして、所定の前処理の後、例えばレーザにより、第1の上層絶縁層144にヴィア146を、また第2の上層絶縁層114にヴィア119及びカットライン292を、それぞれ形成し、デスミア(スミア除去)、ソフトエッチをした後、例えば図10Cに示すように、PNめっき(例えば化学銅めっき及び電気銅めっき)をすることにより、それらヴィア146及び119内、並びにカットライン292内に、導体を形成する。なお、この導体は、導電ペースト(例えば導電粒子入り熱硬化樹脂)を、例えばスクリーン印刷法で印刷することによっても形成することができる。
 続けて、例えばハーフエッチにより、所定の厚さまで基板表面の導体膜を薄くし、その後、例えば所定のリソグラフィ工程(前処理、ラミネート、露光、現像、エッチング、剥膜、内層検査等)を経ることにより、図10Dに示すように、基板表面の導体膜をパターニングする。これにより、導体148及び120が形成される。また、カットライン292内の導体は、エッチングにより除去される。続けて、そしてその後、導体表面を処理して粗化面を形成する。
 ここで、次の工程の説明の前に、その工程に先立って行われる工程について説明する。すなわち、次の工程に先立ち、図11に示すように、複数の製品に共通するウェーハを、例えばレーザ等により切断して、所定の大きさの第3及び第4の上層絶縁層145及び115を形成しておく。また、セパレータ293についても、複数の製品に共通するウェーハを、例えばレーザ等により切断することで、図12に示すように、所定の大きさのものを形成しておく。なお、セパレータ293は、例えば硬化したプリプレグ、ポリイミドフィルム等から構成される。
 そして、続く工程では、図13Aに示すように、基板表裏に、図11及び図12の工程にてカットした第3及び第4の上層絶縁層145及び115、並びにセパレータ293を配置し、その外側に(表裏にそれぞれ)、例えば銅からなる導体膜145a、115aを配置する。その後、例えば加熱などして、第3及び第4の上層絶縁層145及び115を固化する。なお、第3及び第4の上層絶縁層145及び115は、それぞれ例えばガラスクロスに樹脂を含浸して構成された通常のプリプレグから構成される。
 続けて、図13Bに示すように、結果物を、プレスする。その後、例えばハーフエッチにより、所定の厚さまで導体膜145a及び115aをそれぞれ薄膜化する。そして、所定の前処理の後、例えばレーザにより、第3及び第4の上層絶縁層145、115にそれぞれヴィア147、121を形成し、デスミア(スミア除去)、ソフトエッチをした後、例えば図13Cに示すように、PNめっき(例えば化学銅めっき及び電気銅めっき)をすることにより、それらヴィア147及び121内を導体で充填する。このように、ヴィア147及び121の内部を同一の導電ペースト材料で充填することで、ヴィア147及び121の熱応力がかかった際の接続信頼性を向上させることができる。なお、この導体は、導電ペースト(例えば導電粒子入り熱硬化樹脂)を、例えばスクリーン印刷法で印刷することによっても形成することができる。
 続けて、図13Dに示すように、例えばハーフエッチにより、所定の厚さまで基板表面の導体膜を薄くし、その後、例えば所定のリソグラフィ工程(前処理、ラミネート、露光、現像、エッチング、剥膜、内層検査等)を経ることにより、基板表面の銅膜をパターニングする。これにより、導体149及び122、並びに導体パターン150及び123が形成される。その後、結果物を黒化処理する。
 続けて、図14Aに示すように、結果物の表裏に、第5及び第6の上層絶縁層172及び173を配置し、その外側に(表裏にそれぞれ)、例えば銅からなる導体膜172a及び173aを配置する。なお、第5及び第6の上層絶縁層172及び173は、それぞれ例えばガラスクロスに樹脂を含浸して構成されたプリプレグから構成される。
 続けて、図14Bに示すように、プレスする。その後、例えばハーフエッチにより、所定の厚さまで導体膜172a及び173aをそれぞれ薄膜化する。そして、所定の前処理の後、レーザ光などにより、第5、第6の上層絶縁層172、173にそれぞれヴィア174、175を形成するとともに、図14Cに示すように、図14B中に破線にて示す各部の絶縁層、すなわちセパレータ291の端部(第2の絶縁層113とセパレータ291の境界部分)及びセパレータ293の端部(第4の上層絶縁層115とセパレータ293との境界部分)の絶縁層を除去して、カットライン(切り目)294a乃至294c、295a、及び295bを形成する。このとき、カットライン294a乃至294cは、例えば導体パターン151及び124をストッパとして、形成(カット)する。また、カットライン295a及び295bは、例えば導体パターン123をストッパとして、形成する。この際、ストッパとして使用する導体パターン123、124、及び151を、ある程度カットするようにエネルギー又は照射時間を調整することもできる。
 続けて、PNめっき(例えば化学銅めっき及び電気銅めっき)をすることにより、ヴィア174及び175内も含め、基板全体の表面に導体を形成する。続けて、例えばハーフエッチにより、所定の厚さまで基板表面の導体膜を薄くし、その後、例えば所定のリソグラフィ工程(前処理、ラミネート、露光、現像、エッチング、剥膜等)を経ることにより、基板表面の銅箔をパターニングする。こうして、図14Dに示すように、導体パターン176及び177を形成する。そして、パターン形成後、そのパターンを検査する。
 続けて、例えばスクリーン印刷により、基板全体の表面にソルダレジストを形成し、図14Eに示すように、所定のリソグラフィ工程を経ることにより、そのソルダレジストをパターニングする。その後、例えば加熱などして、そのパターニングしたソルダレジスト298及び299を硬化させる。
 続けて、セパレータ291の端部及びセパレータ293の端部(図14B中の破線参照)等に、穴明け及び外形加工をした後、図15Aに示すように、構造体301乃至303をフレキシブル基板13から引きはがすようにして除去する。この際、セパレータ291及び293が配置されているので、分離が容易である。また、構造体301乃至303が他の部分から分離(除去)されるとき、導体パターン151は、フレキシブル基板13のカバーレイ138及び139にプレスにより押しつけられているにすぎず、固着していない(図9C参照)ため、構造体301乃至303と共に、導体パターン151の一部(フレキシブル基板13と接触する部分)も除去される。
 こうして、フレキシブル基板13の中央部を露出させることで、フレキシブル基板13の表裏(絶縁層の積層方向)に、フレキシブル基板13が撓む(曲がる)ためのスペース(領域R1及びR2)が形成される。これにより、フレックスリジッド配線板10を、そのフレキシブル基板13の部分で、折り曲げることなどが可能になる。
 さらに、フレックスリジッド配線板10の表面、特にリジッド基板12の表面の、セパレータ293の部分(領域R3)には、凹部(キャビティ)300が形成される。こうした凹部300は、前述のように、例えば電子部品の収納等に用いることができる。
 除去された部分(領域R1乃至R3)に面する各絶縁層の先端部分には、例えば図15B中に破線にて示すように、導体パターン124及び151、並びに導体パターン123が残存する。この残存した銅は、必要に応じて、図15Cに示すように、例えばマスクエッチング(前処理、ラミネート、露光、現像、エッチング、剥膜等)により除去する。
 続けて、例えば化学金めっきにより、電極178、179を形成し、その後、外形加工、反り修正、通電検査、外観検査、及び最終検査を経て、先の図3に示したフレックスリジッド配線板10が完成する。このフレックスリジッド配線板10は、上述のように、リジッド基板11及び12のコア部(第1及び第2の絶縁層111及び113)の間にフレキシブル基板13の端部が挟みこまれ、且つ、リジッド基板11、12の各ランドとフレキシブル基板13の各接続パッドとがそれぞれめっき皮膜により接続された構造を有する。また、このフレックスリジッド配線板10の表面には、凹部300が形成されている。
 以上、本発明の一実施形態に係るフレックスリジッド配線板10について説明したが、本発明は、上記実施形態に限定されるものではない。
 例えば図16に示すように、凹部300内に、電子部品を実装するための接続端子180を形成することで、電子部品の実装が容易になる。接続端子180は、例えば先の図10C、図10Dに示した工程において、導体120と共に形成する。図16に示す例では、いわゆるフリップチップ接続により、電子部品500(ICチップ)を実装している。詳しくは、電子部品500の電極501に設けられたAuバンプ502と、接続端子180とを、導電性接着剤503により電気的に接続し、その接続部分を絶縁樹脂504で覆っている。
 なお、こうした電子部品を実装するための電極や配線の材質等は、任意である。例えば図17に示すように、導電粒子503aを含有するACF(Anisotropic Conductive Film)を用いて、電子部品500と接続端子180とを電気的に接続するようにしてもよい。こうしたACF接続であれば、位置合わせを容易にすることができる。また、例えばAu-Au接続により、電子部品を実装するようにしてもよい。こうしたAu-Au接続であれば、腐食に強い接続部を形成することができる。
 また接続方法も、フリップチップ接続に限られず任意である。例えば図18Aに示すように、ワイヤ503bを介して、ワイヤボンディングで電子部品を実装するようにしてもよい。また、例えば図18Bに示すように、スプリング503cを介して、電子部品を実装するようにしてもよい。あるいは、コネクタにより、電子部品を実装するようにしてもよい。
 また、例えば図19Aに示すように、リジッド基板12の表面だけでなく、リジッド基板11の表面にも、凹部300aを形成するようにしてもよい。また、図19Bに示すように、リジッド基板11表面(絶縁層の積層方向の一端面)の凹部300aに加え、リジッド基板12の表裏(絶縁層の積層方向の両端面)にそれぞれ凹部300、300bを形成するようにしてもよい。さらに、図19Cに示すように、リジッド基板12表裏の凹部300及び300bに加え、リジッド基板11の表裏にも、それぞれ凹部300a、300cを形成するようにしてもよい。
 凹部(窪み)は、上述したセパレータ293を用いる方法によらず、選択的なエッチング等によりその空間に対応した部分(領域R3)を除去して形成するようにしてもよい。ただし、セパレータ293を用いることで、深い凹部(窪み)も、容易に形成することができる。
 上記実施形態において、各層の材質、サイズ、層数等は、任意に変更可能である。例えばプリプレグに代えて、RCF(Resin Coated Cupper Foil)を用いることもできる。
 また、例えば図20に示すように、リジッド基板11は、コア表裏の一方のみに導体(配線層)を有するものであってもよい(リジッド基板12も同様)。
 また、フレキシブル基板により、3つ以上のリジッド基板を接続するようにしてもよい。例えば図21A又は図21Bに示すように、フレキシブル基板104、105を挟んで対向配置されるリジッド基板の組(対向リジッド基板)として、リジッド基板101とリジッド基板102とから構成される対向リジッド基板1001、及び、リジッド基板101とリジッド基板103とから構成される対向リジッド基板1002を備える構造としてもよい。リジッド基板102及び103は、共通のリジッド基板101に対向配置されている。図21Aの例では、対向リジッド基板1001と対向リジッド基板1002とが、互いに「90°」の角度をもって配置されている。図21Bの例では、対向リジッド基板1001と対向リジッド基板1002とが、互いに「180°」の角度をもって配置されている。こうした構造を有するフレックスリジッド配線板についても、それら3つのリジッド基板101乃至103のうち、少なくとも1つの基板の一方の主面又は表裏両面に少なくとも1つの凹部を設けることで、上述の効果に準ずる効果を得ることができる。また、3組以上の対向リジッド基板を備える構成としてもよい。
 以上、本発明の実施形態について説明したが、設計上の都合やその他の要因によって必要となる様々な修正や組み合わせは、「請求項」に記載されている発明や「発明の実施の形態」に記載されている具体例に対応する発明の範囲に含まれると理解されるべきである。
 本出願は、2008年7月30日に出願された米国特許仮出願第61/084685号に基づく。本明細書中に、米国特許仮出願第61/084685号の明細書、特許請求の範囲、図面全体を参照として取り込む。
 本発明は、一部がフレキシブル基板から構成された折り曲げ可能なフレックスリジッド配線板に適用可能である。

Claims (32)

  1.  少なくとも1つの導体を有するリジッド基板と、少なくとも1つの導体を有するフレキシブル基板とを備え、
     前記リジッド基板の表面に、少なくとも1つの凹部が形成され、
     前記フレキシブル基板の導体の少なくとも1つと、前記リジッド基板の導体の少なくとも1つとが電気的に接続されている、
     ことを特徴とするフレックスリジッド配線板。
  2.  前記フレキシブル基板の少なくとも一部が、前記リジッド基板に埋め込まれており、該埋め込まれた部分で、前記フレキシブル基板の導体の少なくとも1つと前記リジッド基板の導体の少なくとも1つとが電気的に接続されている、
     ことを特徴とする請求項1に記載のフレックスリジッド配線板。
  3.  前記リジッド基板のうち、少なくとも1つの基板は、複数の絶縁層が積層されて形成されている、
     ことを特徴とする請求項1に記載のフレックスリジッド配線板。
  4.  前記凹部の少なくとも1つには、電子部品を実装するための接続端子が少なくとも1つ形成されている、
     ことを特徴とする請求項1に記載のフレックスリジッド配線板。
  5.  前記凹部の少なくとも1つに形成された前記接続端子には、電子部品が実装されている、
     ことを特徴とする請求項4に記載のフレックスリジッド配線板。
  6.  前記電子部品は、フリップチップ接続により、前記接続端子に実装されている、
     ことを特徴とする請求項5に記載のフレックスリジッド配線板。
  7.  前記フレキシブル基板は導体パターンを有し、
     前記リジッド基板は、前記フレキシブル基板の水平方向に配置され、
     前記フレキシブル基板と前記リジッド基板とを被覆し、前記フレキシブル基板の少なくとも一部を露出する絶縁層を備え、
     該絶縁層上には、導体パターンが形成されており、
     前記フレキシブル基板の導体パターンと前記絶縁層上の導体パターンとはめっき皮膜により接続されている、
     ことを特徴とする請求項1に記載のフレックスリジッド配線板。
  8.  少なくとも1つの導体を有するリジッド基板と、少なくとも1つの導体を有するフレキシブル基板とを備え、
     複数の前記リジッド基板は、前記フレキシブル基板を挟んで対向配置される対向リジッド基板を少なくとも1組構成し、
     前記対向リジッド基板を構成する少なくとも1つのリジッド基板の表面には、少なくとも1つの凹部が形成され、
     前記フレキシブル基板の導体の少なくとも1つと、前記リジッド基板の導体の少なくとも1つとが電気的に接続されている、
     ことを特徴とするフレックスリジッド配線板。
  9.  前記対向リジッド基板を構成するリジッド基板のうち、一の基板の一方の主面又は表裏両面には、少なくとも1つの凹部が形成されている、
     ことを特徴とする請求項8に記載のフレックスリジッド配線板。
  10.  前記対向リジッド基板を構成するリジッド基板のうち、前記一の基板に対向する他の基板の一方の主面又は表裏両面には、少なくとも1つの凹部が形成されている、
     ことを特徴とする請求項9に記載のフレックスリジッド配線板。
  11.  前記対向リジッド基板を構成するリジッド基板のうち、一の基板の表裏各面には、それぞれ少なくとも1つの凹部が形成されている、
     ことを特徴とする請求項8に記載のフレックスリジッド配線板。
  12.  前記対向リジッド基板を構成するリジッド基板のうち、前記一の基板に対向する他の基板の表裏各面には、それぞれ少なくとも1つの凹部が形成されている、
     ことを特徴とする請求項11に記載のフレックスリジッド配線板。
  13.  前記フレキシブル基板の少なくとも一部が、前記リジッド基板に埋め込まれており、該埋め込まれた部分で、前記フレキシブル基板の導体の少なくとも1つと前記リジッド基板の導体の少なくとも1つとが電気的に接続されている、
     ことを特徴とする請求項8に記載のフレックスリジッド配線板。
  14.  前記リジッド基板のうち、少なくとも1つの基板には、複数の絶縁層が積層されて形成されている、
     ことを特徴とする請求項8に記載のフレックスリジッド配線板。
  15.  前記凹部の少なくとも1つには、電子部品を実装するための接続端子が少なくとも1つ形成されている、
     ことを特徴とする請求項8に記載のフレックスリジッド配線板。
  16.  前記凹部の少なくとも1つに形成された前記接続端子には、電子部品が実装されている、
     ことを特徴とする請求項15に記載のフレックスリジッド配線板。
  17.  前記電子部品は、フリップチップ接続により、前記接続端子に実装されている、
     ことを特徴とする請求項16に記載のフレックスリジッド配線板。
  18.  前記フレキシブル基板は導体パターンを有し、
     前記対向リジッド基板は、前記フレキシブル基板の水平方向に配置され、
     前記フレキシブル基板と前記リジッド基板とを被覆し、前記フレキシブル基板の少なくとも一部を露出する絶縁層を備え、
     該絶縁層上には、導体パターンが形成されており、
     前記フレキシブル基板の導体パターンと前記絶縁層上の導体パターンとはめっき皮膜により接続されている、
     ことを特徴とする請求項8に記載のフレックスリジッド配線板。
  19.  少なくとも1つの導体を有するリジッド基板と、少なくとも1つの導体を有するフレキシブル基板とを備え、
     複数の前記リジッド基板は、前記フレキシブル基板を挟んで対向配置される対向リジッド基板を少なくとも2組構成し、
     前記対向リジッド基板を構成する少なくとも1つのリジッド基板の表面には、少なくとも1つの凹部が形成され、
     前記フレキシブル基板の導体の少なくとも1つと、前記リジッド基板の導体の少なくとも1つとが電気的に接続されている、
     ことを特徴とするフレックスリジッド配線板。
  20.  前記対向リジッド基板の少なくとも1つを構成するリジッド基板のうち、一の基板の一方の主面又は表裏両面には、少なくとも1つの凹部が形成されている、
     ことを特徴とする請求項19に記載のフレックスリジッド配線板。
  21.  前記対向リジッド基板の少なくとも1つを構成するリジッド基板のうち、前記一の基板に対向する少なくとも1つの他の基板の一方の主面又は表裏両面には、少なくとも1つの凹部が形成されている、
     ことを特徴とする請求項20に記載のフレックスリジッド配線板。
  22.  前記対向リジッド基板の少なくとも1つを構成するリジッド基板のうち、一の基板の表裏各面には、それぞれ少なくとも1つの凹部が形成されている、
     ことを特徴とする請求項19に記載のフレックスリジッド配線板。
  23.  前記対向リジッド基板の少なくとも1つを構成するリジッド基板のうち、前記一の基板に対向する少なくとも1つの他の基板の表裏各面には、それぞれ少なくとも1つの凹部が形成されている、
     ことを特徴とする請求項22に記載のフレックスリジッド配線板。
  24.  前記少なくとも2組の対向リジッド基板は、少なくとも2つのリジッド基板が、それぞれ前記フレキシブル基板を挟んで、共通のリジッド基板に対向配置されてなる、
     ことを特徴とする請求項19に記載のフレックスリジッド配線板。
  25.  前記フレキシブル基板の少なくとも一部が、前記リジッド基板に埋め込まれており、該埋め込まれた部分で、前記フレキシブル基板の導体の少なくとも1つと前記リジッド基板の導体の少なくとも1つとが電気的に接続されている、
     ことを特徴とする請求項19に記載のフレックスリジッド配線板。
  26.  前記リジッド基板のうち、少なくとも1つの基板には、複数の絶縁層が積層されて形成されている、
     ことを特徴とする請求項19に記載のフレックスリジッド配線板。
  27.  前記凹部の少なくとも1つには、電子部品を実装するための接続端子が少なくとも1つ形成されている、
     ことを特徴とする請求項19に記載のフレックスリジッド配線板。
  28.  前記凹部の少なくとも1つに形成された前記接続端子には、電子部品が実装されている、
     ことを特徴とする請求項27に記載のフレックスリジッド配線板。
  29.  前記電子部品は、フリップチップ接続により、前記接続端子に実装されている、
     ことを特徴とする請求項28に記載のフレックスリジッド配線板。
  30.  前記フレキシブル基板は導体パターンを有し、
     前記対向リジッド基板の少なくとも1組は、前記フレキシブル基板の水平方向に配置され、
     前記フレキシブル基板と前記リジッド基板とを被覆し、前記フレキシブル基板の少なくとも一部を露出する絶縁層を備え、
     該絶縁層上には、導体パターンが形成されており、
     前記フレキシブル基板の導体パターンと前記絶縁層上の導体パターンとはめっき皮膜により接続されている、
     ことを特徴とする請求項19に記載のフレックスリジッド配線板。
  31.  絶縁層が積層されてなるリジッド基板を備えるフレックスリジッド配線板の製造方法であって、
     セパレータを設けた状態で前記絶縁層を積層し、その積層の後、上層の絶縁層ごと前記セパレータを除去することにより、前記リジッド基板の表面に、前記セパレータの形状に対応した形状の凹部を形成する工程を備える、
     ことを特徴とするフレックスリジッド配線板の製造方法。
  32.  前記セパレータの除去に際しては、前記上層の絶縁層の所定部位に切り目を形成し、その切り目により、該上層の絶縁層ごと前記セパレータを他の部分から分離させ、除去する、
     ことを特徴とする請求項31に記載のフレックスリジッド配線板の製造方法。
PCT/JP2008/073258 2008-07-30 2008-12-19 フレックスリジッド配線板及びその製造方法 WO2010013366A1 (ja)

Priority Applications (2)

Application Number Priority Date Filing Date Title
JP2010522587A JPWO2010013366A1 (ja) 2008-07-30 2008-12-19 フレックスリジッド配線板及びその製造方法
CN2008801305616A CN102106197A (zh) 2008-07-30 2008-12-19 刚挠性电路板以及其制造方法

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
US8468508P 2008-07-30 2008-07-30
US61/084,685 2008-07-30

Publications (1)

Publication Number Publication Date
WO2010013366A1 true WO2010013366A1 (ja) 2010-02-04

Family

ID=41607169

Family Applications (1)

Application Number Title Priority Date Filing Date
PCT/JP2008/073258 WO2010013366A1 (ja) 2008-07-30 2008-12-19 フレックスリジッド配線板及びその製造方法

Country Status (6)

Country Link
US (2) US8609991B2 (ja)
JP (1) JPWO2010013366A1 (ja)
KR (1) KR20100101000A (ja)
CN (1) CN102106197A (ja)
TW (1) TW201006335A (ja)
WO (1) WO2010013366A1 (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN102149251A (zh) * 2010-02-05 2011-08-10 揖斐电株式会社 刚挠性电路板及其制造方法
JP2014523120A (ja) * 2011-11-18 2014-09-08 北大方正集▲団▼有限公司 硬質可撓性プリント回路基板の製造方法および硬質可撓性プリント回路基板

Families Citing this family (27)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP4574288B2 (ja) * 2004-04-09 2010-11-04 大日本印刷株式会社 リジッド−フレキシブル基板の製造方法
US7982135B2 (en) * 2006-10-30 2011-07-19 Ibiden Co., Ltd. Flex-rigid wiring board and method of manufacturing the same
JP2011119616A (ja) * 2009-12-07 2011-06-16 Fujitsu Ltd プリント配線基板の製造方法、プリント配線基板、および電子装置
US20110147069A1 (en) * 2009-12-18 2011-06-23 International Business Machines Corporation Multi-tiered Circuit Board and Method of Manufacture
CN102548253B (zh) * 2010-12-28 2013-11-06 富葵精密组件(深圳)有限公司 多层电路板的制作方法
KR101241544B1 (ko) 2011-06-10 2013-03-11 엘지이노텍 주식회사 인쇄회로기판 및 그의 제조 방법
CN103458605B (zh) * 2012-05-30 2016-12-14 欣兴电子股份有限公司 软硬复合电路板及其制作方法
KR102142521B1 (ko) * 2013-12-26 2020-08-07 삼성전기주식회사 경연성 인쇄회로기판 및 그의 제조 방법
KR20150125424A (ko) * 2014-04-30 2015-11-09 삼성전기주식회사 강연성 인쇄회로기판 및 강연성 인쇄회로기판의 제조 방법
US9681558B2 (en) 2014-08-12 2017-06-13 Infineon Technologies Ag Module with integrated power electronic circuitry and logic circuitry
US10211158B2 (en) 2014-10-31 2019-02-19 Infineon Technologies Ag Power semiconductor module having a direct copper bonded substrate and an integrated passive component, and an integrated power module
KR20160073766A (ko) * 2014-12-17 2016-06-27 삼성전기주식회사 연성 인쇄회로기판 및 그 제조 방법
KR101750836B1 (ko) * 2015-10-14 2017-06-27 대덕전자 주식회사 캐비티 회로기판 제조방법
KR101726568B1 (ko) 2016-02-24 2017-04-27 대덕전자 주식회사 회로기판 제조방법
US10993635B1 (en) 2016-03-22 2021-05-04 Flextronics Ap, Llc Integrating biosensor to compression shirt textile and interconnect method
CN108538799B (zh) * 2017-03-02 2024-02-27 弗莱克斯有限公司 互连部件和互连组件
US11224117B1 (en) 2018-07-05 2022-01-11 Flex Ltd. Heat transfer in the printed circuit board of an SMPS by an integrated heat exchanger
US11357111B2 (en) * 2018-08-27 2022-06-07 Tactotek Oy Method for manufacturing a multilayer structure with embedded functionalities and related multilayer structure
US10985484B1 (en) 2018-10-01 2021-04-20 Flex Ltd. Electronic conductive interconnection for bridging across irregular areas in a textile product
US10638616B1 (en) * 2018-10-30 2020-04-28 Taiwan Semiconductor Manufacturing Co., Ltd. Circuit carrier and manifacturing method thereof
KR102426308B1 (ko) * 2018-12-04 2022-07-28 삼성전기주식회사 인쇄회로기판 및 이를 포함하는 모듈
US11129284B2 (en) * 2019-09-16 2021-09-21 Apple Inc. Display system and rigid flex PCB with flip chip bonded inside cavity
EP3820258A1 (en) * 2019-11-08 2021-05-12 AT & S Austria Technologie & Systemtechnik Aktiengesellschaft Component carrier with exposed layer
KR20210073805A (ko) * 2019-12-11 2021-06-21 삼성전기주식회사 인쇄회로기판, 이를 포함하는 디스플레이 장치, 및 인쇄회로기판의 제조방법
CN114554673B (zh) * 2020-11-25 2024-03-15 鹏鼎控股(深圳)股份有限公司 柔性电路板及柔性电路板的制作方法
CN115706015A (zh) * 2021-08-11 2023-02-17 群创光电股份有限公司 制造电子装置的方法
CN114599164B (zh) * 2022-03-11 2023-09-29 博敏电子股份有限公司 一种解决cob产品外层线路铜皮破损的方法

Citations (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6158294A (ja) * 1984-08-29 1986-03-25 シャープ株式会社 印刷配線板の製造法
JP2003086761A (ja) * 2001-09-14 2003-03-20 Casio Comput Co Ltd 半導体装置およびその製造方法
JP2003332743A (ja) * 2002-05-14 2003-11-21 Olympus Optical Co Ltd リジットフレキシブル基板
JP4021472B1 (ja) * 2006-10-24 2007-12-12 イビデン株式会社 フレックスリジッド配線板及びその製造方法
JP4024846B1 (ja) * 2006-10-30 2007-12-19 イビデン株式会社 フレックスリジッド配線板及びその製造方法
JP2008131040A (ja) * 2006-11-21 2008-06-05 Samsung Electro Mech Co Ltd 印刷回路基板及びその製造方法
JP2008140941A (ja) * 2006-11-30 2008-06-19 Olympus Corp 実装構造

Family Cites Families (17)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4715928A (en) * 1985-09-27 1987-12-29 Hamby Bill L Flexible printed circuits and methods of fabricating and forming plated thru-holes therein
US4860442A (en) * 1988-11-28 1989-08-29 Kulite Semiconductor Methods for mounting components on convoluted three-dimensional structures
JP2676112B2 (ja) * 1989-05-01 1997-11-12 イビデン株式会社 電子部品搭載用基板の製造方法
US5206463A (en) * 1990-07-24 1993-04-27 Miraco, Inc. Combined rigid and flexible printed circuits and method of manufacture
JPH05259647A (ja) * 1992-03-13 1993-10-08 Toshiba Corp プリント配線板
JP3261179B2 (ja) 1992-11-19 2002-02-25 株式会社トキメック 薄膜製造装置
US6842585B2 (en) 2002-04-18 2005-01-11 Olympus Optical Co., Ltd. Camera
JP4408343B2 (ja) * 2003-04-30 2010-02-03 日本圧着端子製造株式会社 多層プリント配線板の接続構造
WO2005122657A1 (ja) * 2004-06-11 2005-12-22 Ibiden Co., Ltd. フレックスリジッド配線板とその製造方法
JP2006140213A (ja) 2004-11-10 2006-06-01 Cmk Corp リジッドフレックス多層プリント配線板
JP5057653B2 (ja) * 2005-04-06 2012-10-24 エルナー株式会社 フレックスリジッド配線基板及びその製造方法
JP2007067244A (ja) * 2005-08-31 2007-03-15 Sony Corp 回路基板
JP4777759B2 (ja) * 2005-12-01 2011-09-21 富士フイルム株式会社 配線基板及び配線基板接続装置
JP4849908B2 (ja) 2006-02-27 2012-01-11 株式会社フジクラ リジッド基板の接続構造
JP5168838B2 (ja) 2006-07-28 2013-03-27 大日本印刷株式会社 多層プリント配線板及びその製造方法
US8071883B2 (en) 2006-10-23 2011-12-06 Ibiden Co., Ltd. Flex-rigid wiring board including flexible substrate and non-flexible substrate and method of manufacturing the same
US7982135B2 (en) 2006-10-30 2011-07-19 Ibiden Co., Ltd. Flex-rigid wiring board and method of manufacturing the same

Patent Citations (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6158294A (ja) * 1984-08-29 1986-03-25 シャープ株式会社 印刷配線板の製造法
JP2003086761A (ja) * 2001-09-14 2003-03-20 Casio Comput Co Ltd 半導体装置およびその製造方法
JP2003332743A (ja) * 2002-05-14 2003-11-21 Olympus Optical Co Ltd リジットフレキシブル基板
JP4021472B1 (ja) * 2006-10-24 2007-12-12 イビデン株式会社 フレックスリジッド配線板及びその製造方法
JP4024846B1 (ja) * 2006-10-30 2007-12-19 イビデン株式会社 フレックスリジッド配線板及びその製造方法
JP2008131040A (ja) * 2006-11-21 2008-06-05 Samsung Electro Mech Co Ltd 印刷回路基板及びその製造方法
JP2008140941A (ja) * 2006-11-30 2008-06-19 Olympus Corp 実装構造

Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN102149251A (zh) * 2010-02-05 2011-08-10 揖斐电株式会社 刚挠性电路板及其制造方法
US8493747B2 (en) 2010-02-05 2013-07-23 Ibiden Co., Ltd. Flex-rigid wiring board and method for manufacturing the same
CN102149251B (zh) * 2010-02-05 2014-07-30 揖斐电株式会社 刚挠性电路板及其制造方法
JP2014523120A (ja) * 2011-11-18 2014-09-08 北大方正集▲団▼有限公司 硬質可撓性プリント回路基板の製造方法および硬質可撓性プリント回路基板
KR101570730B1 (ko) * 2011-11-18 2015-11-20 피킹 유니버시티 파운더 그룹 컴퍼니, 리미티드 리지드 플렉시블 인쇄회로기판의 제작 방법 및 리지드 플렉시블 인쇄회로기판

Also Published As

Publication number Publication date
US8609991B2 (en) 2013-12-17
US9084381B2 (en) 2015-07-14
KR20100101000A (ko) 2010-09-15
US20120060367A1 (en) 2012-03-15
TW201006335A (en) 2010-02-01
CN102106197A (zh) 2011-06-22
JPWO2010013366A1 (ja) 2012-01-05
US20100025087A1 (en) 2010-02-04

Similar Documents

Publication Publication Date Title
WO2010013366A1 (ja) フレックスリジッド配線板及びその製造方法
WO2010007704A1 (ja) フレックスリジッド配線板及び電子デバイス
JP5121942B2 (ja) フレックスリジッド配線板及びその製造方法
JP5097827B2 (ja) フレックスリジッド配線板及び電子デバイス
JP4021472B1 (ja) フレックスリジッド配線板及びその製造方法
US8275223B2 (en) Opto-electrical hybrid wiring board and method for manufacturing the same
WO2009118935A1 (ja) フレックスリジッド配線板及びその製造方法
KR20090063223A (ko) 리지드 플렉서블 프린트 배선판 및 리지드 플렉서블 프린트배선판의 제조방법
JP2007149870A (ja) 回路基板及び回路基板の製造方法。
TWI549579B (zh) 印刷電路板
JP2013211519A (ja) 多層配線基板の製造方法
KR20130079197A (ko) 다층 배선기판 및 그 제조방법
JP2006269979A (ja) フレックスリジッドプリント配線板およびフレックスリジッドプリント配線板の製造方法
KR101148735B1 (ko) 인쇄회로기판 및 그 제조방법
JP5027193B2 (ja) 配線板及びその製造方法
KR101470706B1 (ko) 다층 배선기판의 제조방법
JP5302920B2 (ja) 多層配線基板の製造方法
KR20160019297A (ko) 인쇄회로기판 및 그 제조방법
JP2005268378A (ja) 部品内蔵基板の製造方法
KR101167422B1 (ko) 캐리어 부재 및 이를 이용한 인쇄회로기판의 제조방법
JP2019121766A (ja) プリント配線板およびその製造方法
JP4899409B2 (ja) 多層プリント配線基板及びその製造方法
JP2006073819A (ja) プリント配線板及びプリント配線板の作製方法
JP2015038908A (ja) フレックスリジッド配線板
JP2009289789A (ja) 部品内蔵プリント配線板及び部品内蔵プリント配線板の製造方法

Legal Events

Date Code Title Description
WWE Wipo information: entry into national phase

Ref document number: 200880130561.6

Country of ref document: CN

121 Ep: the epo has been informed by wipo that ep was designated in this application

Ref document number: 08876664

Country of ref document: EP

Kind code of ref document: A1

WWE Wipo information: entry into national phase

Ref document number: 2010522587

Country of ref document: JP

ENP Entry into the national phase

Ref document number: 20107017242

Country of ref document: KR

Kind code of ref document: A

NENP Non-entry into the national phase

Ref country code: DE

122 Ep: pct application non-entry in european phase

Ref document number: 08876664

Country of ref document: EP

Kind code of ref document: A1