KR970063930A - 가변 지연회로와 이것을 사용한 링 발진기 및 펄스폭 가변회로 - Google Patents

가변 지연회로와 이것을 사용한 링 발진기 및 펄스폭 가변회로 Download PDF

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KR970063930A
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KR
South Korea
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gate
delay
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output
circuit
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KR1019960040131A
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아키라 오타
노리오 히가시사카
테츠야 헤이마
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기다오까 다까시
미쓰비시 뎅끼 가부시끼가이샤
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Abstract

과제
각 지연 게이트에 의한 지연을 같이 하기 위해서는, 각각의 배선의 길이를 일정 하게하면 좋지만, 게이트 배치등에 의한 제한에 의해서, 길이룰 일정 하게하는 것은 곤란하며, 또 길이를 일정하게 했다고 해도 가변지연 회로의 점유 면적이 커진다고 하는 문제점이 있었다.
해결수단
입력 및 IN에 입력된 피 지연 신호가 입력되는 인버터 INV와, 인버터 INV의 출력 N0이 입력되는 인버터 X1a 및 인버터 X1a의 출력 및 제어 신호 S1를 받는 2 입력 NOR 게이트 X1b로 구성되는 지연 게이트 X1와, 지연게이트 Xi-1의 출력 Ni-1과 제어 신호 Si를 입력으로 가지는 지연 게이트 Xi와, 인버터 INV의 출력 N0과 지연 게이트 Xi의 출력 Ni를 입력으로 하는 n 입력 NOR 게이트의 논리게이트 XS과, 논리 게이트 XS의 출력단자 OUT에 의해서 구성되어있다.

Description

가변 지연회로와 이것을 사용한 링 발진기 및 펄스폭 가변회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 실시의 형태 1에 의한 2비트 가변 지연회로의 구성과 타이밍 챠트를 도시한 도면.
제2도는 본 발명의 실시의 형태 2에 의한 n 비트; 가변 지연회로의 구성과 타이밍 챠트를 도시한 도면.

Claims (2)

  1. 피지연신호가 입력되는 입력단자, 이 입력단자에 접속된 지연게이트, 이 지연게이트의 입력 및 지연게이트의 출력을 입력으로 하며, 하나의 지연 회로를 형성하는 논리게이트, 이 논리게이트의 형성하는 지연신호를 출력하는 출력단자를 구비하고, 상기 지연게이트에, 이 지연게이트를 제어하기 위한 제어신호를 입력하는 것을 특징으로 하는 가변지연회로.
  2. 입력단자, 이 입력단자에 입력된 피지연신호를 입력하여, 차례로 출력을 다음단에 입력하도록 직렬로 접속된 n단 (n는 2이상의 정(+)의 정수)의 지연게이트, 이 지연게이트의 각단의 출력을 입력으로 하여, 하나의 지연신호를 형성하는 논리게이트, 이 논리게이트의 형성하는 지연신호를 출력하는 출력단자를 구비하여, 상기 지연게이트의 적어도 한개에, 이 지연게이트를 제어하기 위한 제어신호를 입력하는 것을 특징으로 하는 가변지연회로.
    ※ 참고사항 : 최초출원에 내용에 의하여 공개하는 것임.
KR1019960040131A 1996-02-15 1996-09-16 가변 지연회로와 이것을 사용한 링 발진기 및 펄스폭 가변회로 KR970063930A (ko)

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