KR970053743A - 테이프로 형성되는 댐바(Dambar)를 갖는 리드 프레임 - Google Patents

테이프로 형성되는 댐바(Dambar)를 갖는 리드 프레임 Download PDF

Info

Publication number
KR970053743A
KR970053743A KR1019950068015A KR19950068015A KR970053743A KR 970053743 A KR970053743 A KR 970053743A KR 1019950068015 A KR1019950068015 A KR 1019950068015A KR 19950068015 A KR19950068015 A KR 19950068015A KR 970053743 A KR970053743 A KR 970053743A
Authority
KR
South Korea
Prior art keywords
tape
lead frame
lead
semiconductor package
package according
Prior art date
Application number
KR1019950068015A
Other languages
English (en)
Other versions
KR100196896B1 (ko
Inventor
심성민
Original Assignee
김광호
삼성전자 주식회사
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by 김광호, 삼성전자 주식회사 filed Critical 김광호
Priority to KR1019950068015A priority Critical patent/KR100196896B1/ko
Publication of KR970053743A publication Critical patent/KR970053743A/ko
Application granted granted Critical
Publication of KR100196896B1 publication Critical patent/KR100196896B1/ko

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/48Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/488Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
    • H01L23/495Lead-frames or other flat leads
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805Shape
    • H01L2224/4809Loop shape
    • H01L2224/48091Arched
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48245Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
    • H01L2224/48247Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic connecting the wire to a bond pad of the item

Landscapes

  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Engineering & Computer Science (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Lead Frames For Integrated Circuits (AREA)
  • Encapsulation Of And Coatings For Semiconductor Or Solid State Devices (AREA)

Abstract

댐바가 없는 사전 도금된 리드 프레임을 사용하여 몰딩 공정 후의 댐바 절단 작업을 생략할 수 있도록 하면서, 테이핑에 의해 기존 댐바의 역할 을 대신하도록 하므로써 몰딩 컴파운드의 유출 방지 및 개개 리드의 평탄성을 확보함과 동시에 제작상의 양산성을 갖도록 한다.

Description

테이프로 형성되는 댐바(Cambar)를 갖는 리드 프레임
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명의 실시예에 의한 리드 프레임의 평면도.

Claims (8)

  1. 댐바가 없는 반도체 패키지용 리드 프레임에 있어서, 상기 리드 프레임의 리드의 길이 방향 소정 위치에 각 리드를 연결하여 주는 비도전성의 테이프를 부착한 것을 특징으로 하는 반도체 패키지용 리드 프레임.
  2. 제1항에 있어서, 상기 테이프의 재질은 폴리이미드 수지인 것을 특징으로 하는 반도체 패키지용 리드 프레임.
  3. 제1항에 있어서, 상기 테이프의 한쪽 면에 상기 테이프 두께의 10% 내지 20% 두께의 접착제 층이 형성되어 있는 것을 특징으로 하는 반도체 패키지용 리드 프레임.
  4. 제1항에 있어서, 상기 테이프를 액상의 폴리이미드를 불완전 경화시켜 형성한 폴리아믹 산 필름(Ployamic Acid Film)으로 형성하여, 이를 고온 경화에 의해 상기 리드상에 부착하는 것을 특징으로 하는 반도체 패키지용 리드 프레임.
  5. 제1항에 있어서, 상기 테이프를 상기 리드의 상하 양면에 부착한 것을 특징으로 하는 반도체 패키지용 리드 프레임.
  6. 제5항에 있어서, 상기 테이프의 두께는 상기 리드 두께의 90% 내지 100%인 것을 특징으로 하는 반도체 패키지용 리드 프레임.
  7. 제1항에 있어서, 상기 테이프를 상기 리드의 한 면에 부착한 것을 특징으로 하는 반도체 패키지용 리드 프레임.
  8. 제7항에 있어서, 상기 테이프의 두께는 상기 리드 두께의 45% 내지 50%인 것을 특징으로 하는 반도 체 패키지용 리드 프레임.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019950068015A 1995-12-30 1995-12-30 반도체 패키지 KR100196896B1 (ko)

Priority Applications (1)

Application Number Priority Date Filing Date Title
KR1019950068015A KR100196896B1 (ko) 1995-12-30 1995-12-30 반도체 패키지

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
KR1019950068015A KR100196896B1 (ko) 1995-12-30 1995-12-30 반도체 패키지

Publications (2)

Publication Number Publication Date
KR970053743A true KR970053743A (ko) 1997-07-31
KR100196896B1 KR100196896B1 (ko) 1999-06-15

Family

ID=19447935

Family Applications (1)

Application Number Title Priority Date Filing Date
KR1019950068015A KR100196896B1 (ko) 1995-12-30 1995-12-30 반도체 패키지

Country Status (1)

Country Link
KR (1) KR100196896B1 (ko)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100674502B1 (ko) * 1999-12-28 2007-01-25 삼성전자주식회사 Blp형 반도체 칩 패키지

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100674502B1 (ko) * 1999-12-28 2007-01-25 삼성전자주식회사 Blp형 반도체 칩 패키지

Also Published As

Publication number Publication date
KR100196896B1 (ko) 1999-06-15

Similar Documents

Publication Publication Date Title
JPS57147260A (en) Manufacture of resin-sealed semiconductor device and lead frame used therefor
KR950009988A (ko) 수지봉지형 반도체장치
KR970053752A (ko) 엘.오.씨(LOC:Lead On Chip) 패키지 및 그 제조방법
KR940013306A (ko) 편평구조방식으로 된 전자모쥴
KR880005678A (ko) 반도체장치용 리드프레임
KR950004495A (ko) 반도체장치, 리드프레임 및 반도체장치의 제조방법
KR880008208A (ko) Ic카드
KR930006867A (ko) Loc 패키지 및 그 제조방법
KR890013765A (ko) 리드 프레임
KR880011939A (ko) 반도체 레이저의 조립방법
KR870002642A (ko) 패시베이션필름(passivation film)의 형성방법
KR970053743A (ko) 테이프로 형성되는 댐바(Dambar)를 갖는 리드 프레임
KR910007117A (ko) 수지밀봉형 반도체장치
KR940016718A (ko) 성형 반도체장치 및 성형 반도체장치의 제조방법
JPS5258469A (en) Resin-molded type semiconductor device
JPH0135478Y2 (ko)
KR840008536A (ko) 반도체장치 및 그 제조법
KR940001368A (ko) 반도체 리이드프레임 구조 및 그 제조방법
KR920007154A (ko) 반도체 장치의 패키지 제조공정
KR940012680A (ko) 플라스틱 광학소자 패키지용 리드프레임 및 그를 이용한 패키지 제조방법
KR970030741A (ko) 타이바(tie-bar)에 반도체 칩이 부착된 반도체 칩 패키지
KR970030707A (ko) 외부리드가 표면에 부착 노출된 반도체 패키지
KR970024106A (ko) 업셋 조정된 리드 프레임 및 그를 이용한 반도체 칩 패키지
KR960703272A (ko) 전자소자 팩케이지 및 그 제조방법 (electronic device package and method for manufacturing the same)
KR920010862A (ko) 반도체 장치 및 이것에 사용되는 리드프레임

Legal Events

Date Code Title Description
A201 Request for examination
E902 Notification of reason for refusal
E701 Decision to grant or registration of patent right
GRNT Written decision to grant
FPAY Annual fee payment

Payment date: 20070125

Year of fee payment: 9

LAPS Lapse due to unpaid annual fee