KR970052459A - 금속 배선 형성 방법 - Google Patents
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Abstract
본 발명은 반도체 소자 제조방법에 관한 것으로, 콘택홀의 비정상적인 측면 식각 프로파일로 인하여 금속 배선간 브릿지 또는 금속 배선과 하부의 게이트 전극간의 브릿지가 발생되는 문제를 해소하기 위하여 층간절연막인 BPSG막을 플로우 시킨다음, BPSG막 상부에 접촉 특성이 양호한 TEOS막을 얇게 도포한 후 금속 배선 콘택홀을 형성하는 공정을 실시하고, 금속 배선을 형성하는 것이다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제3도는 본 발명의 실시예에 의해 소오스/드레인에 콘택되는 금속 배선을 형성하는 공정을 도시한 단면도.
Claims (6)
- 반도체소자의 제조방법에 있어서, 실리콘기판에 모스펫을 형성하고, 그상부에 산화막을 증착하고, 그상부에 층간절연막을 평탄하게 형성하는 단계와, 상기 층간절연막 상부에 감광막과 접촉 특성이 양호한 산화막을 증착하는 단계와, 상기 산화막 상부에 콘택 마스크용 감광막패턴을 형성하고, 상기 감광막패턴을 마스크로 이용한 등방성 왯 식각과 드라이 식각을 차례로 실시하여 상기 모스펫의 소오드/드레인이 노출되는 콘택홀을 형성하는 단계와, 상기 감광막패턴을 제거한다음, 금속층을 증착하고 패턴닝 공정으로 금속 배선을 형성하는 것을 포함하는 금속 배선 형성 방법.
- 제1항에 있어서, 상기 금속층은 확산방지층, 알루미늄막과 아크층을 순차적으로 형성하는 것을 특징으로 하는 금속 배선 형성 방법.
- 제2항에 있어서, 상기 확산방지층과 아크층은 TiN으로 형성하는 것을 특징으로 하는 금속 배선 형성 방법.
- 제2항에 있어서, 상기 모스펫 상부에 형성하는 산화막은 TEOS 막인 것을 특징으로 하는 금속 배선 형성 방법.
- 제1항에 있어서, 상기 층간절연막은 BPSG막 인것을 특징으로 하는 금속 배선 형성 방법.
- 제1항에 있어서, 상기 층간절연막 상부에 형성되는 감광막과 접촉 특성이 양호한 산화막은 TEOS막 인것을 특징으로 하는 금속 배선 형성 방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
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KR1019950066086A KR0172542B1 (ko) | 1995-12-29 | 1995-12-29 | 금속배선 형성방법 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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KR1019950066086A KR0172542B1 (ko) | 1995-12-29 | 1995-12-29 | 금속배선 형성방법 |
Publications (2)
Publication Number | Publication Date |
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KR970052459A true KR970052459A (ko) | 1997-07-29 |
KR0172542B1 KR0172542B1 (ko) | 1999-03-30 |
Family
ID=19447248
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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KR1019950066086A KR0172542B1 (ko) | 1995-12-29 | 1995-12-29 | 금속배선 형성방법 |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR0172542B1 (ko) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100713929B1 (ko) * | 2006-02-24 | 2007-05-07 | 주식회사 하이닉스반도체 | 모스펫 소자의 제조방법 |
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1995
- 1995-12-29 KR KR1019950066086A patent/KR0172542B1/ko not_active IP Right Cessation
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100713929B1 (ko) * | 2006-02-24 | 2007-05-07 | 주식회사 하이닉스반도체 | 모스펫 소자의 제조방법 |
Also Published As
Publication number | Publication date |
---|---|
KR0172542B1 (ko) | 1999-03-30 |
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