KR960704274A - 데이터 스트림 모드를 스위칭할 수 있는 메모리 장치(memory device with switching of date stream modes) - Google Patents
데이터 스트림 모드를 스위칭할 수 있는 메모리 장치(memory device with switching of date stream modes)Info
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Abstract
I2C버스 호환 직렬 EEPROM 장치는 주변장치를 제어하기 위해 사용된 호스트 장치와 버스를 통신하여 EEPROM 장치와 연관된 지능 주변장치에 대한 구성 및 제어정보를 기억 및 직렬전송하는 응용에 사용된다. EEPROM 장치는 구성 및 제어정보를 나타내는 데이터를 저장하기 위한 메모리 에러이를 가진다. 데이터 전송의 두가지 모드는 EEPROM장치에 의해 유지되며 EEPROM 어레이에 저장된 데이터가 버스상의 순차 출력에 의해 단지 판독되는지의 여부에 따라 선택적으로 설정된다. 이 구조는 호스트장치 및 주변장치사이의 상호작용을 허용한다. 개별 클럭라인은 설정된 모드에 대한 각각의 클럭라인에 의해 클럭함으로서 다른 모드를 지원하기 위해 I2C버스의 클럭라인 및 데이터 라인을 부가한다. 제어된 멀티플렉서는 두 개의 클럭라인중의 하나상의 소정 논리레벨 천이에 따라 입력클럭을 선택적으로 접속한다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명을 구현하는 단일칩 EEPROM 메모리 장치의 단순화된 블럭도,
제2도는 전송전용 모드에서 제1도의 메모리 장치의 데이터 및 클럭 핀/라인에 대한 상태를 기술한 그래프,
제3도는 장치의 초기화 과정을 도시한 그래프.
Claims (16)
- 버스상의 정보를 호스트 장치와 통신하여 EEPROM 장치와 연관된 지능 주변장치에 대한 구성정보를 기억 및 직렬 전송하는 I2C 버스 호환직렬 전기적 소거·프로그램 가능 판독전용 메모리(EEPROM)장치에 있어서, 구성 및 제어정보를 나타내는 데이터를 기억하기 위한 EEPROM 어레이와, 모드중 각각 다른 하나와 연관된 EEPROM 장치의 개별 클럭 입력라인과 설정된 모드에 대한 각각의 클럭 입력라인에 의해 클럭될 때 EEPROM 어레이로부터의 데이터를 버스상에 출력하는 데이터 라인을 포함하는 상기 호스트 장치 및 상기 주변장치사이에 상호작용을 허용하는 모든 다른 모드에 배타적으로 EEPROM 어레이에 기억된 데이터를 설정된 모드로 버스상에 순차적으로 전송하는 상기 EEPROM 장치에 의해 지원된 임의의 다수의 모드를 선택적으로 설정하는 수단을 포함하며, 선택적으로 설정하는 상기 수단은 설정될 모드에 따라 단일 클럭원으로 EEPROM 장치의 상기 개별 클럭입력 라인을 선택적으로 다중화는 수단을 포함하는 것을 특징으로 하는 I2C 버스 호환 직렬 전기적 소거 · 프로그램 가능 판독 전용 메모리(EEPROM)장치.
- 제1항에 있어서, 선택적으로 다중화하는 상기 수단은 멀티플렉서 및 모드를 스위칭하기 위해 상기 멀티플렉서를 제어하는 모드 스위칭수단을 포함하는 것을 특징으로 하는 I2C 버스 호환 직렬 전기적 소거 · 프로그램 가능 판독전용 메모리(EEPROM)장치.
- 제2항에 있어서, 상기 모드 스위칭수단은 멀티플렉서를 제어하기 위해 상기 호스트 장치로부터 버스통신에 의해 여기된 상기 클럭 입력라인중의 하나상의 천이신호에 응답하는 것을 특징으로 하는 I2C 버스 호환 직렬 전기적 소거 · 프로그램 가능 판독전용 메모리(EEPROM)장치.
- 제2항에 있어서, 상기 모드 스위칭수단은 멀티플렉서를 제어하기 위해 상기 하나의 클럭입력라인상의 논리레벨천이에 응답하는 에지 검출기인 I2C 버스 호환 직렬 전기적 소거·프로그램 가능 판독전용 메모리(EEPROM)장치.
- 제1항에 있어서, 임의의 다수의 모드를 선택적으로 설정하는 상기 수단은 단지 두 개의 모드중의 하나를 설정하기 위해 사용되고, 상기 두 개의 모드중의 하나는 상기 EEPROM 어레이가 상기 단일 클럭원으로부터의 클럭신호에 의해 여기된 데이터를 출력하기 위해서 단지 판독되게 하고, 상기 두 개의 모드중의 다른 하나는 상기 EEPROM 어레이가 상기 단일 클럭원으로부터의 클럭신호에 의해 여기된 데이터를 출력하기위해서 판독되거나 또는 기입되게 하며, 상기 판독전용모드는 EEPROM 장치의 디폴트 모드인 것을 특징으로 하는 I2C 버스 호환 직렬 전기적 소거 · 프로그램 가능 판독전용 메모리(EEPROM)장치.
- 버스로 호스트 장치와 통신하여, 주변장치와 연관된 프로그램가능 데이터 메모리 장치로부터 지능 주변장치에 대한 구성정보를 나타내는 데이터의 스트림을 전송하는 방법에 있어서, 상기 메모리 장치의 어레이에 기억하기 위해 상기 데이터를 수신하고, 각각의 다른 모드와 연관된 메모리 장치의 개별 클럭입력라인과 설정된 모드에 대한 각각의 클럭입력라인에 의해 클럭될 때 어레이로부터 데이터를 버스상에 출력하는 데이터 라인을 포함하는 상기 호스트 장치 및 상기 주변장치 사이에 상호작용을 허용하는 모든 다른 모드에 배타적으로 상기 어레이에 기억된 데이터를 상기 설정된 모드로 버스상에 순차적으로 전송하는 상기 메모리 장치에 의해 지원된 임의의 다수의 모드를 선택적으로 설정하는 메모리 장치 실행단계를 포함하는데, 상기 임의의 다수의 모드를 설정하는 상기 단계는 설정될 모드에 따라 단인 클럭원으로 메모리 장치의 상기 개별 클럭입력라인을 선택적으로 다중화하는 단계를 포함하는 것을 특징으로 하는 데이터의 스트림을 전송하는 방법.
- 제6항에 있어서, 상기 클럭입력라인 중의 하나의 소정 천이신호에 응답하여 상기 모드중의 하나 모드에서 다른 모드로 스위칭하는 단계를 더 포함하는 것을 특징으로 하는 데이터의 스트림을 전송하는 방법.
- 제7항에 있어서, 상기 호스트 장치로부터 버스로 통신된 상기 천이신호를 인식하는 단계를 더 포함하는 것을 특징으로 하는 데이터의 스트림을 전송하는 방법.
- 제7항에 있어서, 스위칭 모드의 명령에 따라 상기 천이 신호의 미리 정해진 에지를 검출하는 단계를 더 포함하는 것을 특징으로 하는 데이터의 스트림을 전송하는 방법.
- 제6항에 있어서, 메모리 장치의 디폴트 모드로서 메모리 장치의 시동후 메모리 장치의 초기모드를 세팅하는 단계를 포함하는 것을 특징으로 하는 데이터의 스트림을 전송하는 방법.
- 제10항에 있어서, 메모리 장치에 대한 데이터 전송의 두 개의 모드만을 선택적으로 설정하는 단계를 포함하는데, 두 개의 모드중의 하나의 모드는 메모리 장치가 어레이에 기억된 데이터를 단지 전송하게 하고, 두 개의 모드중의 다른 한 모드는 상기 메모리 장치가 데이터를 전송하게 하며 어레이에 새로운 데이터를 수신 및 기억하게 하며, 메모리 장치의 디폴트 모드로서 전송전용 모드를 세팅하는 단계를 포함하는 것을 특징으로 하는 데이터의 스트림을 전송하는 방법.
- 상기 메모리 장치와 통신하기 위해 접속되고 주변장치를 제어하기에 적합한 호스트 장치로 연관된 주변장치의 구성을 한정하는 장치의 메모리 어레이에 소정 데이터를 기억하기 위해 프로그램될 수 있는 메모리 장치에 있어서, 상기 데이터를 기억하기 위해 제1수단과, 상기 호스트 장치와 통신하여 기억장치에서 버스로 상기 데이터를 순차적으로 전송하기 위한 제2수단과, 다수의 클럭라인중의 각각의 하나와 연관된 임의의 다수의 선택가능한 모드에서 상기 버스로 전송되는 상기 데이터를 클럭하기 위해 임의의 상기 다수의 입력 클럭라인상에 클럭펄스를 독립적으로 공급하기 위한 제3수단과, 상기 데이터를 클럭하기 위해 사용된 클럭라인과 다른 클럭라인상의 천이논리레벨을 인식함으로서 상기 한 모드에서 상기 다른 모드로 선택적으로 스위칭하기 위한 제4수단과, 상기 버스상에 데이터를 전송하기 위해 선택된 모드에 관계없이 단일 클럭원으로 제3수단을 제한하기 위한 제5수단을 포함하는 것을 특징으로 하는 메모리 장치.
- 제12항에 있어서, 상기 호스트 장치는 개인용 컴퓨터를 포함하며, 상기 주변장치는 디스플레이를 가진 모니터를 포함하는 것을 특징으로 하는 메모리 장치.
- 제12항에 있어서, 상기 단일 클럭원은 상기 메모리 장치의 내부동기화를 위해 사용되는 것을 특징으로 하는 메모리 장치.
- 제12항에 있어서, 상기 제5수단은 초기 전송전용 디폴트 모드로부터 스위칭을 발생시키기 위해 상기 천이 논리레벨에 의해 적어도 부분적으로 제어되는 멀티플렉서를 포함하는 것을 특징으로 하는 메모리 장치.
- 제15항에 있어서, 상기 제5수단은 상기 멀티플렉서를 제어하기 위해 상기 천이논리레벨을 인식하기 위한 에지 검출기를 포함하는 것을 특징으로 하는 메모리 장치.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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Families Citing this family (33)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6121949A (en) * | 1994-03-17 | 2000-09-19 | Cirrus Logic, Inc. | Method and apparatus for automatically maintaining a predetermined image quality in a display system |
US5606715A (en) * | 1995-06-26 | 1997-02-25 | Motorola Inc. | Flexible reset configuration of a data processing system and method therefor |
US5623687A (en) * | 1995-06-26 | 1997-04-22 | Motorola | Reset configuration in a data processing system and method therefor |
US5841996A (en) * | 1995-10-13 | 1998-11-24 | Microchip Technology Incorporated | Serial communication interface system having programmable microcontroller for use in a battery pack |
JPH10133995A (ja) * | 1996-05-13 | 1998-05-22 | Sun Microsyst Inc | コンピュータ・システムと周辺装置間の最適能力を選択する方法および装置 |
US5878234A (en) * | 1996-09-10 | 1999-03-02 | Sierra Wireless, Inc. | Low power serial protocol translator for use in multi-circuit board electronic systems |
US6693678B1 (en) | 1997-12-18 | 2004-02-17 | Thomson Licensing S.A. | Data bus driver having first and second operating modes for coupling data to the bus at first and second rates |
JP4017822B2 (ja) * | 1997-12-18 | 2007-12-05 | トムソン ライセンシング | データの伝送を制御する装置 |
US6363437B1 (en) * | 1999-01-07 | 2002-03-26 | Telefonaktiebolaget Lm Ericsson (Publ) | Plug and play I2C slave |
FR2799045B1 (fr) * | 1999-09-29 | 2002-02-08 | St Microelectronics Sa | Memoire en circuit integre a acces serie |
EP1513059A1 (en) * | 2003-09-08 | 2005-03-09 | Barco N.V. | A pixel module for use in a large-area display |
JP4791696B2 (ja) | 2004-03-02 | 2011-10-12 | オンセミコンダクター・トレーディング・リミテッド | データ転送メモリ及びモジュール |
KR100613606B1 (ko) * | 2004-06-25 | 2006-08-21 | 삼성전자주식회사 | 전송받은 본체의 사양정보를 이용하여 자신의 구동조건을설정하는 화상형성기기의 옵션장치 및 그 제어방법 |
JP4593196B2 (ja) * | 2004-07-29 | 2010-12-08 | シチズンホールディングス株式会社 | 半導体装置 |
KR100871524B1 (ko) * | 2004-08-30 | 2008-12-05 | 샤프 가부시키가이샤 | 표시 제어 디바이스, 표시 장치, 표시 디바이스의 제어방법, 표시 제어 프로그램, 및 그 프로그램을 기록한 기록매체 |
US8094103B2 (en) * | 2004-08-31 | 2012-01-10 | Sharp Kabushiki Kaisha | Viewing-angle control device, display apparatus, method for controlling viewing-angle control device, viewing-angle control program, and storage medium storing the program |
US7834834B2 (en) * | 2004-09-07 | 2010-11-16 | Sharp Kabushiki Kaisha | Display device, viewing angle control device, and electronic apparatus |
JP4704349B2 (ja) * | 2004-09-15 | 2011-06-15 | シャープ株式会社 | 表示装置、視野角制御装置、および電子機器 |
US8031273B2 (en) * | 2004-09-17 | 2011-10-04 | Sharp Kabushiki Kaisha | Display device, viewing angle control device, and electronic device |
KR100848762B1 (ko) * | 2004-10-04 | 2008-07-28 | 샤프 가부시키가이샤 | 표시 장치 및 전자 기기 |
JP4543880B2 (ja) * | 2004-10-27 | 2010-09-15 | ソニー株式会社 | メモリー装置 |
US7796589B2 (en) * | 2005-08-01 | 2010-09-14 | American Power Conversion Corporation | Communication protocol |
US9660808B2 (en) * | 2005-08-01 | 2017-05-23 | Schneider Electric It Corporation | Communication protocol and method for authenticating a system |
CN100517279C (zh) * | 2005-12-01 | 2009-07-22 | 鸿富锦精密工业(深圳)有限公司 | 数据撷取装置和方法 |
WO2009044228A2 (en) | 2006-08-15 | 2009-04-09 | Nxp B.V. | Device with an eeprom having both a near field communication interface and a second interface |
US8185771B2 (en) * | 2006-12-20 | 2012-05-22 | Nxp B.V. | Clock generation for memory access without a local oscillator |
US8549198B2 (en) * | 2009-03-27 | 2013-10-01 | Schneider Electric It Corporation | Communication protocol |
US8194480B2 (en) * | 2009-11-19 | 2012-06-05 | Himax Technologies Limited | Method for initializing memory device |
CN102087880B (zh) * | 2009-12-08 | 2013-09-18 | 奇景光电股份有限公司 | 存储器元件的初始化方法 |
FR3006097A1 (fr) | 2013-05-21 | 2014-11-28 | St Microelectronics Rousset | Mecanisme d'ecriture d'une memoire eeprom sur bus i2c |
FR3006094A1 (fr) | 2013-05-21 | 2014-11-28 | St Microelectronics Rousset | Ecriture d'une memoire eeprom sur bus i2c |
US9639499B2 (en) * | 2013-06-12 | 2017-05-02 | Qualcomm Incorporated | Camera control interface extension bus |
CN113383326A (zh) * | 2019-05-17 | 2021-09-10 | 华为技术有限公司 | 一种具有接口复用功能的集成电路及管脚切换方法 |
Family Cites Families (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4713756A (en) * | 1985-02-28 | 1987-12-15 | Westinghouse Electric Corp. | Non-volatile memory device for a programmable controller |
JPS63184184A (ja) * | 1987-01-26 | 1988-07-29 | Tokyo Keiki Co Ltd | メモリパツケ−ジシステム |
US4841485A (en) * | 1987-11-05 | 1989-06-20 | International Business Machines Corporation | Read/write memory device with an embedded read-only pattern and method for providing same |
JPH01123269U (ko) * | 1988-02-16 | 1989-08-22 | ||
US5053990A (en) * | 1988-02-17 | 1991-10-01 | Intel Corporation | Program/erase selection for flash memory |
US5070500A (en) * | 1988-08-30 | 1991-12-03 | Tokyo Keiki Company Ltd. | Memory package system utilizing inductive coupling between memory module and read/write unit |
US5159672A (en) * | 1989-12-28 | 1992-10-27 | Intel Corporation | Burst EPROM architecture |
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TW327212B (en) | 1998-02-21 |
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