KR920002754B1 - 전력 소비 절약용슬립 기능을 갖는 마이크로컴퓨터 시스템 - Google Patents

전력 소비 절약용슬립 기능을 갖는 마이크로컴퓨터 시스템 Download PDF

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가부시기가이샤 도시바
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Abstract

내용 없음.

Description

전력 소비 절약용슬립 기능을 갖는 마이크로컴퓨터 시스템
제1도는 본 발명의 실시예에 따른 마이크로컴퓨터 시스템의 전체 구조를 도시한 블록도.
제2a도 및 제2b도는 제1도에 도시된 마이크로컴퓨터 시스템의 타이밍 제어회로(10)에 대한 상세한 구조를 도시한 블록도.
제3a도 및 제3b도는 제2a도의 타이밍 제어회로(10)에 대한 타이밍도.
제4a도 및 제4b도는 제2b도의 타이밍 제어회로(10)에 대한 타이밍도.
제5도는 제1도의 마이크로컴퓨터 시스템의 기본 입/출력 서비스 루틴을 도시한 플로우차트.
제6도는 종래 마이크로컴퓨터 시스템의 기본 입/출력 서비스 루틴을 도시한 플로우차트.
제7도는 종래 마이크로컴퓨터 시스템의 입/출력 장치로부터의 응답을 검사하기 위한 루틴을 도시한 플로우차트.
제8a도 및 제8b도는 응용프로그램이 입/출력 장치로부터의 응답을 기다리고 있는동안 실행되는 처리루틴을 도시한 플로우차트.
* 도면의 주요부분에 대한 부호의 설명
1 : CPU 2 : RAM
3 : ROM 5 : DMA 제어기
6 : 입/출력 장치 제어기 8 : 시스템 버스
10 : 타이밍 제어회로 22 : 인터럽션 검출 플립플롭
24 : 슬립 제어 레지스터
본 발명은 배터리에 의해 구동될 수 있는 휴대형 장치에 관한 것으로, 특히, 슬립(sleep)기능을 가짐으로써, 현재 진행중인 동작에 불필요한 섹션들의 동작을 중지시키고 이로써 전력을 절약하는 마이크로컴퓨터 시스템에 관한 것이다.
근래, 휴대형 퍼스널 컴퓨터 및 워드프로세서가 시판되고 있는데, 그러한 장치들의 일부는 베터리를 사용하여 어느곳에서도 동작될 수 있다. 그러한 배터리 구동형 정치에서는, 전력 소비가 작으면 작을수록 동작시간은 더 길어진다. 전력소비를 감소시키기 위해 여러 가지 기능이 사용된다. 이러한 기능들중 한가지는 슬립 기능이다. 이 슬립 기능은 현재 진행중인 동작에 관련되지 않는 섹션들의 동작을 중지시킴으로써 전력을 절약한다. 이제, 마이크로컴퓨터 시스템의 일예를 참조하여 슬립 기능을 설명한다. CPU의 동작 속도에 비교해 볼 때, 키보드, 플로피 디스크 드라이버 및 프린터의 동작 속도는 낮다. 따라서, CPU 및 그 주변 회로가 키보드, 플로피 디스크 드라이버 및 프린터로부터의 입/출력 응답을 기다리는 동안, CPU 및 그 주변회로의 클럭은 중지될 수 있거나, 그 클럭의 속도가 더 낮아질 수 있다. 저 전력 소비는 CPU 및 그 주변회로의 클럭을 슬립 모드로 스위칭 함으로써 실현된다. 슬립기능은 CPU 내의 IC가 CMOS 구조를 갖는 점을 이용한다. CMOS형 IC는 동작 클럭에 비례하여 전력을 소비한다.
전술한 형태의 종래 시스템에 대한 동작을 이하 설명한다. 제6도에는, 종래 시스템의 기본 입/출력 서비스 루틴이 도시되어 있다. 입/출력 장치가 CPU에 입력 신호를 공급할때까지, CPU 및 그 주변 회로는 슬립상태로 유지된다. S60단계에서, 입력신호가 입/출력 장치로부터 공급되지 않을 경우, 루틴은 C61 단계로 진행한다. S61단계에서는 CPU가 슬립모드 명령을 실행하여 CPU 및 그 주변회로의 클럭을 중지 시킨다. 슬립 모드로부터의 복귀는 하드웨어형 인터럽션에 의해 실행한다. 입력신호가 S60 단계에서 입/출력장치로부터 공급되거나, 입터럽션 명령이 입/출력 장치로부터 주어질 경우, 루틴은 S62 단계로 진행하여 테이타 입/출력 동작을 수행한다.
제8a도에 도시한 바와같이, 종래의 응용 프로그램은 제6도의 기본 입/출력 서비스루틴을 실행함으로써 입/출력을 대기한다. 그러나, 근래의 프로그램에서는 제8b도에 도시된 바와같이 입/출력 장치로부터의 입력을 대기하는 시간동안 다른 처리가 수행된다. 이 동작은 제7도에 도시된 바와같이 입/출력 장치로부터의 응답을 검사하기 위한 루틴을 요구하며, 이 루틴에서 입/출력 장치로부터의 입력신호의 존재/부재가 검사된다. S70 단계에서 입력신호가 공급될때는 S72단계에서 플래그가 세트된다. 이 플래그는 CPU의 미리 정해진 내부 레지스터 또는 시스템 메모리의 작업영역(work area)에 위치한다. 입력신호가 입/출력 장치로부터 공급되지 않을때는, S71단계에서 플래그가 클리어 된다. 이제, 제8b도에 도시된 응용 프로그램을 설명한다. S81 단계에서는, 제7도에서 언급한 바와같이 입/출력 장치로부터의 응답을 검사한다. S82 단계에서는 플래그의 상태를 검사한다. 플래그가 클리어되어 있으면, S83 단계에서 다른 처리가 수행된다. S82단계에서 플래그가 세트되어 있으면 루틴은 S84 단계로 진행한다. S84 단계에서는, 제6도의 기본 입/출력서비스 루틴이 실행된다.
제8b도의 응용 프로그램에 있어서, 입/출력 장치로 부터 입력 신호가 없을때는, 제7도의 S71 단계에서 플래그가 클리어된다. 따라서, 제8b도의 S83 단계에서 다른 처리가 수행된다. 한편, 입/출력 장치로부터 입력신호가 있을때는, 제7도의 S72 단계에서 플래그가 세트된다. 따라서, 제8b도의 S84 단계에서는 제6도의 기본 입/출력 루틴이 실행된다. 제6도의 S60 단계에서는, 입/출력 장치로부터 입력신호가 공급되고 있기 때문에, 루틴은 테이타 입/출력 수행하기 위한 단계(S62)로 진행한다. 따라서, 제8b도에 도시된 응용 프로그램이 사용될 경우에는, 제6도의 슬립 모드가 효과적으로 사용될 수 없다.
본 발명의 목적은, 전력소비를 절약하는 개선된 동작 처리에 의해 효과적으로 동작될 수 있는 마이크로컴퓨터 시스템을 제공하는 것이다.
상기 목적을 달성하기 위하여 본 발명의 마이크로컴퓨터 시스템은 클럭 신호에 응답하여, 입/출력 장치로부터의 응답을 기다리는 시간 기간을 나타내는 입출력 장치의 동작을 검출하고 상기 시간 기간을 나타내는 동작 검출시 슬립 모드 실행 명령을 발생하기 위한 처리 수단과, 소정시간동안 상기 슬립 모드 실행 명령에 응답하여 상기 처리 수단에 대한 상기 클럭 신호의 속도를 변화시키는 슬립 모드를 실행하기 위한 타이밍제어 수단을 구비하며, 상기 처리 수단은 또한 상기 타이밍 제어 수단이 슬립 모드를 완료한 후에 입/출력 장치로부터의 응답이 존재하는지의 여부를 검사한다.
이하, 첨부한 도면을 참조하여 본 발명을 상세히 설명한다.
제1도는 본 발명의 실시예를 도시한 블록도이다. 시스템의 주제어 섹션으로서 동작하는 마이크로프로세서(1)(이하, ＂CPU＂라함)는 시스템에 접속된 주변장치를 RAM(2) 및 ROM(3)에 기억된 프로그램에 따라서 제어한다. 주변장치는 메모리 및 리프레시 제어기(4), DMA제어기(5) 입/출력 장치 제어기(6) 및 타이머 LSI(7)를 포함한다. 입/출력 장치 제어기(6)는 직렬식 I/O제어기(SIO), 프린터 I/O제어기, 디스크 I/O제어기 및 디스플레이 I/O제어기를 포함한다.
CPU(1), RAM(2), ROM(3), 메모리 및 메모리 리프레시 제어기(4), DMA제어기(5), 입/출력 장치 제어기(6), 타이밍 제어회로(10) 및 타이머 LSI(7)는 시스템 버스(8)에 공통으로 접속된다.
클럭 발생기(9)는 타이밍 제어회로(10)에 기본 클럭을 공급한다. 타이밍 제어회로(10)는 상기 기본 클럭을 수신하여 CPU(1), 메모리 및 메모리 리프레시 제어기(4), DMA제어기(5), 입/출력 장치 제어기(6) 및 타이머 LSI(7)를 동작시키기 위한 여러 가지 타이밍 신호를 발생한다. 이들 타이밍 신호들은 CPU클럭 리프레시 클럭, DMA클럭, 입/출력 및 타이머 클럭으로 각각 일컬어진다. 타이밍 제어회로(10)는 CPU(1)로부터 슬립 명령을 수신할 때 상기 주변 회로에 대한 클럭을 중지시키기 위한 내부 회로를 갖는다. 타임이 제어회로(10)의 내부 회로의 회로 구성은 제2a도 및 제2a도 및 2b도에 도시되어 있다.
제2a도에서는, 분주회로(21)가 클럭 발생기(9)로부터 기본 클럭을 수신하고, 분주된 클럭을 CPU(1)에 공급한다. 인터럽션 검출 플립플롭(22)의 출력 레벨은 제3a도에 도시된 바와같이 정상적으로는 하이이다. 플립플롭(22)이 슬립 제어 레지스터(24)로부터 출력 신호(24a)를 수신할 때, 플립플롭(22)의 레벨 은제3a도에 도시된 바와같이 로우 레벨로 바뀐다. 이어서, 플립플롭(22)이 입/출력 장치로부터 인터럽션 명령을 수신할 때, 플립플롭(22)의 레벨은 제3a도에 도시된 바와같이 하이레벨로 다시 복귀된다. 타이머 카운터(23)의 출력 레벨은 제3b도에 도시된 바와같이 정상적으로는 하이이다. 타이머 카운터(23)가 슬립제어 레지스터(24)로부터 출력신호(24b)를 수신할 때, 터이머 카운터(23)의 레벨은 제3b도에 도시된 바와같이 로우레벨로 바뀌고, 클럭 발생기(9)로부터 공급된 기본 클럭에 따라서 소정시간 기간동안 카운트를 행한다. 카운팅 완료후에, 타이머 카운터(23)의 레벨은 제3b도에 도시된 바와같이 하이 레벨로 다시 복귀된다. 슬립 제어 레지스터(24)는 인터럽션 검출 플립플롭(22)에 대한 입력용 레지스터 및, 타이머 카운터(23)에 대한 입력용 레지스터를 갖는다. 슬립 제어 레지스터(24)는 CPU(1)로부터 슬립 명령을 수신하고, 그 슬립 명령에 따라서 인터럽션 검출 플립플롭(22)에 대한 입력용 레지스터 또는 타이머 카운터(23)에 대한 입력용 레지스터를 세트시킨다. CPU(1)는 두가지 형태의 슬립 명령을 공급하는데, 그 하나의 명령은 입/출력 장치로부터 인터럽션 명령이 발생될때까지 슬립 상태가 지속되게 하는 명령이고, 다른 하나의 명령은 소정시간 기간동안 슬립 상태가 유지되게 하는 명령이다. 슬릅 제어 레지스터(24)는 전자의 슬립 명령에 따라서 인터럽션 검출 플립플롭(22)에 대한 입력용 레지스터를 세트시키고, 후자의 슬립 명령에 따라서 타이머 카운터(23)에 대한 입력용 레지스터를 세트시킨다.
AND게이트(25)는 분주회로(21), 인터럽션 검출 플립플롭(22) 및 타이머 카운터(23)로 부터의 출력 신호들을 수신하여, 논리곱셈 값을 얻는다. 정상적으로는 인터럽션 검출 플립플롭(22) 및 타이머 카운터(23)의 출력 신호들(22a, 23a)의 레벨이 하이이기 때문에, AND게이트(25)는 분주회로(21)에서 공급된 CPU클럭을 출력시킨다. 인터럽션 검출 플립플롭(22) 또는 타이머 카운터(23)의 출력신호(22a, 23a)중 어느 하나의 레벨이 로우일 때, AND게이트(23)는 CPU클럭의 출력을 중지시키며, 따라서 CPU(1)는 슬립 상태로 된다. 여기에서는 CPU클럭에 대한 제어만이 설명되었지만, 다른 주변 회로에 대한 클럭들도 마찬가지로 제어될 수 있다.
제2a도와 관련하여, 슬립모드에서 클럭 공급이 중지되는 경우는 설명하였지만, 슬립 모드에서 클럭을 지연시킴으로써 전력을 절약하는 것도 가능하다. 이 경우는 제2b도를 참조하여 설명한다. 제2b도에 있어서, 제2a도에 도시된 것과 동일한 블록은 동일 참조 부호를 사용하였으며, 그에 대한 설명은 생략한다. 분주 회로(28)는 클럭 발생기(9)로부터 공급된 기본 클럭을 정상 클럭과 저속 클럭으로 분주한다. 정상클럭은 정상 모드에서 각 장치에 공급되고, 저속 클럭은 슬립 모드에서 공급된다. 정상 클럭 및 저속 클럭은 신호 라인들(28H, 28L)을 통하여 선택회로(26)에 공급된다. AND게이트(27)의 출력에 따라서, 선택회로(26)는 정상 클럭과 저속 클럭중 하나만을 CPU(1)로 출력시킨다. AND게이트(27)의 출력 레벨이 하이일 경우, 선택회로(26)는 신호라인(28L)을 통하여 공급된 정상 클럭을 선택한다. AND게이트(27)의 출력레벨이 로우일 경우, 선택회로(26)는 신호라인(28L)을 통하여 공급된 저속 클럭을 선택한다. AND게이트(27)의 출력레벨은, 안터럽션 검출 플립플롭(22)또는 타이머 카운터(23)의 출력신호(22a, 23a)중 어느 하나가 로우일 때 로우이다. 다시말하면, CPU(1)가 슬립 모드 명령을 출력할 때, 선택회로(26)는 저속 클럭을 선택한다. 따라서, CPU클럭의 속도는 제4a도 및 제4b도에 도시된 바와같이 더 낮고, 전력 소비가 감소된다.
제5도는 본 발명의 실시예에 따른 마이크로프로세서 시스템의 기본 입/출력 서비스 루틴을 도시한 플로우차트이다. 이 서비스루틴은 제6도에 도시된 루틴과 함께 핌웨어 프로그램으로서 ROM(3)내에 기억된다.
이하, 제8b도에 도시된 응용 프로그램의 처리 루틴이 실행될 때 본 발명의 실시예에 시스템이 어떻게 동작하는 지에 대하여 설명한다.
제8b도에 있어서, S81단계에서는 제5도에 도시된 바와같이 입/출력장치의 상태를 검사하기 위한 루틴이 실행된다. 제5도의 S50단계에서는 슬립 모드가 실행된다. CPU(1)는 타이밍 제어회로(10)에 슬립 명령을 공급한다. 이 슬립 명령은 CPU 및 그 주변 회로가 소정 시간 기간동안 슬립 모드에서 유지되게 한다.
CPU(1)로부터의 슬립 명령에 응답하여, 타이밍 제어회로(10)는 CPU(1) 및 그 주변회로의 클럭을 중지시킨다. 즉, 타이밍 제어회로(10)는 타이머 카운터(23)에 대한 입력을 위한 슬립 제어 레지스터(24)내의 레지스터를 세트시킨다. 따라서 타이머 카운터(23)의 출력신호(23a)는 로우 레벨로 세트되며, 이로써 CPU(1) 및 그 주변 회로의 클럭이 중지된다. 한편, 타이머 카운터(23)는 소정 시간 기간동안 카운트를 행한다. 카운팅 완료시, 타이머 카운터(23)의 출력신호(23a)는 하이레벨로 다시 세트된다. 타이머 인터럽션에 의해, CPU(1)는 S50단계에서 슬립 모드를 클리어 한다. 이어서, S51단계에서는 입/출력 장치로부터의 입력이 존재하는지의 여부가 결정된다. S51단계에서는 입/출력 장치로부터 입력이 공급될 경우, CPU(1)는 내부 레지스터내의 소정 플래그(도시생략)를 세트시킨다(S53). 본 발명의 실시예에 있어서는 플래그가 CPU(1)의 내부 레지스터내에 구성되지만, 이 플래그는 RAM(2)내에 구성될 수도 있다. 입/출력 장치로 부터의 입력이 없을 경우에는, S52단계에서 플래그가 클리어 된다.
상태를 검사하기 위한 상기 루틴이 실행된 후에는, 루틴이 S82단계로 진행한다. S82단계에서는, 플래그가 세트되어 있는지의 여부를 결정한다. 클래그가 클리어 되어 있으면, S83단계에서 다른 처리가 수행된다. 플래그가 세트되어 있으면, 제6도의 기본 입/출력 서비스 루틴을 실행하기 위한 단계(S84)로 진행된다. 타이머 카운터(23)에 의해 카운트 되어지는 시간 기간은 입/출력 장치의 응답속도 및 처리에 주는 영향을 고려하여 적당히 결정된다.
상술한 바와같이, 본 발명의 실시예에 있어서, 슬립 모드는 상태를 검사하기 위한 제7도의 루틴 상부에 삽입된다. 따라서, 제8b도의 응용 프로그램이 실행될 경우에는 슬립 모드는 효과적으로 사용된다. 슬립모드의 삽입으로 인해 시스템의 전력 소비는 현저하게 개선된다.
또한, 제6도에 도시된 기본 입/출력 서비스 루틴은 종래 방식대로 사용될 수 있다. 이 경우에 제8a도의 응용 프로그램이 실행되더라도, 슬립 모드의 처리는 효과적으로 활용된다. 제6도의 S61단계에서의 슬립 모드 처리에서는, 타이밍 제어회로(10)가 인터럽션 검출 플립플롭(22)에 대한 입력을 위한 슬립 제어 레지스터(24)내의 레지스터를 세트시킨다. 따라서, 인터럽션 검출 플립플롭(22)의 출력신호(22a)는 로우 레벨로 세트되고 CPU(1) 및 주변회로의 클럭이 중지된다. 그 다음에, 인터럽션 검출 플립플롭(22)이 입/출력 장치로부터 인터럽션 명령을 수신할 때, 플립플롭(22)의 출력신호(22a)는 하이 레벨로 다시 세트된다.
따라서, CPU(1)는 S61단계에서의 슬립 모드를 완료한다.
일예로서, 입/출력 제어기(6)에 접속된 키보드로부터의 입력을 대기하는 경우를 생각해 보자, 일반적으로, 키보드의 입력응답 속도는 최고 수십 밀리초(mS)이다. 그러므로, 수 mS의 슬립 모드가 대기 시간내에 삽입된다 할지라도, 시스템의 성능은 거의 영향을 받지 않는다. 또한, 다른 처리가 대기 시간동안 삽입될 경우, 대개의 경우 그 처리에서 속도는 중요하지 않다. 따라서, 전혀 문제가 없다. 여기서는, 키보드의 입력 처리에 관하여 언급하였다. 슬립 모드는 자기 테이프를 사용하는 입/출력 장치 또는 프린터 같은 어떤 저 처리 속도의 장치에도 적용이 가능하다.

Claims (16)

  1. 하나이상의 관련 입/출력 장치를 구비한 컴퓨터 시스템에 있어서, 클럭 신호에 응답하여, 상기 입/출력 장치로 부터의 응답을 기다리는 시간 기간을 나타내는 입/츨력 장치의 동작을 검출하고 상기 시간 기간을 나타내는 동작 검출시 슬립모드 실행 명령을 발생하는 처리 수단과(1)과; 소정 시간동안 상기 슬립 모드 실행 명령에 응답하여 상기 처리수단에 대한 상기 클럭신호의 속도를 변화시키는 슬립 모드를 실행하는 타이밍 제어수단(10)을 구비하며, 상기 처리 수단(1)은 상기 타이밍 제어 수단이 슬립 모드를 완료한 후에 입/출력 장치로부터의 응답이 존해하는지의 여부를 아울러 검사하는 것을 특징으로 하는 마이크로컴퓨터 시스템.
  2. 제1항에 있어서, 상기 처리수단(1) 및 상기 타임이 제어수단(10)에 결합된 주변회로(4,5,6,7)를 아울러 포함하고, 상기 타이밍 제어 수단이 기본 클럭 신호를 제공하고, 상기 처리 수단 및 상기 주변회로에 미리 정해진 클럭 신호를 공급하는 수단(9, 12)과; 상기 슬립 모드 실행 명령에 응답하여, 미리 정해진 시간 기간동안 상기 클럭신호 공급 수단에 의한 상기 클럭 신호 공급을 중지시키는 수단(23, 24, 25)을 포함하는 것을 특징으로 하는 마이크로컴퓨터 시스템.
  3. 제2항에 있어서, 상기 중지 수단이 상기 미리 정해진 시간 기간 경과후에 상기 클럭 신호의 공급을 재개시 시키는 수단(23)을 포함하는 것을 특징으로 하는 마이크로컴퓨터 시스템.
  4. 제1항에 있어서, 입/출력 장치로부터의 응답이 존재하는 지의 여부에 관한 정보를 보유하는 수단(1 또는 2)을 아울러 구비하고, 상기 처리 수단은 상기 타이밍 제어 수단에 의한 슬립 모드의 완료후에 입/출력 장치로 부터의 응답이 존재하는지의 여부를 검사하여, 응답존재시에는 상기 보유 수단으로 하여금 응답 존재에 고나한 정보를 보유하게 하고, 응답 부재시에는 상기 보유 수단에 기억된 정보를 클리어 시키는 것을 특징으로 하는 마이크로컴퓨터 시스템.
  5. 제4항에 있어서, 상기 보유 수단은 상기 처리 수단에 의해 액세스 가능한 메모리(2)를 포함하는 것을 특징으로 하는 마이크로컴퓨터 시스템.
  6. 제1항에 있어서, 상기 처리 수단 및 상기 타이밍 제어 수단에 결합된 주변 회로(4,5,6,7)를 포함하고, 상기 타이밍 제어 수단이, 상기 슬립 모드 실행 명령에 응답하여, 상기 처리 수단 및 상기 주변 회로에 대한 클럭 신호 속도가 변화도는 상기 슬립 모드를 실행하고, 카운팅 명령을 발생하는 제어 수단(24)과; 상기 제어 수단으로부터의 상기 카운팅 명령에 따라서 상기 미리 정해진 시간 기간동안 카운팅을 행하고, 상기 미리 정해진 시간 기간이 경과한 후에 상기 제어 수단에 인터럽션 신호를 출력하는 수단(23)을 포함하며, 상기 제어 수단은 상기 카운팅 수단으로부터 인터럽션 신호를 수신할 때 슬립 모드를 종료하는 것을 특징으로 하는 마이크로컴퓨터 시스템.
  7. 제1항에 있어서, 상기 처리 수단 및 상기 타이밍 제어 수단에 결합된 주변 회로(4,5,6,7)를 포함하고, 상기 타임이 제어 수단이, 기본 클럭 신호를 정상 클럭 신호와 저속 클럭 신호로 분주하는 수단(28)과, 상기 분주 수단으로부터 상기 정상 클럭 신호 및 저속 클럭 신호를 수신하여, 상기 슬립 모드 중에는 상기 처리수단 및 상기 주변회로에 상기 저속 클럭 신호를 공급하고, 그 이외의 시간에는 상기 정상 클럭 신호를 공급하는 선택 수단(26)을 포함하는 것을 특징으로 하는 마이크로컴퓨터 시스템.
  8. 제1항에 있어서, 상기 처리 수단 및 상기 타임이 제어 수단에 결합된 주변 회로(4,5,6,7)를 포함하고, 상기 타이밍 제어 수단이, 기본 클럭 신호를 공급하는 클럭 발생 수단(9)과, 상기 클럭 발생 수단으로 부터의 상기 기본 클럭 신호를 정상 클럭 신호와 저속 클럭 신호로 분주하는 수단(28)과, 상기 분주 수단으로부터 상기 정상 클럭 신호 및 저속 클럭 신호를 수신하고, 상기 정상 클럭 신호와 저속 클럭 신호중 하나를 상기 처리 수단 및 상기 주변 회로에 공급하는 선택 수단(26)과, 상기 슬립 모드 실행 명령에 응답하여 클럭 변경 명령을 출력하고, 상기 카운팅 수단에 의해 미리 정해진 시간 기간이 카운트된 후에 상기 클럭변경 명령을 취소시키도록 인터럽션 신호를 출력하는 카운팅 수단(23)를 포함하며, 상기 선택 수단은 상기 카운팅 수단으로 부터의 상기 클럭 변경 명령에 응답하여 상기 저속 클럭 신호를 선택하고, 상기 카운팅 수단으로 부터의 상기 인터럽션 신호후에 상기 정상 클럭 신호를 선택하는 것을 특징으로 하는 마이크로컴퓨터 시스템.
  9. 제8항에 있어서, 상기 타이밍 제어 수단이 상기 슬립 모드 실행 명령에 응답하여 상기 카운팅 수단으로 하여금 상기 미리 정해진 시간 기간동안 카운트를 행하도록 명령하는 명령 수단(24)을 아울러 포함하는 것을 특징으로 하는 마이크로컴퓨터 시스템.
  10. 제1항에 있어서, 상기 타이밍 제어 수단을 상기 슬립 모드 중에 상기 클럭 신호가 상기 처리 수단에 인가되지 못하게 하는 것을 특징으로 하는 마이크로컴퓨터 시스템.
  11. 입/출력 장치로부터의 응답을 대기하기 위한 시간 기간을 나타내는 상기 입/출력 장치의 동작을 검출하고 그 시간 기간을 나타내는 동작검출시 슬립 모드 실행 명령을 출력하는 CPU(1)와; 상기 CPU에 접속된 주변 장치( 4, 5, 6, 7)와; 기본 클럭 신호를 공급하는 클럭 발생기(9)와; 상기 클럭 발생기로부터의 상기 기본 클럭 신호를 CPU 및 상기 주변 장치용의 클럭 신호로 분주하고, 상기 클럭 신호를 상기 CPU 및 상기 주변 장치에 공급하는 분주 수단(21)과; 상기 CPU 로부터의 상기 슬립모드 실행 명령에 따라서 카운팅 명령을 발생하는 명령 수단(24)과; 상기 카운팅 명령이 출력되고 있는동안 클럭펄스를 카운팅하고, 상기 카운팅 명령에 응답하여 클럭 중지 명령을 출력하며, 카운트되는 상기 클럭 펄스에 의하여 결정되는 미리 결정된 시간 기간이 경과된 후에 상기 클럭중지 명령을 취소시키기 위한 인터럽션 신호를 출력하는 카운팅 수단(23)과; 상기 카운팅 수단으로부터 상기 클럭 중지 명령을 수신하고, 상기 클럭 중지 명령이 수신될 때 상기 분주 수단으로부터의 상기 클럭 신호의 공급을 중지시키도록 상기 분주 수단에 의한 분주를 중지시키며, 상기 카운팅 수단으로부터 상기 인터럽션 신호가 수신될 때 상기 분주 수단으로부터의 상기 클럭 신호의 공급을 재개시시키도록 상기 분주 수단에 의한 분주를 재개시키는 클럭 중지 수단(25)을 구비하는 것을 특징으로 하는 마이크로컴퓨터 시스템.
  12. 제11항에 있어서, 입/출력 장치로부터의 응답이 존재하는지의 여부에 관한 정보를 보유하는 보유수단(1 또는 2)을 아울러 구비하고, 상기 CPU는 상기 타이밍 제어 수단에 의한 슬립 모드의 완료후에 입/출력장치로부터의 응답이 존재하는지의 여부를 검사하여, 응답 존재시에는 상기 보유 수단으로 하여금 응답 존재에 관한 정보를 보유하게 하고, 응답 부재시에는 상기 보유 수단에 기억된 정보를 클리어 시키는 것을 특징으로 하는 마이크로컴퓨터 시스템.
  13. 제12항에 있어서, 상기 보유 수단은 상기 CPU에 의해 액세스 가능한 메모리(2)를 포함하는 것을 특징으로 하는 마이크로컴퓨터 시스템.
  14. 입/출력 장치로부터의 응답을 대기하기 위한 시간 기간을 검출하여 상기 시간 기간이 발생할 때 제1슬립 모드 실행 명령과 제2슬립 모드 실행 명령중 선택된 하나를 출력시키는데, 입/출력 장치로 부터의 응답이 있을 때까지 슬립 상태가 유지되어야 할 경우 상기 제1슬립 모드 실행 명령을 출력시키고, 미리 정해진 시간 기간동안 슬립 상태가 유지되어야 할 경우 상기 제2슬립 모드 실행 명령을 출력시키는 CPU(1)와; 상기 CPU에 접속된 주변 장치(4,5,6,7)와; 기본 클럭 신호를 공급하는 클럭 발생기(9)와; 상기 클럭 발생기로 부터의 상기 기본 클럭 신호를 상기 CPU 및 상기 주변 장치용의 클럭 신호로 분주하고, 상기 클럭 신호를 상기 CPU 및 상기 주변 공급하는 분주 수단(21)과; 상기 CPU로 부터의 상기 제1슬립 모드 실행 명령에 따라서 슬립 명령을 발생하고, 상기 CPU로부터의 상기 제2슬립 모드 실행 명령에 따라서 카운팅 명령을 발생하는 명령 수단(24)과; 입/출력 장치에 연결되어 그로부터의 응답 표시를 수신하고, 상기슬립 명령에 응답하여 제1클럭 중지 명령을 출력하며, 응답이 있음을 나타내는 상기 응답 표시가 상기 입/출력 장치로부터 수신될 때 제1클럭중지 명령을 취소시키기 위한 제1인터럽션 신호를 출력하는 인터럽션 검출 수단(22)과; 카운팅 명령이 출력되는 동안 클럭 펄스를 카운팅하고, 상기 카운팅 명령에 응답하여 제2클럭 중지 명령을 출력하며, 카운트 되는 상기 클럭 펄스에 의해 결정되는 미리 결정된 시간 기간이 경과된 후에 상기 제2클럭 중지 명령을 취소시키기 위한 제2인터럽션 신호를 출력하는 카운팅 수단(23); 상기 인터럽션 검출 수단으로부터 상기 제1클럭 중지 명령을 수신할 경우 상기 분주 수단으로부터의 상기 클럭 신호 공급을 중지시키도록 상기 분주 수단에 의한 분주를 중지시키고, 상기 인터럽션 검출 수단으로부터 상기 제1인터럽션 신호를 수신할 경우 상기 클럭 신호 공급을 재개시하도록 상기 분주 수단을 인에이블 시키며, 상기 키운팅 수단으로부터 상기 제2클럭 중지 명령을 수신할 경우 상기 분주수단에 의한 분주를 중지시키고, 상기 카운팅 수단으로부터 상기 제2인터럽션 신호를 수신할 경우 상기 클럭 신호의 공급을 재개시하도록 상기 분주 수단을 인에이블시키는 클럭 중지 수단(25)을 구비하는 것을 특징으로 하는 마이크로컴퓨터 시스템.
  15. 제14항에 있어서, 입/출력 장치로부터의 응답이 존재하는지의 여부에 관한 정보를 보유하는 보유 수단(1 또는 2)을 아울러 구비하고, 상기 CPU는 상기 카운팅 수단 및 상기 클럭 중지 수단에 의한 슬립 모드의 완료후에 입/출력 장치로 부터의 응답이 존재하는지의 여부를 검사하여, 응답 존재시에는 상기 보유수단으로 하여금 응답 존재에 관한 정보를 보유하게 하고, 응답 부재시에는 상기 보유 수단에 기억된 정보를 클리어 시키는 것을 특징으로 하는 마이크로컴퓨터 시스템.
  16. 제14항에 있어서, 상기 보유 수단은 상기 CPU에 의해 액세스 가능한 메모리(2)를 포함하는 것을 특징으로 하는 마이크로 컴퓨터 시스템.
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