KR900003974A - 반도체장치의 제조방법 - Google Patents
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1 도는 본 발명의 1실시예에 따른 반도체장치의 제조방법을 도시해 놓은 공정도.
제 2 도는 상기 제 1실시예에 따른 반도체장치의 주요부분에 대한 패턴평면도.
Claims (4)
- 반도체기판(1)상에 제 1절연막(5)이 형성되어 있고, 이 제1 절연막(5)상에 제 1배선층(6)이 형성되어 있으며, 이 제 1배선층(6)상에 제 2절연막(7)이 형성되어 있는 반도체장치의 상기 제2절연막(7)에 상기 제 1배선층(6)까지 도달되는 접속구멍(8)을 형성시키고, 이 접속구멍(8)이 형성된 상기 제2절연막(7)상에 제 3절연막(10)을 형성시키며, 이 제 3절연막(10)을 엣칭해서 상기 접속구멍(8)부분의 제 1매선층(6)을 노출시킨 후, 상기 접속구멍(8)부분을 포함하는 사기 제 2절연막(7)상에 제 2배선층(11)을 형성시키는 것을 특징으로 하는 반도체장치의 제조방법.
- 제 1 항에 있어서, 상기 제 1배선층(6)이 필드산화막(2)상에 연장·형상되어 있는 MOS형 반도체장치의 게이트전극으로 사용되고, 상기 제 2배선층(11)을 금속층으로 형성시키는 것을 특징으로 하는 반도체장치의 제조방법.
- 제 1항에 있어서, 상기 제 3절연막(10)을 Si3ON4막 또는 CVD-SiO2막으로 형성시키는 것을 특징으로 하는 반도체장치의 제조방법.
- 제 1 항에 있어서, 상기 제 3절연막(10)의 두께를 상기 제 1배선층(6)으로 부터 어긋난 위치에 형성된 틈새(9)의 폭의 1/2이상으로 하는 것을 특징으로 하는 반도체장치의 제조방법.※참고사항: 최초출원 내용에 의하여 공개하는 것임.
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