KR20090129803A - 액정표시장치용 어레이 기판 - Google Patents

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Abstract

본 발명은 액정표시장치에 관한 것으로, 보다 상세하게는 정전기에 의한 불량을 방지할 수 있는 액정표시장치 및 그 어레이 기판에 관한 것이다.
이를 위한 본 발명에 따른 액정표시장치용 어레이 기판은 표시 영역과 비표시 영역으로 구분된 기판과; 상기 표시 영역에 대응된 다수의 게이트 배선 및 데이터 배선, 박막트랜지스터 및 화소 전극과; 상기 비표시 영역에 대응된 드라이브 IC와; 상기 드라이브 IC와 이격된 양측에 위치하는 제 1 및 제 2 검사 패드와; 상기 비표시 영역의 가장자리를 따라 구성된 공통전압배선과; 상기 제 1 및 제 2 검사 패드와 공통전압배선을 각각 연결하는 제 1 및 제 2 정전기 방지수단을 포함하는 것을 특징으로 한다.
전술한 구성에서, 액정표시장치를 제작하는 공정 중에 정전기가 발생하더라도, 상기 제 1 및 제 2 검사 패드와 각각 연결된 제 1 및 제 2 정전기 방지수단이 설계되어 있기 때문에, 상기 제 1 및 제 2 검사 패드와 드라이브 IC로 유입되는 정전기를 공통전압배선으로 방출할 수 있는 바, 액정 패널을 등전위로 만들 수 있어 정전기에 의한 피해를 최소화할 수 있는 잠정이 있다.

Description

액정표시장치용 어레이 기판{Array Substrate of Liquid Crystal Display Device}
본 발명은 액정표시장치에 관한 것으로, 보다 상세하게는 정전기에 의한 불량을 방지할 수 있는 액정표시장치 및 그 어레이 기판에 관한 것이다.
일반적으로, 액정표시장치의 구동원리는 액정의 광학적 이방성과 분극성질을 이용하는 바, 상기 액정은 구조가 가늘고 길기 때문에 분자의 배열에 방향성을 가지고 있으며, 인위적으로 액정에 전기장을 인가하여 분자배열의 방향을 제어할 수 있다.
따라서, 상기 액정의 분자배열 방향을 임의로 조절하면, 액정의 분자배열이 변하게 되고, 광학적 이방성에 의하여 상기 액정의 분자배열 방향으로 빛이 굴절하여 화상정보를 표현할 수 있다.
현재에는 박막트랜지스터와 상기 박막트랜지스터에 연결된 화소 전극이 행렬방식으로 배열된 능동행렬 액정표시장치(Active Matrix LCD : AM-LCD)가 해상도 및 동영상 구현능력이 우수하여 가장 주목받고 있다.
이하, 첨부한 도면을 참조하여 종래에 따른 액정표시장치에 대해 설명하도록 한다.
도 1은 종래에 따른 중소형 모델의 액정표시장치를 개략적으로 나타낸 평면도이다.
도시한 바와 같이, 종래에 따른 액정표시장치(1)는 화상을 구현하는 표시 영역(AA)과, 상기 표시 영역(AA)을 제외한 비표시 영역(NAA)으로 각각 구분된 컬러필터 기판(미도시) 및 어레이 기판(10)과, 상기 컬러필터 기판 및 어레이 기판(10)의 이격된 사이 공간에 개재된 액정층(미도시)을 포함한다. 상기 컬러필터 기판 및 어레이 기판(10)과 액정층을 포함하여 액정 패널(미도시)이라 한다.
도면으로 상세히 제시하지는 않았지만, 상기 컬러필터 기판의 하부 면에는 비표시 영역(NAA)에 대응하여 백라이트 유닛(미도시)으로부터 입사되는 빛을 차폐하는 블랙 매트릭스(미도시)와, 상기 표시 영역(AA)에 대응하여 순차적으로 패턴된 적(R), 녹(G), 청(B) 서브 컬러필터를 포함하는 컬러필터층(미도시)과, 상기 컬러필터층의 하부 전면으로 공통 전극(미도시)이 차례로 구성된다.
한편, 상기 어레이 기판(10) 상의 표시 영역(AA)에는 일 방향으로 스캔 신호를 인가받는 다수의 게이트 배선(20)과, 상기 다수의 게이트 배선(20)과 수직 교차하여 다수의 화소 영역(P)을 정의하며, 데이터 신호를 인가받는 다수의 데이터 배선(30)과, 상기 다수의 게이트 및 데이터 배선(20, 30)의 교차지점에 각각 대응 구성된 다수의 박막 트랜지스터(T)와, 상기 다수의 박막트랜지스터(T)와 일대일 대응 연결된 다수의 화소 전극(70)이 구성된다.
또한, 상기 어레이 기판(10) 상의 비표시 영역(NAA)에는 표시 영역(AA)에 대응된 다수의 게이트 배선(20)과 다수의 데이터 배선(30)과 각각 연결되어 드라이브 IC(35)로부터의 스캔 신호와 데이터 신호를 다수의 게이트 배선(20)과 데이터 배선(30)에 각각 인가하는 다수의 게이트 연장배선(22)과 데이터 연장배선(32)이 구성된다.
상기 비표시 영역(NAA)의 가장자리를 따라 FPC(Flexible Printed Circuit: 90)를 통해 외부의 공통 전압발생부(미도시)로부터의 공통 신호를 액정 패널의 네 모퉁이에 각각 위치하는 다수의 도통 수단(86)을 통해 컬러필터 기판의 전면에 구성된 공통 전극에 인가하는 공통전압배선(50)이 위치한다. 상기 드라이브 IC(35)와 이격된 양측으로는 게이트 연장배선(22) 및 데이터 연장배선(32)으로 게이트, 데이터의 전압 및 신호 파형을 각각 검사하는 제 1 및 제 2 검사 패드(60, 62)와, 상기 FPC(90)와 연결하기 위한 패드부(75)가 위치한다. 상기 FPC(90)와 연결된 패드부(75)는 FPC 커넥터(92)를 통해 외부의 시스템(미도시)으로부터의 구동 전압을 각각 인가받게 된다. 상기 도통 수단(86)은 은(Ag) 도트가 이용될 수 있다.
전술한 액정표시장치(1)는 공통 전극에 인가된 공통 전압과 드라이브 IC(35)를 통해 선택기간에 박막트랜지스터(T)를 통해 화소 전극(70)으로 인가된 데이터 신호 간의 전위차에 의해 액정의 분자배열을 변화시키게 되고, 이러한 액정의 분자배열에 따라 액정층을 투과하는 빛의 양을 조절하여 영상을 구현하게 된다.
이때, 상기 어레이 기판(10)은 실리카 계열의 유리로 이루어져 있어 직접적 으로 정전기가 유입되는 것은 아니나, 어레이 기판(10) 상에 각 전극 및 배선을 형성하는 과정에서 챔버 내부에 부유하는 이물질이나 갑작스런 순간 전류로 드라이브 IC(35)와 제 1 및 제 2 검사 패드(60, 62)로 정전기가 유입되는 경우가 종종 발생하고 있다.
이러한 드라이브 IC(35) 및 제 1 및 제 2 검사 패드(60, 62)로 유입된 정전기는 게이트 및 데이터 배선(20, 30)으로 흘러들어가 표시 영역(AA)에 대응된 박막트랜지스터(T)의 구동을 마비시키는 문제를 유발하여 생산 수율을 급격히 저해하고 있는 상황이다.
본 발명은 전술한 문제를 해결하기 위해 안출된 것으로, 드라이브 IC 및 검사 패드로 유입되는 정전기에 의한 소자의 파괴를 미연에 방지하는 것을 통해 생산 수율을 개선하는 것을 목적으로 한다.
전술한 목적을 달성하기 위한 본 발명에 따른 액정표시장치용 어레이 기판은 표시 영역과 비표시 영역으로 구분된 기판과; 상기 표시 영역에 대응된 다수의 게이트 배선 및 데이터 배선, 박막트랜지스터 및 화소 전극과; 상기 비표시 영역에 대응된 드라이브 IC와; 상기 드라이브 IC와 이격된 양측에 위치하는 제 1 및 제 2 검사 패드와; 상기 비표시 영역의 가장자리를 따라 구성된 공통전압배선과; 상기 제 1 및 제 2 검사 패드와 공통전압배선을 각각 연결하는 제 1 및 제 2 정전기 방지수단을 포함하는 것을 특징으로 한다.
이때, 상기 제 1 검사 패드는 상기 데이터 배선과 동일층에서 동일한 물질로 형성된다. 상기 제 1 정전기 방지수단은 절연물질로 이루어진 게이트 절연막을 사이에 두고, 상기 공통전압배선과 제 1 검사 패드의 이격된 사이 공간에 위치하는 제 1 반도체 패턴과, 상기 제 1 반도체 패턴과 접촉되며 양측으로 이격 구성된 제 1 및 제 2 방전 배선을 포함한다.
또한, 상기 제 1 반도체 패턴과 제 1 및 제 2 방전 배선의 상부에는, 상기 공통전압배선과 제 1 방전 배선의 일 측을 각각 노출하는 제 1 및 제 2 콘택홀과, 상기 제 1 검사 패드를 노출하는 다수의 검사 패드 오픈홀을 포함하는 보호막이 형성되고, 상기 보호막 상부에는 상기 제 1 및 제 2 콘택홀을 통해 상기 공통전압배선과 제 1 방전 배선을 연결하는 제 1 투명 연결패턴이 형성된 것을 특징으로 한다.
이때, 상기 제 2 검사 패드는 상기 게이트 배선 및 공통전압배선과 동일층에서 동일한 물질로 형성된다. 상기 제 2 정전기 방지수단은 절연물질로 이루어진 게이트 절연막을 사이에 두고, 상기 공통전압배선과 제 2 검사 패드의 이격된 사이 공간에 위치하는 제 2 반도체 패턴과, 상기 제 2 반도체 패턴과 접촉되며 양측으로 이격 구성된 제 3 및 제 4 방전 배선을 포함한다.
또한, 상기 제 2 반도체 패턴과 제 3 및 제 4 방전 배선의 상부에는, 상기 공통전압배선과 제 3 방전 배선의 일 측을 각각 노출하는 제 3 및 제 4 콘택홀과, 상기 제 4 방전 배선과 제 2 검사 패드의 일 측을 각각 노출하는 제 5 및 제 6 콘택홀과, 상기 제 2 검사 패드를 노출하는 다수의 제 2 검사 패드 오픈홀을 포함하는 보호막이 형성되고, 상기 보호막 상부에는 상기 제 3 및 제 4 콘택홀을 통해 상기 공통전압배선과 제 3 방전 배선을 연결하는 제 2 투명 연결패턴과, 상기 제 5 및 제 6 콘택홀을 통해 상기 제 4 방전 배선과 제 2 검사 패드를 연결하는 제 3 투명 연결패턴이 각각 형성된 것을 특징으로 한다.
상기 제 1 및 제 2 검사 패드는 다수 개 형성되며, 상기 제 1 및 제 2 정전기 방지수단은 상기 제 1 및 제 2 검사 패드의 수에 대응된다.
상기 공통 전극과 평행하게 이격 구성된 공통 전극 또는 상기 게이트 배선과 평행하게 이격 구성된 스토리지 배선과 전기적으로 연결되며, 상기 제 1 또는 제 2 검사 패드와 이격된 일 측에 형성된 제 3 검사 패드를 포함한다.
본 발명에서는 게이트, 데이터, 공통의 전압 및 신호를 검사하는 다수의 검사 패드와 공통전압배선을 다수의 정전기 방지수단과 각각 연결하는 것을 통해 정전기에 의한 피해를 최소화할 수 있다.
--- 실시예 ---
본 발명은 게이트, 데이터, 공통의 신호 및 파형을 검사하는 다수의 검사 패드와 공통전압배선을 다수의 정전기 방지수단과 각각 연결한 것을 특징으로 한다.
이하, 첨부한 도면을 참조하여 본 발명에 따른 액정표시장치에 대해 설명하도록 한다.
도 2는 본 발명에 따른 중소형 모델의 액정표시장치를 개략적으로 나타낸 평면도이고, 도 3은 도 1의 Ⅲ-Ⅲ'선을 따라 절단하여 나타낸 단면도이다.
도 2와 도 3에 도시한 바와 같이, 본 발명에 따른 액정표시장치(100)는 화상을 구현하는 표시 영역(AA)과, 상기 표시 영역(AA)을 제외한 비표시 영역(NAA)으로 각각 구분된 컬러필터 기판(105) 및 어레이 기판(110)과, 상기 컬러필터 기판(105) 및 어레이 기판(110)의 이격된 사이 공간에 개재된 액정층(115)을 포함하는 액정 패널(125)과, 상기 어레이 기판(110)과 이격된 배면에서 내부광을 발산하는 백라이트 유닛(196)을 포함한다.
상기 컬러필터 기판(105)의 투명 기판(101) 하부 면에는 비표시 영역(NAA)과, 상기 표시 영역(AA)에 대응된 화소 영역(P) 간 경계부에 대응하여 백라이트 유닛(196)으로부터 입사되는 빛을 차폐하는 블랙 매트릭스(112)와, 상기 표시 영역(AA)의 블랙 매트릭스(112)를 경계로 순차적으로 패턴된 적(R), 녹(G), 청(B) 서브 컬러필터(116a, 116b, 116c)를 포함하는 컬러필터층(116)과, 상기 컬러필터층(116)을 덮는 오버 코트층(114)과, 상기 오버 코트층(114)의 하부 전면에 구성된 공통 전극(180)을 포함한다.
한편, 상기 어레이 기판(110)의 투명 기판(102) 상부 면에는 표시 영역(AA) 에 대응된 일 방향으로 스캔 신호를 인가받는 다수의 게이트 배선(120)과, 상기 다수의 게이트 배선(120)과 수직 교차하여 다수의 화소 영역(P)을 정의하며, 데이터 신호를 인가받는 다수의 데이터 배선(130)과, 상기 다수의 게이트 및 데이터 배선(120, 130)의 교차지점에 각각 대응 구성된 다수의 박막트랜지스터(T)와, 상기 다수의 박막트랜지스터(T)와 일대일 대응 연결된 다수의 화소 전극(170)을 구성한다.
또한, 상기 어레이 기판(110)의 투명 기판(102) 상부 면의 비표시 영역(NAA)에는 표시 영역(AA)에 대응된 다수의 게이트 배선(120)과 다수의 데이터 배선(130)과 각각 연결되어 드라이브 IC(135)로부터의 스캔 신호와 데이터 신호를 다수의 게이트 배선(120)과 데이터 배선(130)에 각각 인가하는 다수의 게이트 연장배선(122)과 데이터 연장배선(132)을 구성한다.
또한, 상기 비표시 영역(NAA)의 가장자리를 따라 FPC(190)를 통해 외부의 공통 전압발생부(미도시)로부터의 공통 신호를 액정 패널(125)의 네 모퉁이에 각각 위치하는 다수의 도통 수단(186)을 통해 컬러필터 기판(105)의 전면에 구성된 공통 전극(180)에 공통 신호를 인가하는 공통전압배선(150)과, 상기 드라이브 IC(135)와 이격된 양측으로 게이트 연장배선(120) 및 데이터 연장배선(130)으로 인가되는 게이트, 데이터의 전압 및 신호 파형을 각각 검사하는 제 1 및 제 2 검사 패드(160, 162)와, 상기 제 1 및 제 2 검사 패드(160, 162)와 공통전압배선(150)과 각각 연결된 제 1 및 제 2 정전기 방지수단(ESD1, ESD2)과, 상기 FPC(190)와 연결하기 위한 패드부(175)가 형성된다. 상기 FPC(190)와 연결된 패드부(175)는 FPC 커넥터(192) 를 통해 외부의 시스템(미도시)으로부터의 구동 전압을 각각 인가받게 된다.
상기 도통 수단(186)은 금볼, 은 도트 및 은 페이스트 중 선택된 어느 하나가 이용될 수 있다. 이때, 상기 게이트, 데이터의 전압 및 파형을 검사하는 제 1 및 제 2 검사 패드(160, 162) 만을 도시하고 있으나, 어레이 기판(110)에 공통 전극(180)과 화소 전극(170)이 함께 형성되는 횡전계 방식의 액정표시장치나 스토리지 온 커먼 방식으로 스토리지 커패시터를 설계하기 위해 표시 영역(AA)에 대응된 게이트 배선(120)과 평행하게 이격하여 스토리지 배선(미도시)을 설계하는 액정표시장치의 경우 제 1 및 제 2 검사 패드(160, 162)와 이격된 일 측으로 공통의 전압 및 파형을 검사하는 제 3 검사 패드(미도시)가 형성될 수 있다. 이러한 제 1 및 제 2 검사 패드(160, 162)와 제 3 검사 패드는 그 수에 있어서 액정표시장치의 설계 모델에 따라 달라질 수 있다.
즉, 상기 제 1 및 제 2 검사 패드(160, 162)는 다수 개 형성될 수 있으며, 상기 제 1 및 제 2 정전기 방지수단(ESD1, ESD2)은 상기 제 1 및 제 2 검사 패드(160, 162)의 수에 대응되도록 형성된다.
전술한 구성은 어레이 기판(110) 상에 각 전극 및 배선을 형성하는 과정에서 챔버 내부에 부유하는 이물질이나 갑작스런 순간 전류로 드라이브 IC(135) 및 제 1 및 제 2 검사 패드(160, 162)로 정전기가 유입되더라도, 제 1 및 제 2 검사 패드(160, 162)와 공통전압배선(150)에 각각 연결된 제 1 및 제 2 정전기 방지수단(ESD1, ESD2)을 통해 공통전압배선(150)으로 원활히 방출할 수 있게 된다.
따라서, 어레이 기판(110)의 가장자리를 따라 설계되는 공통전압배선(150)으 로 정전기를 방출하는 것을 통해 액정 패널(125)의 전 영역으로 정전기를 균일하게 분산시킬 수 있게 되는 바, 액정 패널(125) 내에서 등전위가 이루어지므로 정전기로부터의 피해를 최소화할 수 있게 된다.
이하, 첨부한 도면을 참조하여 제 1 및 제 2 정전기 방지수단에 대해 보다 상세히 설명하도록 한다.
도 4는 도 2의 A 부분을 확대한 평면도이고, 도 5는 도 4의 Ⅴ-Ⅴ'선을 따라 절단하여 나타낸 단면도로, 데이터 전압 및 파형을 검사하는 제 1 검사 패드를 나타낸 것이다.
도 4와 도 5에 도시한 바와 같이, 기판(110) 상의 비표시 영역(NAA)에는 게이트 메탈 물질로 이루어진 공통전압배선(150)이 형성되고, 상기 공통전압배선(150)의 상부 전면으로는 산화 실리콘(SiO2)과 질화 실리콘(SiNx)을 포함하는 무기절연물질 그룹 중 선택된 하나로 게이트 절연막(145)이 형성된다.
상기 게이트 절연막(145) 상에는 상기 공통전압배선(150)과 이격된 일 측으로 순수 비정질 실리콘(a-Si:H)으로 이루어진 제 1 반도체 패턴(140)과, 상기 제 1 반도체 패턴(140)과 접촉된 상부로 제 1 반도체 패턴(140)을 사이에 두고 양측으로 분리된 제 1 방전 배선(182) 및 제 2 방전 배선(184)과, 상기 제 2 방전 배선(182)과 동일 패턴으로 연장된 제 1 검사 패드(160)가 각각 형성된다. 상기 제 1 및 제 2 방전 배선(182, 184)과 제 1 반도체 패턴(140)을 포함하여 제 1 정전기 방지수단(ESD1)이라 한다.
상기 제 1 정전기 방지수단(ESD1)이 형성된 기판(110) 상에는 공통전압배선(150)과 제 1 방전 배선(182)을 노출하는 제 1 및 제 2 콘택홀(CH1, CH2)과, 상기 제 1 검사 패드(150)를 노출하는 다수의 제 1 검사 패드 오픈홀(DPH1)을 포함하는 보호막(155)이 형성된다.
상기 제 1 및 제 2 콘택홀(CH1, CH2)과 다수의 제 1 검사 패드 오픈홀(DPH1)을 포함하는 보호막(155) 상에는 제 1 및 제 2 콘택홀(CH1, CH2)을 통해 공통전압배선(150)과 제 1 방전 배선(182)을 연결하는 제 1 투명 연결패턴(172)이 형성된다.
전술한 구성을 도 2와 연계하여 설명하면, 액정 패널의 제조 과정 중 챔버 내부에 부유하는 이물질이나 갑작스런 순간 전류로 드라이브 IC(135) 및 제 1 검사 패드(160)로 정전기가 유입될 경우, 드라이브 IC(135)를 타고 게이트 연장배선(122) 및 게이트 배선(120), 데이터 연장 배선(132) 및 데이터 배선(130)으로 흘러들어가는 것이 아니라, 제 1 정전기 방지수단(ESD1)의 제 1 반도체 패턴(140)이 열리면서 공통전압배선(150)으로 정전기를 효율적으로 방출할 수 있게 된다.
이와 같이, 공통전압배선(150)을 통해 액정 패널의 전 영역으로 정전기를 분산시키는 것을 통해 등전위가 이루어지므로 정전기에 의한 피해를 최소화할 수 있는 장점이 있다.
도 6은 도 2의 B 부분을 확대한 평면도이고, 도 7은 도 6의 Ⅶ-Ⅶ'선을 따라 절단하여 나타낸 단면도로, 게이트 전압 및 파형을 검사하는 제 2 검사 패드를 나타낸 것이다.
도 6과 도 7에 도시한 바와 같이, 기판(110) 상의 비표시 영역(NAA)에는 게이트 메탈 물질로 이루어진 공통전압배선(150)과, 상기 공통전압배선(150)과 이격된 제 2 검사 패드(162)가 형성되고, 상기 공통전압배선(150)과 제 2 검사 패드(162)의 상부 전면으로는 산화 실리콘(SiO2)과 질화 실리콘(SiNx)을 포함하는 무기절연물질 그룹 중 선택된 하나로 게이트 절연막(145)이 형성된다.
상기 게이트 절연막(145) 상에는 상기 공통전압배선(150) 및 제 2 검사 패드(162)와 이격된 사이 공간에 순수 비정질 실리콘(a-Si:H)으로 이루어진 제 2 반도체 패턴(142)과, 상기 제 2 반도체 패턴(142)과 접촉된 상부로 제 2 반도체 패턴(142)을 사이에 두고 양측으로 분리된 제 3 방전 배선(186) 및 제 4 방전 배선(188)이 각각 구성된다. 상기 제 3 및 제 4 방전 배선(186, 188)과 제 2 반도체 패턴(142)을 포함하여 제 2 정전기 방지수단(ESD2)이라 한다.
상기 제 2 정전기 방지수단(ESD2)이 형성된 기판(110) 상에는 공통전압배선(150)과 제 3 방전 배선(186)을 각각 노출하는 제 3 및 제 4 콘택홀(CH3, CH4)과, 상기 제 4 방전 배선(188)과 제 2 검사 패드(162)를 각각 노출하는 제 5 및 제 6 콘택홀(CH5, CH6)과, 상기 제 2 검사 패드(162)를 노출하는 다수의 제 2 검사 패드 오픈홀(DPH2)을 포함하는 보호막(155)이 형성된다.
상기 제 3, 제 4, 제 5, 제 6 콘택홀(CH3, CH4, CH5, CH6)과 다수의 제 2 검사 패드 오픈홀(DPH2)을 포함하는 보호막(155) 상에는 제 3 및 제 4 콘택홀(CH3, CH4)을 통해 공통전압배선(150)과 제 3 방전 배선(186)을 연결하는 제 2 투명 연결 패턴(174)과, 상기 제 5 및 제 6 콘택홀(CH5, CH6)을 통해 제 4 방전 배선(188)과 제 2 검사 패드(162)를 연결하는 제 3 투명 연결패턴(176)이 각각 형성된다.
도 4의 제 1 투명 연결패턴(172)과 제 2 및 제 3 투명 연결패턴(174, 176)은 화소 전극(도 2의 170)과 동일층에서 인듐-틴-옥사이드(ITO) 및 인듐-징크-옥사이드(IZO)를 포함하는 투명한 도전성 물질 그룹 중 선택된 하나로 형성된다.
따라서, 본 발명에서는 다수의 검사 패드 및 공통전압배선을 다수의 정전기 방지수단과 각각 연결하는 것을 통해 정전기에 의한 피해를 최소화할 수 있는 장점이 있다.
지금까지, 본 발명에서는 소형의 액정표시장치에 대해 일관되게 설명하였으나 이는 일 예에 불과한 것으로 대형의 액정표시장치에도 동일하게 적용하는 것이 가능하다. 특히, 공통 전극과 화소 전극이 서로 다른 기판에 구성된 수직 전계 모드 뿐만 아니라, 공통 전극과 화소 전극이 어레이 기판 상에 모두 형성되는 횡전계 방식이나 스토리지 온 커먼 방식으로 스토리지 커패시터를 확보하기 위해 스토리지 배선을 설계하는 액정표시장치에 있어서도 동일하게 적용할 수 있다는 것은 자명한 사실일 것인 바, 이에 대한 설명은 생략하도록 한다.
따라서, 본 발명은 상기 실시예에 한정되는 것은 아니며, 본 발명의 사상 및 정신을 벗어나지 않는 한도 내에서 다양하게 변형 및 변경할 수 있다는 것은 주지의 사실일 것이다.
도 1은 종래에 따른 중소형 모델의 액정표시장치를 개략적으로 나타낸 평면도.
도 2는 본 발명에 따른 중소형 모델의 액정표시장치를 개략적으로 나타낸 평면도.
도 3은 도 1의 Ⅲ-Ⅲ'선을 따라 절단하여 나타낸 단면도.
도 4는 도 2의 A 부분을 확대한 평면도.
도 5는 도 4의 Ⅴ-Ⅴ'선을 따라 절단하여 나타낸 단면도.
도 6은 도 2의 B 부분을 확대한 평면도.
도 7은 도 6의 Ⅶ-Ⅶ'선을 따라 절단하여 나타낸 단면도.
* 도면의 주요부분에 대한 부호의 설명*
110 : 어레이 기판 120 : 게이트 배선
122 : 게이트 연장배선 130 : 데이터 배선
132 : 데이터 연장배선 135 : 드라이브 IC
145 : 패드부 150 : 공통전압배선
160, 162 : 제 1 및 제 2 검사 패드 170 : 화소 전극
186 : 도통 수단 190 : FPC
192 : FPC 커넥터 T : 박막트랜지스터
ESD1, ESD2 : 제 1 및 제 2 정전기 방지수단

Claims (9)

  1. 표시 영역과 비표시 영역으로 구분된 기판과;
    상기 표시 영역에 대응된 다수의 게이트 배선 및 데이터 배선, 박막트랜지스터 및 화소 전극과;
    상기 비표시 영역에 대응된 드라이브 IC와;
    상기 드라이브 IC와 이격된 양측에 위치하는 제 1 및 제 2 검사 패드와;
    상기 비표시 영역의 가장자리를 따라 구성된 공통전압배선과;
    상기 제 1 및 제 2 검사 패드와 공통전압배선을 각각 연결하는 제 1 및 제 2 정전기 방지수단
    을 포함하는 액정표시장치용 어레이 기판.
  2. 제 1 항에 있어서,
    상기 제 1 검사 패드는 상기 데이터 배선과 동일층에서 동일한 물질로 형성된 것을 특징으로 하는 액정표시장치용 어레이 기판.
  3. 제 1 항에 있어서,
    상기 제 1 정전기 방지수단은 절연물질로 이루어진 게이트 절연막을 사이에 두고, 상기 공통전압배선과 제 1 검사 패드의 이격된 사이 공간에 위치하는 제 1 반도체 패턴과, 상기 제 1 반도체 패턴과 접촉되며 양측으로 이격 구성된 제 1 및 제 2 방전 배선을 포함하는 것을 특징으로 하는 액정표시장치용 어레이 기판.
  4. 제 3 항에 있어서,
    상기 제 1 반도체 패턴과 제 1 및 제 2 방전 배선의 상부에는, 상기 공통전압배선과 제 1 방전 배선의 일 측을 각각 노출하는 제 1 및 제 2 콘택홀과, 상기 제 1 검사 패드를 노출하는 다수의 검사 패드 오픈홀을 포함하는 보호막이 형성되고, 상기 보호막 상부에는 상기 제 1 및 제 2 콘택홀을 통해 상기 공통전압배선과 제 1 방전 배선을 연결하는 제 1 투명 연결패턴이 형성된 것을 특징으로 하는 액정표시장치용 어레이 기판.
  5. 제 1 항에 있어서,
    상기 제 2 검사 패드는 상기 게이트 배선 및 공통전압배선과 동일층에서 동일한 물질로 형성된 것을 특징으로 하는 액정표시장치용 어레이 기판.
  6. 제 1 항에 있어서,
    상기 제 2 정전기 방지수단은 절연물질로 이루어진 게이트 절연막을 사이에 두고, 상기 공통전압배선과 제 2 검사 패드의 이격된 사이 공간에 위치하는 제 2 반도체 패턴과, 상기 제 2 반도체 패턴과 접촉되며 양측으로 이격 구성된 제 3 및 제 4 방전 배선을 포함하는 것을 특징으로 하는 액정표시장치용 어레이 기판.
  7. 제 6 항에 있어서,
    상기 제 2 반도체 패턴과 제 3 및 제 4 방전 배선의 상부에는, 상기 공통전압배선과 제 3 방전 배선의 일 측을 각각 노출하는 제 3 및 제 4 콘택홀과, 상기 제 4 방전 배선과 제 2 검사 패드의 일 측을 각각 노출하는 제 5 및 제 6 콘택홀과, 상기 제 2 검사 패드를 노출하는 다수의 제 2 검사 패드 오픈홀을 포함하는 보호막이 형성되고, 상기 보호막 상부에는 상기 제 3 및 제 4 콘택홀을 통해 상기 공통전압배선과 제 3 방전 배선을 연결하는 제 2 투명 연결패턴과, 상기 제 5 및 제 6 콘택홀을 통해 상기 제 4 방전 배선과 제 2 검사 패드를 연결하는 제 3 투명 연결패턴이 각각 형성된 것을 특징으로 하는 액정표시장치용 어레이 기판.
  8. 제 1 항에 있어서,
    상기 제 1 및 제 2 검사 패드는 다수 개 형성되며, 상기 제 1 및 제 2 정전기 방지수단은 상기 제 1 및 제 2 검사 패드의 수에 대응되는 것을 특징으로 하는 액정표시장치용 어레이 기판.
  9. 제 1 항에 있어서,
    상기 공통 전극과 평행하게 이격 구성된 공통 전극 또는 상기 게이트 배선과 평행하게 이격 구성된 스토리지 배선과 전기적으로 연결되며, 상기 제 1 또는 제 2 검사 패드와 이격된 일 측에 형성된 제 3 검사 패드를 포함하는 것을 특징으로 하는 액정표시장치용 어레이 기판.
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