KR20020001373A - 반도체 소자의 커패시터 제조 방법 - Google Patents
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Abstract
본 발명은 반도체 소자의 커패시터 제조 방법에 관한 것으로, 고유전율 값을 가지는 BST 유전체막을 이용한 커패시터를 제조 공정에서, 하부 전극을 형성하는 공정에서 확산 방지막이 산화되고, BST 유전체막에 포함된 산소가 하부 전극과 반응하여 BST 유전체막의 유전율이 저하되는 것을 방지하기 위하여, 하부전극 증착 시에는 산화기체 대신 NH3를 사용하여 하부 전극을 증착한 후 하부 전극의 표면을 얇게 산화 처리하고, 상부전극 증착 시에는 산화기체를 사용하여 상부 전극을 증착함으로써, 확산방지막과 접하는 하부전극의 표면은 산소가 거의 없는 전극으로 형성하고, BST 고유전체와 접하는 하부 및 상부전극 표면은 산소가 충분히 공급된 상태의 전극으로 형성할 수 있어, 확산 방지막 및 BST 유전체막의 막질을 향상시켜 우수한 전기적 특성을 가지는 커패시터를 제조할 수 있는 반도체 소자의 커패시터 제조 방법이 개시된다.
Description
본 발명은 반도체 소자의 커패시터 제조 방법에 관한 것으로, 특히 하부 전극과 BST 유전체막이 반응하여 BST 유전체막의 산소가 저하됨에 따라 커패시터의전기적 특성이 저하되는 것을 방지할 수 있는 커패시터 제조 방법에 관한 것이다.
최근 들어, 반도체 소자에서는 Pt, Ru, Ir 등의 귀금속류를 이용하여 BST(BaSrTiO3) 고유전체 커패시터의 전극으로 사용하는데, 전극과 BST 유전체막의 우수한 계면 특성을 확보하기 위해 이중전극을 사용하거나, 여러 가지 방법으로 전극의 표면을 후처리를 하고 있다. 그러나 종래의 방법으로 이중전극을 형성하기 위해서는 공정시간이 길뿐만 아니라, 이중전극 사이의 계면 특성(합금 형성 또는 adhesion 문제)도 조절해야 하는 어려움이 있다.
또한, DRAM의 집적도가 높아짐에 따라 우수한 단차 피복성을 확보하기 위해서는 MOCVD로 전극을 증착하는 것이 필수적이다.
종래의 MOCVD 전극 형성 기술은 전극 재료의 MO 소오스와 N2O, O2같은 산화기체가 유전율을 저하시키는 원인이 된다. 다시 말해, 하부전극 증착시 반응기체로 사용된 산소가 하부 전극 내에 소량으로 잔류하게 되는데, 후속 열처리 때 하부층으로 산소의 확산이 일어나 TiN 같은 확산방지막 또는 Si막을 산화시키는 문제가 발생하여 유전율 저하시킨다. 하부 전극을 형성하고 후속 열처리과정에서는, Ru, Ir 등의 하부 전극이 BST 유전체막의 성분인 산소를 빼앗아 산화물을 형성하게 됨에 따라 BST 유전체막의 산소가 줄어들어 유전율이 저하된다. 유전율의 저하는 커패시터의 전기적 특성이 저하되는 원인이 된다.
따라서, 본 발명은 하부 전극은 NH3가스를 반응 가스로 이용하여 형성한 후 표면만을 얇게 산화처리하고 상부 전극은 산화 가스를 이용하여 형성하므로, 확산 방지막과 접하는 하부전극의 계면에는 산소가 거의 없고 BST 유전체막과 접하는 상부 전극의 계면에는 산소가 충분한 상태로 형성되어, 확산 방지막의 산화 및 유전체막 산소성분 저하를 방지해 커패시터의 전기적 특성을 향상시킬 수 있는 반도체 소자의 커패시터 제조 방법을 제공하는데 그 목적이 있다.
도 1은 본 발명에 따른 반도체 소자의 커패시터 제조 방법을 설명하기 위하여 도시한 단면도.
<도면의 주요 부분에 대한 부호 설명>
1 : 반도체 기판 2 : 층간 절연막
3 : 도프트 실리콘막 4 : 확산 방지막
5 : 하부 전극 5a : 하부 전극 산화층
6 : BST 유전체막 7 : 상부 전극
본 발명에 따른 반도체 소자의 커패시터 제조 방법은 반도체 소자를 형성하기 위한 여러 요소가 형성된 반도체 기판 상에 층간 절연막 및 배선용 도프트 실리콘막을 형성하는 단계, 도프트 실리콘막 상에 확산 방지막을 형성하는 단계, 확산 방지막 상에 하부 전극을 형성하는 단계, 하부 전극의 표면을 후처리하여 하부 전극 산화층을 형성하는 단계, 하부 전극 산화층 상에 유전체막 및 상부 전극을 순차적으로 형성하는 단계를 포함하여 이루어진다.
상기의 단계에서, 층간 절연막은 SiO2, SiON 또는 표면만을 질화물 처리한 SiO2를 이용하여 1000 내지 10000Å의 두께로 형성한다.
확산 방지막은 CVD법 또는 PVD법으로 TiN, TaN, TiSiN, TaSiN, TiAIN 및 TaAIN 중 어느 하나를 이용하여 100 내지 2000Å의 두께로 형성한다.
하부 전극은 NH3, O2, N2O, H2, N2+H2, O2, N2O 및 N2+NH3중 어느 하나를 반응기체로 이용하여 RuR2, RuR3또는 Ru3(CO)12를 MO소오스로 하는 MOCVD법으로 형성한다. R은 H, C1-C8Alky1, C2-C10Alkeny1, C1-C8Alkoxy, C6-C10Ary1, β-diketonates, Cyclopentadieny1, C1-C8Alkylcyclopentadienyl, C1-C8Alkenylcyclopentadienyl 및 불소첨가된 유도체들을 의미한다. 또한, 하부 전극은 CVD법 또는 PVD법으로 Ru, lr, RuO2, lrO2, RuO2/Ru, lrO2/lr, Pd, Rh, Pt, BaxSr1-xRuO3/Ru(x=0 내지 1), CaxSr1-xRuO3/Ru(x=0 내지 1), lr/Ru, Ru/lr, Pt/Ru, Ru/Pt, RuO2/Pt, Pt/lr, lr/Pt 및 lrO2/Pt 중 어느 하나를 100 내지 2000Å의 두께로 형성할 수도 있다. 하부 전극을 형성한 후에는 N2, Ar, He, H2, O2, N2O, NH3, 또는 이들의 혼합기체를 이용하여 300 내지 900℃의 온도범위의 RTP 또는 퍼니스 방법으로 열처리를 실시한다.
하부 전극 산화층은 N2, Ar, He, H2, O2, N2O, NH3, 또는 이들의 혼합기체를 사용기체로 하는 플라즈마 방법 또는 RTP 방법으로 300 내지 900℃의 온도 범위에서 상기 하부 전극의 표면을 후처리하여 형성하거나, 300 내지 600℃의 온도범위에서 상기 하부 전극의 표면을 UV/O3처리하여 형성한다.
유전체막은 화학기상 증착법으로 BaxSr1-xTiO3또는 Ta2O5를 100 내지 1000Å의두께로 형성한다. 유전체막을 형성한 후에는 N2, Ar, He, H2, O2, N2O, NH3, 또는 이들의 혼합기체를 이용하여 300 내지 900℃의 온도범위 RTP 또는 퍼니스 방법으로 열처리를 실시하거나, 300 내지 600℃의 온도범위에서 UV/O3처리를 실시한다.
상부 전극은 NH3, O2, N2O, H2, N2+H2, O2, N2O 및 N2+NH3중 어느 하나를 반응기체로 이용하여, CVD법 또는 PVD법으로 Ru, Ir, RuO2, IrO2, Ru/RuO2, Ir/IrO2, Pd, Rh 및 Pt 등을 100 내지 2000Å 두께로 형성하거나, CVD법 또는 PVD법으로 Ru/BaxSr1-xRuO3(x=0∼1), Ru/CaxSr1-xRuO3(x=0∼1), Ir/Ru, Ru/Ir, Pt/Ru, Ru/Pt, Pt/RuO2, Pt/Ir, Ir/Pt 및 Pt/IrO2등을 100 내지 2000Å 두께로 형성한다. 상부 전극을 형성한 후에는 N2, Ar, He, H2, O2, N2O, NH3, 또는 이들의 혼합기체를 이용하여 300 내지 900℃의 온도범위에서 RTP 또는 퍼니스 방법으로 열처리를 실시한다.
이하, 첨부된 도면을 참조하여 본 발명의 실시예를 상세히 설명하기로 한다.
도 1은 본 발명에 따른 반도체 소자의 커패시터 제조 방법을 설명하기 위하여 도시한 단면도이다.
도 1을 참조하면, 반도체 소자를 형성하기 위한 여러 요소가 형성된 반도체 기판(1) 상에 SiO2, SiON 또는 표면만을 질화물 처리한 SiO2를 이용하여 1000 내지 10000Å의 두께로 층간 절연막(2)을 형성하고, 배선을 위해 도프트 실리콘막(3)을형성한다.
도프트 실리콘막(3)의 산화를 방지하기 위하여 도프트 실리콘막(3)위에 CVD법 또는 PVD법으로 TiN, TaN, TiSiN, TaSiN, TiAIN 및 TaAIN 중 어느 하나를 이용하여 100 내지 2000Å의 두께로 확산 방지막(4)을 형성한다.
확산 방지막(4) 상부에 RuR2, RuR3또는 Ru3(CO)12를 MO소오스로 하고, NH3, O2, N2O, H2, N2+H2, O2, N2O 및 N2+NH3중 어느 하나를 반응기체로 이용하는 MOCVD법으로 100 내지 2000Å 두께의 Ru 하부전극(5)을 형성한다. MO소오스의 화학기호에 포함된 R은 H, C1-C8Alky1, C2-C10Alkeny1, C1-C8Alkoxy, C6-C10Ary1, β-diketonates, Cyclopentadieny1, C1-C8Alkylcyclopentadienyl, C1-C8Alkenylcyclopentadienyl 및 불소첨가된 유도체들을 의미한다.
하부 전극(5)은 CVD법 또는 PVD법을 이용해 Ru, lr, RuO2, lrO2, RuO2/Ru, lrO2/lr, Pd, Rh, Pt, BaxSr1-xRuO3/Ru(x=0 내지 1), CaxSr1-xRuO3/Ru(x=0 내지 1), lr/Ru, Ru/lr, Pt/Ru, Ru/Pt, RuO2/Pt, Pt/lr, lr/Pt 및 lrO2/Pt 중 어느 하나를 100 내지 2000Å의 두께로 하여 형성할 수 있다.
상기 하부 전극(5)을 형성한 후에는 N2, Ar, He, H2, O2, N2O, NH3, 또는 이들의 혼합기체를 이용하여 300 내지 900℃의 온도범위의 RTP 또는 퍼니스 방법으로 열처리를 실시하여 하부 전극(5) 내의 불순물을 제거하고, 하부전극(5)을 결정화한다.
이후, 하부 전극(5)을 표면 처리하여 하부 전극 산화층(5a)을 형성하는데, 하부 전극 산화층(5a)은 N2, Ar, He, H2H2, O2, N2O, NH3, 또는 이들의 혼합기체를 사용기체로 하는 플라즈마 방법 또는 RTP 방법으로 300 내지 900℃의 온도 범위에서 상기 하부 전극의 표면을 후처리하여 형성한다. 또는, 300 내지 600℃의 온도범위에서 상기 하부 전극(5)의 표면을 UV/O3처리하여 형성한다.
하부 전극 산화층(5a)은 하부 전극(5) 상부에 형성되는 후속층과의 계면특성이 저하되는 것을 방지하기 위해서이다. 하부 전극 산화층(5a)을 형성하는 다른 이유는, 하부 전극(5) 형성 후 후속 열공정 등에서 하부 전극(5)의 표면에 심하게 산화되어 유효 산화막 두께가 증가하는 것을 방지하기 위하여 미리 얇은 산화층을 형성하는 것이다.
하부 전극 산화층(5a) 상부에 CVD법으로 BaxSr1-xTiO3또는 Ta2O5을 이용하여유전체막(6)을 100 내지 1000Å의 두께로 형성한 후, RTP 등의 열처리를 실시하여 유전체막(7)을 결정화하고, 유전체막(6) 내의 불순물을 제거한다.
유전체막(6)의 열처리는 N2, Ar, He, H2, O2, N2O, NH3, 또는 이들의 혼합기체를 이용하여 300 내지 900℃의 온도범위 RTP 또는 퍼니스 방법으로 실시하거나, 300 내지 600℃의 온도범위에서 UV/O3처리로 실시한다.
계속해서, 유전체막(6) 상에 상부전극(7)을 MOCVD 방법으로 증착하되, 산화 기체를 반응 기체로 이용하여 상부 전극(7)을 형성하므로써 유전체막(6)의 산소성분 저하를 방지하여 유전율을 향상시킨다. 상부 전극(7)을 형성한 후 RTP 등의 열처리를 통해 상부 전극(7)을 결정화하고 막내의 불순물을 제거한다.
상부 전극(7)은 NH3, O2, N2O, H2, N2+H2, O2, N2O 및 N2+NH3등의 산화기체로 이용하여 CVD법 또는 PVD법으로 Ru, Ir, RuO2, IrO2, Ru/RuO2, Ir/IrO2, Pd, Rh 및 Pt 등을 100 내지 2000Å 두께로 형성한다. 상부 전극(7)은 CVD법 또는 PVD법으로 Ru/BaxSr1-xRuO3(x=0∼1), Ru/CaxSr1-xRuO3(x=0∼1), Ir/Ru, Ru/Ir, Pt/Ru, Ru/Pt, Pt/RuO2, Pt/Ir, Ir/Pt 및 Pt/IrO2등을 100 내지 2000Å 두께로 형성할 수도 있다.
상부 전극(7)을 형성한 후의 열처리는 N2, Ar, He, H2, O2, N2O, NH3, 또는 이들의 혼합기체를 이용하여 300 내지 900℃의 온도범위에서 RTP 또는 퍼니스 방법으로 실시한다.
상기의 공정은 하부 전극 및 상부 전극의 형성 조건을 주변의 물질에 따라 각각의 조건에 맞게 최적화한다. 상기와 같은 방법으로 커패시터를 제조하면, 각각의 막 사이에서 확산이 최대한 방지되어 깨끗한 계면을 얻을 수 있기 때문에 우수한 누설전류 특성을 갖는 커패시터를 제조할 수 있다.
상술한 바와 같이, 본 발명은 하부 전극 및 상부 전극의 형성 조건을 다르게 해줌으로써 막과 막사이의 확산을 방지하고, 계면 특성을 향상시켜 커패시터의 전기적 특성을 향상시키는 효과가 있다.
Claims (17)
- 반도체 소자를 형성하기 위한 여러 요소가 형성된 반도체 기판 상에 층간 절연막 및 배선용 도프트 실리콘막을 형성하는 단계;상기 도프트 실리콘막 상에 확산 방지막을 형성하는 단계;상기 확산 방지막 상에 하부 전극을 형성하는 단계;상기 하부 전극의 표면을 후처리하여 하부 전극 산화층을 형성하는 단계;상기 하부 전극 산화층 상에 유전체막 및 상부 전극을 순차적으로 형성하는 단계로 이루어지는 것을 특징을 하는 반도체 소자의 커패시터 제조 방법.
- 제 1 항에 있어서,상기 층간 절연막은 SiO2, SiON 또는 표면만을 질화물 처리한 SiO2를 이용하여 1000 내지 10000Å의 두께로 형성하는 것을 특징으로 하는 반도체 소자의 커패시터 제조 방법.
- 제 1 항에 있어서,상기 확산 방지막은 CVD법 또는 PVD법으로 TiN, TaN, TiSiN, TaSiN, TiAIN및 TaAIN 중 어느 하나를 이용하여 100 내지 2000Å의 두께로 형성하는 것을 특징으로 하는 반도체 소자의 커패시터 제조 방법.
- 제 1 항에 있어서,상기 하부 전극은 NH3, O2, N2O, H2, N2+H2, O2, N2O 및 N2+NH3중 어느 하나를 반응기체로 이용하여 형성하는 것을 특징으로 하는 반도체 소자의 커패시터 제조 방법.
- 제 1 항에 있어서,상기 하부 전극은 RuR2, RuR3또는 Ru3(CO)12를 MO소오스로 하는 MOCVD법으로 형성하는 것을 특징으로 하는 반도체 소자의 커패시터 제조 방법.
- 제 5 항에 있어서,상기 R은 H, C1-C8Alky1, C2-C10Alkeny1, C1-C8Alkoxy, C6-C10Ary1, β-diketonates, Cyclopentadieny1, C1-C8Alkylcyclopentadienyl, C1-C8Alkenylcyclopentadienyl 및 불소첨가된 유도체들을 포함하는 것을 특징으로 하는반도체 소자의 커패시터 제조 방법.
- 제 1 항에 있어서,상기 하부 전극은 CVD법 또는 PVD법으로 Ru, lr, RuO2, lrO2, RuO2/Ru, lrO2/lr, Pd, Rh, Pt, BaxSr1-xRuO3/Ru(x=0 내지 1), CaxSr1-xRuO3/Ru(x=0 내지 1), lr/Ru, Ru/lr, Pt/Ru, Ru/Pt, RuO2/Pt, Pt/lr, lr/Pt 및 lrO2/Pt 중 어느 하나를 100 내지 2000Å의 두께로 형성하는 것을 특징으로 하는 반도체 소자의 커패시터 제조 방법.
- 제 1 항에 있어서,상기 하부 전극을 형성한 후, N2, Ar, He, H2, O2, N2O, NH3, 또는 이들의 혼합기체를 이용하여 300 내지 900℃의 온도범위의 RTP 또는 퍼니스 방법으로 열처리를 실시하는 것을 특징을 하는 반도체 소자의 커패시터 제조 방법.
- 제 1 항에 있어서,상기 하부 전극 산화층은 N2, Ar, He, H2, O2, N2O, NH3, 또는 이들의 혼합기체를 사용기체로 하는 플라즈마 방법 또는 RTP 방법으로 300 내지 900℃의 온도 범위에서 상기 하부 전극의 표면을 후처리하여 형성하는 것을 특징으로 하는 반도체 소자의 커패시터 제조 방법.
- 제 1 항에 있어서,상기 하부 전극 산화층은 300 내지 600℃의 온도범위에서 상기 하부 전극의 표면을 UV/O3처리하여 형성하는 것을 특징으로 하는 반도체 소자의 커패시터 제조 방법.
- 제 1 항에 있어서,상기 유전체막은 화학기상 증착법으로 BaxSr1-xTiO3또는 Ta2O5를 100 내지 1000Å의 두께로 형성하는 것을 특징으로 하는 반도체 소자의 커패시터 제조 방법.
- 제 1 항에 있어서,상기 유전체막 열처리는 N2, Ar, He, H2, O2, N2O, NH3, 또는 이들의 혼합기체를 이용하여 300 내지 900℃의 온도범위 RTP 또는 퍼니스 방법으로 실시하는 것을 특징을 하는 반도체 소자의 커패시터 제조 방법.
- 제 1 항에 있어서,상기 유전체막 열처리는 UV/O3처리로 300 내지 600℃의 온도범위에서 실시하는 것을 특징으로 하는 반도체 소자의 커패시터 제조 방법.
- 제 1 항에 있어서,상기 상부 전극은 NH3, O2, N2O, H2, N2+H2, O2, N2O 및 N2+NH3중 어느 하나를 반응기체로 이용하여 형성하는 것을 특징으로 하는 반도체 소자의 커패시터 제조 방법.
- 제 1 항에 있어서,상기 상부 전극은 CVD법 또는 PVD법으로 Ru, Ir, RuO2, IrO2, Ru/RuO2, Ir/IrO2, Pd, Rh 및 Pt 등을 100 내지 2000Å 두께로 형성하는 것을 특징으로 하는 반도체 소자의 커패시터 제조 방법.
- 제 1 항에 있어서,상기 상부 전극은 CVD법 또는 PVD법으로 Ru/BaxSr1-xRuO3(x=0∼1), Ru/CaxSr1-xRuO3(x=0∼1), Ir/Ru, Ru/Ir, Pt/Ru, Ru/Pt, Pt/RuO2, Pt/Ir, Ir/Pt 및 Pt/IrO2등을 100 내지 2000Å 두께로 형성하는 것을 특징을 하는 반도체 소자의 커패시터 제조 방법.
- 제 1 항에 있어서,상기 상부 전극을 형성한 후, N2, Ar, He, H2, O2, N2O, NH3, 또는 이들의 혼합기체를 이용하여 300 내지 900℃의 온도범위에서 RTP 또는 퍼니스 방법으로 열처리를 실시하는 것을 특징을 하는 반도체 소자의 커패시터 제조 방법.
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