KR20010087321A - 넓은 시야각을 가지며 제조가 용이한 액정표시패널 - Google Patents
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Abstract
Description
Claims (17)
- 액정표시패널에 있어서, 제1기판, 상기 제1기판상에 형성된 TFT트랜지스터, 상기 TFT트랜지스터에 접속하도록 상기 제1기판상에 형성된 화소전극, 상기 제1기판에 대향하는 제2기판, 소정의 간격으로 상기 화소전극에 마주하도록 상기 제2기판상에 형성된 반대전극, 및 상기 화소전극과 상기 반대전극 사이에 배설된 액정층을 구비하고,상기 화소전극 대신에 상기 제1기판상에 형성된 제어전극;상기 제어전극을 피복하도록 상기 제1기판상에 형성된 절연막; 및소정의 위치에서 슬릿을 가지며 상기 소정의 간격으로 상기 반대전극에 마주하는 상기 절연막상에 형성된 부동전극을 포함하는 액정표시패널.
- 제1항에 있어서, 상기 슬릿이 화소에서 다수의 도메인들을 결정하는 액정표시패널.
- 제2항에 있어서, 상기 슬릿은 십자형을 가진 액정표시패널.
- 제1항에 있어서, 상기 액정표시패널은 칼러필터를 더 포함하고, 상기 칼러필터는 상기 제1기판상에 형성된 액정표시패널.
- 제1항에 있어서, 상기 액정표시패널은 블랙매트릭스를 더 포함하고, 상기 블랙매트릭스는 상기 제1기판상에 형성된 액정표시패널.
- 제1항에 있어서, 상기 액정층은 음유전상수의 이방성을 가지며 상기 제1 및 제2기판에 수직한 방향의 배향을 가진 액정분자들을 구비한 액정표시패널.
- 제1기판, 상기 제1기판상에 형성된 TFT트랜지스터, 상기 TFT트랜지스터에 접속하도록 상기 제1기판상에 형성된 화소전극, 상기 제1기판에 대향하는 제2기판, 소정의 간격으로 상기 화소전극에 마주하는 상기 제2기판상에 형성된 반대전극, 및 상기 화소전극과 상기 반대전극 사이에 배설된 액정층을 구비한 액정표시패널의 제조방법에 있어서,상기 화소전극 대신에 상기 제1기판상에 제어전극을 형성하는 단계;상기 제어전극을 피복하도록 상기 제1기판상에 절연막을 형성하는 단계;상기 소정의 간격으로 상기 반대전극에 마주하도록 상기 절연막상에 부동전극을 형성하는 단계; 및소정의 위치에서 슬릿을 형성하기 위하여 상기 부동전극을 부분적으로 제거하는 단계를 포함하는 액정표시패널의 제조방법.
- 제1투명기판, 제2투명기판, 상기 제1투명기판과 상기 제2투명기판 사이에 삽입된 액정층, 및 칼러필터층을 구비하며, 상기 액정층은 다수의 도메인들로 분할된 상태로 구동되며,상기 제1투명기판상에 형성된 게이트버스;상기 게이트버스로부터 절연되고 상기 게이트버스에 수직하도록 상기 제1투명기판상에 형성된 데이터버스;상기 제1투명기판상에 형성되며 상기 게이트버스 및 상기 데이터버스에 접속된 박막트랜지스터;상기 게이트버스, 상기 데이터버스 및 상기 박막트랜지스터를 피복하도록 상기 제1투명기판상에 형성된 상기 칼러필터층상에 형성된 제1평탄화막;상기 제1평탄화막상에 형성되며, 상기 도메인들을 제어하는 전압을 공급하기 위하여 상기 제1평탄화막과 상기 칼러필터층에 형성된 접촉구멍을 통하여 상기 박막트랜지스터에 접속된 제어전극;상기 제어전극상에 형성된 제2평탄화막; 및상기 제2평탄화막상에 형성되며 상기 제어전극으로부터 절연된 화소전극을 포함하는 액정표시패널.
- 제8항에 있어서, 상기 제2투명기판상에 형성된 반대전극을 더 포함하고, 상기 화소전극은 상기 제어전극과 상기 반대전극 사이의 전압차에 의하여 결정되는 전위, 상기 제어전극과 상기 화소전극 사이의 전기용량, 및 상기 화소전극과 반대전극 사이의 전기용량을 가진 액정표시패널.
- 제8항에 있어서, 상기 액정층은 상기 제1 및 제2투명기판에 수직한 배향의 방위를 갖는 액정분자들을 구비하며, 상기 액정층은 수직배향의 모드로 작동하는 액정표시패널.
- 제8항에 있어서, 상기 화소전극은 액정층을 상기 도메인들로 분할하는 슬릿을 가진 액정표시패널.
- 제1투명기판, 제2투명기판, 상기 제1투명기판과 상기 제2투명기판 사이에 삽입된 액정층, 및 칼러필터층을 구비하고, 상기 액정층은 다수의 도메인들로 분할된 상태로 구동되고,상기 제1투명기판상에 형성된 게이트버스;상기 게이트버스로부터 절연되고 상기 게이트버스에 수직하도록 상기 제1투명기판상에 형성된 데이터버스;상기 제1투명기판상에 형성되고 상기 게이트버스 및 상기 데이터버스에 접속된 박막트랜지스터;상기 제1투명기판상에 형성된 상기 칼러필터층상에 형성되며, 상기 도메인들을 제어하는 전압을 공급하기 위하여 상기 칼러필터층에 형성된 접촉구멍을 통하여 상기 박막트랜지스터에 접속된 제어전극;상기 제어전극상에 형성된 평탄화막; 및상기 평탄화막상에 형성되어 상기 제어전극으로부터 절연된 화소전극을 포함하는 액정표시패널.
- 제12항에 있어서, 상기 액정표시패널은 상기 제2투명기판상에 형성된 반대전극을 더 포함하고,상기 화소전극은 상기 제어전극과 상기 반대전극 사이의 전압차에 의하여 결정되는 전위, 상기 제어전극과 상기 화소전극 사이의 전기용량, 및 상기 화소전극과 반대전극 사이의 전기용량을 가지는 액정표시패널.
- 제12항에 있어서, 상기 액정층은 상기 제1 및 제2 투명기판에 수직한 배향의 방위를 갖는 액정분자들을 구비하고, 상기 액정층은 수직배향의 모드에서 작동하는 액정표시패널.
- 제12항에 있어서, 상기 화소전극은 액정층을 상기 도메인들로 분할하는 슬릿을 가진 액정표시패널.
- 제1투명기판, 제2투명기판, 상기 제1투명기판과 상기 제2투명기판 사이에서 삽입된 액정층, 및 칼러필터층을 구비하고, 상기 액정층은 다수의 도메인들로 분할된 상태로 구동되는 액정표시패널의 제조방법에 있어서,상기 제1투명기판상에서 게이트전극 및 상기 게이트전극에 연속하는 게이트버스를 형성하는 단계;상기 게이트전극 및 상기 게이트버스를 피복하도록 상기 제1투명기판상에 게이트절연막을 형성하는 단계;상기 게이트전극 위에 있는 상기 게이트절연막상에 형성된 반도체층을 형성하는 단계;반도체층에 접속된 소스전극, 반도체층에 접속된 드레인전극, 및 상기 제1투명기판상의 상기 소스전극에 연속하는 데이터버스를 형성하는 단계;상기 소스전극을 노출하도록 상기 제1투명기판상에 패시베이션막을 형성하는 단계;상기 패시베이션막상에서 소정의 면적을 갖는 칼러필터층을 형성하는 단계;상기 패시베이션막이 노출된 영역상에 블랙매트릭스를 형성하는 단계;상기 소스전극에 접속하도록 상기 칼러필터층상에 제어전극을 형성하는 단계;상기 제어전극을 피복하는 평탄화막을 형성하는 단계; 및상기 제어전극으로부터 절연되도록 상기 평탄화막상에 화소전극을 형성하는 단계를 포함하는 액정표시패널의 제조방법.
- 제16항에 있어서, 상기 제어전극이 형성되기 전에 상기 칼러필터 및 상기 블랙매트릭스상에 부가적인 평탄화막을 형성하는 단계를 더 포함하고, 상기 제어전극이 상기 부가적인 평탄화막상에 형성되는 액정표시패널의 제조방법.
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