KR19990082008A - 반도체장치의 제조장치 - Google Patents

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Abstract

반도체 제조장치의 반응실(7)내의 하부전극(3)상의 실리콘 기판(6)의 주위에 평균 거칠기가 1∼1000㎛의 거친면을 가지는 할로겐 원소 스캐빈지 부재로써의 실리콘 링(12)을 배치하고, 실리콘 기판(6)의 상방에 평균 거칠기가 1∼1000㎛의 거친면을 가지는 할로겐 원소 스캐빈지 부재로써의 상부 실리콘 전극(5)을 배치하며, 반응실(7)내로 도입하는 가스로써 C2F6을 사용함으로써, 제조장치의 가동 초기상태에서 불소원소를 효과적으로 스캐빈지할 수 있고, 종래의 장치에 비해, 반도체장치의 에이징시간을 단축할 수 있는 반도체장치의 제조장치를 제공한다.

Description

반도체장치의 제조장치
최근의 반도체 장치의 집적도 향상은 눈부시다. 집적도 향상은 프로세스 기술의 진보에 의한 결과이고, 특히 핫리소그래피 기술과 드라이 에칭 기술의 진보가 집적도 향상에 대해 큰 역할을 담당해 왔다. 최근의 드라이 에칭 기술에 대해 주목하면, 미세화의 관점에서 저 가스 압력, 고밀도 플라즈마를 적극적으로 이용하는 방향에 있다. 그와같은 배경중, 전자 사이클로트론 공명 플라즈마, 유도결합형 플라즈마나 헬리콘(helicon)파 여기(勵起) 플라즈마를 이용한 드라이 에칭장치가 차차 개발, 판매되고 있다(예:「Semiconductor World」1993년 10월호 제68∼75 페이지).
이하, 종래의 산화막 에칭장치의 일예의 구성에 대해 도1에 도시한 유도 결합형 플라즈마를 이용한 장치에 의거하여 설명한다.
도1에 있어서, 1은 유도코일, 2는 고주파 전원으로 유도코일(1)에 고주파전력을 공급하기 위한 것이다. 3은 하부전극, 4는 고주파 전원으로 하부전극(3)에 고주파전압을 공급하기 위한 것이다. 5는 상부 실리콘 전극이고, 6은 실리콘 기판으로 하부전극(3)상에 배치되어 상부 실리콘 전극(5)과 반응실(7)내에 있어서 평행으로 배치되어 있다. 8은 압력제어 밸브, 9는 배기펌프이고, 이들에 의해 반응실(7)안이 소정 압력으로 유지된다. 10은 가스 봄베이고, 매스 플로우(mass flow)(13)를 통하여 반응실(7)내로 C2F6를 공급하기 위한 것이다. 11은 히터이고, 상부 실리콘 전극(5)을 소정 온도로 유지한다. 12는 실리콘 링이고, 하부전극(3)상에 있어서 실리콘기판(6)을 둘러싸도록 배치되어 있다. 13은 매스 플로우, 14는 매춰(matcher)이고, 고주파 전원(4)과 하부전극(3)등과의 임피던스를 맞추기 위한 것이다.
반응실(7)내에 가스 봄베(10)로부터 C2F6를 도입하여 소정 압력으로 유지하고, 유도코일(1)에 고주파전원(2)에서 고주파전력을 공급함으로써, 반응실(7)내에 플라즈마를 생성시킨다. 하부전극(3)에 고주파전원(4)에서 바이어스 전압을 인가함으로써 플라즈마로 부터 이온을 끌어들여 실리콘기판(6)의 에칭을 한다.
실리콘 링(12)과 상부 실리콘 전극(5)(이하 이들을 합쳐 실리콘 부재라고 한다)은 플라즈마중의 불소를 실리콘과의 반응으로 감소시킴으로써, 실리콘 기판(6)에 대해 산화막이 높은 에칭 속도비를 실현시키는 것이다(도2b 참조). 이 실리콘 부재는 평활한 표면을 가지고, 도3b에 도시한 바와같이, 표면의 凹凸H의 평균 거칠기는 약0.1㎛정도이다.
도4의 15에, 표면이 평활한 종래의 실리콘부재를 사용했을 때의 그 사용시간(T)과 실리콘 기판의 산화막 에칭율 대 레지스트 선택비R와의 관계의 일예를 도시한다.
실리콘 부재가 할로겐 원소를 스캐빈지(scavenge)할 수 있는 상태로 하기 위해서는 일정시간을 요하고, 이와같은 에이징(ageing)을 종료한 후에 안정된 에칭율을 얻을 수 있다.
그러나, 도4의 15에서 알 수 있는 바와같이, 표면이 평활한 실리콘 부재를 사용한 종래의 제조장치로는 산화막 에칭율 대 레지스트 선택비(R)가 안정되기 위해서는 장시간을 요한다. 즉, 실리콘 부재가 할로겐 원소를 스캐빈지할 수 있는 상태로 하기 위해서는 긴 에이징시간이 필요하다는 문제가 있었다.
본 발명은 반도체장치의 드라이 에칭 장치에 관한 것이다.
도1은 본 발명의 일실시예의 반도체장치의 에칭장치의 구성도,
도2a는 본 발명의 장치의 원리를 나타내는 모델도, 도2b는 종래 장치의 원리를 나타내는 모델도,
도3a는 본 발명의 일실시예의 장치의 할로겐 원소 스캐빈지부재의 표면확대도, 도3b는 종래예의 장치의 할로겐 원소 스캐빈지부재의 표면확대도,
도4는 본 발명의 일실시예 장치의 사용시간(T)과 실리콘기판의 산화막 에칭율 대 레지스트 선택비(R)와의 관계를, 종래예의 장치에 의한 경우와 대비하여 도시한 도면이다.
본 발명은, 상기 종래의 문제를 해결하기 위해, 표면에 凹凸을 설치한 할로겐 원소 스캐빈지부재를 구비함으로써, 에이징시간을 단축할 수 있는 반도체장치의 제조장치를 제공하는 것을 목적으로 한다.
상기 목적을 달성하기 위해, 본 발명의 반도체장치의 제조장치는, 드라이 에칭장치의 반응실내의 표면에 미소한 凹凸을 설치한 할로겐 원소 스캐빈지부재를 가지는 것을 특징으로 한다.
상기와 같은 반도체장치의 제조장치에 의하면, 표면에 凹凸을 설치한 할로겐원소 스캐빈지부재를 구비하고 있으므로, 할로겐원소에 대한 실효적인 표면적을 초기 상태에서 유지하고, 그에따라 에이징시간이 단축된다.
상기 반도체 장치의 제조장치에 있어서는, 미소한 凹凸의 평균 거칠기가 1∼1000㎛인 것이 바람직하다. 이와같은 범위내이면, 에이징 시간을 단축할 수 있고, 또한, 또한, 에칭 멈춤등의 악영향을 방지할 수 있다.
또한 상기 반도체장치의 제조장치에 있어서, 미소한 凹凸의 평균 거칠기는 1∼10㎛인 것이 바람직하다.
또한, 상기 반도체장치의 제조장치에 있어서, 할로겐 원소 스캐빈지 부재는 실리콘 및 탄소에서 선택된 적어도 한개의 재료를 포함하는 것이 바람직하다.
또한, 상기 반도체 장치의 제조장치에 있어서, 할로겐 원소 스캐빈지 부재는 에칭해야할 실리콘 기재의 주위에 배치되는 실리콘 링인 것이 바람직하다.
또한, 상기 반도체장치의 제조장치에 있어서, 할로겐원소 스캐빈지 부재는 에칭해야할 실리콘기재의 상방에 배치되는 상부 실리콘 전극인 것이 바람직하다.
또한, 상기 반도체장치의 제조장치에 있어서, 凹凸을 웨트 에칭으로 작성하는 것이 바람직하다.
또한, 상기 반도체장치의 제조장치에 있어서, 드라이에칭에 이용하는 가스는 C2F6인 것이 바람직하다. C2F6를 이용하면, 반응실내에 플라즈마를 생성시킬 수 있다.
본 발명의 반도체장치의 제조장치가 상기한 종래장치와 가장 다른점은 할로겐원소 스캐빈지부재 즉 실리콘 링(12) 및 상부 실리콘 전극(5)으로써, 표면이 凹凸를 가지는 거친면 부재를 사용한 것이다.
이하, 본 발명의 일실시예에 대해 도면을 참조하면서 설명한다. 이 실시예 장치의 기본적인 구조는 도1에 도시한대로 이고, 이것은 종래예와 마찬가지이므로, 상세한 설명은 생략한다. 반응실(7)내로 도입되는 가스로써 C2F6를 사용하고, 그 압력을 5×10-3Torr로 했다. 그리고, 실리콘 링(12) 및 상부 실리콘 전극(5)은 도3a에 도시하는 바와같이, 표면의 凹凸H의 평균 거칠기는 1㎛이상으로 종래의 할로겐 원소 스캐빈지 부재의 표면 거칠기의 10배 이상으로 한다. 또한 도3a의 표면상태(표면 모포로지)는 실리콘의 결정 입자경계가 나타나 있고, 도3b의 표면상태와는 다른 것이다.
실리콘 링(12) 및 상부 실리콘 전극(5)이라는 할로겐 원소 스캐빈지부재의 표면을 거친면으로 함으로써, 제조장치 가동의 초기상태에서 불소원소를 스캐빈지할 수 있다. 그 매카니즘을 도2a에 모식적으로 도시한다. 또한 도2b는 종래부재에 의한 스캐빈지의 매카니즘을 나타내고 있다.
도2a, B에 도시한 모델에서도 명백한 바와같이, 할로겐 원소 스캐빈지부재의 유효표면적이 넓은 경우, 보다 많은 불소를 스캐빈지할 수 있다고 생각된다. 그런데, 유효표면적이 너무 넓은 경우에는, 불소를 지나치게 스캐빈지해버리므로, 에칭 멈춤등 특성에 악영향을 주게되므로, 그 표면거칠기는 1000㎛이하인 것이 바람직하다.
따라서, 할로겐 원소 스캐빈지 부재의 凹凸평균 거칠기는 바람직하게는 1∼1000㎛의 범위이고, 특히 바람직한 것은 1∼10㎛의 범위이다.
상기와 같은 할로겐 원소 스캐빈지 부재의 거친면은 웨트 에칭에 의해 작성할 수 있다. 본 실시예는 불화수소(HF)가 1, 초산(HNO3)이 10인 혼합비 용제를 이용하여, 액온25℃에서 30분간의 웨트 에칭에 의해 작성했다.
도4는 본 발명의 실시예장치, 즉 표면의 거칠기가 큰 할로겐 원소 스캐빈지 부재를 사용한 장치의 사용시간(T)과 실리콘기판의 산화막 에칭율 대 레지스트 선택비(R)와의 관계를, 종래장치에 의한 경우와 대비하여 도시한 것이다. 15가 종래예, 16이 본 발명의 실시예의 측정결과를 도시한 것이다.
본 실시예의 할로겐 원소 스캐빈지 부재에는, 凹凸의 평균 거칠기가 3㎛인 것을 이용했다. 종래장치의 할로겐 원소 스캐빈지 부재의 凹凸의 평균 거칠기는 0.2㎛인 것을 이용했다. 또한 본 실시예와 종래장치는 모두 실린콘 링이 내직경210.4mm, 외직경272.9mm, 두께12.9mm인 것을 이용했다.
도4에서 명백한 바와같이, 16으로 표시한 본 실시예의 것은 15로 표시한 종래예의 것에 비해, 실리콘 기판의 산화막 에칭율 대 레지스트 선택비(R)의 안정에 이르는 시간이 짧아진다. 예를들면, 산화막 에칭율 대 레지스트 선택비(R)의 규격치를 7.5로 하면, 15로 표시한 종래예의 것은 규격치를 7.5에 이르는데 32.5시간의 에이징시간을 요하는데 대해, 16으로 표시한 본 실시예의 것은 에이징시간이 제로이다.
또한, 상기한 본 실시예에서는 할로겐 원소 스캐빈지 부재로써 실리콘을 사용했는데, 이에 대신하여 카본을 사용해도 동등한 효과를 얻을 수 있는 것은 말할것도 없다.
이상 설명한 바와같이 본 발명의 반도체장치의 제조장치에서는, 할로겐 원소 스캐빈지 부재의 표면에 미소한 凹凸을 설치함으로써, 에이징 시간을 단축할 수 있다.
이상과 같이 본 발명에 관한 반도체장치의 제조장치에 의하면, 드라이 에칭시의 에이징시간을 단축할 수 있으므로, 반도체장치의 실리콘기판의 드라이 에칭장치로써 이용할 수 있다.

Claims (8)

  1. 반도체장치의 드라이 에칭장치에 있어서, 반응실내에 표면에 미소한 凹凸을 설치한 할로겐 원소 스캐빈지 부재를 가지는 것을 특징으로 하는 반도체장치의 제조장치.
  2. 제1항에 있어서, 미소한 凹凸의 평균 거칠기가 1∼1000㎛인 것을 특징으로 하는 반도체장치의 제조장치.
  3. 제1항에 있어서, 미소한 凹凸의 평균 거칠기가 1∼10㎛인 것을 특징으로 하는 반도체장치의 제조장치.
  4. 제1항에 있어서, 할로겐 원소 스캐빈지 부재가 실리콘 및 탄소에서 선택된 적어도 한개의 재료를 포함하는 것을 특징으로 하는 반도체장치의 제조장치.
  5. 제1항에 있어서, 할로겐 원소 스캐빈지 부재가 에칭해야할 실리콘기재의 주위에 배치되는 실리콘 링인 것을 특징으로 하는 반도체장치의 제조장치.
  6. 제1항에 있어서, 할로겐 원소 스캐빈지 부재가 에칭해야할 실리콘기재의 상방에 배치되는 상부 실리콘 전극인 것을 특징으로 하는 반도체장치의 제조장치.
  7. 제1항에 있어서, 凹凸을 웨트 에칭으로 작성하는 것을 특징으로 하는 반도체장치의 제조장치.
  8. 제1항에 있어서, 드라이 에칭에 이용하는 가스가 C2F6인 것을 특징으로 하는 반도체장치의 제조장치.
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