KR101666101B1 - 반도체용 접착제, 플럭스제, 반도체 장치의 제조 방법 및 반도체 장치 - Google Patents

반도체용 접착제, 플럭스제, 반도체 장치의 제조 방법 및 반도체 장치 Download PDF

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    • H01L2224/13638—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
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    • H01L2224/16135—Disposition the bump connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip
    • H01L2224/16145—Disposition the bump connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being stacked
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    • H01L2224/16—Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
    • H01L2224/161—Disposition
    • H01L2224/16135—Disposition the bump connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip
    • H01L2224/16145—Disposition the bump connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being stacked
    • H01L2224/16148—Disposition the bump connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being stacked the bump connector connecting to a bonding area protruding from the surface
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    • H01L2224/16151—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/16221—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/16225—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
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    • H01L2224/16151—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/16221—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/16225—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • H01L2224/16227—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation the bump connector connecting to a bond pad of the item
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    • H01L2224/16151—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/16221—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/16225—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • H01L2224/16238—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation the bump connector connecting to a bonding area protruding from the surface of the item
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    • H01L2224/15—Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L2224/17—Structure, shape, material or disposition of the bump connectors after the connecting process of a plurality of bump connectors
    • H01L2224/171—Disposition
    • H01L2224/1718—Disposition being disposed on at least two different sides of the body, e.g. dual array
    • H01L2224/17181—On opposite sides of the body
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    • H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/27—Manufacturing methods
    • H01L2224/271—Manufacture and pre-treatment of the layer connector preform
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    • H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/27—Manufacturing methods
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    • H01L2224/2741—Manufacturing methods by blanket deposition of the material of the layer connector in liquid form
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    • H01L2224/32221—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/32225—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
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    • H01L2224/3318—Disposition being disposed on at least two different sides of the body, e.g. dual array
    • H01L2224/33181—On opposite sides of the body
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    • H01L2224/731—Location prior to the connecting process
    • H01L2224/73101—Location prior to the connecting process on the same surface
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    • H01L2224/73104—Bump and layer connectors the bump connector being embedded into the layer connector
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    • H01L2224/81009—Pre-treatment of the bump connector or the bonding area
    • H01L2224/8101—Cleaning the bump connector, e.g. oxide removal step, desmearing
    • H01L2224/81011—Chemical cleaning, e.g. etching, flux
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    • H01L2224/818—Bonding techniques
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    • H01L2224/81895—Direct bonding, i.e. joining surfaces by means of intermolecular attracting interactions at their interfaces, e.g. covalent bonds, van der Waals forces between electrically conductive surfaces, e.g. copper-copper direct bonding, surface activated bonding
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    • H01L2224/81—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
    • H01L2224/81905—Combinations of bonding methods provided for in at least two different groups from H01L2224/818 - H01L2224/81904
    • H01L2224/81907—Intermediate bonding, i.e. intermediate bonding step for temporarily bonding the semiconductor or solid-state body, followed by at least a further bonding step
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Abstract

에폭시 수지, 경화제 및 하기 식(1)으로 표시되는 기를 가지는 화합물을 함유하는, 반도체용 접착제.
[화학식 1]
Figure 112014079839342-pct00018

[식 중, R1은, 전자 공여성기를 나타낸다.]

Description

반도체용 접착제, 플럭스제, 반도체 장치의 제조 방법 및 반도체 장치{ADHESIVE FOR SEMICONDUCTOR, FLUXING AGENT, MANUFACTURING METHOD FOR SEMICONDUCTOR DEVICE, AND SEMICONDUCTOR DEVICE}
본 발명은, 반도체용 접착제, 플럭스제(fluxing agent), 반도체 장치의 제조 방법, 및 반도체 장치에 관한 것이다.
종래, 반도체칩과 기판을 접속하기 위해서는, 금 와이어 등의 금속 세선을 사용하는 와이어 본딩 방식이 널리 적용되고 있다. 한편, 반도체 장치에 대한 고기능화, 고집적화, 고속화 등의 요구에 대응하기 위하여, 반도체칩 또는 기판에 범프(bump)와 같은 도전성 돌기를 형성하여, 반도체칩과 기판을 직접 접속하는 플립 칩(flip chip) 접속 방식(FC 접속 방식)의 사용이 확대되고 있다.
예를 들면, 반도체칩 및 기판 사이의 접속에 있어서, BGA(Ball Grid Array), CSP(Chip Size Package) 등에 활발하게 사용되고 있는 COB(Chip On Board)형의 접속 방식도 FC 접속 방식에 해당한다. 또한, FC 접속 방식은, 반도체칩 상에 접속부(범프나 배선)를 형성하고, 반도체칩 사이를 접속하는 COC(Chip On Chip)형의 접속 방식에도 널리 사용되고 있다(예를 들면, 특허 문헌 1 참조).
또한, 소형화, 박형화, 고기능화가 더욱 강하게 요구되는 패키지에서는, 전술한 접속 방식을 적층·다단화한 칩 스택형 패키지나 POP(Package On Package), TSV(Through-Silicon Via) 등도 널리 보급되기 시작하고 있다. 이와 같은 적층·다단화 기술은, 반도체칩 등을 3차원적으로 배치하므로, 2차원적으로 배치하는 방법과 비교하여 패키지를 작게 할 수 있다. 또한, 반도체의 성능 향상, 노이즈 저감, 실장 면적의 삭감, 전력 절약화에도 유효하므로, 차세대의 반도체 배선 기술로서 주목받고 있다.
그런데, 상기 접속부(범프나 배선)에 사용되는 주된 금속으로서는, 땜납, 주석, 금, 은, 동, 니켈 등이 있고, 이들 복수 종류를 포함한 도전 재료도 사용되고 있다. 접속부에 사용되는 금속은, 표면이 산화하여 산화막이 생성되거나, 표면에 산화물 등의 불순물이 부착되는 것에 의해, 접속부의 접속면에 불순물이 생기는 경우가 있다. 이와 같은 불순물이 잔존하면, 반도체칩 및 기판 사이나 2개의 반도체칩 사이에서의 접속성·절연 신뢰성이 저하되어, 전술한 접속 방식을 채용하는 장점이 훼손될 우려가 있다.
또한, 이들 불순물의 발생을 억제하는 방법으로서, OSP(Organic Solderbility Preservatives) 처리 등으로 알려진 접속부를 산화 방지막으로 코팅하는 방법이 있지만, 이 산화 방지막은 접속 프로세스 시의 땜납 젖음성의 저하, 접속성의 저하 등의 원인이 되는 경우가 있다.
이에, 전술한 산화막이나 불순물을 제거하는 방법으로서, 반도체 재료에 플럭스제를 함유시키는 방법이 제안되어 있다(예를 들면, 특허 문헌 2∼5 참조).
일본공개특허 제2008-294382호 공보 일본공개특허 제2001-223227호 공보 일본공개특허 제2002-283098호 공보 일본공개특허 제2005-272547호 공보 일본공개특허 제2006-169407호 공보
일반적으로 접속부끼리의 접속에는, 접속성·절연 신뢰성을 충분히 확보하는 관점에서, 금속 접합이 사용되고 있다. 반도체 재료가 충분히 플럭스 활성(금속 표면의 산화막이나 불순물의 제거 효과)을 가지고 있지 않은 경우, 금속 표면의 산화막이나 불순물을 제거하지 못하며, 양호한 금속-금속 접합이 형성되지 않아, 통전이 확보되지 않는 경우가 있다.
또한, 반도체 재료를 사용하여 제조되는 반도체 장치는, 내열성 및 내습성이 우수하고, 260℃ 전후의 리플로우(reflow) 온도에 있어서, 반도체 재료의 박리, 접속부의 접속 불량 등이 충분히 억제되도록 한 내(耐)리플로우성을 가지는 것이 요구된다.
본 발명은, 내리플로우성 및 접속 신뢰성이 우수한 반도체 장치의 제작을 가능하게 하는 반도체용 접착제를 제공하는 것을 목적으로 한다. 또한, 본 발명은, 상기 반도체용 접착제를 사용한 반도체 장치의 제조 방법 및 반도체 장치를 제공하는 것을 목적으로 한다. 또한, 본 발명은, 상기 반도체용 접착제의 실현을 가능하게 하는 플럭스제를 제공하는 것을 목적으로 한다.
본 발명의 일 태양은, 에폭시 수지, 경화제 및 하기 식(1)으로 표시되는 기를 가지는 화합물을 함유하는, 반도체용 접착제를 제공한다.
[화학식 1]
Figure 112014079839342-pct00001
[식 중, R1은, 전자 공여성기를 나타낸다.]
본 태양의 반도체용 접착제는, 에폭시 수지 및 경화제를 함유하고, 또한 식(1)으로 표시되는 기를 가지는 화합물을 함유함으로써, 금속 접합하는 플립 칩 접속 방식에 있어서 반도체용 접착제로서 적용한 경우라도, 내리플로우성 및 접속 신뢰성이 우수한 반도체 장치를 제작할 수 있다.
내리플로우성의 향상에는, 고온에서의 흡습(吸濕) 후의 접착력의 저하를 억제하는 것이 필요하다. 종래, 플럭스제로서 카르본산이 사용되고 있지만, 종래의 플럭스제에서는, 하기의 이유에 의해 접착력의 저하가 생기는 것으로 본 발명자들은 생각하고 있다.
통상, 에폭시 수지와 경화제가 반응하여 경화 반응이 진행되지만, 이 때 플럭스제인 카르본산이 상기 경화 반응에 받아들여진다. 즉, 에폭시 수지의 에폭시기와 플럭스제의 카르복실기가 반응함으로써, 에스테르 결합이 형성되는 경우가 있다. 이 에스테르 결합은, 흡습 등에 의한 가수분해 등을 쉽게 생기게 하고, 이 에스테르 결합의 분해가, 흡습 후의 접착력의 저하의 한 요인인 것으로 생각된다.
이에 비해, 본 태양의 반도체용 접착제는, 식(1)으로 표시되는 기, 즉 근방에 전자 공여성기를 구비한 카르복실기를 가지는 화합물을 함유하고 있다. 그러므로, 본 태양에서는, 카르복실기에 의해 플럭스 활성을 충분히 얻을 수 있는 동시에, 전술한 에스테르 결합이 형성된 경우라도, 전자 공여성기에 의해 에스테르 결합부의 전자 밀도가 높아져, 에스테르 결합의 분해가 억제되는 것으로 생각된다.
또한, 본 태양에서는, 카르복실기의 근방에 치환기(전자 공여성기)가 존재하므로, 입체 장애에 의해, 카르복실기와 에폭시 수지와의 반응이 억제되고, 에스테르 결합이 쉽게 생성되지 않는 것으로 생각된다.
이러한 이유에 의해, 본 태양의 반도체용 접착제에서는, 흡습 등에 의한 조성 변화가 쉽게 생기지 않고, 우수한 접착력이 유지된다. 또한, 전술한 작용은, 에폭시 수지와 경화제와의 경화 반응이 플럭스제에 의해 저해되기 어려운 점도 있어, 전술한 작용에 의해, 에폭시 수지와 경화제와의 경화 반응의 충분한 진행에 의한 접속 신뢰성의 향상과 같은 효과도 기대할 수 있다.
식(1)으로 표시되는 기를 가지는 화합물은, 카르복실기를 2개 가지는 화합물인 것이 바람직하다. 카르복실기를 2개 가지는 화합물은, 카르복실기를 1개 가지는 화합물과 비교하여, 접속 시의 고온에 의해서도 휘발하기 어렵고, 보이드(void)의 발생을 한층 억제할 수 있다. 또한, 카르복실기를 2개 가지는 화합물을 사용하면, 카르복실기를 3개 이상 가지는 화합물을 사용한 경우와 비교하여, 보관시·접속 작업 시 등에 있어서의 반도체용 접착제의 점도 상승을 한층 억제할 수 있고, 반도체 장치의 접속 신뢰성을 한층 향상시킬 수 있다.
식(1)으로 표시되는 기를 가지는 화합물은, 하기 식(2)으로 표시되는 화합물인 것이 바람직하다. 하기 식(2)으로 표시되는 화합물에 의하면, 반도체 장치의 내리플로우성 및 접속 신뢰성을 한층 향상시킬 수 있다.
[화학식 2]
Figure 112014079839342-pct00002
[식 중, R1은 전자 공여성기를 나타내고, R2는 수소 원자 또는 전자 공여성기를 나타내고, n은 0∼15의 정수를 나타내고, 복수 존재하는 R2는 서로 동일할 수도 있고 상이할 수도 있다.]
식(1)으로 표시되는 기를 가지는 화합물은, 하기 식(3)으로 표시되는 화합물인 것이 더욱 바람직하다. 하기 식(3)으로 표시되는 화합물에 의하면, 반도체 장치의 내리플로우성 및 접속 신뢰성을 더 한층 향상시킬 수 있다.
[화학식 3]
Figure 112014079839342-pct00003
[식 중, R1은 전자 공여성기를 나타내고, R2는 수소 원자 또는 전자 공여성기를 나타내고, m은 0∼10의 정수를 나타낸다.]
식(3)에서의 m은, 0∼5의 정수인 것이 바람직하다. m이 5 이하이면, 한층 우수한 접속 신뢰성을 얻을 수 있다.
식(1)으로 표시되는 기를 가지는 화합물의 융점은, 150℃ 이하인 것이 바람직하다. 이와 같은 화합물은, 에폭시 수지와 경화제와의 경화 반응이 생기기 전에 플럭스 활성이 충분히 발현하므로, 상기 화합물을 함유하는 반도체용 접착제에 의하면, 접속 신뢰성이 한층 우수한 반도체 장치를 실현할 수 있다.
상기 전자 공여성기는, 탄소수 1∼10의 알킬기인 것이 바람직하다. 전자 공여성기가 탄소수 1∼10의 알킬기이면, 전술한 효과가 한층 현저하게 나타난다.
본 태양의 반도체용 접착제는, 식(1)으로 표시되는 기를 가지는 화합물을 포함하는 플럭스제를 함유할 수도 있고, 플럭스제로서 식(1)으로 표시되는 기를 가지는 화합물을 함유할 수도 있으며, 식(1)으로 표시되는 기를 가지는 화합물로 이루어지는 플럭스제를 함유할 수도 있다.
본 태양의 반도체용 접착제는, 중량 평균 분자량이 10000 이상인 고분자 성분을 더 함유할 수도 있다. 상기 고분자 성분에 의하면, 반도체용 접착제의 내열성 및 필름 형성성을 향상시킬 수 있다. 또한, 고분자 성분을 함유하는 반도체용 접착제에 있어서는, 상기 식(1)으로 표시되는 기를 가지는 화합물에 의한 본 발명의 효과가 한층 현저하게 나타난다.
프리어플라이드(Pre-applied) 방식으로 반도체 칩과 배선 기판의 공극 또는 복수의 반도체 칩 사이의 공극을 봉지(封止)하는 경우의 작업성을 향상시킬 수 있으므로, 본 태양의 반도체용 접착제는, 형상이 필름형인 것이 바람직하다.
본 태양의 반도체용 접착제는, 반도체 칩 및 배선 회로 기판의 각각의 접속부가 서로 전기적으로 접속된 반도체 장치, 또는 복수의 반도체 칩의 각각의 접속부가 서로 전기적으로 접속된 반도체 장치에서의 상기 접속부 중 적어도 일부를 봉지하기 위하여, 바람직하게 사용할 수 있다. 이와 같은 용도에 의해, 내리플로우성 및 접속 신뢰성이 우수한 반도체 장치가 실현된다.
본 발명의 다른 태양은, 하기 식(1)으로 표시되는 기를 가지는 화합물을 포함하는, 플럭스제를 제공한다.
[화학식 4]
Figure 112014079839342-pct00004
[식 중, R1은, 전자 공여성기를 나타낸다.]
본 태양의 플럭스제에 의하면, 에폭시 수지 및 경화제와 조합함으로써, 내리플로우성 및 접속 신뢰성이 우수한 반도체 장치의 제작을 가능하게 하는 반도체용 접착제를 실현할 수 있다.
본 태양의 플럭스제에 있어서, 식(1)으로 표시되는 기를 가지는 화합물은, 카르복실기를 2개 가지는 화합물인 것이 바람직하다.
또한, 식(1)으로 표시되는 기를 가지는 화합물은, 하기 식(2)으로 표시되는 화합물인 것이 보다 바람직하다.
[화학식 5]
Figure 112014079839342-pct00005
[식 중, R1은 전자 공여성기를 나타내고, R2는 수소 원자 또는 전자 공여성기를 나타내고, n은 0∼15의 정수를 나타내고, 복수 존재하는 R2는 서로 동일할 수도 있고 상이할 수도 있다.]
또한, 식(1)으로 표시되는 기를 가지는 화합물은, 하기 식(3)으로 표시되는 화합물인 것이 더욱 바람직하다.
[화학식 6]
Figure 112014079839342-pct00006
[식 중, R1은 전자 공여성기를 나타내고, R2는 수소 원자 또는 전자 공여성기를 나타내고, m은 0∼10의 정수를 나타낸다.]
본 태양의 플럭스제에 있어서, 상기 식(3)에서의 m은, 0∼5의 정수인 것이 바람직하다.
본 태양의 플럭스제에 있어서, 상기 전자 공여성기는, 탄소수 1∼10의 알킬기인 것이 바람직하다.
본 태양의 플럭스제는, 에폭시 수지 및 경화제를 함유하는 반도체용 접착제에 배합되는 플럭스제로서 바람직하게 사용할 수 있다.
본 발명의 다른 태양은, 반도체 칩 및 배선 회로 기판의 각각의 접속부가 서로 전기적으로 접속된 반도체 장치, 또는 복수의 반도체 칩의 각각의 접속부가 서로 전기적으로 접속된 반도체 장치의 제조 방법으로서, 상기 접속부 중 적어도 일부를, 상기 반도체용 접착제를 사용하여 봉지하는 공정을 포함하는, 반도체 장치의 제조 방법을 제공한다.
본 태양의 제조 방법에 의하면, 상기 반도체용 접착제를 사용함으로써, 반도체 장치의 내리플로우성 및 접속 신뢰성을 향상시킬 수 있다.
본 발명의 다른 태양은, 상기 제조 방법에 의해 얻어지는, 반도체 장치를 제공한다. 본 태양의 반도체 장치는, 내리플로우성 및 접속 신뢰성이 우수하다.
본 발명에 의하면, 내리플로우성 및 접속 신뢰성이 우수한 반도체 장치의 제작을 가능하게 하는 반도체용 접착제가 제공된다. 또한, 본 발명에 의하면, 상기 반도체용 접착제를 사용한 반도체 장치의 제조 방법 및 반도체 장치가 제공된다. 또한, 본 발명에 의하면, 상기 반도체용 접착제의 실현을 가능하게 하는 플럭스제가 제공된다.
도 1은 본 발명의 반도체 장치의 일실시형태를 나타낸 모식 단면도이다.
도 2는 본 발명의 반도체 장치의 다른 일실시형태를 나타낸 모식 단면도이다.
도 3은 본 발명의 반도체 장치의 다른 일실시형태를 나타낸 모식 단면도이다.
도 4는 본 발명의 반도체 장치의 제조 방법의 일실시형태를 모식적으로 나타낸 공정 단면도이다.
이하, 경우에 따라 도면을 참조하면서 본 발명의 바람직한 실시형태에 대하여 상세하게 설명한다. 그리고, 도면 중, 동일하거나 또는 상당 부분에는 동일한 부호를 부여하고, 중복되는 설명은 생략한다. 또한, 상하 좌우 등의 위치 관계는, 특별히 언급하지 않는 이상 도면에 나타낸 위치 관계에 기초한 것으로 한다. 또한, 도면의 치수 비율은 도시한 비율로 한정되는 것은 아니다.
<반도체용 접착제>
본 실시형태의 반도체용 접착제는, 에폭시 수지(이하, 경우에 따라 「(a) 성분」이라고 함), 경화제(이하, 경우에 따라 「(b) 성분」이라고 함), 및 하기 식(1-1) 또는 식(1-2)으로 표시되는 기를 가지는 화합물(이하, 경우에 따라 「(c) 성분」이라고 함)을 함유한다.
[화학식 7]
Figure 112014079839342-pct00007
식(1) 중, R1은, 전자 공여성기를 나타낸다.
본 실시형태의 반도체용 접착제에 의하면, 에폭시 수지 및 경화제를 함유하고, 또한 식(1)으로 표시되는 기를 가지는 화합물을 함유함으로써, 금속 접합하는 플립 칩 접속 방식에 있어서 반도체용 접착제로서 적용한 경우라도, 내리플로우성 및 접속 신뢰성이 우수한 반도체 장치를 제작할 수 있다.
내리플로우성의 향상에는, 고온에서의 흡습 후의 접착력의 저하를 억제하는 것이 필요하다. 종래, 플럭스제로서 카르본산이 사용되고 있지만, 종래의 플럭스제에서는, 하기의 이유에 의해 접착력의 저하가 생기고 있는 것으로 본 발명자들은 생각하고 있다.
통상, 에폭시 수지와 경화제가 반응하여 경화 반응이 진행되지만, 이 때 플럭스제인 카르본산이 상기 경화 반응에 받아들여진다. 즉, 에폭시 수지의 에폭시기와 플럭스제의 카르복실기가 반응함으로써, 에스테르 결합이 형성되는 경우가 있다. 이 에스테르 결합은, 흡습 등에 의한 가수분해 등이 생기기 쉽고, 이 에스테르 결합의 분해가, 흡습 후의 접착력의 저하의 한 요인인 것으로 생각된다.
이에 비해, 본 실시형태의 반도체용 접착제는, 식(1)으로 표시되는 기, 즉 근방에 전자 공여성기를 구비한 카르복실기를 가지는 화합물을 함유하고 있다. 그러므로, 본 실시형태의 반도체용 접착제에서는, 카르복실기에 의해 플럭스 활성을 충분히 얻을 수 있는 동시에, 전술한 에스테르 결합이 형성된 경우라도, 전자 공여성기에 의해 에스테르 결합부의 전자 밀도가 높아져, 에스테르 결합의 분해가 억제된다.
또한, 본 실시형태에서는, 카르복실기의 근방에 치환기(전자 공여성기)가 존재하므로, 입체 장애에 의해, 카르복실기와 에폭시 수지와의 반응이 억제되고, 에스테르 결합이 생성되기 어려운 것으로 생각된다.
이러한 이유에 의해, 본 실시형태의 반도체용 접착제에서는, 흡습 등에 의한 조성 변화가 쉽게 생기지 않고, 우수한 접착력이 유지된다. 또한, 전술한 작용은, 에폭시 수지와 경화제와의 경화 반응이 플럭스제에 의해 저해되기 어려운 점도 있어, 전술한 작용에 의해, 에폭시 수지와 경화제와의 경화 반응이 충분하게 진행되어 접속 신뢰성이 향상되는 효과도 기대할 수 있다.
본 실시형태의 반도체용 접착제는, 필요에 따라, 중량 평균 분자량이 10000 이상인 고분자 성분(이하, 경우에 따라 「(d) 성분」이라고 함)을 함유하고 있어도 된다. 또한, 본 실시형태의 반도체용 접착제는, 필요에 따라, 필러(filler)(이하, 경우에 따라 「(e) 성분」이라고 함)를 함유하고 있어도 된다.
이하에서, 본 실시형태의 반도체용 접착제를 구성하는 각 성분에 대하여 설명한다.
(a) 성분: 에폭시 수지
에폭시 수지로서는, 분자 내에 2개 이상의 에폭시기를 가지는 것이면 특별히 제한없이 사용할 수 있다. (a) 성분으로서, 예를 들면, 비스페놀 A형 에폭시 수지, 비스페놀 F형 에폭시 수지, 나프탈렌형 에폭시 수지, 페놀 노볼락형 에폭시 수지, 크레졸 노볼락형 에폭시 수지, 페놀아랄킬형 에폭시 수지, 비페닐형 에폭시 수지, 트리페닐메탄형 에폭시 수지, 디시클로펜타디엔형 에폭시 수지 및 각종 다관능성 에폭시 수지를 사용할 수 있다. 이들은 단독으로 사용할 수도 있고, 2종 이상의 혼합물로서 사용할 수도 있다.
(a) 성분은, 고온에서의 접속 시에 분해하여 휘발 성분이 발생하는 것을 억제하는 관점에서, 접속 시의 온도가 250℃인 경우에는, 250℃에서의 열중량 감소량율이 5% 이하인 에폭시 수지를 사용하는 것이 바람직하고, 300℃의 경우에는, 300℃에서의 열중량 감소량율이 5% 이하인 에폭시 수지를 사용하는 것이 바람직하다.
(a) 성분의 함유량은, 반도체용 접착제의 전체량 기준으로, 예를 들면 5∼75 질량%이며, 바람직하게는 10∼50 질량%이며, 더욱 바람직하게는 15∼35 질량%이다.
(b) 성분: 경화제
(b) 성분으로서는, 예를 들면, 페놀 수지계 경화제, 산무수물계 경화제, 아민계 경화제, 이미다졸계 경화제 및 포스핀계 경화제를 들 수 있다. (b) 성분이 페놀성 수산기, 산무수물, 아민류 또는 이미다졸류를 포함하면, 접속부에 산화막이 생기는 것을 억제하는 플럭스 활성을 나타내고, 접속 신뢰성·절연 신뢰성을 향상시킬 수 있다. 이하, 각 경화제에 대하여 설명한다.
(i) 페놀 수지계 경화제
페놀 수지계 경화제로서는, 분자 내에 2개 이상의 페놀성 수산기를 가지는 것이면 특별히 제한은 없고, 예를 들면, 페놀 노볼락 수지, 크레졸 노볼락 수지, 페놀아랄킬 수지, 크레졸나프톨포름알데히드 중축합물, 트리페닐메탄형 다관능성 페놀 수지 및 각종 다관능성 페놀 수지를 사용할 수 있다. 이들은 단독으로 사용할 수도 있고, 2종 이상의 혼합물로서 사용할 수도 있다.
상기 (a) 성분에 대한 페놀 수지계 경화제의 당량비(페놀성 수산기/에폭시기, 몰비)는, 양호한 경화성, 접착성 및 보존 안정성의 관점에서, 0.3∼1.5가 바람직하고, 0.4∼1.0이 보다 바람직하고, 0.5∼1.0이 더욱 바람직하다. 당량비가 0.3 이상이면, 경화성이 향상되고 접착력이 향상되는 경향이 있고, 1.5 이하이면 미반응의 페놀성 수산기가 과잉으로 잔존하지 않고, 흡수율이 낮게 억제되고, 절연 신뢰성이 향상되는 경향이 있다.
(ii) 산무수물계 경화제
산무수물계 경화제로서는, 예를 들면, 메틸시클로헥산테트라카르본산 이무수물, 무수 트리멜리트산, 무수 피로멜리트산, 벤조페논테트라카르본산 이무수물 및 에틸렌글리콜비스안하이드로트리멜리테이트를 사용할 수 있다. 이들은 단독으로 사용할 수도 있고, 2종 이상의 혼합물로서 사용할 수도 있다.
상기 (a) 성분에 대한 산무수물계 경화제의 당량비(산무수물기/에폭시기, 몰비)는, 양호한 경화성, 접착성 및 보존 안정성의 관점에서, 0.3∼1.5가 바람직하고, 0.4∼1.0이 보다 바람직하고, 0.5∼1.0이 더욱 바람직하다. 당량비가 0.3 이상이면, 경화성이 향상되고 접착력이 향상되는 경향이 있고, 1.5 이하이면 미반응의 산무수물이 과잉으로 잔존하지 않고, 흡수율이 낮게 억제되고, 절연 신뢰성이 향상되는 경향이 있다.
(iii) 아민계 경화제
아민계 경화제로서는, 예를 들면, 디시안디아미드를 사용할 수 있다.
상기 (a) 성분에 대한 아민계 경화제의 당량비(아민/에폭시기, 몰비)는, 양호한 경화성, 접착성 및 보존 안정성의 관점에서 0.3∼1.5가 바람직하고, 0.4∼1.0이 보다 바람직하고, 0.5∼1.0이 더욱 바람직하다. 당량비가 0.3 이상이면, 경화성이 향상되고 접착력이 향상되는 경향이 있거, 1.5 이하이면 미반응의 아민이 과잉으로 잔존하지 않으며, 절연 신뢰성이 향상되는 경향이 있다.
(iv) 이미다졸계 경화제
이미다졸계 경화제로서는, 예를 들면, 2-페닐이미다졸, 2-페닐-4-메틸이미다졸, 1-벤질-2-메틸이미다졸, 1-벤질-2-페닐이미다졸, 1-시아노에틸-2-운데실이미다졸, 1-시아노-2-페닐이미다졸, 1-시아노에틸-2-운데실이미다졸트리멜리테이트, 1-시아노에틸-2-페닐이미다졸륨트리멜리테이트, 2,4-디아미노-6-[2'-메틸이미다졸릴-(1')]-에틸-s-트리아진, 2,4-디아미노-6-[2'-운데실이미다졸릴-(1')]-에틸-s-트리아진, 2,4-디아미노-6-[2'-에틸-4'-메틸이미다졸릴-(1')]-에틸-s-트리아진, 2,4-디아미노-6-[2'-메틸이미다졸릴-(1')]-에틸-s-트리아진이소시아누르산 부가체, 2-페닐이미다졸이소시아누르산 부가체, 2-페닐-4,5-디하이드록시메틸이미다졸, 2-페닐-4-메틸-5-하이드록시메틸이미다졸, 및 에폭시 수지와 이미다졸류의 부가체를 들 수 있다. 이들 중에서도, 우수한 경화성, 보존 안정성 및 접속 신뢰성의 관점에서, 1-시아노에틸-2-운데실이미다졸, 1-시아노-2-페닐이미다졸, 1-시아노에틸-2-운데실이미다졸트리멜리테이트, 1-시아노에틸-2-페닐이미다졸륨트리멜리테이트, 2,4-디아미노-6-[2'-메틸이미다졸릴-(1')]-에틸-s-트리아진, 2,4-디아미노-6-[2'-에틸-4'-메틸이미다졸릴-(1')]-에틸-s-트리아진, 2,4-디아미노-6-[2'-메틸이미다졸릴-(1')]-에틸-s-트리아진이소시아누르산 부가체, 2-페닐이미다졸이소시아누르산 부가체, 2-페닐-4,5-디하이드록시메틸이미다졸 및 2-페닐-4-메틸-5-하이드록시메틸이미다졸이 바람직하다. 이들은 단독으로 사용할 수도 있고, 2종 이상을 병용할 수도 있다. 또한, 이들을 마이크로 캡슐화한 잠재성 경화제로 만들어도 된다.
이미다졸계 경화제의 함유량은, (a) 성분 100 질량부에 대하여, 0.1∼20 질량부가 바람직하고, 0.1∼10 질량부가 더욱 바람직하다. 이미다졸계 경화제의 함유량이 0.1 질량부 이상이면 경화성이 향상되는 경향이 있고, 20 질량부 이하이면 금속 접합이 형성되기 전에 반도체용 접착제가 경화되지 않아, 접속 불량이 쉽게 생기지 않는 경향이 있다.
(v)포스핀계 경화제
포스핀계 경화제로서는, 예를 들면, 트리페닐포스핀, 테트라페닐포스포늄 테트라페닐보레이트, 테트라페닐포스포늄테트라(4-메틸페닐)보레이트 및 테트라페닐포스포늄(4-플루오로페닐)보레이트를 들 수 있다.
포스핀계 경화제의 함유량은, (a) 성분 100 질량부에 대하여, 0.1∼10 질량부가 바람직하고, 0.1∼5 질량부가 더욱 바람직하다. 포스핀계 경화제의 함유량이 0.1 질량부 이상이면 경화성이 향상되는 경향이 있고, 10 질량부 이하이면 금속 접합이 형성되기 전에 반도체용 접착제가 경화되지 않아, 접속 불량이 쉽게 생기지 않는 경향이 있다.
페놀 수지계 경화제, 산무수물계 경화제 및 아민계 경화제는, 각각 1종을 단독으로 사용할 수도 있고, 2종 이상의 혼합물로서 사용할 수도 있다. 이미다졸계 경화제 및 포스핀계 경화제는 각각 단독으로 사용할 수도 있고, 페놀 수지계 경화제, 산무수물계 경화제 또는 아민계 경화제와 함께 사용할 수도 있다.
보존 안정성이 한층 향상되고, 흡습에 의한 분해나 열화가 쉽게 일어나지 않는 관점에서, (b) 성분은, 페놀 수지계 경화제, 아민계 경화제, 이미다졸계 경화제 및 포스핀계 경화제로 이루어지는 군으로부터 선택되는 경화제인 것이 바람직하다. 또한, 경화 속도의 조정의 용이성의 관점, 및 빠른 경화성에 의해 생산성 향상을 목적으로 하는 단시간 접속을 실현할 수 있는 관점에서는, (b) 성분은, 페놀 수지계 경화제, 아민계 경화제 및 이미다졸계 경화제로 이루어지는 군으로부터 선택되는 경화제인 것이 더욱 바람직하다.
반도체용 접착제가 (b) 성분으로서, 페놀 수지계 경화제, 산무수물계 경화제 또는 아민계 경화제를 포함하는 경우, 산화막을 제거하는 플럭스 활성을 나타내고, 접속 신뢰성을 더욱 향상시킬 수 있다.
(c) 성분: 식(1)으로 표시되는 기를 가지는 화합물
(c) 성분은, 식(1)으로 표시되는 기를 가지는 화합물(이하, 경우에 따라 「플럭스 화합물」이라고 함)이다. (c) 성분은 플럭스 활성을 가지는 화합물이며, 본 실시형태의 반도체용 접착제에 있어서, 플럭스제로서 기능한다. (c) 성분으로서는, 플럭스 화합물의 1종을 단독으로 사용해도 되고, 플럭스 화합물의 2종 이상을 병용해도 된다.
[화학식 8]
Figure 112014079839342-pct00008
식(1) 중, R1은, 전자 공여성기를 나타낸다.
전자 공여성기로서는, 예를 들면, 알킬기, 수산기, 아미노기, 알콕시기 및 알킬아미노기를 들 수 있다. 전자 공여성기로서는, 다른 성분(예를 들면, (a) 성분의에폭시 수지)과 반응하기 어려운 기가 바람직하고, 구체적으로는, 알킬기, 수산기 또는 알콕시기가 바람직하고, 알킬기가 더욱 바람직하다.
전자 공여성기의 전자 공여성이 강해지면, 전술한 에스테르 결합의 분해를 억제하는 효과를 용이하게 얻을 수 있는 경향이 있다. 또한, 전자 공여성기의 입체 장애는, 크면, 전술한 카르복실기와 에폭시 수지와의 반응을 억제하는 효과를 용이하게 얻을 수 있다. 전자 공여성기는, 전자 공여성 및 입체 장애를 양호한 밸런스로 가지고 있는 것이 바람직하다.
알킬기로서는, 탄소수 1∼10의 알킬기가 바람직하고, 탄소수 1∼5의 알킬기가 더욱 바람직하다. 알킬기의 탄소수는, 많을수록 전자 공여성 및 입체 장애가 커지는 경향이 있다. 탄소수가 전술한 범위인 알킬기는, 전자 공여성 및 입체 장애의 밸런스가 우수하므로, 상기 알킬기에 의하면, 본 발명의 효과가 한층 현저하게 나타난다.
또한, 알킬기는, 직쇄형이라도 되고 분지형이라도 되지만, 그 중에서도 직쇄형이 바람직하다. 알킬기가 직쇄형일 때, 전자 공여성 및 입체 장애의 밸런스의 관점에서, 알킬기의 탄소수는, 플럭스 화합물의 주쇄(主鎖)의 탄소수 이하인 것이 바람직하다. 예를 들면, 플럭스 화합물이 하기 식(2)으로 표시되는 화합물이며, 전자 공여성기가 직쇄형의 알킬기일 때, 상기 알킬기의 탄소수는, 플럭스 화합물의 주쇄의 탄소수(n＋1) 이하인 것이 바람직하다.
알콕시기로서는, 탄소수 1∼10의 알콕시기가 바람직하고, 탄소수 1∼5의 알콕시기가 더욱 바람직하다. 알콕시기의 탄소수는, 많을수록 전자 공여성 및 입체 장애가 커지는 경향이 있다. 탄소수가 전술한 범위인 알콕시기는, 전자 공여성 및 입체 장애의 밸런스가 우수하므로, 상기 알콕시기에 의하면, 본 발명의 효과를 한층 현저하게 나타난다.
또한, 알콕시기의 알킬기 부분은, 직쇄형이라도 되고 분지형이라도 되지만, 그 중에서도 직쇄형이 바람직하다. 알콕시기가 직쇄형일 때, 전자 공여성 및 입체 장애의 밸런스의 관점에서, 알콕시기의 탄소수는, 플럭스 화합물의 주쇄의 탄소수 이하인 것이 바람직하다. 예를 들면, 플럭스 화합물이 하기 식(2)으로 표시되는 화합물이며, 전자 공여성기가 직쇄형 알콕시기일 때, 상기 알콕시기의 탄소수는, 플럭스 화합물의 주쇄의 탄소수(n＋1) 이하인 것이 바람직하다.
알킬아미노기로서는, 모노알킬아미노기, 디알킬아미노기를 예로 들 수 있다. 모노알킬아미노기로서는, 탄소수 1∼10의 모노알킬아미노기가 바람직하고, 탄소수 1∼5의 모노알킬아미노기가 더욱 바람직하다. 모노알킬아미노기의 알킬기 부분은, 직쇄형이라도 되고 분지형이라도 되지만, 직쇄형인 것이 바람직하다.
디알킬아미노기로서는, 탄소수 2∼20의 디알킬아미노기가 바람직하고, 탄소수 2∼10의 디알킬아미노기가 더욱 바람직하다. 디알킬아미노기의 알킬기 부분은, 직쇄형이라도 되고 분지형이라도 되지만, 직쇄형인 것이 바람직하다.
플럭스 화합물은, 카르복실기를 2개 가지는 화합물(디카르본산)인 것이 바람직하다. 카르복실기를 2개 가지는 화합물은, 카르복실기를 1개 가지는 화합물(모노카르본산)과 비교하여, 접속 시의 고온에 의해서도 휘발하기 어렵고, 보이드의 발생을 한층 억제할 수 있다. 또한, 카르복실기를 2개 가지는 화합물을 사용하면, 카르복실기를 3개 이상 가지는 화합물을 사용한 경우와 비교하여, 보관시·접속 작업 시 등에 있어서의 반도체용 접착제의 점도 상승을 한층 억제할 수 있고, 반도체 장치의 접속 신뢰성을 한층 향상시킬 수 있다.
플럭스 화합물로서는, 하기 식(2)으로 표시되는 화합물을 바람직하게 사용할 수 있다. 하기 식(2)으로 표시되는 화합물에 의하면, 반도체 장치의 내리플로우성 및 접속 신뢰성을 한층 향상시킬 수 있다.
[화학식 9]
Figure 112014079839342-pct00009
식(2) 중, R1은 전자 공여성기를 나타내고, R2는 수소 원자 또는 전자 공여성기를 나타내고, n은 0 또는 1 이상의 정수를 나타내고, 복수 존재하는 R2는 서로 동일할 수도 있고 상이할 수도 있다.
식(2)에서의 n은, 1 이상인 것이 바람직하다. n이 1 이상이면, n이 0인 경우와 비교하여, 접속 시의 고온에 의해서도 플럭스 화합물이 휘발하기 어렵고, 보이드의 발생을 한층 억제할 수 있다. 또한, 식(2)에서의 n은, 15 이하인 것이 바람직하고, 11 이하인 것이 더욱 바람직하고, 6 이하 또는 4 이하라도 된다. n이 15 이하이면, 한층 우수한 접속 신뢰성을 얻을 수 있다.
또한, 플럭스 화합물로서는, 하기 식(3)으로 표시되는 화합물이 더욱 바람직하다. 하기 식(3)으로 표시되는 화합물에 의하면, 반도체 장치의 내리플로우성 및 접속 신뢰성을 더 한층 향상시킬 수 있다.
[화학식 10]
Figure 112014079839342-pct00010
식(3) 중, R1은 전자 공여성기를 나타내고, R2는 수소 원자 또는 전자 공여성기를 나타내고, m은 0 또는 1 이상의 정수를 나타낸다.
식(3)에서의 m은, 10 이하인 것이 바람직하고, 5 이하인 것이 보다 바람직하고, 3 이하인 것이 더욱 바람직하다. m이 10 이하이면, 한층 우수한 접속 신뢰성을 얻을 수 있다.
식(3)에 있어서, R2는, 수소 원자라도 되고 전자 공여성기라도 된다. R2가 수소 원자이면, 융점이 낮아지는 경향이 있고, 반도체 장치의 접속 신뢰성을 더욱 향상시킬 수 있는 경우가 있다. 또한, R1과 R2가 상이한 전자 공여성기이면, R1과 R2가 동일한 전자 공여성기인 경우와 비교하여, 융점이 낮아지는 경향이 있고, 반도체 장치의 접속 신뢰성을 더욱 향상시킬 수 있는 경우가 있다.
식(3)으로 표시되는 화합물 중, R2가 수소 원자인 화합물로서는, 메틸숙신산, 2-메틸글루타르산, 2-메틸아디프산, 2-메틸피멜산, 2-메틸수베르산 등을 예로 들 수 있다. 이들 화합물에 의하면, 반도체 장치의 접속 신뢰성을 한층 향상시킬 수 있다. 또한, 이들 화합물 중, 메틸숙신산 및 2-메틸글루타르산이 특히 바람직하다.
그리고, 식(3)에 있어서, R1과 R2가 같은 전자 공여성기이면, 대칭 구조로 되어 융점이 높아지는 경향이 있지만, 이 경우에도 본 발명의 효과는 충분히 얻을 수 있다. 특히 융점이 150℃ 이하로 충분히 낮은 경우에는, R1과 R2가 동일한 기라도, R1과 R2가 상이한 기인 경우와 동일한 정도의 접속 신뢰성을 얻을 수 있다.
플럭스 화합물로서는, 예를 들면, 숙신산, 글루타르산, 아디프산, 피멜산, 수베르산, 아젤라산, 세바스산, 운데칸 이산 및 도데칸 이산으로부터 선택되는 디카르본산의 2번 위치에 전자 공여성기가 치환한 화합물을 사용할 수 있다.
플럭스 화합물의 융점은, 150℃ 이하가 바람직하고, 140℃ 이하가 보다 바람직하고, 130℃ 이하가 더욱 바람직하다. 이와 같은 플럭스 화합물은, 에폭시 수지와 경화제와의 경화 반응이 생기기 전에 플럭스 활성이 충분히 발현하기 쉽다. 그러므로, 이와 같은 플럭스 화합물을 함유하는 반도체용 접착제에 의하면, 접속 신뢰성이 한층 우수한 반도체 장치를 실현할 수 있다. 또한, 플럭스 화합물의 융점은, 25℃ 이상이 바람직하고, 50℃ 이상이 더욱 바람직하다. 또한, 플럭스 화합물은, 실온(25℃)에서 고형인 것이 바람직하다.
플럭스 화합물의 융점은, 일반적인 융점 측정 장치를 사용하여 측정할 수 있다. 융점을 측정하는 시료는, 미분말(微粉末)로 분쇄되고, 또한 미량을 사용함으로써 시료 내의 온도의 편차를 적게 하는 것이 요구된다. 시료의 용기로서는 한쪽 단(端)을 폐쇄한 모세관이 사용되는 경우가 많지만, 측정 장치에 따라서는 2개의 현미경용 커버 글래스에 끼워서 용기로 하는 경우도 있다. 또한 급격하게 온도를 상승시키면 시료와 온도계의 사이에 온도 구배(句配)가 발생하여 측정 오차가 생기므로, 융점을 계측하는 시점에서의 가온(加溫)은 매분 1℃ 이하의 상승률로 측정하는 것이 바람직하다.
전술한 바와 같이 미분말로서 조정하므로, 표면에서의 난반사에 의해 융해 전의 시료는 불투명하다. 통상, 시료의 외관이 투명화하기 시작한 온도를 융점의 하한점으로 하고, 융해된 온도를 상한점으로 한다. 측정 장치는 각종 형태가 존재하지만, 가장 고전적인 장치는 이중관식 온도계에, 시료를 충전한 모세관을 장착하여 온욕으로 가온하는 장치가 사용된다. 이중관식 온도계에 모세관을 부착할 목적으로 온욕의 액체로서 점성이 높은 액체가 사용되고, 진한 황산 내지는 실리콘 오일이 사용되는 경우가 많고, 온도계 선단의 섬프(sump) 근방에 시료가 오도록 장착한다. 또한, 융점 측정 장치로서는 금속의 히트 블록을 사용하여 가온하고, 광의 투과율을 측정하면서 가온을 조정하면서 자동적으로 융점을 결정하는 것을 사용할 수도 있다.
그리고, 본 명세서 중, 융점이 150℃ 이하란, 융점의 상한점이 150℃ 이하인 것을 의미하고, 융점이 25℃ 이상이란, 융점의 하한점이 25℃ 이상인 것을 의미한다.
(c) 성분의 함유량은, 반도체용 접착제의 전체량 기준으로, 0.5∼10 질량%인 것이 바람직하고, 0.5∼5 질량%인 것이 더욱 바람직하다.
(d) 성분: 중량 평균 분자량이 10000 이상인 고분자 성분
본 실시형태의 반도체용 접착제는, 필요에 따라, 중량 평균 분자량이 10000 이상인 고분자 성분((d) 성분)을 함유하고 있어도 된다. (d) 성분을 함유하는 반도체용 접착제는, 내열성 및 필름 형성성이 한층 우수하다.
(d) 성분으로서는, 예를 들면, 우수한 내열성, 필름 형성성 및 접속 신뢰성을 얻을 수 있는 관점에서, 페녹시 수지, 폴리이미드 수지, 폴리아미드 수지, 폴리카르보디이미드 수지, 시아네이트에스테르 수지, 아크릴 수지, 폴리에스테르 수지, 폴리에틸렌 수지, 폴리에테르술폰 수지, 폴리에테르이미드 수지, 폴리비닐아세탈 수지, 우레탄 수지 및 아크릴 고무가 바람직하다. 이들 중에서도 내열성 및 필름 형성성이 한층 우수한 관점에서, 페녹시 수지, 폴리이미드 수지, 아크릴 고무, 아크릴 수지, 시아네이트에스테르 수지 및 폴리카르보디이미드 수지가 보다 바람직하고, 페녹시 수지, 폴리이미드 수지, 아크릴 고무 및 아크릴 수지가 더욱 바람직하다. 이들 (d) 성분은 단독으로 사용할 수도 있고 또는 2종 이상의 혼합물이나 공중합체로서 사용할 수도 있다. 단, (d) 성분에는, (a) 성분인 에폭시 수지가 포함되지 않는다.
(d) 성분의 중량 평균 분자량은, 10000 이상이며, 20000 이상인 것이 바람직하고, 30000 이상인 것이 더욱 바람직하다. 이와 같은 (d) 성분에 의하면, 반도체용 접착제의 내열성 및 필름 형성성을 한층 향상시킬 수 있다.
또한, (d) 성분의 중량 평균 분자량은, 1000000 이하인 것이 바람직하고, 500000 이하인 것이 더욱 바람직하다. 이와 같은 (d) 성분에 의하면, 고내열성과 같은 효과를 얻을 수 있다.
그리고, 상기 중량 평균 분자량은, GPC(겔 침투 크로마토그래피, Gel Permeation Chromatography)를 사용하여 측정된, 폴리스티렌 환산의 중량 평균 분자량을 나타낸다. GPC법의 측정 조건의 일례를 이하에 나타낸다.
장치: HCL-8320GPC, UV-8320(제품명, 도소사 제조), 또는 HPLC-8020(제품명, 도소사 제조)
컬럼: TSKgel superMultiporeHZ-M×2, 또는 2 pieces of GMHXL ＋ 1 piece of G-2000 XL
검출기: RI 또는 UV 검출기
컬럼 온도: 25∼40 ℃
용리액: 고분자 성분이 용해하는 용매를 선택한다. 예를 들면, THF(테트라하이드로퓨란), DMF(N,N-디메틸포름아미드), DMA(N,N-디메틸아세트아미드), NMP(N-메틸피롤리돈), 톨루엔. 그리고, 극성을 가지는 용제를 선택하는 경우에는, 인산의 농도를 0.05∼0.1 mol/L(통상은 0.06 mol/L), LiBr의 농도를 0.5∼1.0 mol/L(통상은 0.63 mol/L)로 조정해도 된다.
유속(流速): 0.30∼1.5 mL/분
표준 물질: 폴리스티렌
반도체용 접착제가 (d) 성분을 함유할 때, (d) 성분의 함유량 Cd에 대한 (a) 성분의 함유량 Ca의 비 Ca/Cd(질량비)는, 0.01∼5인 것이 바람직하고, 0.05∼3인 것이 보다 바람직하고, 0.1∼2인 것이 더욱 바람직하다. 비 Ca/Cd를 0.01 이상으로 함으로써, 보다 양호한 경화성 및 접착력을 얻을 수 있고, 비 Ca/Cd를 5 이하로 함으로써 보다 양호한 필름 형성성을 얻을 수 있다.
(e) 성분: 필러
본 실시형태의 반도체용 접착제는, 필요에 따라, 필러((e) 성분)를 함유하고 있어도 된다. (e) 성분에 의해, 반도체용 접착제의 점도, 반도체용 접착제의 경화물의 물성 등을 제어할 수 있다. 구체적으로는, (e) 성분에 의하면, 예를 들면, 접속 시의 보이드 발생의 억제, 반도체용 접착제의 경화물의 흡습 비율의 저감 등을 도모할 수 있다.
(e) 성분으로서는, 절연성 무기 필러, 위스커, 수지 필러 등을 사용할 수 있다. 또한, (e) 성분은, 1종을 단독으로 사용해도 되고, 2종 이상을 병용해도 된다.
절연성 무기 필러로서는, 예를 들면, 유리, 실리카, 알루미나, 산화 티탄, 카본 블랙, 운모 및 질화 붕소를 들 수 있다. 이들 중에서도, 실리카, 알루미나, 산화 티탄 및 질화 붕소가 바람직하고, 실리카, 알루미나 및 질화 붕소가 더욱 바람직하다.
위스커로서는, 예를 들면, 붕산 알루미늄, 티탄산 알루미늄, 산화 아연, 규산 칼슘, 황산 마그네슘 및 질화 붕소를 들 수 있다.
수지 필러로서는, 예를 들면, 폴리우레탄, 폴리이미드 등의 수지로 이루어지는 필러를 들 수 있다.
수지 필러는, 유기 성분(에폭시 수지 및 경화제 등)과 비교하여 열팽창율이 작으므로, 접속 신뢰성의 향상 효과가 우수하다. 또한, 수지 필러에 의하면, 반도체용 접착제의 점도 조정을 용이하게 행할 수 있다. 또한, 수지 필러는, 무기 필러와 비교하여 응력을 완화하는 기능이 우수하므로, 수지 필러에 의하면 리플로우 시험 등에 있어서의 박리를 한층 억제할 수 있다.
무기 필러는, 수지 필러와 비교하여 열팽창율이 작으므로, 무기 필러에 의하면, 접착제 조성물의 낮은 열팽창율화를 실현할 수 있다.또한, 무기 필러에는 범용품으로서 입경이 제어된 것이 많기 때문에, 점도 조정에도 바람직하다.
수지 필러 및 무기 필러는 각각에 유리한 효과가 있으므로, 용도에 따라 어느 한쪽을 사용해도 되고, 양쪽의 기능을 발현하기 위해 양쪽을 혼합하여 사용해도 된다.
(e) 성분의 형상, 입경 및 함유량은 특별히 한정되지 않는다. 또한, (e) 성분은, 표면 처리에 의해 물성을 적절하게 조정된 것이라도 된다.
(e) 성분의 함유량은, 반도체용 접착제의 전체량 기준으로, 10∼80 질량%인 것이 바람직하고, 15∼60 질량%인 것이 더욱 바람직하다.
(e) 성분은, 절연물로 구성되어 있는 것이 바람직하다. (e) 성분이 도전성 물질(예를 들면, 땜납, 금, 은, 구리 등)로 구성되어 있으면, 절연 신뢰성(특히 HAST 내성)이 저하될 우려가 있다.
(그 외의 성분)
본 실시형태의 반도체용 접착제에는, 산화 방지제, 실란 커플링제, 티탄 커플링제, 레벨링제, 이온 트랩제 등의 첨가제를 배합해도 된다. 이들은 1종을 단독으로 사용할 수도 있고, 2종 이상을 조합하여 사용할 수도 있다. 이들의 배합량에 대해서는, 각 첨가제의 효과가 발현하도록 적절하게 조정하면 된다.
본 실시형태의 반도체용 접착제는, 필름형으로 성형할 수 있다. 본 실시형태의 반도체용 접착제를 사용한 필름형 접착제의 제작 방법의 일례를 이하에 나타낸다.
먼저, (a) 성분, (b) 성분 및 (c) 성분, 및 필요에 따라 첨가 되는 (d) 성분, (e) 성분 등을, 유기용매 중에 가하고, 교반, 혼합, 혼련 등에 의해, 용해 또는 분산시켜, 수지 바니스를 조제한다.그 후, 이형(離型) 처리를 행한 기재(基材) 필름 상에, 수지 바니스를 나이프 코터, 롤 코터, 어플리케이터 등을 사용하여 도포한 후, 가열에 의해 유기용매를 제거함으로써, 기재 필름 상에 필름형 접착제를 형성할 수 있다.
필름형 접착제의 두께는 특별히 한정되지 않지만, 예를 들면, 접속 전의 범프의 높이의 0.5∼1.5 배인 것이 바람직하고, 0.6∼1.3 배인 것이 보다 바람직하고, 0.7∼1.2 배인 것이 더욱 바람직하다.
필름형 접착제의 두께가 범프의 높이의 0.5배 이상이면, 접착제의 미충전에 의한 보이드의 발생을 충분히 억제할 수 있고, 접속 신뢰성을 한층 향상시킬 수 있다. 또한, 두께가 1.5배 이하이면, 접속 시에 칩 접속 영역으로부터 압출되는 접착제의 양을 충분히 억제할 수 있으므로, 불필요한 부분에 대한 접착제의 부착을 충분히 방지할 수 있다. 필름형 접착제의 두께가 1.5배보다 크면, 많은 접착제를 범프로부터 배제하지 않으면 안되므로, 통전 불량이 쉽게 생긴다. 또한, 협(狹)피치화·다핀화에 의한 범프의 약화(범프 직경의 미소화)에 대하여, 많은 수지를 배제하는 것은, 범프에 대한 손상이 커지므로, 바람직하지 않다.
일반적으로 범프의 높이가 5∼100 ㎛인 것을 고려하면, 필름형 접착제의 두께는 2.5∼150 ㎛인 것이 바람직하고, 3.5∼120 ㎛인 것이 더욱 바람직하다.
수지 바니스의 조제에 사용하는 유기용매로서는, 각 성분을 균일하게 용해 또는 분산할 수 있는 특성을 가지는 것이 바람직하고, 예를 들면, 디메틸포름아미드, 디메틸아세트아미드, N-메틸-2-피롤리돈, 디메틸술폭시드, 디에틸렌 글리콜디메틸에테르, 톨루엔, 벤젠, 크실렌, 메틸에틸케톤, 테트라하이드로퓨란, 에틸 셀로솔브, 에틸 셀로솔브 아세테이트, 부틸 셀로솔브, 디옥산, 시클로헥사논, 및 에틸아세테이트를 들 수 있다. 이들 유기용매는, 단독으로 사용할 수도 있고, 2 종류 이상을 조합하여 사용할 수도 있다. 수지 바니스 조제 시의 교반 혼합이나 혼련은, 예를 들면, 교반기, 맷돌식 교반기, 3롤, 볼 밀, 비즈 밀 또는 호모 믹서를 사용하여 행할 수 있다.
기재 필름으로서는, 유기용매를 휘발시킬 때의 가열 조건에 견딜 수 있는 내열성을 가지는 것이면 특별히 제한은 없고, 폴리프로필렌 필름, 폴리메틸펜텐 필름 등의 폴리올레핀 필름, 폴리에틸렌테레프탈레이트 필름, 폴리에틸렌나프탈레이트 필름 등의 폴리에스테르 필름, 폴리이미드 필름 및 폴리에테르이미드 필름을 예시할 수 있다. 기재 필름은, 이들 필름으로 이루어지는 단층 필름으로 한정되지 않고, 2종 이상의 재료로 이루어지는 다층 필름이라도 된다.
기재 필름에 도포한 수지 바니스로부터 유기용매를 휘발시킬 때의 건조 조건은, 유기용매가 충분히 휘발하는 조건으로 하는 것이 바람직하고, 구체적으로는, 50∼200 ℃, 0.1∼90 분간의 가열을 행하는 것이 바람직하다. 유기용매는, 필름형 접착제 전체량에 대하여 1.5 질량% 이하까지 제거되는 것이 바람직하다.
또한, 본 실시형태의 반도체용 접착제는, 웨이퍼 상에서 직접 형성해도 된다. 구체적으로는, 예를 들면, 상기 수지 바니스를 웨이퍼 상에 직접 스핀 코팅하여 막을 형성한 후, 유기용매를 제거함으로써, 웨이퍼 상에 직접 반도체용 접착제를 형성해도 된다.
<반도체 장치>
본 실시형태의 반도체 장치에 대하여, 도 1 및 2를 사용하여 이하에 설명한다. 도 1은, 본 발명의 반도체 장치의 일실시형태를 나타낸 모식 단면도이다. 도 1의 (a)에 나타낸 바와 같이, 반도체 장치(100)는, 서로 대향하는 반도체칩(10) 및 기판(회로 배선 기판)(20)고, 반도체칩(10) 및 기판(20)의 서로 대향하는 면에 각각 배치된 배선(15)과, 반도체칩(10) 및 기판(20)의 배선(15)을 서로 접속하는 접속 범프(30)와, 반도체칩(10) 및 기판(20) 사이의 공극에 간극없이 충전된 접착 재료(40)를 가지고 있다. 반도체칩(10) 및 기판(20)은, 배선(15) 및 접속 범프(30)에 의해 플립 칩 접속되어 있다. 배선(15) 및 접속 범프(30)는, 접착 재료(40)에 의해 봉지되어 있어, 외부 환경으로부터 차단되어 있다.
도 1의 (b)에 나타낸 바와 같이, 반도체 장치(200)는, 서로 대향하는 반도체칩(10) 및 기판(20)과, 반도체칩(10) 및 기판(20)의 서로 대향하는 면에 각각 배치된 범프(32)와, 반도체칩(10) 및 기판(20) 사이의 공극에 간극없이 충전된 접착 재료(40)를 가지고있다. 반도체칩(10) 및 기판(20)은, 대향하는 범프(32)가 서로 접속됨으로써 플립 칩 접속되어 있다. 범프(32)는, 접착 재료(40)에 의해 봉지되어 있어, 외부 환경으로부터 차단되어 있다. 접착 재료(40)는, 본 실시형태의 반도체용 접착제의 경화물이다.
도 2는, 본 발명의 반도체 장치의 다른 일실시형태를 나타낸 모식 단면도이다. 도 2의 (a)에 나타낸 바와 같이, 반도체 장치(300)는, 2개의 반도체칩(10)이 배선(15) 및 접속 범프(30)에 의해 플립 칩 접속되어 있는 점을 제외하고, 반도체 장치(100)와 동일하다. 도 2의 (b)에 나타낸 바와 같이, 반도체 장치(400)는, 2개의 반도체칩(10)이 범프(32)에 의해 플립 칩 접속되어 있는 점을 제외하고, 반도체 장치(200)와 동일하다.
반도체칩(10)으로서는, 특별히 한정되지 않고, 실리콘, 게르마늄 등의 동일 종류의 원소로 구성되는 원소 반도체, 갈륨 비소, 인듐인 등의 화합물 반도체를 사용할 수 있다.
기판(20)으로서는, 회로 기판이면 특별히 제한은 없고, 유리 에폭시, 폴리이미드, 폴리에스테르, 세라믹, 에폭시, 비스말레이미드트리아진 등을 주된 성분으로 하는 절연 기판의 표면에, 금속막의 불필요한 개소를 에칭 제거하여 형성된 배선(배선 패턴)(15)을 가지는 회로 기판, 상기 절연 기판의 표면에 금속 도금 등에 의해 배선(15)이 형성된 회로 기판, 상기 절연 기판의 표면에 도전성 물질을 인쇄하여 배선(15)이 형성된 회로 기판을 사용할 수 있다.
배선(15)이나 범프(32) 등의 접속부는, 주성분으로서, 금, 은, 동, 땜납(주성분은, 예를 들면, 주석-은, 주석-납, 주석-비스무트, 주석-동, 주석-은-동), 니켈, 주석, 납 등을 함유하고 있으며, 복수의 금속을 함유하고 있어도 된다.
전술한 금속 중에서도, 접속부의 전기 전도성·열전도성이 우수한 패키지로 형성하는 관점에서, 금, 은 및 동이 바람직하고, 은 및 동이 더욱 바람직하다. 비용이 저감된 패키지로 형성하는 관점에서, 염가인 점을 고려하면, 은, 동 및 땜납이 바람직하고, 동 및 땜납이 보다 바람직하고, 땜납이 더욱 바람직하다. 실온에 있어서 금속의 표면에 산화막이 형성되면 생산성이 저하되는 경우나 비용이 증가하는 경우가 있으므로, 산화막의 형성을 억제하는 관점에서, 금, 은, 동 및 땜납이 바람직하고, 금, 은, 땜납이 보다 바람직하고, 금, 은이 더욱 바람직하다.
상기 배선(15) 및 범프(32)의 표면에는, 금, 은, 동, 땜납(주성분은, 예를 들면, 주석-은, 주석-납, 주석-비스무트, 주석-동), 주석, 니켈 등을 주된 성분으로 하는 금속층이, 예를 들면, 도금에 의해 형성되어 있어도 된다. 이 금속층은 단일 성분만으로 구성되어 있어도 되고, 복수의 성분으로 구성되어 있어도 된다. 또한, 상기 금속층은, 단층 또는 복수의 금속층이 적층된 구조를 하고 있어도 된다.\
또한, 본 실시형태의 반도체 장치는, 반도체 장치(100∼400)에 나타낸 바와 같은 구조(패키지)가 복수 적층되어 있어도 된다. 이 경우, 반도체 장치(100∼400)는, 금, 은, 동, 땜납(주성분은, 예를 들면, 주석-은, 주석-납, 주석-비스무트, 주석-동, 주석-은-동), 주석, 니켈 등을 포함하는 범프나 배선으로 서로 전기적으로 접속되어 있어도 된다.
반도체 장치를 복수 적층하는 방법으로서는, 도 3에 나타낸 바와 같이, 예를 들면, TSV(Through-Silicon Via) 기술을 들 수 있다. 도 3은, 본 발명의 반도체 장치의 다른 일실시형태를 나타낸 모식 단면도이며, TSV 기술을 사용한 반도체 장치이다. 도 3에 나타낸 반도체 장치(500)에서는, 인터포저(50) 상에 형성된 배선(15)이 반도체칩(10)의 배선(15)이 접속 범프(30)를 통하여 접속됨으로써, 반도체칩(10)과 인터포저(50)는 플립 칩 접속되어 있다. 반도체칩(10)과 인터포저(50)의 사이의 공극에는 접착 재료(40)가 간극없이 충전되어 있다. 상기 반도체칩(10)에서의 인터포저(50)와 반대측의 표면 상에는, 배선(15), 접속 범프(30) 및 접착 재료(40)를 통하여 반도체칩(10)이 반복적으로 적층되어 있다. 반도체칩(10)의 표면 및 배면에서의 패턴면의 배선(15)은, 반도체칩(10)의 내부를 관통하는 구멍 내에 충전된 관통 전극(34)에 의해 서로 접속되어 있다. 그리고, 관통 전극(34)의 재질로서는, 동, 알루미늄 등을 사용할 수 있다.
이와 같은 TSV 기술에 의해, 통상은 사용되지 않는 반도체칩의 배면으로부터도 신호를 취득할 수 있게 된다. 또한, 반도체칩(10) 내에 관통 전극(34)을 수직으로 통과시키기 때문에, 대향하는 반도체칩(10) 사이나 반도체칩(10) 및 인터포저(50) 사이의 거리를 짧게 하고, 유연한 접속이 가능하다. 본 실시형태의 반도체용 접착제는, 이와 같은 TSV 기술에 있어서, 대향하는 반도체칩(10) 사이나, 반도체칩(10) 및 인터포저(50) 사이의 반도체용 접착제로서 적용할 수 있다.
또한, 에리어범프칩 기술 등의 자유도가 높은 범프 형성 방법에서는, 인터포저를 개재하지 않고 그대로 반도체칩을 마더 보드에 직접 실장할 수 있다. 본 실시형태의 반도체용 접착제는, 이와 같은 반도체칩을 마더 보드에 직접 실장하는 경우에도 적용할 수 있다. 그리고, 본 실시형태의 반도체용 접착제는, 2개의 배선 회로 기판을 적층하는 경우에, 기판 사이의 공극을 봉지할 때도 적용할 수 있다.
<반도체 장치의 제조 방법>
본 실시형태의 반도체 장치의 제조 방법에 대하여, 도 4를 사용하여 이하에서 설명한다. 도 4는, 본 발명의 반도체 장치의 제조 방법의 일실시형태를 모식적으로 나타낸 공정 단면도이다.
먼저, 도 4의 (a)에 나타낸 바와 같이, 배선(15)을 가지는 기판(20) 상에, 접속 범프(30)를 형성하는 위치에 개구를 가지는 솔더 레지스트(60)를 형성한다. 이 솔더 레지스트(60)는 반드시 설치할 필요는 없다. 그러나, 기판(20) 상에 솔더 레지스트를 설치함으로써, 배선(15) 사이의 브리지의 발생을 억제하고, 접속 신뢰성·절연 신뢰성을 향상시킬 수 있다. 솔더 레지스트(60)는, 예를 들면, 시판 중인 패키지용 솔더 레지스트용 잉크를 사용하여 형성할 수 있다. 시판중인 패키지용 솔더 레지스트용 잉크로서는, 구체적으로는, SR 시리즈(히타치가세이고교 가부시키가이샤 제조, 상품명) 및 PSR4000-AUS 시리즈(타이요잉크제조(주) 제조, 상품명)를 예로 들 수 있다.
다음으로, 도 4의 (a)에 나타낸 바와 같이, 솔더 레지스트(60)의 개구에 접속 범프(30)를 형성한다. 그리고, 도 4의 (b)에 나타낸바와 같이, 접속 범프(30) 및 솔더 레지스트(60)가 형성된 기판(20) 상에, 필름형의 반도체용 접착제(이하, 경우에 따라 「필름형 접착제」라고 함)(41)를 접착한다. 필름형 접착제(41)의 접착은, 가열 프레스, 롤 라미네이트, 진공 라미네이트 등에 의해 행할 수 있다. 필름형 접착제(41)의 공급 면적이나 두께는, 반도체칩(10) 및 기판(20)의 사이즈나, 접속 범프(30)의 높이에 따라 적절하게 설정된다.
전술한 바와 같이 필름형 접착제(41)를 기판(20)에 접착한 후, 반도체칩(10)의 배선(15)과 접속 범프(30)를 플립 칩 본더 등의 접속 장치를 사용하여, 위치맞춤시킨다. 이어서, 반도체칩(10)과 기판(20)을 접속 범프(30)의 융점 이상의 온도로 가열하면서 압착(壓着)하고, 도 4의 (c)에 나타낸 바와 같이, 반도체칩(10)과 기판(20)을 접속하고, 또한 필름형 접착제(41)의 경화물인 접착 재료(40)에 의해, 반도체칩(10) 및 기판(20) 사이의 공극을 봉지 충전한다. 이로써, 반도체 장치(600)를 얻을 수 있다.
본 실시형태의 반도체 장치의 제조 방법에서는, 위치맞춤을 행한 후에 가고정하고(반도체용 접착제를 개재하고 있는 상태), 리플로우 로(爐)에서 가열 처리함으로써, 접속 범프(30)를 용융시켜 반도체칩(10)과 기판(20)을 접속해도 된다. 가고정의 단계에서는, 금속 접합을 형성하는 것이 반드시 필요한 것은 아니므로, 전술한 바와 같이 가열하면서 압착하는 방법에 비해 저하중, 단시간, 저온도에 의하여 압착하면 되므로, 생산성이 향상되는 동시에 접속부의 열화를 억제할 수 있다.
또한, 반도체칩(10)과 기판(20)을 접속한 후, 오븐 등으로 가열 처리를 행하여, 접속 신뢰성·절연 신뢰성을 더욱 높여도 된다. 가열 온도는, 필름형 접착제의 경화가 진행하는 온도가 바람직하고, 완전히 경화되는 온도가 더욱 바람직하다. 가열 온도, 가열 시간은 적절하게 설정된다.
본 실시형태의 반도체 장치의 제조 방법에서는, 필름형 접착제(41)를 반도체칩(10)에 접착한 후에 기판(20)을 접속해도 된다. 또한, 반도체칩(10) 및 기판(20)을 배선(15) 및 접속 범프(30)에 의해 접속한 후, 반도체칩(10) 및 기판(20) 사이의 공극에 페이스트상(狀)의 반도체용 접착제를 충전하고, 경화시켜도 된다.
생산성이 향상되는 관점에서, 복수의 반도체칩(10)이 연결된 반도체 웨이퍼에 반도체용 접착제를 공급한 후, 다이싱(dicing)하여 개편화(個片化)하는 것에 의해, 반도체칩(10) 상에 반도체용 접착제가 공급된 구조체를 얻어도 된다. 또한, 반도체용 접착제가 페이스트상인 경우에는, 특별히 제한되는 것은 아니지만, 스핀 코팅 등의 도포 방법에 의해, 반도체칩(10) 상의 배선이나 범프를 매립하여, 두께를 균일화시키면 된다. 이 경우에, 수지의 공급량이 일정하게 되므로 생산성이 향상되는 동시에, 매립 부족에 의한 보이드의 발생 및 다이싱성의 저하를 억제할 수 있다. 한편, 반도체용 접착제가 필름형인 경우에는, 특별히 제한되는 것은 아니지만, 가열 프레스, 롤 라미네이트 및 진공 라미네이트 등의 접착 방식에 의해 반도체칩(10) 상의 배선이나 범프를 매립하도록 필름형 반도체용 접착제를 공급하면 된다. 이 경우, 수지의 공급량이 일정하게 되므로 생산성이 향상되고, 매립 부족에 의한 보이드의 발생 및 다이싱성의 저하를 억제할 수 있다.
페이스트상의 반도체용 접착제를 스핀 코팅하는 방법과 비교하여, 필름형의 반도체용 접착제를 라미네이팅하는 방법에 의하면, 공급 후의 반도체용 접착제의 평탄성이 양호해지는 경향이 있다. 그러므로, 반도체용 접착제의 형태로서는, 필름형이 바람직하다. 또한, 필름형 접착제는, 다양한 프로세스에 대한 적용성, 취급성 등도 우수하다.
또한, 필름형 접착제를 라미네이팅함으로써 반도체용 접착제를 공급하는 방법에서는, 반도체 장치의 접속성을 한층 확보하기 쉬워지는 경향이 있다. 그 이유에 대하여, 확실하지 않지만, 본 발명자들은 다음과 같이 생각하고 있다. 즉, 본 실시형태의 플럭스제는, 융점이 낮은 경향이 있어, 플럭스 활성이 발현되기 쉬운 경향이 있다. 그러므로, 필름형 접착제를 반도체 웨이퍼에 라미네이팅할 때의 가열에 의해, 플럭스 활성이 발현하여, 반도체 웨이퍼 상의 범프 표면의 산화막 중 적어도 일부가 환원 제거되는 것으로 생각된다. 이 환원 제거에 의해, 필름형 접착제가 공급된 시점에서 범프 중 적어도 일부가 노출되고, 이것이 접속성의 향상에 기여하고 있는 것으로 여겨진다.
접속 하중은, 접속 범프(30)의 수나 높이의 불균일, 가압에 의한 접속 범프(30), 또는 접속부의 범프를 받는 배선의 변형량을 고려하여 설정된다. 접속 온도는, 접속부의 온도가 접속 범프(30)의 융점 이상인 것이 바람직하지만, 각각의 접속부(범프나 배선)의 금속 접합이 형성되는 온도이면 된다. 접속 범프(30)가 땜납 범프인 경우에는, 약 240℃ 이상이 바람직하다.
접속 시의 접속 시간은, 접속부의 구성 금속에 따라 상이하지만, 생산성이 향상되는 관점에서 단시간일수록 바람직하다. 접속 범프(30)가 땜납 범프인 경우, 접속 시간은 20초 이하가 바람직하고, 10초 이하가 보다 바람직하고, 5초 이하가 더욱 바람직하다. 동-동 또는 동-금의 금속 접속의 경우에는, 접속 시간은 60초 이하가 바람직하다.
전술한 다양한 패키지 구조의 플립 칩 접속부에 있어서도, 본 실시형태의 반도체용 접착제는, 우수한 내리플로우성 및 접속 신뢰성을 나타낸다.
이상, 본 발명의 바람직한 실시형태에 대하여 설명하였으나, 본 발명은 상기 실시형태로 한정되는 것은 아니다.
예를 들면, 본 발명의 일측면은, 식(1)으로 표시되는 기를 가지는 화합물의 반도체용 접착제에 배합되는 플럭스제로서의 사용에 관한 것이다. 또한, 본 발명의 다른 측면은, 식(1)으로 표시되는 기를 가지는 화합물의 반도체용 접착제의 제조를 위한 사용에 관한 것이다.
또한, 본 발명의 다른 측면은, 식(1)으로 표시되는 기를 가지는 화합물을 포함하는 플럭스제에 관한 것이다. 또한, 본 발명의 다른 측면은, 식(1)으로 표시되는 기를 가지는 화합물을 포함하는 플럭스제의 반도체용 접착제의 제조를 위한 사용이라고도 할 수 있다.
또한, 본 발명의 다른 측면은, 에폭시 수지, 경화제 및 식(1)으로 표시되는 기를 가지는 화합물을 함유하는 조성물의 반도체용 접착제로서의 사용이라고도 할 수 있다. 또한, 본 발명의 다른 측면은, 에폭시 수지, 경화제 및 식(1)으로 표시되는 기를 가지는 화합물을 함유하는 조성물의 반도체용 접착제의 제조를 위한 사용이라고도 할 수 있다.
[실시예]
이하에서, 실시예에 의해 본 발명를 더욱 구체적으로 설명하지만, 본 발명은 실시예로 한정되는 것은 아니다.
각각의 실시예 및 비교예에서 사용한 화합물은 다음과 같다.
(a) 에폭시 수지
·트리페놀메탄 골격 함유 다관능성 고형 에폭시(재팬 에폭시 레진 가부시키가이샤 제조, 상품명 「EP1032H60」, 이하 「EP1032」라고 함)
·비스페놀 F형 액상(液狀) 에폭시(재팬 에폭시 레진 가부시키가이샤 제조, 상품명 「YL983U」, 이하 「YL983」이라고 함)
·유연성 에폭시(재팬 에폭시 레진 가부시키가이샤 제조, 상품명 「YL7175」, 이하 「YL7175」라고 함)
(b) 경화제
·2,4-디아미노-6-[2'-메틸이미다졸릴-(1')]-에틸-s-트리아진이소시아누르산 부가체(시코쿠 화성 가부시키가이샤 제조, 상품명 「2MAOK-PW」, 이하 「2MAOK」라고 함)
(c) 식(1)으로 표시되는 기를 가지는 화합물로 이루어지는 플럭스제
·2-메틸글루타르산(알드리치사 제조, 융점 약 78℃)
·메틸숙신산(알드리치사 제조, 융점 약 116℃)
(c') 다른 플럭스제
·글루타르산(도쿄 화성 가부시키가이샤 제조, 융점 약 98℃)
·숙신산(알드리치사 제조, 융점 약 188℃)
·3-메틸글루타르산(도쿄 화성주식회사 제조, 융점 약 87℃)
·아디프산(도쿄 화성 가부시키가이샤 제조, 융점 약 153℃)
·말론산(알드리치사 제조, 융점 약 135∼137 ℃)
·1,3,5-펜탄트리카르복시산(도쿄 화성 가부시키가이샤 제조, 융점 약 113℃, 이하 「펜탄트리카르복시산」이라고 함)
(d) 분자량 10000 이상의 고분자 성분
·페녹시 수지(도토 화성 가부시키가이샤 제조, 상품명 「ZX1356-2」, Tg: 약 71℃, Mw: 약 63000, 이하 「ZX1356」이라고 함)
(e) 필러
(e-1) 무기 필러
·실리카 필러(가부시키가이샤 아드마텍스 제조, 상품명 「SE2050」, 평균 입경 0.5㎛, 이하 「SE2050」이라고 함)
·에폭시 실란 처리 실리카 필러(가부시키가이샤 아드마텍스 제조, 상품명 「SE2050-SEJ」, 평균 입경 0.5㎛, 이하 「SE2050-SEJ」라고 함)
·아크릴 표면 처리 나노 실리카 필러(가부시키가이샤 아드마텍스 제조, 상품명 「YA050C-SM」, 평균 입경 약 50 ㎚, 이하 「SM 나노 실리카」라고 함)
(e-2) 수지 필러
·유기 필러(롬앤하스 재팬 가부시키가이샤 제조, 상품명 「EXL-2655」, 코어 쉘 타입 유기 미립자, 이하 「EXL-2655」라고 함)
고분자 성분의 중량 평균 분자량(Mw)은, GPC법에 의해 구한 것이다. GPC법의 상세한 것은 이하에 나타낸 바와 같다.
장치명: HPLC-8020(제품명, 도소사 제조)
컬럼: 2 pieces of GMHXL ＋ 1 piece of G-2000XL
검출기: RI 검출기
컬럼 온도: 35℃
유속: 1 mL/분
표준 물질: 폴리스티렌
<필름형 반도체용 접착제의 제작>
(실시예 1)
에폭시 수지 3 g(「EP1032」를 2.4 g, 「YL983」을 0.45 g, 「YL7175」를 0.15 g), 경화제 「2MAOK」0.1 g, 2-메틸글루타르산 0.1 g(0.69 ㎜ol), 무기 필러 1.9 g(「SE2050」을 0.38 g, 「SE2050-SEJ」를 0.38 g, 「SM 나노 실리카」를 1.14 g), 수지 필러(EXL-2655) 0.25 g, 및 메틸에틸케톤(고형분량이 63 질량%가 되는 양)을 투입하고, 직경 0.8 ㎜의 비즈 및 직경 2.0 ㎜의 비즈를 고형분과 동일한 중량 가하고, 비즈 밀(프리치(fritsch)·재팬 가부시키가이샤, 유성형 미분쇄기 P-7)로 30분 교반하였다. 그 후, 페녹시 수지(ZX1356)를 1.7 g를 가하고, 다시 비즈 밀로 30분 교반한 후, 교반에 사용한 비즈를 여과에 의해 제거하여, 수지 바니스를 얻었다.
얻어진 수지 바니스를, 기재 필름(테이진 듀퐁 필름 가부시키가이샤 제조, 상품명 「퓨렉스 A53」) 상에, 소형 정밀 도포 장치(야스이 정기(精機))로 도포하고, 클린 오븐(ESPEC 제조)으로 건조(70℃/10 min)하여, 필름형 접착제를 얻었다.
(실시예 2, 비교예 1∼6)
사용한 재료의 조성을 하기 표 1에 기재된 대로로 변경한 점 이외에는, 실시예 1과 동일한 방법에 의해, 실시예 2 및 비교예 1∼6의 필름형 접착제를 제작하였다.
이하에서, 실시예 및 비교예에서 얻어진 필름형 접착제의 평가 방법을 나타낸다.
<초기 접속성의 평가>
실시예 또는 비교예에서 제작한 필름형 접착제를 소정 사이즈(세로 8 ㎜×가로 8 ㎜×두께 0.045 ㎜)로 잘라내고, 유리 에폭시 기판(유리 에폭시 기재: 420㎛ 두께, 동배선: 9㎛ 두께) 상에 접착하고, 땜납 범프를 가진 반도체칩(칩 사이즈: 세로 7.3 ㎜×가로 7.3 ㎜×두께 0.15 ㎜, 범프 높이: 동 필러(pillar)＋땜납 합계 약 40㎛, 범프수 328)을 플립 실장 장치 「FCB3」(파나소닉 제조, 상품명)으로 실장하였다(실장 조건: 압착 헤드 온도 350℃, 압착 시간 5초, 압착 압력 0.5 MPa). 이로써, 도 4와 마찬가지로 상기 유리 에폭시 기판과 땜납 범프를 가진 반도체칩이 데이지 체인(daisy chain) 접속된 반도체 장치를 제작하였다.
얻어진 반도체 장치의 접속 저항값을, 멀티미터(ADVANTEST 제조, 상품명 「R6871E」)를 사용하여 측정함으로써, 실장 후의 초기 통전을 평가했다. 접속 저항값이 10.0∼13.5 Ω인 경우를 접속성 양호 「A」로 하고, 접속 저항값이 13.5∼20 Ω인 경우를 접속성 불량 「B」로 하고, 접속 저항값이 20Ω보다 큰 경우, 접속 저항값이 10Ω 미만인 경우 및 접속 불량에 인한 Open(저항값이 표시되지 않음) 경우를 모두 접속성 불량 「C」로 평가했다.
<보이드 평가>
전술한 방법으로 제작한 반도체 장치에 대하여, 초음파 영상 진단 장치(상품명 「Insight-300」, 인사이트 제조)에 의해 외관 화상을 촬영하고, 스캐너 GT-9300UF(EPSON사 제조, 상품명)로 칩 상의 접착 재료층(반도체용 접착제의 경화물으로 이루어지는 층)의 화상을 스캐닝하고, 화상 처리 소프트웨어 Adobe Photoshop을 사용하여, 색조 보정, 2계조화에 의해 보이드 부분을 식별하고, 히스토그램에 의해 보이드 부분이 차지하는 비율을 산출하였다. 칩 상의 접착 재료 부분의 면적을 100%로 하고, 보이드 발생율이 10% 이하인 경우를 「A」로 하고, 10∼20 %를 「B」로 하고, 20%보다 많은 경우를 「C」로서 평가했다.
<땜납 젖음성 평가>
전술한 방법으로 제작한 반도체 장치에 대하여, 접속부의 단면을 관찰하고, Cu 배선의 상면에 90% 이상 땜납이 젖어 있는 경우를 「A」(양호), 땜납이 젖어 있는 것이 90%보다 작은 경우를 「B」(젖음 부족)로서 평가했다.
<흡습 전의 260℃에서의 접착력의 측정>
실시예 또는 비교예에서 제작한 필름형 접착제를 소정 사이즈(세로 5 ㎜×가로 5 ㎜×두께 0.045 ㎜)로 잘라내고, 실리콘 칩(세로 5 ㎜×가로 5 ㎜×두께 0.725 ㎜, 산화막 코팅) 상에 70℃에서 접착하고, 열압착 시험기(히타치 화성 테크노 플랜트 가부시키가이샤 제조)를 사용하여 솔더 레지스트(타이요잉크 제조, 상품명 「AUS308」)가 코팅된 유리 에폭시 기판(두께 0.02 ㎜)에 압착했다(압착 조건: 압착 헤드 온도 250℃, 압착 시간 5초, 압착 압력 0.5 MPa). 다음으로, 클린 오븐(ESPEC 제조) 중에서 애프터 큐어(175℃, 2 h)하여, 시험 샘플로서의 반도체 장치를 얻었다.
상기 시험 샘플에 대하여, 260℃의 핫 플레이트 상에서 접착력 측정 장치(DAGE사 제조, 만능형 본드 테스터 DAGE4000형)를 사용하여, 기판으로부터의 툴 높이 0.05 ㎜, 툴 속도 0.05 ㎜/s의 조건 하에서 접착력을 측정하였다.
<흡습 후의 260℃에서의 접착력의 측정>
실시예 또는 비교예에서 제작한 필름형 접착제를 소정 사이즈(세로 5 ㎜×가로 5 ㎜×두께 0.045 ㎜)로 잘라내고, 실리콘 칩(세로 5 ㎜×가로 5 ㎜×두께 0.725 ㎜, 산화막 코팅) 상에 70℃에서 접착하고, 열압착 시험기(히타치 화성 테크노 플랜트 가부시키가이샤 제조)를 사용하여 솔더 레지스트(타이요잉크 제조, 상품명 「AUS308」)가 코팅된 유리 에폭시 기판(두께 0.02 ㎜)에 압착했다(압착 조건: 압착 헤드 온도 250℃, 압착 시간 5초, 압착 압력 0.5 MPa). 다음으로, 클린 오븐(ESPEC 제조) 중에서 애프터 큐어(175℃, 2 h)하여, 시험 샘플로서의 반도체 장치를 얻었다.
상기 시험 샘플을, 85℃, 상대 습도 60%의 항온항습기(ESPEC 제조, PR-2 KP)에 48시간 방치하고, 꺼낸 후, 260℃의 핫 플레이트 상에서 접착력 측정 장치(DAGE사 제조, 만능형 본드 테스터 DAGE4000형)를 사용하여, 기판으로부터의 툴 높이 0.05 ㎜, 툴 속도 0.05 ㎜/s의 조건 하에서 접착력을 측정하였다.
<내리플로우성의 평가>
<초기 접속성의 평가>에 기재된 방법으로 제작한 반도체 장치를, 봉지재(히타치가세이고교 가부시키가이샤 제조, 상품명 「CEL9750ZHF10」)를 사용하여, 180℃, 6.75 MPa, 90초의 조건 하에서 몰딩하고, 클린 오븐(ESPEC 제조) 중에서 175℃에서 5시간 애프터 큐어를 행하여, 패키지를 얻었다. 다음으로, 이 패키지를 JEDEC level 2 조건에서 고온 흡습한 후, IR 리플로우 로(FURUKAWA ELECTRIC 제조, 상품명 「SALAMANDER」)에 패키지를 3회 통과시켰다. 리플로우 후의 패키지의 접속성에 대하여, 전술한 초기 접속성의 평가와 동일한 방법의 방법으로 평가하여, 내리플로우성의 평가로 하였다. 박리가 없고 접속이 양호한 경우를 「A」로 하고, 박리나 접속 불량이 생긴 경우를 「B」로 했다.
<내TCT 평가(접속 신뢰성의 평가)>
<초기 접속성의 평가>에 기재된 방법으로 제작한 반도체 장치를, 봉지재(히타치가세이고교 가부시키가이샤 제조, 상품명 「CEL9750ZHF10」)를 사용하여, 180℃, 6.75 MPa, 90초의 조건 하에서 몰딩하고, 클린 오븐(ESPEC 제조) 중에서 175℃에서 5시간 애프터 큐어를 행하여, 패키지를 얻었다. 다음으로, 이 패키지를 냉열 사이클 시험기(ETAC 제조, 상품명 「THERMAL SHOCK CHAMBER NT1200」)에 연결하고, 1 mA 전류를 흐르게 하고, 25℃ 2분간/-55℃ 15분간/25℃ 2분간/125℃ 15분간/25℃ 2분간을 1사이클로 하여, 1000 사이클 반복한 후의 접속 저항의 변화를 평가했다. 초기의 저항값 파형에 비해 1000 사이클 후에도 큰 변화가 없는 경우를 「A」, 1Ω 이상의 차이가 생긴 경우를 「B」로 했다.
<절연 신뢰성 시험(HAST 시험: Highly Accelerated Storage Test)>
실시예 또는 비교예에서 제작한 필름형 접착제(두께: 45㎛)를, 빗살형 전극 평가 TEG(히타치가세이고교 가부시키가이샤 제조, 배선 피치: 50㎛)에 접착하고, 클린 오븐(ESPEC 제조) 중, 175℃에서 2시간 큐어했다. 큐어 후의 샘플을, 가속 수명 시험 장치(HIRAYAMA사 제조, 상품명「PL-422R8」, 조건: 130℃/85%RH/100시간, 5V 인가)에 설치하고, 절연 저항을 측정하였다. 100시간 후의 절연 저항이 108Ω 이상인 경우를 「A」로 하고, 107Ω 이상 108Ω 미만인 경우를 「B」로 하고, 107Ω 미만인 경우를 「C」로서 평가했다.
[표 1]
Figure 112014079839342-pct00011
실시예 1 및 2의 반도체용 접착제는, 흡습 후의 260℃에서의 접착력이 높고, 실시예 1 또는 2의 반도체용 접착제를 사용하여 제작된 반도체 장치에서는, 보이드 발생이 충분히 억제되고, 땜납 젖음성이 양호하며, 내리플로우성, 내TCT성 및 내HAST성이 우수한 것이 확인되었다.
10: 반도체 칩, 15: 배선(접속부), 20: 기판(배선 회로 기판), 30: 접속 범프, 32: 범프(접속부), 34: 관통 전극, 40: 접착 재료, 41: 반도체용 접착제(필름형 접착제), 50: 인터 포더, 60: 솔더 레지스트, 90: 빗살형 전극, 100, 200, 300, 400, 500, 600: 반도체 장치

Claims (25)

  1. 에폭시 수지; 경화제; 메틸숙신산, 2-메틸글루타르산, 2-메틸아디프산, 2-메틸피멜산 또는 2-메틸수베르산인 화합물; 및 수지 필러를 함유하는, 반도체용 접착제.
  2. 삭제
  3. 삭제
  4. 삭제
  5. 삭제
  6. 삭제
  7. 삭제
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  9. 제1항에 있어서,
    상기 화합물이, 플럭스제(fluxing agent)인, 반도체용 접착제.
  10. 제1항 또는 제9항에 있어서,
    중량 평균 분자량이 10000 이상인 고분자 성분을 추가로 함유하는, 반도체용 접착제.
  11. 제1항 또는 제9항에 있어서,
    형상이 필름형인, 반도체용 접착제.
  12. 삭제
  13. 삭제
  14. 삭제
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  21. 삭제
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  23. 반도체 칩 및 배선 회로 기판의 각각의 접속부가 서로 전기적으로 접속된 반도체 장치, 또는 복수의 반도체 칩의 각각의 접속부가 서로 전기적으로 접속된 반도체 장치의 제조 방법으로서,
    상기 접속부 중 적어도 일부를, 제1항 또는 제9항에 기재된 반도체용 접착제를 사용하여 봉지(封止)하는 공정을 포함하는, 반도체 장치의 제조 방법.
  24. 제23항에 기재된 제조 방법에 의해 얻어지는, 반도체 장치.
  25. 제1항 또는 제9항에 있어서,
    절연성인 반도체용 접착제.
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