KR100326269B1 - 반도체소자의고유전체캐패시터제조방법 - Google Patents

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Abstract

본 발명은 반도체 기술에 관한 것으로, 특히 초고집적 메모리 소자에 있어서 고유전 특성을 지닌 BST((Ba1-xSrx)TiO3)를 캐패시터 유전체막으로 사용하는 고유전체 캐패시터 제조방법에 관한 것이며, BST막 증착 후 박막 내에 포함된 탄소 및 박막 증착시 유발된 산소 결핍 결함을 효과적으로 제거할 수 있는 반도체 소자의 고유전체 캐패시터 제조방법을 제공하는데 그 목적이 있다. 본 발명은 반응성이 좋은 O3가스를 사용하여 플라즈마를 형성하고, BST 박막을 플라즈마 처리함으로써 박막내에 존재하는 탄소 및 산소 결핍 결함을 효과적으로 제거할 수 있는 기술이다. O3가스를 사용한 플라즈마 처리를 통해 종래의 UV-O3처리시 문제가 되었던 활성화된 산소의 라이프 타임을 길게 가져갈 수 있어 공정의 난이도를 증가시키거나 캐패시터의 전기적 특성을 열화시키지 않으면서 BST 박막 내의 탄소 및 산소 결함을 제거할 수 있다. 본 발명은 또한, O3가스를 사용한 플라즈마 처리를 최적화할 수 있는 상세 공정 조건을 제안한다.

Description

반도체 소자의 고유전체 캐패시터 제조방법{A method for fabricating high dielectric capacitor in semiconductor device}
본 발명은 반도체 기술에 관한 것으로, 특히 초고집적 메모리 소자에 있어서 고유전 특성을 지닌 BST((Ba1-xSrx)TiO3)를 캐패시터 유전체막으로 사용하는 고유전체 캐패시터 제조방법에 관한 것이다.
DRAM을 비롯한 반도체 장치의 고집적화에 따라 캐패시터의 충분한 정전용량을 확보하는 것이 큰 문제로 부각되었으며, 이를 해결하는 하나의 방안으로서 캐패시터의 하부 전극인 전하저장 전극의 표면적을 증가시키는 기술에 대한 많은 연구·개발이 진행되어 왔다. 그러나, 역시 고집적화에 수반되는 공정 마진의 저하 때문에 전하저장 전극의 표면적을 증가시키는데는 한계가 있다.
이러한 한계를 극복하기 위하여 고유전체인 BST를 캐패시터 유전막으로 사용하는 고유전체 캐패시터 제조 기술에 대한 관심이 증대되고 있는데, 이는 캐패시터의 정전용량이 유전율에 비례하는 원리를 적용한 것이다.
고유전체 캐패시터 제조 공정은 전반적으로 통상의 NO(Nitride/Oxide) 캐패시터 제조 공정과 유사하나, 고유전체 물질인 BST를 이용한 박막 형성 기술과 캐패시터의 전기적 특성 열화를 방지하기 위한 전·후 처리 기술 등의 난이도 높은 공정을 포함하게 된다.
캐패시터 유전막으로서 BST 박막을 사용하는 경우, 반응 원료로 Ba(C11H19O2)2, Sr(C11H19O2)2, Ti(C3H7O)2를 사용하고 있어 박막내에 다량의 탄소를 포함하게 되고, 또한 박막 증착시 산소 결핍 결함을 초래하여 누설전류를 증가시켜 캐패시터의 전기적 특성을 열화시키는 문제점이 있었음에도 뚜렷한 효과를 발휘하는 후처리 기술이 없는 실정이다.
종래에는 BST막 내의 탄소 제거나 산소 결핍 결함을 제거하기 위해 후속 열처리 공정으로 UV-O3처리나, O2또는 N2O 가스를 사용한 플라즈마 처리를 실시해 왔다. UV-O3처리의 경우 활성화된 산소를 유지하기 위해 준상압 혹은 상압 상태에서 공정이 이루어져야 하므로 높은 압력에서 옥시던트(Oxidant)의 평균 자유 행로가 짧아 라이프 타임(Life Time)이 짧아지므로 이를 극복하기 위해서는 UV-램프와 웨이퍼 간격이 극단적으로 가까워야하며 또한 정밀하게 조절되어야 하므로 여러 가지 공정상의 제약이 따른다. 또한, O2또는 N2O 가스를 사용한 플라즈마 처리의 경우, O2가스는 N2O 가스에 비해 활성화되기 어렵기 때문에 N2O 가스에 비해 BST 박막의 처리 효과가 떨어지며, N2O 가스를 플라즈마로 여기시키게 되면 분해되어 산소와 질소 이온이 생성되어 탄소 제거와 산소 결핍을 제거하나, 질소 이온에 의해 BST 박막에 손상(Damage)을 줄 가능성이 있어 전기적 특성의 열화를 수반할 우려가 있다.
본 발명은 상기와 같은 종래기술의 문제점을 해결하기 위하여 제안된 것으로, BST막 증착 후 박막 내에 포함된 탄소 및 박막 증착시 유발된 산소 결핍 결함을 효과적으로 제거할 수 있는 반도체 소자의 고유전체 캐패시터 제조방법을 제공하는데 그 목적이 있다.
도 1a 내지 도 1c는 본 발명의 일 실시예에 따른 BST 캐패시터 제조 공정도.
* 도면의 주요 부분에 대한 부호의 설명
20 : 폴리실리콘 플러그
21 : Ti/TiN막
22, 24 : Pt막
23 : BST 박막
상기의 기술적 과제를 달성하기 위한 본 발명의 일 측면에 따르면, 소정의 하부층 상에 하부전극용 전도막을 형성하는 제1 단계; 상기 하부전극용 전도막 상부에 BST막을 형성하는 제2 단계; 오존 가스를 사용하여 상기 BST막을 플라즈마 처리하는 제3 단계; 및 상기 BST막 상부에 상부전극용 전도막을 형성하는 제4 단계를 포함하여 이루어지며, 상기 플라즈마 처리는, 10000ppm 내지 2000000ppm의 오존 가스를 사용하며, 50Watt 내지 400Watt의 RF 전원, 10torr 내지 900torr의 압력, 100℃ 내지 500℃의 서브 히터 온도 조건을 사용하여 1분 내지 20분 동안 수행하는 것을 특징으로 하는 반도체 소자의 고유전체 캐패시터 제조방법이 제공된다.
본 발명은 반응성이 좋은 O3가스를 사용하여 플라즈마를 형성하고, BST 박막을 플라즈마 처리함으로써 박막내에 존재하는 탄소 및 산소 결핍 결함을 효과적으로 제거할 수 있는 기술이다. O3가스를 사용한 플라즈마 처리를 통해 종래의 UV-O3처리시 문제가 되었던 활성화된 산소의 라이프 타임을 길게 가져갈 수 있어 공정의 난이도를 증가시키거나 캐패시터의 전기적 특성을 열화시키지 않으면서 BST 박막 내의 탄소 및 산소 결함을 제거할 수 있다. 본 발명은 또한, O3가스를 사용한 플라즈마 처리를 최적화할 수 있는 상세 공정 조건을 제안한다.
이하, 본 발명이 속한 기술분야에서 통상의 지식을 가진 자가 본 발명을 보다 용이하게 실시할 수 있도록 하기 위하여 본 발명의 바람직한 실시예를 소개하기로 한다.
첨부된 도면 도 1a 내지 도 1c는 본 발명의 일 실시예에 따른 BST 캐패시터 제조 공정을 도시한 것으로, 이하 이를 참조하여 그 공정을 살펴보기로 한다.
우선, 소정의 하부층 공정을 마친 기판 상에 층간절연막을 증착하고, 이를 선택 식각하여 콘택홀을 형성한 다음, 도 1a에 도시된 바와 같이 폴리실리콘 플러그(20)를 형성한다. 이하의 도면은 주요부에 국한하여 간략화 하였다. 이어서, 폴리실리콘 플러그 표면에 형성된 자연산화막을 제거하고, 전체구조 상부에 Ti/TiN막(21)을 실온∼700℃, 0.2torr∼10torr에서 100Å∼500Å 두께로 증착한다. 계속하여, Ti/TiN막(21) 상에 하부전극 재료인 Pt막(22)을 실온∼500℃ 온도에서 1000Å∼2000Å 두께로 증착한다.
다음으로, 도 1b에 도시된 바와 같이 600℃∼800℃, 0.1torr∼2torr에서 BST 박막(23)을 증착한 다음, 후속 열공정으로 O3가스를 사용하여 BST 박막(23)을 플라즈마 처리한다. 이때, O3가스를 사용한 플라즈마 처리는 다음과 같은 조건으로 실시한다.
가. 챔버 내의 압력을 10torr∼900torr로 유지한다.
나. 웨이퍼 하부의 서브 히터(sub heater) 온도를 100℃∼500℃로 유지한다.
다. RF(radio frequency) 전원(power)을 50Watt∼400Watt 범위로 설정한다.
라. RF 전원 인가시 서브 히터를 접지로 하고, 샤워 헤드(shower head)를 전극으로 한다.
마. O3처리시간을 1분∼20분으로 설정한다.
바. O3농도는 10000ppm∼200000ppm으로 설정한다.
이어서, 도 1c에 도시된 바와 같이 상부전극 재료로서 Pt막(24)을 실온∼500℃ 온도에서 1000Å∼2000Å 두께로 증착한다.
이상에서 설명한 본 발명은 전술한 실시예 및 첨부된 도면에 의해 한정되는 것이 아니고, 본 발명의 기술적 사상을 벗어나지 않는 범위 내에서 여러 가지 치환, 변형 및 변경이 가능하다는 것이 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자에게 있어 명백할 것이다.
예를 들어, 전술한 실시예에서는 단순 스택형 캐패시터를 제조하는 공정을 일례로 들어 설명하였으나, 본 발명은 실린더 구조, 핀 구조 및 반구형 실리콘이 응용된 복잡한 구조에도 적용될 수 있다.
또한, 전술한 실시예에서는 하부전극 및 상부전극의 패터닝 공정을 설명하지 않았으나, 본 발명은 캐패시터의 패터닝 공정 순서에 관계없이 적용될 수 있다.
전술한 본 발명은 O3가스를 사용한 BST 박막의 플라즈마 처리를 통해 박막 내의 탄소 및 산소 결핍 결함을 효율적으로 제거할 수 있으며, 이에 따라 고유전체 박막의 막질을 향상시켜 누설전류 특성을 향상시키고 캐패시터의 전기적 특성을 개선하는 효과가 있다.

Claims (1)

  1. 소정의 하부층 상에 하부전극용 전도막을 형성하는 제1 단계;
    상기 하부전극용 전도막 상부에 BST막을 형성하는 제2 단계;
    오존 가스를 사용하여 상기 BST막을 플라즈마 처리하는 제3 단계; 및
    상기 BST막 상부에 상부전극용 전도막을 형성하는 제4 단계를 포함하여 이루어지며,
    상기 플라즈마 처리는,
    10000ppm 내지 2000000ppm의 오존 가스를 사용하며, 50Watt 내지 400Watt의 RF 전원, 10torr 내지 900torr의 압력, 100℃ 내지 500℃의 서브 히터 온도 조건을 사용하여 1분 내지 20분 동안 수행하는 것을 특징으로 하는 반도체 소자의 고유전체 캐패시터 제조방법.
KR1019980058594A 1998-12-24 1998-12-24 반도체소자의고유전체캐패시터제조방법 KR100326269B1 (ko)

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