JPS649676B2 - - Google Patents

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JPS649676B2
JPS649676B2 JP55118858A JP11885880A JPS649676B2 JP S649676 B2 JPS649676 B2 JP S649676B2 JP 55118858 A JP55118858 A JP 55118858A JP 11885880 A JP11885880 A JP 11885880A JP S649676 B2 JPS649676 B2 JP S649676B2
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JP
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word
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Masato Tanaka
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Sony Corp
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Publication date
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Priority to BR8105461A priority patent/BR8105461A/pt
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Publication of JPS649676B2 publication Critical patent/JPS649676B2/ja
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Description

【発明の詳細な説明】 本発明は、PCMオーデイオ信号の編集に適用
して好適な電子編集方法に関する。
PCMオーデイオ信号を記録する場合、記録再
生のプロセスで生じるドロツプアウト等によるバ
ーストエラーに対処するために、ワード単位の
PCMデータ及びエラー訂正用の冗長コードの配
列の並べ変え（インタリーブと称する）が行なわ
れる。
このようなコード化を行なう装置の簡単な一例
を第１図に示す。第１図において、１で示す入力
端子に１チヤンネルのオーデイオ信号が供給さ
れ、PCM変調部２によりPCMオーデイオ信号に
変換される。PCM変調は、サンプリングホール
ド回路の出力の１サンプルをＡ／Ｄ変換器によつ
て１ワードWiに変換する構成とされている。
PCM変調部２から得られるPCMオーデイオ信号
が分配回路３に供給され、４個のPCMデータ系
列W(0)，W(1)，W(2)，W(3)に分割される。各デー
タ系列には、下記のようなワードが含まれる。
W(0)＝（W0，W4，W8………） W(1)＝（W1，W5，W9………） W(2)＝（W2，W6，W10………） W(3)＝（W3，W7，W11………） これらのPCMデータ系列の夫々から取り出さ
れた４ワードが（mod.2）の加算器（図では、○
印で表わす）に供給され、パリテイデータ系列
P(0)を形成する各パリテイワードPiが生成される。
例えば（P0＝W0W1W2W3）であり、この
ようなパリテイワードとこれを生成する４ワード
とが１符号ブロツクを構成する。
これらのデータ系列がインタリーバ４に供給さ
れ、インタリーブされる。インタリーバ４は、互
いにＤ（単位：ブロツク）ずつ異なる０，Ｄ，
2D，3D，4Dの各遅延量を有する遅延回路を含ん
でいる。実際には、RAMでもつてインタリーバ
４が構成され、RAMの書込みブロツクアドレス
と読出しブロツクアドレスとが制御されることに
より上述の遅延量が付与され、その場合には、分
配回路３及び次段の合成回路５は特に必要としな
い。
インタリーバ４によつて所定量遅延されたデー
タ系列W(0)，W(1)′，W(2)′，W(3)′P(0)′が合成回路
５
に供給され、各データ系列から取り出された５ワ
ード毎が１ブロツクとなされてCRC発生器６に
供給され、この５ワードに対するCRCコードが
付加される。CRCコードは、一種のエラー検出
コードを形成する巡回コードである。CRC発生
器６の出力が同期混合回路７に供給され、出力端
子８には、第２図に示すような配列の信号が現れ
る。CRCコードは、W(0)〜P(0)′の各系列の５ワー
ドをエラー検出の対象としており、これらの同期
信号、５ワードのデータ及びCRCコードを１伝
送ブロツクと称する。CRCは、１伝送ブロツク
単位でエラー検出を行ない、その一部でもエラー
を含むときには、この１伝送ブロツクの全てのデ
ータがエラーワードとして検出される。図示を省
略するが、出力端子８には、変調器、記録アン
プ、記録ヘツドが接続されており、上述の信号が
磁気テープの長手方向にのびるトラツクに記録さ
れる。
上述のようなコード化を行つている場合、磁気
テープのトラツクにおいて、ある特定の符号ブロ
ツクを構成する５ワードは、第３図に示すよう
に、Ｄ毎の距離をおいて記録されている。この符
号ブロツクの全てのワードが記録されるのに必要
な長さを符号系列長CLとすると、Ｎワードの
PCMデータ及びｎワードのパリテイデータで１
符号ブロツクが構成されるときには、CL＝（Ｎ＋
ｎ−１）Ｄとなり、上述の例では、（CL＝4D）
となる。そして、パリテイワードをエラー訂正に
用いることで、１符号ブロツク内の１ワードのエ
ラーは訂正可能であり、インタリーブが施されて
いるために、Ｄ以下の長さのバーストエラーは訂
正可能となる。
ところで、固定ヘツド式のPCM録音機には、
既に記録されているPCMデータに新たなPCMデ
ータを接続するようにトラツクを書き換える電子
編集機能が設けられており、編集モードにはアツ
センブル編集やインサート編集などがある。この
ような電子編集を行なう場合、録音機の機械的な
ジツタやテープの伸び縮みなどが存在するため、
記録状態の開始点又は終了点では、既に記録され
ているPCMデータと新たに記録されたPCMデー
タとがワード精度で正しく接続されることが少な
く、既に記録されているブロツクに一部が重なる
ように新たなブロツクが記録されると、既に記録
されているブロツクの数ワードが消滅するため、
それらのワードはエラーとなり、既に記録された
ブロツクに重なつて新たに記録されたワードも、
既に記録されていたワードに見誤られるためエラ
ーとなる。
また、記録開始時及び記録最終時に記録電流が
不安定であると、その過渡状態において、記録さ
れるワードにエラーが生じることが避けられな
い。このエラーが１個所だけで生じるときには、
そのエラーワードはエラー訂正符号によつて訂正
することができるが、略々同一個所で何度も編集
が行われると、その際の記録状態の開始点又は終
了点が必ずしも同一個所でないため、同一の符号
ブロツク内に多数のエラーが生じて訂正不能にな
る。
第３図の例において、１回目の編集で、例えば
カツトインによりワードW2がエラーワードとな
り、さらに編集のやり直しが必要になつて２回目
の編集のカツトインでワードW3がエラーワード
となると、同一符号ブロツク内に２ワードのエラ
ーワードが生じるため訂正不能となつてしまう。
本発明は、上述のように、略々同一の点で何回
も編集をやり直したり、細かくつないで編集する
ときに、エラー訂正符号の同一の符号ブロツクに
ついて多数のエラーが発生し、訂正不能となる欠
点を除去するようにしたものである。
本発明では、電子編集のための記録の開始又は
終了が可能な点（以下、カツトイン／アウト点と
称する）を制限することにより、編集の結果、訂
正不能となるようなエラーが発生することを防止
するようにしたものである。本発明は、ｍ重エラ
ー訂正可能なエラー訂正コードとインタリーブと
を用いている場合において、カツトイン／アウト
によつて（ｍ＋１）以上のエラーを生じないよう
に、記録されているデータ系列のインタリーブと
の関連でカツトイン／アウト点を示す制御信号を
発生するようにしたものである。
前述のように、（ｍ＝１）で（CL＝4D）のコ
ード化がなされている場合を例にして本発明の基
本的一例を説明すると、記録されているデータ系
列（第４図Ａ）に対して第４図Ｂに示すように、
符号系列長CLより大きい間隔Ｔをもつようにカ
ツトイン／アウト点の系列を限定する。この系列
は、必ずしも等間隔でなくてもよい。
本発明の他の基本例は、単位遅延量Ｄでもつて
規則的に符号ブロツクの各ワードが離れるインタ
リーブに対して適用されるもので、記録されてい
るデータ系列の単位遅延量Ｄとカツトイン／アウ
ト点の系列の間隔Ｔとの最小公倍数を符号系列長
CLより大とするものである。この関係に間隔Ｔ
を選ぶと、第５図Ａ及びＢに示すように、同一符
号ブロツクに属する各ワードとカツトイン／アウ
ト点とが重なる部分を１ワードにおさえることが
できる。
以下、本発明の一実施例について説明する。第
６図に示すように、この例では、1/4インチ幅の
磁気テープ９に対して、８本のデータトラツク
TD0〜TD7と２本のアナログトラツクTA1，TA2
とコントロールトラツクTCとタイムコードトラ
ツクTTとを形成するようにしている。この８本
のデータトラツクTD0〜DT7には、CH1〜CH8
の計８チヤンネルの各PCMオーデイオ信号を所
定のコード化によつて記録する。
第７図Ａに示すように、データトラツクTD
（TD0〜TD7）とコントロールトラツクTCとは、
互いの記録位置が１セクターを単位として幅方向
で一致している。データトラツクTDの１セクタ
ー内には、４ブロツクのデータが含まれる。第７
図Ｂに示すように、１ワードを16ビツトとする16
ワードのデータと、その最初に付加されたデータ
同期信号（斜線で示す）と、その終わりに付加さ
れたCRCコードとによつて１伝送ブロツク（単
に１ブロツクと称する）が構成されている。デー
タ同期信号区間には、３ビツトのブロツクアドレ
ス信号が挿入されており、このブロツクアドレス
信号とデータとの両者がCRCによるエラー検出
の対象とされている。
また、コントロールトラツクTCの１セクター
は、４ビツトの同期信号（斜線区間で示す）と、
16ビツトのコントロールワードと、28ビツトのセ
クターアドレス信号と、16ビツトのCRCコード
とから構成されている。コントロールワードは、
記録されるPCMオーデイオ信号のサンプリング
周波数、記録フオーマツトの判別用のもので、セ
クターアドレスは、０番地から歩進する絶対番地
であり、このコントロールワード及びセクターア
ドレスがCRCによるエラー検出の対象とされて
いる。データトラツクTDに記録するための変調
法としては、3PM方式などの高密度記録が可能
なものが用いられ、コントロールトラツクTCに
記録するための変調法としては、FM方式などの
ものが用いられる。セクターアドレス信号の最下
位ビツトS0がそのセクター内に含まれる４ビツト
の各ブロツクアドレス信号の最上位ビツトと一致
するようにされている。つまり、ブロツクアドレ
ス〔B2B1B0〕は、そのセクター内において、
〔S000〕〔S001〕〔S010〕〔S011〕と順次変化する。
第８図に示すように、磁気テープ９の走行方向
に対して記録ヘツドHR、再生ヘツドHP、記録
ヘツドHR′が順次位置するようなヘツド配置とさ
れている。各ヘツドは、磁気テープ９の幅方向に
インラインに配列された10個の記録又は再生用の
磁気ギヤツプを有しており、そのうちの８個がデ
ータトラツクTD0〜TD7と対応し、他の２個がコ
ントロールトラツクTC及びタイムコードトラツ
クTTと夫々対応している。磁気テープ９に対す
る最初の記録は、記録ヘツトHRによりなされ、
シンク録音、カツトイン／アウトなどのときは、
記録ヘツドHR′が用いられる。記録ヘツドHRに
よつて一旦形成されたコントロールトラツクTC
は、書き換えがなされず、データトラツクのみが
書き換えられる。
第９図は、記録系の構成を示し、第１０図は、
再生系の構成を示している。記録系においては、
入力端子１０ａ〜１０ｈの夫々から、CH1〜
CH8のPCMオーデイオ信号がエンコーダ１１ａ
〜１１ｈに供給される。エンコーダ１１ａ〜１１
ｈの夫々は、インタリーブ回路、パリテイ発生回
路、CRC付加回路、同期信号付加回路等を備え、
（Ｎ＝６，ｎ＝２）の符号ブロツクを形成する。
エンコーダ１１ａ〜１１ｈからのデータ系列がデ
マルチプレクサ１２に供給され、デマルチプレク
サ１２から現われる８個のデータ系列が夫々変調
器１３ａ〜１３ｈ、記録アンプ１４ａ〜１４ｈを
介して記録ヘツドHR0〜HR7に供給される。記
録ヘツドHR0〜HR7は、磁気テープ９の幅方向
にインラインに配設されている。この例のよう
に、複数チヤンネルのPCMオーデイオ信号を１
チヤンネル当り各１本のトラツクに記録するとき
には、デマルチプレクサ１２は必要ないが、１チ
ヤンネル当りの占有トラツク数を２本或いは４本
とするような他の記録フオーマツトのときには、
デマルチプレクサ１２によるデータの分配が必要
となる。
また、コントロールトラツクTCには、前述の
ような信号が記録コントロールヘツドHRcによ
つて記録される。コントロールトラツクTCに記
録される信号は、端子１５からのタイミング信
号、判別信号にもとづいてコントロールエンコー
ダ１６において形成され、変調器１７、記録アン
プ１８を介して記録コントロールヘツドHRcに
供給される。コントロールエンコーダ１６におい
て形成されるフオーマツト指定信号を用いてデマ
ルチプレクサ１２の動作モードが切換えられる。
再生系においては、磁気テープ９のデータトラ
ツクTD0〜TD7の夫々と対接する再生ヘツドHP0
〜HP7と、コントロールトラツクTCと対接する
再生コントロールヘツドHPcとが設けられてい
る。第１０図に示すように、再生ヘツドHP0〜
HP7，HPcの各出力が再生アンプ１９ａ〜１９
ｈ，２０を介してクロツク抽出回路２１ａ〜２１
ｈ，２２に供給される。クロツク抽出回路２１ａ
〜２１ｈの出力が、復調器２３ａ〜２３ｈを介し
て、TBC（時間軸補正装置）２４ａ〜２４ｈに供
給される。クロツク抽出回路２２からの出力が復
調器２６に供給され、再生コントロール信号が得
られ、これがコントロールデコーダ２７に供給さ
れる。
コントロールデコーダ２７からキヤプスタンサ
ーボ用の信号、マルチプレクサ２５の動作モード
を記録フオーマツトに従つて制御する信号と共
に、TBC２４ａ〜２４ｈのメモリーに対する書
込みクロツクが発生する。コントロールトラツク
TC及びデータトラツクTD0〜TD7の夫々に記録
されているセクターアドレス及びブロクアドレス
を用いて、TBC２４ａ〜２４ｈのメモリーの書
込みアドレスを規定するようになされる。TBC
２４ａ〜２４ｈの読出しは、端子２８からの基準
のクロツクパルスによつて行なわれ、TBC２４
ａ〜２４ｈの出力には、時間軸変動分が除去され
たデータ系列が現れる。このTBC２４ａ〜２４
ｈの出力系列がマルチプレクサ２５に供給され
る。マルチプレクサ２５は、８本のデータトラツ
クからの再生データを所定数のチヤンネルのデー
タ系列に戻すもので、各チヤンネルのデータ系列
がデコーダ２９ａ〜２９ｈに供給される。デコー
ダ２９ａ〜２９ｈの夫々は、CRCチエツカ、デ
インタリーブ回路、エラー訂正回路、エラー補正
回路等を備えており、出力端子３０ａ〜３０ｈに
再生PCMオーデイオ信号が現れる。
記録系に設けられたエンコーダ１１ａ〜１１ｈ
は、夫々同様の構成とされており、第１１図にそ
の一例を示す。端子３１から各ワードWiが連続
している１チヤンネルのPCMデータ系列が偶奇
分配回路３２に供給され、12個のデータ系列に分
けられる。この場合、奇数番目のワードからなる
データ系列W(1)，W(3)，W(5)，W(7)，W(9)，W(11)
と偶数番目のワードからなるデータ系列W(2)，
W(4)，W(6)，W(8)，W(10)，W(12)とに分離される。
奇数番目のワードからなるデータ系列と、偶数番
目のワードからなるデータ系列とは、夫々別個に
エラー訂正コード化がなされる。これらのデータ
系列には、下記のようなワードが含まれる。
W(1)＝（W1，W13，W25………） W(3)＝（W3，W15，W27………） ： W(10)＝（W11，W23，W35………） W(2)＝（W2，W14，W26………） W(4)＝（W4，W16，W28………） ： W(12)＝（W12，W24，W36………） 奇数番目のワードからなるデータ系列W(0)〜
W(11)から取り出された６ワードを（mod.2）の加
算器に供給することで、第１のパリテイデータ系
列P(0)を形成する各パリテイワードPiが生成され
る。例えば（P1＝W1W3W5W7W9
W11）である。これらのデータ系列がインタリー
バ３３Ａに供給される。インタリーバ３３Ａは、
単位遅延量をｄ（単位：ブロツク）とすると、０，
ｄ，2d，3d，5d，6d，7dの各遅延量を有する遅
延回路を備え、パリテイデータ系列P(0)に対して
は3dの遅延量が付加される。このインタリーバ
３３Ａによつて所定量遅延されたデータ系列
W(1)，W(3)′，W(5)′，P(1)′，W(7)′，W(9)′，W(11
)′の
夫々から取り出された各ワードが（mod.2）の加
算器に供給され、第２のパリテイデータ系列Q(1)
を形成する各パリテイワードQiが生成される。
この６個のデータ系列W(1)〜W(11)′とパリテイデ
ータ系列P(1)′Q(1)とがインタリーバ３４Ａに供給
される。インタリーバ３４Ａは、０，（Ｄ―ｄ），
２（Ｄ―ｄ）…７（Ｄ―ｄ）の各遅延量を有する遅
延回路を備えており、パリテイデータ系列P(1)′，
Q(1)に対しては、３（Ｄ―ｄ），４（Ｄ―ｄ）の遅
延量が割当てられている。このインタリーバ３４
Ａから得られるW(1)，W(3)″，W(5)″，P(1)″，Q(1)′
，
W(7)″，W(9)″，W(11)″の計８個のデータ系列が合
成回路３５に供給される。
上述のインタリーブ回路は、２個のインタリー
バ３３Ａ，３４Ａが縦続接続され、各系列に対す
る遅延量０，Ｄ，2D……7Dが分割され、この分
割点に現れる各データ系列から取出されたワード
からパリテイワードが形成されるもので、クロス
インタリーブと称されている。単位遅延量ｄ，Ｄ
の値は、Ｄと（Ｄ―ｄ）との最小公倍数が符号系
列長CL＝7Dを越えるものとなるように選ばれ、
これによつて第１のパリテイワードを含む符号ブ
ロツクに含まれる複数ワードと、第２のパリテイ
ーワードを含む符号ブロツクに含まれる複数のワ
ードのうち、両方の符号ブロツクに重複して含ま
れるワードが１ワードしかないようにされてい
る。一例として、（ｄ＝２）（Ｄ＝17）とされてお
り、その17と15の最小公倍数255は符号系列長105
を越えるものとなる。
偶奇分配回路３２からはの偶数ワードからなる
PCMデータ系列W(2)〜W(12)は、縦続接続された
インタリーバ３３Ｂ，３４Ｂと（mod.2）の加算
器とによつて上述と同様のクロスインタリーブを
用いたエラー訂正コード化がされている。そして
コード化されたデータ系列の各々をＫ（単位：ブ
ロツク）遅延させる遅延回路３６に供給され、そ
の出力に現れるデータ系列W(2)，W(4)″，W(6)″，
P(2)″，Q(2)′，W(8)″，W(10)″，W(12)″が合成回路
３
５に供給される。このように偶数番目のワードか
らなるデータ系列を一様にＫ遅延させるのは、ス
プライス編集を行なつた場合に、編集点付近でエ
ラーが多発するときでも、エラー訂正或いは補正
を効果的に行なうためである。
以上のようなコード化がなされたデータ系列が
合成回路３５に供給され、各系列から取り出され
た12ワードのPCMデータと４ワードのパリテイ
データとが１ブロツクのデータとなされ、CRC
発生器３７においてCRCコードが付加され、出
力端子３８に取り出される。出力端子３８には、
図示を省略するが、同期付加回路が設けられてお
り、第１２図に示すような信号構成を１ブロツク
とする信号が形成される。
上述の本発明の一実施例において、奇数番目の
PCMワードからなるデータ系列と偶数番目の
PCMワードからなるデータ系列とは、別個のコ
ード化が行なわれているから、その一方例えば奇
数データ系列に注目した場合、インタリーブの態
様は、第１３図及び第１４図によつて説明され
る。インタリーブされた出力として、第１３図に
示すように〔W1W3″W5″P1″Q1′W7″W9″W11″〕の
データが現れるタイミングを基準とすると、
PCMワードW1を含む符号ブロツクは、○印で示
す複数ワードと×印で示す複数ワードとによつて
形成される。つまり、パリテイワードP1を生成
する符号ブロツクは、〔W1W3W5P1W7W9〕であ
り、パリテイワードQ1を生成する符号ブロツク
は、〔W1，W3′，W5′P1′Q1W7′W9′W11′〕である。
磁気テープに記録されたときのこれらの符号ブロ
ツクを生成する複数ワードは、第１４図Ａに示す
ように、（Ｄ＝17ブロツク）又は（Ｄ―ｄ＝15ブ
ロツク）毎の間隔で分布する。このようなクロス
インタリーブにおいて、符号系列長CLは、（7D
＝119ブロツク）となる。
また、再生系に設けられたデコーダ２９ａ〜２
９ｈは夫々同様の構成とされており、第１５図に
その一例を示す。端子３９から再生データ系列が
供給され、CRCチエツカ４０で各伝送ブロツク
毎にエラー検出がなされ、その検出結果が１ビツ
トのポインタとして各ワード毎に付加される。そ
して分配回路４１に供給され、６個のPCMデー
タ系列W(1)〜W(11)″及び２個のパリテイデータ系
列P(1)″Q(1)′の組と、他の６個のPCMデータ系列
W(2)〜W(12)″及び２個のパリテイデータ系列
P(2)″Q(2)′の組とに分けられ、夫々が別個にエラー
訂正される。
まず、奇数番目のワードを関連するデータ系列
が遅延回路４２に供給されることにより、遅延回
路３６による遅延量をキヤンセルするように、一
様にＫだけ遅延されてからデインタリーバ４３Ａ
に供給される。デインタリーバ４３Ａは、インタ
リーバ３４Ａにより付加された遅延量をキヤンセ
ルするように、７（Ｄ―ｄ），４（Ｄ―ｄ），５（Ｄ
―ｄ）…０の遅延量を各データ系列に対して与え
る。このデインタリーバ４３Ａの出力系列がＱデ
コーダ４４Ａに供給され、第２のパリテイデータ
系列Q(1)を用いたエラー訂正がなされる。この
Q(1)を除く他のデータ系列がデインタリーバ４５
Ａに供給される。記録系のインタリーバ３３Ａで
与えられた遅延量をキヤンセルするように、7d，
6d…０の各遅延量をデータ系列に与えるように、
デインタリーバ４５Ａが構成され、その出力系列
がＰデコーダ４６Ａに供給されて、第１のパリテ
イデータ系列P(1)を用いたエラー訂正がなされる。
Ｑデコーダ４４Ａ及びＰデコーダ４６Ａにおける
エラー訂正によつて、訂正がなされたワードに関
するポインタは、エラーがないことを示すものに
クリアされる。このＰデコーダ４６Ａの出力に
は、奇数番目のワードからなるPCMデータ系列
W(1)〜W(11)が現れる。
偶数番目のワードからなるPCMデータ系列及
びこれと関連するパリテイデータ系列W(2)〜
W(12)″についても、デインタリーバ４３Ｂ、Ｑデ
コーダ４４Ｂ、デインタリーバ４５Ｂ、Ｐデコー
ダ４６Ｂが設けられて、Ｐデコーダ４６Ｂの出力
にエラー訂正がなされたPCMデータ系列が得ら
れる。そしてＰデコーダ４６Ａ，４６Ｂから現れ
るPCMデータ系列W(1)〜W(12)が補正回路４７に
供給され、訂正できなかつたエラーワードがその
前後に位置する正しいワードの平均値でもつて補
間される。この補正回路４７の出力が偶奇合成回
路４８に供給され、出力端子４９にPCMオーデ
イオ信号が得られる。Ｑデコーダ４４Ａ，４４Ｂ
とＰデコーダ４６Ａ，４６Ｂとを設けたことで、
２度のエラー訂正を行なうことができる、エラー
訂正能力を向上させることができる。
上述のようなクロスインタリーブによるエラー
訂正コード化を採用しているPCM記録再生装置
に本発明を適用して電子編集を行なう場合の構成
を第１６図に示す。説明の簡単のため、１チヤン
ネルのPCMオーデイオ信号が１本のトラツク
TD0として記録されている場合であつて、このト
ラツクTD0についてインサート編集を行なうもの
とする。
記録ヘツドHR0′とこれにより先行する再生ヘ
ツドHP0（第８図参照）とが用いられ、再生ヘツ
ドHP0から、エラー訂正コード化されて記録され
ているPCMオーデイオ信号が再生され、前述の
再生系５０（第１０図及び１５図参照）で誤り訂
正が行われ、デインタリーブが行われ後、遅延回
路５１を介してクロスフエーダ５２の一方の入力
端子に供給される。クロスフエーダ５２の他方の
入力端子には、インサートされるべき新たな
PCMオーデイオ信号が端子５３から供給される。
この新たなPCMオーデイオ信号は、他のPCM信
号記録再生装置によつて再生されるか、又は同一
のPCM信号記録再生装置によつて同一磁気テー
プの他のトラツクから再生される別チヤンネルの
PCMオーデイオ信号であり、上述と同様に誤り
訂正が行われ、デインタリーブが行われている。
クロスフエーダ５２の出力が前述の記録系５４
（第１０図及び１５図参照）でエラー訂正コード
化されて、インタリーブが行われた後、記録ゲー
ト回路５５を介して記録ヘツドHR0に供給され
る。再生ヘツドHP0と記録ヘツドHR0′との間の
距離に相当する時間の遅延量が遅延回路５１によ
り補償されており、したがつて再生ヘツドHP0の
出力を再生系５０と遅延回路５１とクロスフエー
ダ５２と記録系５４と記録ゲート回路５５とを介
して記録ヘツドHR0′に加えて記録したときには、
元から記録されているのと全く同一の信号が再記
録されることになる。
クロスフエーダ５２は、α及び（１−α）の係
数を夫々発生する係数発生器と、２つの入力
PCM信号にα及び（１−α）を夫々乗ずる乗算
器と、この乗算器の出力を加え合せて出力する加
算器とから構成されている。端子５６から供給さ
れるクロスフエーダ制御パルスP1が“１”の区
間で係数αが０から１に徐々に増大し、係数（１
−α）が１から０に徐々に減少するように動作す
る。この制御パルスP1は、端子５７からの記録
制御指令P2の立上り及び立下りの直後に発生す
る。記録制御指令P2は、“１”が記録状態と対応
するように形成されている。
また、この実施例では、オン／オフ制御パルス
CRRを32ブロツク毎に発生させる。つまり、ク
ロスインタリーブの第１のパリテイワードP1を
生成するワード及びその第１のパリテイワード
W1，W3，W5，P1，W7，W9，W11は、第１４図
Ａに示されるようにＤ（＝17）ブロツク毎（第２
のパリテイデータQ1は第１のパリテイデータP1
を生成するワードに含まれないため、P1とW7と
の間は2Dブロツク離れている。）に分布し、ワー
ドW1を共通に含む第２のパリテイワードQ1を生
成するワード及びその第２のパリテイワードW1，
W3，W5，P1，Ｑ，W7，W9，W11は、Ｄ―ｄ（＝
15）ブロツク毎に分布しているから、17との最小
公倍数及び15との最小公倍数が、夫々の符号系列
長7D＝119及び７（Ｄ―ｄ）＝105より大となるよ
うな数、例えば８，11，13，14，16，19，22，
23，24，26，28，29，31，32，33，……ブロツク
毎に、制御パルスCRRを発生させる。制御パル
スCRRは複数回の編集の度に、テープ上で常に
同一タイミングで発生しなければならないから、
セクターアドレスに同期させる必要があり、以下
に述べるように回路構成を簡単するために、セク
ター周期の整数倍（４の倍数）、例えば、32ブロ
ツクに設定する。このように設定すれば、第１４
図Ｂに示されるように、W1が含まれ伝送ブロツ
クと制御パルスCRRとが一致しているときに、
ワードW1を含む夫々の誤り訂正ブロツクに含ま
れる他の何れのワードが含まれる伝送ブロツクも
制御パルスと同一タイミングとならない。然も、
（2D＝34）、２（Ｄ―ｄ）＝30であるから、制御パ
ルスCRRと、ワードW1を含む夫々の誤り訂正ブ
ロツクに含まれる他のワードが含まれる伝送ブロ
ツクとは、少なくとも２ブロツクの間隔が存在す
ることにより、磁気テープの伸び、ジツタなどに
よつて制御パルスCCRと記録されているデータ
との関係に誤差が生じても、これを許容できる。
そこで本実施例では、制御パルスCCRを32ブ
ロツク毎に発生させるために、以下のように構成
されている。クロツク発生器５８よりセクター周
期のクロツクパルスCP1とブロツク周期のクロツ
クパルスCP2とが発生する。カウンタ５９は５ビ
ツトのバイナリカウンタであつて、そのクロツク
端子にクロツクパルスCP2が32個供給されるとオ
ン／オフ制御パルスCRRが１個発生する。カウ
ンタ５９のプリセツト入力には２ビツトの“０”
と再生セクターアドレスの下位３ビツト
〔S2S1S0〕が供給され、それらがすべて“０”に
なる８セクター毎に、５ビツトの“０”がプリセ
ツトされるようになされている。１セクターは４
ブロツクであるから、従つて、カウンタ５９は８
セクター、即ち32ブロツク毎に１回の割合でプリ
セツトされ、制御パルスCRRは32ブロツク毎に
セクターアドレスと常に一定の関係で発生する。
なお、コントロールトラツクTCに記録されてい
る同期信号が再生コントロール信号として分離さ
れ、クロツクパルスCP1と再生コントロール信号
とが、図示を省略したキヤプスタンサーボ回路に
供給され、クロツクパルスCP1にテープ走行がロ
ツクするようなサーボがかけられている。
また、クロスフエーダ制御パルスP1と、これ
を遅延回路６０で遅延してなるパルスP3と、記
録制御指令P2とがオアゲート６１に供給され、
オアゲート６１の出力がＤフリツプフロツプ６２
の入力端に供給される。このＤフリツプフロツプ
６２のクロツク入力端に制御パルスCRRが供給
され、その出力が記録オン／オフパルスP4とし
て取り出される。この記録オン／オフパルスP4
が“１”の区間記録ゲート回路５５がオンして記
録動作がなさこれる。遅延回路６０の遅延量は、
符号系列長CLと等しいものに選ばれている。
上述の構成において、記録制御指令P2が第１
７図Ａに示すように発生した後、クロスフエーダ
制御パルスP1が同図Ｂに示すように発生すると、
第１７図Ｃに示すようなパルスP3が遅延回路６
０から発生する。また同図Ｄに示すようにオン／
オフ制御パルスCRRは、前述のように（Ｔ＝32
ブロツク）の周期で且つ記録されているデータの
特定の位相で発生する。したがつてＤフリツプフ
ロツプ６２から第１７図Ｅに示すように、制御パ
ルスCRRに同期して立上り、パルスP3が“０”
に立下つた後に制御パルスCRRに同期して立下
る記録オン／オフパルスP4が形成されることに
なる。
このような記録オン／オフパルスP4によつて
データトラツクTD0には、第１７図Ｆに示すよう
にデータがインサート編集される。まず、カツト
イン点t1より少し前から先行再生ヘツドHP0より
再生信号を得るようにしておき、パルスP4が
“１”となるt1から記録ゲート回路５５がオンし、
記録ヘツドHR0による記録動作が開始する。ク
ロスフエード動作が開始するとt2までは、上述し
たように元から記録されているものと全く同一の
信号が記録される。続いてt2〜t5までの区間で
は、再生ヘツドHP0から得られた元から記録され
ている信号で徐々にレベルが減少するものと、入
力端子５３に供給される新たに記録される信号で
徐々にレベルが増大するものとが、傾斜した実線
と破線で模式的に示すような混合比で混合されて
なる信号が記録される。このようなクロスフエー
ド処理によつて２つのPCMオーデイオ信号のつ
なぎ目におけるレベル飛びなどの不連続性を目立
たなくすることができる。
もつとも、クロスフエード動作開始点t2からク
ロスインタリーブの符号系列長CL（＝7D）だけ
離れたt3までの区間には、クロスフエードされた
信号と、インタリーブ処理によつて遅延されてい
るクロスフエード動作が開始する以前の信号で元
から記録されていた信号がそのまま記録される信
号との両方が混在して分布しており、、クロスフ
エード動作終了点t4からクロスインタリーブの符
号系列長CL（＝7D）だけ離れたt5までの区間に
は、インタリーブ処理によつて遅延されているク
ロスフエードされた信号と、クロスフエード動作
が終了した後の新たな信号との両方が混在して分
布している。
次に記録制御指令P2がt6において“０”となる
と、第１７図Ｂに示すようにクロスフエーダ制御
パルスP1が“１”となり、クロスフエード動作
がスタートし、（t6〜t8）の間にクロスフエード
動作が行なわれる。また、上述と同様に、クロス
フエード動作開始点t6からクロスインタリーブの
符号系列長CL（＝7D）だけ離れたt9までの区間に
は、クロスフエードされた信号と、インタリーブ
処理によつて遅延されているクロスフエード動作
が開始する以前の信号で新たに記録された信号と
の両方が混在して分布しており、クロスフエード
動作終了点t8からクロスインタリーブの符号系列
長CL（＝7D）だけ離れたt9までの区間には、イン
タリーブ処理によつて遅延されているクロスフエ
ードされた信号と、クロスフエード動作が終了し
た後の元から記録されていた信号がそのまま記録
される信号との両方が混在して分布している。そ
して制御パルスP1とパルスP3とが共に“０”と
なつた直後のオン／オフ制御パルスCRRによつ
て、t10において記録オン／オフパルスP4が“０”
となり、記録ゲート回路５５がオフとなり、記録
動作が終了する。このように、カツトアウト時に
は、クロスフエードされたPCMデータとこれに
関連するパリテイデータとが全て記録されてか
ら、記録動作が解除するようになされる。
２回目以降の編集を行う場合、第１７図Ａ及び
同図Ｂに破線で示すようにクロスフエーダ制御パ
ルスP1とそれに対応する記録制御指令P2を、任
意のタイミングで発生させても、上述したように
制御パルスCRRは常に同一のタイミングで発生
するから、記録オン／オフパルスP4は第１７図
Ｅに破線で示すように制御パルスCRRに同期し
たタイミングで発生し、記録制御指令P2が１回
目の編集時の記録制御指令P2に非常に近いタイ
ミングで発生した場合は、１回目の編集時の記録
オン／オフパルスP4と同じタイミングで発生し、
それ以外の場合は１回目の編集時の記録制御指令
P2と異なるタイミングで発生する。
なお、第１７図において、（t2〜t4）及び（t3〜
t5）の区間（（t6〜t8）及び（t7〜t9）の区間も同
様）は、符号系列長CLが長いとき、即ち、相対
的にクロスフエード期間が短いときでは、必ずし
もオーバーラツプしない。そのような場合では、
P1とP3との間に“０”の区間が生じないような
処理が必要となる。
上述の一実施例の説明から理解されるように、
本発明によれば、複数ワードとこれに関連するエ
ラー訂正コードとによつてブロツクコード化を行
つており、ひとつの符号ブロツクに含まれるこれ
らのデータをインタリーブして記録している場
合、同じ点で何度も編集（カツトイン／アウト）
をやり直しても、編集点における記録及び再生の
切替に伴うエラーが付号のエラー訂正能力を越え
る問題点を防止することができる。上述の一実施
例では、最初の例えばカツトイン動作によつて
PCMワードW1がエラーとなり、PCMワードW1
を含む伝送ブロツクがCRCによりエラーワード
を含むものと判定された場合でも、W1がエラー
ワードとなつたとすると、略々同一箇所で２度目
以降のカツトイン動作を行なうときに、W1と同
一の符号ブロツクに含まれる他のPCMワード或
いはパリテイーワードがエラーワードとならない
ように制御できる。つまり、オン／オフ制御パル
スCRRは、コントロールトラツクTCに記録され
ているセクターアドレスに基いて形成されるの
で、２度目以降の編集においても最初の編集時と
同一位相でもつて発生することになる。セクター
アドレスに限らず、記録されているデータと一定
の関係にある信号（データアドレス、コントロー
ル信号など）を用いてオン／オフ制御パルス
CRRを形成するようにしても良い。
なお、１チヤンネルのPCMオーデイオ信号を
複数本のトラツクに分配して記録する固定ヘツド
式のPCM録音機や回転ヘツド式のPCM録音機対
して本発明を適用しても良い。また、エラー訂正
コードとしては、全加算コード、隣接コード等を
用いることができる。隣接コードのなかには、２
ワードエラーを訂正可能なものがあり、そのよう
なエラー訂正コードを用いるときには、１符号ブ
ロツクのうちで２ワードが記録オン／オフによつ
てエラーワードとなることまでが許容される。
【図面の簡単な説明】
第１図，第２図及び第３図は本発明を適用しう
るPCM録音機の一例のブロツク図、その伝送時
の信号構成及びインタリーブの説明に用いる略線
図、第４図及び第５図の夫々は本発明の基本的な
一例及び他の例の説明に用いる略線図、第６図、
第７図及び第８図は本発明の一実施例を適用した
PCM録音機におけるトラツクパターン、記録フ
オーマツト及びヘツド配置の説明に用いる略線
図、第９図及び第１０図の夫々は本発明の一実施
例を適用したPCM録音機の記録系及び再生系の
構成を示すブロツク図、第１１図は記録系に設け
られるエンコーダの構成を示すブロツク図、第１
２図、第１３図及び第１４図は本発明の一実施例
における伝送時の信号構成及びクロスインタリー
ブの説明に用いる略線図、第１５図は再生系に設
けられるデコーダの構成を示すブロツク図、第１
６図及び第１７図は本発明の一実施例を適用した
PCM録音機の要部のブロツク図及びその動作説
明に用いるタイムチヤートである。 ４，３３Ａ，３３Ｂ，３４Ａ，３４Ｂはインタ
リーバ、９は磁気テープ、１１ａ〜１１ｈはエン
コーダ、２９ａ〜２９ｈはデコーダ、４３Ａ，４
３Ｂ，４５Ａ，４５Ｂはデインタリーバ、５２は
クロスフエーダ、５５は記録ゲート回路、５９は
カウンタ、TD0〜TD7はデータトラツク、TCは
コントロールトラツク、HR，HR′，HR0〜HR7
は記録ヘツド、HP，HP0〜HP7は再生ヘツドで
ある。

Claims (1)

  1. 【特許請求の範囲】 １ 複数ワード毎に符号ブロツク化されて符号ブ
    ロツク毎にｍワードエラー訂正可能なエラー訂正
    コード化され、各符号ブロツクに含まれる複数ワ
    ードが記録媒体の記録手段に対する相対走行方向
    に異なる位置に配置されるように記録されている
    データ系列と上記エラー訂正コード化された新た
    なデータ系列とが接続されるように記録する電子
    編集方法において、 上記記録の開始又は終了の可能な点が上記記録
    媒体の上記相対走行方向に同一の上記符号ブロツ
    クに含まれるｍ＋１以上のワードの記録位置を含
    まないように、記録オン又はオフ制御信号を発生
    するようにしたことを特徴とする電子編集方法。
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