JPH053773B2 - - Google Patents
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- JPH053773B2 JPH053773B2 JP10869883A JP10869883A JPH053773B2 JP H053773 B2 JPH053773 B2 JP H053773B2 JP 10869883 A JP10869883 A JP 10869883A JP 10869883 A JP10869883 A JP 10869883A JP H053773 B2 JPH053773 B2 JP H053773B2
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- JP
- Japan
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- bits
- word
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- words
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- 230000005540 biological transmission Effects 0.000 claims description 9
- 238000005070 sampling Methods 0.000 description 8
- 238000010586 diagram Methods 0.000 description 5
- 238000000034 method Methods 0.000 description 5
- 230000005236 sound signal Effects 0.000 description 4
- 230000006835 compression Effects 0.000 description 3
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- 230000008929 regeneration Effects 0.000 description 3
- 238000011069 regeneration method Methods 0.000 description 3
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Classifications
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B20/00—Signal processing not specific to the method of recording or reproducing; Circuits therefor
- G11B20/10—Digital recording or reproducing
- G11B20/18—Error detection or correction; Testing, e.g. of drop-outs
- G11B20/1806—Pulse code modulation systems for audio signals
- G11B20/1813—Pulse code modulation systems for audio signals by adding special bits or symbols to the coded information
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- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Signal Processing For Digital Recording And Reproducing (AREA)
- Transmission Systems Not Characterized By The Medium Used For Transmission (AREA)
Description
【発明の詳細な説明】
「産業上の利用分野」
この発明は、例えばオーデイオPCMテープレ
コーダに使用して好適なデータ列伝送システムに
関する。
コーダに使用して好適なデータ列伝送システムに
関する。
「背景技術とその問題点」
オーデイオPCMテープレコーダのひとつとし
て、標本化ワードのビツト数を２通り例えば16ビ
ツトと12ビツトとに切替え可能な構成のものがあ
る。音楽信号の録音のためには、サンプリング周
波数が48KHzで、16ビツトリニア量子化が用いら
れ、会話などの録音のためには、サンプリング周
波数が32KHzで、12ビツト折れ線量子化が用いら
れる。この切替を行なうことによつて、記録媒体
としての磁気テープの走行速度を半分とし、テー
プ消費量を少なくすることができる。
て、標本化ワードのビツト数を２通り例えば16ビ
ツトと12ビツトとに切替え可能な構成のものがあ
る。音楽信号の録音のためには、サンプリング周
波数が48KHzで、16ビツトリニア量子化が用いら
れ、会話などの録音のためには、サンプリング周
波数が32KHzで、12ビツト折れ線量子化が用いら
れる。この切替を行なうことによつて、記録媒体
としての磁気テープの走行速度を半分とし、テー
プ消費量を少なくすることができる。
第１図Ａに示すように、16ビツトの３ワード
W1，W2，W3と12ビツトの４ワードW′1，W′2，
W′3，W′4との２つのデータ列のフオーマツトが
生じる時を考える。従来では、16ビツトに関する
フオーマツトに12ビツトのワードW′1〜W′4を適
合させるには、第１図Ｂに示すように、このワー
ドを16ビツトずつに３分割するのが普通であつ
た。これと反対に、12ビツトに関するフオーマツ
トに16ビツトの３ワードW1〜W3を適合させるに
は、この16ビツトの３ワードを第１図Ｃに示すよ
うに12ビツトずつに４分割するのが普通であつ
た。
W1，W2，W3と12ビツトの４ワードW′1，W′2，
W′3，W′4との２つのデータ列のフオーマツトが
生じる時を考える。従来では、16ビツトに関する
フオーマツトに12ビツトのワードW′1〜W′4を適
合させるには、第１図Ｂに示すように、このワー
ドを16ビツトずつに３分割するのが普通であつ
た。これと反対に、12ビツトに関するフオーマツ
トに16ビツトの３ワードW1〜W3を適合させるに
は、この16ビツトの３ワードを第１図Ｃに示すよ
うに12ビツトずつに４分割するのが普通であつ
た。
しかしながら、従来の方法では、第１図Ｂ及び
第１図Ｃから明かなように、１つのワードスロツ
トに奇数番のワードW2o+1（又はW′2o+1）と偶数
番のワードW2o（又はW′2o）との両者が含まれて
しまう。
第１図Ｃから明かなように、１つのワードスロツ
トに奇数番のワードW2o+1（又はW′2o+1）と偶数
番のワードW2o（又はW′2o）との両者が含まれて
しまう。
オーデイオPCM信号を固定ヘツドによつて磁
気テープの長手方向に記録する場合には、第２図
に示すように、隣接する２ワードの記録位置がＬ
だけ離れるように、奇数番のワードの集合と偶数
番のワードの集合とに分けて記録することが行な
われる。回転ヘツドを用いて斜めのトラツクとし
てオーデイオPCM信号を記録する時でも、同様
にトラツクの前半及びその後半の夫々に奇数番の
ワードの集合及び偶数番のワードの集合を記録す
ることがなされる。この方法は、偶奇インターリ
ーブと称され、ドロツプアウトなどによつてバー
ストエラーが再生時に生じても、前後に位置する
エラーを含まないワードの平均値によつて補間す
ることを可能にする。ところが、上述のように、
奇数番のワードとして処理される１ワード内に、
オーデイオPCM信号の奇数番及び偶数番のワー
ドが含まれていると、偶奇インターリーブがされ
ても、エラー補正能力が著しく低下する。
気テープの長手方向に記録する場合には、第２図
に示すように、隣接する２ワードの記録位置がＬ
だけ離れるように、奇数番のワードの集合と偶数
番のワードの集合とに分けて記録することが行な
われる。回転ヘツドを用いて斜めのトラツクとし
てオーデイオPCM信号を記録する時でも、同様
にトラツクの前半及びその後半の夫々に奇数番の
ワードの集合及び偶数番のワードの集合を記録す
ることがなされる。この方法は、偶奇インターリ
ーブと称され、ドロツプアウトなどによつてバー
ストエラーが再生時に生じても、前後に位置する
エラーを含まないワードの平均値によつて補間す
ることを可能にする。ところが、上述のように、
奇数番のワードとして処理される１ワード内に、
オーデイオPCM信号の奇数番及び偶数番のワー
ドが含まれていると、偶奇インターリーブがされ
ても、エラー補正能力が著しく低下する。
「発明の目的」
この発明は、標本化ワードのビツト数が切替え
られる場合に、何れのビツト数の時でもエラー補
正能力を低下させないようにしたデータ列伝送シ
ステムの提供を目的とするものである。
られる場合に、何れのビツト数の時でもエラー補
正能力を低下させないようにしたデータ列伝送シ
ステムの提供を目的とするものである。
「発明の概要」
この発明は、送信側で、１ワードＮビツトのデ
ータ列をインターリーブするインターリーブ回
路、受信側で、デインターリーブ回路及びエラー
ワードを補正する回路を有するデータ列伝送シス
テムであつて、 １ワードＭビツトを１ワードＮビツトに変換す
る第１のビツト変換回路をインターリーブ回路の
前に、１ワードＮビツトを１ワードＭビツトに変
換する第２のビツト変換回路を、デインターリー
ブ回路とエラー補正回路との間に設定し、 第１のビツト変換回路では、１ワードＭビツト
のデータ列のある時刻からａ番目のワードをWn
としたときに、データ列を（Wok+1）（Wok+2）…
…（Wok+k）（ｎ：任意の整数）のｋ通りの集合
に分け、１ワードＮビツトのデータ列のある時刻
からｂ番目のワードをWb′としたときに、データ
列を（W′ok+1）（W′ok+2）……（W′ok+k）のｋ通
りの集合に分け、（Wok+n）の集合内のワードの
ビツトは、全て（W′ok+n）の集合内のワードの
ビツトであるようにしたデータ列伝送システムで
ある。
ータ列をインターリーブするインターリーブ回
路、受信側で、デインターリーブ回路及びエラー
ワードを補正する回路を有するデータ列伝送シス
テムであつて、 １ワードＭビツトを１ワードＮビツトに変換す
る第１のビツト変換回路をインターリーブ回路の
前に、１ワードＮビツトを１ワードＭビツトに変
換する第２のビツト変換回路を、デインターリー
ブ回路とエラー補正回路との間に設定し、 第１のビツト変換回路では、１ワードＭビツト
のデータ列のある時刻からａ番目のワードをWn
としたときに、データ列を（Wok+1）（Wok+2）…
…（Wok+k）（ｎ：任意の整数）のｋ通りの集合
に分け、１ワードＮビツトのデータ列のある時刻
からｂ番目のワードをWb′としたときに、データ
列を（W′ok+1）（W′ok+2）……（W′ok+k）のｋ通
りの集合に分け、（Wok+n）の集合内のワードの
ビツトは、全て（W′ok+n）の集合内のワードの
ビツトであるようにしたデータ列伝送システムで
ある。
「実施例」
この発明の一実施例は、オーデイオPCM信号
を磁気テープに記録し、また、再生する場合にこ
の発明を適用したものであり、（Ｍ＝12ビツト）
（Ｎ＝16ビツト）（ｋ＝２）で奇数番データの集合
と偶数番データの集合に分けるものである。
を磁気テープに記録し、また、再生する場合にこ
の発明を適用したものであり、（Ｍ＝12ビツト）
（Ｎ＝16ビツト）（ｋ＝２）で奇数番データの集合
と偶数番データの集合に分けるものである。
第３図Ａに示すように、PCMテープレコーダ
が16ビツトを１ワードとする（W1，W3，W5）
の奇数番ワードの集合と、（W2，W4，W6）の偶
数番ワードの集合に分けられたデータ列を記録す
る構成とされている。これと対応して、１ワード
が12ビツトのオーデイオPCM信号を記録する時
には、第３図Ｂに示すように（W′1，W′3，W′5，
W′7）の奇数番ワードの集合と、（W′2，W′4，
W′6，W′8）の偶数番ワードの集合とに分ける。
そして、各集合を16ビツトのタイムスロツトに割
当てる。この場合、第３図Ｃに拡大して示すよう
に、同一のタイムスロツト内には、奇数番ワード
だけが含まれるように12ビツトのワードを分割す
る。同様に、同一のタイムスロツト内に偶数番ワ
ードだけが含まれるように、12ビツトのワードを
分割する。このようなビツト変換を行なつた後、
PCMテープレコーダは、ビツト数が16ビツトの
場合と全く同じ処理を行ない、記録信号を形成す
る。
が16ビツトを１ワードとする（W1，W3，W5）
の奇数番ワードの集合と、（W2，W4，W6）の偶
数番ワードの集合に分けられたデータ列を記録す
る構成とされている。これと対応して、１ワード
が12ビツトのオーデイオPCM信号を記録する時
には、第３図Ｂに示すように（W′1，W′3，W′5，
W′7）の奇数番ワードの集合と、（W′2，W′4，
W′6，W′8）の偶数番ワードの集合とに分ける。
そして、各集合を16ビツトのタイムスロツトに割
当てる。この場合、第３図Ｃに拡大して示すよう
に、同一のタイムスロツト内には、奇数番ワード
だけが含まれるように12ビツトのワードを分割す
る。同様に、同一のタイムスロツト内に偶数番ワ
ードだけが含まれるように、12ビツトのワードを
分割する。このようなビツト変換を行なつた後、
PCMテープレコーダは、ビツト数が16ビツトの
場合と全く同じ処理を行ない、記録信号を形成す
る。
第４図は、この発明の一実施例の記録及び再生
回路を示し、１で示す入力端子にアナログオーデ
イオ信号が供給される。このオーデイオ信号が
Ａ／Ｄコンバータ２によつて、１ワードが16ビツ
トのオーデイオPCM信号に変換される。オーデ
イオPCM信号がスイツチ回路３の入力端子に供
給される。このスイツチ回路３の一方の出力端子
４Ａが記録エンコーダ５の入力端子に接続され、
その他方の出力端子４Ｂがデイジタルの折れ線圧
縮回路６の入力端子に接続される。
回路を示し、１で示す入力端子にアナログオーデ
イオ信号が供給される。このオーデイオ信号が
Ａ／Ｄコンバータ２によつて、１ワードが16ビツ
トのオーデイオPCM信号に変換される。オーデ
イオPCM信号がスイツチ回路３の入力端子に供
給される。このスイツチ回路３の一方の出力端子
４Ａが記録エンコーダ５の入力端子に接続され、
その他方の出力端子４Ｂがデイジタルの折れ線圧
縮回路６の入力端子に接続される。
スイツチ回路３は、標本化ワードのビツト数が
16ビツトのデータの記録時に出力端子４Ａが選択
され、これが12ビツトのデータの記録時に出力端
子４Ｂが選択されるものである。また、このスイ
ツチ回路３の切替と連動してサンプリング周波数
が48KHzと32KHzとに切替わるようにされてい
る。したがつて、16ビツトフオーマツトの場合で
は、48KHzの周波数でサンプリングされ、リニア
量子化されたオーデイオPCM信号がそのまま記
録エンコーダ５に供給される。これに対し、12ビ
ツトフオーマツトの場合には、折れ線圧縮回路６
によつて16ビツトが12ビツトに圧縮され、更に、
ビツト変換回路７に供給される。このビツト変換
回路７の出力が記録エンコーダ５に供給される。
16ビツトのデータの記録時に出力端子４Ａが選択
され、これが12ビツトのデータの記録時に出力端
子４Ｂが選択されるものである。また、このスイ
ツチ回路３の切替と連動してサンプリング周波数
が48KHzと32KHzとに切替わるようにされてい
る。したがつて、16ビツトフオーマツトの場合で
は、48KHzの周波数でサンプリングされ、リニア
量子化されたオーデイオPCM信号がそのまま記
録エンコーダ５に供給される。これに対し、12ビ
ツトフオーマツトの場合には、折れ線圧縮回路６
によつて16ビツトが12ビツトに圧縮され、更に、
ビツト変換回路７に供給される。このビツト変換
回路７の出力が記録エンコーダ５に供給される。
第５図にビツト変換回路７の一例を示す。ビツ
ト変換回路７は、シリアルイン／パラレルアウト
のシフトレジスタ２１とパラレルイン／シリアル
アウトのシフトレジスタ２２とにより構成され
る。シフトレジスタ２１は、（12ビツト×８＝96
ビツト）のもので、シフトレジスタ２２は、（16
ビツト×６＝96ビツト）のもので、第５図では、
シフトレジスタ２１及び２２間の信号線が４ビツ
トずつまとめられている。
ト変換回路７は、シリアルイン／パラレルアウト
のシフトレジスタ２１とパラレルイン／シリアル
アウトのシフトレジスタ２２とにより構成され
る。シフトレジスタ２１は、（12ビツト×８＝96
ビツト）のもので、シフトレジスタ２２は、（16
ビツト×６＝96ビツト）のもので、第５図では、
シフトレジスタ２１及び２２間の信号線が４ビツ
トずつまとめられている。
シフトレジスタ２１には、入力端子２３から１
ワード12ビツトに圧縮されたオーデイオPCM信
号が供給される。端子２４から、１ビツトに１回
の割合でシフトクロツクがシフトレジスタ２１及
び２２に供給される。このシフトレジスタ２１の
パラレル出力がシフトレジスタ２２のパラレル入
力とされる。このシフトレジスタ２１及び２２間
が第５図に示すように接続される。シフトレジス
タ２２の出力端子２５が導出されている側から順
に、16ビツトずつのタイムスロツトをT1〜T6と
すると、タイムスロツトT1，T3，T5には、第３
図Ｃに示す態様でもつて奇数番ワードが分割して
挿入され、タイムスロツトT2，T4，T6には、同
様に偶数番ワードが分割して挿入される。シフト
レジスタ２２は、端子２６からのロードパルスに
よつて、12ビツトが８ワード分即ち96ビツトシフ
トする毎に１回の割合でシフトレジスタ２１の出
力をロードする。そして、シフトレジスタ２２か
らの直列出力が出力端子２５に取り出される。
ワード12ビツトに圧縮されたオーデイオPCM信
号が供給される。端子２４から、１ビツトに１回
の割合でシフトクロツクがシフトレジスタ２１及
び２２に供給される。このシフトレジスタ２１の
パラレル出力がシフトレジスタ２２のパラレル入
力とされる。このシフトレジスタ２１及び２２間
が第５図に示すように接続される。シフトレジス
タ２２の出力端子２５が導出されている側から順
に、16ビツトずつのタイムスロツトをT1〜T6と
すると、タイムスロツトT1，T3，T5には、第３
図Ｃに示す態様でもつて奇数番ワードが分割して
挿入され、タイムスロツトT2，T4，T6には、同
様に偶数番ワードが分割して挿入される。シフト
レジスタ２２は、端子２６からのロードパルスに
よつて、12ビツトが８ワード分即ち96ビツトシフ
トする毎に１回の割合でシフトレジスタ２１の出
力をロードする。そして、シフトレジスタ２２か
らの直列出力が出力端子２５に取り出される。
ビツト変換回路７は、上述のようにシフトレジ
スタを用いた組合せ回路の構成の他に、RAM及
びその制御回路によつて構成することができる。
スタを用いた組合せ回路の構成の他に、RAM及
びその制御回路によつて構成することができる。
記録エンコーダ５は、16ビツトを１ワードとし
てエラー訂正符号の符号化を行なうと共に、隣接
する奇数番データと偶数番データとの夫々の記録
位置を離す偶奇インターリーブの処理を行なう。
この記録エンコーダ５の出力が記録アンプ８及び
記録再生切替スイツチ９を介して磁気ヘツド１０
に供給される。磁気ヘツド１０により、磁気テー
プ（図示せず）の長手方向に沿つてエラー訂正符
号化されたオーデイオPCM信号が記録される。
サンプリング周波数が低くされ、ビツト数が16ビ
ツトから12ビツトに減少されることによつて、記
録データ量が半減するので、磁気テープの走行速
度が1/2に下げられる。
てエラー訂正符号の符号化を行なうと共に、隣接
する奇数番データと偶数番データとの夫々の記録
位置を離す偶奇インターリーブの処理を行なう。
この記録エンコーダ５の出力が記録アンプ８及び
記録再生切替スイツチ９を介して磁気ヘツド１０
に供給される。磁気ヘツド１０により、磁気テー
プ（図示せず）の長手方向に沿つてエラー訂正符
号化されたオーデイオPCM信号が記録される。
サンプリング周波数が低くされ、ビツト数が16ビ
ツトから12ビツトに減少されることによつて、記
録データ量が半減するので、磁気テープの走行速
度が1/2に下げられる。
この例と異なり、磁気テープの幅方向に複数本
のトラツクを設けるマルチトラツク方式や、回転
ヘツドを用いた記録方式を用いるようにしても良
い。
のトラツクを設けるマルチトラツク方式や、回転
ヘツドを用いた記録方式を用いるようにしても良
い。
再生時には、磁気ヘツド１０の再生信号が記録
再生切替スイツチ９及び再生アンプ１１を介して
クロツク再生回路１２に供給される。クロツク再
生回路１２は、再生信号に同期したビツトクロツ
クを形成するPLLの構成とされている。再生さ
れたビツトクロツクが再生時のデータ処理に用い
られる。クロツク再生回路１２の出力に現れる再
生信号が再生デコーダ１３に供給される。
再生切替スイツチ９及び再生アンプ１１を介して
クロツク再生回路１２に供給される。クロツク再
生回路１２は、再生信号に同期したビツトクロツ
クを形成するPLLの構成とされている。再生さ
れたビツトクロツクが再生時のデータ処理に用い
られる。クロツク再生回路１２の出力に現れる再
生信号が再生デコーダ１３に供給される。
再生デコーダ１３では、離れた位置に記録され
ている奇数番データ及び偶数番データを元の順序
に戻すデインターリーブとエラー訂正とが行なわ
れる。使用するエラー訂正符号によつて訂正でき
るエラーの大きさは異なる。エラー訂正符号とし
ては、リードソロモン符号、単純パリテイ、隣接
符号などを用いることができる。これらの符号を
積符号の形に組合わせたり、エラー検出用の
CRCコードを併用することもある。
ている奇数番データ及び偶数番データを元の順序
に戻すデインターリーブとエラー訂正とが行なわ
れる。使用するエラー訂正符号によつて訂正でき
るエラーの大きさは異なる。エラー訂正符号とし
ては、リードソロモン符号、単純パリテイ、隣接
符号などを用いることができる。これらの符号を
積符号の形に組合わせたり、エラー検出用の
CRCコードを併用することもある。
再生デコーダ１３の出力には、元の時系列に戻
されたオーデイオPCM信号が取り出される。こ
の再生信号がスイツチ回路１４に供給される。こ
のスイツチ回路１４の一方の出力端子１５Ａがエ
ラー補正回路１８の入力端子に接続され、その他
方の出力端子１５Ｂがビツト変換回路１６の入力
端子に接続される。スイツチ回路１４は、標本化
ワードのビツト数が16ビツトの時に出力端子15A
を選択し、これが12ビツトの時に出力端子１５Ｂ
を選択する。このスイツチ回路１４の切替は、例
えば記録信号に付加されているフオーマツト判別
信号を再生時に取り出すことにより自動的になさ
れる。
されたオーデイオPCM信号が取り出される。こ
の再生信号がスイツチ回路１４に供給される。こ
のスイツチ回路１４の一方の出力端子１５Ａがエ
ラー補正回路１８の入力端子に接続され、その他
方の出力端子１５Ｂがビツト変換回路１６の入力
端子に接続される。スイツチ回路１４は、標本化
ワードのビツト数が16ビツトの時に出力端子15A
を選択し、これが12ビツトの時に出力端子１５Ｂ
を選択する。このスイツチ回路１４の切替は、例
えば記録信号に付加されているフオーマツト判別
信号を再生時に取り出すことにより自動的になさ
れる。
ビツト変換回路１６は、各タイムスロツトに挿
入されている16ビツトを12ビツトのワードに戻す
ものである。このビツト変換回路１６は、第５図
に示されるビツト変換回路７の入出力関係を逆と
し、ロードパルスをシフトレジスタ２１に与える
ように変形した構成のものである。ビツト変換回
路１６の出力がデイジタルの折れ線伸長回路１７
に供給される。この折れ線伸長回路１７は、折れ
線圧縮回路６と相補的な伸長を行ない、その出力
に16ビツトを１ワードとするオーデイオPCM信
号が現れる。
入されている16ビツトを12ビツトのワードに戻す
ものである。このビツト変換回路１６は、第５図
に示されるビツト変換回路７の入出力関係を逆と
し、ロードパルスをシフトレジスタ２１に与える
ように変形した構成のものである。ビツト変換回
路１６の出力がデイジタルの折れ線伸長回路１７
に供給される。この折れ線伸長回路１７は、折れ
線圧縮回路６と相補的な伸長を行ない、その出力
に16ビツトを１ワードとするオーデイオPCM信
号が現れる。
この折れ線伸長回路１７の出力がエラー補正回
路１８に供給される。エラー補正回路１８は、再
生デコーダ１３において訂正できなかつたエラー
ワードを補正するものである。エラー補正回路１
８は、エラーワードの前後のワードが正しい時に
平均値補間を行ない、前後のワードの片方だけが
正しい時に前値ホールド又は後値ホールドの動作
を行なう。このエラー補正回路１８の出力がＤ／
Ａコンバータ１９に供給され、出力端子２０にア
ナログオーデイオ信号が取り出される。
路１８に供給される。エラー補正回路１８は、再
生デコーダ１３において訂正できなかつたエラー
ワードを補正するものである。エラー補正回路１
８は、エラーワードの前後のワードが正しい時に
平均値補間を行ない、前後のワードの片方だけが
正しい時に前値ホールド又は後値ホールドの動作
を行なう。このエラー補正回路１８の出力がＤ／
Ａコンバータ１９に供給され、出力端子２０にア
ナログオーデイオ信号が取り出される。
再生時に、スイツチ回路１４が再生データのフ
オーマツトに応じて切替えられると共に、磁気テ
ープの走行速度もフオーマツトと対応したものと
される。
オーマツトに応じて切替えられると共に、磁気テ
ープの走行速度もフオーマツトと対応したものと
される。
この発明の一実施例のように、16ビツトを12ビ
ツトに変換するビツト変換回路１６は、エラー訂
正後で且つエラー補正前の段階に挿入される。こ
れは、再生デコーダ１３でなされるエラー訂正が
16ビツトを１ワードとする処理であつて、エラー
訂正がなされた時は、完全に元のデータに戻るの
に対し、エラー補正回路１８でなされる補正がワ
ードの値そのものが意味を持つ演算処理だからで
ある。
ツトに変換するビツト変換回路１６は、エラー訂
正後で且つエラー補正前の段階に挿入される。こ
れは、再生デコーダ１３でなされるエラー訂正が
16ビツトを１ワードとする処理であつて、エラー
訂正がなされた時は、完全に元のデータに戻るの
に対し、エラー補正回路１８でなされる補正がワ
ードの値そのものが意味を持つ演算処理だからで
ある。
「応用例」
この発明では、入力データ列及び伝送データ列
を複数の集合に分ける場合、偶数及び奇数の違い
に限らず、例えば３の倍数を3nとする時に、
（3n）（3n＋１）（3n＋２）の３個の集合や、（4n）
（4n＋１）（4n＋２）（4n＋３）の４個の集合に分
けるようにしても良い。
を複数の集合に分ける場合、偶数及び奇数の違い
に限らず、例えば３の倍数を3nとする時に、
（3n）（3n＋１）（3n＋２）の３個の集合や、（4n）
（4n＋１）（4n＋２）（4n＋３）の４個の集合に分
けるようにしても良い。
「発明の効果」
この発明に依れば、元の時系列で奇数番及び偶
数番のワードが伝送データの時系列においても
夫々奇数番及び偶数番のタイムスロツトに挿入さ
れるので、偶奇インターリーブを行なう場合に、
ビツト数が違うためにエラー補正能力が著るしく
低下することを防止できる。
数番のワードが伝送データの時系列においても
夫々奇数番及び偶数番のタイムスロツトに挿入さ
れるので、偶奇インターリーブを行なう場合に、
ビツト数が違うためにエラー補正能力が著るしく
低下することを防止できる。
第１図は従来のデータ列伝送方法の説明に用い
る略線図、第２図は偶奇インターリーブの説明に
用いる略線図、第３図はこの発明の一実施例の説
明に用いる略線図、第４図はこの発明の一実施例
の回路構成を示すブロツク図、第５図はビツト変
換回路の一例の構成を示すブロツク図である。 １……アナログオーデイオ信号の入力端子、３
……スイツチ回路、５……記録エンコーダ、７…
…ビツト変換回路、１０……磁気ヘツド、１３…
…再生デコーダ、１４……スイツチ回路、１６…
…ビツト変換回路、１８……エラー補正回路。
る略線図、第２図は偶奇インターリーブの説明に
用いる略線図、第３図はこの発明の一実施例の説
明に用いる略線図、第４図はこの発明の一実施例
の回路構成を示すブロツク図、第５図はビツト変
換回路の一例の構成を示すブロツク図である。 １……アナログオーデイオ信号の入力端子、３
……スイツチ回路、５……記録エンコーダ、７…
…ビツト変換回路、１０……磁気ヘツド、１３…
…再生デコーダ、１４……スイツチ回路、１６…
…ビツト変換回路、１８……エラー補正回路。
Claims (1)
- 【特許請求の範囲】 １ 送信側で、１ワードＮビツトのデータ列をイ
ンターリーブするインターリーブ回路、受信側
で、デインターリーブ回路及びエラーワードを補
正する回路を有するデータ列伝送システムであつ
て、 １ワードＭビツトを１ワードＮビツトに変換す
る第１のビツト変換回路を上記インターリーブ回
路の前に、１ワードＮビツトを１ワードＭビツト
に変換する第２のビツト変換回路を、上記デイン
ターリーブ回路と上記エラー補正回路との間に設
定し、 上記第１のビツト変換回路では、上記１ワード
Ｍビツトのデータ列のある時刻からａ番目のワー
ドをWnとしたときに、上記データ列を（Wok+1）
（Wok+2）……（Wok+k）（ｎ：任意の整数）のｋ
通りの集合に分け、上記１ワードＮビツトのデー
タ列のある時刻からｂ番目のワードをWb′とした
ときに、上記データ列を（W′ok+1）（W′ok+2）…
…（W′ok+k）のｋ通りの集合に分け、（Wok+n）
の集合内のワードのビツトは、全て（W′ok+n）
の集合内のワードのビツトであるようにしたデー
タ列伝送システム。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10869883A JPS601940A (ja) | 1983-06-17 | 1983-06-17 | データ列伝送システム |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10869883A JPS601940A (ja) | 1983-06-17 | 1983-06-17 | データ列伝送システム |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS601940A JPS601940A (ja) | 1985-01-08 |
| JPH053773B2 true JPH053773B2 (ja) | 1993-01-18 |
Family
ID=14491364
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10869883A Granted JPS601940A (ja) | 1983-06-17 | 1983-06-17 | データ列伝送システム |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS601940A (ja) |
Families Citing this family (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61230678A (ja) * | 1985-04-05 | 1986-10-14 | Hitachi Ltd | Ｐｃｍ信号記録再生装置 |
| JP2574744B2 (ja) * | 1985-04-10 | 1997-01-22 | 株式会社日立製作所 | Ｐｃｍ信号記録再生装置 |
| JPS62192979A (ja) * | 1986-02-19 | 1987-08-24 | Sony Corp | デ−タ伝送方法 |
| JPH0817247B2 (ja) * | 1988-11-09 | 1996-02-21 | 富士電気化学株式会社 | 感温素子材料の製造方法 |
| JPH0817248B2 (ja) * | 1988-11-09 | 1996-02-21 | 富士電気化学株式会社 | 感温素子材料の製造方法 |
-
1983
- 1983-06-17 JP JP10869883A patent/JPS601940A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS601940A (ja) | 1985-01-08 |
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