JPS643080Y2 - - Google Patents

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JPS643080Y2
JPS643080Y2 JP1981029945U JP2994581U JPS643080Y2 JP S643080 Y2 JPS643080 Y2 JP S643080Y2 JP 1981029945 U JP1981029945 U JP 1981029945U JP 2994581 U JP2994581 U JP 2994581U JP S643080 Y2 JPS643080 Y2 JP S643080Y2
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Description

【考案の詳細な説明】 本考案は、負荷が断線および短絡しているか否
かを検出する装置に関する。
先行技術では、負荷に直列に接続された抵抗に
よつて負荷電流が変換された電圧を、2つの比較
回路の各一方の入力端子にそれぞれ与え、比較回
路の他方の入力端子には負荷の断線時および短絡
時に比較回路の出力レベルが変化するように予め
定められたレベルの電圧が与えられる。このよう
な先行技術では、比較回路を2つ必要とし、また
それに関連する抵抗などの電気回路素子が増加す
る。
本考案の目的は、構成が簡略化された負荷の断
線および短絡検出装置を提供することである。
本考案は、制御信号で駆動される駆動回路によ
り通電制御される負荷と、比較用の基準電圧を発
生する基準電圧発生手段と、該負荷に流れる負荷
電流によつて生じる電圧と該基準電圧を比較する
比較手段と、正常時の前記負荷電流によつて生じ
る電圧を境として該基準電圧を大小2値のいずれ
かに切換えるスイツチング手段と、該比較手段の
出力と該スイツチング手段の開閉状態との組合わ
せに応じて前記負荷の断線および短絡を検出する
検出手段とから構成されることを特徴とする負荷
の断線および短絡検出装置である。
図面は、本考案の一実施例の電気回路図であ
る。直流電源1の高電位側のライン2と、低電位
の接地との間には、電磁コイルなどの負荷Lと、
トランジスタTRと、第1抵抗R1とから成る直
列回路が接続される。このライン2と接地との間
にはまた、第2抵抗R2および第3抵抗R3とか
ら成る直列回路が接続される。第1抵抗R1の負
荷L側の端子、すなわち抵抗R1とトランジスタ
TRのエミツタとの接続点3は、比較回路COM
の一方の入力端子Aに接続される。抵抗R2,R
3の接点4は、比較回路COMの他方の端子Bに
接続される。比較回路COMの出力は、端子Aの
電位が端子Bの電位よりも大きいときに接地電位
に等しいローレベルであり、端子Aの電位が端子
Bの電位よりも低いときに比較回路COMの出力
はライン2の電位に等しいハイレベルである。ト
ランジスタTRのベースは、抵抗R5を介してラ
イン2に接続される。
マイクロコンピユータ5は、電力付勢用の端子
Dがライン2に接続され、端子Fが接地される。
端子Gは、抵抗R6を介してトランジスタTRの
ベースに接続される。トランジスタTRのベース
はまた、抵抗R5を介してライン2に接続され
る。比較回路COMの入力端子Bしたがつて接続
点4は、第4の抵抗R4を介してマイクロコンピ
ユータ5の端子Kに接続される。マイクロコンピ
ユータ5内では、端子KとFが等価的なスイツチ
ング素子SWを介して接続されている。マイクロ
コンピユータ5は、比較回路COMの出力を端子
Mに受信し、その出力レベルを弁別する。
負荷Lの断線を検出するにあたつては、先ず、
マイクロコンピユータ5はローレベルの信号を端
子Gに与え、これによつてトランジスタTRを導
通させる。そのため負荷Lには電源1からライン
2、抵抗R1、接続点3およびトランジスタTR
を経て負荷電流が流れる。この負荷電流は、抵抗
R1によつて電圧に変換され、その接続点3にお
ける電圧は比較回路COMの一方の端子Aに与え
られる。負荷Lの断線検出のためにマイクロコン
ピユータ5はスイツチング素子SWを遮断してい
る。これによつて接点4における電圧V4は第1
式で示される値となつている。ここでEは電源1
の出力電圧である。
V4=R3/R2+R3E …(1) 負荷Lが断線していないとき、すなわち正常で
あるときおよび短絡しているときには、抵抗R1
による電圧降下が大きく、したがつて接続点3の
電圧V3よりも接続点4の電圧V4が大きい(V3<
V4)。したがつて比較回路COMの出力はハイレ
ベルである。マイクロコンピユータ5は、比較回
路COMの出力レベルを弁別し、負荷が断線して
いないことを判別する。
負荷Lが断線しているときには、接続点3の電
圧V3は電圧V4よりも大きい(V3>V4)。したが
つて比較回路COMの出力はローレベルである。
負荷Lが短絡しているか否かを判別するにあた
つては、マイクロコンピユータ5は、トランジス
タTRを導通した状態において、スイツチング素
子SWを導通する。このスイツチング素子SWの
導通によつて接点4の電圧V4aは第2式で示され
る電圧となる。ここでR3R4は抵抗R3,R4
の合成抵抗である。
V4a=R3R4/R2+R3R4E …(2) マイクロコンピユータ5のスイツチング素子
SWが導通することによつて、抵抗R3には抵抗
R4が並列に接続されたことになる。したがつて
V4>V4aとなる。負荷Lが短絡していないとき、
すなわち正常時で正常なときと断線しているとき
には、V3>V4aである。したがつて比較回路
COMの出力はローレベルである。
負荷Lが短絡しているときには、V3<V4aで
ある。これによつて比較回路COMの出力はハイ
レベルとなる。マイクロコンピユータ5はスイツ
チング素子SWのスイツチング態様と端子Mに受
信する比較回路COMの出力のレベルとに応答し
て、負荷Lが短絡していることを検出する。
本考案の他の実施例として、トランジスタTR
に代えて、リレーなどの負荷制御用スイツチング
素子が用いられてもよい。比較回路COMの端子
Aは、トランジスタTRと負荷Lとの間に接続さ
れてもよい。
以上のように本考案によれば、単一の比較回路
の一方の入力には負荷に流れる負荷電流によつて
生じる電圧を与え、他方の端子には負荷の断線お
よび短絡をそれぞれ検出するために、正常時の負
荷電流によつて生じる電圧を境として大小2値の
いずれかにスイツチング手段によつて切換えて得
られる基準電圧を比較手段に与えるようにしたの
で、構成が簡略化される。
【図面の簡単な説明】
図面は本考案の一実施例の電気回路図である。 1……電源、5……マイクロコンピユータ、R
1〜R6……抵抗、TR……トランジスタ、
COM……比較回路、L……負荷、SW……等価
的なスイツチング素子。

Claims (1)

    【実用新案登録請求の範囲】
  1. 制御信号で駆動される駆動回路により通電制御
    される負荷と、比較用の基準電圧を発生する基準
    電圧発生手段と、該負荷に流れる負荷電流によつ
    て生じる電圧と該基準電圧を比較する比較手段
    と、正常時の前記負荷電流によつて生じる電圧を
    境として該基準電圧を大小2値のいずれかに切換
    えるスイツチング手段と、該比較手段の出力と該
    スイツチング手段の開閉状態との組合わせに応じ
    て前記負荷の断線および短絡を検出する検出手段
    とから構成されることを特徴とする負荷の断線お
    よび短絡検出装置。
JP1981029945U 1981-03-04 1981-03-04 Expired JPS643080Y2 (ja)

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JPS57144077U JPS57144077U (ja) 1982-09-09
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Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5471347A (en) * 1978-05-22 1979-06-07 Mazda Motor Corp State detector
JPS5633571B2 (ja) * 1974-05-24 1981-08-04

Family Cites Families (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5633571U (ja) * 1979-08-23 1981-04-02

Patent Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5633571B2 (ja) * 1974-05-24 1981-08-04
JPS5471347A (en) * 1978-05-22 1979-06-07 Mazda Motor Corp State detector

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JPS57144077U (ja) 1982-09-09

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