JPS63250163A - 半導体集積回路装置 - Google Patents

半導体集積回路装置

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Publication number
JPS63250163A
JPS63250163A JP62086227A JP8622787A JPS63250163A JP S63250163 A JPS63250163 A JP S63250163A JP 62086227 A JP62086227 A JP 62086227A JP 8622787 A JP8622787 A JP 8622787A JP S63250163 A JPS63250163 A JP S63250163A
Authority
JP
Japan
Prior art keywords
lead
lead frame
plated
integrated circuit
semiconductor integrated
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP62086227A
Other languages
English (en)
Inventor
Yoshihiro Miyagawa
宮川 芳広
Minoru Kurohichi
黒肥地 稔
Kiyoshi Iwamori
岩森 清
Masashi Shimoda
下田 正志
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Priority to JP62086227A priority Critical patent/JPS63250163A/ja
Publication of JPS63250163A publication Critical patent/JPS63250163A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/181Encapsulation
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/30Assembling printed circuits with electric components, e.g. with resistor
    • H05K3/32Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits
    • H05K3/34Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits by soldering
    • H05K3/341Surface mounted components
    • H05K3/3421Leaded components

Landscapes

  • Lead Frames For Integrated Circuits (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 乙の発明は、複数のリードフし・−ムを備えた半導体集
積回路装置に関するものである。
〔従来の技術〕
従来のこの種の半導体集積回路装置は、複数のリードフ
レームが内部で半導体チップとボンディングワイヤによ
り接続されており、これらのり−ドフレームを基板上に
はんだ付けして実装される。
これを第3図(a)、(b)により説明する。
第3図において、1は半導体集積回路装置の本体(以下
装置本体という)を示し、2はこの装置本体1に設けら
れたリードフレームで、複数取り付けられている。2a
は前記リードフレーム2の一端を切断した時のリード力
・ソト部(後述する第2図のA−A綿)42bは前記リ
ードカット部2aの非メッキ部分であり、このリードフ
レーム2が基板4上にはんt′!3によりはんだ付けさ
れ実装される。
上記のような構成におけろ半導体集積回路装置10のリ
ードフレーム2ば、装置本体1の付は根部分の幅とリー
ドカット部2aの先端部分の幅とが同一寸法に形成され
ているため、リードカットされた端面部公金てが非メッ
キ部分2bとなる。
〔発明が解決しようとする問題点〕
したがって、上記のようなり−・ドフレーム2の構成で
は、非メッキ部分2bには第3図に示すように、はんだ
3が付着しにくり、はんだ付けが不完全になる。このた
め、再度のは/した付は作業が必要とな抄、その結果、
この再度のはんだ付けにより、装置本体1に熱的あるい
は機械的なストレスが加わり、リードフレーム2を破損
したり、あるいは特性が劣化したりして半導体R積回路
装置の品質の低下をきたし、信頼性を損ねる等の問題点
があった。
乙の発明は、上記のような従来の問題点を解決するため
になされたもので、良好なはんだ付けができるとともに
、品質の低下のない半導体集積回路装置を得ることを目
的とする。
〔問題点を解決するための手段〕
この発明に係る半導体集積回路装置は、リードフレーム
のそれぞれのリードカット部の非メッキ部分を少なくす
るために、各リードフレームの先端側に四部を形成した
ものである。
〔作用〕 この発明においては、リードフレームの先端側に凹部を
形成したことから、この凹部内側にはメッキが施されて
いるので、メッキ後に切断されるリードカット部の非メ
ッキ部分が減少し、はんだ付着部分が増大する。
〔実施例〕
第1図(a)〜(e)は乙の発明の一実施例を示す半導
体集積回路装置の主要構成部分を示す図で、第1図(a
)は斜視図、第1図(b)は正面図、第1図(C)は側
面図である。
また、第2図は、第1図(a)の上面図を示すとともに
、リードフレーム2のリードカットについて説明する図
である。
これらの図で、第3図と同一符号は同一構成部分を示し
、5は前記リードフレーム2の先端部に形成された凹部
であり、この凹部5の形成後、メッキが施され、その後
、第2図に示すA −、A 線からリードカットが行わ
れる。したがって、リードカットされた部分は非メッキ
部分2bとなっているが、凹部5の形成により凹部5の
内面2cはメッキが施されているため、非メツ・弁部分
2bの面積は従来に比べ極めて少なくなっている。
このように非メッキ部分2bを少なくすることにより、
第1図(bJ、(e)に示すように、基板4上へ実装す
る際、はんだ付けにおいて、は/l、 f! 3が付着
する部分3′が多くなり、高品質の実装が可能となる。
〔発明の効果〕
以上説明したように、この発明は、各リードフレームの
リードカット部分の非メッキ部分を少な(したので、は
んだ付けによる基板上への実装に際してもはんだの付着
部分が多くなり、一度のはんだ付けで実装が可能となる
。したがって、装置本体に熱的2機械的ストレスが加わ
ることがなくなり、高品質で高信頼性の半導体集積回路
装置が得られる利点がある。
【図面の簡単な説明】
第1図(a)〜(C)はこの発明の一実施例を示す半導
体集積回路装置の主要部の構成を示す斜視図。 正面図、および側面図、第2図は、第1図(a)のリー
ドカット前の上面図、第3図(a)、(b)は従来の半
導体集積回路袋・置の主要部の構成を示す側面図および
正面図である。 図において、1は装置本体、2はリードフレーム、2a
はリードカット部、2bは非メッキ部分、2cは凹部の
内面、3ははんだ、4は基板、5は凹部である。 なお、各図中の同一符号は同一または相当部分を示す。 代理人 大 岩 増 雄   (外2名)第1図 (a) 第2図 第3図 (a)  10 1

Claims (1)

    【特許請求の範囲】
  1. ボンディングワイヤにより内部で半導体チップと接続さ
    れたリードフレームを複数備えた半導体集積回路装置に
    おいて、前記リードフレームのそれぞれのリードカット
    部の非メッキ部分を少なくするための凹部を前記リード
    フレームの先端側に形成したことを特徴とする半導体集
    積回路装置。
JP62086227A 1987-04-06 1987-04-06 半導体集積回路装置 Pending JPS63250163A (ja)

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JPS63250163A true JPS63250163A (ja) 1988-10-18

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Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH04162466A (ja) * 1990-10-24 1992-06-05 Nec Corp 半導体装置用リードフレーム
JPH04170056A (ja) * 1990-11-02 1992-06-17 Nec Kyushu Ltd 半導体装置
JPH0555438A (ja) * 1991-08-26 1993-03-05 Rohm Co Ltd 電子部品のリード端子構造
JP2021121042A (ja) * 2020-03-13 2021-08-19 ローム株式会社 半導体装置
US11784295B2 (en) 2007-03-30 2023-10-10 Rohm Co., Ltd. Semiconductor light-emitting device

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