JPS62174838A - マルチプロセサ・システムに於けるプロセサ障害検出方法 - Google Patents
マルチプロセサ・システムに於けるプロセサ障害検出方法Info
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- JPS62174838A JPS62174838A JP61017120A JP1712086A JPS62174838A JP S62174838 A JPS62174838 A JP S62174838A JP 61017120 A JP61017120 A JP 61017120A JP 1712086 A JP1712086 A JP 1712086A JP S62174838 A JPS62174838 A JP S62174838A
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- Japan
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- processor
- processors
- slave
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- Pending
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- 238000001514 detection method Methods 0.000 title claims description 7
- 238000012790 confirmation Methods 0.000 claims description 18
- 238000010586 diagram Methods 0.000 description 2
- 238000012544 monitoring process Methods 0.000 description 2
- 239000012528 membrane Substances 0.000 description 1
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- Hardware Redundancy (AREA)
- Multi Processors (AREA)
- Retry When Errors Occur (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はデータ処理装置に関し、特に複数のマイクロ・
プロセサ間をプロセサ・バスにより接Ｈしたマルチプロ
セサ・システムに於けるプロセサ障害検出方法に関する
０ 〔従来の技術〕 従来、この種のプロセサ障害検出は、障害発生プロセサ
からの障害通知信号の受信又は−膜処理信号送受信時の
確認信号のタイミング監視によりプロセサ障害を検出し
ていた。
プロセサ間をプロセサ・バスにより接Ｈしたマルチプロ
セサ・システムに於けるプロセサ障害検出方法に関する
０ 〔従来の技術〕 従来、この種のプロセサ障害検出は、障害発生プロセサ
からの障害通知信号の受信又は−膜処理信号送受信時の
確認信号のタイミング監視によりプロセサ障害を検出し
ていた。
上述した従来のプロセサ障害検出は、障害発生プロセサ
からの障害通知信号の受信又は−膜処理信号送受信時の
確認信号のタイミング監視によりプロセサ障害を検出す
る様になっているので、メモリ・リソース軽鎖やプロセ
サ・バスＩＩ害により障害通知信号が紛失したり、無負
荷状態中は障害検出が出来ないという問題点がある。
からの障害通知信号の受信又は−膜処理信号送受信時の
確認信号のタイミング監視によりプロセサ障害を検出す
る様になっているので、メモリ・リソース軽鎖やプロセ
サ・バスＩＩ害により障害通知信号が紛失したり、無負
荷状態中は障害検出が出来ないという問題点がある。
本発明によるプロセサ障害検出方法は、複数のプロセサ
間をプロセサ・バスにより接続したマルチプロセサ・シ
ステムに於いて、マスタ・プロセサが他のスレーブ・プ
ロセサへ周期的に動作確認信号を送信し、該スレーブ・
プロセサは該動作確認信号を受信すると該マスタ・プロ
セサへ動作応答信号を送信し、該マスタ・プロセサは該
スレーブ・プロセサからの該動作応答信号の受信タイミ
ングを監視し、該動作応答信号を受信すれば該スレーブ
・プロセサを正常動作中と見做し、受信タイミングを越
えれば再試行を行ない再試行でも失敗すれば該スレーブ
・プロセサを障害と見做し、複数階層構成のマルチプロ
セサ゛・シスチムニ於イては、各上位プロセサが各直積
下位の子プロセサへ周期的に動作確認信号を送信し、核
子プロセサは該動作確認信号を受信すると該上位プロセ
サへ動作応答信号を送信し、該上位プロセサは核子プロ
セサからの該動作応答信号の受信タイミングを監視し、
該動作応答信号を受信すれば核子プロセサを正常動作中
と見做し、受信タイミングを越えれば再試行を行ない再
試行でも失敗すれば核子プロセサを障害と見做し、各上
位プロセサは該プロセサの上位プロセサ又はマスタ拳プ
ロセサへの動作応答信号で配下のプロセサ障害を順次知
らせる事によシ、マスタ・プロセサで７ステム全体のプ
ロセサ障害を把握する事を特徴とする。
間をプロセサ・バスにより接続したマルチプロセサ・シ
ステムに於いて、マスタ・プロセサが他のスレーブ・プ
ロセサへ周期的に動作確認信号を送信し、該スレーブ・
プロセサは該動作確認信号を受信すると該マスタ・プロ
セサへ動作応答信号を送信し、該マスタ・プロセサは該
スレーブ・プロセサからの該動作応答信号の受信タイミ
ングを監視し、該動作応答信号を受信すれば該スレーブ
・プロセサを正常動作中と見做し、受信タイミングを越
えれば再試行を行ない再試行でも失敗すれば該スレーブ
・プロセサを障害と見做し、複数階層構成のマルチプロ
セサ゛・シスチムニ於イては、各上位プロセサが各直積
下位の子プロセサへ周期的に動作確認信号を送信し、核
子プロセサは該動作確認信号を受信すると該上位プロセ
サへ動作応答信号を送信し、該上位プロセサは核子プロ
セサからの該動作応答信号の受信タイミングを監視し、
該動作応答信号を受信すれば核子プロセサを正常動作中
と見做し、受信タイミングを越えれば再試行を行ない再
試行でも失敗すれば核子プロセサを障害と見做し、各上
位プロセサは該プロセサの上位プロセサ又はマスタ拳プ
ロセサへの動作応答信号で配下のプロセサ障害を順次知
らせる事によシ、マスタ・プロセサで７ステム全体のプ
ロセサ障害を把握する事を特徴とする。
次に、本発明について図面を参照して説明する。
第１図は本発明によるプロセサ障害検出方法の一実施例
を示した図である。マスタ・プロセサ１゜スレーブ・プ
ロセサ２．３及びスレーブ・プロセサ２．３の子プロセ
サ４，５，６．７が有シ、マスク東グロセサ１とスレー
ブ・プロセサ２．３はプロセサ拳バス１１で接続され、
スレーブ・プロセサ２と子プロセサ４．５もプロセサー
バスで接続され、同様にスレーブ会プロセサ３と子プロ
セサ６．７もプロセサ・バスで接続されている。
を示した図である。マスタ・プロセサ１゜スレーブ・プ
ロセサ２．３及びスレーブ・プロセサ２．３の子プロセ
サ４，５，６．７が有シ、マスク東グロセサ１とスレー
ブ・プロセサ２．３はプロセサ拳バス１１で接続され、
スレーブ・プロセサ２と子プロセサ４．５もプロセサー
バスで接続され、同様にスレーブ会プロセサ３と子プロ
セサ６．７もプロセサ・バスで接続されている。
マスタ・プロセサ１はスレーブ・プロセサ２゜３へ周期
的に動作確認信号２０．２２を送信し、スレーブ［有］
プロセサ２゜３は動作確認信号２０゜２２を受信すると
マスタ・プロセサ１へ動作応答信号２１．２３を送信し
、マスタ・プロセサ１はスレーブ−プロセサ２．３から
の動作応答信４＋２１゜２３の受信タイミングを監視し
、動作応答信号Ｉ。
的に動作確認信号２０．２２を送信し、スレーブ［有］
プロセサ２゜３は動作確認信号２０゜２２を受信すると
マスタ・プロセサ１へ動作応答信号２１．２３を送信し
、マスタ・プロセサ１はスレーブ−プロセサ２．３から
の動作応答信４＋２１゜２３の受信タイミングを監視し
、動作応答信号Ｉ。
２３を受信すればスレーブ・プロセサ２，３を正常動作
中と見做し、受信タイミングを越えれば再試行を行ない
再試行でも失敗すればスレーブ・プロセサ２．３を障害
と見做す。
中と見做し、受信タイミングを越えれば再試行を行ない
再試行でも失敗すればスレーブ・プロセサ２．３を障害
と見做す。
各上位プロセサ（スレーブ・プロセサ）２．３が各直弯
下位子プロセサ４．５，６．７へ動作確認信号２４，２
６，２８．３０を送信し、子プロセサ４，５，６．７は
動作確認信号２４，２６゜２８．３０を受信すると上位
プロセサ（スレーブ会プロセサ）２．３へ動作応答信号
２５．２７゜２９．３１を送信し、上位プロセサ（スレ
ーブ・プロセサ）２．３は子プロセサ４，５，６．７か
らの動作応答信号２５．２７，２９．３１の受信タイミ
ングを監視し、動作応答信号２５．２７゜２９．３１を
受信すれば子プロセサ４，５．６゜７を正常動作中と見
做し、受信タイミングを越えれば再試行を行ない再試行
でも失敗すれば子プロセサ４，５，６．７を障害と見做
す。
下位子プロセサ４．５，６．７へ動作確認信号２４，２
６，２８．３０を送信し、子プロセサ４，５，６．７は
動作確認信号２４，２６゜２８．３０を受信すると上位
プロセサ（スレーブ会プロセサ）２．３へ動作応答信号
２５．２７゜２９．３１を送信し、上位プロセサ（スレ
ーブ・プロセサ）２．３は子プロセサ４，５，６．７か
らの動作応答信号２５．２７，２９．３１の受信タイミ
ングを監視し、動作応答信号２５．２７゜２９．３１を
受信すれば子プロセサ４，５．６゜７を正常動作中と見
做し、受信タイミングを越えれば再試行を行ない再試行
でも失敗すれば子プロセサ４，５，６．７を障害と見做
す。
各上位プロセサ（スレーブ・プロセサ）２．３は該プロ
セサの上位プロセサ（本例では無し）又はマスタ拳プロ
セサ１への動作応答信号２１．２３で配下のプロセサ障
害を順次知らせる事により、マスタ・プロセサ１でシス
テム全体のプロセサ障害を把握する。
セサの上位プロセサ（本例では無し）又はマスタ拳プロ
セサ１への動作応答信号２１．２３で配下のプロセサ障
害を順次知らせる事により、マスタ・プロセサ１でシス
テム全体のプロセサ障害を把握する。
以上説明したように本発明は、マスタ・プロセサが他の
スレーブ−プロセサへ周期的に動作確認信号を送信し、
スレーブ・プロセサは動作確認信号を受信するとマスタ
・プロセサへ動作応答信号を送信し、マスタ・プロセサ
はスレーブ・プロセサからの動作応答信号の受信タイミ
ングを監視し、動作応答信号を受信すればスレーブＱグ
ロセサを正常動作中に見做し、受信タイミングを越えれ
ば再試行を行ない再試行でも失敗すればスレーブ・プロ
セサを障害と見做し、複数階層構成のマルチプロセサ・
システムに於いては、各上位プロセサが各直属下位の子
プロセサへ周期的に動作確認信号を送信し、子プロセサ
は動作確認信号を受信すると上位プロセサへ動作応答信
号を送信し、上位プロセサは子プロセサからの動作応答
信号の受信タイミングを監視し、動作応答信号を受信す
れは子プロセサを正常動作中と見做し、受信タイミング
を越えれば再試行を行ない再試行でも失敗すれば子プロ
七すを障害と見做し、各上位プロセサは該プロセサの上
位プロセサ又はマスターズロセサヘの動作応答信号で配
下のプロセサ障害を順次知らせる事により、障害発生プ
ロセサからの障害通知信号が紛失したり、無負荷状態中
にもマスタ・プロセサでシステム全体のプロセサ障害を
把握する事が出来るという効果がある。
スレーブ−プロセサへ周期的に動作確認信号を送信し、
スレーブ・プロセサは動作確認信号を受信するとマスタ
・プロセサへ動作応答信号を送信し、マスタ・プロセサ
はスレーブ・プロセサからの動作応答信号の受信タイミ
ングを監視し、動作応答信号を受信すればスレーブＱグ
ロセサを正常動作中に見做し、受信タイミングを越えれ
ば再試行を行ない再試行でも失敗すればスレーブ・プロ
セサを障害と見做し、複数階層構成のマルチプロセサ・
システムに於いては、各上位プロセサが各直属下位の子
プロセサへ周期的に動作確認信号を送信し、子プロセサ
は動作確認信号を受信すると上位プロセサへ動作応答信
号を送信し、上位プロセサは子プロセサからの動作応答
信号の受信タイミングを監視し、動作応答信号を受信す
れは子プロセサを正常動作中と見做し、受信タイミング
を越えれば再試行を行ない再試行でも失敗すれば子プロ
七すを障害と見做し、各上位プロセサは該プロセサの上
位プロセサ又はマスターズロセサヘの動作応答信号で配
下のプロセサ障害を順次知らせる事により、障害発生プ
ロセサからの障害通知信号が紛失したり、無負荷状態中
にもマスタ・プロセサでシステム全体のプロセサ障害を
把握する事が出来るという効果がある。
第１図は本発明によるプロセサ障害検出方法の一実施例
を示した図である。 １・・・・・・マスタ拳フロセサ、２．３・川・・スレ
ーブ。
を示した図である。 １・・・・・・マスタ拳フロセサ、２．３・川・・スレ
ーブ。
Claims (1)
- 複数のプロセサ間をプロセサ・バスにより接続したマル
チプロセサ・システムに於いて、マスタ・プロセサが他
のスレーブ・プロセサへ周期的に動作確認信号を送信し
、該スレーブ・プロセサは該動作確認信号を受信すると
該マスタ・プロセサへ動作応答信号を送信し、該マスタ
・プロセサは該スレーブ・プロセサからの該動作応答信
号の受信タイミングを監視し、該動作応答信号を受信す
れば該スレーブ・プロセサを正常動作中と見做し、受信
タイミングを越えれば再試行を行ない再試行でも失敗す
れば該スレーブ・プロセサを障害と見做し、複数階層構
成のマルチプロセサ・システムに於いては、各上位プロ
セサが各直属下位の子プロセサへ周期的に動作確認信号
を送信し、該子プロセサは該動作確認信号を受信すると
該上位プロセサへ動作応答信号を送信し、該上位プロセ
サは該子プロセサからの該動作応答信号の受信タイミン
グを監視し、該動作応答信号を受信すれば該子プロセサ
を正常動作中と見做し、受信タイミングを越えれば再試
行を行ない再試行でも失敗すれば該子プロセサを障害と
見做し、各上位プロセサは該プロセサの上位プロセサ又
はマスタ・プロセサへの動作応答信号で配下のプロセサ
障害を順次知らせる事により、マスタ・プロセサでシス
テム全体のプロセサ障害を把握する事を特徴とするマル
チプロセサ・システムに於けるプロセサ障害検出方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61017120A JPS62174838A (ja) | 1986-01-28 | 1986-01-28 | マルチプロセサ・システムに於けるプロセサ障害検出方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61017120A JPS62174838A (ja) | 1986-01-28 | 1986-01-28 | マルチプロセサ・システムに於けるプロセサ障害検出方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62174838A true JPS62174838A (ja) | 1987-07-31 |
Family
ID=11935173
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61017120A Pending JPS62174838A (ja) | 1986-01-28 | 1986-01-28 | マルチプロセサ・システムに於けるプロセサ障害検出方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62174838A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH05216855A (ja) * | 1992-02-04 | 1993-08-27 | Fujitsu Ltd | マルチｃｐｕ制御方式 |
| US7043561B2 (en) | 2001-04-25 | 2006-05-09 | Nec Corporation | System and method for prioritizing requests for server services |
| JP2014146176A (ja) * | 2013-01-29 | 2014-08-14 | Nec Access Technica Ltd | デバイスの状態監視方法 |
-
1986
- 1986-01-28 JP JP61017120A patent/JPS62174838A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH05216855A (ja) * | 1992-02-04 | 1993-08-27 | Fujitsu Ltd | マルチｃｐｕ制御方式 |
| US7043561B2 (en) | 2001-04-25 | 2006-05-09 | Nec Corporation | System and method for prioritizing requests for server services |
| JP2014146176A (ja) * | 2013-01-29 | 2014-08-14 | Nec Access Technica Ltd | デバイスの状態監視方法 |
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