JPS61245283A - 画像メモリの処理方式 - Google Patents
画像メモリの処理方式Info
- Publication number
- JPS61245283A JPS61245283A JP8670085A JP8670085A JPS61245283A JP S61245283 A JPS61245283 A JP S61245283A JP 8670085 A JP8670085 A JP 8670085A JP 8670085 A JP8670085 A JP 8670085A JP S61245283 A JPS61245283 A JP S61245283A
- Authority
- JP
- Japan
- Prior art keywords
- central processing
- processing unit
- memory
- arithmetic
- address
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔概要〕
画像メモリの処理方式であって、画像データをビット構
成からなるビットマツプのイメージデータとして格納す
るメモリを有する制御装置において、メモリの読取りデ
ータに演算を加え、演算値を書込む演算部を設け、演算
部の演算形式を指定できるよう構成し、中央処理装置の
負荷の軽減を図る。
成からなるビットマツプのイメージデータとして格納す
るメモリを有する制御装置において、メモリの読取りデ
ータに演算を加え、演算値を書込む演算部を設け、演算
部の演算形式を指定できるよう構成し、中央処理装置の
負荷の軽減を図る。
画像データを印刷装置及びCRT表示装置に出力するの
に、画像データをビットマツプ形式のイメージ・データ
として格納するメモリ、即ちビットマツプ・メモリが用
いられている。このビットマツプ・メモリは厖大な容量
を必要とし、又このメモリを利用するCRT表示装置等
は複数であることから、CRT表示装置等とメモリとを
制御する制御装置が用いられている。
に、画像データをビットマツプ形式のイメージ・データ
として格納するメモリ、即ちビットマツプ・メモリが用
いられている。このビットマツプ・メモリは厖大な容量
を必要とし、又このメモリを利用するCRT表示装置等
は複数であることから、CRT表示装置等とメモリとを
制御する制御装置が用いられている。
一般に、この制御装置は、中央処理装置を内蔵し、この
中央処理装置がメモリの読取りを行ったデータに演算を
して、演算結果をメモリに書込むことをしている。
中央処理装置がメモリの読取りを行ったデータに演算を
して、演算結果をメモリに書込むことをしている。
中央処理装置がメモリの読み/書きを行う場合には、勿
論中央処理装置のアドレス指示に基づいて行う。ところ
が、ビットマツプ・メモリは、1アドレスに対して、例
えば8ビツトのビットデータで構成されている。
論中央処理装置のアドレス指示に基づいて行う。ところ
が、ビットマツプ・メモリは、1アドレスに対して、例
えば8ビツトのビットデータで構成されている。
従って、第2図に示すように、既に、メモリに格納され
たABのデータにCDなるデータを加え・さらにABと
CDの交点を白抜きにしたいような要求があると、中央
処理装置はアドレスを指定して、該当するアドレスのデ
ータを読取り、すれにCDを加える書込みを行う。この
結果は、第3図に示すようになる。
たABのデータにCDなるデータを加え・さらにABと
CDの交点を白抜きにしたいような要求があると、中央
処理装置はアドレスを指定して、該当するアドレスのデ
ータを読取り、すれにCDを加える書込みを行う。この
結果は、第3図に示すようになる。
これを目的とする画像を得ようとすると、中央処理装置
は読取ったデータに所要の演算を行わねばならず、中央
処理装置の負荷は増大し、又このためのプログラム作成
に時間を要するばかりでなアドレス指定、読取り、演算
、書込みの工程を必要とすることとなる。
は読取ったデータに所要の演算を行わねばならず、中央
処理装置の負荷は増大し、又このためのプログラム作成
に時間を要するばかりでなアドレス指定、読取り、演算
、書込みの工程を必要とすることとなる。
従って、要求される画像を容易に得られ、中央処理装置
の負荷を軽減することのできる画像メモリの処理方式が
要望されている。
の負荷を軽減することのできる画像メモリの処理方式が
要望されている。
従来の方式にては、所要の画像を得ようとするとその度
に、プログラムの作成とプログラム処理のために中央処
理装置の負荷が増大すると云うことが生じた。
に、プログラムの作成とプログラム処理のために中央処
理装置の負荷が増大すると云うことが生じた。
本発明はこのような点にかんがみて創作されたもので、
簡易な構成で中央処理装置の負荷軽減の図れ、しかも書
替え処理が迅速に行える画像メモリの処理方式を提供す
ること目的としている。
簡易な構成で中央処理装置の負荷軽減の図れ、しかも書
替え処理が迅速に行える画像メモリの処理方式を提供す
ること目的としている。
制御装置のメモリにビット単位に演算を行う演算部を付
設すると共に、演算部の演算形式を中央処理装置が指示
できる構成としている。
設すると共に、演算部の演算形式を中央処理装置が指示
できる構成としている。
所要とする演算形式を中央処理装置が指示することによ
り、アドレスに基づくデータの各ビットが演算部にて演
算され、メモリに書込まれ、中央処理装置の負荷軽減と
処理速度の向上が図れる。
り、アドレスに基づくデータの各ビットが演算部にて演
算され、メモリに書込まれ、中央処理装置の負荷軽減と
処理速度の向上が図れる。
第1図は本発明の実施例であって、制御装置3は、中央
処理装置1とビットマツプ・メモリ (メモリと記す)
2と演算部4とレジスタ5とで構成されている。中央処
理装置1は演算部4に対して、例えば排他的論理和、論
理和等の指示を行う。演算部4は中央処理装置の指示に
基づいて、該当する演算を行う。
処理装置1とビットマツプ・メモリ (メモリと記す)
2と演算部4とレジスタ5とで構成されている。中央処
理装置1は演算部4に対して、例えば排他的論理和、論
理和等の指示を行う。演算部4は中央処理装置の指示に
基づいて、該当する演算を行う。
中央処理装置1は所要とするアドレスで演算部4を介し
てメモリ2をアクセスする。メモリ2から読取られたデ
ータは、レジスタ5に格納され、次に中央処理装置1か
ら入力されるデータとレジスタ5のデータとの演算を行
い、上記したアドレスに演算値を書込む。
てメモリ2をアクセスする。メモリ2から読取られたデ
ータは、レジスタ5に格納され、次に中央処理装置1か
ら入力されるデータとレジスタ5のデータとの演算を行
い、上記したアドレスに演算値を書込む。
尚、レジスタ5はアドレスで構成されるビット数、例え
ば8ビツトで構成され、演算部4も演算形式、例えば排
他的論理和がビット数に対応する8個設けである。
ば8ビツトで構成され、演算部4も演算形式、例えば排
他的論理和がビット数に対応する8個設けである。
従って、本実施例の中央処理装置は、演算形式指示と1
回のアドレス指示によって演算値をメモリ2に格納する
こととなり、中央処理装置1は演算を行うことなく、ア
ドレス指示と書込み指示のみで処理時間の短縮が図れる
。
回のアドレス指示によって演算値をメモリ2に格納する
こととなり、中央処理装置1は演算を行うことなく、ア
ドレス指示と書込み指示のみで処理時間の短縮が図れる
。
従来例にて説明した第3図の画像データを得ようとする
と、中央処理装置1は演算部4に排他的論理和の指示と
該当するアドレスの指示と書込み指示を行うのみにて所
要の画像データが得られる。
と、中央処理装置1は演算部4に排他的論理和の指示と
該当するアドレスの指示と書込み指示を行うのみにて所
要の画像データが得られる。
以上述べてきたように、本発明によれば、極めて簡易な
構成で所要とする画像データが得られ、中央処理装置の
負荷軽減及び処理時間の短縮が図れ、実用的に極めて有
用なものとなる。
構成で所要とする画像データが得られ、中央処理装置の
負荷軽減及び処理時間の短縮が図れ、実用的に極めて有
用なものとなる。
第1図は本発明の実施例のブロック図、第2図は所要と
する画像データの模式図、第3図は従来方式による画像
データの模式図である。 図において、1は中央処理装置、2はメモリ、3は制御
装置、4は演算部を示す。 ン1ミa’Err )町:20(辷t)J47”D・y
7@Il1図 第2F!!J @葺粗方’1!;:、 tz z4里4象デゝりのネ莞
大ヨコ第3図
する画像データの模式図、第3図は従来方式による画像
データの模式図である。 図において、1は中央処理装置、2はメモリ、3は制御
装置、4は演算部を示す。 ン1ミa’Err )町:20(辷t)J47”D・y
7@Il1図 第2F!!J @葺粗方’1!;:、 tz z4里4象デゝりのネ莞
大ヨコ第3図
Claims (1)
- 【特許請求の範囲】 中央処理装置(1)とメモリ(2)とを有し、前記中央
処理装置(1)のアドレス指示に基づき前記メモリ(2
)の読取り演算を行い演算値の書込みをする制御装置(
3)において、 前記メモリ(2)に演算部(4)を付設すると共に、該
演算部(4)の演算形式を変えられるように構成し、前
記中央処理装置(1)の読取リアドレスによって所要の
ビット単位の演算を行い、演算値を前記メモリに書込む
よう構成したことを特徴とする画像メモリの処理方式。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP8670085A JPS61245283A (ja) | 1985-04-22 | 1985-04-22 | 画像メモリの処理方式 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP8670085A JPS61245283A (ja) | 1985-04-22 | 1985-04-22 | 画像メモリの処理方式 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS61245283A true JPS61245283A (ja) | 1986-10-31 |
Family
ID=13894217
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP8670085A Pending JPS61245283A (ja) | 1985-04-22 | 1985-04-22 | 画像メモリの処理方式 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS61245283A (ja) |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS58129552A (ja) * | 1982-01-28 | 1983-08-02 | Hitachi Ltd | 演算処理装置 |
JPS58178470A (ja) * | 1982-04-14 | 1983-10-19 | Hitachi Ltd | メモリ制御装置 |
-
1985
- 1985-04-22 JP JP8670085A patent/JPS61245283A/ja active Pending
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS58129552A (ja) * | 1982-01-28 | 1983-08-02 | Hitachi Ltd | 演算処理装置 |
JPS58178470A (ja) * | 1982-04-14 | 1983-10-19 | Hitachi Ltd | メモリ制御装置 |
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