JPS61175746A - 計算機システム - Google Patents
計算機システムInfo
- Publication number
- JPS61175746A JPS61175746A JP60015823A JP1582385A JPS61175746A JP S61175746 A JPS61175746 A JP S61175746A JP 60015823 A JP60015823 A JP 60015823A JP 1582385 A JP1582385 A JP 1582385A JP S61175746 A JPS61175746 A JP S61175746A
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- JP
- Japan
- Prior art keywords
- input
- server
- output
- type
- central processing
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
- G06F13/10—Program control for peripheral devices
Landscapes
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、システム立上げ時に補助記憶装置からシステ
ムを構成する各装置に制御プログラムをローデングする
ようにした計算機システムに関するものである。
ムを構成する各装置に制御プログラムをローデングする
ようにした計算機システムに関するものである。
第３図は従来の計算機システムの構成例を示すブロック
図である。図において、１は装置個有の制御プログラム
にもとづき利用者のアプリケーションプログラムを実行
する中央処理装置（以下、プログラムサーバと記す）
、２１． ２２−＝２ ｎはそれぞれ個有の制御プログ
ラムにもとづき図示を省略した各種入出力装置を制御す
る入出力制御装置（以下、入出力サーバと記す）、３は
上記各装置間を接続するシステムバス、４は上記各種プ
ロダラム及びデータが記憶される磁気ディスク等の補助
記憶装置であり、上記したプログラムサーバ１及び各入
出力サーバ２１〜２ｎ用の制御プログラムファイル４ａ
やシステムの構成及び各種別を予め登録した構成テーブ
ル４ｂ等が記憶されている。
図である。図において、１は装置個有の制御プログラム
にもとづき利用者のアプリケーションプログラムを実行
する中央処理装置（以下、プログラムサーバと記す）
、２１． ２２−＝２ ｎはそれぞれ個有の制御プログ
ラムにもとづき図示を省略した各種入出力装置を制御す
る入出力制御装置（以下、入出力サーバと記す）、３は
上記各装置間を接続するシステムバス、４は上記各種プ
ロダラム及びデータが記憶される磁気ディスク等の補助
記憶装置であり、上記したプログラムサーバ１及び各入
出力サーバ２１〜２ｎ用の制御プログラムファイル４ａ
やシステムの構成及び各種別を予め登録した構成テーブ
ル４ｂ等が記憶されている。
次に動作について説明する。プログラムサーバ１および
各入出力サーバ２１〜２ｎは、電源立上げ時には制御プ
ログラムを保持しておらず、次に示す制御プログラムロ
ーディング手順を実行できるだけの機能を有している。
各入出力サーバ２１〜２ｎは、電源立上げ時には制御プ
ログラムを保持しておらず、次に示す制御プログラムロ
ーディング手順を実行できるだけの機能を有している。
電源立上げ時、プログラムサーバ１は補助記憶装置４内
にあるプログラムファイル４ａの中から自己の制御プロ
グラムを読込む。次に構成テーブル４ｂを読込み、該計
算機システムの各入出力サーバ２１〜２ｎの種別と構成
を知る。次にプログラムサーバ１は上記構成テーブル４
ｂの示す内容に従って各入出力サーバ２１〜２ｎに対応
する制御プログラムをプログラムファイル４ａの中から
順次読込み、システムバス３を介して各入出力サーバ２
１〜２ｎへのローディングを行なう。この動作は、構成
テーブル４ｂに登録されているすべての入出力サーバ２
１〜２ｎに対して行なわれる。
にあるプログラムファイル４ａの中から自己の制御プロ
グラムを読込む。次に構成テーブル４ｂを読込み、該計
算機システムの各入出力サーバ２１〜２ｎの種別と構成
を知る。次にプログラムサーバ１は上記構成テーブル４
ｂの示す内容に従って各入出力サーバ２１〜２ｎに対応
する制御プログラムをプログラムファイル４ａの中から
順次読込み、システムバス３を介して各入出力サーバ２
１〜２ｎへのローディングを行なう。この動作は、構成
テーブル４ｂに登録されているすべての入出力サーバ２
１〜２ｎに対して行なわれる。
以上で計算機システムの立上げが完了する。
プログラムサーバ１は、この後補助記憶装置４の他の領
域に記憶されているアプリケーションプログラムを読み
込み、実行する。
域に記憶されているアプリケーションプログラムを読み
込み、実行する。
しかしながら、従来のこのような計算機システムでは、
構成テーブル４ｂをシステム構成に対応して作成するこ
とが必要であり、システム構成を変えるときにはその都
度この構成テーブルを作りなおさなければならないとい
う問題点を有していた。
構成テーブル４ｂをシステム構成に対応して作成するこ
とが必要であり、システム構成を変えるときにはその都
度この構成テーブルを作りなおさなければならないとい
う問題点を有していた。
本発明は係る問題点を解決するためになされたもので、
システム構成テーブルの作成を不要とすることができる
計算機システムを得ることを目的とするものである。
システム構成テーブルの作成を不要とすることができる
計算機システムを得ることを目的とするものである。
本発明に係る計算機システムは、中央処理装置に、入出
力制御装置を接続可能なシステムバスの全アドレスに対
してシステム立上げ時上記各入出力制御装置の種別を問
合せる種別問合せ手段と、この問合せに対する応答情報
にもとづきシステム構成テーブルを生成するテーブル生
成手段とを備えるとともに、上記各入出力制御装置に、
上記中央処理装置からの種別問合せに対して応答情報を
返送する種別応答手段を備えたものである。
力制御装置を接続可能なシステムバスの全アドレスに対
してシステム立上げ時上記各入出力制御装置の種別を問
合せる種別問合せ手段と、この問合せに対する応答情報
にもとづきシステム構成テーブルを生成するテーブル生
成手段とを備えるとともに、上記各入出力制御装置に、
上記中央処理装置からの種別問合せに対して応答情報を
返送する種別応答手段を備えたものである。
本発明においては、システム立上げ時、中央処理装置に
備えられた種別問合せ手段によりシステムバスに接続さ
れたすべての入出力制御装置に対してその種別の問合せ
がなされ、各入出力制御装置は種別応答手段により上記
問合せに対する応答情報を中央処理装置に返送する。中
央処理装置はテーブル生成手段によりこの応答情報にも
とづくシステム構成テーブルを生成し、このシステム構
成テーブルに従って補助記憶装置から各入出力制御装置
に対応する制御プログラムをローデングする。
備えられた種別問合せ手段によりシステムバスに接続さ
れたすべての入出力制御装置に対してその種別の問合せ
がなされ、各入出力制御装置は種別応答手段により上記
問合せに対する応答情報を中央処理装置に返送する。中
央処理装置はテーブル生成手段によりこの応答情報にも
とづくシステム構成テーブルを生成し、このシステム構
成テーブルに従って補助記憶装置から各入出力制御装置
に対応する制御プログラムをローデングする。
以下、本発明を第１図及び第２図に示す実施例にもとづ
き説明する。第１図は実施例の構成を示すブロック図で
あり、第３図従来例と同−又は相当部分には同一符号を
用い、その詳細な説明は省略する。図において、ｌａ、
ｌｂ及び２１ａ〜２ｎａはプログラムサーバ１及び各入
出力サーバ２１〜２ｎに新たに備えられたものであり、
１ａはシステム立上げ時に、入出力サーバを接続可能な
システムバス３の全アドレスに対して順次その種別を問
合せる種別センス命令を送出する種別問合せ手段、１ｂ
は上記種別センス命令に対して各入出力サーバ２１〜２
ｎ側から返送される応答情報にもとづき、システムの構
成テーブルＩＣを内臓されたメモリ（図示省略）内に生
成するテーブル生成手段、２１１〜２ｎａは上記種別問
合せ手段１ａからの種別センス命令に対して自己の種別
を示す応答情報を返送する種別応答手段である。
き説明する。第１図は実施例の構成を示すブロック図で
あり、第３図従来例と同−又は相当部分には同一符号を
用い、その詳細な説明は省略する。図において、ｌａ、
ｌｂ及び２１ａ〜２ｎａはプログラムサーバ１及び各入
出力サーバ２１〜２ｎに新たに備えられたものであり、
１ａはシステム立上げ時に、入出力サーバを接続可能な
システムバス３の全アドレスに対して順次その種別を問
合せる種別センス命令を送出する種別問合せ手段、１ｂ
は上記種別センス命令に対して各入出力サーバ２１〜２
ｎ側から返送される応答情報にもとづき、システムの構
成テーブルＩＣを内臓されたメモリ（図示省略）内に生
成するテーブル生成手段、２１１〜２ｎａは上記種別問
合せ手段１ａからの種別センス命令に対して自己の種別
を示す応答情報を返送する種別応答手段である。
なお、補助記憶装置４には従来の構成テーブル４ｂは記
憶されていない。
憶されていない。
次に動作について第２図を用いて説明する。なお、同図
（ａ）はプログラムサーバ１側の動作フローチャート、
同図（ｂ）は各入出力サーバ２１〜２ｎ側の動作フロー
チャートである。
（ａ）はプログラムサーバ１側の動作フローチャート、
同図（ｂ）は各入出力サーバ２１〜２ｎ側の動作フロー
チャートである。
電源オン時、プログラムサーバ１は構成テーブルＩＣを
クリアしくステップ１１）、アドレス１の入出力サーバ
２１に対し種別センスを行なうための命令を送る（ステ
ップ１２−１３）。一方、各入出力サーバ２１〜２ｎは
電源オン時、プログラムサーバ１からの種別センス命令
を待っており、この命令を受けるとただちに自己の入出
力サーバ種別を応答情報として送り返す（ステップ１９
−２０）。
クリアしくステップ１１）、アドレス１の入出力サーバ
２１に対し種別センスを行なうための命令を送る（ステ
ップ１２−１３）。一方、各入出力サーバ２１〜２ｎは
電源オン時、プログラムサーバ１からの種別センス命令
を待っており、この命令を受けるとただちに自己の入出
力サーバ種別を応答情報として送り返す（ステップ１９
−２０）。
プログラムサーバｌは、この応答情報を構成テーブル１
ｃに登録する（ステップ１４→１５）。
ｃに登録する（ステップ１４→１５）。
一定時間内に応答を受けなかった場合は、その番号の入
出力サーバは存在しないものとみなし、次のステップに
進む（ステップ１４→１６）プログラムサーバ１は次に
アドレス番号ｉをカウントアツプし、システムで定めら
れた入出力サ−バの最大アドレスｎになるまで上記と同
様の動作をくり返す（ステップ１６−１７−１３）。以
上の動作で、システム固有の構成テーブル１ｃがプログ
ラムサーバ１のメモリ上に構成される。
出力サーバは存在しないものとみなし、次のステップに
進む（ステップ１４→１６）プログラムサーバ１は次に
アドレス番号ｉをカウントアツプし、システムで定めら
れた入出力サ−バの最大アドレスｎになるまで上記と同
様の動作をくり返す（ステップ１６−１７−１３）。以
上の動作で、システム固有の構成テーブル１ｃがプログ
ラムサーバ１のメモリ上に構成される。
以後の動作は第３図で説明した従来のローディング手順
と同様となり、上記構成テーブル１ｃに従って各制御プ
ログラムがロードされ、立上げ手順が完了する（ステッ
プ１８．２１）。
と同様となり、上記構成テーブル１ｃに従って各制御プ
ログラムがロードされ、立上げ手順が完了する（ステッ
プ１８．２１）。
以上説明したように本発明によれば、中央処理装置に、
入出力制御装置を接続可能なシステムバスの全アドレス
に対してシステム立上げ時上記各入出力制御装置の種別
を問合せる種別問合せ手段と、この問合せに対する応答
情報にもとづきシステム構成テーブルを生成するテーブ
ル生成手段とを備えるとともに、上記各入出力制御装置
に、上記中央処理装置からの種別問合せに対して応答情
報を返送する種別応答手段を備えるようにしたことによ
り、システム構成テーブルがその時のシステム構成に対
応して自動的に生成されるので、システム構成テーブル
のユーザによる作成を不要とする計算機システムが得ら
れるという効果がある。
入出力制御装置を接続可能なシステムバスの全アドレス
に対してシステム立上げ時上記各入出力制御装置の種別
を問合せる種別問合せ手段と、この問合せに対する応答
情報にもとづきシステム構成テーブルを生成するテーブ
ル生成手段とを備えるとともに、上記各入出力制御装置
に、上記中央処理装置からの種別問合せに対して応答情
報を返送する種別応答手段を備えるようにしたことによ
り、システム構成テーブルがその時のシステム構成に対
応して自動的に生成されるので、システム構成テーブル
のユーザによる作成を不要とする計算機システムが得ら
れるという効果がある。
第１図は本発明による計算機システムの一実施例を示す
ブロック図、第２図は上記実施例の動作フローチャート
、第３図は従来の計算機システムの一例を示すブロック
図である。 １・・・中央処理装置、１ａ・・・種別問合せ手段、１
ｂ・・・テーブル生成手段、１ｃ・・・システム構成テ
ーブル、２１〜２ｎ・・・入出力制御装置、２１ａ〜２
ｎａ・・・種別応答手段、３・・・システムバス、４・
・・補助記憶装置、４ａ・・・制御プログラムファイル
。 なお、図中間−又は相当部分には同一符号を用いている
。 代理人 大 岩 増 雄（ほか２名）第１図 ２１ａ−２ｎａ：＃ＩＬｊＰＪＡ＠呼隈３： システム
バス ４− ａ’ｊシア□Ｓと・１１号１−キ、う劃４゜ 第２図 （ａ） （ｂ）
ブロック図、第２図は上記実施例の動作フローチャート
、第３図は従来の計算機システムの一例を示すブロック
図である。 １・・・中央処理装置、１ａ・・・種別問合せ手段、１
ｂ・・・テーブル生成手段、１ｃ・・・システム構成テ
ーブル、２１〜２ｎ・・・入出力制御装置、２１ａ〜２
ｎａ・・・種別応答手段、３・・・システムバス、４・
・・補助記憶装置、４ａ・・・制御プログラムファイル
。 なお、図中間−又は相当部分には同一符号を用いている
。 代理人 大 岩 増 雄（ほか２名）第１図 ２１ａ−２ｎａ：＃ＩＬｊＰＪＡ＠呼隈３： システム
バス ４− ａ’ｊシア□Ｓと・１１号１−キ、う劃４゜ 第２図 （ａ） （ｂ）
Claims (1)
- 各種プログラム及びデータが記憶される補助記憶装置と
、システム立上げ時上記補助記憶装置から中央処理用制
御プログラムを読込んで、この制御プログラムにもとづ
き上記補助記憶装置から読込まれるアプリケーションプ
ログラムを実行する中央処理装置と、システム構成テー
ブルに従い上記中央処理装置を介して上記補助記憶装置
から読込まれる入出力用制御プログラムにもとづき各種
入出力装置を制御する複数の入出力制御装置と、上記中
央処理装置と各入出力制御装置間を接続するシステムバ
スとを備えた計算機システムにおいて、上記中央処理装
置に入出力制御装置を接続可能なシステムバスの全アド
レスに対してシステム立上げ時上記各入出力制御装置の
種別を問合せる種別問合せ手段と、この問合せに対する
応答情報にもとづき上記システム構成テーブルを生成す
るテーブル生成手段とを備えるとともに、上記各入出力
制御装置に、上記中央処理装置からの種別問合せに対し
て応答情報を返送する種別応答手段を備えたことを特徴
とする計算機システム。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60015823A JPS61175746A (ja) | 1985-01-30 | 1985-01-30 | 計算機システム |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60015823A JPS61175746A (ja) | 1985-01-30 | 1985-01-30 | 計算機システム |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61175746A true JPS61175746A (ja) | 1986-08-07 |
Family
ID=11899570
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60015823A Pending JPS61175746A (ja) | 1985-01-30 | 1985-01-30 | 計算機システム |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61175746A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0287295A2 (en) * | 1987-04-13 | 1988-10-19 | Prime Computer, Inc. | Multiple I/O bus virtual broadcast of programmed I/O instructions |
| JPH09218777A (ja) * | 1996-02-09 | 1997-08-19 | Nec Corp | コンピュータシステム |
-
1985
- 1985-01-30 JP JP60015823A patent/JPS61175746A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0287295A2 (en) * | 1987-04-13 | 1988-10-19 | Prime Computer, Inc. | Multiple I/O bus virtual broadcast of programmed I/O instructions |
| JPH09218777A (ja) * | 1996-02-09 | 1997-08-19 | Nec Corp | コンピュータシステム |
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