JPS61160124A - メモリ給電方式 - Google Patents
メモリ給電方式Info
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- JPS61160124A JPS61160124A JP59279658A JP27965884A JPS61160124A JP S61160124 A JPS61160124 A JP S61160124A JP 59279658 A JP59279658 A JP 59279658A JP 27965884 A JP27965884 A JP 27965884A JP S61160124 A JPS61160124 A JP S61160124A
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- power supply
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- G—PHYSICS
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- G06F1/00—Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
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- G06F1/30—Means for acting in the event of power-supply failure or interruption, e.g. power-supply fluctuations
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- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02J—CIRCUIT ARRANGEMENTS OR SYSTEMS FOR SUPPLYING OR DISTRIBUTING ELECTRIC POWER; SYSTEMS FOR STORING ELECTRIC ENERGY
- H02J9/00—Circuit arrangements for emergency or stand-by power supply, e.g. for emergency lighting
- H02J9/04—Circuit arrangements for emergency or stand-by power supply, e.g. for emergency lighting in which the distribution system is disconnected from the normal source and connected to a standby source
- H02J9/06—Circuit arrangements for emergency or stand-by power supply, e.g. for emergency lighting in which the distribution system is disconnected from the normal source and connected to a standby source with automatic change-over, e.g. UPS systems
- H02J9/061—Circuit arrangements for emergency or stand-by power supply, e.g. for emergency lighting in which the distribution system is disconnected from the normal source and connected to a standby source with automatic change-over, e.g. UPS systems for DC powered loads
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明は、メモリ(記憶装置)の給電方式に係り、特に
電源装置のAC遮断(パワーオフ)や停電による揮発性
メモリの揮発防止と停電時等におけるバックアップ電源
であるバッテリーの過放電防止に最適なメモリ給電方式
に関する。
電源装置のAC遮断(パワーオフ)や停電による揮発性
メモリの揮発防止と停電時等におけるバックアップ電源
であるバッテリーの過放電防止に最適なメモリ給電方式
に関する。
揮発性メモリの給電方式としては、例えば、特開昭56
−168246号公報、特開昭57−23123号公報
、特開昭59−24323号公報等にみられるように、
主電源の立下がりを検出して自動的にバッテリーに切換
える方式のものが多いが、いずれも停電でないパワーオ
フによる主電源立下り後のバックアップをバッテリーで
一律に行うというものであり、大容量のバッテリーを必
要とする欠点がある。一方、特開昭56−116134
号公報に示されるように、停電時のみバッテリーに切換
えることによりバッテリーの消耗を少なくする方式のも
のもあるが、パワーオフでメモリの電源電圧が立下った
ときにバックアップする点については配慮されていない
。また停電の検出は、入力電源ラインの電圧低下で検出
しているため、電源ラインが交流電源である場合は、そ
の検出回路が複雑となり高価になる点についても配慮が
なされていないのが実情である。
−168246号公報、特開昭57−23123号公報
、特開昭59−24323号公報等にみられるように、
主電源の立下がりを検出して自動的にバッテリーに切換
える方式のものが多いが、いずれも停電でないパワーオ
フによる主電源立下り後のバックアップをバッテリーで
一律に行うというものであり、大容量のバッテリーを必
要とする欠点がある。一方、特開昭56−116134
号公報に示されるように、停電時のみバッテリーに切換
えることによりバッテリーの消耗を少なくする方式のも
のもあるが、パワーオフでメモリの電源電圧が立下った
ときにバックアップする点については配慮されていない
。また停電の検出は、入力電源ラインの電圧低下で検出
しているため、電源ラインが交流電源である場合は、そ
の検出回路が複雑となり高価になる点についても配慮が
なされていないのが実情である。
本発明の目的は、メモリへの電源供給を装置のパワーオ
ン中は主電源により、同パワーオフ中は補助電源により
、そして停電時等にはバッテリーにより行うことによっ
て常に連続的に給電するとともに、前記パワーオン中に
発生する停電とパワーオフ中に発生する停電とでバッテ
リーバックアップ時間を異ならしめ、バッテリーの過放
電防止を図るものである。
ン中は主電源により、同パワーオフ中は補助電源により
、そして停電時等にはバッテリーにより行うことによっ
て常に連続的に給電するとともに、前記パワーオン中に
発生する停電とパワーオフ中に発生する停電とでバッテ
リーバックアップ時間を異ならしめ、バッテリーの過放
電防止を図るものである。
一般にメモリは、アクセス時は大きな電力を消費するが
、情報の保持のみの時は小さな電力でよい、このことに
鑑み1本発明はメモリアクセスによる消費電力が大であ
るパワーオン中は主電源から給電し、スタンバイ時であ
るパワーオフ中はバッテリーでない補助電源から給電し
、停電時のみバッテリーによりバックアップする。また
、バッテリーは過放電すると寿命が短かくなることを配
慮して、重要情報をフロッピーディスク等の不揮発性メ
モリに退避する余裕のないパワーオン中の停電には長時
間バックアップが可能なようにバッテリーバックアップ
時間を設定するが1重要情報が退避済みのパワーオフ中
の停電や不意のAC遮断には短時間バックアップとし、
バッテリーの過放電を防止している。
、情報の保持のみの時は小さな電力でよい、このことに
鑑み1本発明はメモリアクセスによる消費電力が大であ
るパワーオン中は主電源から給電し、スタンバイ時であ
るパワーオフ中はバッテリーでない補助電源から給電し
、停電時のみバッテリーによりバックアップする。また
、バッテリーは過放電すると寿命が短かくなることを配
慮して、重要情報をフロッピーディスク等の不揮発性メ
モリに退避する余裕のないパワーオン中の停電には長時
間バックアップが可能なようにバッテリーバックアップ
時間を設定するが1重要情報が退避済みのパワーオフ中
の停電や不意のAC遮断には短時間バックアップとし、
バッテリーの過放電を防止している。
以下1本発明の実施例を第1図により説明する。
同図において、1はAC人力Vinを受電するためのプ
ラグであり、2は該AC人力Vinを直流に変換する変
換部を有する電源装置である。該電源装置E2は、該装
置のパワーオン操作で出力する主電源出力vMと、AC
入力Vinを受電していれば上記装置をパワーオフ操作
しても出力を維持する補助電源出力vAの各端子を備え
ている。主電源出力vMは図示しない他の制御回路にも
使用され。
ラグであり、2は該AC人力Vinを直流に変換する変
換部を有する電源装置である。該電源装置E2は、該装
置のパワーオン操作で出力する主電源出力vMと、AC
入力Vinを受電していれば上記装置をパワーオフ操作
しても出力を維持する補助電源出力vAの各端子を備え
ている。主電源出力vMは図示しない他の制御回路にも
使用され。
該出力が立上ると装置の各部分は正常動作することがで
きる。補助電源出力vAはパワーオフ時。
きる。補助電源出力vAはパワーオフ時。
メモリ(記憶装置)4の給電を受は持つものであるが、
これは図示しないパワーオン、パワーオフの制御電源と
しても使用される。
これは図示しないパワーオン、パワーオフの制御電源と
しても使用される。
電源装置2の主電源出力vMは、ダイオードDlを介し
て直流安定化回路3に接続され、該回路3の出力からメ
モリ4に供給される。また、主電源出力vMには、その
立上り、立下りを検出するツェナーダイオードZDIと
抵抗R1の直列回路が接続されている。補助電源出力v
Aは、ダイオードD2を介してPNPトランジスタQ1
のエミッタに接続され、そのコレクタは直流安定化回路
3の入力に接続される。ダイオードD2のカソード側に
はバッテリー充電回路5を接続し、該回路の出力と大地
間にバッテリーv7を設ける。バッテリーvRの+側は
、ダイオードD3を介してトランジスタQ1のエミッタ
にも接続する。トランジスタQ1のオン・オフのスイッ
チ動作を制御するために、該トランジスタQlのベース
に、抵抗R2を介してNPNトランジスタQ2を設け、
該トランジスタのバイアスは抵抗R3を介してバッテリ
ーv8から供給される。トランジスタQ2のベースには
、PNPトランジスタQ3が接続され。
て直流安定化回路3に接続され、該回路3の出力からメ
モリ4に供給される。また、主電源出力vMには、その
立上り、立下りを検出するツェナーダイオードZDIと
抵抗R1の直列回路が接続されている。補助電源出力v
Aは、ダイオードD2を介してPNPトランジスタQ1
のエミッタに接続され、そのコレクタは直流安定化回路
3の入力に接続される。ダイオードD2のカソード側に
はバッテリー充電回路5を接続し、該回路の出力と大地
間にバッテリーv7を設ける。バッテリーvRの+側は
、ダイオードD3を介してトランジスタQ1のエミッタ
にも接続する。トランジスタQ1のオン・オフのスイッ
チ動作を制御するために、該トランジスタQlのベース
に、抵抗R2を介してNPNトランジスタQ2を設け、
該トランジスタのバイアスは抵抗R3を介してバッテリ
ーv8から供給される。トランジスタQ2のベースには
、PNPトランジスタQ3が接続され。
トランジスタQ2のオン・オフを制御できるようになっ
ている。トランジスタQ3のオン・オフ制御は、主電源
出力VMの立上りで行うようにするため、ツェナーダイ
オードZDIのアノード側からトランジスタQ3のベー
スに接続し、トランジスタQ3にバイアスする。また、
補助電源出力V1の立上り、立下りを検出するために、
該出力にツェナーダイオードZD2を介して抵抗R4が
接続されている。
ている。トランジスタQ3のオン・オフ制御は、主電源
出力VMの立上りで行うようにするため、ツェナーダイ
オードZDIのアノード側からトランジスタQ3のベー
スに接続し、トランジスタQ3にバイアスする。また、
補助電源出力V1の立上り、立下りを検出するために、
該出力にツェナーダイオードZD2を介して抵抗R4が
接続されている。
6はクロック信号発生回路で、該回路からのクロック信
号はクロックカウンタ7の端子CLに供給される。該カ
ウンタ7の端子Rはクロックカウントを元に戻すリセッ
ト端子であり、補助電源出力vAが立上ると、前記ツェ
ナーダイオードZD2と抵抗R4とにより立上りを検出
し、ドライバ回路8により、ドライブされ、リセットさ
れる。
号はクロックカウンタ7の端子CLに供給される。該カ
ウンタ7の端子Rはクロックカウントを元に戻すリセッ
ト端子であり、補助電源出力vAが立上ると、前記ツェ
ナーダイオードZD2と抵抗R4とにより立上りを検出
し、ドライバ回路8により、ドライブされ、リセットさ
れる。
またクロックカウンタ7は、出力端子C1とC2を備え
ており、該カウンタが計時し、所定時間をカウントする
と出力パルスを出す、ここでは、端子C1は短時間1例
えば15分、端子C2はそれより長い、例えば2時間の
カウントでそれぞれ出力パルスを出すものとする。9は
フリップフロップ回路で、クロックカランタフの端子C
2の出力でセットされ、ドライバ回路8の出力でリセッ
トされる。10はパワーオフの状況を指示するパワーオ
フ指示信号P−OFF−Nの入力端子であり。
ており、該カウンタが計時し、所定時間をカウントする
と出力パルスを出す、ここでは、端子C1は短時間1例
えば15分、端子C2はそれより長い、例えば2時間の
カウントでそれぞれ出力パルスを出すものとする。9は
フリップフロップ回路で、クロックカランタフの端子C
2の出力でセットされ、ドライバ回路8の出力でリセッ
トされる。10はパワーオフの状況を指示するパワーオ
フ指示信号P−OFF−Nの入力端子であり。
該信号は停電等、パワーオフ操作しないで電源装置2が
オフになった場合は出力されない。該信号は論理積回路
12の一方の端子に接続され、該回路の他方の端子には
クロックカウンタ7の端子C1が接続される。論理積回
路12の出力は、フリッププロップ回路13のセット端
子に接続される。
オフになった場合は出力されない。該信号は論理積回路
12の一方の端子に接続され、該回路の他方の端子には
クロックカウンタ7の端子C1が接続される。論理積回
路12の出力は、フリッププロップ回路13のセット端
子に接続される。
11はパワーオンの状況を指示するパワーオン指示信号
P−ON−Pの入力端子で、該入力は前記フリップフロ
ップ回路13のリセット端子に接続される。論理和回路
14は、ブリップフロップ回路9及びフリップフロップ
回路13の論理和をとり、その出力はトランジスタQ2
のベース端子に接続され、該トランジスタを強制的にオ
フにするよう作動する。
P−ON−Pの入力端子で、該入力は前記フリップフロ
ップ回路13のリセット端子に接続される。論理和回路
14は、ブリップフロップ回路9及びフリップフロップ
回路13の論理和をとり、その出力はトランジスタQ2
のベース端子に接続され、該トランジスタを強制的にオ
フにするよう作動する。
なお、上記トランジスタQl−Q3.グロックカウンタ
7やフリップフロップ回路9.13等の電源には、バッ
テリーvoが使われてもよい。また、パワーオフ指示端
子lOやパワーオン指示端子11は当該装置のコンソー
ル等に用意されているものである。
7やフリップフロップ回路9.13等の電源には、バッ
テリーvoが使われてもよい。また、パワーオフ指示端
子lOやパワーオン指示端子11は当該装置のコンソー
ル等に用意されているものである。
次に、第1図の動作を説明する。第2図はそれに必要な
各信号のタイミング関係を示したものである。
各信号のタイミング関係を示したものである。
まず前提毫件として、バッテリーv8は充分に充電され
ており、メモリ4には情報が保持されていて、電源装置
!2はパワーオンされているものとする。また、フリッ
プフロップ回路9及び13はリセット状態とする。
ており、メモリ4には情報が保持されていて、電源装置
!2はパワーオンされているものとする。また、フリッ
プフロップ回路9及び13はリセット状態とする。
電源装置2がパワーオンであるから、主電源出力VMは
出力しており、直流安定化回路3には正常電圧が印加さ
れてメモリ4に電圧Vccが供給されている。主電源出
力vMが出力しているので。
出力しており、直流安定化回路3には正常電圧が印加さ
れてメモリ4に電圧Vccが供給されている。主電源出
力vMが出力しているので。
ツェナーダイオードZDIはオンして、抵抗R1にもバ
イアス電圧が印加され、トランジスタQ3がオンとなり
、トランジスタQ2及びQlはそれぞれオフとなる。そ
のため、補助電源出力v8と、バッテリーvoからの電
力供給はない。このように、パワーオン中は、メモリ4
への電力供給は主電源出力vMによって行われる。
イアス電圧が印加され、トランジスタQ3がオンとなり
、トランジスタQ2及びQlはそれぞれオフとなる。そ
のため、補助電源出力v8と、バッテリーvoからの電
力供給はない。このように、パワーオン中は、メモリ4
への電力供給は主電源出力vMによって行われる。
次に、電源装置2をパワーオフすると、主電源出力VM
が立下がるので、ツェナーダイオードZDIが規定電圧
でオフとなり、トランジスタQ3はオフとなる。したが
ってトランジスタQ2がオン、トランジスタQlもオン
して、直流安定化回路3には主電源出力v4より小さい
補助電源出力vAが供給され、メモリ4には、その内容
が保持されるに足る電圧が印加される。
が立下がるので、ツェナーダイオードZDIが規定電圧
でオフとなり、トランジスタQ3はオフとなる。したが
ってトランジスタQ2がオン、トランジスタQlもオン
して、直流安定化回路3には主電源出力v4より小さい
補助電源出力vAが供給され、メモリ4には、その内容
が保持されるに足る電圧が印加される。
このとき、即ち正常パワーオフ時に停電が生じAC入力
Vinがオフになると、補助電源出力vAも立下るが1
代ってバッテリー充電回路5で充電されていたバッテリ
ーv8からの電力がダイオードD3を通して直流安定化
回路13に給電されるので、メモリ4の内容は保持を続
ける。
Vinがオフになると、補助電源出力vAも立下るが1
代ってバッテリー充電回路5で充電されていたバッテリ
ーv8からの電力がダイオードD3を通して直流安定化
回路13に給電されるので、メモリ4の内容は保持を続
ける。
一方、上記停電による補助電源出力vAの立下りにより
、ツェナーダイオードZD2がオフしてドライバ回路8
がオフとなり、クロックカウンタ7及びフリップフロッ
プ回路9のリセットが解除される。クロックカランタフ
のリセットが解除されると、該カウンタはクロック信号
発生回路6からのクロック信号により計時を開始し、1
5分間が経過しても停電が回復しない場合に、その端子
C1から出力信号を生ず。また端子10には、正常パワ
ーオフ後の停電のため、既に正常パワーオンによる信号
P−OFF−Nがきており、このP・0FF−N信号と
クロックカウンタ7の端子C1の出力とで論理積回路1
2は論理積が成立し、フリップフロップ回路13がセッ
トされる。該フリップフロップ回路13のリセット端子
へは、パワーオフ中のため、端子Ifを経てパワーオン
指示信号P−ON−Pはきておらず、リセットされない
。したがって、ブリップフロップ回路13のセット信号
がその1端子から出て、論理和回路14がオンして、ト
ランジスタQ2のベースバイアスを強制的に引き抜き、
トランジスタQ2がオフ、トランジスタQlもオフとな
り、バッテリーv!Iからのバックアップは停止する。
、ツェナーダイオードZD2がオフしてドライバ回路8
がオフとなり、クロックカウンタ7及びフリップフロッ
プ回路9のリセットが解除される。クロックカランタフ
のリセットが解除されると、該カウンタはクロック信号
発生回路6からのクロック信号により計時を開始し、1
5分間が経過しても停電が回復しない場合に、その端子
C1から出力信号を生ず。また端子10には、正常パワ
ーオフ後の停電のため、既に正常パワーオンによる信号
P−OFF−Nがきており、このP・0FF−N信号と
クロックカウンタ7の端子C1の出力とで論理積回路1
2は論理積が成立し、フリップフロップ回路13がセッ
トされる。該フリップフロップ回路13のリセット端子
へは、パワーオフ中のため、端子Ifを経てパワーオン
指示信号P−ON−Pはきておらず、リセットされない
。したがって、ブリップフロップ回路13のセット信号
がその1端子から出て、論理和回路14がオンして、ト
ランジスタQ2のベースバイアスを強制的に引き抜き、
トランジスタQ2がオフ、トランジスタQlもオフとな
り、バッテリーv!Iからのバックアップは停止する。
つまり、正常パワーオフの停電では、15分間のみバッ
テリーバックアップを行う。
テリーバックアップを行う。
次に正常パワーオン時にいきなり停電になると。
端子10にはパワーオフ指示信号P・0FF−Nが生じ
ないので、クロックカウンタ7が15分間経過後にその
端子C1に出力がでても、論理積回路12は成立せず、
フリップフロップ回路13はセットされない。停電が2
時間経過しても回復しないときは、その時点でクロック
カランタフの端子C2から出力信号が出て、フリップフ
ロップ回路9がセットされ、論理和回路14がオンする
。
ないので、クロックカウンタ7が15分間経過後にその
端子C1に出力がでても、論理積回路12は成立せず、
フリップフロップ回路13はセットされない。停電が2
時間経過しても回復しないときは、その時点でクロック
カランタフの端子C2から出力信号が出て、フリップフ
ロップ回路9がセットされ、論理和回路14がオンする
。
したがって、トランジスタQ2を強制的にオフにし、ト
ラジスタQ1がオフになり、バッテリーバックアンプは
止まる。つまり、パワーオン中の停電では2時間のバッ
クアップが行われることになる。
ラジスタQ1がオフになり、バッテリーバックアンプは
止まる。つまり、パワーオン中の停電では2時間のバッ
クアップが行われることになる。
一般に、揮発性メモリ内の情報はパワーオフ前に、不揮
発性メモリである例えばフロッピーディスク、固定ディ
スクあるいは他の記憶装置に転送し、重要データを事前
に退避しているが、パワーオン時、該不揮発性メ1モリ
から再ロードする時間を短縮するため、パワーオフ中、
補助電源よりメモリに電力を供給して、その内容を保持
しておくことは有効である。これは、仮にパワーオフ中
に停電してもバッテリーより続けることが望ましい。
発性メモリである例えばフロッピーディスク、固定ディ
スクあるいは他の記憶装置に転送し、重要データを事前
に退避しているが、パワーオン時、該不揮発性メ1モリ
から再ロードする時間を短縮するため、パワーオフ中、
補助電源よりメモリに電力を供給して、その内容を保持
しておくことは有効である。これは、仮にパワーオフ中
に停電してもバッテリーより続けることが望ましい。
しかし、バッテリーの放電量が大きいと、充電にも長時
間を要するため、パワーオフ中の停電等では9重要デー
タが事前に不揮発性メモリに退避されていることに鑑み
、メモリを短時間(実施例では15分間)バックアップ
してバッテリーの消耗を少なくする6すなわちパワーオ
フ中には停電であったか、電源交流入力コンセント引き
抜きによるAC遮断か、あるいはACスイッチによるA
C遮断かどうかの判別ができないため、これらの場合に
よるAC遮断に対するバックアップを短時間で止めて、
バッテリー放電を少なくすることにより、再立上げ後の
長時間停電に充分備えるのである。一方、パワーオン時
の停電では、メモリ上の情報を他の不揮発性メモリに退
避する時間がないので、バッテリーによりメモリを長時
間(実施例では2時間)バックアップして停電の回復を
待つのである。
間を要するため、パワーオフ中の停電等では9重要デー
タが事前に不揮発性メモリに退避されていることに鑑み
、メモリを短時間(実施例では15分間)バックアップ
してバッテリーの消耗を少なくする6すなわちパワーオ
フ中には停電であったか、電源交流入力コンセント引き
抜きによるAC遮断か、あるいはACスイッチによるA
C遮断かどうかの判別ができないため、これらの場合に
よるAC遮断に対するバックアップを短時間で止めて、
バッテリー放電を少なくすることにより、再立上げ後の
長時間停電に充分備えるのである。一方、パワーオン時
の停電では、メモリ上の情報を他の不揮発性メモリに退
避する時間がないので、バッテリーによりメモリを長時
間(実施例では2時間)バックアップして停電の回復を
待つのである。
本発明によれば、メモリには電源状態に関係なく常に連
続的に電力が供給されてバックアップすることができ、
また、バッテリーは停電時等のみ放電するようにし、さ
らに停電時等の装置の状態によりバックアップ時間を制
限するため、バッテリーの過放電を防止することができ
る。
続的に電力が供給されてバックアップすることができ、
また、バッテリーは停電時等のみ放電するようにし、さ
らに停電時等の装置の状態によりバックアップ時間を制
限するため、バッテリーの過放電を防止することができ
る。
第1図は本発明の一実施例の回路図、第2図は各動作の
タイミング図である。 ■・・・ACコンセント、 2・・・電源装置、3・・
・直流安定化回路、 4・・・メモリ。 5・・・バッテリー充電回路、 6・・・クロック信
号発生装置、 7・・・計時装置、 8・・・ドライバ
回路、 9.13・・・フリップフロップ回路。 lO・・・パワーオフ指示信号入力端子。 11・・・パワーオン指示信号入力端子。 12・・・論理積回路、 14・・・論理和回路。 第 1 図 第 2 図
タイミング図である。 ■・・・ACコンセント、 2・・・電源装置、3・・
・直流安定化回路、 4・・・メモリ。 5・・・バッテリー充電回路、 6・・・クロック信
号発生装置、 7・・・計時装置、 8・・・ドライバ
回路、 9.13・・・フリップフロップ回路。 lO・・・パワーオフ指示信号入力端子。 11・・・パワーオン指示信号入力端子。 12・・・論理積回路、 14・・・論理和回路。 第 1 図 第 2 図
Claims (2)
- (1)パワーオン操作で立ち上がり、パワーオフ操作で
立ち下がる主電源と、前記主電源が立ち下がると閉路す
るスイッチ回路を介し、パワーオフ操作によっても有効
となっている補助電源と、該補助電源の出力に逆流防止
回路を介して接続されたバッテリーとを具備し、メモリ
への給電を、パワーオン中は前記主電源により、パワー
オフ中は前記スイッチ回路を介して前記補助電源により
行い、前記主電源と補助電源がともに立ち下がると前記
バッテリーにより行うことを特徴とするメモリ給電方式
。 - (2)少なくとも前記補助電源が立ち下がると計時を開
始して、第1の所定時間を経過すると第1の信号を、前
記第1の所定時間より長い第2の所定時間を経過すると
、第2の信号を出力する計時手段を設け、パワーオフ中
に前記主電源と補助電源がともに立ち下がった場合は、
前記第1の信号によって前記スイッチ回路を開路状態に
して前記バッテリーによるその後の給電を止め、パワー
オン中に前記主電源と補助電源がともに立ち下がった場
合は、前記第2の信号によって前記スイッチ回路を開路
状態にして前記バッテリーによるその後の給電を止める
ことを特徴とする特許請求の範囲第1項記載のメモリ給
電方式。
Priority Applications (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP59279658A JPS61160124A (ja) | 1984-12-29 | 1984-12-29 | メモリ給電方式 |
DE8585116468T DE3584769D1 (de) | 1984-12-29 | 1985-12-23 | Stromversorgungssystem fuer ein elektronisches geraet mit speicher. |
EP85116468A EP0187369B1 (en) | 1984-12-29 | 1985-12-23 | Power supply system for an electronic apparatus having memory |
US06/813,155 US4677311A (en) | 1984-12-29 | 1985-12-24 | Power supply system for an electronic apparatus having memory |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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