JPS61158010A - 磁気ヘツド回路 - Google Patents
磁気ヘツド回路Info
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- JPS61158010A JPS61158010A JP27931884A JP27931884A JPS61158010A JP S61158010 A JPS61158010 A JP S61158010A JP 27931884 A JP27931884 A JP 27931884A JP 27931884 A JP27931884 A JP 27931884A JP S61158010 A JPS61158010 A JP S61158010A
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- transistor
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- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B5/00—Recording by magnetisation or demagnetisation of a record carrier; Reproducing by magnetic means; Record carriers therefor
- G11B5/02—Recording, reproducing, or erasing methods; Read, write or erase circuits therefor
- G11B5/09—Digital recording
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B15/00—Driving, starting or stopping record carriers of filamentary or web form; Driving both such record carriers and heads; Guiding such record carriers or containers therefor; Control thereof; Control of operating function
- G11B15/02—Control of operating function, e.g. switching from recording to reproducing
- G11B15/12—Masking of heads; circuits for Selecting or switching of heads between operative and inoperative functions or between different operative functions or for selection between operative heads; Masking of beams, e.g. of light beams
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
- H03K17/51—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used
- H03K17/56—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices
- H03K17/60—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices the devices being bipolar transistors
- H03K17/66—Switching arrangements for passing the current in either direction at will; Switching arrangements for reversing the current at will
- H03K17/661—Switching arrangements for passing the current in either direction at will; Switching arrangements for reversing the current at will connected to both load terminals
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K3/00—Circuits for generating electric pulses; Monostable, bistable or multistable circuits
- H03K3/02—Generators characterised by the type of circuit or by the means used for producing pulses
- H03K3/26—Generators characterised by the type of circuit or by the means used for producing pulses by the use, as active elements, of bipolar transistors with internal or external positive feedback
- H03K3/28—Generators characterised by the type of circuit or by the means used for producing pulses by the use, as active elements, of bipolar transistors with internal or external positive feedback using means other than a transformer for feedback
- H03K3/281—Generators characterised by the type of circuit or by the means used for producing pulses by the use, as active elements, of bipolar transistors with internal or external positive feedback using means other than a transformer for feedback using at least two transistors so coupled that the input of one is derived from the output of another, e.g. multivibrator
- H03K3/286—Generators characterised by the type of circuit or by the means used for producing pulses by the use, as active elements, of bipolar transistors with internal or external positive feedback using means other than a transformer for feedback using at least two transistors so coupled that the input of one is derived from the output of another, e.g. multivibrator bistable
- H03K3/288—Generators characterised by the type of circuit or by the means used for producing pulses by the use, as active elements, of bipolar transistors with internal or external positive feedback using means other than a transformer for feedback using at least two transistors so coupled that the input of one is derived from the output of another, e.g. multivibrator bistable using additional transistors in the input circuit
- H03K3/2885—Generators characterised by the type of circuit or by the means used for producing pulses by the use, as active elements, of bipolar transistors with internal or external positive feedback using means other than a transformer for feedback using at least two transistors so coupled that the input of one is derived from the output of another, e.g. multivibrator bistable using additional transistors in the input circuit the input circuit having a differential configuration
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- Engineering & Computer Science (AREA)
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- Digital Magnetic Recording (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
[発明の技術分野]
本発明は磁気記憶袋ガにおける磁気ヘッドに書込み電流
を流すための磁気ヘッド回路、特にセンタータップ構成
を有しない磁気ヘッド回路に関する。
を流すための磁気ヘッド回路、特にセンタータップ構成
を有しない磁気ヘッド回路に関する。
[発明の技術的背景とその問題点]
薄膜磁気ヘッドの巻線は微細構造であるため磁気ヘッド
回路もセンタータップのない構成となっているが、この
構成ではインピーダンス整合のための整合抵抗を必要と
する。しかしこの整合抵抗は高速書込みにとっては実質
的に書込み電流を減少させ、無駄な電力を消費する問題
点があった。
回路もセンタータップのない構成となっているが、この
構成ではインピーダンス整合のための整合抵抗を必要と
する。しかしこの整合抵抗は高速書込みにとっては実質
的に書込み電流を減少させ、無駄な電力を消費する問題
点があった。
また、スイッチング素子の駆動のために余分な電流を必
要とし、高速書込みを困難なものにしていた。以下これ
について詳細に説明する。
要とし、高速書込みを困難なものにしていた。以下これ
について詳細に説明する。
第2図は従来例に係る整合抵抗を有する磁気ヘッド回路
の回路図であり、1は磁気ヘッド、2は磁気ヘッド1に
よって読出された信号を増幅する増幅器、3は入力する
書込みデータ信号に従ってQ(Q)出力から信号を出力
し、トランジスタ4とトランジスタ5を交互にオン、オ
フするフリップ70ツブである。また6は書込み/読み
出し切換信号に従ってオン、オフするトランジスタであ
リ、R1,R2は整合抵抗である。
の回路図であり、1は磁気ヘッド、2は磁気ヘッド1に
よって読出された信号を増幅する増幅器、3は入力する
書込みデータ信号に従ってQ(Q)出力から信号を出力
し、トランジスタ4とトランジスタ5を交互にオン、オ
フするフリップ70ツブである。また6は書込み/読み
出し切換信号に従ってオン、オフするトランジスタであ
リ、R1,R2は整合抵抗である。
この回路の動作の概略を説明すると、まず読出し動作の
ときは、書込み/読出し切換信号は“L′であり、トラ
ンジスタ6はオフする。このため接地電源からR1,ト
ランジスタ4と6.R3を介して電源VEEへのルート
及び接地fi源からR2゜トランジスタ5と6.R3を
介して電源V[Eへのルートには電流が流れず、磁気ヘ
ッド1により読に従って読出し信号が増幅器2から出力
される。
ときは、書込み/読出し切換信号は“L′であり、トラ
ンジスタ6はオフする。このため接地電源からR1,ト
ランジスタ4と6.R3を介して電源VEEへのルート
及び接地fi源からR2゜トランジスタ5と6.R3を
介して電源V[Eへのルートには電流が流れず、磁気ヘ
ッド1により読に従って読出し信号が増幅器2から出力
される。
書込み動作のときは、書込み/続出し切換信号は“H′
であり、トランジスタ6はオン状態である。この状態で
古込みデータ信号が入力するとこの書込みデータに従っ
てトランジスタ4と5がオン・オフする。そして磁気ヘ
ッド1のコイルには^込みデータによりWi流方向が定
まる比較的大きな書込み電流が流れ、書込み動作が行わ
れる。
であり、トランジスタ6はオン状態である。この状態で
古込みデータ信号が入力するとこの書込みデータに従っ
てトランジスタ4と5がオン・オフする。そして磁気ヘ
ッド1のコイルには^込みデータによりWi流方向が定
まる比較的大きな書込み電流が流れ、書込み動作が行わ
れる。
いま古込みデータ信号が“1゛のときの動作を考えると
、フリップ7Oツブ3のQ出力はH′でありQ出力は゛
し′であるから、トランジスタ4がオンしトランジスタ
5がオフする。このときトランジスタ4に流れ込む電流
には接地taからR1,節点Aを介して流れるI!ll
tと、接地電源から抵抗R2,節点B、l!気ヘッド1
のコイル。
、フリップ7Oツブ3のQ出力はH′でありQ出力は゛
し′であるから、トランジスタ4がオンしトランジスタ
5がオフする。このときトランジスタ4に流れ込む電流
には接地taからR1,節点Aを介して流れるI!ll
tと、接地電源から抵抗R2,節点B、l!気ヘッド1
のコイル。
節点へを介して流れる電流I2の2つのバスかある。と
ころでflのバスは書込みには何ら寄与しない電流であ
って無駄な電流というだけでなく、高速書込みを妨げる
ものである。すなわちトランジスタ4によって2つのバ
スの電流を駆動しないと書込みができないのであるから
、それだけトランジスタ4の駆動能力が要求されること
になる。
ころでflのバスは書込みには何ら寄与しない電流であ
って無駄な電流というだけでなく、高速書込みを妨げる
ものである。すなわちトランジスタ4によって2つのバ
スの電流を駆動しないと書込みができないのであるから
、それだけトランジスタ4の駆動能力が要求されること
になる。
それはトランジスタ4のオン・オフ動作に時間がかかる
ことであり書込み動作の高速化を妨げるものである。を
込みデータ信号が0′のときも同様である。
ことであり書込み動作の高速化を妨げるものである。を
込みデータ信号が0′のときも同様である。
[発明の目的]
本発明は上2の点に鑑み成されたものであり、
゛整合抵抗を有する構成においても高速書込みを可能と
する磁気ヘッド回路の提供を目的とする。
゛整合抵抗を有する構成においても高速書込みを可能と
する磁気ヘッド回路の提供を目的とする。
[発明のI!要]
本発明は、磁気ヘッドと前記磁気ヘッドのコイルの両端
を2入力とする読出し信号増幅器と、一端をNm端子に
、他端を前記コイルの両端にそれぞれ接続された第1.
第2の整合抵抗と、一端を前記コイルの両端にそれぞれ
接続され相補的動作を行う第1.第2のスイッチング素
子と、前記第1、第2のスイッチング素子の他端に共通
接続された電流源とを有する磁気ヘッド回路において、
前記スイッチング素子の相補的動作に同期してオフとな
るスイッチング素子に接続されている整合抵抗を短絡す
る切換手段を設置ノ、書込み動作時に潟込みに不要な電
流がスイッチング素子に流れることを防止して高速内込
みを可能とするものである。
を2入力とする読出し信号増幅器と、一端をNm端子に
、他端を前記コイルの両端にそれぞれ接続された第1.
第2の整合抵抗と、一端を前記コイルの両端にそれぞれ
接続され相補的動作を行う第1.第2のスイッチング素
子と、前記第1、第2のスイッチング素子の他端に共通
接続された電流源とを有する磁気ヘッド回路において、
前記スイッチング素子の相補的動作に同期してオフとな
るスイッチング素子に接続されている整合抵抗を短絡す
る切換手段を設置ノ、書込み動作時に潟込みに不要な電
流がスイッチング素子に流れることを防止して高速内込
みを可能とするものである。
[発明の実施例]
以下図面を参照しながら本発明の実施例について説明す
る。第1図は本発明の実施例に係る磁気ヘッド回路の回
路図であり、第2図の従来例回路と同じ符号・番号のも
のは同じ機能を有する。図において破線で囲む11は本
発明の実施例に係る切換手段たる1!電流供給であり、
相互に作動対接続されベースがそれぞれスイッチグ素子
4.5のコレクタに接続されたトランジスタ7.8と、
該トランジスタ7.8のコレクタと接地ライン間にそれ
ぞれ挿入接続された抵抗Ra 、Rsと、各整合抵抗R
t 、R2にそれぞれ並列接続され、ベースがそれぞれ
トランジスタ8と7のコレクタに交差接続されたトラン
ジスタ9.10及び作動対トランジスタ7.8の電流源
を構成する抵抗R6とによって構成されている。
る。第1図は本発明の実施例に係る磁気ヘッド回路の回
路図であり、第2図の従来例回路と同じ符号・番号のも
のは同じ機能を有する。図において破線で囲む11は本
発明の実施例に係る切換手段たる1!電流供給であり、
相互に作動対接続されベースがそれぞれスイッチグ素子
4.5のコレクタに接続されたトランジスタ7.8と、
該トランジスタ7.8のコレクタと接地ライン間にそれ
ぞれ挿入接続された抵抗Ra 、Rsと、各整合抵抗R
t 、R2にそれぞれ並列接続され、ベースがそれぞれ
トランジスタ8と7のコレクタに交差接続されたトラン
ジスタ9.10及び作動対トランジスタ7.8の電流源
を構成する抵抗R6とによって構成されている。
次に実施例に係る磁気ヘッド回路の動作を説明する。読
出し動作及び書込み動作も基本的には第2図の従来例回
路と同じであるが、寓込み動作における電流供給が異な
る。例えば、いま内込みデータ信号3が1”であるとす
る。トランジスタ4はオンし、トランジスタ5はオフす
る。その際電流供給源から節点B、磁気コイル15節点
A。
出し動作及び書込み動作も基本的には第2図の従来例回
路と同じであるが、寓込み動作における電流供給が異な
る。例えば、いま内込みデータ信号3が1”であるとす
る。トランジスタ4はオンし、トランジスタ5はオフす
る。その際電流供給源から節点B、磁気コイル15節点
A。
トランジスタ4に流れる電流と、磁気コイル懺1の有す
る抵抗との積の分だけ節点Bの°電圧レベルは接点Aの
M El、レベルより高くなる。従ってトランジスタ7
はオフ、トランジスタ8はオンし、このためトランジス
タ7のコレクタ電位は上がり、トランジスタ10はオン
、トランジスタ9はオフする。即ち、整合抵抗R2はト
ランジスタ10によって短絡される。このため、トラン
ジスタ4に流れ込む電流は図示するように、接地電源か
らR1、節点Aを介して流れる電流11及びiI源から
トランジスタ102節点B、m気ヘッド及び節点Aを介
して電流I3となる。すなわらトランジスタ10がオフ
しているときに流れていた電流I2(電源、整合抵抗R
2,節点B、la気ヘッド1゜節点Aを流れる電流)は
阻止される。ところで前記電流■3は抵抗を介さずに流
れる電流であるからIt、I2に比べかなり大きい。従
って書込み電流値はほぼI3+Itの°電流値にましい
と考えてよい。即ち、このようにして磁気ヘッド1に流
れる電流が多くなった分だけ整合抵抗R1を介して流れ
る電流11を減らすことができる。したがって、例えば
定II流源を構成するトランジスタ6のエミッタ側の可
変抵抗R3を調整して前記電流11を減少させることが
できる。この結果、書込み時のトランジスタ4を流れる
電流を全体として減らすことができるので高速のスイッ
チング動作すなわち高速目送みが可能となる。尚、内込
みデータ信号が°O′のときもトランジスタ9がオンと
なって整合抵抗R1を短絡するので前記と同様な動作を
する。
る抵抗との積の分だけ節点Bの°電圧レベルは接点Aの
M El、レベルより高くなる。従ってトランジスタ7
はオフ、トランジスタ8はオンし、このためトランジス
タ7のコレクタ電位は上がり、トランジスタ10はオン
、トランジスタ9はオフする。即ち、整合抵抗R2はト
ランジスタ10によって短絡される。このため、トラン
ジスタ4に流れ込む電流は図示するように、接地電源か
らR1、節点Aを介して流れる電流11及びiI源から
トランジスタ102節点B、m気ヘッド及び節点Aを介
して電流I3となる。すなわらトランジスタ10がオフ
しているときに流れていた電流I2(電源、整合抵抗R
2,節点B、la気ヘッド1゜節点Aを流れる電流)は
阻止される。ところで前記電流■3は抵抗を介さずに流
れる電流であるからIt、I2に比べかなり大きい。従
って書込み電流値はほぼI3+Itの°電流値にましい
と考えてよい。即ち、このようにして磁気ヘッド1に流
れる電流が多くなった分だけ整合抵抗R1を介して流れ
る電流11を減らすことができる。したがって、例えば
定II流源を構成するトランジスタ6のエミッタ側の可
変抵抗R3を調整して前記電流11を減少させることが
できる。この結果、書込み時のトランジスタ4を流れる
電流を全体として減らすことができるので高速のスイッ
チング動作すなわち高速目送みが可能となる。尚、内込
みデータ信号が°O′のときもトランジスタ9がオンと
なって整合抵抗R1を短絡するので前記と同様な動作を
する。
本発明は前記実施例に限定されず種々の変形実施が可能
である例えば前記切換手段たる電流供給部11の構成は
前記実施例に限らず、書込み/読出し切換信号によって
直接制御されるスイッチング素子を用いてもよい。
である例えば前記切換手段たる電流供給部11の構成は
前記実施例に限らず、書込み/読出し切換信号によって
直接制御されるスイッチング素子を用いてもよい。
[発明の効果]
以上説明したように、本発明によれば整合抵抗を有する
回路構成であっても書込みに不要な?4流を減らすこと
ができるので、無駄な電力消費の防止及び高速書込みが
可能となる。特にスイッチングトランジスタの電流容量
を減らすことができるので設計自由度を確保できる。
回路構成であっても書込みに不要な?4流を減らすこと
ができるので、無駄な電力消費の防止及び高速書込みが
可能となる。特にスイッチングトランジスタの電流容量
を減らすことができるので設計自由度を確保できる。
第1図は本発明の実施例に係る磁気ヘッド回路の回路図
、第2図は従来例に係る磁気ヘッド回路の回路図である
。 1・・・磁気ヘッド、2・・・増幅器、3・・・フリッ
プフロップ、 4〜10・・・トランジスタ、11・・・切換手段、R
t 、R2・・・整合抵抗、R4−R6・・・抵抗、1
* 、12.13・・・トランジスタ4に流れ込む電流
。 代理人 弁理士 三 渾 正 義EE
、第2図は従来例に係る磁気ヘッド回路の回路図である
。 1・・・磁気ヘッド、2・・・増幅器、3・・・フリッ
プフロップ、 4〜10・・・トランジスタ、11・・・切換手段、R
t 、R2・・・整合抵抗、R4−R6・・・抵抗、1
* 、12.13・・・トランジスタ4に流れ込む電流
。 代理人 弁理士 三 渾 正 義EE
Claims (1)
- 磁気ヘッドと、前記磁気ヘッドのコイルの両端を2入力
とする読出し信号増幅器と、一端を電源端子に、他端を
前記コイルの両端にそれぞれ接続された第1、第2の整
合抵抗と、一端を前記コイルの両端にそれぞれ接続され
相補的動作を行う第1、第2のスイッチング素子と、前
記第1、第2のスイッチング素子の他端に共通接続され
た電流源とを有する磁気ヘッド回路において、前記コイ
ルの両端に生ずる電位差を前記スイッチング素子のスイ
ッチング入力信号とし、スイッチング素子に接続されて
いる整合抵抗を短絡する切換手段とを設けたことを特徴
とする磁気ヘッド回路。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP27931884A JPS61158010A (ja) | 1984-12-28 | 1984-12-28 | 磁気ヘツド回路 |
DE19853546146 DE3546146A1 (de) | 1984-12-28 | 1985-12-27 | Schaltkreis fuer einen duennfilm-magnetkopf |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP27931884A JPS61158010A (ja) | 1984-12-28 | 1984-12-28 | 磁気ヘツド回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS61158010A true JPS61158010A (ja) | 1986-07-17 |
Family
ID=17609497
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP27931884A Pending JPS61158010A (ja) | 1984-12-28 | 1984-12-28 | 磁気ヘツド回路 |
Country Status (2)
Country | Link |
---|---|
JP (1) | JPS61158010A (ja) |
DE (1) | DE3546146A1 (ja) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH02158903A (ja) * | 1988-12-09 | 1990-06-19 | Mitsubishi Electric Corp | ヘッドドライバー |
Family Cites Families (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US3678292A (en) * | 1970-08-06 | 1972-07-18 | Rca Corp | Multi-function logic gate circuits |
US3763383A (en) * | 1972-08-21 | 1973-10-02 | Ibm | Drive circuit for inductive device |
-
1984
- 1984-12-28 JP JP27931884A patent/JPS61158010A/ja active Pending
-
1985
- 1985-12-27 DE DE19853546146 patent/DE3546146A1/de active Granted
Also Published As
Publication number | Publication date |
---|---|
DE3546146A1 (de) | 1986-07-03 |
DE3546146C2 (ja) | 1988-09-01 |
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