JPS60224370A - カラ−画像読取り装置 - Google Patents

カラ−画像読取り装置

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JPS60224370A
JPS60224370A JP59081492A JP8149284A JPS60224370A JP S60224370 A JPS60224370 A JP S60224370A JP 59081492 A JP59081492 A JP 59081492A JP 8149284 A JP8149284 A JP 8149284A JP S60224370 A JPS60224370 A JP S60224370A
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signal
flop
flip
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reading
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Yoshinori Ikeda
義則 池田
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Original Assignee
Canon Inc
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔技術分野〕 本発明はカラー画像を色分解して読取るカラー画家読取
り装置に関するものである。
〔従来技術〕
最近、カラー原稿を色分解フィルタ等で色分解し、これ
を各色毎に複数本設けられたＣＯＤ等の撮像素子からな
るラインセンサによって光電的に読取ることにより色画
像信号を形成し、この色画像信号に従ってカラー画像再
現したり、カラー画像を遠隔地へ伝送したり、或いは光
ディスク等に記憶せしめたりする装置が提案されている
。
この様な装置において、例えば色ずれのないカラー画像
を再現するためには、カラー画像の読取り段階における
色ずれを防止することが重要である、しかしながら、複
数本のラインセンサは空間的に配置されるものであって
、夫々のラインセンサの読取位置を正確に一致させ、セ
ンサ間の読取位置のずれをなくすことは非常に難しい。
また、センサの配置を正確に合せることが可能であって
も、環境条件経時変化或いは外部からの衝撃等により、
そのずれを生じることが考えられる。
〔目的」 本発明は以上の点に鑑みてなされたもので、カラー画像
の読取りにおける色ずれを防止すべく、複数のラインセ
ンサ間の読取り位置のずれを自動的に補正するカラー画
像読取り装置を提供するものである。
〔実施例〕
以下に本発明の詳細な説明する、第１図は、本発明にか
かるカラー画像読取り装置の構造を示す図である。２は
原稿１を載置するプラテン台、３は原稿押えカバー、６
．７は原稿を照射するハロゲンランプ、５．８は反射笠
である、ハロゲンランプ６．７により照射された原稿１
からの反射光は、第１ミラー９．第２ミラー１゜で反射
され５レンズ１１−１で集光され近赤外カットフィルタ
１１−２により、近赤外より長波長側成分をカットされ
て、色分解用ダイクロイックフィルタ１２に入射し、こ
こで、３光路に分けられる。３光路に分けられた原稿反
射光は夫々ブルー（Ｂ）フィルタ１３、グリーン（Ｏフ
ィルタ１５、レッド（６）フィルタ１７によってＢ成分
（４００〜５００ｎｍ）、Ｇ成分（５００〜６００ｎｍ
）、Ｒ成分（６００〜７００　ｎｍ）に色分解され、そ
れぞれＣＯＤ（ラインイメージセンサ）１４゜１６．１
８に照射される。露光ランプ５．６及び第１ミラー９を
速度Ｖ又、第２ミラー１０を速度Ｖ／２で原稿送り方向
に移動させて副走査する事により、原稿１の全面を各色
成分画像として読み取る事ができる。
４はＣＣＤ１４．１６．１８の主走査中に渡って均一な
濃度（例えば白色）を有した較正板であり、原稿走査に
先だって、Ｃ０Ｄ１４，１６゜１８にて読取られる位置
に設けられている。２０は第１ミラー９の位置検出を行
なうセンサで、第１ミラー９が第１図示の実線状態にあ
って、ＣＯＤが較正板４を走査可能となっている場合に
信号ＨＰを出力する。第２図に原稿台まわりのプラテン
台２及び較正板の配置を模式的に示す。尚、ＭＳはＣＣ
Ｄの主走査方向を示し、ＳＳは副走査方向を示す。図の
如く、プラテン台２の外側に較正板４は配置され、較正
板４０所定位置には較正板４の地肌（例えば白色）と区
別可能な基準線５０（例えば黒線）が設けられている、 本較正板４は第１図示構成の読取り装置において、３本
のＣＣＤＩ４．１６．１８の原稿画像に対する主走査方
向ＭＳの読取り位置のずれを自動補正するために設けら
れたものであり、原稿走査に先だってＣＯＤにより較正
板４を走査し読取ることにより、ＣＯＤ相互の主走査方
向に関する読取位置のずれ量を検出し、この検出結果に
基づいて原稿読取りの際のＣＣＤの読取動作を制御する
、尚、較正板４はＣＣＤの読取り位置制御だけではなく
、ＣＣＤの感度不均一補正′や欠陥ピット検出、或いは
照射ランプの光量補正等の基準板として用いることも可
能である。
第３図を用いてＣＯＤの読取り位置のずれ補正の概略を
説明する。第３図（ａ）及び（ｂ）は各ＣＣＤの較正板
４を走査して得た出力信号の状態を示すものである。３
本のＣ０Ｄ１４，１６．１８の読取り位置にずれが無い
場合は、各ＣＯＤの出力において第３図（ａ）に示す如
く基準線５０を読取って得た信号が同一位置に発生する
。即ち、第３図（ａ）は基準線５０に対応する信号が３
本のＣＣＤともに初めから１ビツト目（工画素目）に現
われた状態を示しており、この場合はＣＯＤの読取り動
作に補正をする必要はない一一方、何らかの原因で３本
のＣＯＤの読取り位置にずれケ生じた場合、ＣＣＤ１４
，１６゜１８の出力は第３図（ｂ）の如くになる。即ち
、第３図（ｂ）は基準線５０に対応する信号がＣＣＤ１
４ではにビット目（ｋ画素目）、ＣＣＤ１６ではｍビッ
ト目（１画素目）、ＣＣＤ１８ではｍビット目（ｍ画素
目）Ｋそれぞれ現われた状態を示している。従って、第
３図（ｂ）の状態にある３本のＣＯＤを何の補正も行な
わずに通常の駆動、即ち、同一のＣＯＤ走査開始信号を
用いて３本のＣＯＤを同一タイミングで読出し動作せし
めると、各色信号は第４図に示す如く、各々ずれた状態
で読出される。そこで、各ＣＯＤの読出しタイミングを
ずれ量に従って制御（例えば遅延）させることにより、
そのずれを補正することができる。
尚、較正板４上の基準線５０はＣＯＤの受光面の端部で
且つ読出し開始側に投影される様に配置することが好ま
しい。即ち、これによると基準線検出迄のカウント値を
小とすることが出来、後述する回路構成におけるカウン
タ回路にカウント容量が小さ々ものを用いることが可能
となる。
また、ＣＯＤの総画素数を５０（１０ビツト（画素）と
すると、Ａ４サイズの長手方向が２９７■であり、１６
　ｐｅｌ／＋ｗの解像度を有する読取りを行なう場合４
７５２画素が有効画素となり、２４８画素が読取り位置
のずれ補正のためのビット数として用いることができる
。従って、以上の様式によるとＣＯＤの位置ずれに対し
、最大１６１迄対応することが可能となる。
第５図は上述のずれ補正機能を有したＣＯＤ駆動用の回
路構成を示すブロック図である。１４゜１６．１８は第
１図と同様のＣＯＤである。各ＣＯＤは列状に配置され
た複数のフォトセルを有し、このフォトセルに入射光拡
に応じて電荷が蓄積される。蓄積された電荷はシフトパ
ルスにより不図示のシフトレジスタに１ライン分同時に
移送され、−その後、所定のクロック信号に同期して電
圧値として読出される。２１〜２３はＣ０Ｄ１４，１６
．１８を夫々駆動するためのＣＯＤドライバである。３
本のＣＣＤ１４．１６．１８から出力されるアナログ画
信号ＶＩＤＥＯは夫々Ａ／Ｄ変換器２４〜２６に入力さ
れ、８ビツトのデジタル画信号ＤＶに変換される。３０
〜３２はアンドゲート回路であり、Ａ／Ｄ変換器２４〜
２６より夫々入力されたデジタル画信号ＤＶを出方制御
信号ＶＤＥＯＥＮに従ってゲート動作することにより、
所定タイミングで後段の処理回路（不図示）へのデジタ
ル画信号ＤＶの伝送を制御する。
２７〜２９は誤差調整回路であって、ＣＯＤで前述の較
正板４を走査している時のＡ／Ｄ変換器２４　＝−２６
の出力デジタル信号を取込み、ＣＯＤの読取り位置のず
れ量を検出する、そして、この検出結果に基づいてずれ
量を補正すべく各ＣＯＤドライバ２１〜２３の駆動制御
を行なう。
尚、第５図において、信号ＣＣＤＣＬＫはＣＣＤの転送
動作に用いるＣＣＤクロック、信号ＣＬＫＡＤはＡ／Ｄ
変換のタイミングを与えるＡＤ変換クロック、信号Ｈ８
ＹＮＣはＣＣＤの走査基準となる水平同期信号、信号Ｈ
Ｐは第１図示のセンサ２０の出力信号であり、また３３
は本回路の基準クロックＣＬＫを発生するクロック発生
器である。
第６図は第５図示のＣ０Ｄ−Ｂ１４に係、わる誤差調整
回路２９の詳細な構成を示す回路図であシ、第７図はそ
の動作タイミングチャートである。尚、説明の都合上、
Ａ／Ｄ変換器２４及びアンドゲート回路３０も含ませで
ある。また、ＣＣＤ−Ｇ１６及びＣＣＤ−Ｒ１８に係わ
る回路構成は第６図と同一なので、その説明は省く。
まず、本回路構成の動作基準となる３信号、即ち、信号
ＡＤＪＳＴ、ＶＤＥＮ、ＶＤＯＥＨにツイテ説明する。
原稿走査に先立ち、露光ランプ及び第１ミラー９が較正
板４の位置にある時、センサ２０より信号ＨＰが出力さ
れる。信号ＨＰはフリップフロップ１０１に入力されて
おり、信号ＨＰの出力時に水平同期信号ＨＰが入力され
るとフリップフロップ１０１より較正タイミング信号Ａ
ＤＪＳＴが、少くとも１水平走査区間以上、高レベルで
出力される。また、有効期間カウンタ１０２け信号Ｈ８
ＹＮＣの入力から、基準クロックＣＬＫｅカウントし、
カウント１直がＣＩとなったらフリップ７０ツブ１０３
のＪ入力にセット信号を送出する。セット信号を受けた
７ケ・ツプフロツプ１０３はセット信号入力後のクロッ
クＣＬＫの立上りでセットし、Ｑ出力が高レベルとなる
。また、有効期間カウンタ１０２はカウント値が０２に
なると７リツプフロツプ１０３のに人力へリセット信号
を出力する。リセット信号を入力したフリップフロップ
１０３はリセット信号入力後のクロックＣＬＫの立上り
でＱ出力を低レベルとする。従って、信号Ｈ８ＹＮＣの
入力からカウントを行ない０１カウントから０２カウン
ト迄の期間フリップフロップ１０３のＱ出力は高レベル
となる。尚、このフリップフロップ１０３のＱ出力が有
効期間信号ＶＤＥＮである。
一方、有効中カウンタ１０４は前述の有効期間カウンタ
１０２と同様に信号Ｈ８ＹＮＣの入力よりカウント動作
を開始し、カウント値がＣ３（Ｃ３＞ＣＩ　）となった
ときにフリップフロップ１０５のＪ入力に対し、セット
信号を出力し、又カウント値が０２となったときに７リ
ツプフロツプ１０５０に入力にリセット信号を出力する
。従って、フリップフロッグ１０５ｔｉ０３カウントか
らＣ２カウント迄の期間Ｑ出力が高レベルとなる。尚、
このフリップフロップ１０５のＱ出力が有効中信号ＶＤ
ＯＥＭとなる。
次に、以上の３信号を用いた補正動作を説明する。第１
ミラー９が第１図実線位置にあり、ＣＣＤが較正板４を
読取る状態にある場合、フリップフロップ１０１より信
号ＡＤＪＳＴが出力されるとオアゲート１０７を介し、
アンドゲート１０６がオンとなり、基準クロックＣＬＫ
をＣＣＤクロックＣＣＤＣＬＫとして出力する。このク
ロックＣＣＤＣＬＫによりＣＣＤ１４は画信号の転送を
開始する。フリップフロップ１０１からの信号ＡＤＪＳ
Ｔと７リツプフロツプ１０３からの信号ＶＤＥＮが共に
高レベルとなるとアンドゲート１１０から高レベルの信
号により誤差ビット検出カウンタ１１１が動作開始する
。即ち、有効期間信号ＶＤＥＮの出力点（有効走査開始
点）より誤差ビット検出カウンタ１１１がＡＤ変換クり
ックＣＬＫＡＤをカウントする。尚、ＡＤ変換クりック
ＣＬＫＡＤはアンドゲート１０６から出力されるＣＣＤ
クロックＣＣＤＣＬＫをインバータ１０７で反転したク
ロックである。一方、Ａ／Ｄ変換器２４からＡＤ変換ク
りックＣＬＫＡＤに同期して出力される８ビツトデジタ
ル画信号ハコンパレータ１１５において、黒設定回路１
１６から与えられる８ビツトのスレショルド信号と比較
され、入力するデジタル画信号が黒か否かを判断する。
そして、入力するデジタル画信号がスレショルド信号よ
り大となったときにコンパレータ１１５はアンドゲート
１１８に黒検出信号を出力する。これは、較正板４にお
ける基準線５０の位置に対応する。アンドゲート１１８
の別の入力にはフリップフロップ１０１より信号ＡＤＪ
ＳＴが入力され、従って、コンパレータ１１５が黒検出
したときにラッチ１１２にラッチ信号を供給する。この
ラッチ１１２には誤差ビット検出カウンタ１１１のカウ
ント値が印加されており、このラッチ動作により、有効
期間信号ＶＤＥＮの出力からＣＣＤ１４が基準線５０を
読取るまでのビット数（画素数）がラッチされることに
なる。そして、このラッチした値（誤差ビット）は電源
断又は次の較正動作（即ち、信号ＡＤＪＳＴが出力され
るとき）迄保持される、 以上の様に、較正板４の読取りにより誤差ビットが検出
された後に原稿走査が行なわれる。
原稿走査のために第１ミラー９が移動を開始するとセン
サ２０の出力が低レベルとなり、従って、フリップフロ
ップ１０１の出力信号ＡＤＪＳＴも低レベルとなる。従
って、オアゲート１０７を介して信号ＡＤＪＳＴにてオ
ン状態にあったアンドゲート１０６もオフとなり、ＣＣ
Ｄクロッれない。
原稿走査が開始後、水平同期信号Ｈ８ＹＮＣにより、較
正板４の走査で得た誤差ビット値がラッチ１１２より誤
差ビット調整カウンタ１１３にプリセットされる。誤差
ビット調整カウンタ１１３はフリップフロップ１０３か
らの有効期間信号ＶＤＥＮの入力により、基準クロック
ＣＬＫをインバーター０８で反転した信号をカウント開
始する。このカワンタ１１３はダウンカウンタであって
、プリセットされた値のカウントダウンがなされるとキ
ャリ信号ＲＣを出力する。
キャリ信号ＲＣＶｉフリップフロップ１１７のセット端
子に入力されそれをセットする、尚、フリップフロップ
１１７は水平同期信号Ｈ８ＹＮＣでリセットされる。フ
リップフロップ１１７のＱ出力はオアゲート１０７を介
し、アンドゲート１０６をオン状態とする。従って、と
のキャリ信号ＲＣの出力時よりＣＯＤクロックＣＣＤＣ
ＬＫがアンドゲート１０６より出力される。
以上により、較正板４を読取って得た誤差ピット分（例
えばにビット分）遅延して、ＣＣＤり０ツクＣＣＤＣＬ
Ｋが第３図（４）の如＜　ＣＣＤ１４の駆動クロックＣ
ＣＤＣＬＫＢとして出力されることになる。従って、Ｃ
ＣＤ１４の先頭画素がそのクロック分遅延して出力され
る。
他のＣ０Ｄ１６．１８に対しても同様の補正動作がなさ
れ、有効期間信号ＶＤＥＮを基準に各ＣＯＤの駆動用ク
ロックＣＣＤＣＬＫが独立に制御される。この様に、各
ＣＯＤの読出し開始タイミングを制御することによりＣ
ＣＤ間の主走査方向に関する読取り位置のずれの補正が
なされる、 尚、以上のずれ補正のための誤差ビットの検出は、原稿
走査１回毎に行なってもよいし、もちろん所定回毎に実
行してもよい。また、装置電源投入時等のある決まった
タイミングで実行する事も可能である。
尚、本実施例では原稿を固定し、ミラーを移動すること
により副走査する構成を説明したが、原稿台又は原稿を
移動させる構成でも良いことはもちろんである。また、
Ｒ，Ｇ、Ｂの３色色分解に関して説明したが、他の色分
解、例えば２色分解やイエロ、マゼンタ、シアン等地の
色に分解する構成に適用できることは言うまでもない。
また、カラーフィルム等の読取りを行なう様、透過光を
用いたカラー読取装置にも適用可能である。
更には、ずれ量補正のためにＣＯＤクロックを遅延する
のではなく、逆に早めに印加する様にしてもよいし、３
ホウ１本のタイミングを固定し、他の２本の抗出しタイ
ミングを制御してもよい。また、１ラインの画像を複数
本のラインセンサで分担して読取る型式の読取り装置に
も適用できるものである。
尚、ラインセンサはＣＣＤに限るものではなく、クロッ
ク信号に同期して転送動作する他のラインセンサを用い
ることも可能である。
〔効果〕
以上説明した様に４本発明によるとカラー画像読取りの
ための複数のラインセンサの読取り位置のずれを確実に
補正できるものであり、高精度な調整をそれほど必要と
することなく、良好なカラー画像の吹、取が可能となる
ものである。
【図面の簡単な説明】
第１図は本発明を適用したカラー画像読取り装置の構造
を示す図、第２図は原稿台の模式的な構成図、第３図（
ａ）　、　（ｂ）は較正板を走査したＣＯＤの出力状態
を示す図、第４図は各色信号のずれを示す図、第５図ｔ
ｉｃｃＤ駆動用の回路構成を示すブロック図、第６図は
第５図示誤差調整回路の詳細な構成を示す回路図、第７
図は第６図の動作タイムチャート図であり、１は原稿、
２はプラテン台、９は第１ミラー、１２けダイクロイッ
クフィルタ、１４．１６．１８はＣＯＤ、２７．２８．
２９は誤差調整回路である。 出願人　キャノン株式会社 唱３図 Ｈ’；ＹＮＣ ｐ

Claims (1)

  1. 【特許請求の範囲】 （１）画像を色分解して読取るための複数のラインセン
    サと、上記複数のラインセンサの読取り位置のずれを検
    出する検出手段と、上記検出手段の検出結果に基づいて
    上記複数のラインセンサの読取動作を制御する制御手段
    とを有することを特徴とするカラー画像読取り装置。 （２、特許請求の範囲第（１）項において、上記制御手
    段は上記複数のラインセンサの読取動作の基準となるク
    ロック信号を制御することを特徴とするカラー画像読取
    り装−置。 （３）特許請求の範囲第（１）項において、上記検出手
    段は上記複数のラインセンサからの出力に基づいて検出
    動作することを特徴とするカラー画像読取り装置。
JP59081492A 1984-04-23 1984-04-23 カラ−画像読取り装置 Pending JPS60224370A (ja)

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