JPS60172085A - 図形処理装置 - Google Patents

図形処理装置

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JPS60172085A
JPS60172085A JP59027155A JP2715584A JPS60172085A JP S60172085 A JPS60172085 A JP S60172085A JP 59027155 A JP59027155 A JP 59027155A JP 2715584 A JP2715584 A JP 2715584A JP S60172085 A JPS60172085 A JP S60172085A
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔発明の利用分野〕 本発明は、図形表示データを作成する図形処理装置に係
り、特に表示用メモリ内で図形表示データの転送処理を
行うに好適な図形処理装置に関する。
〔発明の背景〕
(、RT画面等のディスプレイ装置や印刷装置に出力す
る文字や図形等のデータを制御する方式として、読書き
可能な表示用メモリに記憶するデータの種類の違いから
次の2通りがある。
(1)文字コードを記憶する方式 表示用メモリには文字や図形情報をコード化した形で記
憶しておき、表示のタイミングに同期して読出されたコ
ードを用いて文字発生器等のパターン・メモリをアクセ
スし表示データを祷る。表示用メモリは比救的小容量で
済むが、図形表示には適さない。
(2)画素データをそのまま記憶する方式表示用メモリ
には画素単位の表示データを記憶する。表示画面分の画
素データを記憶するため大容量の表示用メモリを必要と
するが、任意の図形表示や融通性の冒い文字表示が可能
である。
メモリの低価格化に伴い、後者が増える傾向にあるが、
大容量のデータを処理するだめ、処理性能が問題となる
。特に、画素データの転送処理が重要である。第1図に
は転送処理の例を示す。
i 1 CFI)図は文字を表示する例を示している。
表示用メモリは、実際に画面に表示されるデータを記憶
する領域と、画面上には表示さ訃ないが種々のパターン
を記憶するパターン・バッファ領域から成る。画面上に
文字を表示する場合、パターン・バッファ領域に記憶さ
れた文字フォント・データを所定の表示位置に転送する
ことによって実行される。
また、第1(b)図はカーソル表示を説明するものであ
る。カーソルは次の手順により表示される。
(1) カーソル表示位置の表示データをパターン・バ
ッファ領域の待避エリアに待避する。
(11) カーソル・パターンを表示位置に転送する。
この場合には単純な転送ではなく、もとの表示データと
の演算処理が行われる。
更に、カーソルを移動する場合には、待避エリアのデー
タを表示位置に転送してカーソルを消去した後に新たな
表示位置にカーソル表示の手順を繰返せばよい。
以上のように、画素データの転送処理は非常にM要であ
るが、この転送処理に次のような問題があり、一般に簡
単ではない。
第2図は、ある画素データを別の画素位置に転送する場
合を示している。通常、メモリの一語には水平方向に連
続する複数画素のデータを記憶している。従って、める
画素データを別の画素位置に転送する場合に、演算のビ
ット位置を揃えるためのシフト処理またはソース画素デ
ータの切り出し処理が必要となる。従来、この転送処理
をソフトウェアによって行っており、第3図に1画素転
送処理のフローチャートを示す。第1図に示す外処理の
ように矩形領域のデータを転送する処理のような場合に
は、ソース画素及びディスティネーション画素を指定す
るポインタの移動、転送回数のカウント、等の処理が加
算される。この結果、汎用のマイクロ・プロセッサを用
いた場合、1画素描りの転送処理に数μS〜数十μsを
要するため、処理の高速化が課題となっていた。
〔発明の目的〕
本発明の目的は、メモリの1語に複数画素のデータを格
納する方式で、画素情報を別の画素位置に高速に転送し
得る図形処理装置を提供することである。
〔発明の概要〕
上記目的を達成するための本発明の!特徴は、転送元と
転送先の1語内の画素位置を指定する情報からシフトi
を算出する手段と、転送元から読出された1語のデータ
に対して1度に複数ビットのシフトを行う手段とを設け
たことにある。
〔発明の実施例〕
以下図面に基づいて本発明の好適な実施例を詳細に説明
する。
第4図には本発明を実施した図形処理装置の構成を示す
。従来はマイクロプロセッサ等のソフトウェア処理によ
っていたものを、本発明では特有のハードウェア構成に
より、高速に面整データの転送を実行する。
すなわち、ソースアドレスレジスタ10、ディスティネ
ーションアドレスレジスタ11、アドレスセレクタ12
、減H1器13、バレルシフタ14、転送モードレジス
タ15、アドレスデコーダ16、論理演算器17、デー
タバッファ18、表示用メモリ19、ビットモードレジ
スタ20、から成る。
表示用メモリ19は、1語が16ビツトの構成でnl!
 次アドレスが付されている。ソースアドレスレジスタ
10およびディスティネーションアドレスレジスタ11
は24ビツトの構成で、上位20ビツトで表示用メモリ
アドレスを、下位4ビツトはメモリの1語内のビット位
置を、それぞれ指定する。
ソースアドレスレジスタ10は転送元の画素位置を指定
し、ディスティネーションアドレスレジスタ11は転送
先の画素位置を指定する。アドレスセレクタ12は表示
用メモリに送出するアドレスを選択する。1j5.n器
13はソースアドレスレジスタ10とディスティネーシ
ョンアドレスレジスタ11の下位4ビツトを減算し、バ
レルシフタのシフト量を計算する。バレルシフタ14i
t、16ビツトのデータを圧意のビット長だけ1度にシ
フトする機能を持つもので、減算器13の演算結果でシ
フト量が制御される。
転送モードレジスタ15は種々の転送モードを記憶する
。アドレスデコーダ16は、ディスティネーションアド
レスレジスタ11の下位4ビツトを人力し、転送モード
レジスタ15及びピットモードレジスタ20の指定に対
応したデコードを行い1語内の演算ビット位置を指定す
るマスク情報を出力する。論理演算器17はマスク情報
で指定されたビットに対してのみ選択的に演算を行う。
データバッファ18は表示用メモリとの間で転送される
データを一時記憶する。
ここで、ソースアドレスレジスタ101デイステイネー
シヨンアドレスレジスタ11、転送モードレジスタ15
、ピットモードレジスタ20は、図示していないが、中
央処理装置(CPU)または他の専用制御装置からデー
タを書込まれ制御されている。
第5図は、第4図の実施例の動作を説明する図で、転送
モードレジスタ15で指定される2つの転送モードの場
合を示している。同図(a)は1度に1画素のデータだ
けを転送する1画素転送モードを示す。アドレスセレク
タ12では、最初にソースアドレスレジスタ10が選択
され、表示用メモリ19からソース画素の含まれる1語
のデータが読出され、データバッファ18を介してバレ
ルシフタ14に送られる。一方減算器13ではソースア
ドレスとディスティネーションアドレスの下位4ビツト
が減算されており、バレルシフタ14で複数ビットのシ
フト操作が行われる。次に、アドレスセレクタ12では
ディスティネーションアドレスレジスタ11が選択され
、ディスティネーション画素位11屋を含むデータの1
語が読出され、データバッファ18を介して論理演算器
17に送られる。一方、ディスティネーションアドレス
の下位4ビツトはアドレスデコーダ16でデコードされ
、ディスティネーション画素位置を指定するマスク情報
が出力される。論理演算器17では、ディスティネーシ
ョンの1語データのうち、マスク情報で指定されるビッ
ト位置に対してのみバレルシフタ14の出力への置換え
演算が施される。この演算結果は、データバッファ18
を介して表示用メモリのディスティネーションアドレス
に格納される。この1画素の転送処理を、ソースアドレ
ス及びディスティネーションアドレスを順次更新しなが
ら繰返すことによって、メモリの語の境界にかかわらず
大量のデータを高速に転送できる。
第5図(b)は、複数画素転送モードの動作を説明する
もので、この場合には、アドレスデコーダ16では転送
モードレジスタ15の指定に従い、複数のビット位置に
”1”をセットする。従って水平に連続する複数ピット
を転送する場合に、史に高速化できる。
このように、本実施例によれば、表示用メモリの1語に
複数画素のデータが格納される場合にも、ソース読出し
、ディスティネーション読出し、ディスティネーション
書込みの3回のメモリアクセスで1あるいは複数の任意
の画素位置に対して画素データの転送を行うことができ
、尚速転送が可能である。
更に、第4図の実施例では、1画素のデータが複数ビッ
トで表現される場合(カラーや多階調の処理)にも効率
良く処理し得る嵌能ンMしており、ビットモードレジス
タ20の、l1li定に従って5種類の異なる動作モー
ドを選択できる。第6図には、各モードにおける表示用
メモリの1語の構成を示す。
(a)1ピット/画素モード 白黒画像のように11I!Ll素を1ビツトで表現する
噛合に用いるモードで、表示用メモリの1飴には連続す
る166画素データを格納する。
(b)2ビット/画素モード 1画素を2ビツトで表現するもので4色まだは4階調ま
での表示に用いる。表示用メモリの1語には連続する8
画素のデータを格納する。
(C)4ビット/画素モード 1画素を4ビツトで表現するもので、表示用メモリの1
語には連続する4画素のデータを格納する。
(d)8ビット/画累モード 1+1illl<を8ビツトで表現し、表示用メモリの
1暗には2画素分のデータを格納する。
(e)16ビツト/画素モード 1画素を16ビツトで表現するもので、表示用メモリの
1語が1画素データに対応する。
第7図は、4ビット/画素モードの場合を例に、1画素
データの転送を図示したものである。ソース画素の含ま
れる1語データを絖出し、そのうちのソース画素データ
のみをディスティ・ネーション画紫位置に埋め込む処理
が必要である。
第8図は、4ビット/画素モードの場合の1画素の転送
処理の流れを示したものである。まず、ソース画素の含
まれる表示用メモリ19の1語が読出され、データバッ
ファ18に一時記憶される。
一方、ソース画素を指定するアドレス情報の下位4ビツ
トとディスティネーション画素を指定するアドレス情報
の下位4ビツトが減算される。この値は、ソース画素と
ディスティネーション画素のビット位置の差を表してい
る。ソース読出しデータがバレルシフタ14でシフトさ
れ、ソース画素(C1)はディスティネーションll1
11素の位置にJiihえられる。続いて、ディスティ
ネーション画素(Cd)の含まれる1語が読出され、i
龍埋演算器17でソース画素(C8)との演丼が行われ
る。このとき、マスク情報としてはディスティネーショ
ン画素位置にのみ1″が発生されているので、ディステ
ィネーションの1画素のみが更新され1込みデータが得
られる。tj、Iii埋演算演算類は、ぼ侯え、論理演
昇、などが可能である。4ビット/画素モード以外の場
合にも、マスク情報の形式が異なるのみで、まったく同
様の演算が行われる。
以上のように本実施例によれば、1画素のデータがvJ
故のビットで表現される場合にも、ソース読出し、ディ
スティネーション、υを出し、ディスティネーション書
込み、の3回のメモリアクセスで任意の画素位置に対し
て画素データの転送ができるという効果がある。
〔発明の効果〕
以上詳細に説明したように、本発明によれば、表示用メ
モリの1語に複数画素のデータが格納される場合にも、
表示用メモリ内での高速データ転送が可能である。
また、第9図は、本発明の応用例として、矩形頭載の転
送命令のポインタ移動方向(SD)を示す。画素単位の
処理を行なうため種々のポインタ走査が可能である。(
a)〜(h)の8通りの移動方向が短縁されており、ソ
ース領域、ディスティネーション・唄域にそれぞれ独立
に指定できる。従って転送方法に種々の組合せが可能で
ある。第10図は、ソース領域に5D=1、デイステイ
ネーンヨ/領域に5D=5を指定した転送例を示す。
【図面の簡単な説明】
第1図は画1象データ転送の例を示す図を、第2図は1
画素の転送を示す図を、第3図は従来のソフトウェア処
理のフローチャート會、第4図は本発明の実施例を示す
ブロック図を、第5図は第4図に対するデータ転送の説
明図を、第6図はピッ1フ画素モードの説明図を、第7
図は画素データ転送を示す図を、第8図は画素データ転
送の説明図を、第9図は・領域データ転送の説明図を、
第10図は領域データ転送の例を示す図を、それぞれ示
す。 10・・・ソースアドレスレンスタ、11・・・デイス
デイネーションアドレスレジスタ、13・・・減算器、
14・・・バレルシフタ、16・・・アドレスデコーダ
、17・・・嗣埋演算器。 第1(a)図 第1(b)図 15図 (a)1画素転送上−ト 第6目 1画素5り

Claims (1)

    【特許請求の範囲】
  1. 1.1語に複数画素の表示データを割自て、該データの
    アクセスを行って表示を制御する図形処理装置において
    、 前記表示用のメモリのアドレスと前記1語内の画素位置
    を指定する第1の画素アドレスとを記憶する第1の手段
    と、 前記表示用のメモリのアドレスと前記1語内の画素位置
    を指定する第2の画素アドレスとを記憶する第2の手段
    と、 前記複数画素に対応する複数ピットをシフト前記表示デ
    ータの複数ビットをシフト処理する第3前記1語内の画
    素位置を指定する情報から指定された画素位置に相当す
    る1又は複数のピット位置を指定する情報を出力する第
    5の手段と、前記1語の表示データ中の所定の画素に対
    応す畠 るピットに対してのみ描面論理演算を行う第6の手段と
    を有し、 前記第1の手段に記憶された前記第1の画素アドレスか
    ら得られるメモリアドレスを出力して前記表示用のメモ
    リの1語を読み出し、 前記第1の手段に記憶された第1の画素アドレスから得
    られる1語内の画素位置を指定する情報及び前記第2の
    手段に記憶された第2の画素アドレスから得られる1語
    内の画素位置を指定する情報から、前記第4の手段にて
    所定のシフtitを算出し、 前記表示用のメモリから読出されたデータを前記第3の
    手段によって前記所定のシフト量だけのシフト演算を行
    い、 前記第2の手段に記憶された第2の画素アドレスから得
    られるメモリアドレスを出力して表示用メモリの1語を
    読出し、 前記第6の手段によって前記第5の手段で指定される1
    又は複数のピット位置に対して前記第3の手段で得たシ
    フト結果を用いて更新演算し、前記表示用のメモリへの
    書き込みデータとして出力することを特徴とする図形処
    理装置。 2、特許請求の範囲第1項記載の図形処理装置において
    、 前記第3の手段は、1度に複数ビットをシフト処理する
    バレルシフタであることを特徴とする図形処理装置。 3、特許請求の範囲第2項記載の図形処理装置において
    、 1画素のビット数を指定するデータを格納する第7の手
    段を設け、 前記第5の手段において前記第7の手段の指定に従って
    複数通りのビット位置情報出力形態を有することを特徴
    とする図形処理装置。
JP59027155A 1983-12-26 1984-02-17 図形処理装置 Granted JPS60172085A (ja)

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