JPS58169185A - メモリのアクセス方式 - Google Patents
メモリのアクセス方式Info
- Publication number
- JPS58169185A JPS58169185A JP57052995A JP5299582A JPS58169185A JP S58169185 A JPS58169185 A JP S58169185A JP 57052995 A JP57052995 A JP 57052995A JP 5299582 A JP5299582 A JP 5299582A JP S58169185 A JPS58169185 A JP S58169185A
- Authority
- JP
- Japan
- Prior art keywords
- data
- bits
- decoder
- bit
- address
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(8)発明の技術分針
本発明は%1C1iiI!1g#処理システムに用いら
れるメモリのアクセス方式に関する。
れるメモリのアクセス方式に関する。
■)h術のNj!1
&像は人聞の感覚器1の中で特に発達している視覚を利
用しようとするものであり、プンビーータの処理結果を
人間に伝達する媒体として最適の4のといわれている。
用しようとするものであり、プンビーータの処理結果を
人間に伝達する媒体として最適の4のといわれている。
そして伝達効果を更にあけるために各種の補助機能が用
いられているが、表示面上において画像を移動させる方
法奄その一例として各種0@像処理システムにおいて頻
繁に用いられるようになりた。
いられているが、表示面上において画像を移動させる方
法奄その一例として各種0@像処理システムにおいて頻
繁に用いられるようになりた。
(Q I来技術と問題点
例えけりフレッシュ形の1iil像表示錬tにおいては
表示面分のh&に対応したバッフアメ毫すを備えパクフ
ァメ峰りの内容を繰返し表示するものであり、表示のt
更をおこなうにはバックアメモリの内容の書替えをおこ
なりている。
表示面分のh&に対応したバッフアメ毫すを備えパクフ
ァメ峰りの内容を繰返し表示するものであり、表示のt
更をおこなうにはバックアメモリの内容の書替えをおこ
なりている。
し九がって、−像を水平方向に移動させるためにはパッ
クアメモリの内容をそのように書替えればよい。モノク
ローム式表示装置においては1m素分のデータは通常1
ビツトであるので、1ビツトずつシフトして書替えれは
111mは水平方向に1画素分ずつ移動するわけである
。
クアメモリの内容をそのように書替えればよい。モノク
ローム式表示装置においては1m素分のデータは通常1
ビツトであるので、1ビツトずつシフトして書替えれは
111mは水平方向に1画素分ずつ移動するわけである
。
ところが従来のメ毫すのアクセス方式においては、デー
タにはビット・バイトあるいはワード単位罠アドレスが
与えられ、且つメモリの内容の書替え社アドレス岸位す
力わちビット・バイトあるいれワード単位におこ々って
いた。このため1ビツトのシフトも1バイトあるいは1
ワードのシフトと同じ処丹時間を要し、これ以上早くす
ることができないという欠点があった。
タにはビット・バイトあるいはワード単位罠アドレスが
与えられ、且つメモリの内容の書替え社アドレス岸位す
力わちビット・バイトあるいれワード単位におこ々って
いた。このため1ビツトのシフトも1バイトあるいは1
ワードのシフトと同じ処丹時間を要し、これ以上早くす
ることができないという欠点があった。
(ハ)発明の目的
本発明の目的は、前記従来例の欠点の排除、すなわち、
1バイト分あるいは1ワ一ド分の構成ビット数よりも少
々いビット数をシフトしてデータの書込みをおこなう場
合、その速度を従来より本増大し得るメモリのアクセス
方式を提供するととKある。
1バイト分あるいは1ワ一ド分の構成ビット数よりも少
々いビット数をシフトしてデータの書込みをおこなう場
合、その速度を従来より本増大し得るメモリのアクセス
方式を提供するととKある。
(ト)発明の構成
本発明になるメモリのアクセス方式は、入力データを所
定のビット数シフトして出力するデータデコーダと、前
記所定のと、ト数をあらかじめ記憶するレジスタと、前
記デコーダの出力データに対しビット毎にビット番号と
シフトされたビット数と、【応じてはm〜を指定するア
ド レスデコーダとを備え、所定のビット数シフトさせ九デ
ータの書込みを高速におこなうようにし九ものである。
定のビット数シフトして出力するデータデコーダと、前
記所定のと、ト数をあらかじめ記憶するレジスタと、前
記デコーダの出力データに対しビット毎にビット番号と
シフトされたビット数と、【応じてはm〜を指定するア
ド レスデコーダとを備え、所定のビット数シフトさせ九デ
ータの書込みを高速におこなうようにし九ものである。
(至)発−の実施例
次に本発明の要旨を図示実施例によって具体的に説−す
ゐ。
ゐ。
第1図は本発明一実施例のブロック図を示し、図におい
てlはデータの書込みがなされるメモリ、2はデータバ
スを経て転送される入力データを後記レジスタの内容に
応じて所定のビット数シフトして出力するデータデコー
ダ、3祉データデコーダ2がシフトするビット数をあら
かじめ記憶するレジスタ、4はデータデコーダ2の出力
データに対しビット毎にビット番号とシフトされたビッ
ト数とに応じはじめのアドレスもしくは次のアドレスを
指定するアドレスデコーダである。
てlはデータの書込みがなされるメモリ、2はデータバ
スを経て転送される入力データを後記レジスタの内容に
応じて所定のビット数シフトして出力するデータデコー
ダ、3祉データデコーダ2がシフトするビット数をあら
かじめ記憶するレジスタ、4はデータデコーダ2の出力
データに対しビット毎にビット番号とシフトされたビッ
ト数とに応じはじめのアドレスもしくは次のアドレスを
指定するアドレスデコーダである。
このような構成において、例えばデータ長t8ビット、
シフトするビット数を3ビツトとする場合について説明
をおこなう0まずシフトするビ。
シフトするビット数を3ビツトとする場合について説明
をおこなう0まずシフトするビ。
ト数「3」をレジスタ3にあらかじめ記憶する0これに
従ってデータデコーダ2は転送され九人カデータを3ビ
ツトずつシフトしてメモリIK送るCデータデコーダ2
に転送さ第1たある入力データに与えられていたはじめ
のアドレスをNとすれば、アドレスデコーダ4は第2図
に示すように前記データのうちビット番号b1とb3と
b4とb5のビットに対してはアドレスNを、またビッ
ト番号b6とb7とb8のビットに対してはアドレス(
N+1)を指定する。以下の入力データに対しても同様
にしてアドレス指定をおこなう。
従ってデータデコーダ2は転送され九人カデータを3ビ
ツトずつシフトしてメモリIK送るCデータデコーダ2
に転送さ第1たある入力データに与えられていたはじめ
のアドレスをNとすれば、アドレスデコーダ4は第2図
に示すように前記データのうちビット番号b1とb3と
b4とb5のビットに対してはアドレスNを、またビッ
ト番号b6とb7とb8のビットに対してはアドレス(
N+1)を指定する。以下の入力データに対しても同様
にしてアドレス指定をおこなう。
このように、レジスタ3に任意のビット数を記憶するこ
とKよって任意のビット数をシフトしてメモリlにデー
タの書込みをおこなうことができるのであるが、このシ
フトのために1通常の書込みの場合に比し特別の時間を
要することがない。
とKよって任意のビット数をシフトしてメモリlにデー
タの書込みをおこなうことができるのであるが、このシ
フトのために1通常の書込みの場合に比し特別の時間を
要することがない。
(2)発−の効果
実施例によって説明したように、本発明によるメモリの
アクセス方式によれば、1バイト分あるいは1ワ一ド分
のビット数より少ない任意のビット数をシフトしてメモ
リにデータの書込みをおζなう場合、その速度を従来よ
りも増大することができる。したがって本発明を画像テ
く示装置に適用した場合、表示画像を水平力向に移動さ
せる時間を従来よりも短縮することができる。またホス
トコンピュータの負荷を1滅することもできるC7
アクセス方式によれば、1バイト分あるいは1ワ一ド分
のビット数より少ない任意のビット数をシフトしてメモ
リにデータの書込みをおζなう場合、その速度を従来よ
りも増大することができる。したがって本発明を画像テ
く示装置に適用した場合、表示画像を水平力向に移動さ
せる時間を従来よりも短縮することができる。またホス
トコンピュータの負荷を1滅することもできるC7
Claims (1)
- 入力データを所定のピット数シフトして出力するデータ
デコーダと、前記所定のビット数をあらかじめ記憶する
レジスタと、前記データデコーダの出力データに対しビ
ット毎にビットt*とシフトされたピット数とに応じて
はじめのアドレスもしくは次のアドレスを指定するアド
レスデコーダとを備え、所定のビット数シフトさせてデ
ータの書込みをおこなうことを%黴とするメモリのアク
セス方式。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP57052995A JPS58169185A (ja) | 1982-03-31 | 1982-03-31 | メモリのアクセス方式 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP57052995A JPS58169185A (ja) | 1982-03-31 | 1982-03-31 | メモリのアクセス方式 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS58169185A true JPS58169185A (ja) | 1983-10-05 |
Family
ID=12930502
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP57052995A Pending JPS58169185A (ja) | 1982-03-31 | 1982-03-31 | メモリのアクセス方式 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS58169185A (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS60172085A (ja) * | 1984-02-17 | 1985-09-05 | 株式会社日立製作所 | 図形処理装置 |
JPS63147191A (ja) * | 1986-12-10 | 1988-06-20 | 松下電器産業株式会社 | 画素デ−タ処理装置 |
JPS63298545A (ja) * | 1987-05-29 | 1988-12-06 | Matsushita Electric Ind Co Ltd | メモリ装置 |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS53111244A (en) * | 1976-12-29 | 1978-09-28 | Fujitsu Ltd | Display system for position |
-
1982
- 1982-03-31 JP JP57052995A patent/JPS58169185A/ja active Pending
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS53111244A (en) * | 1976-12-29 | 1978-09-28 | Fujitsu Ltd | Display system for position |
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS60172085A (ja) * | 1984-02-17 | 1985-09-05 | 株式会社日立製作所 | 図形処理装置 |
JPH0562348B2 (ja) * | 1984-02-17 | 1993-09-08 | Hitachi Ltd | |
JPS63147191A (ja) * | 1986-12-10 | 1988-06-20 | 松下電器産業株式会社 | 画素デ−タ処理装置 |
JPS63298545A (ja) * | 1987-05-29 | 1988-12-06 | Matsushita Electric Ind Co Ltd | メモリ装置 |
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