JPS592107A - インタ−フエイス装置 - Google Patents

インタ−フエイス装置

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JPS592107A
JPS592107A JP58097018A JP9701883A JPS592107A JP S592107 A JPS592107 A JP S592107A JP 58097018 A JP58097018 A JP 58097018A JP 9701883 A JP9701883 A JP 9701883A JP S592107 A JPS592107 A JP S592107A
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General Electric Co
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    • H03M1/12Analogue/digital converters
    • H03M1/48Servo-type converters
    • H03M1/485Servo-type converters for position encoding, e.g. using resolvers or synchros

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】
この発明は一般的に外部で発生された信号をR1算及び
制御計装にインターフェイス接続する手段、特に種々の
形式の交代的な位置感知変換器からの信号を数値制御装
置、バ1算機又はその他の計装にインターフェイス接続
する回路に関する。 発明の背景 物体の相対位置を非常に正確に決定して、知覚した位置
に基づいて適正な措置をとることが出来る様に、決定さ
れた位置を制御装置又は81算様に知らける為にいろい
ろな努力を払う必要のある場合が多い。例えば、数値制
御の工作機械ぐは、成る基準位置に対する加工工具の位
置を連続的に且つ正確に決定りることか絶対条件である
。勿論、いろいろな種類の位置を決定する変換器がよく
知られCおり、数値制御の用途では、位置変換器は符号
化器形式又はレゾルバ形式の何れがであるのが普通であ
る。こういう装置は位置の直線的な変化、又は軸の位置
の角度変化の様な角度変化に応答し得る。 然し、この様ないろいろな形式の装置によって発生され
る位置を表わす信号は、かなり形式が異なる。即ち、信
号を制御装置又はその他のit装に呈示づる時、変換器
の形式に関係なく、受取る側の計装と両立し得る形で信
号を呈示Jる為に、夫々−組の信号を違った形でインタ
ーフェイス接続しな()ればならない。普通、受取側の
C1装に対づる全く別個の2つの人力チャンネルを設け
るという意味C1本質的に別々C異なる2つのインター
フェイス装置が用いられている。特に数値制御の分野で
は、交代的な形式の位置感知変換器を複雑で別個の回路
通路を必要とせずに、制御装置のif算機母線システム
に容易にインターフェイス接続することが出来、且つ信
号の形式が異なるにもか)わらず、交代的な変換器に共
通の信号処理部品を使うことによって、回路の経済性が
達成される様な何等かの手段が当業者から求められてい
る。 従って、この発明の目的は、上に)本へた様な問題並び
に条件を満足する様に、交代的な形式の位置感知変換器
を計算機の母線システム又はその他のh1装にインター
フェイス接続づる装置を117供することである。然し
、更に特定の目的は、符号化器形式又はレゾルバ形式の
何れの位置変換器でも、数値制御装置に便利に且つ経済
的にインターフェイス接続することが出来る様な回路を
提供りることである。 窺貝の概要 この発明の好ましい形式では、数値制御装置によってそ
の位置を制御しようとする物体の位置を監視する様に配
置された符号化器又はレゾルバがらの信号を数値制御装
置の制御i−+紳機に選択的にインターフェイス接続覆
るインターフェイス装置を提供りる。 この装置は、符号化器からの信号をインターフェイス接
続すべき時、第1の様式ぐ逆進31数器とし−(作用し
術るど共に、レゾルバからの信号をインターフェイス接
続すべき時、第2の様式で基準51数器どして作用し得
るディジタル計数器と、該81数器及び制御計*iの間
に接続されていて、計数器からのカウントを受取り、h
1算機によって読取る為に該カウントを保持するデータ
・ラッチと、符号化器様式〇は、各々のカウントが符号
化器によって感知された位置変化を表わり一様なカウン
ト信号を発生リ−ると共に、符号化器によって感知され
た移動の方向を表わづ信号を発生する様に作用づる回路
と、レゾルバ様式では、レゾルバ回路からの基準信号が
発生した時に、計数器をゼロにリレットづる様に作用り
ると共に、レゾルバ回路からの位置を表ねり信号と略同
時に発生するカラン、ト値をデータ・ラッチが獲得し−
C保持する様に作用する回路と、適当な時刻に計数器か
らのカウント値をラッチしC保持し、その後計算機から
の指令があった時、S1算機がこのカラン1〜を読取れ
る様にするデータ転送制御回路とを有する。 泪数冊は、何れの様式でも、監視4る物体の現在位置を
表わすカウント値を発生づる。 この発明の要旨は特許請求の範囲に具体的に且つ明確に
記載しであるが、この発明を以下図面について説明づる
所から、更によく理解されよう。 詳細な記載 第1図には数値制御の機械10が示され−Cいる。 この機械は、成る°特定の工作物に対する加工作業を行
なう様に指示される工作機械であってよい。 機械10に1対の位置変換器12.14が接続されるこ
とが示されている。この一方は符号化器(12)であり
、他方はレゾルバ(14)である。 この発明の説明を判り易くする為、形式の異なる2つの
変換器が1台の機械に接続された場合を示したが、実際
には、任意の所定の時刻に、一般的に一方の種類又は他
方の種類の変換器だ1ノが使ねれることが理解されよう
。更に、変換器12.14は、直線変位、又は角度或い
は回転変位に応答づる種類のものであってよい。この発
明は何れの種類の動作にも適している。変換器12.1
4はに作機械10の例えば切削工具又はその他の部品の
変位を表わり様に配置りることが出来る。 2つの形式の変換器によって発生された信号はかなり形
式が異なる。符号化器は「A jjツドB」形式と普通
呼ばれる様な3つの別個の信号を発生Jる。即ち、A相
信号PA、B相信号F) B及びZ相信号PZである。 信号P△及びP Bの振幅変化の数を追跡することによ
って、これらの信号から位置が決定され、それらの位相
関係が変位の方向を表わJ、、信号1) Zは基準マー
カとなり、例えば回転形符号化器では、符号化器の軸の
1回転毎に1回発生す−る単独のパルスである。符号化
器の信号はその前縁並びに後縁が実質的に4角であるが
、第1図の信号条件づ(J装置16に於て行なわれる様
な1角乗作用]によっC改善することが好ましい。 レゾルバ14が発生ずる出力信号の基準信号に対する位
相関係が位置を表わJoこの為、第1図では、レゾルバ
14が励振装置18からの信号によって励振される。励
振装置が基準信号又は[同期」信号を発生し、これに対
してレゾルバの出ツノ信号の位相を比較する。レゾルバ
の出力が波形整形回路20を介して取出され、波形整形
信号wSとなる。レゾルバに対する励振信号、従っC1
同期信号と信号WSは、例えば約3 K f−1zの周
波数にづることが出来る。 符号化器12又はレゾルバ14がらの位置を表わす信号
が(勿論具なる形式で)s1算m母線21にインターフ
ェイス接続される。この母線は、工作機械10に対する
数値制御装置の中にある81紳機との情報交換をする通
路として作用する。この点で、変換器12.14(何れ
が使われ”Cいるかに応じて)によって発生された位置
情報がディジタル計数器22からデータ母線21に転送
されることが認められよう。計数器22は、位置情報が
符号化器12から来るがレゾルバ14がら来るがに応じ
で、逆進轟1数様式又は基準計数様式の何れかひ動作し
1qる。この特徴は後で更に詳しく説明づる。然し、最
初は、2つの入力変換器に対−りる信号処理回路を説明
し、先ず符号化器12からの□信号を数十げる。 信号F) A及びPBが最初にり[1ツク作用によって
同期及び遅延回路23に送られ、入力信号P△及び1)
I3を同SU1させて遅延したものを作る。これらの信
号から、パルス発生器24が一連のパルスを光生りる。 この各々のパルスが入力信号1)Δ及びPaの振幅変化
を表わ1゜同時に、方向感知回路26が、監視される装
置の移動の方向を表ねり出力信号(遅延しC同期させた
入力信号の位相関係に基づく)を発生器る。 様式選択回路28が入力の選択(符号化器12又はレゾ
ルバ14のどちらをインターフェイス接続づ−るかに基
づい−C人力線29で決められる)に応答し−C1線3
0に出力信号を発生゛する。この出力信号は、H1数器
22に増数/減数計数器として第1の様式(符号化器)
で動作りるか、又は基準81数器として第2の様式〈レ
ゾルバ)で動作することを指示する。入力の選択は、手
動スイッチ、ジャンパ配線又は任意の同様な適当な手段
によって行なうことが出来る。 符号化器の人力に対しては、h向感知回路26によって
発生された方向信号が実質的に変化なく様式選択回路2
8を通過し、符号化器12が感知した移動の方向の関数
として、計数器22に増数又は減数計数する様に指示す
る為に使われる。 様式選択回路28からの信号によって制御されるゲート
回路32が、パルス発生器24がらの変化を表わリーパ
ルスを計数器22のイζ]能入力に通過させる。これら
のパルスが、符号化器12が応答した動きに従って、(
方向感知回路26がらの15号によって指示される通り
に)ム1数冊22にJ、って増数又は減数y1数される
。最初に破算されCいるので(これは後で詳しく説明り
る)、旧数冊22は常に監視づる■具又は物体の現在位
置を表ゎリカラント値を持っている。 マーカ信号PZは、それからの変位を測定りる為の1口
基準点を設定することが出来る様にづる。 信号])/は周期的に発生づるパルスであり、これはり
1−1ツク作用によっ−C同期及び遅延回路34に通さ
れ、適当な持続時間を持つマーカ・パルスになる。ゲー
ト36の他方の入力に1ゼロ設定基準」九′[゛可信号
が供給された時には、何時でもマーカ・パルスがゲート
36を通過づる。符号化器様式で動作する場合、排他的
オア・ゲート38が出力信号LDを発生し、これは計数
器をゼロにリセットし、こうしく基準点を作る。位置ぎ
めされる物体が基準点から遠ざかるにつれで、現在位置
31数器22の)」ラントが増加する。物体が基準点に
向って近づくと、カウントが減少する。「ゼロ設定基準
」信号は、一般的に係員によっ
【開始され、機械10の
初期の設定の間に使うことが出来る。 これに対しCルゾルバ様式では、様式選択回路28がh
向感知回路26からの信号を阻止し、線30に信号を発
生して、δ1数器22を強制的に増数81数様式にと鵠
゛める。同時に、ゲート32の状態が固定され、それが
計数器22の入力E N l)に付能信号を供給する様
にする。この為、h1数器22は基t!P−,;I数様
式にあっC1この時入力端子CCに印加されたシステム
・り[1ツク39からの(3号を計数りる。 レゾルバ様式にある時、レゾルバ励振回路18からの一
定の速匪の同期パルスが同期及び遅延回路40を通過し
て、信号の適正なタイミングをどろと共に、適正な持続
時間を持つパルスを作り出す。同期パルスが排他的オア
・ゲート38に印加され、これが信号LDを計数器22
に通過さけ、それをゼロにリセットづる。この為、レゾ
ルバ様式では、計数器22はレゾルバ同期信号が発生づ
る時、反復的にゼロにリセットされ、その後、へ1数器
が同期信号が再び発生づ−るのと略一致して予定のカウ
ントに達するまで、クロック信号を増数計数づることが
許される。この後、計数器22がゼロにリセットされる
。1例として、種々の1g号(例えばクロック信号及び
同期信号)のタイミング及び周波数関係は、計数器が3
999まひ旧教して、ゼロにリセットされる様にづ−る
ことか出来る。この為、例えば回転レゾルバぐは、36
0゜の回転が4000個の部分に分割される。 レゾルバ様式では、信号WSが発生した時に旧教冊22
に存在リ−るカウントは、監視する位置を表わリカラン
トである。この点、信号WS及び同期16号の間の位相
の隔たりが位置を表わづことに注意されたい。この為、
信号WSの時点で計数器22に累算されたり[1ツク・
パルスの数が、同期信号と信号WSの間の期間を表わし
1.監視りる位置を表わり。従って、信号WSは、位置
の目安としで、η1数器22の値をラッチづる為に使わ
れる。 信号WSは最初に同期回路42で同期さけられ、その俊
パルス発生器44ぐWS制御信号を取出す。 この制御信号は、データ転送制御回路46を通じて作用
し、B1数器22にあるカウントを1対のデータ・ラッ
チ48.49にラッチし、こ)からこのカウントを計算
機母線21に転送づる。当然、データ・ラッチ48.4
9が制御される態様は、符号化器12又はレゾルバ14
のどちらを使っCいるかに応じて異なる。 符号化器様式では、データ・ラッチ48.49は、クロ
ック・サイクル毎に、データ転送制御回路46からの線
50を介し−C何曲される。従つC1ラツヂ48.49
にあるカウントが計数器22のカウントを追跡覆る。然
し、線52に読取信号が発生覆ると、カウントがラッチ
され、S1算機母線21を介して中央計算機へ転送され
る。レゾルバ様式では、信号WSが発生したことによつ
Cラッチ48.49が何曲される時を除き、データがフ
ッヂされる。信号WSが発生した時、ラッチ(まR1数
器22から新しいカウントを獲得し、そのカウントを直
ちにラッチづる。レゾルバ様式で線52の読取信号は、
ラッチされたデータを計算機母線21に転送させる。 読取サイクルの間、データ転送制御回路46がラッチ4
8.49をラッチ状態に保ち、その時計数器からの新し
いカウントを獲得しない様にりる。 読取信号は、位置情報を供給する制御装置の訓粋機によ
って供給することが好ましく、周期的な速度で発生し得
る。 図示の様に、データは2つのバイトに分けて81枠I 
fJJ線に転送されるものとしている。2つのデータ・
ラッチ48.49の各々から1つずつのバイトが来る。 両方の様式ぐ、「現在位置」が、計数器の値を現在位置
ラッチに周期的にラッチしで、このラッチを読取ること
によっ゛(得られる。 第2Δ図及び第2B図は第1図の実施例を更に詳しく示
しているが、第1図の信号条イ′4づ(]回路1Gから
の符号化器信号PA及びPBが最初に8進り形フリップ
70ツブ60の別々のフリップフ1−1ツブの入力に印
加される。これらのフリップフ1−1ツブは人ツノ信号
[)Δ及びI) Bの変化をり[−Iツク・(ノイクル
と同期させる。夫々線61,62に現われるこれらのフ
リップフ目ツブの出力が8進フリツブフ11ツブ60の
対応づる第2組の7リツプフロツゾの人ツノに接続され
Cいる。この時信号は遅延してクロック・サイクルと再
び同期さけられCいる。信号1) A及びl) Bの再
び同期さけて遅延したものが、夫々出力線63.64に
現われる。 第1の1対のフリップフ1」ツブからの出力(信号P△
に関連していて線61.63に現われる)が第1の排他
的オア・ゲート66に印加される。 第2の1対の7リツプフロツプからの出力(信号P B
に関連していて線62.64に現われる)が第2の排他
的オア・ゲート68に印加される。これらの信号のタイ
ミングは、排他的オア・ゲート66が、入力信号PAの
各々の振幅変化Cパルスを発生し、排他的オア・ゲート
68が入力(、j ?31)Bの各々の振幅変化でパル
スを発生する様にhっCいる。ゲート66からのパルス
が第3の排他的オア・ゲート70の一方の入力に印加さ
れ、グー1−68からのパルスが同じゲートの他fjの
入力に印加される。従って、ゲート70からの出力は、
各々のパルスが信号PA又はI) Bの振幅変化を表わ
り様な一連のパルスである。 排他的オア・ゲート71が、フリップフに1ツブの出力
から線61を介して同期さゼた信号1)△、及び線64
を介して同期させて遅延した(ffi g l) +3
を受取る。排他的オア・ゲート71の出力は、f、号P
A及びPBの位相関係に応じC1従つC1監視りる物体
の移動の方向に応じC1高又は低になるパルス信号であ
る。 第3図は一方の移動方向C・成る特定の速痘の時の符号
化器の波形とそのタイミング関係を示1.。 前に述べた様に、動作様式は手動で選択可能である。一
般的に、この選択は人力線72に適当な信号RS L 
V Rを印加することによって行なわれる。この信号を
インバータ73.74で2回反転もて、信号R3LVR
A及びR8LVRAを発生りる。 装置が符号化様式にある時、信号+(S L1くΔが線
76に印加されて、符号化器によって構成された変換器
が使われていること、従ってゲート71からの方向信号
並びにグー1〜70のカウント・パルスをクロック作用
によって夫々フリツプフlilツブ77.78に通すべ
きであることを1対のD形フリップフ【−1ツブ77.
78に知らUる。 フリップフロツノ′78からのパルスが3つの4ビツト
2進泪数器80.81.82の何曲入力に印加され、こ
れと同時に、フリップ70ツブ77からの方向パルスが
各々の計数器の増数/減数人ツノに印加される。この為
、計数器は逆進様式にあって、符号化器が感知した移動
方向に応じC1変化パルスがカウントに加算され又は減
算される。 計数器80乃至82は、符号化様式にある時の成る基準
位置で、最初にゼ【」に設定することが出来、この為現
在位置が常にカウント値によって表わされる。この目的
の為、「ゼロ設定基準」がナンド・ゲート84の一方の
入力に印加される。後で説明り−るが、この信号は計算
機から供給することが好ましく、係員の判断によって開
始される。 信号PA、PB及びPZが同時に存在し、符号化器様式
にある時(R8LVRム信号が真)、アンド・ゲート8
5が出ツノパルスを発生する。このパルスが8進フリツ
プフロツプ装@60にある1対のフリップフロップで同
期させられると共に遅延し、線86.87にパルス(一
方は他方より遅延している)を発生する。線87のパル
スがインバータ88によって反転されてから、ナンド・
ゲート84の一方の入力に印加される。線86のパルス
がナンド・ゲート84の残りの、即ら3番目の入力に印
加される。「ゼロ設定基準」信号と同時にこれらの信号
が発生づると、比較的幅の狭いパルスが発生され、それ
がナンド・グー1−90を介しCバ1数冊80乃至82
の人力百に印加され、計数器をゼロにリセットJる。信
号「■は、PA又はl) [3の変化によって(端子[
: N l)に)カラン1〜信号が発生ずるのと同時に
発生し、他の場合に生ずるカウントは翳1数器をゼロか
ら変えない。 レゾルバ様式にある時、線76の信号R8LVπが低で
あり、フリップフロップ77.78によって計数器80
乃至82に増数計数様式を指示覆る。この為、hl数数
冊基準計数器になり、各々の81数器80乃至82の端
子CCに印加されたり【コック信号を増数翳1数りる。 第2A図及び第2B図には具体的にりUツクを示してな
い。必要な場合、り【1ツク入力はCL及びOLで表わ
してあり、これはり1ツク信号の反転形式及び非反転形
式を表ねり。図示のこの発明の実施例では、例えば12
M HZの周波数で動作するクロックが適している。 レゾルバからの同期パルスの合間の各々の期間の間、計
数器80乃至82が増数計数する。同明信号がアンド・
ゲート91及び同期用フリップフロツノ92に加えられ
、その後(信号5YNCΔとして)ナンド・ゲート90
に印加される。従つ”(、信号LDは同期信号の速度で
発生され、レゾルバの同期信号が発生ずる度に、計数器
80乃至82をゼロにリセットする。リセットされた後
、計数器は再びクロック信号の増数計数を自由に開始す
る。 レゾルバからの信号WSが発生した時、監視J−る物体
の現在位置の表示して、計数器の値をラッチJることが
望ましい。信号WSが、8進フリツプ70ツブ装置60
にある1対のフリツプフ【」ツブによって最初に同期さ
せられ且つ遅延さけられ、線93に同期遅延信号を発生
する。この信号がインバータ94に印加され、そこで反
転された後、アンド・ゲート95の一方の入力に印加さ
れる。 第1図の波形整形回路20で同期さけた信号WSが、ア
ンド・ゲート95の他方の入力に直接的に印加される。 その結果前られる出力パルスは、この明細書でパルスW
SPLSと呼ぶものである。 この波形整形パルスがD形フリップフ[1ツブ96に印
加され、それによっCクロックと再び同期さけられる。 フリップフロップ96の出力がナンド・ゲート97に印
加され、これはレゾルバ様式にある時、このパルスをア
ンド・ゲート98に通過させる。アンド・ゲート98が
このパルスをクロッ゛りの半サイクルの間通し、線99
にラッチ何面信号を発生ずる。 データ・ラッチ101.102は夫々ε3ビツト・ラッ
チであって、81数器80乃至82に接続されu、:、
l数冊に梵生きれた(適当な時刻の)現在位置カラン1
へを保持づる。レゾルバ様式では、上に述べた様に信号
WSI)LSから取出されたラッチイ1能信号は、単に
信号WSの後縁と略同時に、ラッチを4=J能りるだけ
Cある。この時、現在位置カウントが、ラッチの16ビ
ツトの内の最初の12ビツトどし−C1ラッチ101及
び102に捕捉され且つ保持される。 フリップフ[1ツブ96がナンド・ゲート97及びアン
ド・ゲート98と組合さっC同期作用をし、旧教冊80
乃至81がりL1ツク動作を受けるのと反対のクロック
の半サイクルで、ラッチ何面信号が発生する様にする。 これによって、h1数器80乃至82からのデータのラ
ッチ作用が、翳1数器が落着いた後にのみ起ることが保
証される。 符号化器様式では、ラッチ101.102は違った形で
動作覆る。この様式では、ラッチは各々り【−Jツク・
1ナイクルの半分の間何曲され、4律機からデータが要
請されるまで、ラッチ101.102にあるカウントは
胴数冊80乃¥82のカウントを追跡覆る。この為、符
号化器様式で・は、ナンド・ゲート97に対する人力R
S L V RΔが低ぐあって、その出力が高レベルに
なる。この出力信号がアンド・ゲート98の一方の入力
に印加される。り[1ツクでない他方の人)jも高であ
り、この為半クロック・サイクル毎にラッチ(=J能パ
ルスが発生される。従って、現在位置カウントがデータ
・ラッチ101及び102に反復的にラッチされる。デ
ータ・ラッチ101.102の出力線が、(何れかの変
換器からの)用柱位置データを制御バ1算機に周期的に
転送する為に、多重化アドレス及びデータ母線〈計算機
母線)104に接続される。 ラッチからの位置データが、削痺機からの読取指令によ
り、S1算機に転送される。後C説明覆るが、ラッチ1
01.102からの位置データが2つのパイ1〜に分け
て読取られる。一般的に、下位バイトを持つラッチ10
2からのデータは、RI)0信号が発生した時、最初に
読取られる。RDO信号がバイト間保持フリップフロッ
プ106及びデータ・ラッチ102に同時に印加される
。RDO信号が7リツプフL1ツ′ゾ106をセットシ
、アンド・ゲート98を介して、両方のデータ・ラッチ
101.102のデータをラッチJる為の信号を発生づ
る。ラッチ102のl(D O信号はデータの下位バイ
トを晶1算m母線104にもイ」能りる。 この後、1(D1信号が発生されて、ラッチ101から
の高位バイトをitem母線104にイ」能する。 RDI信号がフリップフロップ107及びラッチ101
に同時に印加される。データの両方のバイトが読取られ
るまで、ラッチ101.102にデータを保持するため
、ノリツブフロップ107、フリップフロップ108及
びアンド・ゲート109が協働し゛U、RDI信号の後
縁で破算パルスを発生ずる。これは、両方のバイトのデ
ータが読取られた後にのみ、バイト間保持フリップ70
ツブ106を破算し、こうしてラッチ101.102が
十分な期間の間、データを保持覆る様に保証す゛る。 第4図は読取信号RDO及びRDIの発生の仕方を示す
と共に、2つの形式の変換器の何れかに伴う誤りを検出
するこの発明の1面をも示し−Cいる。後に述べた方の
この発明の1面は、これまで説明しなかった所である。 第4図r、it算機母線104が、多重化アドレス及び
データ線ADO−へD7の他に、〈1)アドレス・ラッ
チ付能ALE、(2)チップ選択O3,(3)読取指令
RD及び(4)書込み指令W1(1に対りる制御み11
からの線をも含んCいる。 最初に81n機が信号ΔLE及びO8を出して、この発
明のインターフェイス装置i置に、自分がアドレスされ
Cいることを警告する。例えば読取り−イクルでは、ア
ドレスがアドレス・ラッチ115にラッチされ、アドレ
ス復号論理回路117によって復号されC1ΔD RS
 O信号及び△D R81信号を順次発生する。これら
の信号が計棹機からの読取信号1?j)とアンド・グー
1−118.119c夫々組合されて、適当な時刻に信
号[くDO及びRDlを発生りる。この信号が、上に述
べた様に、第2A図及び第2B図のデータ・ラッチ10
1.102とフリッ1)L】ツブ106.107に印加
される。81幹機1)s tらの書込み信号W R1−
がアンド・ゲート120でアドレス・ゼロ信号ΔD I
< S Oと組合されて、フリップフロップ121をレ
ットし、前に述べた「ゼ「」設定基準」信号を発生する
。この為、係員が計算機の制御装置を通じて、成る基準
点で符号化器様式を初ll!1設定りることが出来る。 史に第4図は線122のり[1ツク入力と2つのクロッ
クイ5号CL及びσTを発生覆るインバータ123とを
示しくいる。 この発明の特徴は、変換器信号に起り得る成る誤りを検
出することが出来ることである。例えば、符号化器から
の信号を処理する時、種々の影響により、信号PA及び
l) Bの振幅変化が略同時に起る様なことがある。こ
の様な誤りがある場合、第2A図の排他的オア・ゲート
66.68が何れも略同時にパルスを発生し、ナンド・
ゲート75を作動して、符号化器誤り表示信@ E N
 E +< Rを発生づる。 第5図はレゾルバ様式の誤り検出する回路を示づ。第2
B図の81数器82から、2048カウントを表わす信
号のパルスが、フリツプフ1]ツブ130.131で描
成された2バイトの計数器の一方の人力に供給される。 波形整形パルスW S +−’ LSが計数器回路に対
する反復的なリセツ1−信号になる。即ち、組数器が一
杯に計数Jると、この一杯に計数づる前に波形整形パル
ス(レゾルバ人力から取出す)が発生しなければ、レゾ
ルバ伝相がないことを示す信号RS E I< Rを発
生づる。信号RS L V R△によっC付能されるナ
ンド・ゲート132がトリガされ、誤り信号を発生する
。波形整形パルスはインバータ133及びナンド・ゲー
ト134を介して送込まれる。他の図面と同じく、第5
図に示した信号CLRは、この発明の図示の実施例のイ
ンターフェイス装置の機能を初期設定りる為に使われる
信号である。 1りび第4図について説明すると、誤りを表わす信号ト
N E F< R及びRS E RRがナンド・ゲート
1/IOに供給される。何れか一組の変換器信号に誤り
が検出された場合、フリップフロップ141がセットさ
れ、信号FBE)≧Rを発生づる。この信号が第2B図
のデータ・ラッチ101に1ビツトとしCラッチされる
。この後、誤りの表示が制御計n機に転送され、適正な
措置をとることが出来る様に°する。誤りに正しく応答
すると、hI算機から読出し゛(アンド・ゲート142
を作動し、フリップフI]ツブ141を破算することに
より、誤り信号が破算される。信@ RS E RRは
第2A図のナンド・グー1−97のパノjにもなり、変
換器信号に誤りが検出された場合、データ・ラッチ10
1.102がラッチされる様にする。 以上この発明の好ましい実施例を説明した。当業者であ
れば、この発明の範囲内でこの他の種々の実施例が考え
られることは明らかであろう。従って、この発明は、こ
)に説明した細部に制約されるものではなく、特許請求
の範囲の記載に含まれるいろいろな変更が可能であるこ
とを承知されIこ い 。
【図面の簡単な説明】
第1図はこの発明の好ましい形式のインターフェイス装
置のブロック図、第2A図及び第2B図は併せて第1図
に示したこの発明のインターフェイス装置の一部分の回
路図、第3図は符号化器様式に関連した第2A図及び第
2B図の回路の一部分のタイミング関係を示す時間線図
、第4図は第1図に示したこの発明のインターフェイス
装置の別の一部分の回路図、第5図はレゾルパイ3号の
誤りを検出りる回路の回路図である。 主な符号の説明 12:宥号化器 14:レゾルバ 21:組算機母線 22 : 、’il数器 数冊:パルス発生器 28;様式選択器 38:す1他的オア・グー1〜 39:クロック 44:パルス発生器 46:データ転送制御回路 48.49:データ・ラッチ 特γ1出願人

Claims (1)

  1. 【特許請求の範囲】 1)物体の相対位置を監視する様に第1及び第2の変換
    器が配置されていて、該第2の変換器は基準信号並びに
    該基準信号に対する位相関係が位置を表わづ様な位置信
    号を発生づる様に構成された形式であって、前記第1の
    変換器がその位相関係が位置の方向変化を表わし且つマ
    ーカ信号に対するその撮幅変化の数が位置を表わり様な
    信号Δ及びBを発生する形式である様な第1又は第2の
    変換器からの信号を選択的に語幹機にインターフェイス
    接続する装置に於て、第1の様式では逆進引数器として
    作用し得ると共に第2の様式では基準翳1数器として作
    用することが出来、何れの様式でも物体の位置を表わす
    出力カウントを発生覆るディジタルh1数器と、前記第
    1の変換器又は前記第2の変換器からの何れの信号を轟
    1算機にインターフェイス接続するかに応じて、前記計
    数器を第1の様式又は第2の様式で動作させる様式選択
    手段と、前記計算機及び前記計数器の間に接続されてい
    て、該t1数器からの出力カウントを受取ると共に、前
    記劇評機に対する指令された転送の為、該出力カウント
    を保持するデータ・ラッチ手段と、信号を同期させると
    共に基準計数の為のりUツク信号を発生ずる手段と、前
    記第1の変換器からの信@A及びBを受取り、それに応
    答して前記信号A及びBの変化を表わすカウント信号を
    発生し、前記計数器が第1の様式にある時、該信号Δ及
    びBの間の位相関係に応じて前記計数器が前記カウント
    信号を増数又は減数計数する様にする手段と、前記第2
    の変換器の基準信号を受取って、それに応答して、前記
    計数器が前記第2の様式にある時、前記基準信号が発生
    する度に、前記計数器をゼロ・カウントにリセットして
    、その後該訂数器が前記りOツク信号の計数を開始する
    ことが出来る様にする手段と、前記第2の変換器の位置
    信号を受取って、それに応答して、前記計数器が前記第
    2の様式にある時、前記位置信号と略同時に発生する前
    記計数器の出力カウントを前記データ・ラッチ手段に保
    持させる制御信号を発生ずる手段と、前記M数冊が前記
    第2の様式にある時、前記計算機からの読取指令に応答
    して、位置を表わすカウントのflnIffに対する指
    令された転送を実行するど共に、前記ら1数器が前記第
    1の様式にある時、前記計算機からの読取指令に応答し
    て、位置を表ねづ力1クントをラッチして、その51紳
    機に対づる指令された転送を実行するデータ転送制御手
    段とを右づる装置。 2、特許請求の範囲1)に記載した装置に於て、前記第
    1の様式にある前記計数器をゼロにしで、前記物体の位
    置変化を決定づる為の基準点を設定する手段を含む装置
    。 33)特許請求の範囲2)に記載した装置に於て、前記
    第1及び第2の変換器によって発生された信号を表わす
    信号の誤りを検出する誤り検出回路を含む装置。 4)特許請求の範囲3)に記載した装置に於て、前記デ
    ータ・ラッチ手段が前記出力カウントを2バイトに分り
    で保持する1対のデータ・ラッチで構成され、前記デー
    タ転送制御手段が前記計算機から読取信号及びアドレス
    信号を受取り−CO読取信号及び1読取信号を発生する
    手段と、該O読取信号及び1読取信号に応答して、前記
    1対の両方のバイトがhl算機に転送されるまで、前記
    データ・ラッチ手段が出力カウントを保持す′る様にさ
    ける手段とを含んでいる装置。 5)特許請求の範囲4)に記載した装置に於て、前記誤
    り検出回路が、前記制御信号が発生されないでいる経過
    期間に応答して第1の誤りを表わづ信号を発生する手段
    と、前記信号A及び(3を表わづ一信号の略同時の変化
    に応答して、第2の誤りを表わす信号を発生する手段と
    で構成されている装置。 6)特許請求の範囲5)に記載した装置に於C1前記様
    式選択手段が前記信号A及びBを表わづ信号を受取り、
    その位相関係に応答し−C1前記物体の移動方向に応じ
    て、前記計数器が前記カラン[一信号を増数又は減数計
    数する様に自動的に指示するゲート回路を含んでいる装
    置。 7)特許請求の範囲6)に記載した装置に於て、前記デ
    ィジタル引数器が12ビツトの同期81数器で構成され
    る装置。 8)その位置を当該数値制御装置によって制御しようと
    づる物体の位置を監視する様に符号化器又はレゾルバが
    配置されでぃc1Δ相信号及びB相信号及びマーカ信号
    を発生4゛る符号化器、又は基準信号及び位置信号を発
    生するレゾルバからの信号を数値制御装置の制御計算機
    に選択的にインターフェイス接続するインターフェイス
    装置に於て、前記符号化器からの信号をインターフェイ
    ス接続すべき時に第1の様式で逆進計数器として作用し
    得ると共に、前記レゾルバからの信号をインターフェイ
    ス接続すべき時に第2の様式でクロック信号を引数する
    基準S1数器として作用り゛ることが出来、何れの様式
    でも物体の現在位置を表わすカラン1−値を発生するデ
    ィジタル計数器と、該計数器及び制御計算機の間に接続
    されていて該計数器からのカウント値を受取って計算機
    によって読取る為に該カウント値を保持するデータ・ラ
    ッチと、第1の様式にある計数器と組合さっC1Δ相及
    びB相信号を受取り、それに応答して、各々のカラン1
    〜が前記物体の位置変化を表ゎ1様な轟1数可能な第1
    の信号を発生ずると共に、この変化の方向を表わす第2
    の信号を発生し、前記第1の信号が計数器に供給されて
    、該計数器によって計数され、前記第2の信号が前記引
    数器に供給されてその増数又は減数計数の向きを決定す
    る様に作用する手段と、前記第2の様式にある計数器と
    組合さって、前記基準信号を受取って、それに応答して
    、基準信号が発生する度に、前記計数器を1口・カウン
    ト値にリセッ]〜する様に作用づる手段と、前記第2の
    様式にある引数器と組合さって、前記位置信号を受取っ
    て、それに応答しで、前記データ・ラッチに、位置信号
    と略同時に発生するカウント値を獲得して保持させる様
    に作用する手段と、計算機からの読取指令を受取っC1
    それに応答して、計数器が第1の様式にある時、前記デ
    ータ・ラッチに前記計数器からの現在位置のカウン1〜
    値をラッチさけると共に、削数冊が第1又は第2の様式
    にある時、h1算機が現在位置のカウントを読取れる様
    にり−るデータ転送制御手段とを有するインターフェイ
    ス装置。 9)特許請求の範囲8)に記載したインターフェイス装
    置に於C1前記第1の様式にある計数器と組合さって、
    オペレータの指令があった時、前記物体の基準位置を表
    わ寸ゼロ・カウントに前記81数器をリセッ1〜する様
    に作用し得る手段を有するインターフェイス装置。 10)特許請求の範囲9)に記載したインターフェイス
    装置に於C1前記削数器が12ビツトの同期削数冊で構
    成され、前記データ・ラッチが第1及び第2の8ビツト
    ・データ・ラッチで構成されるインターフ1イス装置。 11)特許請求の範囲10)に記載しICインターフェ
    イス装置に於て、前記データ転送制御手段が、前記読取
    指令に応答して、前記第1及び第2の8ピツト・ラッチ
    からのカウント値を逐次的な2つのバイトに分りで計算
    機に転送する手段と、前記読取指令に応答して、両方の
    バイトの転送が完了するまで、前記データ・ラッチ4に
    現在位置のカウント値を保持させる手段とを含んでいる
    インターフェイス装置。 12、特許請求の範囲11)に記載したインターフェイ
    ス装置に於て、A相及びB相信号が略同時に発生するこ
    とを符号化器の信号の誤りの表示どして検出する手段と
    、予定の期間の間に位置信号がないことをレゾルバ信号
    の誤りの表示とし−C検出り−る手段とを有するインタ
    ーフ1イス装置。
JP58097018A 1982-09-07 1983-06-02 インタ−フエイス装置 Granted JPS592107A (ja)

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