JPS5856409A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
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- JPS5856409A JPS5856409A JP56155185A JP15518581A JPS5856409A JP S5856409 A JPS5856409 A JP S5856409A JP 56155185 A JP56155185 A JP 56155185A JP 15518581 A JP15518581 A JP 15518581A JP S5856409 A JPS5856409 A JP S5856409A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は絶縁基板上の半導体層に素子を形成した構造の
半導体装置の製造方法に関する。
半導体装置の製造方法に関する。
近年絶縁基板上の半導体装置1例えは5O8(Stli
eon on 5apphir・)Ml牛導体装置かそ
の高速性、低消費電力性から注目されてきている。
eon on 5apphir・)Ml牛導体装置かそ
の高速性、低消費電力性から注目されてきている。
従来サファイア上のシリコン層中には高密度な格子欠陥
や圧縮応力が存在し、半導体装置の電気的特性を変化さ
せていfcいすなわちMOSデバイス特性における実効
移動度の低下、しきい値電圧の変動、リーク電流の増加
等が挙けられる。
や圧縮応力が存在し、半導体装置の電気的特性を変化さ
せていfcいすなわちMOSデバイス特性における実効
移動度の低下、しきい値電圧の変動、リーク電流の増加
等が挙けられる。
最近、前記シリコン層中に高濃度の84”をイオン注入
することでシリコン層中の一部(例えばシリコンとサフ
ァイア界面近傍)を非晶質化し、次に約600℃以上の
温度で7ニールすることで非晶質化していない領域(例
えばシリコン表面II)を種に界面側へ同相成長させる
ことで大幅な結晶欠陥密度の減少と圧縮応力の減少を実
現する方法か開発されている。この方法は欠陥密度の高
い5l−t7フイア界面領域を非晶質化し、欠陥密度の
少ないシリコ7表thi@の結晶層を橿に同相成長させ
たことで欠陥減少を果したことにある。モして固相成長
を低温(例えば900℃以下ンで行なえはシリコン層中
の圧縮応力の減少も同時に実現できる。−万、このより
なSi イオン注入技術による結晶性改良を笑顔にデ
バイスへ応用する場合、従来ではデバイス製作前にシリ
コン層全面に81+をイオン注入して非晶質層を形成し
、次に600’C以上の熱処理を施して固相成長を行な
って結晶性を改良し、その後に通常のデバイス製作工程
を行なうことでデバイス特性の向上を得ていた。しかし
麿からこのような従来方法では固相成長後にデバイス製
作工程中に導入される900’C以上の熱処理工程にて
前に述べたシリコン層中の圧縮応力がSlとす7アイア
の熱膨張係数の違いに、よって再び生じるという問題が
あった。
することでシリコン層中の一部(例えばシリコンとサフ
ァイア界面近傍)を非晶質化し、次に約600℃以上の
温度で7ニールすることで非晶質化していない領域(例
えばシリコン表面II)を種に界面側へ同相成長させる
ことで大幅な結晶欠陥密度の減少と圧縮応力の減少を実
現する方法か開発されている。この方法は欠陥密度の高
い5l−t7フイア界面領域を非晶質化し、欠陥密度の
少ないシリコ7表thi@の結晶層を橿に同相成長させ
たことで欠陥減少を果したことにある。モして固相成長
を低温(例えば900℃以下ンで行なえはシリコン層中
の圧縮応力の減少も同時に実現できる。−万、このより
なSi イオン注入技術による結晶性改良を笑顔にデ
バイスへ応用する場合、従来ではデバイス製作前にシリ
コン層全面に81+をイオン注入して非晶質層を形成し
、次に600’C以上の熱処理を施して固相成長を行な
って結晶性を改良し、その後に通常のデバイス製作工程
を行なうことでデバイス特性の向上を得ていた。しかし
麿からこのような従来方法では固相成長後にデバイス製
作工程中に導入される900’C以上の熱処理工程にて
前に述べたシリコン層中の圧縮応力がSlとす7アイア
の熱膨張係数の違いに、よって再び生じるという問題が
あった。
本発明は上記欠点を解消するため罠なされたもので、非
晶質層の再結晶化と不純物の活性化とを同時に行なうこ
とによって絶縁基板上に良好な結晶性と圧縮応力が低減
された単結晶半導体層を簡単に形成し得る半導体装置の
製造方法を提供しようとするものである。
晶質層の再結晶化と不純物の活性化とを同時に行なうこ
とによって絶縁基板上に良好な結晶性と圧縮応力が低減
された単結晶半導体層を簡単に形成し得る半導体装置の
製造方法を提供しようとするものである。
以下1本発明をnチャンネルMos型半導体装置に適用
した例についてm1図(a)〜(幻を参照して説明する
。
した例についてm1図(a)〜(幻を参照して説明する
。
実施例
(1) tず、サファイア基板1土に単結晶シリコン
層を例えはエピタキシャル成長法によ)形成し、このシ
リコン層をフォトエツチング技術によF) /+ターニ
ングして島状の単結晶シリコン層2を形成した後、例え
Vi900’c以上の高温酸素雰囲気中で熱酸化処理し
てシリコン層2表面にダート酸化膜3を成長させた(第
19(a)図示)。
層を例えはエピタキシャル成長法によ)形成し、このシ
リコン層をフォトエツチング技術によF) /+ターニ
ングして島状の単結晶シリコン層2を形成した後、例え
Vi900’c以上の高温酸素雰囲気中で熱酸化処理し
てシリコン層2表面にダート酸化膜3を成長させた(第
19(a)図示)。
つづいて、 Sl+をダート酸化膜3を通して単結晶シ
リコン層2にイオン注入し、表面側を除くシリコン層2
に非晶質層4を選択的に形成した(第1図(b)図示)
。
リコン層2にイオン注入し、表面側を除くシリコン層2
に非晶質層4を選択的に形成した(第1図(b)図示)
。
[i+) 次いで、がロンをサファイア基板1の界面
付近の非晶質層4にピークをもつ濃度分布6となるよう
にイオン注入した(第1図(e)図示)。
付近の非晶質層4にピークをもつ濃度分布6となるよう
にイオン注入した(第1図(e)図示)。
このがロンのイオン注入はサファイア基板1界面のシリ
コン層を高濃度p型領域とすることによシ、サファイア
基板1界面に存在するn型界面単位による電子の反転層
の形成を防ぐために行なう。電子の反転層力・形成され
にチ・ンネルトランジスタがサファイア基板1の界面付
近全通して流れる、いわゆるパックチャンネル現象を起
こす。
コン層を高濃度p型領域とすることによシ、サファイア
基板1界面に存在するn型界面単位による電子の反転層
の形成を防ぐために行なう。電子の反転層力・形成され
にチ・ンネルトランジスタがサファイア基板1の界面付
近全通して流れる、いわゆるパックチャンネル現象を起
こす。
(lil) 次いで、全面に600℃の低圧CVD
@ 4c 19不純物ドープ多結晶シリコン膜を堆積し
、これをフォトエツチング技術によ多Δターニングして
ダート電極6.を形成した(第1図(dl示)。
@ 4c 19不純物ドープ多結晶シリコン膜を堆積し
、これをフォトエツチング技術によ多Δターニングして
ダート電極6.を形成した(第1図(dl示)。
つづいて、ダート電極6をマスクとしてソース。
ドレイン領域を形成するための砒素を濃度分布7となる
ように非晶質層4を有するシリコン層3にイオン注入し
た(第1図(・)図示)。
ように非晶質層4を有するシリコン層3にイオン注入し
た(第1図(・)図示)。
Ov) 次いで、全面に例えは600℃の低圧CVD
法によ、り 5tO2膜(層間絶縁II)at−堆積し
た後、900℃のPOC1s雰囲気中で燐処塩を施して
電子の安定化を行なった。この燻処理時において1、シ
リコン層2上層の単結晶層′t−樵とした同相成長によ
って非晶質層4が再結晶化され、良好な結晶性を有する
亨結晶シリコン層9に変換されると共に、イオン注入さ
れ九カロン、砒素が活性化されn” Wのソース、ドレ
イン領域JO。
法によ、り 5tO2膜(層間絶縁II)at−堆積し
た後、900℃のPOC1s雰囲気中で燐処塩を施して
電子の安定化を行なった。この燻処理時において1、シ
リコン層2上層の単結晶層′t−樵とした同相成長によ
って非晶質層4が再結晶化され、良好な結晶性を有する
亨結晶シリコン層9に変換されると共に、イオン注入さ
れ九カロン、砒素が活性化されn” Wのソース、ドレ
イン領域JO。
11が形成され、かつソース、ドレイン領域10911
間にp″′″領域とp領域からなるチャンネル領域J2
か形成された。なお、燐処理時間は30分間行なえは十
分である。つづいて、810、 J[aにコンタクトホ
ールを開孔し、全面にA7I!li真9蒸!シ、これを
Δターニングしてソース、ドレイン取出しAI電極13
、141f形成し、nチャンネルMO8型半導体装置
を製造した(第1図(f)図示〕。
間にp″′″領域とp領域からなるチャンネル領域J2
か形成された。なお、燐処理時間は30分間行なえは十
分である。つづいて、810、 J[aにコンタクトホ
ールを開孔し、全面にA7I!li真9蒸!シ、これを
Δターニングしてソース、ドレイン取出しAI電極13
、141f形成し、nチャンネルMO8型半導体装置
を製造した(第1図(f)図示〕。
しかして、本発明方法はSt のイオン注入後直ちに
固相成長を行なわず、JI造工程中に用いられるがロン
や砒素等のイオン注入後に不純物の活性化と固相成長を
同時に1回の熱処理で行なうために、以下に示す檀々の
効果を有する。
固相成長を行なわず、JI造工程中に用いられるがロン
や砒素等のイオン注入後に不純物の活性化と固相成長を
同時に1回の熱処理で行なうために、以下に示す檀々の
効果を有する。
第1i1tシリコン層2の濃度を変えたシ(例えば?ロ
ン)、導電型を変えたり(例えは砒素)する目的でイオ
ン注入された不純物は非晶′X層4中にはぼと)込まれ
るため、非晶質層4か再結晶化する際不純物が容易に8
1と置換され。
ン)、導電型を変えたり(例えは砒素)する目的でイオ
ン注入された不純物は非晶′X層4中にはぼと)込まれ
るため、非晶質層4か再結晶化する際不純物が容易に8
1と置換され。
その結果活性化温度を低下できることである。
活性化温度が低いことは、製造プロセスの低温化を実現
でき、ダート電極6下へのソース、ドレイン領域10.
11の広がシを抑制できるため、累、子の微細化に対し
て有利である。
でき、ダート電極6下へのソース、ドレイン領域10.
11の広がシを抑制できるため、累、子の微細化に対し
て有利である。
wJ2に、砒Xを非晶質層4に導入すると、その不純物
の拡散は速くなるため、低温で活性したにもかかわらす
深いソース、ドレイン領域10.11を形成できること
である。つtr、砒素のような拡散係数の小さい不純物
でもサファイア基板1にまで到達するソース、ドレイン
領域10.11を形成でき、ひいてはソース。
の拡散は速くなるため、低温で活性したにもかかわらす
深いソース、ドレイン領域10.11を形成できること
である。つtr、砒素のような拡散係数の小さい不純物
でもサファイア基板1にまで到達するソース、ドレイン
領域10.11を形成でき、ひいてはソース。
ドレイン領域の接合容量を低減できSOS構造の高速性
を維持できる。
を維持できる。
第3に、イオン注入層の活性化と固相成長を1回の熱処
理工程で行なうことによって、プロセスの簡略化と、結
晶性の改善はもとより圧縮応力が低減された単結晶クリ
;ン層9金形成できることである。
理工程で行なうことによって、プロセスの簡略化と、結
晶性の改善はもとより圧縮応力が低減された単結晶クリ
;ン層9金形成できることである。
なお、上記実施例ではサファイア基板界面付近の単結晶
シリコン層に非晶質層を形成する場合について述べたが
、かならずしもこうした方法に限定されない。例えば、
第2図に示す如く島状の単結晶シリコン層2の表面側に
非晶質層4′を形成し、その後−ロン非晶質層4′付近
にピークをもつ不純物分布5′となるようにイオン注入
してもよい。
シリコン層に非晶質層を形成する場合について述べたが
、かならずしもこうした方法に限定されない。例えば、
第2図に示す如く島状の単結晶シリコン層2の表面側に
非晶質層4′を形成し、その後−ロン非晶質層4′付近
にピークをもつ不純物分布5′となるようにイオン注入
してもよい。
また、上記実施例では燐処理(リングツメン工程で不純
物の活性化と固相成長を同時に行なったが、その他の熱
処理工程時に不純物の活性化と同相成長を行なってもよ
い。また熱アニールに代えてレーデアニールしてもよい
。
物の活性化と固相成長を同時に行なったが、その他の熱
処理工程時に不純物の活性化と同相成長を行なってもよ
い。また熱アニールに代えてレーデアニールしてもよい
。
上記実施例では絶縁基板としてサファイア基板を用いた
が、これに限定されず例えばスピネル基板、5io2基
板、第1絶縁層上に半導体層を介して第2の絶縁層を設
けた多層構造の基板等を用いてもよい。
が、これに限定されず例えばスピネル基板、5io2基
板、第1絶縁層上に半導体層を介して第2の絶縁層を設
けた多層構造の基板等を用いてもよい。
本発明方法はnチャンネルMO8型半導体装置の製造の
みに限らず、pチャンネルMO8型半導体製造や相補型
MO8半導体装置の製造等にも同様に適用できる。
みに限らず、pチャンネルMO8型半導体製造や相補型
MO8半導体装置の製造等にも同様に適用できる。
以上詳述した如く9本発明によれは絶縁基板上の単結晶
半導体層に形成した非晶質層の再結晶化と同半導体層に
導入した不純物の活性化を一回の熱処理工程により行な
うことによって、活性化温度の低減化、プロセスの簡略
化を図ることかできると共に圧縮応力が低減され、妙)
つ結晶性か良好な単結晶半導体層を形成でき、ひいては
高性能、高信頼性、高密度の半導体装置を製造できる等
顕著な効果を有する。
半導体層に形成した非晶質層の再結晶化と同半導体層に
導入した不純物の活性化を一回の熱処理工程により行な
うことによって、活性化温度の低減化、プロセスの簡略
化を図ることかできると共に圧縮応力が低減され、妙)
つ結晶性か良好な単結晶半導体層を形成でき、ひいては
高性能、高信頼性、高密度の半導体装置を製造できる等
顕著な効果を有する。
第1図(&)〜(f)は本発明の実施例におけるnチャ
ンネルMO8型半導体装置の製造を示す工程断面図、第
2図は本発明の他実施例を示すnチャンネルMO8型牛
導体装置の非晶質層形成工程の断面図である。 1・・・サファイア基板、2.9−島状の単結晶シリコ
ン層、3・・・r−ト酸化膜、4 t ’′・・・非晶
質層、6・・・ダート電極、10−真 型ソース領域、
11・・・n型ドレイン領域、12.13・・・Aノミ
極。 第1図
ンネルMO8型半導体装置の製造を示す工程断面図、第
2図は本発明の他実施例を示すnチャンネルMO8型牛
導体装置の非晶質層形成工程の断面図である。 1・・・サファイア基板、2.9−島状の単結晶シリコ
ン層、3・・・r−ト酸化膜、4 t ’′・・・非晶
質層、6・・・ダート電極、10−真 型ソース領域、
11・・・n型ドレイン領域、12.13・・・Aノミ
極。 第1図
Claims (1)
- 【特許請求の範囲】 絶縁基板上に単結晶半導体層を形成し、この半導体層の
厚さ方向に結晶格子の規則性を破壊するイオンを注入し
て非晶質層を選択的に形成した後、残存した単結晶層を
種とした固相成長によりて前記非晶質層を再結晶化する
に際し。 前記固相成長前に非晶質層を含む半導体層に不純物を導
入し、固相成長によって該加重質層の再結晶化と同時に
不純物の活性化を行なうことt−特徴とする半導体装置
の製造方法。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP56155185A JPS5856409A (ja) | 1981-09-30 | 1981-09-30 | 半導体装置の製造方法 |
US06/423,146 US4463492A (en) | 1981-09-30 | 1982-09-24 | Method of forming a semiconductor device on insulating substrate by selective amorphosization followed by simultaneous activation and reconversion to single crystal state |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP56155185A JPS5856409A (ja) | 1981-09-30 | 1981-09-30 | 半導体装置の製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS5856409A true JPS5856409A (ja) | 1983-04-04 |
Family
ID=15600335
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP56155185A Pending JPS5856409A (ja) | 1981-09-30 | 1981-09-30 | 半導体装置の製造方法 |
Country Status (2)
Country | Link |
---|---|
US (1) | US4463492A (ja) |
JP (1) | JPS5856409A (ja) |
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-
1981
- 1981-09-30 JP JP56155185A patent/JPS5856409A/ja active Pending
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1982
- 1982-09-24 US US06/423,146 patent/US4463492A/en not_active Expired - Lifetime
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