JPS58134430A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
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- JPS58134430A JPS58134430A JP1659882A JP1659882A JPS58134430A JP S58134430 A JPS58134430 A JP S58134430A JP 1659882 A JP1659882 A JP 1659882A JP 1659882 A JP1659882 A JP 1659882A JP S58134430 A JPS58134430 A JP S58134430A
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
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- H01L21/26—Bombardment with radiation
- H01L21/263—Bombardment with radiation with high-energy radiation
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明は、半導体基板中に内在する欠陥の除去さらに
ゾロ七ス造中で導入される欠陥の除去を効果的に行なわ
せる半導体装置の製造方法に関する。
ゾロ七ス造中で導入される欠陥の除去を効果的に行なわ
せる半導体装置の製造方法に関する。
半導体基板における欠陥は、この基板に対して形成され
る半導体素子の電気的特性に対して悪影響をおよぼすこ
とは、よく知られている。
る半導体素子の電気的特性に対して悪影響をおよぼすこ
とは、よく知られている。
半導体基板、例えばシリコン基板には、シリコン結晶製
作工sにおいて結晶中lfc@起される欠陥、および半
導体素子形成工種中の熱処理によって結晶中の酸素〔0
〕、炭素(C)等の不純、 2 物が核となって発生する欠陥等が存在するり現在のよう
に、1つめ半導体基板に対して多数の半導体素子を形成
するように、集積度を向上させるようにした場合、上記
のような半導体基板中の欠陥は大きな間llメなるもの
であ)、集積度を向上させる場合に上記のような欠陥の
発生防止の問題はさらに重要性を−すもので6石。
作工sにおいて結晶中lfc@起される欠陥、および半
導体素子形成工種中の熱処理によって結晶中の酸素〔0
〕、炭素(C)等の不純、 2 物が核となって発生する欠陥等が存在するり現在のよう
に、1つめ半導体基板に対して多数の半導体素子を形成
するように、集積度を向上させるようにした場合、上記
のような半導体基板中の欠陥は大きな間llメなるもの
であ)、集積度を向上させる場合に上記のような欠陥の
発生防止の問題はさらに重要性を−すもので6石。
従来、このような半導体基fK内在する欠陥の発生防止
の九めには、例えば素子の形成されない半導体基板の背
EIK対してかき傷を形成したり、リン等の不純物を拡
散した〕、あるいはイオン注入さらにはレーデ等を照射
して、半導体基板の背面部に欠陥の吸収源を形成させる
ことによって、加熱処理□工程において発生する欠陥等
を、上記吸収源に°吸収させるいわゆるr。
の九めには、例えば素子の形成されない半導体基板の背
EIK対してかき傷を形成したり、リン等の不純物を拡
散した〕、あるいはイオン注入さらにはレーデ等を照射
して、半導体基板の背面部に欠陥の吸収源を形成させる
ことによって、加熱処理□工程において発生する欠陥等
を、上記吸収源に°吸収させるいわゆるr。
タリングが行なわれている。
纂1図はその具体的手段を説明するもので、まず(4)
図に示すシリコン基板11の表面12には、従来から知
られている手段で素子の形Wされるもので、この表rf
jrxlld411)、シュされ硬面とされている。そ
して、このシリコン基板11の背面JJK対して、上記
素子の形成王権を行なうに先立ち、(至))図に示すよ
うにレーザを例えば15 J/cd権電照耐電照射るい
はイオン注入等でダメージ層14を形成する。
図に示すシリコン基板11の表面12には、従来から知
られている手段で素子の形Wされるもので、この表rf
jrxlld411)、シュされ硬面とされている。そ
して、このシリコン基板11の背面JJK対して、上記
素子の形成王権を行なうに先立ち、(至))図に示すよ
うにレーザを例えば15 J/cd権電照耐電照射るい
はイオン注入等でダメージ層14を形成する。
また、(0図に示すようにシリコン基板11の背ml
JK対して、例えばLPCVD等テ2000 X程度の
窒化シリコン(SIN)、多結晶シリコン4 等の薄膜15を堆積し、応力場を形成する。
JK対して、例えばLPCVD等テ2000 X程度の
窒化シリコン(SIN)、多結晶シリコン4 等の薄膜15を堆積し、応力場を形成する。
このように、シリコン基板11に対して、ダメージ層1
4あるいは薄$1..sによる歪層が存在すると、加熱
処理工程中において発生する微小欠陥の咳となる酸素や
炭車等の不純物、ある用い は熱処理に伴なって混入す、:、、る重金属等の汚染を
吸収し、欠陥の発生を防止するようになるものである・ しかし、C)図に示したダメージ層14を形成する手段
では、このダメージ層14が浅いものであるために1熱
処理を行なうとこのダメージ層14が消失し、r、タリ
ング能力が消失する欠点がある。また、(C)図の薄1
115を形成する手段では、シリコン基板11の背面1
3のみに窒化シリコン等の薄膜を堆積する感のである。
4あるいは薄$1..sによる歪層が存在すると、加熱
処理工程中において発生する微小欠陥の咳となる酸素や
炭車等の不純物、ある用い は熱処理に伴なって混入す、:、、る重金属等の汚染を
吸収し、欠陥の発生を防止するようになるものである・ しかし、C)図に示したダメージ層14を形成する手段
では、このダメージ層14が浅いものであるために1熱
処理を行なうとこのダメージ層14が消失し、r、タリ
ング能力が消失する欠点がある。また、(C)図の薄1
115を形成する手段では、シリコン基板11の背面1
3のみに窒化シリコン等の薄膜を堆積する感のである。
このため、例えばこの基板110表[IJjのみK C
VD等で酸化膜を形成し、次に基板11表面12および
背面13に窒化シリコン膜を形成し、その後シリコン基
板11の表面12の窒化シリコン膜を除去するような複
雑な工程を必賛とするようになる。さらに、窒化シリコ
ン嘆を形成する際に熱処理を必要とするようKなるもの
である。
VD等で酸化膜を形成し、次に基板11表面12および
背面13に窒化シリコン膜を形成し、その後シリコン基
板11の表面12の窒化シリコン膜を除去するような複
雑な工程を必賛とするようになる。さらに、窒化シリコ
ン嘆を形成する際に熱処理を必要とするようKなるもの
である。
さらに1上紀の、ような吸収源を形成する際に、重金属
等の汚染を1:伴なうおそれもある。
等の汚染を1:伴なうおそれもある。
この発明は1呵のような点に1みなされたもので、不畳
な熱i□′−を施す必要がなく、さらに上記レーデによ
るrツタリング効果と共に薄膜等の応力によるr、タリ
ング効果とが相乗作用して、より効果的に欠陥発生防止
効果を向上させ得るようにする半導体装置の製造方法を
提供しようとするものである。
な熱i□′−を施す必要がなく、さらに上記レーデによ
るrツタリング効果と共に薄膜等の応力によるr、タリ
ング効果とが相乗作用して、より効果的に欠陥発生防止
効果を向上させ得るようにする半導体装置の製造方法を
提供しようとするものである。
すなわち、この発明に係る製造方法は、半導体基板の背
面部に反応性物質を堆積したり、あるいは反応性ガス雰
囲気中で、すなわち少なくとも背面に反応性物質の存在
するガス雰囲気中で、上記半導体基板背面にレーデある
いは電子線を照射して、ダメージ層と反応生成薄膜層を
同時に形成させるようにするものである。
面部に反応性物質を堆積したり、あるいは反応性ガス雰
囲気中で、すなわち少なくとも背面に反応性物質の存在
するガス雰囲気中で、上記半導体基板背面にレーデある
いは電子線を照射して、ダメージ層と反応生成薄膜層を
同時に形成させるようにするものである。
以下図面を参照してこの発明の一実施例に係る半導体の
製造方法を説明する。まず、第2図に示すように、アン
モニア(NH,)等の反応性のガス雰囲気(反応性物質
)16の中に、第1図の囚で示したようなシリコン基板
11t−設定し、このシリコン基板11の背面13に対
して、例えばl 5 J/eta”のレーデ照射を行な
う。そして、シリコン基板1ノの背面13のみに、レー
デ照射による熱で解融したシリコンが、 3Si+4NH,→81sN4+6112のような反応
1に−起こし、183図に示′すようにシリコ7基板1
1の背面13に菫化シリコンC6L5N4 )の薄膜1
1が形成される。
製造方法を説明する。まず、第2図に示すように、アン
モニア(NH,)等の反応性のガス雰囲気(反応性物質
)16の中に、第1図の囚で示したようなシリコン基板
11t−設定し、このシリコン基板11の背面13に対
して、例えばl 5 J/eta”のレーデ照射を行な
う。そして、シリコン基板1ノの背面13のみに、レー
デ照射による熱で解融したシリコンが、 3Si+4NH,→81sN4+6112のような反応
1に−起こし、183図に示′すようにシリコ7基板1
1の背面13に菫化シリコンC6L5N4 )の薄膜1
1が形成される。
ここで、ガス雰囲気l#は、上記のようにアンモニアだ
けでなくぐ例えばシラン(ssn4)6るいはノクロロ
シラン(5iH2C42)とアンモニアの雰囲気、すな
わちr 5IH4+NH3Jあるいはr 81H2Cj
2+ NHsJ等の窒化シリコン(S i sNa )
膜の形成可能な雰囲気ならばよい。
けでなくぐ例えばシラン(ssn4)6るいはノクロロ
シラン(5iH2C42)とアンモニアの雰囲気、すな
わちr 5IH4+NH3Jあるいはr 81H2Cj
2+ NHsJ等の窒化シリコン(S i sNa )
膜の形成可能な雰囲気ならばよい。
また、雰囲気J6i例えばr 02 Jr81H4+
02J等で構成すれば、シリコン基板Iノの背面13に
s 102あるいtisiH4等によって多結晶シリコ
ンの薄膜が形成されるようになp1前記窒化シリコン膜
堆積効果と同様の効果を得られる。
02J等で構成すれば、シリコン基板Iノの背面13に
s 102あるいtisiH4等によって多結晶シリコ
ンの薄膜が形成されるようになp1前記窒化シリコン膜
堆積効果と同様の効果を得られる。
すなわち、上記のようにガス昼囲気16中でレーデ照射
することによって、シリコン基板11の背面13に、レ
ーデによるダメージ層と、窒化シリコンあるいは多結晶
シリコン等の薄膜の形成が同時に行なわれるようになる
。
することによって、シリコン基板11の背面13に、レ
ーデによるダメージ層と、窒化シリコンあるいは多結晶
シリコン等の薄膜の形成が同時に行なわれるようになる
。
したがって、このような手段によればシリコン基板11
の背向13に対して、熱処理工種を必要とせずに1 し
かも工程を特に増加させることなく、窒化シリコン等の
薄膜を形成することができ、この薄膜によるピックリン
グ効果とレーザ照射による重金属等の汚染のない!メー
、り層の形成によるr、タリング効果との相乗効果が得
られ、後に加熱処理工程を経ても上記r。
の背向13に対して、熱処理工種を必要とせずに1 し
かも工程を特に増加させることなく、窒化シリコン等の
薄膜を形成することができ、この薄膜によるピックリン
グ効果とレーザ照射による重金属等の汚染のない!メー
、り層の形成によるr、タリング効果との相乗効果が得
られ、後に加熱処理工程を経ても上記r。
タリング効果は消滅せず、はぼ全工程にわ九ってr、タ
リング能力が繍持される。すなわち、この半導体基板を
使用して構成される半導体素子の特性および製造歩留り
を、効果的に向上させることができる。
リング能力が繍持される。すなわち、この半導体基板を
使用して構成される半導体素子の特性および製造歩留り
を、効果的に向上させることができる。
尚、上記説明ではレーデ照射を半導体基板11の背面I
J全全面行なうようにしたが、これはライン状あるいは
格子状、同心円状、らせん状等の部分的照射を行なうよ
うにしてもよい。
J全全面行なうようにしたが、これはライン状あるいは
格子状、同心円状、らせん状等の部分的照射を行なうよ
うにしてもよい。
このようにし九場合には、背面13の全面に照射した場
合よりも、半導体□基□板11に加わる応力を小さくす
ることができる。さらには半導体基板表面のいわゆるス
クライプラインに形成してもよい。
合よりも、半導体□基□板11に加わる応力を小さくす
ることができる。さらには半導体基板表面のいわゆるス
クライプラインに形成してもよい。
オた、上記実施例では、アンモニア等のがスをレーデ照
射時において導入したが、レーデ照射前に半導体基板1
1の背面13に、この基板11と反応するような膜(反
応性物質)、例えば籾子状のモリブデン(Mo )、I
ロンナイトライド、リン等をあらかじめ堆積しておいて
もよい。
射時において導入したが、レーデ照射前に半導体基板1
1の背面13に、この基板11と反応するような膜(反
応性物質)、例えば籾子状のモリブデン(Mo )、I
ロンナイトライド、リン等をあらかじめ堆積しておいて
もよい。
また、レーデ照射によって形成された窒化シリコン膜等
は、レーデ照射部のみに形成されるようにしてよく、さ
らにレーデの照射部および未照射部の全面に上記膜が形
成されるように、レーデの波長により任意選定するよう
Kしてもよい。
は、レーデ照射部のみに形成されるようにしてよく、さ
らにレーデの照射部および未照射部の全面に上記膜が形
成されるように、レーデの波長により任意選定するよう
Kしてもよい。
さらに上記実権例では、半導体基板11の背面にレーデ
照射してシリコンを溶融するようにしたが、これはレー
デに隈らず電子線等を用いつ・。
照射してシリコンを溶融するようにしたが、これはレー
デに隈らず電子線等を用いつ・。
て4よいものである。
以上のようにこの発明によれば、半導体基板の素子の形
成されない背面等にダメージ層と薄膜層とを同時に形成
するようになるもので69、ダメーゾ層および薄膜層そ
れぞれによるビッタリング効果が相乗効果として得られ
、基板中の欠陥発生防止に非常に大きな効果を発揮する
ようになる。
成されない背面等にダメージ層と薄膜層とを同時に形成
するようになるもので69、ダメーゾ層および薄膜層そ
れぞれによるビッタリング効果が相乗効果として得られ
、基板中の欠陥発生防止に非常に大きな効果を発揮する
ようになる。
第1図は従来の半導体基板に対する欠陥発生防止工程を
説明する図、鷹2図および第3図鉱この発明の一実権例
を説明するもので、半導体基板に対する欠陥発生防止工
程を示す図である。 11・・・半導体基板、13・・・背面、16・・・f
ス亦囲気、11・・・薄膜。 出願人代理人 弁理士 鈴 江 武 彦第1図 第2区 第3図
説明する図、鷹2図および第3図鉱この発明の一実権例
を説明するもので、半導体基板に対する欠陥発生防止工
程を示す図である。 11・・・半導体基板、13・・・背面、16・・・f
ス亦囲気、11・・・薄膜。 出願人代理人 弁理士 鈴 江 武 彦第1図 第2区 第3図
Claims (1)
- 表面部に素子を形成すべき半導体基板の少なくとも背面
に反応性物質が存在する状態のがス雰囲気中で、上記半
導体基板背面部にレーデあるいは電子1等の一一〜−−
緩の照射を行ない、上記半導体背面にダメージ層および
反応生成薄膜層を同時く形成させるようにし九ことを特
徴とする半導体装置の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1659882A JPS58134430A (ja) | 1982-02-04 | 1982-02-04 | 半導体装置の製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1659882A JPS58134430A (ja) | 1982-02-04 | 1982-02-04 | 半導体装置の製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS58134430A true JPS58134430A (ja) | 1983-08-10 |
JPH0345535B2 JPH0345535B2 (ja) | 1991-07-11 |
Family
ID=11920724
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1659882A Granted JPS58134430A (ja) | 1982-02-04 | 1982-02-04 | 半導体装置の製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS58134430A (ja) |
Cited By (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS60111430A (ja) * | 1983-11-22 | 1985-06-17 | Rikagaku Kenkyusho | 半導体表面層に不純物又は金属層を埋め込み形成する方法 |
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