JPS58101081A - サ−マルヘツド駆動のためのデ−タの分配方式 - Google Patents
サ−マルヘツド駆動のためのデ−タの分配方式Info
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- JPS58101081A JPS58101081A JP56167379A JP16737981A JPS58101081A JP S58101081 A JPS58101081 A JP S58101081A JP 56167379 A JP56167379 A JP 56167379A JP 16737981 A JP16737981 A JP 16737981A JP S58101081 A JPS58101081 A JP S58101081A
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- B—PERFORMING OPERATIONS; TRANSPORTING
- B41—PRINTING; LINING MACHINES; TYPEWRITERS; STAMPS
- B41J—TYPEWRITERS; SELECTIVE PRINTING MECHANISMS, i.e. MECHANISMS PRINTING OTHERWISE THAN FROM A FORME; CORRECTION OF TYPOGRAPHICAL ERRORS
- B41J2/00—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed
- B41J2/315—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of heat to a heat sensitive printing or impression-transfer material
- B41J2/32—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of heat to a heat sensitive printing or impression-transfer material using thermal heads
- B41J2/35—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of heat to a heat sensitive printing or impression-transfer material using thermal heads providing current or voltage to the thermal head
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- Electronic Switches (AREA)
- Fax Reproducing Arrangements (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
仁の発明はファクシ廻りのサーマルヘッドへのデータ分
配方法、特に２つの発熱素子に共通の給電線とデーター
人力線、を有するサーマルヘッドへのデーター分配方法
に関するものである。
配方法、特に２つの発熱素子に共通の給電線とデーター
人力線、を有するサーマルヘッドへのデーター分配方法
に関するものである。
従来のファクシミリは、１列に並べられた発熱素子群の
個々の素子が独自の給電線とデータ入力線を有するサー
マルヘッドを用い、該発熱素子群を一端から例えば８つ
のブロックに分割し、入力−素データーを一端のブロッ
クから順に入力する欅にしていたのであり、上記発熱集
子の１ブロツクの大きさは、サーマルヘッドの電力供給
能力によって決定されていた。
個々の素子が独自の給電線とデータ入力線を有するサー
マルヘッドを用い、該発熱素子群を一端から例えば８つ
のブロックに分割し、入力−素データーを一端のブロッ
クから順に入力する欅にしていたのであり、上記発熱集
子の１ブロツクの大きさは、サーマルヘッドの電力供給
能力によって決定されていた。
しかしながらこの方法は、上記の様に個々の発熱素子が
独自の給電線とデーター人力線を有しているサーマルヘ
ッドを用いた場合について適用され得るものであり、そ
のサーマルヘッドの製造暑こ際しては個々の素子への給
電線、データー人力線のボンデングが非常に手間がかか
り、又、結線数が多くなるため、不良品や故障が多くな
る欠点を有していた。
独自の給電線とデーター人力線を有しているサーマルヘ
ッドを用いた場合について適用され得るものであり、そ
のサーマルヘッドの製造暑こ際しては個々の素子への給
電線、データー人力線のボンデングが非常に手間がかか
り、又、結線数が多くなるため、不良品や故障が多くな
る欠点を有していた。
この発明は上記従来の事情に艦みて提案されたものであ
って、製造の手数や故障回数を少なくするために給電線
やデータ入力線を２素子づつ共通にして全体の配線数を
従来の半分としたサーマルヘッドへのデーターの分配方
法を得ることを目的とするものである。
って、製造の手数や故障回数を少なくするために給電線
やデータ入力線を２素子づつ共通にして全体の配線数を
従来の半分としたサーマルヘッドへのデーターの分配方
法を得ることを目的とするものである。
この発明は、サーマルヘッドの１列の発熱素子群を、２
個間隔２個づつを１組とする２つのプロツクに分割し、
それぞれのブロックを更に４つの小ブロックに分割して
、葭小ブロックの２個づつに順次受信画素データーを入
力する仁とを主たる特徴とするものであって、以下更に
詳しく説明する。
個間隔２個づつを１組とする２つのプロツクに分割し、
それぞれのブロックを更に４つの小ブロックに分割して
、葭小ブロックの２個づつに順次受信画素データーを入
力する仁とを主たる特徴とするものであって、以下更に
詳しく説明する。
まずサーマルヘッドでの１列の発熱素子群を第１図に示
す様に２個間隔８Ｉｌづつを１組とする８つのブロック
Ｂ（０１）・Ｂ（Ｏｎ）に分割する。すなわち第１図斜
線部をブロックＢ（Ｏｓ）とすると白部がブロックＢ（
０りとなり、第２図に示す様に缶ブロックＢ（０１）と
Ｂ（０りは上記８個１組、に共通な給電線ＬＯ１・、Ｌ
Ｏｌ、を介して別個の電源０１−Ｃ！ によって電力を
供給される。
す様に２個間隔８Ｉｌづつを１組とする８つのブロック
Ｂ（０１）・Ｂ（Ｏｎ）に分割する。すなわち第１図斜
線部をブロックＢ（Ｏｓ）とすると白部がブロックＢ（
０りとなり、第２図に示す様に缶ブロックＢ（０１）と
Ｂ（０りは上記８個１組、に共通な給電線ＬＯ１・、Ｌ
Ｏｌ、を介して別個の電源０１−Ｃ！ によって電力を
供給される。
次に、上記２つの大ブロックＢ（Ｏｌ） Ｂ（Ｏｓ）を
更に、それぞれ４つの小ブロックＢ（０１−Ｒａｔ ）
・Ｂ（Ｏｔ−Ｒａｍ） ・Ｂ（Ｏｔ−Ｒｅｓ） ・Ｂ
（０１−Ｒ６１４） ・Ｂ（Ｏｓ−Ｒｅｔ） ・Ｂ（Ｏ
ｇ Ｒａｇ） ・Ｂ（Ｏｘ−Ｒｅｓ） ＠ Ｂ（０２Ｒ
ｅ４）の計８つに分割する。
更に、それぞれ４つの小ブロックＢ（０１−Ｒａｔ ）
・Ｂ（Ｏｔ−Ｒａｍ） ・Ｂ（Ｏｔ−Ｒｅｓ） ・Ｂ
（０１−Ｒ６１４） ・Ｂ（Ｏｓ−Ｒｅｔ） ・Ｂ（Ｏ
ｇ Ｒａｇ） ・Ｂ（Ｏｘ−Ｒｅｓ） ＠ Ｂ（０２Ｒ
ｅ４）の計８つに分割する。
上記サーマルヘッドＴの発熱素子群は第２図に示ｔ１１
に、互に他の大ブロックに属する隣り合う２個の発熱素
子に共通のドライバＤ１〜Ｄｎ’・Ｄｎ’＋ １〜Ｄ旦
によって駆動され、該ドライバＤ１〜Ｄｎ’に対してシ
フトレジスタＲｅ１−Ｒｅ２が又、ドライバＤｎ’＋ｔ
〜Ｄ−に対してシフトレジスタＲａｇ・Ｒｅ４が備えら
れている。
に、互に他の大ブロックに属する隣り合う２個の発熱素
子に共通のドライバＤ１〜Ｄｎ’・Ｄｎ’＋ １〜Ｄ旦
によって駆動され、該ドライバＤ１〜Ｄｎ’に対してシ
フトレジスタＲｅ１−Ｒｅ２が又、ドライバＤｎ’＋ｔ
〜Ｄ−に対してシフトレジスタＲａｇ・Ｒｅ４が備えら
れている。
上記８つの小ブロックの中、符号Ｒｅ１・Ｒｅ２・Ｒｅ
Ｂ−Ｒｅ４はレジスタＲｅ１−Ｂｅ２ ・ＩＬｅＢ ・
Ｒｅ４にそれぞれ対応する。
Ｂ−Ｒｅ４はレジスタＲｅ１−Ｂｅ２ ・ＩＬｅＢ ・
Ｒｅ４にそれぞれ対応する。
動力シリアルに送信されてくる受信画素データをまず、
上記発熱素子ｔの大ブロックＢ（０１）・Ｂ （０２）
に入力されるべきデータに分割し、該分割された情報を
更に８つの小ブロックＢ（０１−Ｒｅｌ）・Ｂ（０１−
Ｒａｇ） ・Ｂ（Ｏｔ−Ｒｅａ） ・Ｂ（０１−Ｒｅａ
） ・Ｂ（Ｏｇ−Ｒｅｌ） ・、Ｂ（０２−Ｒｅｇ）
・Ｂ（０２−Ｂｅｇ） ・ＢＣ（４−Ｒｅ４）に入力さ
れるべきデータ憂ε−分割し、この様ビ細分されたデー
タをサーマルヘッドＴの発熱素子ｔの小ブロックに対し
て■Ｂ（０１−Ｒｅｔ） ・Ｂ（０１−Ｒｅｇ）■Ｂ（
０，−凡ｅａ） ・Ｂ（Ｏｘ−Ｒｅ４）■Ｂ （０２−
Ｒｅｌ） ・Ｂ （０２−Ｒｅｇ）■Ｂ（０２−Ｒｅｓ
） ・Ｂ（０２−Ｒｅ４）の順で入力し記録するのであ
る。 ゛ この記録順序をドライバＤ１〜Ｄｎ’・Ｄｎ−Ｄ−とシ
フトレジスタＲｅ１− Ｒａｇ−Ｒｅｓ−Ｒｅ４ と
の関係を踏まえて更に詳しく記すると、 （１）シフトレジスタＲｅｌ ・ＲｅｇにブロックＢ（
０１−Ｒｅ１） ・Ｂ（０１−Ｒａｇ）に送るべきデー
タを入力 （ｉｆ）シフトレジスタＲｅｌ・ＲＪに対応
するドライバＤ１〜Ｄｎ を駆動しＣ，ブロックＢ（Ｕ
ｌ−Ｒｃｎ）とＢ（Ｏｓ−Ｒｅ２）で記録し、同時にシ
フトレジスターＬ６ｓ−Ｒｅ４にブａ’７りＢ（Ｏｌ−
Ｒａｍ） ・Ｂ（Ｏｓ−Ｒ６４）に送るべ番データを入
力、（転）シフトレジスタＲｅｇ・Ｒ６４に対応するド
ライバＤｎ’＋ＩＮＤ−を駆動してブロックＢ（０１−
Ｒｅｓ）とＢ（０１−Ｒ８４）で記録し、同時ニシフト
レジスタＲ６１・１６ｇにブロックＢ（Ｏｇ−Ｒｅｄ）
−”Ｂ（Ｏｘ−ＩＬｏｇ） に送るべきデータを入力
４Ｖ）ドライバＤ１”Ｄｎ′を駆動してブロックＢ（
０！−Ｒａ１）とＢ（Ｏｉ−Ｒａｇ）で記録し、同時に
シフトしジスタＲｅ＠ ｊ Ｒｅ４にブｏ’７りＢ （
０２−Ｒａｍ ） ・Ｂ （０２−Ｂｅ４）に送るべき
データを入力 （ｖ）ドライバＤｎ’〜Ｄｎを駆動し、
ブａ’）りＢ（Ｏｇ−Ｒｅｓ）とＢ（０３１−Ｒｅａ）
で記録する。以上で１ラインの記録が終了したわけであ
り、以後はこの（１）〜（Ｖ）までの手順の繰り返しで
受信画素データが受信紙に記録される。
上記発熱素子ｔの大ブロックＢ（０１）・Ｂ （０２）
に入力されるべきデータに分割し、該分割された情報を
更に８つの小ブロックＢ（０１−Ｒｅｌ）・Ｂ（０１−
Ｒａｇ） ・Ｂ（Ｏｔ−Ｒｅａ） ・Ｂ（０１−Ｒｅａ
） ・Ｂ（Ｏｇ−Ｒｅｌ） ・、Ｂ（０２−Ｒｅｇ）
・Ｂ（０２−Ｂｅｇ） ・ＢＣ（４−Ｒｅ４）に入力さ
れるべきデータ憂ε−分割し、この様ビ細分されたデー
タをサーマルヘッドＴの発熱素子ｔの小ブロックに対し
て■Ｂ（０１−Ｒｅｔ） ・Ｂ（０１−Ｒｅｇ）■Ｂ（
０，−凡ｅａ） ・Ｂ（Ｏｘ−Ｒｅ４）■Ｂ （０２−
Ｒｅｌ） ・Ｂ （０２−Ｒｅｇ）■Ｂ（０２−Ｒｅｓ
） ・Ｂ（０２−Ｒｅ４）の順で入力し記録するのであ
る。 ゛ この記録順序をドライバＤ１〜Ｄｎ’・Ｄｎ−Ｄ−とシ
フトレジスタＲｅ１− Ｒａｇ−Ｒｅｓ−Ｒｅ４ と
の関係を踏まえて更に詳しく記すると、 （１）シフトレジスタＲｅｌ ・ＲｅｇにブロックＢ（
０１−Ｒｅ１） ・Ｂ（０１−Ｒａｇ）に送るべきデー
タを入力 （ｉｆ）シフトレジスタＲｅｌ・ＲＪに対応
するドライバＤ１〜Ｄｎ を駆動しＣ，ブロックＢ（Ｕ
ｌ−Ｒｃｎ）とＢ（Ｏｓ−Ｒｅ２）で記録し、同時にシ
フトレジスターＬ６ｓ−Ｒｅ４にブａ’７りＢ（Ｏｌ−
Ｒａｍ） ・Ｂ（Ｏｓ−Ｒ６４）に送るべ番データを入
力、（転）シフトレジスタＲｅｇ・Ｒ６４に対応するド
ライバＤｎ’＋ＩＮＤ−を駆動してブロックＢ（０１−
Ｒｅｓ）とＢ（０１−Ｒ８４）で記録し、同時ニシフト
レジスタＲ６１・１６ｇにブロックＢ（Ｏｇ−Ｒｅｄ）
−”Ｂ（Ｏｘ−ＩＬｏｇ） に送るべきデータを入力
４Ｖ）ドライバＤ１”Ｄｎ′を駆動してブロックＢ（
０！−Ｒａ１）とＢ（Ｏｉ−Ｒａｇ）で記録し、同時に
シフトしジスタＲｅ＠ ｊ Ｒｅ４にブｏ’７りＢ （
０２−Ｒａｍ ） ・Ｂ （０２−Ｂｅ４）に送るべき
データを入力 （ｖ）ドライバＤｎ’〜Ｄｎを駆動し、
ブａ’）りＢ（Ｏｇ−Ｒｅｓ）とＢ（０３１−Ｒｅａ）
で記録する。以上で１ラインの記録が終了したわけであ
り、以後はこの（１）〜（Ｖ）までの手順の繰り返しで
受信画素データが受信紙に記録される。
サーマルヘッドＴの発熱素子ｔの総数ｎは１７２８、又
は２０４８であり例えばｎ＝２０４８を例にとると２５
６ビツトのレジスタ８個分のデータを受は入れることが
できるので上記４個のシフトレジスタＲｅｌ ＃ ’Ｂ
ｅ２ ・ＲＪ ・Ｒ６４の２つづつを相互に書き込み読
み出しに分けて２回用いる様にすると合理的である。
は２０４８であり例えばｎ＝２０４８を例にとると２５
６ビツトのレジスタ８個分のデータを受は入れることが
できるので上記４個のシフトレジスタＲｅｌ ＃ ’Ｂ
ｅ２ ・ＲＪ ・Ｒ６４の２つづつを相互に書き込み読
み出しに分けて２回用いる様にすると合理的である。
家た、サーマルヘッドに供給し得る許容電流には限度が
あるので上記の様に、発熱素子総数の１づつ駆動する様
にしている。
あるので上記の様に、発熱素子総数の１づつ駆動する様
にしている。
第４図はサーマルヘッド丁の上記８つのブロックに対応
するデーターとシフトレジスタＢｅｔ・ＴＬｅ２ＲｅＢ
°Ｒｅ４に上記中（ｉｌ）（助４Ｖ）の順序で入力する
ための装置の１例を示すものである。
するデーターとシフトレジスタＢｅｔ・ＴＬｅ２ＲｅＢ
°Ｒｅ４に上記中（ｉｌ）（助４Ｖ）の順序で入力する
ための装置の１例を示すものである。
１は分配回路であって、その入力はシリアルな受信画素
データであり、その出力データａはブロックＢ（０１）
に入力されるべきデータ、同じく出力データｂはブロッ
クＢ（Ｏｇ）に入力されるべきデータ。２はカウンタで
あって分配されるデータ数を整えるものである。
データであり、その出力データａはブロックＢ（０１）
に入力されるべきデータ、同じく出力データｂはブロッ
クＢ（Ｏｇ）に入力されるべきデータ。２はカウンタで
あって分配されるデータ数を整えるものである。
８．４は第２分配回路であって、上記データａを入力と
する分配回路８の出力データ０はブロワ’ｒ Ｂ（Ｏｆ
−ＲｓＢ）とＢ（Ｏｔ−Ｒａｍ）に、又、出力データｄ
はブロックＢ（Ｏｌ−Ｒｅｇ）とＢ（Ｏｌ−Ｒｅｎ）に
入力するデータであり、データｂを入力とする分配回路
４の出力データｅはブロックＢ（Ｏｇ−Ｒｅｌ）とＢ（
Ｏｇ−１ｔｅａ）に、又出力データｆはブロックＢ（Ｏ
ｓ−Ｒｅｇ）とＢ（Ｏｇ−Ｒ６４）に入力されるべきデ
ータである。
する分配回路８の出力データ０はブロワ’ｒ Ｂ（Ｏｆ
−ＲｓＢ）とＢ（Ｏｔ−Ｒａｍ）に、又、出力データｄ
はブロックＢ（Ｏｌ−Ｒｅｇ）とＢ（Ｏｌ−Ｒｅｎ）に
入力するデータであり、データｂを入力とする分配回路
４の出力データｅはブロックＢ（Ｏｇ−Ｒｅｌ）とＢ（
Ｏｇ−１ｔｅａ）に、又出力データｆはブロックＢ（Ｏ
ｓ−Ｒｅｇ）とＢ（Ｏｇ−Ｒ６４）に入力されるべきデ
ータである。
６．７はメモリであって、上記８つに分割された４組の
データ０・ｄ−ｅ−ｆを記憶する部分６１．６２，６Ｌ
６４と７１．７２．７８．７４に分けることができる
。この結果、単位のメモリ６１〜６４、と７１〜７４に
は以後の説明からも明らかな様に、同時にいずれかのシ
フトレジスタに転送されるこｔのないデータが記憶され
ていることになる。例えば、メモリ６１にはデータ０す
なわちシフトレジスタＲＪとＲｅ１ζ転送されるべきデ
ータが記憶されているが、この２つのデータは同時にシ
フトレジスタＲｅｌとＲｅｇに転送されることはない。
データ０・ｄ−ｅ−ｆを記憶する部分６１．６２，６Ｌ
６４と７１．７２．７８．７４に分けることができる
。この結果、単位のメモリ６１〜６４、と７１〜７４に
は以後の説明からも明らかな様に、同時にいずれかのシ
フトレジスタに転送されるこｔのないデータが記憶され
ていることになる。例えば、メモリ６１にはデータ０す
なわちシフトレジスタＲＪとＲｅ１ζ転送されるべきデ
ータが記憶されているが、この２つのデータは同時にシ
フトレジスタＲｅｌとＲｅｇに転送されることはない。
またメモリ６は同７に対して、メモリ７は同６に対して
予備的な役割を有しており、メモリ６のデータが続み出
されているときにはメモリ７には書き込みがなされ、ま
た逆にメモリ７が読み出されているときは、メモリ６に
書き込みがなされる。上述した様に分配器１．８．４と
メモリ６、又は７に受信データが分配される様子を第５
図に示した。
予備的な役割を有しており、メモリ６のデータが続み出
されているときにはメモリ７には書き込みがなされ、ま
た逆にメモリ７が読み出されているときは、メモリ６に
書き込みがなされる。上述した様に分配器１．８．４と
メモリ６、又は７に受信データが分配される様子を第５
図に示した。
５．８はデータセレクタであって、上記メモリの前後に
設けられ相互に逆のスイッチング動作曾して、上記メモ
リ６．７の書き込み、続み出し、相互の切換ができる様
になっている。すなわちメモリ６から発熱素子ｔにデー
タが出力されているときはデータセレクタ８がメモリ６
側であり、データセレクタ５はメモリ７側を選択して受
信データはメモリγ側に入力され、１ラインの記録が終
了すると、データセレクタ５．８はそれぞれ反転してメ
モリ６側に書き込み、メモリ７側から読み出しが出来る
状態となる。
設けられ相互に逆のスイッチング動作曾して、上記メモ
リ６．７の書き込み、続み出し、相互の切換ができる様
になっている。すなわちメモリ６から発熱素子ｔにデー
タが出力されているときはデータセレクタ８がメモリ６
側であり、データセレクタ５はメモリ７側を選択して受
信データはメモリγ側に入力され、１ラインの記録が終
了すると、データセレクタ５．８はそれぞれ反転してメ
モリ６側に書き込み、メモリ７側から読み出しが出来る
状態となる。
９．１０もデータセレクタであ２て、セレクタ９は信号
ムによって電源０１伺の発熱素子ｔへのデータ転送と電
源ｏｇ側の発熱素子ｔへのデータ転送の切換えをする。
ムによって電源０１伺の発熱素子ｔへのデータ転送と電
源ｏｇ側の発熱素子ｔへのデータ転送の切換えをする。
またセレクタ１０は信号ＢによってシフトレジスタＲｅ
１ｌ・Ｒｅ２の側と、 Ｒｅｇ・Ｒｅａ Ｈの切換えを
する。
１ｌ・Ｒｅ２の側と、 Ｒｅｇ・Ｒｅａ Ｈの切換えを
する。
今、サーマルヘッドでの駆動順序に従ってデータセレク
タ９．１０の作動を説明すると、（１）データセレクタ
９は、メモリ６１．６１ブロツクＢ（Ｏｌ） ）側、デ
ータセレクタ１０は、シフトレジスタＲ４１・Ｒｅ２を
辿択。このときメモリ６１には、ｗ４６図に示す様にＢ
（０１−Ｒｅｔ）とＢ（Ｏｓ −ＩＬｅｓ）に対するデ
ータが、またメモリ６２にはブロックＢ（０１−Ｒａｍ
）とＢ（Ｏｌ−Ｒｅ４）に対するデータが記憶されてい
るが、ブロックＢ（ＯＨ−ＩＬｅｌ）とＢ（０１−Ｒａ
ｍ）に対するデータのみがシフトレジスタＲｅｌ−Ｒ６
ｍに転送される。
タ９．１０の作動を説明すると、（１）データセレクタ
９は、メモリ６１．６１ブロツクＢ（Ｏｌ） ）側、デ
ータセレクタ１０は、シフトレジスタＲ４１・Ｒｅ２を
辿択。このときメモリ６１には、ｗ４６図に示す様にＢ
（０１−Ｒｅｔ）とＢ（Ｏｓ −ＩＬｅｓ）に対するデ
ータが、またメモリ６２にはブロックＢ（０１−Ｒａｍ
）とＢ（Ｏｌ−Ｒｅ４）に対するデータが記憶されてい
るが、ブロックＢ（ＯＨ−ＩＬｅｌ）とＢ（０１−Ｒａ
ｍ）に対するデータのみがシフトレジスタＲｅｌ−Ｒ６
ｍに転送される。
（ｉｆ） データセレクタ９は、メモリ６１．６２（
ブロックＢ（Ｏｒ） ）側、データセレクタ１０はシフ
トレジスタＲｅ＠ ＠ Ｒｅ４を選択し、ブロックＢ（
ＯＢ−Ｒ６１１１）とＢ（０１−Ｒｅ４）に対するデー
タ、すなわち（１）ノ残りのデータがシフトレジスタＲ
ｅｇ・Ｒ６４に転送される。
ブロックＢ（Ｏｒ） ）側、データセレクタ１０はシフ
トレジスタＲｅ＠ ＠ Ｒｅ４を選択し、ブロックＢ（
ＯＢ−Ｒ６１１１）とＢ（０１−Ｒｅ４）に対するデー
タ、すなわち（１）ノ残りのデータがシフトレジスタＲ
ｅｇ・Ｒ６４に転送される。
（１１０データセレクタ９はメモ！）６Ｂ、６４（ブロ
ックＢ（０２） ）［、データセレクタ１０はシフトレ
ジスタＲ８１・Ｒａｇを選択、このときメモリ６８には
第６図に示す様にブロックＢ（Ｏｇ−Ｒａｔ）とＢ（０
２−Ｒｅｓ）に対するデータが、またメモリ６４にはブ
ａ”）りＢ（Ｏｇ−Ｒａｇ）とＢ（０２−Ｒｅ４）に対
するデータが記憶されているが、ブロックＢＣＯ２−Ｒ
ｅｔ）とＢ（Ｏｇ−Ｒｅｇ） に対するデータのみがシ
フトレジスタＲＪ・Ｒａｇに転送される。
ックＢ（０２） ）［、データセレクタ１０はシフトレ
ジスタＲ８１・Ｒａｇを選択、このときメモリ６８には
第６図に示す様にブロックＢ（Ｏｇ−Ｒａｔ）とＢ（０
２−Ｒｅｓ）に対するデータが、またメモリ６４にはブ
ａ”）りＢ（Ｏｇ−Ｒａｇ）とＢ（０２−Ｒｅ４）に対
するデータが記憶されているが、ブロックＢＣＯ２−Ｒ
ｅｔ）とＢ（Ｏｇ−Ｒｅｇ） に対するデータのみがシ
フトレジスタＲＪ・Ｒａｇに転送される。
４ｖｌ データセレクタ９はメモリ６８．６４（ブロ
ックＢ（０２） ）側、データセレクタ１０はシフトレ
ジスタＲｏ８・Ｒｅ４を選択し、ブロックＢ（０１−Ｒ
ｅｓ）とＢ（Ｏｌ−Ｒｅ４）に対するデータ、すなわち
（２）の残りのデータがシフトレジスタＲｅ８・Ｒｅ４
＝ＩＣ転送すれる。
ックＢ（０２） ）側、データセレクタ１０はシフトレ
ジスタＲｏ８・Ｒｅ４を選択し、ブロックＢ（０１−Ｒ
ｅｓ）とＢ（Ｏｌ−Ｒｅ４）に対するデータ、すなわち
（２）の残りのデータがシフトレジスタＲｅ８・Ｒｅ４
＝ＩＣ転送すれる。
以上に記、述したメモリ６、又は７からサーマルヘッド
Ｔの４つのシフトレジスタＲＪ・Ｒａｇ−Ｒｅ畠Ｒ４４
に転送される様子を示したのが第６−であって、図中破
線で示したデータがシフトレジスタに転送されるデータ
である。
Ｔの４つのシフトレジスタＲＪ・Ｒａｇ−Ｒｅ畠Ｒ４４
に転送される様子を示したのが第６−であって、図中破
線で示したデータがシフトレジスタに転送されるデータ
である。
以上説明した様に乙の発明は、２個間隔２つづつの発熱
素子を交互に駆動する様にしているので給電線及びドラ
イバの数を従来の半分とすることができ、従ってボンデ
ングの手数が略け、故障の発生率も少ないサーマルヘッ
ドを用いることができる効果を有するものであり、史書
ζ１回の駆動でサーマルヘッドの発熱素子がｉづつ作動
する様になっているので、サーマルヘッドの許容電流内
での駆動が可能となる効果を有する。
素子を交互に駆動する様にしているので給電線及びドラ
イバの数を従来の半分とすることができ、従ってボンデ
ングの手数が略け、故障の発生率も少ないサーマルヘッ
ドを用いることができる効果を有するものであり、史書
ζ１回の駆動でサーマルヘッドの発熱素子がｉづつ作動
する様になっているので、サーマルヘッドの許容電流内
での駆動が可能となる効果を有する。
第１図はこの発明に用いるサーマルヘッドの発熱素子の
ブロックの構成を示す。第２図はサーマルヘッドへの給
電及びドライバからの結線を示す。 １１８図はドライバ及びシフトレジスタを示す。第４図
はこの発明を実施するための装置。第６図は受信データ
ーの分配方法。Ｒｅ６図は分配されたデータの入力方法
を示す。 図中、 Ｂ（Ｏｓ）・Ｂ（Ｏｇ）・・・大ブロック、Ｂ（０１−
Ｒｅｌ） ・Ｂ（Ｏｌ−Ｒａｇ）、・ Ｂ（０１−Ｒｅ
ａ） ・Ｂ（ＯＨ−Ｒｅ４）Ｂ（Ｏｓ−Ｒｅｓ） ・Ｂ
（０１−Ｂｅｓ’） ・Ｂ（Ｏｓ−Ｒｅｓ） ・ＢＣＯ
ｓ−Ｒｅａ）・・・小ブロック、 Ｄ１〜ｎｎ ６ Ｄｎ’＋ｔ 〜Ｄ−・・・ドライバ、
ＲＪ −Ｒａｇ ’ Ｒｅｓ ” Ｒｅ４ ”’シフト
レジスタ、！・・・サーマルヘッド、 ｔ・・・発熱素子 手続補正書 ｌ ・バ件の表示 昭和５６年 ４１ＩＩＮ １第１１１７８７９号２
発明の名称 サーーーツドνｉのためのデータの雰１房
χ３ 補正をする者 事件との関係 出願人 ４、代理人〒６４０ 別紙の過秒 補正の内容 明細書１８ペ一ジ１６行〜１６行目に、［プｏツクＢ
（Ｃ１−ＩＬｅ、 ） ト８ （（３１−ＩＬｅ、）に
対する」とあるのを ［りａッ９Ｂ （０１−Ｒｅａ） トＢ （Ｃ，−ＩＬ
ｅ４）に対する」とする。
ブロックの構成を示す。第２図はサーマルヘッドへの給
電及びドライバからの結線を示す。 １１８図はドライバ及びシフトレジスタを示す。第４図
はこの発明を実施するための装置。第６図は受信データ
ーの分配方法。Ｒｅ６図は分配されたデータの入力方法
を示す。 図中、 Ｂ（Ｏｓ）・Ｂ（Ｏｇ）・・・大ブロック、Ｂ（０１−
Ｒｅｌ） ・Ｂ（Ｏｌ−Ｒａｇ）、・ Ｂ（０１−Ｒｅ
ａ） ・Ｂ（ＯＨ−Ｒｅ４）Ｂ（Ｏｓ−Ｒｅｓ） ・Ｂ
（０１−Ｂｅｓ’） ・Ｂ（Ｏｓ−Ｒｅｓ） ・ＢＣＯ
ｓ−Ｒｅａ）・・・小ブロック、 Ｄ１〜ｎｎ ６ Ｄｎ’＋ｔ 〜Ｄ−・・・ドライバ、
ＲＪ −Ｒａｇ ’ Ｒｅｓ ” Ｒｅ４ ”’シフト
レジスタ、！・・・サーマルヘッド、 ｔ・・・発熱素子 手続補正書 ｌ ・バ件の表示 昭和５６年 ４１ＩＩＮ １第１１１７８７９号２
発明の名称 サーーーツドνｉのためのデータの雰１房
χ３ 補正をする者 事件との関係 出願人 ４、代理人〒６４０ 別紙の過秒 補正の内容 明細書１８ペ一ジ１６行〜１６行目に、［プｏツクＢ
（Ｃ１−ＩＬｅ、 ） ト８ （（３１−ＩＬｅ、）に
対する」とあるのを ［りａッ９Ｂ （０１−Ｒｅａ） トＢ （Ｃ，−ＩＬ
ｅ４）に対する」とする。
Claims (1)
- 【特許請求の範囲】 （１）サーマルヘッドの１列の発熱素子群を、２個間＠
２個づつを１組とする２つの大ブロックＢ（Ｏｓ）Ｂ（
Ｏｇ）に分割し、更に該ブロックＢ（０１） Ｂ（Ｏｘ
）をそれぞれ４つのブロックＢ（０１−Ｒｅｘ） ・Ｂ
（Ｏｔ−Ｒａｇ）Ｂ（（ｈ−Ｒｅｓ） ・Ｂ（Ｏｔ−Ｒ
６４）とＢ（Ｏｓ−Ｒａｔ） Ｉ Ｂ（Ｏｒ−Ｒｅ２）
・Ｒｅ０２−Ｒａｇ） ・Ｂ（０２−Ｒｅ４）の８ブ
ロツクに分割し、上記発熱集子群に対して互に他の大ブ
ロックに属する隣り合う２４ｉＩの発熱素子に共通のド
ライバＤＩ ” Ｄｎ’ ＠ Ｄｎ ＋ １〜Ｄ ２と
、更に上記ドライ′バ群に対して４個のシフトレジスタ
Ｒｅｌ・Ｒｅ２・Ｒｅ８・Ｒｅ４を備えておき、 受信画素データを上記８つのブロックに入力されるべき
グループに分割して、 （１）シフトレジスタＲ８１＋ Ｒｅ２にブロックＢ（
Ｏｔ−ＩＬｅｌ）・Ｂ（０１−１６ｇ）に転送すべきデ
ータを入力（１１）シフトレジスタＲｅ１・Ｒｅ２に対
応するドライバ（ＤＢ 〜Ｄｎ’） を駆動してブロ
ックＢ（Ｏｓ−Ｒａｔ）とＢ（０１−Ｒｅ２）で記録し
、同時にシフトレジスタＲｅｇ ・Ｒｅ４にブロックＢ
（０１−Ｒｅｓ） ・Ｂ（Ｏｔ−Ｒｅ４）に転送すべき
データを入力 （ト）シフトレジスタＲｅ５−Ｒｅ４に
対応するドライバＤｎ′＋１〜ＤＴを駆動しブａ ’７
りＢ（Ｕｌ−Ｒｅａ）とＢ（Ｏｔ−Ｒｅａ）で記録し、
同時にシフトレジスタＲｅｌ−ＲｅｇＪこブロックＢ（
０！−Ｒｅｌ） −Ｂ＜０１−Ｒａｇ）に転送すべきデ
ータを入力、４Ｖ）ドライバＤ １〜Ｄｎ’を駆動しブ
ロックＢ（Ｏ３ｌ−Ｒｅ１）とＢ（０１−Ｒｅｇ）で記
録し、同時にシフトレジスタＲｅ６ ” Ｒｅ４にブｏ
’７りＢＣＯｓ−Ｒａｇ） ・Ｂ（Ｏｇ−Ｒｅ４）に転
送すべきデータを入力、Ｍドライバ（Ｄｎ＋ｓ〜Ｄ１ｎ
）を駆動し、ブａ’７りＢ（Ｏｇ−Ｒｅｓ）とＢ （Ｏ
ｘ＝Ｒｅ４）で記録、 の（１）（ＩＩ）（１１０４Ｖ）（Ｖ）の順序に従って
データを分配駆動記録するサーマルヘッドへのデーター
分配方法。 （２） サーマルヘッドの１列の発熱素子群を、２個
間隔２個づつをＬ組とする２つの大ブロック１１（Ｏｔ
）Ｂ （０２）に分割し、更に該ブロックＢ（０１）Ｂ
（０りをそれくれ４つのブロックＥ（０１−Ｒｅ１）
・Ｂ（０１−Ｂｅｓ）Ｂ（０１−Ｒｅａ） ・Ｂ（Ｏｔ
−Ｒｅ４）とＢ（０２−Ｒｅｔ） ・Ｂ（Ｏｇ−Ｒａｇ
） ・Ｂ（０２−Ｒｅａ） ６ Ｂ（Ｏｇ−Ｒａ４）の
８ブａツクに分割し、上記発熱素子群に対して互に他の
大ブロックに属する隣り合う２個の発熱素子に共通のド
ライバＤ１〜Ｄｎ’・Ｄｎ’ ＋ １〜Ｄｉと、更に上
記ドライバ群に対して４個のシフトレジスタＲＪ・Ｒｅ
２・’ＨＡｇ−Ｒｅ４を備、ｔておｉ、 受信画素データを上記８つのブロックに入力されるべき
グループに分割して、同時に駆動されることのない２つ
のブロックに転送されるデータを１組として４つのメモ
リに記憶させ、 （１）シフトレジスタＲｅｌ＠ Ｒｅ２にブロックＢ（
０１−Ｒｅｘ） ・Ｂ（Ｏｌ−Ｒａｇ）に送るべきデー
タを上記メモリから入力 （１１）シフトレジスタＲｅ
１−Ｒｅ２に対応するドライバ（Ｄｒ〜Ｄｎｊ）を駆動
してブロックＢ（０１−Ｒｅｔ）とＢ（０１−Ｒｅ２）
で記録し、同時にシフトレジスタＲｅｇ ・Ｒｅ４にブ
ロックＢ（Ｏｌ−Ｒａｇ） ・Ｂ（０１Ｒｅ４） に送
るべきデータを上記メモリから人力 ＯＩＤシフトレジ
スタＲｅＲｅａｅ４に対応するドライバＤｒ／＋１〜Ｄ
賛を駆動しブロックＢ （０１−Ｒｅａ）とＢ（０１−
Ｒ６４）で記録し、同時にシフトレジスタＲｅｌ−Ｒａ
ｇにブロックＢ（０２−Ｒｅｔ） ・Ｂ（０１−Ｒａｇ
）に送るべ番データを上記メモリから入力、鴫埴ドラ４
／＜ ＤＩ 〜Ｄｒ／ ヲＨｊＡｍ Ｌ／ブ０’／り
Ｂ（Ｏｇ Ｒｅｔ） とＢ（０１−Ｒｅｄ）で記録し
、同時にシフトレジスタＲｅ魯” Ｒｅ４にブロックＢ
（０１−Ｒｅｓ） ・Ｂ（Ｏｓ−ＩＬ８４）に送るべき
データを上記メモリから入力、Ｍドライバ（Ｄｔ／＋ｔ
〜：ｏ−ｎ）を駆動し、プロ′ツクＢ（Ｏｉ−意 Ｒｅ５）とＢ（０！−Ｒ１５１４）で記録、の（１）（
ｉｌ）ＱＩＤ４Ｖ（Ｖｌの順序に従ってデータを分配駆
動記ａするサーマルヘッドへのデーター分配方法。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56167379A JPS58101081A (ja) | 1981-10-20 | 1981-10-20 | サ−マルヘツド駆動のためのデ−タの分配方式 |
| US06/435,034 US4475112A (en) | 1981-10-20 | 1982-10-18 | Method of distributing data for driving a thermal printing head |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56167379A JPS58101081A (ja) | 1981-10-20 | 1981-10-20 | サ−マルヘツド駆動のためのデ−タの分配方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58101081A true JPS58101081A (ja) | 1983-06-16 |
Family
ID=15848619
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56167379A Pending JPS58101081A (ja) | 1981-10-20 | 1981-10-20 | サ−マルヘツド駆動のためのデ−タの分配方式 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US4475112A (ja) |
| JP (1) | JPS58101081A (ja) |
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1982
- 1982-10-18 US US06/435,034 patent/US4475112A/en not_active Expired - Lifetime
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| US11285717B2 (en) | 2016-10-06 | 2022-03-29 | Hewlett-Packard Development Company, L.P. | Input control signals propagated over signal paths |
Also Published As
| Publication number | Publication date |
|---|---|
| US4475112A (en) | 1984-10-02 |
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