JPH11312776A - 集積回路パッケージ - Google Patents
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- JPH11312776A JPH11312776A JP10310928A JP31092898A JPH11312776A JP H11312776 A JPH11312776 A JP H11312776A JP 10310928 A JP10310928 A JP 10310928A JP 31092898 A JP31092898 A JP 31092898A JP H11312776 A JPH11312776 A JP H11312776A
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Abstract
(57)【要約】
【課題】EMIとその関連する雑音を、その雑音の発生
源近くで低減することのできる集積回路パッケージを提
供する。 【解決手段】本発明の一実施例によれば、ボール・グリ
ッド・アレイのような低インダクタンス集積回路パッケ
ージが提供される。パッケージに実装された集積回路に
よって引き起こされる電磁妨害(EMI)を低減するた
め、集積回路に供給される電源線とアース線との少なく
とも一方にフィルタ装置が結合される。一実施例におい
ては、複数のフィルタ・キャパシタがパッケージのキャ
ビティの中または近くで電源線とアース線との間に結合
される。
源近くで低減することのできる集積回路パッケージを提
供する。 【解決手段】本発明の一実施例によれば、ボール・グリ
ッド・アレイのような低インダクタンス集積回路パッケ
ージが提供される。パッケージに実装された集積回路に
よって引き起こされる電磁妨害(EMI)を低減するた
め、集積回路に供給される電源線とアース線との少なく
とも一方にフィルタ装置が結合される。一実施例におい
ては、複数のフィルタ・キャパシタがパッケージのキャ
ビティの中または近くで電源線とアース線との間に結合
される。
Description
【0001】
【産業上の利用分野】本発明は、ボール・グリッド・ア
レイに関し、より具体的には、内部の望ましくない雑音
の低減に関する。
レイに関し、より具体的には、内部の望ましくない雑音
の低減に関する。
【0002】
【従来の技術】ボール・グリッド・アレイ(BGA)な
どは、既知のタイプの集積回路パッケージである。通常
のボール・グリッド・アレイは、ダイ取付領域が上に設
けられたプラットフォームを含む。ダイ取付領域のある
部分は、一般にキャビティと呼ばれ、キャビティの周辺
部分は、ボーダーと呼ばれることがある。通常、ダイ取
付領域の縁に沿って複数の接触パッドが配置され、この
接触パッドは、プラットフォームの内部導体によって、
プラットフォームの後側(実装したときに下側)の導電
性のボールに接続される。このような導電性ボールは、
通常、グリッド・パターンに配列され、そのためボール
・グリッド・アレイと呼ばれる。これらの導電性ボール
は、ボール・グリッド・アレイ・パッケージとプリント
回路基板の間に低インダクタンスの電気接続を形成す
る。
どは、既知のタイプの集積回路パッケージである。通常
のボール・グリッド・アレイは、ダイ取付領域が上に設
けられたプラットフォームを含む。ダイ取付領域のある
部分は、一般にキャビティと呼ばれ、キャビティの周辺
部分は、ボーダーと呼ばれることがある。通常、ダイ取
付領域の縁に沿って複数の接触パッドが配置され、この
接触パッドは、プラットフォームの内部導体によって、
プラットフォームの後側(実装したときに下側)の導電
性のボールに接続される。このような導電性ボールは、
通常、グリッド・パターンに配列され、そのためボール
・グリッド・アレイと呼ばれる。これらの導電性ボール
は、ボール・グリッド・アレイ・パッケージとプリント
回路基板の間に低インダクタンスの電気接続を形成す
る。
【0003】電磁妨害(EMI)は、一般に雑音と呼ば
れ、ボール・グリッド・アレイでパッケージングされた
回路など、小型の高速回路に関連する問題である。ボー
ル・グリッド・アレイ環境においてEMIを低減させる
ための従来技術の試みでは、ボール・グリッド・アレイ
を取り付けるプリント回路基板上にキャパシタが配置さ
れるか、または、プラットフォームの背面にキャパシタ
が形成されていた。キャパシタをプリント回路基板に実
装する構成の場合、この構成の欠点は、キャパシタがE
MI発生源(パッケージングした集積回路)から遠くに
あり、そのため、キャパシタが雑音を抑制するよりも前
に「望ましくない雑音」がかなり広く分散されることで
ある。キャパシタを背面に配置する構成の場合、このよ
うな構成の欠点は、製造が複雑でかつ高価になりやす
く、またその寸法に適応するようにボール・グリッド・
アレイの高さを高くしなければならない点である。
れ、ボール・グリッド・アレイでパッケージングされた
回路など、小型の高速回路に関連する問題である。ボー
ル・グリッド・アレイ環境においてEMIを低減させる
ための従来技術の試みでは、ボール・グリッド・アレイ
を取り付けるプリント回路基板上にキャパシタが配置さ
れるか、または、プラットフォームの背面にキャパシタ
が形成されていた。キャパシタをプリント回路基板に実
装する構成の場合、この構成の欠点は、キャパシタがE
MI発生源(パッケージングした集積回路)から遠くに
あり、そのため、キャパシタが雑音を抑制するよりも前
に「望ましくない雑音」がかなり広く分散されることで
ある。キャパシタを背面に配置する構成の場合、このよ
うな構成の欠点は、製造が複雑でかつ高価になりやす
く、またその寸法に適応するようにボール・グリッド・
アレイの高さを高くしなければならない点である。
【0004】
【発明が解決しようとする課題】したがって、本発明の
目的は、EMIとその関連する雑音を、その雑音の発生
源近くの基板上で低減することができるボール・グリッ
ド・アレイを提供することである。
目的は、EMIとその関連する雑音を、その雑音の発生
源近くの基板上で低減することができるボール・グリッ
ド・アレイを提供することである。
【0005】本発明のもう1つの目的は、キャビティ内
に雑音低減手段を有するボール・グリッド・アレイを提
供することである。
に雑音低減手段を有するボール・グリッド・アレイを提
供することである。
【0006】また、本発明の目的は、EMIを抑制しか
つ安価に作成することができるボール・グリッド・アレ
イを提供することである。
つ安価に作成することができるボール・グリッド・アレ
イを提供することである。
【0007】本発明の以上およびその関連する目的は、
本明細書に記載したようなボール・グリッド・アレイを
使用することにより達成される。
本明細書に記載したようなボール・グリッド・アレイを
使用することにより達成される。
【0008】
【課題を解決するための手段】1つの実施形態におい
て、本発明は、第1の側に複数の低インダクタンス実装
導体が形成されたプラットフォームと、前記プラットフ
ォームの第2の側に形成され、ダイ取付領域を含むキャ
ビティと、前記キャビティ内の前記ダイ取付領域の近く
に形成され、少なくとも一部が前記プラットフォームの
導体によって前記実装導体の一部に結合され、前記ダイ
取付領域に実装される集積回路のパッドを受ける複数の
電気接点と、前記電気接点の少なくとも1つに結合され
た電源線と、前記電気接点の少なくとも別のものに結合
されたアース線と、前記プラットフォームの前記第2の
側に設けられ、前記電源線とアース線の少なくとも1つ
に結合され、前記ダイ取付領域に実装された集積回路に
よって生成されるEMIを低減する手段とを含む。好ま
しい実施形態において、EMI低減手段は、電源線とア
ース線の間に結合され、フィルタリング・キャパシタを
含む。また、EMI低減手段は、ダイ取付領域近くに表
面実装されることが好ましい。
て、本発明は、第1の側に複数の低インダクタンス実装
導体が形成されたプラットフォームと、前記プラットフ
ォームの第2の側に形成され、ダイ取付領域を含むキャ
ビティと、前記キャビティ内の前記ダイ取付領域の近く
に形成され、少なくとも一部が前記プラットフォームの
導体によって前記実装導体の一部に結合され、前記ダイ
取付領域に実装される集積回路のパッドを受ける複数の
電気接点と、前記電気接点の少なくとも1つに結合され
た電源線と、前記電気接点の少なくとも別のものに結合
されたアース線と、前記プラットフォームの前記第2の
側に設けられ、前記電源線とアース線の少なくとも1つ
に結合され、前記ダイ取付領域に実装された集積回路に
よって生成されるEMIを低減する手段とを含む。好ま
しい実施形態において、EMI低減手段は、電源線とア
ース線の間に結合され、フィルタリング・キャパシタを
含む。また、EMI低減手段は、ダイ取付領域近くに表
面実装されることが好ましい。
【0009】もう1つの実施形態において、本発明は、
複数の低インダクタンス実装導体が下側に形成されたプ
ラットフォームと、前記プラットフォームの上側に形成
され、ダイ取付領域を含むキャビティと、前記キャビテ
ィ内に実装された集積回路に電力を提供するために前記
キャビティ内に形成された電源線と、前記キャビティ内
に形成され、前記キャビティ内に実装された集積回路に
アースを提供するアース線と、前記電源線とアース線の
少なくとも1つに結合され、前記ダイ取付領域に実装さ
れた集積回路によって生成される雑音をフィルタリング
するフィルタリング装置とを含む。
複数の低インダクタンス実装導体が下側に形成されたプ
ラットフォームと、前記プラットフォームの上側に形成
され、ダイ取付領域を含むキャビティと、前記キャビテ
ィ内に実装された集積回路に電力を提供するために前記
キャビティ内に形成された電源線と、前記キャビティ内
に形成され、前記キャビティ内に実装された集積回路に
アースを提供するアース線と、前記電源線とアース線の
少なくとも1つに結合され、前記ダイ取付領域に実装さ
れた集積回路によって生成される雑音をフィルタリング
するフィルタリング装置とを含む。
【0010】本発明の以上およびその関連する利点およ
び特徴の達成は、図面と共に本発明の以下のさらに詳細
な説明を検討することにより、当業者には容易に明らか
になるはずである。
び特徴の達成は、図面と共に本発明の以下のさらに詳細
な説明を検討することにより、当業者には容易に明らか
になるはずである。
【0011】
【実施例】図1を参照すると、本発明によるボール・グ
リッド・アレイ10の斜視図が示される。ボール・グリ
ッド・アレイ10は、プラットフォーム12、ボーダー
14およびキャビティ20を備える。キャビティ20
は、1つまたは複数の集積回路(図示せず)またはその
関連デバイスを配置するダイ取付領域22を含む。
リッド・アレイ10の斜視図が示される。ボール・グリ
ッド・アレイ10は、プラットフォーム12、ボーダー
14およびキャビティ20を備える。キャビティ20
は、1つまたは複数の集積回路(図示せず)またはその
関連デバイスを配置するダイ取付領域22を含む。
【0012】キャビティ20は、また、集積回路のパッ
ドを取り付ける複数の導電性トレース24(図2に詳細
に示す)を含む。キャビティ内の集積回路の導電性トレ
ースへの取り付けは、当技術分野では周知である。導電
性トレース24は、ボール・グリッド・アレイ10内部
の導体によって、表面実装の低インダクタンス導電性バ
ンプまたはボール18に接続される。導電性ボールは、
プラットフォーム12の下側にグリッド・パターンで配
置されることが好ましく、はんだや導電性エポキシ樹脂
またはそれと同様の導電性材料からなることが好まし
い。信号トレース24と導電性ボール17〜19の間の
導体の配置と構成は、当技術分野では周知である。
ドを取り付ける複数の導電性トレース24(図2に詳細
に示す)を含む。キャビティ内の集積回路の導電性トレ
ースへの取り付けは、当技術分野では周知である。導電
性トレース24は、ボール・グリッド・アレイ10内部
の導体によって、表面実装の低インダクタンス導電性バ
ンプまたはボール18に接続される。導電性ボールは、
プラットフォーム12の下側にグリッド・パターンで配
置されることが好ましく、はんだや導電性エポキシ樹脂
またはそれと同様の導電性材料からなることが好まし
い。信号トレース24と導電性ボール17〜19の間の
導体の配置と構成は、当技術分野では周知である。
【0013】図1は、さらに、ボール17を介して供給
される電源線26と、ボール19を介して供給されるア
ース線28を示す。電源線26およびアース線28は、
キャビティ内の電源ループ40とアース・ループ42と
にそれぞれ接続される。後で詳細に説明するように、キ
ャビティ内の集積回路によって生成されるEMIを低減
するために、電源ループとアース・ループの間に複数の
フィルタ・キャパシタ30を結合することが好ましい。
好ましい実施形態では、電源線とアース線の間にフィル
タ・キャパシタを結合するが、他の実施態様では、異な
る電源線間または電源線と電気的共通線の間にフィルタ
・キャパシタを結合しても有利である。さらに、代替実
施形態において、フィルタ・キャパシタを、フィルタ・
キャパシタ31で表わしたようにボーダー領域内に設け
ることもできる。このような構成は、雑音を低減できる
が、表面実装したキャパシタと埋め込まれた電源導体と
アース導体との接続のためのバイア(via)を形成する
必要がある。
される電源線26と、ボール19を介して供給されるア
ース線28を示す。電源線26およびアース線28は、
キャビティ内の電源ループ40とアース・ループ42と
にそれぞれ接続される。後で詳細に説明するように、キ
ャビティ内の集積回路によって生成されるEMIを低減
するために、電源ループとアース・ループの間に複数の
フィルタ・キャパシタ30を結合することが好ましい。
好ましい実施形態では、電源線とアース線の間にフィル
タ・キャパシタを結合するが、他の実施態様では、異な
る電源線間または電源線と電気的共通線の間にフィルタ
・キャパシタを結合しても有利である。さらに、代替実
施形態において、フィルタ・キャパシタを、フィルタ・
キャパシタ31で表わしたようにボーダー領域内に設け
ることもできる。このような構成は、雑音を低減できる
が、表面実装したキャパシタと埋め込まれた電源導体と
アース導体との接続のためのバイア(via)を形成する
必要がある。
【0014】図2を参照し、本発明による図1のボール
・グリッド・アレイ10のキャビティ20内の導体の平
面図を示す。ダイ取付領域22の近くに複数の接触パッ
ド32が設けられる。領域22に実装される集積回路の
パッドは、低インダクタンスのフリップ実装やその他の
周知の技術によって接触パッドに接続することができ
る。導電性トレース24の一部は、接触パッド32と、
ボール・グリッド・アレイ10の内部導体に接続された
接触パッド36(前述)との間に接続される。他の導電
性トレース24は、電源ループとアース・ループと接触
パッド32の間に接続される。接触パッド32、導電性
トレース24および接触パッド36は数が多いため、こ
れらの構成要素を代表する一部にだけ、対応する参照番
号を付けてある。
・グリッド・アレイ10のキャビティ20内の導体の平
面図を示す。ダイ取付領域22の近くに複数の接触パッ
ド32が設けられる。領域22に実装される集積回路の
パッドは、低インダクタンスのフリップ実装やその他の
周知の技術によって接触パッドに接続することができ
る。導電性トレース24の一部は、接触パッド32と、
ボール・グリッド・アレイ10の内部導体に接続された
接触パッド36(前述)との間に接続される。他の導電
性トレース24は、電源ループとアース・ループと接触
パッド32の間に接続される。接触パッド32、導電性
トレース24および接触パッド36は数が多いため、こ
れらの構成要素を代表する一部にだけ、対応する参照番
号を付けてある。
【0015】入力電源線26に結合された電源ループ4
0が、ダイ取付領域22の周囲に設けられる。入力アー
ス線28に結合されたアース・ループ42が、ダイ取付
け領域22の周囲に設けられる。
0が、ダイ取付領域22の周囲に設けられる。入力アー
ス線28に結合されたアース・ループ42が、ダイ取付
け領域22の周囲に設けられる。
【0016】図2の実施形態において、電源ループ40
とアース・ループ42の間には、4つのフィルタ・キャ
パシタ30が接続される。これらのキャパシタは、集積
回路のすぐ近くにおいてフィルタリングを実現し、それ
により、EMIをその発生源のきわめて近くで低減させ
る。発生源のきわめて近くでEMIを低減させること
は、雑音を含む信号が他の部品に伝わるのを低減し、ま
た雑音の寄生効果を低減するため望ましい。さらに、図
2の構成では、フィルタ・キャパシタを、露出した電源
ループとアース・ループに直接表面実装することができ
る。表面実装は、標準的な表面実装アセンブリ・プロセ
スで達成され、フィルタ・キャパシタを実装する伝統的
な安価な方法であるため好ましい。
とアース・ループ42の間には、4つのフィルタ・キャ
パシタ30が接続される。これらのキャパシタは、集積
回路のすぐ近くにおいてフィルタリングを実現し、それ
により、EMIをその発生源のきわめて近くで低減させ
る。発生源のきわめて近くでEMIを低減させること
は、雑音を含む信号が他の部品に伝わるのを低減し、ま
た雑音の寄生効果を低減するため望ましい。さらに、図
2の構成では、フィルタ・キャパシタを、露出した電源
ループとアース・ループに直接表面実装することができ
る。表面実装は、標準的な表面実装アセンブリ・プロセ
スで達成され、フィルタ・キャパシタを実装する伝統的
な安価な方法であるため好ましい。
【0017】製造する際、キャパシタは、導電性トレー
ス24のワイヤ・ボンディングを形成するよりも前に実
装することが好ましい。キャパシタは、容量が約0.1
〜0.001マイクロファラッドの範囲で、サイズ名称
0402であることが好ましい。
ス24のワイヤ・ボンディングを形成するよりも前に実
装することが好ましい。キャパシタは、容量が約0.1
〜0.001マイクロファラッドの範囲で、サイズ名称
0402であることが好ましい。
【0018】図2では、ダイ取付け領域の角部にキャパ
シタ30が示されているが、フィルタは任意の場所に配
置できることを理解されたい。用途によっては角部への
配置が都合がよいこともあるが、主な目的は、雑音を低
減させるために集積回路の近くでフィルタリングを行う
ことである。したがって、隣り合った導電性トレース間
に、図よりも少ないかまたは多い数のキャパシタを他の
配置で設けて、EMIとその関連する雑音のフィルタリ
ングを達成することができる。
シタ30が示されているが、フィルタは任意の場所に配
置できることを理解されたい。用途によっては角部への
配置が都合がよいこともあるが、主な目的は、雑音を低
減させるために集積回路の近くでフィルタリングを行う
ことである。したがって、隣り合った導電性トレース間
に、図よりも少ないかまたは多い数のキャパシタを他の
配置で設けて、EMIとその関連する雑音のフィルタリ
ングを達成することができる。
【0019】本発明をその特定の実施形態に関して説明
したが、さらに他の修正が可能であり、本出願が、本発
明の一般的な原理に従い、本発明が関係する当技術分野
において周知または慣例的な実施の範囲内にあり、以上
説明した本質的な機能に適用することができ、本発明の
範囲および併記特許請求の範囲の制限の範囲内にあるよ
うな本開示からの逸脱を含む、本発明の任意の変形、使
用法または適応をカバーするように意図されていること
を理解されよう。
したが、さらに他の修正が可能であり、本出願が、本発
明の一般的な原理に従い、本発明が関係する当技術分野
において周知または慣例的な実施の範囲内にあり、以上
説明した本質的な機能に適用することができ、本発明の
範囲および併記特許請求の範囲の制限の範囲内にあるよ
うな本開示からの逸脱を含む、本発明の任意の変形、使
用法または適応をカバーするように意図されていること
を理解されよう。
【0020】以上、本発明の実施例について詳述した
が、以下、本発明の各実施態様の例を示す。
が、以下、本発明の各実施態様の例を示す。
【0021】[実施態様1]第1の側に複数の低インダク
タンス実装導体(18)が形成されたプラットフォーム
(12)と、前記プラットフォームの第2の側に形成さ
れ、ダイ取付領域(22)を含むキャビティ(20)
と、前記キャビティ内の前記ダイ取付領域の近くに形成
され、少なくとも一部が前記プラットフォームの導体に
よって前記実装導体の一部に結合され、前記ダイ取付領
域に実装される集積回路のパッドを受けるための複数の
電気接点(32)と、前記電気接点の少なくとも1つに
結合された電源線(40)と、前記電気接点の少なくと
も別のものに結合されたアース線(42)と、前記プラ
ットフォームの前記第2の側に設けられ、前記電源線
(40)とアース線(42)の少なくとも1つに結合さ
れ、前記ダイ取付領域(22)に実装された集積回路に
よって生成されたEMIを低減する手段(30)と、を
備えて成る低インダクタンス集積回路パッケージ。
タンス実装導体(18)が形成されたプラットフォーム
(12)と、前記プラットフォームの第2の側に形成さ
れ、ダイ取付領域(22)を含むキャビティ(20)
と、前記キャビティ内の前記ダイ取付領域の近くに形成
され、少なくとも一部が前記プラットフォームの導体に
よって前記実装導体の一部に結合され、前記ダイ取付領
域に実装される集積回路のパッドを受けるための複数の
電気接点(32)と、前記電気接点の少なくとも1つに
結合された電源線(40)と、前記電気接点の少なくと
も別のものに結合されたアース線(42)と、前記プラ
ットフォームの前記第2の側に設けられ、前記電源線
(40)とアース線(42)の少なくとも1つに結合さ
れ、前記ダイ取付領域(22)に実装された集積回路に
よって生成されたEMIを低減する手段(30)と、を
備えて成る低インダクタンス集積回路パッケージ。
【0022】[実施態様2]前記EMI低減手段(30)
が、前記電源線(40)とアース線(42)の他方に結
合されたことを特徴とする実施態様1に記載の集積回路
パッケージ。
が、前記電源線(40)とアース線(42)の他方に結
合されたことを特徴とする実施態様1に記載の集積回路
パッケージ。
【0023】[実施態様3]前記EMI低減手段(30)
が、前記電源線(40)とアース線(42)との間に結
合されたことを特徴とする実施態様1に記載の集積回路
パッケージ。
が、前記電源線(40)とアース線(42)との間に結
合されたことを特徴とする実施態様1に記載の集積回路
パッケージ。
【0024】[実施態様4]前記EMI低減手段(30)
が、前記キャビティ(20)内に設けられたことを特徴
とする実施態様3に記載の集積回路パッケージ。
が、前記キャビティ(20)内に設けられたことを特徴
とする実施態様3に記載の集積回路パッケージ。
【0025】[実施態様5]前記キャビティのまわりの前
記プラットフォーム(12)上に形成されたボーダー領
域(14)をさらに備えて成り、前記EMI低減手段
(30)が、前記ボーダー領域に設けられたことを特徴
とする実施態様1に記載の集積回路パッケージ。
記プラットフォーム(12)上に形成されたボーダー領
域(14)をさらに備えて成り、前記EMI低減手段
(30)が、前記ボーダー領域に設けられたことを特徴
とする実施態様1に記載の集積回路パッケージ。
【0026】[実施態様6]前記低インダクタンス実装導
体が、導電性ボール(18)であることを特徴とする実
施態様1に記載の集積回路パッケージ。
体が、導電性ボール(18)であることを特徴とする実
施態様1に記載の集積回路パッケージ。
【0027】[実施態様7]前記EMI低減手段が、フィ
ルタ・キャパシタ(30)を有することを特徴とする実
施態様1に記載の集積回路パッケージ。
ルタ・キャパシタ(30)を有することを特徴とする実
施態様1に記載の集積回路パッケージ。
【0028】[実施態様8]前記電源線(40)とアース
線(42)とがそれぞれ、前記ダイ取付領域を囲む電源
線ループとアース線ループとを含むことを特徴とする実
施態様1に記載の集積回路パッケージ。
線(42)とがそれぞれ、前記ダイ取付領域を囲む電源
線ループとアース線ループとを含むことを特徴とする実
施態様1に記載の集積回路パッケージ。
【0029】[実施態様9]前記EMI低減手段が、電源
ループとアース・ループとの間にそれぞれ結合された複
数のフィルタ・キャパシタを有することを特徴とする実
施態様8に記載の集積回路パッケージ。
ループとアース・ループとの間にそれぞれ結合された複
数のフィルタ・キャパシタを有することを特徴とする実
施態様8に記載の集積回路パッケージ。
【0030】[実施態様10]前記複数のフィルタ・キャ
パシタ(30)が、前記電源ループ(40)とアース・
ループ(42)とに表面実装されていることを特徴とす
る実施態様9に記載の集積回路パッケージ。
パシタ(30)が、前記電源ループ(40)とアース・
ループ(42)とに表面実装されていることを特徴とす
る実施態様9に記載の集積回路パッケージ。
【0031】
【発明の効果】以上説明したように、本発明を用いるこ
とにより、EMIとその関連する雑音を、その雑音の発
生源近くの基板上で低減することができる。また、この
低減は安価に行うことができる。
とにより、EMIとその関連する雑音を、その雑音の発
生源近くの基板上で低減することができる。また、この
低減は安価に行うことができる。
【図1】本発明によるボール・グリッド・アレイの斜視
図である。
図である。
【図2】本発明による図1のボール・グリッド・アレイ
のキャビティ内の導体の平面図である。
のキャビティ内の導体の平面図である。
10:ボール・グリッド・アレイ 12:プラットフォーム 14:ボーダー 17:導電性ボール 18:ボール 19:ボール 20:キャビティ 22:ダイ取付領域 24:導電性トレース 26:電源線 28:アース線 30:キャパシタ 31:キャパシタ 32:接触パッド 36:接触パッド 40:電源ループ 42:アース線
Claims (10)
- 【請求項1】第1の側に複数の低インダクタンス実装導
体が形成されたプラットフォームと、 前記プラットフォームの第2の側に形成され、ダイ取付
領域を含むキャビティと、 前記キャビティ内の前記ダイ取付領域の近くに形成さ
れ、少なくとも一部が前記プラットフォームの導体によ
って前記実装導体の一部に結合され、前記ダイ取付領域
に実装される集積回路のパッドを受けるための複数の電
気接点と、 前記電気接点の少なくとも1つに結合された電源線と、 前記電気接点の少なくとも別のものに結合されたアース
線と、 前記プラットフォームの前記第2の側に設けられ、前記
電源線とアース線の少なくとも1つに結合され、前記ダ
イ取付領域に実装された集積回路によって生成されたE
MIを低減する手段と、 を備えて成る低インダクタンス集積回路パッケージ。 - 【請求項2】前記EMI低減手段が、前記電源線とアー
ス線の他方に結合されたことを特徴とする請求項1に記
載の集積回路パッケージ。 - 【請求項3】前記EMI低減手段が、前記電源線とアー
ス線との間に結合されたことを特徴とする請求項1に記
載の集積回路パッケージ。 - 【請求項4】前記EMI低減手段が、前記キャビティ内
に設けられたことを特徴とする請求項3に記載の集積回
路パッケージ。 - 【請求項5】前記キャビティのまわりの前記プラットフ
ォーム上に形成されたボーダー領域をさらに備えて成
り、前記EMI低減手段が、前記ボーダー領域に設けら
れたことを特徴とする請求項1に記載の集積回路パッケ
ージ。 - 【請求項6】前記低インダクタンス実装導体が、導電性
ボールであることを特徴とする請求項1に記載の集積回
路パッケージ。 - 【請求項7】前記EMI低減手段が、フィルタ・キャパ
シタを有することを特徴とする請求項1に記載の集積回
路パッケージ。 - 【請求項8】前記電源線とアース線とがそれぞれ、前記
ダイ取付領域を囲む電源線ループとアース線ループとを
含むことを特徴とする請求項1に記載の集積回路パッケ
ージ。 - 【請求項9】前記EMI低減手段が、電源ループとアー
ス・ループとの間にそれぞれ結合された複数のフィルタ
・キャパシタを有することを特徴とする請求項8に記載
の集積回路パッケージ。 - 【請求項10】前記複数のフィルタ・キャパシタが、前
記電源ループとアース・ループとに表面実装されている
ことを特徴とする請求項9に記載の集積回路パッケー
ジ。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US96073597A | 1997-10-30 | 1997-10-30 | |
US960,735 | 1997-10-30 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH11312776A true JPH11312776A (ja) | 1999-11-09 |
Family
ID=25503549
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP10310928A Pending JPH11312776A (ja) | 1997-10-30 | 1998-10-30 | 集積回路パッケージ |
Country Status (5)
Country | Link |
---|---|
US (1) | US6476486B1 (ja) |
EP (1) | EP0913865A2 (ja) |
JP (1) | JPH11312776A (ja) |
KR (1) | KR100600202B1 (ja) |
CN (1) | CN1216402A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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DE10102354C1 (de) * | 2001-01-19 | 2002-08-08 | Infineon Technologies Ag | Halbleiter-Bauelement mit ESD-Schutz |
US6888240B2 (en) * | 2001-04-30 | 2005-05-03 | Intel Corporation | High performance, low cost microelectronic circuit package with interposer |
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