JPH09306954A - 半導体装置及びその実装方法並びに実装構造体 - Google Patents
半導体装置及びその実装方法並びに実装構造体Info
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Abstract
(57)【要約】
【課題】 半導体チップ3から発生した熱を外気に放出
する放熱効率が低下する。 【解決手段】 配線基板2の一表面上にバンプ電極4を
介在して半導体チップ3が実装され、前記配線基板2の
一表面と前記半導体チップ3の主面との間の間隙領域に
樹脂5が充填されたパッケージ構造を有する半導体装置
において、前記半導体チップ3の主面と対向するその裏
面上に、前記半導体チップ3の平面サイズに比べて大き
い平面サイズで形成され、かつ窒化アルミニウム材で形
成された平板部材7を配置し、前記半導体チップ3の裏
面にこの半導体チップの裏面と対向する前記平板部材7
の一表面の固着領域をろう材6を介在して固着する。
する放熱効率が低下する。 【解決手段】 配線基板2の一表面上にバンプ電極4を
介在して半導体チップ3が実装され、前記配線基板2の
一表面と前記半導体チップ3の主面との間の間隙領域に
樹脂5が充填されたパッケージ構造を有する半導体装置
において、前記半導体チップ3の主面と対向するその裏
面上に、前記半導体チップ3の平面サイズに比べて大き
い平面サイズで形成され、かつ窒化アルミニウム材で形
成された平板部材7を配置し、前記半導体チップ3の裏
面にこの半導体チップの裏面と対向する前記平板部材7
の一表面の固着領域をろう材6を介在して固着する。
Description
【0001】
【発明の属する技術分野】本発明は、半導体装置に関
し、特に、配線基板の一表面上にバンプ電極を介在して
半導体チップが実装され、前記配線基板の一表面と前記
半導体チップの主面との間の間隙領域に樹脂が充填され
たパッケージ構造を有する半導体装置に適用して有効な
技術に関するものである。
し、特に、配線基板の一表面上にバンプ電極を介在して
半導体チップが実装され、前記配線基板の一表面と前記
半導体チップの主面との間の間隙領域に樹脂が充填され
たパッケージ構造を有する半導体装置に適用して有効な
技術に関するものである。
【0002】
【従来の技術】半導体装置として、例えば、工業調査会
発行の電子材料〔1996年、4月号、第14頁乃至第
19頁〕に記載されているように、配線基板の一表面上
にバンプ電極を介在して半導体チップが実装され、配線
基板の一表面と半導体チップの主面との間の間隙領域に
樹脂が充填されたパッケージ構造を有する半導体装置が
開発されている。この半導体装置は、配線基板の一表面
と半導体チップの主面との間の間隙領域に充填された樹
脂の機械的強度でバンプ電極の機械的強度を補うことが
できるので、配線基板と半導体チップとの熱膨張係数の
差に起因するバンプ電極の破損を防止することができ
る。また、この半導体装置は、半導体チップの主面と対
向するその裏面及びその側面が外部に露出されており、
半導体チップと外気とが接触する接触面積が大きいの
で、半導体チップが封止体で封止された半導体装置及び
パッケージ体で形成されるキャビティ内に半導体チップ
が塔載された半導体装置に比べて、半導体チップから発
生した熱を外気に放出する放熱効率が高い。
発行の電子材料〔1996年、4月号、第14頁乃至第
19頁〕に記載されているように、配線基板の一表面上
にバンプ電極を介在して半導体チップが実装され、配線
基板の一表面と半導体チップの主面との間の間隙領域に
樹脂が充填されたパッケージ構造を有する半導体装置が
開発されている。この半導体装置は、配線基板の一表面
と半導体チップの主面との間の間隙領域に充填された樹
脂の機械的強度でバンプ電極の機械的強度を補うことが
できるので、配線基板と半導体チップとの熱膨張係数の
差に起因するバンプ電極の破損を防止することができ
る。また、この半導体装置は、半導体チップの主面と対
向するその裏面及びその側面が外部に露出されており、
半導体チップと外気とが接触する接触面積が大きいの
で、半導体チップが封止体で封止された半導体装置及び
パッケージ体で形成されるキャビティ内に半導体チップ
が塔載された半導体装置に比べて、半導体チップから発
生した熱を外気に放出する放熱効率が高い。
【0003】
【発明が解決しようとする課題】前記半導体装置におい
て、半導体チップから発生する発熱量は、半導体チップ
に塔載される回路システムの高性能化に伴って増加の傾
向にある。一方、半導体チップの平面サイズは、半導体
チップに塔載される回路システムの高性能化に伴って大
型化の傾向にあるが、半導体チップの平面サイズが増加
する割合は、半導体チップの発熱量が増加する割合に比
べて小さい。つまり、半導体チップと外気とが接触する
接触面積は半導体チップの発熱量に比例して増加しな
い。このため、半導体チップから発生した熱を外気に放
出する放熱効率が低下する。
て、半導体チップから発生する発熱量は、半導体チップ
に塔載される回路システムの高性能化に伴って増加の傾
向にある。一方、半導体チップの平面サイズは、半導体
チップに塔載される回路システムの高性能化に伴って大
型化の傾向にあるが、半導体チップの平面サイズが増加
する割合は、半導体チップの発熱量が増加する割合に比
べて小さい。つまり、半導体チップと外気とが接触する
接触面積は半導体チップの発熱量に比例して増加しな
い。このため、半導体チップから発生した熱を外気に放
出する放熱効率が低下する。
【0004】本発明の目的は、配線基板の一表面上にバ
ンプ電極を介在して半導体チップが実装され、前記配線
基板の一表面と前記半導体チップの主面との間の間隙領
域に樹脂が充填されたパッケージ構造を有する半導体装
置の放熱効率を高めることが可能な技術を提供すること
にある。
ンプ電極を介在して半導体チップが実装され、前記配線
基板の一表面と前記半導体チップの主面との間の間隙領
域に樹脂が充填されたパッケージ構造を有する半導体装
置の放熱効率を高めることが可能な技術を提供すること
にある。
【0005】本発明の前記ならびにその他の目的と新規
な特徴は、本明細書の記述及び添付図面によって明らか
になるであろう。
な特徴は、本明細書の記述及び添付図面によって明らか
になるであろう。
【0006】
【課題を解決するための手段】本願において開示される
発明のうち、代表的なものの概要を簡単に説明すれば、
下記のとおりである。
発明のうち、代表的なものの概要を簡単に説明すれば、
下記のとおりである。
【0007】配線基板の一表面上にバンプ電極を介在し
て半導体チップが実装され、前記配線基板の一表面と前
記半導体チップの主面との間の間隙領域に樹脂が充填さ
れたパッケージ構造を有する半導体装置において、前記
半導体チップの主面と対向するその裏面上に、前記半導
体チップの平面サイズに比べて大きい平面サイズで形成
され、かつ窒化アルミニウム材で形成された平板部材を
配置し、前記半導体チップの裏面にこの半導体チップの
裏面と対向する前記平板部材の一表面の固着領域をろう
材を介在して固着する。
て半導体チップが実装され、前記配線基板の一表面と前
記半導体チップの主面との間の間隙領域に樹脂が充填さ
れたパッケージ構造を有する半導体装置において、前記
半導体チップの主面と対向するその裏面上に、前記半導
体チップの平面サイズに比べて大きい平面サイズで形成
され、かつ窒化アルミニウム材で形成された平板部材を
配置し、前記半導体チップの裏面にこの半導体チップの
裏面と対向する前記平板部材の一表面の固着領域をろう
材を介在して固着する。
【0008】上述した手段によれば、半導体チップの外
形サイズに比べて大きい外形サイズで形成された平板部
材は半導体チップに比べて外気と接触する接触面積が大
きい。また、窒化アルミニウム材で形成された平板部材
は熱伝導率が高い。また、ろう材を介在する半導体チッ
プの裏面と平板部材の一表面との固着は、半導体チップ
から平板部材に熱を伝達する熱伝達率が高い。従って、
半導体チップから発生した熱は半導体チップから平板部
材に効率良く伝達され、平板部材に伝達された熱は効率
良く拡散され、平板部材で拡散された熱は外気と接触す
る接触面積が大きい平板部材から外気に効率良く伝達さ
れるので、半導体チップから発生した熱を外気に放出す
る放熱効率を高めることができる。
形サイズに比べて大きい外形サイズで形成された平板部
材は半導体チップに比べて外気と接触する接触面積が大
きい。また、窒化アルミニウム材で形成された平板部材
は熱伝導率が高い。また、ろう材を介在する半導体チッ
プの裏面と平板部材の一表面との固着は、半導体チップ
から平板部材に熱を伝達する熱伝達率が高い。従って、
半導体チップから発生した熱は半導体チップから平板部
材に効率良く伝達され、平板部材に伝達された熱は効率
良く拡散され、平板部材で拡散された熱は外気と接触す
る接触面積が大きい平板部材から外気に効率良く伝達さ
れるので、半導体チップから発生した熱を外気に放出す
る放熱効率を高めることができる。
【0009】また、平板部材の一表面において、半導体
チップの裏面に固着される固着領域を除く他の領域は外
部に露出されるので、配線基板に平板部材を固定した場
合やパッケージ体に平板部材を固定した場合に比べて、
平板部材と外気とが接触する接触面積を増加できる。
チップの裏面に固着される固着領域を除く他の領域は外
部に露出されるので、配線基板に平板部材を固定した場
合やパッケージ体に平板部材を固定した場合に比べて、
平板部材と外気とが接触する接触面積を増加できる。
【0010】また、窒化アルミニウム材で形成された平
板部材は、珪素基板からなる半導体チップとの熱膨張係
数の差が小さいので、半導体チップの裏面にろう材を介
在して平板部材を固着しても、平板部材と半導体チップ
との熱膨張係数の差に起因する熱応力を抑制できる。
板部材は、珪素基板からなる半導体チップとの熱膨張係
数の差が小さいので、半導体チップの裏面にろう材を介
在して平板部材を固着しても、平板部材と半導体チップ
との熱膨張係数の差に起因する熱応力を抑制できる。
【0011】
【発明の実施の形態】以下、図面を参照して本発明の実
施の形態を詳細に説明する。
施の形態を詳細に説明する。
【0012】なお、発明の実施の形態を説明するための
全図において、同一機能を有するものは同一符号を付
け、その繰り返しの説明は省略する。
全図において、同一機能を有するものは同一符号を付
け、その繰り返しの説明は省略する。
【0013】(実施形態1)本発明の実施形態1である
半導体装置の概略構成を図1(断面図)に示す。
半導体装置の概略構成を図1(断面図)に示す。
【0014】図1に示すように、半導体装置1は、配線
基板2の一表面(実装面)上にバンプ電極4を介在して半
導体チップ3が実装され、配線基板2の一表面と半導体
チップ3の主面との間の間隙領域に樹脂5が充填された
パッケージ構造で構成されている。
基板2の一表面(実装面)上にバンプ電極4を介在して半
導体チップ3が実装され、配線基板2の一表面と半導体
チップ3の主面との間の間隙領域に樹脂5が充填された
パッケージ構造で構成されている。
【0015】前記配線基板2の平面形状は例えば方形状
で形成されている。配線基板2は、例えば酸化アルミニ
ウム(Al2O3)材からなるセラミックス基板で構成され
ている。この場合の配線基板2は、1000[℃]以上
の耐熱温度を有し、7×10~6[1/℃]程度の熱膨張
係数を有する。配線基板2は、例えば、30[mm]×
30[mm]の外形サイズで形成されている。
で形成されている。配線基板2は、例えば酸化アルミニ
ウム(Al2O3)材からなるセラミックス基板で構成され
ている。この場合の配線基板2は、1000[℃]以上
の耐熱温度を有し、7×10~6[1/℃]程度の熱膨張
係数を有する。配線基板2は、例えば、30[mm]×
30[mm]の外形サイズで形成されている。
【0016】前記配線基板2の一表面には電極パッド2
Aが複数個配置され、また、配線基板2の一表面と対向
するその裏面には電極パッド2Bが複数個配置されてい
る。この電極パッド2A、電極パッド2Bの夫々は、配
線基板2の配線を介して電気的に接続されている。
Aが複数個配置され、また、配線基板2の一表面と対向
するその裏面には電極パッド2Bが複数個配置されてい
る。この電極パッド2A、電極パッド2Bの夫々は、配
線基板2の配線を介して電気的に接続されている。
【0017】前記半導体チップ3の平面形状は例えば方
形状で形成されている。半導体チップ3は、例えば、珪
素基板及びその主面(素子形成面)上に形成された配線
層を主体とする構造で構成されている。この場合の半導
体チップ3は、3.5×10~6[1/℃]程度の熱膨張
係数を有する。半導体チップ3は、例えば、10[m
m]×10[mm]の平面サイズで形成されている。
形状で形成されている。半導体チップ3は、例えば、珪
素基板及びその主面(素子形成面)上に形成された配線
層を主体とする構造で構成されている。この場合の半導
体チップ3は、3.5×10~6[1/℃]程度の熱膨張
係数を有する。半導体チップ3は、例えば、10[m
m]×10[mm]の平面サイズで形成されている。
【0018】前記半導体チップ3には、論理回路システ
ム、記憶回路システム、或はそれらの混合回路システム
が塔載されている。これらの回路システムは高性能化の
傾向にあり、この回路システムの高性能化に伴って半導
体チップ3から発生する発熱量は増加する。
ム、記憶回路システム、或はそれらの混合回路システム
が塔載されている。これらの回路システムは高性能化の
傾向にあり、この回路システムの高性能化に伴って半導
体チップ3から発生する発熱量は増加する。
【0019】前記半導体チップ3の主面には外部端子3
Aが複数個配置されている。この複数個の外部端子3A
の夫々は、これに限定されないが、例えば、珪素基板の
主面上に形成された配線層のうち、最上層の配線層に形
成された複数個の内部端子の夫々の表面上に形成されて
いる。内部端子は、例えばアルミニウム膜又はアルミニ
ウム合金膜で形成されている。
Aが複数個配置されている。この複数個の外部端子3A
の夫々は、これに限定されないが、例えば、珪素基板の
主面上に形成された配線層のうち、最上層の配線層に形
成された複数個の内部端子の夫々の表面上に形成されて
いる。内部端子は、例えばアルミニウム膜又はアルミニ
ウム合金膜で形成されている。
【0020】前記複数個の外部端子3Aの夫々は、配線
基板2の一表面に配置された複数個の電極パッド2Aの
夫々にバンプ電極4を介在して固着され、電気的にかつ
機械的に接続されている。つまり、半導体チップ3は配
線基板2の一表面上にフェイスダウン方式で実装されて
いる。バンプ電極4は、例えば、320[℃]程度の融
点を有する98.2[重量%]Pb−1.8[重量%]
Sn組成の金属材で形成されている。
基板2の一表面に配置された複数個の電極パッド2Aの
夫々にバンプ電極4を介在して固着され、電気的にかつ
機械的に接続されている。つまり、半導体チップ3は配
線基板2の一表面上にフェイスダウン方式で実装されて
いる。バンプ電極4は、例えば、320[℃]程度の融
点を有する98.2[重量%]Pb−1.8[重量%]
Sn組成の金属材で形成されている。
【0021】前記配線基板2の電極パッド2A及び半導
体チップ3の外部端子3Aは、バンプ電極4との高い濡
れ性を確保するため、例えば下地金属膜で形成されてい
る。また、前記配線基板2の電極パッド2Bは、バンプ
電極8との高い濡れ性を確保するため、例えば下地金属
膜で形成されている。これらの下地金属膜は、この構造
に限定されないが、例えば、クロム(Cr)膜、ニッケル
(Ni)膜、金(Au)膜の夫々を順次積層した積層構造で
構成されている。
体チップ3の外部端子3Aは、バンプ電極4との高い濡
れ性を確保するため、例えば下地金属膜で形成されてい
る。また、前記配線基板2の電極パッド2Bは、バンプ
電極8との高い濡れ性を確保するため、例えば下地金属
膜で形成されている。これらの下地金属膜は、この構造
に限定されないが、例えば、クロム(Cr)膜、ニッケル
(Ni)膜、金(Au)膜の夫々を順次積層した積層構造で
構成されている。
【0022】前記配線基板2の一表面と半導体チップ3
の主面との間の間隙領域に充填された樹脂5は、例え
ば、シリカ充填剤、硬化促進剤、カップリング剤等を添
加したエポキシ系の熱硬化樹脂で形成されている。配線
基板2の一表面と半導体チップ3の主面との間の間隙領
域に樹脂5を充填することにより、バンプ電極4の機械
的強度を樹脂5の機械的強度で補うことができるので、
配線基板2と半導体チップ3との熱膨張係数の差に起因
するバンプ電極15の破損を防止することができる。
の主面との間の間隙領域に充填された樹脂5は、例え
ば、シリカ充填剤、硬化促進剤、カップリング剤等を添
加したエポキシ系の熱硬化樹脂で形成されている。配線
基板2の一表面と半導体チップ3の主面との間の間隙領
域に樹脂5を充填することにより、バンプ電極4の機械
的強度を樹脂5の機械的強度で補うことができるので、
配線基板2と半導体チップ3との熱膨張係数の差に起因
するバンプ電極15の破損を防止することができる。
【0023】前記半導体チップ3の主面と対向するその
裏面上には平板部材7が配置され、半導体チップ3の裏
面にこの半導体チップ3の裏面と対向する平板部材7の
一表面の固着領域がろう材6を介在して固着されてい
る。
裏面上には平板部材7が配置され、半導体チップ3の裏
面にこの半導体チップ3の裏面と対向する平板部材7の
一表面の固着領域がろう材6を介在して固着されてい
る。
【0024】前記平板部材7の平面形状は例えば方形状
で形成されている。平板部材7は、半導体チップ3の平
面サイズに比べて大きい平面サイズで形成されている。
例えば、平板部材7は45[mm]×45[mm]の平
面サイズで形成されている。また、平板部材7は熱伝導
率が高い窒化アルミニウム(AlN)材で形成されてい
る。窒化アルミニウム材で形成された平板部材7は、1
000[℃]以上の耐熱温度を有し、4.1×10~
6[1/℃]程度の熱膨張係数を有する。
で形成されている。平板部材7は、半導体チップ3の平
面サイズに比べて大きい平面サイズで形成されている。
例えば、平板部材7は45[mm]×45[mm]の平
面サイズで形成されている。また、平板部材7は熱伝導
率が高い窒化アルミニウム(AlN)材で形成されてい
る。窒化アルミニウム材で形成された平板部材7は、1
000[℃]以上の耐熱温度を有し、4.1×10~
6[1/℃]程度の熱膨張係数を有する。
【0025】前記ろう材6は、バンプ電極4の融点に比
べて低い融点を有する金属材、例えば、300[℃]程
度の融点を有する90[重量%]Pb−10[重量%]
Sn組成の金属材で形成されている。
べて低い融点を有する金属材、例えば、300[℃]程
度の融点を有する90[重量%]Pb−10[重量%]
Sn組成の金属材で形成されている。
【0026】前記半導体チップ3の裏面には、ろう材6
に対して濡れ性を有するメタライズ層3Bが形成されて
いる。メタライズ層3Bは、この構造に限定されない
が、例えば、半導体チップ3の裏面から、ニッケル(N
i)膜、金(Au)膜の夫々を順次積層した積層構造で構
成されている。
に対して濡れ性を有するメタライズ層3Bが形成されて
いる。メタライズ層3Bは、この構造に限定されない
が、例えば、半導体チップ3の裏面から、ニッケル(N
i)膜、金(Au)膜の夫々を順次積層した積層構造で構
成されている。
【0027】前記平板部材7の一表面の固着領域には、
ろう材6に対して濡れ性を有するメタライズ層7Aが形
成されている。メタライズ層7Aは平板部材7の一表面
の固着領域に形成されている。メタライズ層7Aは、こ
の構造に限定されないが、例えば、メタライズ層3Bと
同様の構造で構成されている。
ろう材6に対して濡れ性を有するメタライズ層7Aが形
成されている。メタライズ層7Aは平板部材7の一表面
の固着領域に形成されている。メタライズ層7Aは、こ
の構造に限定されないが、例えば、メタライズ層3Bと
同様の構造で構成されている。
【0028】前記配線基板2の裏面に配置された複数個
の電極パッド2Bの夫々の表面にはバンプ電極8が固着
されている。このバンプ電極8は、ろう材6の融点に比
べて低い融点を有する金属材、例えば、183[℃]の
融点を有する37[重量%]Pb−63[重量%]Sn
組成の金属材で形成されている。
の電極パッド2Bの夫々の表面にはバンプ電極8が固着
されている。このバンプ電極8は、ろう材6の融点に比
べて低い融点を有する金属材、例えば、183[℃]の
融点を有する37[重量%]Pb−63[重量%]Sn
組成の金属材で形成されている。
【0029】前記平板部材7の一表面の固着領域を除く
他の領域は外部に露出されている。また、平板部材7の
裏面及び側面は外部に露出されている。つまり、平板部
材7は、一表面の固着領域を除いた全てが外部に露出さ
れているので、半導体チップ3の平面サイズに比べて平
板部材7の平面サイズを大きくすることにより、平板部
材7と外気とが接触する接触面積が大きくなる。
他の領域は外部に露出されている。また、平板部材7の
裏面及び側面は外部に露出されている。つまり、平板部
材7は、一表面の固着領域を除いた全てが外部に露出さ
れているので、半導体チップ3の平面サイズに比べて平
板部材7の平面サイズを大きくすることにより、平板部
材7と外気とが接触する接触面積が大きくなる。
【0030】前記平板部材7は、半導体チップ3の外形
サイズに比べて大きい外形サイズで形成されている。こ
の平板部材7は、半導体チップ3に比べて外気と接触す
る接触面積が大きい。また、平板部材7は窒化アルミニ
ウム材で形成されている。この窒化アルミニウム材で形
成された平板部材7は熱伝達率が高い。また、平板部材
7の一表面の固着領域は、半導体チップ3の裏面にろう
材6を介在して固着されている。このろう材6を介在す
る半導体チップ3の裏面と平板部材7の一表面との固着
は、半導体チップ3から平板部材7に熱を伝達する熱伝
達率が高い。従って、半導体チップ3から発生した熱は
半導体チップ3から平板部材7に効率良く伝達され、平
板部材7に伝達された熱は効率良く拡散され、平板部材
7で拡散された熱は外気と接触する接触面積が大きい平
板部材7から外気に効率良く伝達される。
サイズに比べて大きい外形サイズで形成されている。こ
の平板部材7は、半導体チップ3に比べて外気と接触す
る接触面積が大きい。また、平板部材7は窒化アルミニ
ウム材で形成されている。この窒化アルミニウム材で形
成された平板部材7は熱伝達率が高い。また、平板部材
7の一表面の固着領域は、半導体チップ3の裏面にろう
材6を介在して固着されている。このろう材6を介在す
る半導体チップ3の裏面と平板部材7の一表面との固着
は、半導体チップ3から平板部材7に熱を伝達する熱伝
達率が高い。従って、半導体チップ3から発生した熱は
半導体チップ3から平板部材7に効率良く伝達され、平
板部材7に伝達された熱は効率良く拡散され、平板部材
7で拡散された熱は外気と接触する接触面積が大きい平
板部材7から外気に効率良く伝達される。
【0031】次に、前記半導体装置1の製造方法につい
て、図2乃至図5(製造方法を説明するための断面図)
を用いて説明する。
て、図2乃至図5(製造方法を説明するための断面図)
を用いて説明する。
【0032】まず、配線基板2及び半導体チップ3を準
備する。半導体チップ3の裏面にはメタライズ層3Bが
形成されている。また、半導体チップ3の主面に配置さ
れた外部端子3Aの表面上には、既にバンプ電極4が固
着されている。バンプ電極4は、例えば、320[℃]
程度の融点を有する98.2[重量%]Pb−1.8
[重量%]Sn組成の金属材で形成されている。
備する。半導体チップ3の裏面にはメタライズ層3Bが
形成されている。また、半導体チップ3の主面に配置さ
れた外部端子3Aの表面上には、既にバンプ電極4が固
着されている。バンプ電極4は、例えば、320[℃]
程度の融点を有する98.2[重量%]Pb−1.8
[重量%]Sn組成の金属材で形成されている。
【0033】次に、前記配線基板2の一表面上に半導体
チップ2を載置すると共に、配線基板2の一表面に配置
された電極パッド2Aの表面と半導体チップ3の主面に
配置された外部端子3Aの表面との間にバンプ電極4を
配置する。
チップ2を載置すると共に、配線基板2の一表面に配置
された電極パッド2Aの表面と半導体チップ3の主面に
配置された外部端子3Aの表面との間にバンプ電極4を
配置する。
【0034】次に、熱処理を施し、図2に示すように、
配線基板2の電極パッド2Aと半導体チップ3の外部端
子3Aとをバンプ電極4で固着する。熱処理は、例えば
350[℃]程度の温度雰囲気中で行う。この工程にお
いて、配線基板2の電極パッド2A、半導体チップ3の
外部端子3Aの夫々は、バンプ電極4を介在して電気的
にかつ機械的に接続され、半導体チップ3は実装基板2
の一表面上に実装される。
配線基板2の電極パッド2Aと半導体チップ3の外部端
子3Aとをバンプ電極4で固着する。熱処理は、例えば
350[℃]程度の温度雰囲気中で行う。この工程にお
いて、配線基板2の電極パッド2A、半導体チップ3の
外部端子3Aの夫々は、バンプ電極4を介在して電気的
にかつ機械的に接続され、半導体チップ3は実装基板2
の一表面上に実装される。
【0035】次に、図3に示すように、前記配線基板2
の一表面と半導体チップ3の主面との間の間隙領域に液
状の樹脂5を充填する。
の一表面と半導体チップ3の主面との間の間隙領域に液
状の樹脂5を充填する。
【0036】次に、熱処理を施し、前記液状の樹脂5を
硬化させる。
硬化させる。
【0037】次に、前記平板部材7の一表面の固着領域
に形成されたメタライズ層7Aの表面上にろう材6を介
在して前記半導体チップ3の裏面に形成されたメタライ
ズ層3Bを装着する。ろう材6は、例えば300[℃]
程度の融点を有する90[重量%]Pb−10[重量
%]Sn組成の金属材で形成されている。
に形成されたメタライズ層7Aの表面上にろう材6を介
在して前記半導体チップ3の裏面に形成されたメタライ
ズ層3Bを装着する。ろう材6は、例えば300[℃]
程度の融点を有する90[重量%]Pb−10[重量
%]Sn組成の金属材で形成されている。
【0038】次に、熱処理を施し、図4に示すように、
前記平板部材7の一表面の固着領域と半導体チップ3の
裏面とをろう材6で固着する。熱処理は例えば310
[℃]程度の温度雰囲気中で行う。この工程において、
ろう材6は、バンプ電極4の融点に比べて低い融点を有
する金属材で形成されているので、バンプ電極4を溶融
することなく、平板部材7の一表面と半導体チップ3の
裏面とをろう材6で固着することができる。また、半導
体チップ3の裏面には、ろう材6に対して濡れ性を有す
るメタライズ層3Bが形成され、平板部材7の一表面の
固着領域にはろう材6に対して濡れ性を有するメタライ
ズ層7Aが形成されているので、半導体チップ3の裏面
と平板部材7の一表面の固着領域とをろう材6で固着す
ることができる。
前記平板部材7の一表面の固着領域と半導体チップ3の
裏面とをろう材6で固着する。熱処理は例えば310
[℃]程度の温度雰囲気中で行う。この工程において、
ろう材6は、バンプ電極4の融点に比べて低い融点を有
する金属材で形成されているので、バンプ電極4を溶融
することなく、平板部材7の一表面と半導体チップ3の
裏面とをろう材6で固着することができる。また、半導
体チップ3の裏面には、ろう材6に対して濡れ性を有す
るメタライズ層3Bが形成され、平板部材7の一表面の
固着領域にはろう材6に対して濡れ性を有するメタライ
ズ層7Aが形成されているので、半導体チップ3の裏面
と平板部材7の一表面の固着領域とをろう材6で固着す
ることができる。
【0039】次に、前記配線基板2の一表面と対向する
その裏面に配置された電極パッド2Bの表面上に、ガラ
スマスクを用いたボール供給法でバンプ電極8を供給す
る。バンプ電極8は、ろう材6の融点に比べて低い融点
を有する金属材、例えば183[℃]の融点を有する3
7[重量%]Pb−63[重量%]Sn組成の金属材で
形成されている。
その裏面に配置された電極パッド2Bの表面上に、ガラ
スマスクを用いたボール供給法でバンプ電極8を供給す
る。バンプ電極8は、ろう材6の融点に比べて低い融点
を有する金属材、例えば183[℃]の融点を有する3
7[重量%]Pb−63[重量%]Sn組成の金属材で
形成されている。
【0040】次に、熱処理を施し、図5に示すように、
配線基板2の裏面の電極パッド2Bの表面にバンプ電極
8を固着する。熱処理は、例えば200[℃]程度の温
度雰囲気中で行う。この工程において、バンプ電極8は
ろう材6の融点に比べて低い融点を有する金属材で形成
されているので、ろう材6を溶融することなく、配線基
板2の電極パッド2Bの表面にバンプ電極8を固着する
ことができる。この工程により、半導体装置1はほぼ完
成する。
配線基板2の裏面の電極パッド2Bの表面にバンプ電極
8を固着する。熱処理は、例えば200[℃]程度の温
度雰囲気中で行う。この工程において、バンプ電極8は
ろう材6の融点に比べて低い融点を有する金属材で形成
されているので、ろう材6を溶融することなく、配線基
板2の電極パッド2Bの表面にバンプ電極8を固着する
ことができる。この工程により、半導体装置1はほぼ完
成する。
【0041】この後、半導体装置1は製品として出荷さ
れる。製品として出荷された半導体装置1は、実装基板
の一表面(実装面)上にバンプ電極8を介在して実装され
る。
れる。製品として出荷された半導体装置1は、実装基板
の一表面(実装面)上にバンプ電極8を介在して実装され
る。
【0042】次に、前記半導体装置1の実装方法につい
て、図6乃至図7(実装方法を説明するための断面図)
を用いて説明する。
て、図6乃至図7(実装方法を説明するための断面図)
を用いて説明する。
【0043】まず、半導体装置1を準備する。半導体装
置1の配線基板2の裏面に配置された電極パッド2Bの
表面には既にバンプ電極8が固着されている。
置1の配線基板2の裏面に配置された電極パッド2Bの
表面には既にバンプ電極8が固着されている。
【0044】次に、前記半導体装置1の平板部材7の裏
面に柔軟層11を介在して放熱フィン部材12を固定す
る。放熱フィン部材12は、半導体チップ3の平面サイ
ズに比べて大きい平面サイズ、例えば45[mm]×4
5[mm]の平面サイズで形成されている。放熱フィン
部材12は、熱伝導率が高いアルミニウム材又はアルミ
ニウム材を主体とする合金材若しくは銅材又は銅材を主
体とする合金材で形成されている。アルミニウム材から
なる放熱フィン部材12は、23.1×10~6[1/
℃]程度の熱膨張係数を有する。銅材からなる放熱フィ
ン部材12は、16.5×10~6×[1/℃]程度の熱
膨張係数を有する。柔軟層11は熱伝導率が高い弾性材
又は粘性材で形成されている。弾性材としては、例えば
シリコーンゲル、伝熱シート等を用いる。粘性材として
は、例えば熱伝導性グリース又は熱伝導性コンパンド等
を用いる。この柔軟層11は、平板部材7と放熱フィン
部材12との熱膨張係数の差に起因する熱応力を吸収す
ることができる。
面に柔軟層11を介在して放熱フィン部材12を固定す
る。放熱フィン部材12は、半導体チップ3の平面サイ
ズに比べて大きい平面サイズ、例えば45[mm]×4
5[mm]の平面サイズで形成されている。放熱フィン
部材12は、熱伝導率が高いアルミニウム材又はアルミ
ニウム材を主体とする合金材若しくは銅材又は銅材を主
体とする合金材で形成されている。アルミニウム材から
なる放熱フィン部材12は、23.1×10~6[1/
℃]程度の熱膨張係数を有する。銅材からなる放熱フィ
ン部材12は、16.5×10~6×[1/℃]程度の熱
膨張係数を有する。柔軟層11は熱伝導率が高い弾性材
又は粘性材で形成されている。弾性材としては、例えば
シリコーンゲル、伝熱シート等を用いる。粘性材として
は、例えば熱伝導性グリース又は熱伝導性コンパンド等
を用いる。この柔軟層11は、平板部材7と放熱フィン
部材12との熱膨張係数の差に起因する熱応力を吸収す
ることができる。
【0045】次に、図6に示すように、前記半導体装置
1の平板部材7と放熱フィン部材12とを、弾性力を有
する挟持部材13で挟持固定する。この工程において、
放熱フィン部材12は柔軟層11の接着力によって平板
部材7の裏面に接着固定されているが、柔軟層11の接
着力は弱いので、平板部材7と放熱フィン部材12と
を、弾性力を有する挟持部材13で挟持固定することに
より、平板部材7と放熱フィン部材12との固定強度を
増加できる。
1の平板部材7と放熱フィン部材12とを、弾性力を有
する挟持部材13で挟持固定する。この工程において、
放熱フィン部材12は柔軟層11の接着力によって平板
部材7の裏面に接着固定されているが、柔軟層11の接
着力は弱いので、平板部材7と放熱フィン部材12と
を、弾性力を有する挟持部材13で挟持固定することに
より、平板部材7と放熱フィン部材12との固定強度を
増加できる。
【0046】次に、実装基板10の一表面(実装面)上に
半導体装置1を載置すると共に、前記実装基板10の一
表面に配置された電極パッド10Aと半導体装置1の配
線基板2の裏面に配置された電極パッド2Bとの間にバ
ンプ電極8を配置する。
半導体装置1を載置すると共に、前記実装基板10の一
表面に配置された電極パッド10Aと半導体装置1の配
線基板2の裏面に配置された電極パッド2Bとの間にバ
ンプ電極8を配置する。
【0047】次に、熱処理を施し、図7に示すように、
前記実装基板10の電極パッド10Aと配線基板2の電
極パッド2Bとをバンプ電極8で固着する。熱処理は、
例えば200[℃]程度の温度雰囲気中で行う。この工
程において、バンプ電極8はろう材6の融点に比べて低
い融点を有する金属材で形成されているので、ろう材6
を溶融することなく、実装基板10の電極パッド10A
と配線基板2の電極パッド2Bとをバンプ電極8で固着
することができる。この工程により、半導体装置1は実
装基板10の一表面上にバンプ電極8を介在して実装さ
れる。また、この工程により、実装基板10の一表面上
にバンプ電極8を介在して半導体装置1が実装され、半
導体装置1の平板部材7の一表面と対向するその裏面に
柔軟層11を介在して放熱フィン部材12が固定された
実装構造体(電子装置)が構成される。
前記実装基板10の電極パッド10Aと配線基板2の電
極パッド2Bとをバンプ電極8で固着する。熱処理は、
例えば200[℃]程度の温度雰囲気中で行う。この工
程において、バンプ電極8はろう材6の融点に比べて低
い融点を有する金属材で形成されているので、ろう材6
を溶融することなく、実装基板10の電極パッド10A
と配線基板2の電極パッド2Bとをバンプ電極8で固着
することができる。この工程により、半導体装置1は実
装基板10の一表面上にバンプ電極8を介在して実装さ
れる。また、この工程により、実装基板10の一表面上
にバンプ電極8を介在して半導体装置1が実装され、半
導体装置1の平板部材7の一表面と対向するその裏面に
柔軟層11を介在して放熱フィン部材12が固定された
実装構造体(電子装置)が構成される。
【0048】このように、本実施形態によれば、以下の
作用効果が得られる。
作用効果が得られる。
【0049】(1)配線基板2の一表面上にバンプ電極
4を介在して半導体チップ3が実装され、前記配線基板
2の一表面と前記半導体チップ3の主面との間の間隙領
域に樹脂5が充填されたパッケージ構造を有する半導体
装置において、前記半導体チップ3の主面と対向するそ
の裏面上に、前記半導体チップ3の平面サイズに比べて
大きい平面サイズで形成され、かつ窒化アルミニウム材
で形成された平板部材7を配置し、前記半導体チップ3
の裏面にこの半導体チップ3の裏面と対向する前記平板
部材7の一表面の固着領域をろう材6を介在して固着す
る。
4を介在して半導体チップ3が実装され、前記配線基板
2の一表面と前記半導体チップ3の主面との間の間隙領
域に樹脂5が充填されたパッケージ構造を有する半導体
装置において、前記半導体チップ3の主面と対向するそ
の裏面上に、前記半導体チップ3の平面サイズに比べて
大きい平面サイズで形成され、かつ窒化アルミニウム材
で形成された平板部材7を配置し、前記半導体チップ3
の裏面にこの半導体チップ3の裏面と対向する前記平板
部材7の一表面の固着領域をろう材6を介在して固着す
る。
【0050】この構成により、半導体チップ3の外形サ
イズに比べて大きい外形サイズで形成された平板部材7
は半導体チップ3に比べて外気と接触する接触面積が大
きい。また、窒化アルミニウム材で形成された平板部材
7は熱伝導率が高い。また、ろう材6を介在する半導体
チップ3の裏面と平板部材7の一表面との固着は、半導
体チップ3から平板部材7に熱を伝達する熱伝達率が高
い。従って、半導体チップ3から発生した熱は半導体チ
ップ3から平板部材7に効率良く伝達され、平板部材7
に伝達された熱は効率良く拡散され、平板部材7で拡散
された熱は外気と接触する接触面積が大きい平板部材7
から外気に効率良く伝達されるので、半導体チップ3か
ら発生した熱を外気に放出する放熱効率を高めることが
できる。
イズに比べて大きい外形サイズで形成された平板部材7
は半導体チップ3に比べて外気と接触する接触面積が大
きい。また、窒化アルミニウム材で形成された平板部材
7は熱伝導率が高い。また、ろう材6を介在する半導体
チップ3の裏面と平板部材7の一表面との固着は、半導
体チップ3から平板部材7に熱を伝達する熱伝達率が高
い。従って、半導体チップ3から発生した熱は半導体チ
ップ3から平板部材7に効率良く伝達され、平板部材7
に伝達された熱は効率良く拡散され、平板部材7で拡散
された熱は外気と接触する接触面積が大きい平板部材7
から外気に効率良く伝達されるので、半導体チップ3か
ら発生した熱を外気に放出する放熱効率を高めることが
できる。
【0051】また、平板部材7の一表面において、半導
体チップ3の裏面に固着される固着領域を除く他の領域
は外部に露出されるので、配線基板に平板部材7を固着
した場合やパッケージ体に平板部材7を固定した場合に
比べて、平板部材7と外気とが接触する接触面積を増加
できる。
体チップ3の裏面に固着される固着領域を除く他の領域
は外部に露出されるので、配線基板に平板部材7を固着
した場合やパッケージ体に平板部材7を固定した場合に
比べて、平板部材7と外気とが接触する接触面積を増加
できる。
【0052】また、窒化アルミニウム材で形成された平
板部材7は、珪素基板からなる半導体チップ3との熱膨
張係数の差が小さいので、半導体チップ3の裏面にろう
材6を介在して平板部材7を固着しても、平板部材7と
半導体チップ3との熱膨張係数の差に起因する熱応力を
抑制できる。
板部材7は、珪素基板からなる半導体チップ3との熱膨
張係数の差が小さいので、半導体チップ3の裏面にろう
材6を介在して平板部材7を固着しても、平板部材7と
半導体チップ3との熱膨張係数の差に起因する熱応力を
抑制できる。
【0053】(2)前記半導体チップ3の裏面及び前記
平板部材7の一表面の固着領域にろう材6に対して濡れ
性を有するメタライズ層(3B,7A)を形成する。この
構成により、珪素基板からなる半導体チップ3の裏面に
窒化アルミニウム材からなる平板部材7をろう材6で固
着できるので、半導体チップ3と平板部材7との固定強
度を高めることができる。
平板部材7の一表面の固着領域にろう材6に対して濡れ
性を有するメタライズ層(3B,7A)を形成する。この
構成により、珪素基板からなる半導体チップ3の裏面に
窒化アルミニウム材からなる平板部材7をろう材6で固
着できるので、半導体チップ3と平板部材7との固定強
度を高めることができる。
【0054】(3)前記バンプ電極4の融点に比べて低
い融点を有する金属材で前記ろう材6を形成する。この
構成により、配線基板2の一表面上にバンプ電極4を介
在して実装された半導体チップ4の裏面に、バンプ電極
4を溶融することなく、平板部材7の一表面の固着領域
を固着することができる。
い融点を有する金属材で前記ろう材6を形成する。この
構成により、配線基板2の一表面上にバンプ電極4を介
在して実装された半導体チップ4の裏面に、バンプ電極
4を溶融することなく、平板部材7の一表面の固着領域
を固着することができる。
【0055】(4)前記ろう材6の融点に比べて低い融
点を有する金属材で前記バンプ電極8を形成する。この
構成により、ろう材6を溶融することなく、実装基板1
0の一表面上にバンプ電極8を介在して半導体装置1を
実装することができる。
点を有する金属材で前記バンプ電極8を形成する。この
構成により、ろう材6を溶融することなく、実装基板1
0の一表面上にバンプ電極8を介在して半導体装置1を
実装することができる。
【0056】(5)実装基板10の一表面上に半導体装
置を実装する実装方法において、配線基板2の一表面上
にバンプ電極4を介在して半導体チップ3が実装され、
前記配線基板2の一表面と前記半導体チップ3の主面と
の間の間隙領域に樹脂5が充填されたパッケージ構造を
有し、更に、前記半導体チップ3の主面と対向するその
裏面に、前記半導体チップの平面サイズに比べて大きい
平面サイズで形成され、かつ窒化アルミニウム材で形成
された平板部材7が配置され、前記半導体チップ3の裏
面にこの半導体チップ3の裏面と対向する前記平板部材
7の一表面の固着領域がろう材6を介在して固着された
半導体装置1を準備する工程と、前記平板部材7の一表
面と対向するその裏面に柔軟層を介在して放熱フィン部
材12を固定する工程と、実装基板10の一表面上にバ
ンプ電極8を介在して前記半導体装置1を実装する工程
を備える。
置を実装する実装方法において、配線基板2の一表面上
にバンプ電極4を介在して半導体チップ3が実装され、
前記配線基板2の一表面と前記半導体チップ3の主面と
の間の間隙領域に樹脂5が充填されたパッケージ構造を
有し、更に、前記半導体チップ3の主面と対向するその
裏面に、前記半導体チップの平面サイズに比べて大きい
平面サイズで形成され、かつ窒化アルミニウム材で形成
された平板部材7が配置され、前記半導体チップ3の裏
面にこの半導体チップ3の裏面と対向する前記平板部材
7の一表面の固着領域がろう材6を介在して固着された
半導体装置1を準備する工程と、前記平板部材7の一表
面と対向するその裏面に柔軟層を介在して放熱フィン部
材12を固定する工程と、実装基板10の一表面上にバ
ンプ電極8を介在して前記半導体装置1を実装する工程
を備える。
【0057】これにより、実装基板10の一表面上にバ
ンプ電極8を介在して半導体装置1を実装する際、半導
体装置1の平板部材7と放熱フィン部材12との熱膨張
係数の差に起因する熱応力を柔軟層6で吸収することが
できるので、熱膨張係数が大きい金属材、例えば、アル
ミニウム材又は銅材からなる放熱フィン部材を平板部材
7の裏面に固定したままの状態で、実装基板10の一表
面上に半導体装置1を実装できる。
ンプ電極8を介在して半導体装置1を実装する際、半導
体装置1の平板部材7と放熱フィン部材12との熱膨張
係数の差に起因する熱応力を柔軟層6で吸収することが
できるので、熱膨張係数が大きい金属材、例えば、アル
ミニウム材又は銅材からなる放熱フィン部材を平板部材
7の裏面に固定したままの状態で、実装基板10の一表
面上に半導体装置1を実装できる。
【0058】また、平板部材7は半導体チップ3の平面
サイズに比べて大きい平面サイズで形成されているの
で、平板部材7の裏面に、半導体チップ3の平面サイズ
に比べて大きい平面サイズで形成された放熱部材12を
安定した状態で固定することができる。
サイズに比べて大きい平面サイズで形成されているの
で、平板部材7の裏面に、半導体チップ3の平面サイズ
に比べて大きい平面サイズで形成された放熱部材12を
安定した状態で固定することができる。
【0059】なお、図8(断面図)に示すように、配線基
板2と平板部材7との間に平板部材7を支持するための
支持部材14を設けた構造で半導体装置1を構成しても
よい。この場合、平面サイズが小さい半導体チップ3の
裏面に、平面サイズが大きい平板部材7を安定した状態
で取付けることができる。
板2と平板部材7との間に平板部材7を支持するための
支持部材14を設けた構造で半導体装置1を構成しても
よい。この場合、平面サイズが小さい半導体チップ3の
裏面に、平面サイズが大きい平板部材7を安定した状態
で取付けることができる。
【0060】また、図9(断面図)に示すように、平板部
材7の裏面に柔軟層11を介在して放熱フィン部材12
を固定した構造で半導体装置1を構成してもよい。
材7の裏面に柔軟層11を介在して放熱フィン部材12
を固定した構造で半導体装置1を構成してもよい。
【0061】また、図9に示すように、平板部材7と放
熱フィン部材12とを弾性力を有する挟持部材13で挟
持固定した構造で半導体装置1を構成してもよい。この
場合、平板部材7と放熱フィン部材12との固定強度を
増加できるので、搬送時、保管時等における放熱フィン
部材12の脱落を防止できる。
熱フィン部材12とを弾性力を有する挟持部材13で挟
持固定した構造で半導体装置1を構成してもよい。この
場合、平板部材7と放熱フィン部材12との固定強度を
増加できるので、搬送時、保管時等における放熱フィン
部材12の脱落を防止できる。
【0062】また、図9に示すように、配線基板2の裏
面にパッド2Cを配置し、このパッド2Cの表面に、ろ
う材6の融点に比べて低く、バンプ電極8の融点に比べ
て高い融点を有する金属材で形成され、かつバンプ電極
8の高さに比べて同一又はそれよりも低い高さに設定さ
れた支持バンプ15を固着した構造で半導体装置1を構
成してもよい。この場合、実装基板10の一表面上にバ
ンプ電極8を介在して半導体装置1を実装する際、半導
体装置1を支持バンプ15で支持しながらバンプ電極8
を溶融することができるので、平板部材7や放熱フィン
部材12によって半導体装置1の重量が増加していて
も、バンプ電極8が支持バンプ15の高さ以下に押し潰
されることはない。従って、支持バンプ15の高さでバ
ンプ電極8の高さを制御することができる。
面にパッド2Cを配置し、このパッド2Cの表面に、ろ
う材6の融点に比べて低く、バンプ電極8の融点に比べ
て高い融点を有する金属材で形成され、かつバンプ電極
8の高さに比べて同一又はそれよりも低い高さに設定さ
れた支持バンプ15を固着した構造で半導体装置1を構
成してもよい。この場合、実装基板10の一表面上にバ
ンプ電極8を介在して半導体装置1を実装する際、半導
体装置1を支持バンプ15で支持しながらバンプ電極8
を溶融することができるので、平板部材7や放熱フィン
部材12によって半導体装置1の重量が増加していて
も、バンプ電極8が支持バンプ15の高さ以下に押し潰
されることはない。従って、支持バンプ15の高さでバ
ンプ電極8の高さを制御することができる。
【0063】また、半導体装置1の実装プロセスにおい
て、図10(断面図)に示すように、実装基板10に支持
部材16を介して放熱部材12を支持してもよい。この
場合、半導体装置1を実装した後の実装基板10の搬
送、保管及び筐体への実装時における放熱フィン部材1
2の脱落を防止できる。また、放熱フィン部材12の荷
重がバンプ電極8にかかるのを防ぐことができる。これ
により、配線基板2と実装基板10との熱膨張係数の差
によるバンプ電極8のひずみ、更に荷重によるひずみが
加わることを防止し、バンプ電極8の電気的接続信頼度
を確保することができる。
て、図10(断面図)に示すように、実装基板10に支持
部材16を介して放熱部材12を支持してもよい。この
場合、半導体装置1を実装した後の実装基板10の搬
送、保管及び筐体への実装時における放熱フィン部材1
2の脱落を防止できる。また、放熱フィン部材12の荷
重がバンプ電極8にかかるのを防ぐことができる。これ
により、配線基板2と実装基板10との熱膨張係数の差
によるバンプ電極8のひずみ、更に荷重によるひずみが
加わることを防止し、バンプ電極8の電気的接続信頼度
を確保することができる。
【0064】また、半導体装置1の実装プロセスにおい
て、実装基板10の一表面上にバンプ電極8を介在して
半導体装置1を実装し、その後、半導体装置1の平板部
材7の裏面に柔軟層11を介在して放熱フィン部材12
を固定してもよい。この場合、バンプ電極8を溶融する
熱処理時の熱による柔軟層11の劣化を防止できる。
て、実装基板10の一表面上にバンプ電極8を介在して
半導体装置1を実装し、その後、半導体装置1の平板部
材7の裏面に柔軟層11を介在して放熱フィン部材12
を固定してもよい。この場合、バンプ電極8を溶融する
熱処理時の熱による柔軟層11の劣化を防止できる。
【0065】また、半導体装置1の実装プロセスにおい
て、平板部材7と放熱フィン部材12とを挟持部材13
で挟持固定する工程は省略してもよい。
て、平板部材7と放熱フィン部材12とを挟持部材13
で挟持固定する工程は省略してもよい。
【0066】また、図11(断面図)に示すように、複数
の半導体装置1毎に放熱フィン部材12を設けてもよ
い。
の半導体装置1毎に放熱フィン部材12を設けてもよ
い。
【0067】また、図12(断面図)に示すように、平板
部材7及び放熱フィン部材12において、一方に溝17
Aを設け、他方に溝17Aと嵌合する突起17Bを設け
た構成にしてもよい。この場合、平板部材7と放熱フィ
ン部材12との位置決めを容易に行うことができる。
部材7及び放熱フィン部材12において、一方に溝17
Aを設け、他方に溝17Aと嵌合する突起17Bを設け
た構成にしてもよい。この場合、平板部材7と放熱フィ
ン部材12との位置決めを容易に行うことができる。
【0068】また、同図に示すように、溝17A、突起
17Bの夫々をあり溝形状で構成してもよい。この場
合、搬送時、保管時等における放熱フィン部材12の脱
落を防止できる。
17Bの夫々をあり溝形状で構成してもよい。この場
合、搬送時、保管時等における放熱フィン部材12の脱
落を防止できる。
【0069】以上、本発明者によってなされた発明を、
前記実施形態に基づき具体的に説明したが、本発明は、
前記実施形態に限定されるものではなく、その要旨を逸
脱しない範囲において種々変更可能であることは勿論で
ある。
前記実施形態に基づき具体的に説明したが、本発明は、
前記実施形態に限定されるものではなく、その要旨を逸
脱しない範囲において種々変更可能であることは勿論で
ある。
【0070】
【発明の効果】本願において開示される発明のうち代表
的なものによって得られる効果を簡単に説明すれば、下
記のとおりである。
的なものによって得られる効果を簡単に説明すれば、下
記のとおりである。
【0071】配線基板の一表面上にバンプ電極を介在し
て半導体チップが実装され、前記配線基板の一表面と前
記半導体チップの主面との間の間隙領域に樹脂が充填さ
れたパッケージ構造を有する半導体装置の放熱効率を高
めることができる。
て半導体チップが実装され、前記配線基板の一表面と前
記半導体チップの主面との間の間隙領域に樹脂が充填さ
れたパッケージ構造を有する半導体装置の放熱効率を高
めることができる。
【図1】本発明の一実施形態である半導体装置の概略構
成を示す断面図である。
成を示す断面図である。
【図2】前記半導体装置の製造方法を説明するための断
面図である。
面図である。
【図3】前記半導体装置の製造方法を説明するための断
面図である。
面図である。
【図4】前記半導体装置の製造方法を説明するための断
面図である。
面図である。
【図5】前記半導体装置の製造方法を説明するための断
面図である。
面図である。
【図6】前記半導体装置の実装方法を説明するための断
面図である。
面図である。
【図7】前記半導体装置の実装方法を説明するための断
面図である。
面図である。
【図8】本発明の実施形態の第1変形例である半導体装
置の断面図である。
置の断面図である。
【図9】本発明の実施形態の第2変形例である半導体装
置の断面図である。
置の断面図である。
【図10】本発明の実施形態の第3変形例である半導体
装置の実装状態の断面図である。
装置の実装状態の断面図である。
【図11】本発明の実施形態の第4変形例である半導体
装置の実装状態の断面図である。
装置の実装状態の断面図である。
【図12】本発明の実施形態の第5変形例である半導体
装置の断面図である。
装置の断面図である。
1…半導体装置、2…配線基板、3…半導体チップ、4
…バンプ電極、5…樹脂、6…ろう材、7…平板部材、
8…バンプ電極、10…実装基板、11…柔軟層、12
…放熱フィン部材、13…挟持部材、14…支持部材、
15…支持バンプ、16…支持部材。17A…溝、17
B…突起。
…バンプ電極、5…樹脂、6…ろう材、7…平板部材、
8…バンプ電極、10…実装基板、11…柔軟層、12
…放熱フィン部材、13…挟持部材、14…支持部材、
15…支持バンプ、16…支持部材。17A…溝、17
B…突起。
───────────────────────────────────────────────────── フロントページの続き (72)発明者 林田 哲哉 東京都青梅市今井2326番地 株式会社日立 製作所デバイス開発センタ内
Claims (10)
- 【請求項1】 配線基板の一表面上にバンプ電極を介在
して半導体チップが実装され、前記配線基板の一表面と
前記半導体チップの主面との間の間隙領域に樹脂が充填
されたパッケージ構造を有する半導体装置において、前
記半導体チップの主面と対向するその裏面上に、前記半
導体チップの平面サイズに比べて大きい平面サイズで形
成され、かつ窒化アルミニウム材で形成された平板部材
が配置され、前記半導体チップの裏面にこの半導体チッ
プの裏面と対向する前記平板部材の一表面の固着領域が
ろう材を介在して固着されていることを特徴とする半導
体装置。 - 【請求項2】 請求項1に記載の半導体装置において、
前記半導体チップの裏面及び前記平板部材の一表面の固
着領域に、前記ろう材に対して濡れ性を有するメタライ
ズ層が形成されていることを特徴とする半導体装置。 - 【請求項3】 請求項1又は請求項2に記載の半導体装
置において、前記ろう材は、前記バンプ電極の融点に比
べて低い融点を有する金属材で形成されていることを特
徴とする半導体装置。 - 【請求項4】 請求項1乃至請求項3のうちいずれか1
項に記載の半導体装置において、前記配線基板の一表面
と対向するその裏面に電極パッドが配置され、この電極
パッドの表面に前記ろう材の融点に比べて低い融点を有
する金属材で形成されたバンプ電極が固着されているこ
とを特徴とする半導体装置。 - 【請求項5】 請求項4に記載の半導体装置において、
前記配線基板の裏面にパッドが配置され、このパッドの
表面に、前記ろう材の融点に比べて低く、前記配線基板
の裏面のバンプ電極の融点に比べて高い融点を有する金
属材で形成され、かつ前記配線基板の裏面のバンプ電極
の高さに比べて同一又はそれよりも若干低い高さに設定
された支持バンプが固着されていることを特徴とする半
導体装置。 - 【請求項6】 請求項1乃至請求項5のうちいずれか1
項に記載の半導体装置において、前記平板部材の一表面
と対向するその裏面に柔軟層を介在して放熱フィン部材
が固定されていることを特徴とする半導体装置。 - 【請求項7】 請求項6に記載の半導体装置において、
前記平板部材と前記放熱フィン部材とが、弾性力を有す
る挾持部材で挟持固定されていることを特徴とする半導
体装置。 - 【請求項8】 実装基板の一表面上に実装される半導体
装置の実装方法において、配線基板の一表面上に第1バ
ンプ電極を介在して半導体チップが実装され、前記配線
基板の一表面と前記半導体チップの主面との間の間隙領
域に樹脂が充填されたパッケージ構造を有し、更に、前
記半導体チップの主面と対向するその裏面上に、前記半
導体チップの平面サイズに比べて大きい平面サイズで形
成され、かつ窒化アルミニウム材で形成された平板部材
が配置され、前記半導体チップの裏面にこの半導体チッ
プの裏面と対向する前記平板部材の一表面の固着領域が
ろう材を介在して固着された半導体装置を準備する工程
と、前記平板部材の一表面と対向するその裏面上に柔軟
層を介在して放熱フィン部材を固定する工程と、実装基
板の一表面上に第2バンプ電極を介在して前記半導体装
置を実装する工程を備えたことを特徴とする半導体装置
の実装方法。 - 【請求項9】 配線基板の一表面上に第1バンプ電極を
介在して半導体チップが実装され、前記配線基板の一表
面と前記半導体チップの主面との間の間隙領域に樹脂が
充填されたパッケージ構造を有し、更に、窒化アルミニ
ウム材で形成され、前記半導体チップの平面サイズに比
べて大きい平面サイズで形成され、一表面の固着領域が
前記半導体チップの主面と対向するその裏面にろう材を
介在して固着された平板部材を有する半導体装置が実装
基板の一表面上に第2バンプ電極を介在して実装され、
前記平板部材の一表面と対向するその裏面に柔軟層を介
在して放熱フィン部材が固定されていることを特徴とす
る実装構造体。 - 【請求項10】 配線基板の一表面上に第1バンプ電極
を介在して半導体チップが実装され、前記配線基板の一
表面と前記半導体チップの主面との間の間隙領域に樹脂
が充填されたパッケージ構造を有し、更に、窒化アルミ
ニウム材で形成され、前記半導体チップの平面サイズに
比べて大きい平面サイズで形成され、一表面の固着領域
が前記半導体チップの主面と対向するその裏面にろう材
を介在して固着された平板部材を有する半導体装置が実
装基板の一表面上に第2バンプ電極を介在して実装さ
れ、かつ前記平板部材の一表面と対向するその裏面に、
前記実装基板に支持部材を介して支持された放熱フィン
部材の一表面が柔軟層を介在して連結されていることを
特徴とする実装構造体。
Priority Applications (5)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP8124156A JPH09306954A (ja) | 1996-05-20 | 1996-05-20 | 半導体装置及びその実装方法並びに実装構造体 |
TW086105474A TW366575B (en) | 1996-05-20 | 1997-04-26 | Semiconductor device and the manufacturing method |
KR1019970017649A KR970077570A (ko) | 1996-05-20 | 1997-05-08 | 반도체장치 및 그 제조방법 |
US08/858,695 US6111322A (en) | 1996-05-20 | 1997-05-19 | Semiconductor device and manufacturing method thereof |
US09/543,769 US6380621B1 (en) | 1996-05-20 | 2000-04-05 | Semiconductor device and manufacturing method thereof |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP8124156A JPH09306954A (ja) | 1996-05-20 | 1996-05-20 | 半導体装置及びその実装方法並びに実装構造体 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH09306954A true JPH09306954A (ja) | 1997-11-28 |
Family
ID=14878333
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP8124156A Pending JPH09306954A (ja) | 1996-05-20 | 1996-05-20 | 半導体装置及びその実装方法並びに実装構造体 |
Country Status (4)
Country | Link |
---|---|
US (2) | US6111322A (ja) |
JP (1) | JPH09306954A (ja) |
KR (1) | KR970077570A (ja) |
TW (1) | TW366575B (ja) |
Cited By (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
FR2795285A1 (fr) * | 1999-06-17 | 2000-12-22 | Nec Corp | Structure de montage d'un dispositif a circuit integer ayant un effet eleve d'amortissement de contrainte et une fiabilite elevee de connexion par soudure, et procede de montage de ce dernier |
US6574106B2 (en) | 1998-06-10 | 2003-06-03 | Nec Corporation | Mounting structure of semiconductor device |
JP2007095932A (ja) * | 2005-09-28 | 2007-04-12 | Sharp Corp | 半導体装置、その製造方法および電子機器 |
JP2010528472A (ja) * | 2007-05-25 | 2010-08-19 | エルエスアイ コーポレーション | 熱性能の向上のためにフタをはんだ付けされた集積回路パッケージ |
JP2010283085A (ja) * | 2009-06-03 | 2010-12-16 | Toshiba Corp | 電子機器 |
JP2015511070A (ja) * | 2012-03-30 | 2015-04-13 | レイセオン カンパニー | マルチチャネルフリップチップベースのパネルアレイ回路の伝導冷却 |
Families Citing this family (53)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3849277B2 (ja) * | 1998-01-26 | 2006-11-22 | ソニー株式会社 | 半導体装置 |
JP4311774B2 (ja) * | 1998-03-11 | 2009-08-12 | 富士通株式会社 | 電子部品パッケージおよびプリント配線板 |
JP3278055B2 (ja) * | 1998-06-30 | 2002-04-30 | セイコーインスツルメンツ株式会社 | 電子回路装置 |
US6461891B1 (en) | 1999-09-13 | 2002-10-08 | Intel Corporation | Method of constructing an electronic assembly having an indium thermal couple and an electronic assembly having an indium thermal couple |
US6291884B1 (en) * | 1999-11-09 | 2001-09-18 | Amkor Technology, Inc. | Chip-size semiconductor packages |
US6770513B1 (en) * | 1999-12-16 | 2004-08-03 | National Semiconductor Corporation | Thermally enhanced flip chip packaging arrangement |
US6900534B2 (en) * | 2000-03-16 | 2005-05-31 | Texas Instruments Incorporated | Direct attach chip scale package |
JP2001339012A (ja) * | 2000-05-30 | 2001-12-07 | Nec Kyushu Ltd | 半導体装置およびその製造方法 |
TW490830B (en) * | 2001-03-12 | 2002-06-11 | Siliconware Precision Industries Co Ltd | Heat sink with a shrinking mechanism and semiconductor device having the heat sink |
US6808959B2 (en) | 2001-05-24 | 2004-10-26 | Nec Electronics Corporation | Semiconductor device having reinforced coupling between solder balls and substrate |
JP4105409B2 (ja) * | 2001-06-22 | 2008-06-25 | 株式会社ルネサステクノロジ | マルチチップモジュールの製造方法 |
US6504242B1 (en) * | 2001-11-15 | 2003-01-07 | Intel Corporation | Electronic assembly having a wetting layer on a thermally conductive heat spreader |
JP4206915B2 (ja) * | 2002-12-27 | 2009-01-14 | 三菱マテリアル株式会社 | パワーモジュール用基板 |
US20040134680A1 (en) * | 2003-01-09 | 2004-07-15 | Xiang Dai | Use of perimeter stops to support solder interconnects between integrated circuit assembly components |
US7154174B2 (en) * | 2003-02-27 | 2006-12-26 | Power-One, Inc. | Power supply packaging system |
US7129577B2 (en) * | 2003-02-27 | 2006-10-31 | Power-One, Inc. | Power supply packaging system |
US7416922B2 (en) * | 2003-03-31 | 2008-08-26 | Intel Corporation | Heat sink with preattached thermal interface material and method of making same |
WO2004093187A1 (ja) * | 2003-04-16 | 2004-10-28 | Fujitsu Limited | 電子部品パッケージ、電子部品パッケージ組立体およびプリント基板ユニット |
US7030485B2 (en) * | 2003-06-26 | 2006-04-18 | Intel Corporation | Thermal interface structure with integrated liquid cooling and methods |
US6987671B2 (en) * | 2003-06-26 | 2006-01-17 | Intel Corporation | Composite thermal interface devices and methods for integrated circuit heat transfer |
KR20050001930A (ko) * | 2003-06-28 | 2005-01-07 | 삼성전기주식회사 | 고밀도 칩 스케일 패키지 및 그 제조 방법 |
US7527090B2 (en) * | 2003-06-30 | 2009-05-05 | Intel Corporation | Heat dissipating device with preselected designed interface for thermal interface materials |
TWI234209B (en) * | 2003-10-31 | 2005-06-11 | Advanced Semiconductor Eng | BGA semiconductor device with protection of component on ball-planting surface |
US8053159B2 (en) | 2003-11-18 | 2011-11-08 | Honeywell International Inc. | Antireflective coatings for via fill and photolithography applications and methods of preparation thereof |
US7692287B2 (en) * | 2004-05-21 | 2010-04-06 | Nec Corporation | Semiconductor device and wiring board |
US7362580B2 (en) * | 2004-06-18 | 2008-04-22 | Intel Corporation | Electronic assembly having an indium wetting layer on a thermally conductive body |
US7364063B2 (en) * | 2004-08-09 | 2008-04-29 | Intel Corporation | Thermally coupling an integrated heat spreader to a heat sink base |
KR100702969B1 (ko) * | 2005-04-19 | 2007-04-03 | 삼성전자주식회사 | 더미 솔더 볼을 갖는 bga형 반도체 칩 패키지의 기판 실장 구조 |
JP2007005670A (ja) * | 2005-06-27 | 2007-01-11 | Fujitsu Ltd | 電子部品パッケージおよび接合組立体 |
US7422448B2 (en) * | 2005-07-28 | 2008-09-09 | Delphi Technologies, Inc. | Surface mount connector |
US7416923B2 (en) * | 2005-12-09 | 2008-08-26 | International Business Machines Corporation | Underfill film having thermally conductive sheet |
JP4764159B2 (ja) * | 2005-12-20 | 2011-08-31 | 富士通セミコンダクター株式会社 | 半導体装置 |
TWI328736B (en) * | 2006-03-17 | 2010-08-11 | Matac Internat Co | Radiation structure for processors |
US8952524B2 (en) * | 2006-04-28 | 2015-02-10 | Juniper Networks, Inc. | Re-workable heat sink attachment assembly |
US20080007915A1 (en) * | 2006-07-06 | 2008-01-10 | Chao-Chuan Chen | Heat sink device for a heat generating element |
TWI355048B (en) * | 2006-12-13 | 2011-12-21 | Siliconware Precision Industries Co Ltd | Heat-dissipation semiconductor package and heat-di |
TW200830488A (en) * | 2007-01-10 | 2008-07-16 | Siliconware Precision Industries Co Ltd | Heat-dissipating semiconductor package |
US8642246B2 (en) | 2007-02-26 | 2014-02-04 | Honeywell International Inc. | Compositions, coatings and films for tri-layer patterning applications and methods of preparation thereof |
JP2009147058A (ja) * | 2007-12-13 | 2009-07-02 | Panasonic Corp | インピーダンス整合フィルタ、および、実装基板 |
US8400539B2 (en) | 2008-11-12 | 2013-03-19 | Bae Systems Information And Electronic Systems Integration Inc. | High density composite focal plane array |
US8557877B2 (en) | 2009-06-10 | 2013-10-15 | Honeywell International Inc. | Anti-reflective coatings for optically transparent substrates |
US8362609B1 (en) | 2009-10-27 | 2013-01-29 | Xilinx, Inc. | Integrated circuit package and method of forming an integrated circuit package |
JP5480722B2 (ja) * | 2010-05-28 | 2014-04-23 | 新光電気工業株式会社 | 放熱用部品及びそれを備えた半導体パッケージ |
US8810028B1 (en) | 2010-06-30 | 2014-08-19 | Xilinx, Inc. | Integrated circuit packaging devices and methods |
US9198284B2 (en) * | 2010-08-06 | 2015-11-24 | Panasonic Intellectual Property Management Co., Ltd. | Circuit board and method for manufacturing same |
KR20120053332A (ko) * | 2010-11-17 | 2012-05-25 | 삼성전자주식회사 | 반도체 패키지 및 이의 제조 방법 |
US8864898B2 (en) | 2011-05-31 | 2014-10-21 | Honeywell International Inc. | Coating formulations for optical elements |
US9480185B2 (en) | 2014-01-08 | 2016-10-25 | Enphase Energy, Inc. | Double insulated heat spreader |
EP3194502A4 (en) | 2015-04-13 | 2018-05-16 | Honeywell International Inc. | Polysiloxane formulations and coatings for optoelectronic applications |
JP6711098B2 (ja) | 2016-04-15 | 2020-06-17 | オムロン株式会社 | 半導体装置の放熱構造 |
CN107801320A (zh) * | 2017-09-22 | 2018-03-13 | 郑州云海信息技术有限公司 | 一种组件与印刷电路板之间的封装结构及其制造方法 |
US11177192B2 (en) * | 2018-09-27 | 2021-11-16 | Taiwan Semiconductor Manufacturing Company, Ltd. | Semiconductor device including heat dissipation structure and fabricating method of the same |
WO2023141052A1 (en) * | 2022-01-19 | 2023-07-27 | Tesla, Inc. | A method for applying a cooling solution to one or more integrated circuit components and assemble for integrated circuit cooling |
Family Cites Families (18)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US3871015A (en) * | 1969-08-14 | 1975-03-11 | Ibm | Flip chip module with non-uniform connector joints |
US4561011A (en) * | 1982-10-05 | 1985-12-24 | Mitsubishi Denki Kabushiki Kaisha | Dimensionally stable semiconductor device |
JPS62136865A (ja) * | 1985-12-11 | 1987-06-19 | Hitachi Ltd | モジユ−ル実装構造 |
US4914551A (en) * | 1988-07-13 | 1990-04-03 | International Business Machines Corporation | Electronic package with heat spreader member |
JP2821229B2 (ja) * | 1990-03-30 | 1998-11-05 | 株式会社日立製作所 | 電子回路装置 |
US5866951A (en) * | 1990-10-12 | 1999-02-02 | Robert Bosch Gmbh | Hybrid circuit with an electrically conductive adhesive |
JPH04192552A (ja) * | 1990-11-27 | 1992-07-10 | Nec Corp | 半導体素子用パッケージ |
EP0509825A3 (en) * | 1991-04-16 | 1993-11-24 | Nec Corp | Package structure for semiconductor device |
JPH0786471A (ja) * | 1993-09-20 | 1995-03-31 | Hitachi Ltd | 半導体モジュ−ル |
JPH07307410A (ja) * | 1994-05-16 | 1995-11-21 | Hitachi Ltd | 半導体装置 |
JPH0846098A (ja) * | 1994-07-22 | 1996-02-16 | Internatl Business Mach Corp <Ibm> | 直接的熱伝導路を形成する装置および方法 |
US5585671A (en) * | 1994-10-07 | 1996-12-17 | Nagesh; Voddarahalli K. | Reliable low thermal resistance package for high power flip clip ICs |
US5616958A (en) * | 1995-01-25 | 1997-04-01 | International Business Machines Corporation | Electronic package |
US5598036A (en) * | 1995-06-15 | 1997-01-28 | Industrial Technology Research Institute | Ball grid array having reduced mechanical stress |
US5745344A (en) * | 1995-11-06 | 1998-04-28 | International Business Machines Corporation | Heat dissipation apparatus and method for attaching a heat dissipation apparatus to an electronic device |
US6225695B1 (en) * | 1997-06-05 | 2001-05-01 | Lsi Logic Corporation | Grooved semiconductor die for flip-chip heat sink attachment |
US6219543B1 (en) * | 1998-06-03 | 2001-04-17 | Howard M. Myers | Energy detection device |
TW411595B (en) * | 1999-03-20 | 2000-11-11 | Siliconware Precision Industries Co Ltd | Heat structure for semiconductor package device |
-
1996
- 1996-05-20 JP JP8124156A patent/JPH09306954A/ja active Pending
-
1997
- 1997-04-26 TW TW086105474A patent/TW366575B/zh not_active IP Right Cessation
- 1997-05-08 KR KR1019970017649A patent/KR970077570A/ko not_active Application Discontinuation
- 1997-05-19 US US08/858,695 patent/US6111322A/en not_active Expired - Lifetime
-
2000
- 2000-04-05 US US09/543,769 patent/US6380621B1/en not_active Expired - Fee Related
Cited By (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6574106B2 (en) | 1998-06-10 | 2003-06-03 | Nec Corporation | Mounting structure of semiconductor device |
FR2795285A1 (fr) * | 1999-06-17 | 2000-12-22 | Nec Corp | Structure de montage d'un dispositif a circuit integer ayant un effet eleve d'amortissement de contrainte et une fiabilite elevee de connexion par soudure, et procede de montage de ce dernier |
JP2007095932A (ja) * | 2005-09-28 | 2007-04-12 | Sharp Corp | 半導体装置、その製造方法および電子機器 |
JP2010528472A (ja) * | 2007-05-25 | 2010-08-19 | エルエスアイ コーポレーション | 熱性能の向上のためにフタをはんだ付けされた集積回路パッケージ |
JP2010283085A (ja) * | 2009-06-03 | 2010-12-16 | Toshiba Corp | 電子機器 |
JP4676012B2 (ja) * | 2009-06-03 | 2011-04-27 | 株式会社東芝 | 電子機器 |
US8072759B2 (en) | 2009-06-03 | 2011-12-06 | Kabushiki Kaisha Toshiba | Electronic device |
JP2015511070A (ja) * | 2012-03-30 | 2015-04-13 | レイセオン カンパニー | マルチチャネルフリップチップベースのパネルアレイ回路の伝導冷却 |
Also Published As
Publication number | Publication date |
---|---|
TW366575B (en) | 1999-08-11 |
US6380621B1 (en) | 2002-04-30 |
KR970077570A (ko) | 1997-12-12 |
US6111322A (en) | 2000-08-29 |
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