JPH079953B2 - 半導体装置の製造方法 - Google Patents
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Description
【発明の詳細な説明】 〔発明の目的〕 (産業上の利用分野) 本発明は、特にLSIのように端子数が多ピンの半導体装
置で、プリント基板等の配線基板の上に配線パターンを
形成し、この配線基板をステムの上面に重合させるとと
もに、この周囲及び上方を金属製シェルで覆った半導体
装置の改良に関する。
置で、プリント基板等の配線基板の上に配線パターンを
形成し、この配線基板をステムの上面に重合させるとと
もに、この周囲及び上方を金属製シェルで覆った半導体
装置の改良に関する。
(従来の技術) ピン挿入型半導体パッケージとしては、その代表がDIP
(デュアル・インライン・パッケージ)であるが、この
DIPではピン数に限度があり、せいぜい60ピン程度が現
実的で、これ以上は一般に実現不可能であった。これ以
上の多ピンに対応するためには、パッケージの下面から
剣山状に多数のピンを突出させた、ピン挿入型のPGA
(ピン・グリッド・アレイ)が一般的に用いられてい
た。
(デュアル・インライン・パッケージ)であるが、この
DIPではピン数に限度があり、せいぜい60ピン程度が現
実的で、これ以上は一般に実現不可能であった。これ以
上の多ピンに対応するためには、パッケージの下面から
剣山状に多数のピンを突出させた、ピン挿入型のPGA
(ピン・グリッド・アレイ)が一般的に用いられてい
た。
このPAGには、セラミック基板にメタライズを施し、多
層に積層して構成した、いわゆるセラミック形PGAや、
このセラミック型PGAの価格の低減を図るために、この
基板部分の配線をプリント基板に置換えた、いわゆるプ
ラスチック形PGAがあった。
層に積層して構成した、いわゆるセラミック形PGAや、
このセラミック型PGAの価格の低減を図るために、この
基板部分の配線をプリント基板に置換えた、いわゆるプ
ラスチック形PGAがあった。
しかしながら、上記セラミック形PGAは、一般にかなり
高価となってしまい、またプラスチック形PGAでは、半
導体チップやプリント基板等の配線基板の完全な気密封
止が一般に困難で、セラミック形PGAに比較すると信頼
性に劣るといった種々の問題点があった。
高価となってしまい、またプラスチック形PGAでは、半
導体チップやプリント基板等の配線基板の完全な気密封
止が一般に困難で、セラミック形PGAに比較すると信頼
性に劣るといった種々の問題点があった。
そこで出願人は、上記セラミック形PGAやプラスチック
形PGAの有する欠点を解消するため、特願昭61−280225
号として、第6図乃至第8図に示す半導体装置を提案し
た。
形PGAの有する欠点を解消するため、特願昭61−280225
号として、第6図乃至第8図に示す半導体装置を提案し
た。
即ち、金属製のステム1のほぼ中央に放熱部材2を配置
し、この放熱部材2の上面に半導体チップ3をマウント
するとともに、この半導体チップ3の周囲において、上
面に中央部の起端から放射状に外方に延びる所定形状の
配線パターン4を形成したプリント基板等の配線基板5
を上記ステム1の上面に重合させ、この配線パターン4
の中央部の起端と半導体チップ3のボンディングパッド
とをアルミニウム等のボンディングワイヤ6で電気的に
接続する。そして、上記ステム1及び配線基板5の両者
を重合した際に互いに連通する位置に夫々穿設した透孔
1a及び5a内にリードピン7の上端を挿通させ、このステ
ム1の透孔1aとリードピン7との間にガラス等の絶縁部
材8を介在させるとともに、配線基板5の上面におい
て、半田等の接合部材9を介して、上記配線パターン4
とリードピン7とを電気的に接続してこのリードピン7
を配線基板5に接合させ、更に上記半導体チップ2の上
方と配線基板5の上方及びこの周囲を金属製シェル10で
覆って、これらを気密封止したものである。
し、この放熱部材2の上面に半導体チップ3をマウント
するとともに、この半導体チップ3の周囲において、上
面に中央部の起端から放射状に外方に延びる所定形状の
配線パターン4を形成したプリント基板等の配線基板5
を上記ステム1の上面に重合させ、この配線パターン4
の中央部の起端と半導体チップ3のボンディングパッド
とをアルミニウム等のボンディングワイヤ6で電気的に
接続する。そして、上記ステム1及び配線基板5の両者
を重合した際に互いに連通する位置に夫々穿設した透孔
1a及び5a内にリードピン7の上端を挿通させ、このステ
ム1の透孔1aとリードピン7との間にガラス等の絶縁部
材8を介在させるとともに、配線基板5の上面におい
て、半田等の接合部材9を介して、上記配線パターン4
とリードピン7とを電気的に接続してこのリードピン7
を配線基板5に接合させ、更に上記半導体チップ2の上
方と配線基板5の上方及びこの周囲を金属製シェル10で
覆って、これらを気密封止したものである。
この半導体装置の場合、第10図に詳細に示すように、上
記配線基板5の上面に形成した配線パターン4の外部終
端は、配線基板5の外周端面まで延びていた。
記配線基板5の上面に形成した配線パターン4の外部終
端は、配線基板5の外周端面まで延びていた。
これは、配線基板5の配線パターン4を銅により形成し
た場合で、この起端にアルミニウム等のボンディングワ
イヤ6を接続するためには、この配線パターン4の起端
に金メッキ処理を施して、このボンディングワイヤ6と
の接合の安定性を図る必要があるためである。
た場合で、この起端にアルミニウム等のボンディングワ
イヤ6を接続するためには、この配線パターン4の起端
に金メッキ処理を施して、このボンディングワイヤ6と
の接合の安定性を図る必要があるためである。
即ち、第9図に示すように、全ての配線パターン5の外
部終端を一回り大きくした配線基板5の周囲にパターニ
ング配線層11まで引き出し、この配線層11を介して全て
の配線パターン4を電気的に導通させ電気的にショート
させることによって金メッキ処理を施し、このメッキ処
理後、第10図に示すように、配線層11部分を切除して配
線基板5を構成する必要があった。
部終端を一回り大きくした配線基板5の周囲にパターニ
ング配線層11まで引き出し、この配線層11を介して全て
の配線パターン4を電気的に導通させ電気的にショート
させることによって金メッキ処理を施し、このメッキ処
理後、第10図に示すように、配線層11部分を切除して配
線基板5を構成する必要があった。
(発明が解決しようとする課題) しかしながら、配線基板5の外周端部と金属製シェル10
の立上がり部内周面との距離tを十分大きく取れる場合
には別段問題がないが、半導体装置の小形化の要請によ
り、この距離tをできるだけ小さくすることが望まし
く、この要請に答えるべくこの距離tを小さくしようと
すると、製造上の問題で配線パターン4の外部終端と金
属製シェル10の立上がり部内周面との間で接触が起き
て、配線パターン4,4間で電気的にショートし易くなっ
てしまい、この電気的なショートを確実に防止するため
には、勢いこの距離tを大きくして、半導体装置全体が
大形化してしまう問題点があることが解った。
の立上がり部内周面との距離tを十分大きく取れる場合
には別段問題がないが、半導体装置の小形化の要請によ
り、この距離tをできるだけ小さくすることが望まし
く、この要請に答えるべくこの距離tを小さくしようと
すると、製造上の問題で配線パターン4の外部終端と金
属製シェル10の立上がり部内周面との間で接触が起き
て、配線パターン4,4間で電気的にショートし易くなっ
てしまい、この電気的なショートを確実に防止するため
には、勢いこの距離tを大きくして、半導体装置全体が
大形化してしまう問題点があることが解った。
本発明は上記に鑑み、配線基板の上面に形成した配線パ
ターンの中央部の起端に金等のメッキ処理を施すことが
でき、しかも配線基板の外周端部と金属製シェルの立上
がり部内周面との距離をできるだけ小さく、即ちゼロに
しても配線パターン間で電気的ショートが発生してしま
うことがないものを提供することを目的とする。
ターンの中央部の起端に金等のメッキ処理を施すことが
でき、しかも配線基板の外周端部と金属製シェルの立上
がり部内周面との距離をできるだけ小さく、即ちゼロに
しても配線パターン間で電気的ショートが発生してしま
うことがないものを提供することを目的とする。
(課題を解決するための手段) 上記目的を達成するため、本発明における半導体装置
は、上面に中央部の起端から放射状に外方に延びる配線
をパターニングした配線基板の下面にステムを重合さ
せ、この配線基板及びステムに互いに連通するよう配置
して穿設した透孔内にリードピンの上部を挿通させ、こ
のリードピンを上記配線基板の上面において接合部材を
介して該配線基板の配線パターンに接合するとともに、
上記配線基板の周囲及びこの上方を金属製シェルで覆っ
た半導体装置の製造方法において、 上記配線基板の上面に放射状に中央部から延びる配線パ
ターンを形成し、この配線パターンの外部終端が該配線
基板に穿設した上記リードピンを挿通させる透孔の上部
付近までに止まり上記配線基板の周囲まで至らないよう
にし、 放射状に中央部から延びる上記配線パターンの中央部終
端を互いに電気的に導通させることによって上記配線パ
ターンの金属メッキ処理を施し、 この金属メッキ処理の後、上記配線基板の中央部を所定
の寸法に従って打ち抜いて取り除き、打ち抜かれた上記
配線基板の中央部に半導体チップを装着することを特徴
とする。
は、上面に中央部の起端から放射状に外方に延びる配線
をパターニングした配線基板の下面にステムを重合さ
せ、この配線基板及びステムに互いに連通するよう配置
して穿設した透孔内にリードピンの上部を挿通させ、こ
のリードピンを上記配線基板の上面において接合部材を
介して該配線基板の配線パターンに接合するとともに、
上記配線基板の周囲及びこの上方を金属製シェルで覆っ
た半導体装置の製造方法において、 上記配線基板の上面に放射状に中央部から延びる配線パ
ターンを形成し、この配線パターンの外部終端が該配線
基板に穿設した上記リードピンを挿通させる透孔の上部
付近までに止まり上記配線基板の周囲まで至らないよう
にし、 放射状に中央部から延びる上記配線パターンの中央部終
端を互いに電気的に導通させることによって上記配線パ
ターンの金属メッキ処理を施し、 この金属メッキ処理の後、上記配線基板の中央部を所定
の寸法に従って打ち抜いて取り除き、打ち抜かれた上記
配線基板の中央部に半導体チップを装着することを特徴
とする。
(作用) 上記のように構成した本発明によれば、配線基板の上面
に形成した中央部の起端から放射状に外方に延びる配線
パターンの外部終端は、この配線基板に穿設したリード
ピンを挿通させ穿孔の上部付近であるため、この外部終
端が配線基板の外周端面から露出してしまうことなく、
従って配線基板の外周端部と金属製シェルの立上がり部
内周面との距離を最少、即ちゼロにしても配線パターン
間でショートしてしまうおそれを全くなくして、半導体
装置のより小形化を図ることができる。
に形成した中央部の起端から放射状に外方に延びる配線
パターンの外部終端は、この配線基板に穿設したリード
ピンを挿通させ穿孔の上部付近であるため、この外部終
端が配線基板の外周端面から露出してしまうことなく、
従って配線基板の外周端部と金属製シェルの立上がり部
内周面との距離を最少、即ちゼロにしても配線パターン
間でショートしてしまうおそれを全くなくして、半導体
装置のより小形化を図ることができる。
また、配線パターンの全ての起端を、配線基板の中央部
に設けた配線層に連通させ、この状態で配線パターンの
起端部に金等のメッキを施し、このメッキ終了後、配線
基板の中央部の配線層を打つ抜くこと等により、配線パ
ターンの起端部のメッキ処理に対処するようにすること
ができる。
に設けた配線層に連通させ、この状態で配線パターンの
起端部に金等のメッキを施し、このメッキ終了後、配線
基板の中央部の配線層を打つ抜くこと等により、配線パ
ターンの起端部のメッキ処理に対処するようにすること
ができる。
(実施例) 以下、本発明の一実施例について第1図乃至第5図に基
づいて説明する。
づいて説明する。
金属製のステム1のほぼ中央には、放熱部材2が配置さ
れ、この放熱部材2の上面に半導体チップ3がマウント
されているとともに、この半導体チップ3の周囲におい
て、上面に中央部の起端から放射状に外方に延びる所定
形状の配線パターン4が形成された配線基板5が上記ス
テム1の上面に重合され、この配線パターン4の中央部
の起端に半導体チップ3のボンディングパッドとがアル
ミニウム等のボンディングワイヤ6で電気的に接続され
ている。そして、上記ステム1及び配線基板5の両者を
重合した際に互いに連通する位置に夫々穿設されている
透孔1a及び5a内にリードピン7の上端が挿通され、この
ステム1の透孔1aとリードピン7との間にガラス等の絶
縁部材8が介在されているとも、配線基板5の上面にお
いて、半田等の接合部材9を介して、上記配線パターン
3の外部終端とリードピン7とが電気的に接続されてリ
ードピン7が配線基板5に接合され、更に上記半導体チ
ップ3の上方と配線基板5の上方及びこの周囲は金属製
シェル10で覆われて、気密的に封止されている。
れ、この放熱部材2の上面に半導体チップ3がマウント
されているとともに、この半導体チップ3の周囲におい
て、上面に中央部の起端から放射状に外方に延びる所定
形状の配線パターン4が形成された配線基板5が上記ス
テム1の上面に重合され、この配線パターン4の中央部
の起端に半導体チップ3のボンディングパッドとがアル
ミニウム等のボンディングワイヤ6で電気的に接続され
ている。そして、上記ステム1及び配線基板5の両者を
重合した際に互いに連通する位置に夫々穿設されている
透孔1a及び5a内にリードピン7の上端が挿通され、この
ステム1の透孔1aとリードピン7との間にガラス等の絶
縁部材8が介在されているとも、配線基板5の上面にお
いて、半田等の接合部材9を介して、上記配線パターン
3の外部終端とリードピン7とが電気的に接続されてリ
ードピン7が配線基板5に接合され、更に上記半導体チ
ップ3の上方と配線基板5の上方及びこの周囲は金属製
シェル10で覆われて、気密的に封止されている。
上記配線基板5の上面に、中央部の起端から外方に延び
て形成した配線パターン4の外部終端は、第5図に詳細
に示すように、配線基板5に穿設した上記リードピン7
の上部を挿通させる穿設5aの上部付近までであり、これ
によって、配線パターン4の外部終端が配線基板5の外
周端面に露出してしまうことが防止されている。
て形成した配線パターン4の外部終端は、第5図に詳細
に示すように、配線基板5に穿設した上記リードピン7
の上部を挿通させる穿設5aの上部付近までであり、これ
によって、配線パターン4の外部終端が配線基板5の外
周端面に露出してしまうことが防止されている。
これにより、金属製シェル10の立上がり内周面と配線基
板5の外終端部との距離tがゼロ(t=0)であって
も、配線パターン4,4間で電気的にショートしてしまう
ことがないよう構成されている。
板5の外終端部との距離tがゼロ(t=0)であって
も、配線パターン4,4間で電気的にショートしてしまう
ことがないよう構成されている。
配線基板5の配線パターン4を銅により形成した場合
で、この起端にアルミニウム等のボンディングワイヤ6
を接続するためには、この配線パターン5の起端に金メ
ッキ処理を施して、このボンディングワイヤ6との接合
の安定性を図る必要があるが、この時には、第4図に示
すように、全ての配線パターン4の起端部を配線基板5
の中央部に設けパターニング配線層11まで引き出し、こ
の配線層11を介して全ての配線パターン4を電気的に導
通させて電気的にショートさせることによってこの金メ
ッキ処理を施し、このメッキ処理後、第5図に示すよう
に、中央部の配線層11を所定の寸法に従って打ち抜いて
取り除くことによってこれを行うようにすることができ
る。
で、この起端にアルミニウム等のボンディングワイヤ6
を接続するためには、この配線パターン5の起端に金メ
ッキ処理を施して、このボンディングワイヤ6との接合
の安定性を図る必要があるが、この時には、第4図に示
すように、全ての配線パターン4の起端部を配線基板5
の中央部に設けパターニング配線層11まで引き出し、こ
の配線層11を介して全ての配線パターン4を電気的に導
通させて電気的にショートさせることによってこの金メ
ッキ処理を施し、このメッキ処理後、第5図に示すよう
に、中央部の配線層11を所定の寸法に従って打ち抜いて
取り除くことによってこれを行うようにすることができ
る。
本発明は上記のような構成であるので、配線パターン間
での電気的なショートを確実に防止しつつ、配線基板の
外周端部と金属製シェルの立上がり部内周面との距離を
できるだけ小さく、最終的にはゼロとして半導体装置と
しての小形化の要請に答えることができる。
での電気的なショートを確実に防止しつつ、配線基板の
外周端部と金属製シェルの立上がり部内周面との距離を
できるだけ小さく、最終的にはゼロとして半導体装置と
しての小形化の要請に答えることができる。
しかも、配線基板の上面に形成した配線パターンの中央
部の起端に金等のメッキ処理を施すようにすることもで
きるといった効果がある。
部の起端に金等のメッキ処理を施すようにすることもで
きるといった効果がある。
第1図乃至第5図は本発明の一実施例を示し、第1図は
一部を切断して示す斜視図、第2図は縦断面図、第3図
は第2図の要部拡大図、第4図は配線パターンの起端に
金メッキを施す時の配線基板を示す平面図、第5図は完
成後の配線基板を示す平面図、第6図乃至第10図は従来
例を示し、第6図は一部を切断して示す斜視図、第7図
は縦断面図、第8図は第7図の要部拡大図、第9図は配
線パターンの起端に金メッキを施す時の配線基板を示す
平面図、第10図は完成後の配線基板を示す平面図であ
る。 1…ステム、3…半導体チップ、4…配線パターン、5
…配線基板、6…ボンディングワイヤ、7…リードピ
ン、10…金属製シェル、11…配線層。
一部を切断して示す斜視図、第2図は縦断面図、第3図
は第2図の要部拡大図、第4図は配線パターンの起端に
金メッキを施す時の配線基板を示す平面図、第5図は完
成後の配線基板を示す平面図、第6図乃至第10図は従来
例を示し、第6図は一部を切断して示す斜視図、第7図
は縦断面図、第8図は第7図の要部拡大図、第9図は配
線パターンの起端に金メッキを施す時の配線基板を示す
平面図、第10図は完成後の配線基板を示す平面図であ
る。 1…ステム、3…半導体チップ、4…配線パターン、5
…配線基板、6…ボンディングワイヤ、7…リードピ
ン、10…金属製シェル、11…配線層。
Claims (1)
- 【請求項1】上面に中央部の起端から放射状に外方に延
びる配線をパターニングした配線基板の下面にステムを
重合させ、この配線基板及びステムに互いに連通するよ
う配置して穿設した透孔内にリードピンの上部を挿通さ
せ、このリードピンを上記配線基板の上面において接合
部材を介して該配線基板の配線パターンに接合するとと
もに、上記配線基板の周囲及びこの上方を金属製シェル
で覆った半導体装置の製造方法において、 上記配線基板の上面に放射状に中央部から延びる配線パ
ターンを形成し、この配線パターンの外部終端が該配線
基板に穿設した上記リードピンを挿通させる透孔の上部
付近までに止まり上記配線基板の周囲まで至らないよう
にし、 放射状に中央部から延びる上記配線パターンの中央部終
端を互いに電気的に導通させることによって上記配線パ
ターンに金属メッキ処理を施し、 この金属メッキ処理の後、上記配線基板の中央部を所定
の寸法に従って打ち抜いて取り除き、打ち抜かれた上記
配線基板の中央部に半導体チップを装着することを特徴
とする半導体装置の製造方法。
Priority Applications (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63090856A JPH079953B2 (ja) | 1988-04-13 | 1988-04-13 | 半導体装置の製造方法 |
KR1019890004890A KR920005315B1 (ko) | 1988-04-13 | 1989-04-13 | 반도체장치 |
EP19890106568 EP0337448A3 (en) | 1988-04-13 | 1989-04-13 | Semiconductor device having a metal stem |
US07/648,311 US5093282A (en) | 1988-04-13 | 1991-01-29 | Method of making a semiconductor device having lead pins and a metal shell |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63090856A JPH079953B2 (ja) | 1988-04-13 | 1988-04-13 | 半導体装置の製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH01261849A JPH01261849A (ja) | 1989-10-18 |
JPH079953B2 true JPH079953B2 (ja) | 1995-02-01 |
Family
ID=14010206
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP63090856A Expired - Fee Related JPH079953B2 (ja) | 1988-04-13 | 1988-04-13 | 半導体装置の製造方法 |
Country Status (4)
Country | Link |
---|---|
US (1) | US5093282A (ja) |
EP (1) | EP0337448A3 (ja) |
JP (1) | JPH079953B2 (ja) |
KR (1) | KR920005315B1 (ja) |
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US5103292A (en) * | 1989-11-29 | 1992-04-07 | Olin Corporation | Metal pin grid array package |
US5206460A (en) * | 1991-07-24 | 1993-04-27 | Yang Mu K | Oscillator package |
US5291375A (en) * | 1991-09-30 | 1994-03-01 | Kabushiki Kaisha Toshiba | Printed circuit board and electric device configured to facilitate bonding |
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US5479319A (en) * | 1992-12-30 | 1995-12-26 | Interconnect Systems, Inc. | Multi-level assemblies for interconnecting integrated circuits |
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Citations (1)
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Family Cites Families (14)
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JPS61296743A (ja) * | 1985-06-25 | 1986-12-27 | Matsushita Electric Works Ltd | チツプキヤリア |
DE3527818A1 (de) * | 1985-08-02 | 1987-02-26 | Rose Elektrotech Gmbh | Gehaeuse fuer einen hybridschaltkreis |
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-
1988
- 1988-04-13 JP JP63090856A patent/JPH079953B2/ja not_active Expired - Fee Related
-
1989
- 1989-04-13 KR KR1019890004890A patent/KR920005315B1/ko not_active IP Right Cessation
- 1989-04-13 EP EP19890106568 patent/EP0337448A3/en not_active Ceased
-
1991
- 1991-01-29 US US07/648,311 patent/US5093282A/en not_active Expired - Lifetime
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS63133553A (ja) * | 1986-11-25 | 1988-06-06 | Toshiba Corp | 半導体パツケ−ジ |
Also Published As
Publication number | Publication date |
---|---|
EP0337448A2 (en) | 1989-10-18 |
US5093282A (en) | 1992-03-03 |
KR920005315B1 (ko) | 1992-07-02 |
EP0337448A3 (en) | 1991-05-08 |
KR890016661A (ko) | 1989-11-29 |
JPH01261849A (ja) | 1989-10-18 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
LAPS | Cancellation because of no payment of annual fees |