JPH07193024A - 半導体装置およびその製造方法 - Google Patents
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Abstract
(57)【要約】
【目的】 コンタクト部の空洞等の形状不良やシリサイ
ド化に伴う応力の問題を回避し、シリサイド層を厚くす
ることにより低抵抗化が可能となる。 【構成】 コンタクトの底部と層間絶縁膜5上に金属を
形成した後、シリコン層7を形成し、熱処理してシリサ
イド化する。コンタクトの底部と層間絶縁膜上の金属シ
リサイド層8は前記シリコン層で電気的に接続される。
コンタクト側壁部には金属が形成されていないので、形
状不良やシリサイド化の際の応力は問題なく、金属の膜
厚を厚くして、配線・コンタクトを低抵抗化させること
ができる。
ド化に伴う応力の問題を回避し、シリサイド層を厚くす
ることにより低抵抗化が可能となる。 【構成】 コンタクトの底部と層間絶縁膜5上に金属を
形成した後、シリコン層7を形成し、熱処理してシリサ
イド化する。コンタクトの底部と層間絶縁膜上の金属シ
リサイド層8は前記シリコン層で電気的に接続される。
コンタクト側壁部には金属が形成されていないので、形
状不良やシリサイド化の際の応力は問題なく、金属の膜
厚を厚くして、配線・コンタクトを低抵抗化させること
ができる。
Description
【0001】
【産業上の利用分野】本発明は、半導体装置およびその
製造方法に関し、特に抵抗値の低いコンタクトを有する
半導体装置とその製法に関する。
製造方法に関し、特に抵抗値の低いコンタクトを有する
半導体装置とその製法に関する。
【0002】
【従来の技術】従来、拡散層や、コンタクトの抵抗を低
くするため、金属層をシリサイド化する技術がよく知ら
れている。図4(a)〜(d)は拡散層をシリサイド化
する時の従来の工程断面図である。図4(a)で示すよ
うに、P型シリコン基板1上にフィールド酸化膜2およ
びゲート酸化膜3を形成した後、基板と逆導電型のN型
拡散層4を形成する。しかる後、図4(b)で示すよう
に、ゲート酸化膜3を除去後、金属層6として、例えば
チタニウムを積層する。しかる後、図4(c)で示すよ
うに、熱処理をすることによりN型拡散層表面でシリサ
イド反応をおこし、金属シリサイド層8を形成する。し
かる後、図4(d)で示すように、未反応のチタニウム
を除去することにより、拡散層のシリサイド化を行って
いた。
くするため、金属層をシリサイド化する技術がよく知ら
れている。図4(a)〜(d)は拡散層をシリサイド化
する時の従来の工程断面図である。図4(a)で示すよ
うに、P型シリコン基板1上にフィールド酸化膜2およ
びゲート酸化膜3を形成した後、基板と逆導電型のN型
拡散層4を形成する。しかる後、図4(b)で示すよう
に、ゲート酸化膜3を除去後、金属層6として、例えば
チタニウムを積層する。しかる後、図4(c)で示すよ
うに、熱処理をすることによりN型拡散層表面でシリサ
イド反応をおこし、金属シリサイド層8を形成する。し
かる後、図4(d)で示すように、未反応のチタニウム
を除去することにより、拡散層のシリサイド化を行って
いた。
【0003】また、配線層間の接続をする配線層が少な
くともシリサイド層によって形成する製造方法の中で、
特開平3−234062号公報に示されている図5
(a)〜(e)のようなシリサイド化の方法が知られて
いる。この方法では、図5(a)で示すように、P型シ
リコン基板1上にフィールド酸化膜2およびゲート酸化
膜3を形成した後、基板と逆導電型のN型拡散層4を形
成する。次に図5(b)で示すように、ゲート酸化膜3
を除去後、金属層6として例えばチタニウムを積層し、
さらにその上にシリコン層7を積層する。しかる後、図
5(c)で示すように、局所配線となる領域以外の部分
のシリコン層7を除去する。しかる後、図5(d)で示
すように、熱処理をすることにより、N型拡散層表面お
よびシリコン層と金属層とでシリサイド反応をおこし、
金属シリサイド層8を形成する。しかる後、図5(e)
で示すように、未反応のチタニウムを除去し、拡散層の
シリサイド化と局所配線の形成を行っていた。
くともシリサイド層によって形成する製造方法の中で、
特開平3−234062号公報に示されている図5
(a)〜(e)のようなシリサイド化の方法が知られて
いる。この方法では、図5(a)で示すように、P型シ
リコン基板1上にフィールド酸化膜2およびゲート酸化
膜3を形成した後、基板と逆導電型のN型拡散層4を形
成する。次に図5(b)で示すように、ゲート酸化膜3
を除去後、金属層6として例えばチタニウムを積層し、
さらにその上にシリコン層7を積層する。しかる後、図
5(c)で示すように、局所配線となる領域以外の部分
のシリコン層7を除去する。しかる後、図5(d)で示
すように、熱処理をすることにより、N型拡散層表面お
よびシリコン層と金属層とでシリサイド反応をおこし、
金属シリサイド層8を形成する。しかる後、図5(e)
で示すように、未反応のチタニウムを除去し、拡散層の
シリサイド化と局所配線の形成を行っていた。
【0004】またコンタクト・配線層の形成方法として
特開昭63−34954号公報に示されている図6
(a)〜(e),図7(a)〜(e)のような方法が知
られている。
特開昭63−34954号公報に示されている図6
(a)〜(e),図7(a)〜(e)のような方法が知
られている。
【0005】図6の方法では、まず図6(a)で示すよ
うに、P型シリコン基板1上にフィールド酸化膜2およ
びゲート酸化膜3を形成した後、N型拡散層4を形成し
た後、層間絶縁膜5としてたとえばCVDシリコン酸化
膜を積層し、コンタクト孔を開孔する。しかる後、図6
(b)で示すように、金属シリサイド層8として例えば
チタンシリサイド層を積層する。しかる後、図6(c)
に示すように、シリコン層7を積層する。しかる後、図
6(d)に示すように、シリコン層7をエッチバックす
ることにより、金属シリサイド層上の空洞部を埋め込
む。しかる後、図6(e)で示すように、配線形成部以
外の金属シリサイドをエッチング除去するというもので
ある。
うに、P型シリコン基板1上にフィールド酸化膜2およ
びゲート酸化膜3を形成した後、N型拡散層4を形成し
た後、層間絶縁膜5としてたとえばCVDシリコン酸化
膜を積層し、コンタクト孔を開孔する。しかる後、図6
(b)で示すように、金属シリサイド層8として例えば
チタンシリサイド層を積層する。しかる後、図6(c)
に示すように、シリコン層7を積層する。しかる後、図
6(d)に示すように、シリコン層7をエッチバックす
ることにより、金属シリサイド層上の空洞部を埋め込
む。しかる後、図6(e)で示すように、配線形成部以
外の金属シリサイドをエッチング除去するというもので
ある。
【0006】また、図7の方法では、まず図7(a)で
示すように、P型シリコン基板1上にフィールド酸化膜
2およびゲート酸化膜3を形成した後、N型拡散層4を
形成した後、層間絶縁膜5としてたとえばCVDシリコ
ン酸化膜を積層し、コンタクト孔を開孔する。その後、
図7(b)で示すように、金属層6として、例えばチタ
ニウムを積層する。しかる後、図7(c)で示すよう
に、シリコン層7を積層する。しかる後、図7(d)で
示すように、シリコン層7をエッチバックすることによ
り、金属層上の空洞部を埋め込む。しかる後、図7
(e)で示すように、配線形成部以外の金属層をエッチ
ング除去するというものである。
示すように、P型シリコン基板1上にフィールド酸化膜
2およびゲート酸化膜3を形成した後、N型拡散層4を
形成した後、層間絶縁膜5としてたとえばCVDシリコ
ン酸化膜を積層し、コンタクト孔を開孔する。その後、
図7(b)で示すように、金属層6として、例えばチタ
ニウムを積層する。しかる後、図7(c)で示すよう
に、シリコン層7を積層する。しかる後、図7(d)で
示すように、シリコン層7をエッチバックすることによ
り、金属層上の空洞部を埋め込む。しかる後、図7
(e)で示すように、配線形成部以外の金属層をエッチ
ング除去するというものである。
【0007】図6(a)〜(e),図7(a)〜(e)
の構造では、N型シリコン基板層と層間絶縁膜上の配線
層とは、コンタクト底部および側面部の金属シリサイド
層あるいは金属層で接続されることになる。
の構造では、N型シリコン基板層と層間絶縁膜上の配線
層とは、コンタクト底部および側面部の金属シリサイド
層あるいは金属層で接続されることになる。
【0008】
【発明が解決しようとする課題】しかしながら、従来の
構造・製造方法については以下に述べるような問題点が
あった。
構造・製造方法については以下に述べるような問題点が
あった。
【0009】まず図4(a)〜(d)の製造方法では、
最近の高密度・高集積化に伴う浅い拡散層に対しては、
シリサイド化に伴う接合リークが、特に厚い金属シリサ
イド膜厚を形成する際、問題になってきている。このこ
とはIEEE TRANSACTIONS ON EL
ECTRON DEVICES vol.39,No.
4(1992)p.971に記載されている。
最近の高密度・高集積化に伴う浅い拡散層に対しては、
シリサイド化に伴う接合リークが、特に厚い金属シリサ
イド膜厚を形成する際、問題になってきている。このこ
とはIEEE TRANSACTIONS ON EL
ECTRON DEVICES vol.39,No.
4(1992)p.971に記載されている。
【0010】また、図5(a)〜(e)の製造方法で
は、拡散層が浅くなったときにも、金属層シリサイド化
が上下のシリコン層で行われるため、図4(a)〜
(d)のような問題は解決され、配線のような平坦な領
域では問題ないが、コンタクト部については図6(a)
〜(e),図7(a)〜(e)で述べるような問題があ
った。
は、拡散層が浅くなったときにも、金属層シリサイド化
が上下のシリコン層で行われるため、図4(a)〜
(d)のような問題は解決され、配線のような平坦な領
域では問題ないが、コンタクト部については図6(a)
〜(e),図7(a)〜(e)で述べるような問題があ
った。
【0011】まず図6(a)〜(e)の構造・製造方法
は、金属シリサイド層のステップカバレッジの悪さによ
るコンタクト部の空洞の形成を、シリコン層で埋めて平
坦にし、拡散層と配線層を金属シリサイド層でつなぐと
いうものであった。しかしながら、コンタクトの微細化
に伴い、金属シリサイドのステップカバレッジの悪さの
ため、空洞を埋められず形状不良をおこしたり、また、
拡散層との接触部でシリサイド反応をさせているわけで
はないので、界面抵抗が大きいという問題があった。
は、金属シリサイド層のステップカバレッジの悪さによ
るコンタクト部の空洞の形成を、シリコン層で埋めて平
坦にし、拡散層と配線層を金属シリサイド層でつなぐと
いうものであった。しかしながら、コンタクトの微細化
に伴い、金属シリサイドのステップカバレッジの悪さの
ため、空洞を埋められず形状不良をおこしたり、また、
拡散層との接触部でシリサイド反応をさせているわけで
はないので、界面抵抗が大きいという問題があった。
【0012】図7(a)〜(e)の構造・製造方法にお
いても、図6(a)〜(e)と同様の形状不良の問題を
おこした。また、界面抵抗も金属層と拡散層とのシリサ
イド反応をさせていないので高かった。
いても、図6(a)〜(e)と同様の形状不良の問題を
おこした。また、界面抵抗も金属層と拡散層とのシリサ
イド反応をさせていないので高かった。
【0013】そして、図7(a)〜(e)の製造方法
と、図4(a)〜(d)の製造方法とを組み合わせて、
金属層と、拡散層、空洞を埋め込んだシリコン層とで、
シリサイド反応をさせて界面抵抗を下げるとともに、浅
い接合に対しても接合リークを大きくさせないようにす
ると、図4(a)〜(d)のような平坦部ではなくコン
タクト部であるので、コンタクト部の側壁部からのシリ
サイド化に伴う応力が大きく、接合リーク、体積膨張に
よるクラック等の種々の問題が発生していた。また層抵
抗を下げるためにはチタニウムの膜厚を厚くする必要が
あることが、例えばIEEE TRANSACTION
S ON ELECTRON DEVICES vo
l.38 No.2(1991)p.265からわか
る。しかしチタニウムの膜厚を厚くすることは、空洞発
生の形状不良と、応力の増大を生ずるため困難であっ
た。
と、図4(a)〜(d)の製造方法とを組み合わせて、
金属層と、拡散層、空洞を埋め込んだシリコン層とで、
シリサイド反応をさせて界面抵抗を下げるとともに、浅
い接合に対しても接合リークを大きくさせないようにす
ると、図4(a)〜(d)のような平坦部ではなくコン
タクト部であるので、コンタクト部の側壁部からのシリ
サイド化に伴う応力が大きく、接合リーク、体積膨張に
よるクラック等の種々の問題が発生していた。また層抵
抗を下げるためにはチタニウムの膜厚を厚くする必要が
あることが、例えばIEEE TRANSACTION
S ON ELECTRON DEVICES vo
l.38 No.2(1991)p.265からわか
る。しかしチタニウムの膜厚を厚くすることは、空洞発
生の形状不良と、応力の増大を生ずるため困難であっ
た。
【0014】本発明の目的は、コンタクト部の空洞等の
形状不良やシリサイド化に伴う応力の問題を回避し、低
抵抗化を可能とした半導体装置および製造方法を提供す
ることにある。
形状不良やシリサイド化に伴う応力の問題を回避し、低
抵抗化を可能とした半導体装置および製造方法を提供す
ることにある。
【0015】
【課題を解決するための手段】本発明は、二層以上の配
線層の間を電気的に接続するコンタクト孔を有する半導
体装置において、層間絶縁膜に開孔されたコンタクト底
部と層間絶縁膜上の配線層の少なくとも一部とが、金属
シリサイド層で形成されており、前記金属シリサイド層
同士がコンタクトプラグ内に形成されたシリコン層で電
気的に接続されていることを特徴とする。
線層の間を電気的に接続するコンタクト孔を有する半導
体装置において、層間絶縁膜に開孔されたコンタクト底
部と層間絶縁膜上の配線層の少なくとも一部とが、金属
シリサイド層で形成されており、前記金属シリサイド層
同士がコンタクトプラグ内に形成されたシリコン層で電
気的に接続されていることを特徴とする。
【0016】また本発明は、二層以上の配線層の間を電
気的に接続するために、層間絶縁膜にコンタクト孔を有
する半導体装置の製造方法において、前記コンタクト孔
の底部および層間絶縁膜上に、金属層を形成する工程
と、前記金属層上に、シリコン層を形成する工程と、前
記コンタクト孔の底部と前記層間絶縁膜上の金属層と、
前記シリコン層の少なくとも一部とでシリサイド反応を
させる工程と、を含むことを特徴とする。
気的に接続するために、層間絶縁膜にコンタクト孔を有
する半導体装置の製造方法において、前記コンタクト孔
の底部および層間絶縁膜上に、金属層を形成する工程
と、前記金属層上に、シリコン層を形成する工程と、前
記コンタクト孔の底部と前記層間絶縁膜上の金属層と、
前記シリコン層の少なくとも一部とでシリサイド反応を
させる工程と、を含むことを特徴とする。
【0017】
【実施例】次に本発明の実施例について図面を参照して
説明する。
説明する。
【0018】図1は本発明の一実施例を示す構造断面図
であり、図2(a)〜(e)および図3(a)〜(f)
は、図1の構造を形成するにいたる2種類のプロセスフ
ローを示しており、以下詳細に説明する。
であり、図2(a)〜(e)および図3(a)〜(f)
は、図1の構造を形成するにいたる2種類のプロセスフ
ローを示しており、以下詳細に説明する。
【0019】図1に示すように本発明の半導体装置は、
P型シリコン基板1上に形成されたN型拡散層4と、層
間絶縁膜5上に形成された金属シリサイド層8とが、コ
ンタクトプラグ内に形成されたシリコン層7で電気的に
接続されている。
P型シリコン基板1上に形成されたN型拡散層4と、層
間絶縁膜5上に形成された金属シリサイド層8とが、コ
ンタクトプラグ内に形成されたシリコン層7で電気的に
接続されている。
【0020】この半導体装置の構造を、その製造方法と
ともに、さらに詳細に説明する。
ともに、さらに詳細に説明する。
【0021】まず図2(a)に示すように、P型シリコ
ン基板1上に通常のLOCOS法により、フィールド酸
化膜2およびゲート酸化膜3をそれぞれ5000オング
ストローム,200オングストローム形成し、しかる
後、基板1と逆導電型の不純物として、例えばヒ素50
keV,1.0×1015cm-2をイオン注入することに
よりN型拡散層4を形成する。しかる後、層間絶縁膜5
として例えばCVDシリコン酸化膜を5000オングス
トローム積層した後、N型拡散層4に対して、例えば
0.3μm角のコンタクト孔を開孔する。
ン基板1上に通常のLOCOS法により、フィールド酸
化膜2およびゲート酸化膜3をそれぞれ5000オング
ストローム,200オングストローム形成し、しかる
後、基板1と逆導電型の不純物として、例えばヒ素50
keV,1.0×1015cm-2をイオン注入することに
よりN型拡散層4を形成する。しかる後、層間絶縁膜5
として例えばCVDシリコン酸化膜を5000オングス
トローム積層した後、N型拡散層4に対して、例えば
0.3μm角のコンタクト孔を開孔する。
【0022】しかる後、図2(b)に示すように、金属
層6として、例えばチタニウムを800オングストロー
ム、コリメートスパッタすることにより、コンタクト底
部と層間絶縁膜上に形成する。
層6として、例えばチタニウムを800オングストロー
ム、コリメートスパッタすることにより、コンタクト底
部と層間絶縁膜上に形成する。
【0023】しかる後、図2(c)に示すように、シリ
コン層7として例えばアモルファスシリコンを500℃
で2000オングストローム程度形成し、コンタクト内
部を埋め込む。
コン層7として例えばアモルファスシリコンを500℃
で2000オングストローム程度形成し、コンタクト内
部を埋め込む。
【0024】しかる後、図2(d)に示すように、50
0〜900℃の温度で熱処理することにより、N型拡散
層4と、シリコン層7と、チタニウムとでシリサイド反
応をさせ、金属シリサイド層8を形成する。図2(d)
では層間絶縁膜5上のシリコン層7がすべてチタニウム
とシリサイド化しているように図示しているが、未反応
のシリコン層が残っていてもかまわない。
0〜900℃の温度で熱処理することにより、N型拡散
層4と、シリコン層7と、チタニウムとでシリサイド反
応をさせ、金属シリサイド層8を形成する。図2(d)
では層間絶縁膜5上のシリコン層7がすべてチタニウム
とシリサイド化しているように図示しているが、未反応
のシリコン層が残っていてもかまわない。
【0025】次に図2(e)で示すように、配線・コン
タクトを形成する領域以外の部分をエッチング除去する
ことにより、図1の構造を得る。
タクトを形成する領域以外の部分をエッチング除去する
ことにより、図1の構造を得る。
【0026】図3(a)〜(f)は、図1の構造を得る
もう一つの実施例である。
もう一つの実施例である。
【0027】まず図3(a)に示すように、P型シリコ
ン基板1上に通常のLOCOS法によりフィールド酸化
膜2およびゲート酸化膜3をそれぞれ5000オングス
トローム,200オングストローム形成し、しかる後、
基板と逆導電型の不純物として、例えばヒ素50ke
V,1.0×1015cm-2をイオン注入することによ
り、N型拡散層4を形成する。しかる後、層間絶縁膜5
として例えばCVDシリコン酸化膜を5000オングス
トローム積層した後、N型拡散層に対して例えば0.3
μm角のコンタクト孔を開孔する。
ン基板1上に通常のLOCOS法によりフィールド酸化
膜2およびゲート酸化膜3をそれぞれ5000オングス
トローム,200オングストローム形成し、しかる後、
基板と逆導電型の不純物として、例えばヒ素50ke
V,1.0×1015cm-2をイオン注入することによ
り、N型拡散層4を形成する。しかる後、層間絶縁膜5
として例えばCVDシリコン酸化膜を5000オングス
トローム積層した後、N型拡散層に対して例えば0.3
μm角のコンタクト孔を開孔する。
【0028】しかる後、図3(b)に示すように、金属
層6として、例えばチタニウムを800オングストロー
ムコリメートスパッタすることにより、コンタクト底部
と層間絶縁膜上に形成する。
層6として、例えばチタニウムを800オングストロー
ムコリメートスパッタすることにより、コンタクト底部
と層間絶縁膜上に形成する。
【0029】しかる後、図3(c)に示すように、シリ
コン層7として例えばアモルファスシリコンを500℃
で2000オングストローム程度形成し、コンタクト内
部を埋め込む。
コン層7として例えばアモルファスシリコンを500℃
で2000オングストローム程度形成し、コンタクト内
部を埋め込む。
【0030】しかる後、図3(d)で示すように、配線
・コンタクトを形成する以外の部分のシリコン層をエッ
チング除去する。
・コンタクトを形成する以外の部分のシリコン層をエッ
チング除去する。
【0031】しかる後、図3(e)に示すように、50
0℃〜900℃の温度で熱処理することにより、N型拡
散層4と、シリコン層7と、チタニウムとでシリサイド
反応をさせ、金属シリサイド層8を形成する。
0℃〜900℃の温度で熱処理することにより、N型拡
散層4と、シリコン層7と、チタニウムとでシリサイド
反応をさせ、金属シリサイド層8を形成する。
【0032】しかる後、図3(f)に示すように、未反
応のチタニウム層を除去することにより、図1の構造を
得る。
応のチタニウム層を除去することにより、図1の構造を
得る。
【0033】以上の製造方法において、コンタクト底部
と層間絶縁膜5上の金属シリサイド層8を電気的に接続
するシリコン層の導電性は、成長時に不純物をドーピン
グしてもよいし、成長後にイオン注入してもかまわな
い。
と層間絶縁膜5上の金属シリサイド層8を電気的に接続
するシリコン層の導電性は、成長時に不純物をドーピン
グしてもよいし、成長後にイオン注入してもかまわな
い。
【0034】またチタニウム以外の金属としては、シリ
コンと反応してシリサイドを形成する材料ならば、例え
ば、Zr,Hf,V,Mo,Co,Ptの高融点金属、
貴金属でもよい。
コンと反応してシリサイドを形成する材料ならば、例え
ば、Zr,Hf,V,Mo,Co,Ptの高融点金属、
貴金属でもよい。
【0035】また実施例では、拡散層に対するコンタク
トについて述べたが、ゲートポリシリ配線や、他の配線
においても同様である。
トについて述べたが、ゲートポリシリ配線や、他の配線
においても同様である。
【0036】また層間絶縁膜上の金属シリサイド上にさ
らにアルミニウム等の金属を積層してから、配線コンタ
クト部以外の金属シリサイドおよびアルミニウムをエッ
チング除去してもかまわない。またシリコンの形成も、
CVDでもスパッタでも、コンタクト部が埋まりさえす
れば、特に制限されるものでもない。
らにアルミニウム等の金属を積層してから、配線コンタ
クト部以外の金属シリサイドおよびアルミニウムをエッ
チング除去してもかまわない。またシリコンの形成も、
CVDでもスパッタでも、コンタクト部が埋まりさえす
れば、特に制限されるものでもない。
【0037】
【発明の効果】以上説明したように、本発明は二層以上
の配線層の間を電気的に接続するコンタクト孔を有する
半導体装置において、層間絶縁膜に開孔されたコンタク
ト底部と層間絶縁膜上の配線層の少なくとも一部とが金
属シリサイド層で形成されており、前記金属シリサイド
層同士がコンタクトプラグ内に形成されたシリコン層で
電気的に接続されているという構造をとることにより、
次のような効果が生まれた。
の配線層の間を電気的に接続するコンタクト孔を有する
半導体装置において、層間絶縁膜に開孔されたコンタク
ト底部と層間絶縁膜上の配線層の少なくとも一部とが金
属シリサイド層で形成されており、前記金属シリサイド
層同士がコンタクトプラグ内に形成されたシリコン層で
電気的に接続されているという構造をとることにより、
次のような効果が生まれた。
【0038】第1に微細なコンタクトに対しても空洞部
等の形状不良をおこさず、コンタクト部のシリサイド化
が可能となった。第2に、微細なコンタクトの側面部に
は金属がないので、シリサイド化の際の応力による問題
が緩和された。第3にコンタクト底部の金属膜厚を厚く
しても、形状、応力の点で問題がないので、シリサイド
膜厚が厚くでき、コンタクト抵抗を下げられ、また、下
の配線層として浅い拡散層の場合は、シリサイド化が金
属の上下で進むので、接合リークの問題も解決された。
等の形状不良をおこさず、コンタクト部のシリサイド化
が可能となった。第2に、微細なコンタクトの側面部に
は金属がないので、シリサイド化の際の応力による問題
が緩和された。第3にコンタクト底部の金属膜厚を厚く
しても、形状、応力の点で問題がないので、シリサイド
膜厚が厚くでき、コンタクト抵抗を下げられ、また、下
の配線層として浅い拡散層の場合は、シリサイド化が金
属の上下で進むので、接合リークの問題も解決された。
【図1】本発明の実施例を示す構造断面図である。
【図2】図1の構造を形成するための第1の実施例を示
す工程断面図である。
す工程断面図である。
【図3】図1の構造を形成するための第2の実施例を示
す工程断面図である。
す工程断面図である。
【図4】従来の拡散層シリサイド形成方法を示す工程断
面図である。
面図である。
【図5】従来の中間配線のシリサイド形成方法を示す工
程断面図である。
程断面図である。
【図6】従来のコンタクト部のシリサイド配線形成方法
を示す工程断面図である。
を示す工程断面図である。
【図7】従来のコンタクト部の金属配線形成方法を示す
工程断面図である。
工程断面図である。
1 P型シリコン基板 2 フィールド酸化膜 3 ゲート酸化膜 4 N型拡散層 5 層間絶縁膜 6 金属層 7 シリコン層 8 金属シリサイド層
Claims (4)
- 【請求項1】二層以上の配線層の間を電気的に接続する
コンタクト孔を有する半導体装置において、 層間絶縁膜に開孔されたコンタクト底部と層間絶縁膜上
の配線層の少なくとも一部とが、金属シリサイド層で形
成されており、前記金属シリサイド層同士がコンタクト
プラグ内に形成されたシリコン層で電気的に接続されて
いることを特徴とする半導体装置。 - 【請求項2】二層以上の配線層の間を電気的に接続する
ために、層間絶縁膜にコンタクト孔を有する半導体装置
の製造方法において、 前記コンタクト孔の底部および層間絶縁膜上に、金属層
を形成する工程と、 前記金属層上に、シリコン層を形成する工程と、 前記コンタクト孔の底部と前記層間絶縁膜上の金属層
と、前記シリコン層の少なくとも一部とでシリサイド反
応をさせる工程と、を含むことを特徴とする半導体装置
の製造方法。 - 【請求項3】二層以上の配線層の間を電気的に接続する
ために、層間絶縁膜にコンタクト孔を有する半導体装置
の製造方法において、 前記コンタクト孔の底部および層間絶縁膜上に、金属層
を形成する工程と、 前記金属層上に、シリコン層を形成する工程と、 前記コンタクト孔の底部と前記層間絶縁膜上の金属層
と、前記シリコン層の少なくとも一部とでシリサイド反
応をさせる工程と、 前記層間絶縁膜と前記シリコン層とのシリサイド反応に
より形成された金属シリサイド層の、配線・コンタクト
を形成する領域以外の部分をエッチング除去する工程
と、を含むことを特徴とする半導体装置の製造方法。 - 【請求項4】二層以上の配線層の間を電気的に接続する
ために、層間絶縁膜にコンタクト孔を有する半導体装置
の製造方法において、 前記コンタクト孔の底部および層間絶縁膜上に、金属層
を形成する工程と、 前記金属層上に、シリコン層を形成する工程と、 前記層間絶縁膜上の前記シリコン層の、配線・コンタク
トを形成する以外の部分をエッチング除去する工程と、 前記コンタクト孔の底部と前記層間絶縁膜上の金属層
と、前記シリコン層の少なくとも一部とでシリサイド反
応をさせる工程と、を含むことを特徴とする半導体装置
の製造方法。
Priority Applications (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP5330688A JPH07193024A (ja) | 1993-12-27 | 1993-12-27 | 半導体装置およびその製造方法 |
US08/364,226 US5514910A (en) | 1993-12-27 | 1994-12-27 | Semiconductor device having multi-level interconnection structure |
KR1019940037110A KR0164441B1 (ko) | 1993-12-27 | 1994-12-27 | 멀티 레벨 상호 접속 구조를 가진 반도체 장치 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP5330688A JPH07193024A (ja) | 1993-12-27 | 1993-12-27 | 半導体装置およびその製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH07193024A true JPH07193024A (ja) | 1995-07-28 |
Family
ID=18235469
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP5330688A Pending JPH07193024A (ja) | 1993-12-27 | 1993-12-27 | 半導体装置およびその製造方法 |
Country Status (3)
Country | Link |
---|---|
US (1) | US5514910A (ja) |
JP (1) | JPH07193024A (ja) |
KR (1) | KR0164441B1 (ja) |
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- 1993-12-27 JP JP5330688A patent/JPH07193024A/ja active Pending
-
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- 1994-12-27 US US08/364,226 patent/US5514910A/en not_active Expired - Fee Related
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Publication number | Publication date |
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KR950021406A (ko) | 1995-07-26 |
KR0164441B1 (ko) | 1999-02-01 |
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