JPH0561616B2 - - Google Patents

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JPH0561616B2
JPH0561616B2 JP57228184A JP22818482A JPH0561616B2 JP H0561616 B2 JPH0561616 B2 JP H0561616B2 JP 57228184 A JP57228184 A JP 57228184A JP 22818482 A JP22818482 A JP 22818482A JP H0561616 B2 JPH0561616 B2 JP H0561616B2
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Description

【発明の詳細な説明】 本発明は、スイツチング素子を用いて構成され
た画像表示装置、いわゆるアクテイブ・マトリツ
クスパネルに関するものである。
従来のアクテイブ・マトリツクスパルスを第１
図に示す、この図から明らかなように各画素は、
信号電圧書き込み用のトランジスタTijとその信
号を保持するキヤパシタCijと液晶LCijから構成
されており、キヤパシタCijの一電極はトランジ
スタのトレインに、他の一電極は基板と接続され
ている。このように全画素のキヤパシタの一方の
電極をその基板に接続するため、画面全域に基板
電位を供給する電極が必要となり、これが逆に、
パネル製造過程の不具合から生じる信号供給電極
Sjおよびアドレス電極Giと基板との短絡の原因
となつていた。この短絡は、表示画面上に線欠陥
として現れ、表示装置として致命的な欠陥であ
り、パネルの製造歩留りを低下させる一要因とな
つていた。
この欠点を除去する対策として、キヤパシタ
Cijの一方の電極をこのキヤパシタに含まれる画
素が属する行の次の行のアドレス電極に接続する
ことが考えられる。
しかし、この接続では、製造上回避できない
TFTの特性のバラツキが、そのまま画面のコン
トラストむらとなつて現れる欠点がある。
これについて、第４図の等価回路図に基づいて
説明する。
ｉ行、ｊ列目の単位画素は、画像信号書み込み
用トランジスタTijと液晶LCijおよび信号電圧を
保持するキヤパシタCijからなつており、キヤパ
シタCijの一方の電極が、次の行のアドレス電極
Gi＋１に接続されている。いま、アドレス電極
Giに電圧VONが印加され、キパヤシタCijに信号
電圧Ｖが保持されたときを考える。この時、アド
レス電極Gi＋１の電位はVOFFである。次にア
ドレス電極Giの電位がVONからVOFFにかわり、
次行のアドレス電極Gi＋１に電圧VONが印加さ
れたとする。
一般に、トランジスタの特性にはバラツキがあ
り、特に、TFTトランジスタは大きい。第３図
はTFTトランジスタの１例である。
トランジスタTijが図のような特性を示したと
すると、アドレス電極Gi＋１の電位がVOFFか
らVONに変化した時、トランジスタTijのドレイ
ンＤの電圧はVsからVs＋（VON−VOFF）とな
るので、信号供給電極Sjの電位が０のとき、大き
なドレイン電流I2が流れる。この電流I2はトラン
ジスタの特性に従いそれぞれ異なつている。
この電流により、アドレス電極Gi＋１に再び
VOFFが印加された時、最初に書き込まれた信号
電圧Vsより低い電圧がキヤパシタCijに保持され
る。よつて１フレーム時間中、そのほとんどの時
間および（１−１／ｎ）の割合で、書き込まれた
電位と異なる電位が液晶に印加されることにな
る。そして、TFTの特性は前述したようにバラ
ツキが多く、その特性のバラツキが液晶への印加
電圧の相違となるので、これがそのまま画面のコ
ントラストむらとなつて現れる。
本発明は、これらの欠点を除去するためになさ
れたもので、TSTの特性のバラツキがあつても、
それが画面のコントラストむらとなつて現れる欠
点を防止することにより、画像不良がなく、製造
歩留りの高いアクテイブ・マトリツクスパネルの
製造歩留りを提供することを目的としたものであ
る。
以下、本発明の実施例を説明する。第２図が本
発明の実施例であるアクテイブ・マトリツクスパ
ネルの構成を示す等価回路図である。
キヤパシタCijの一電極は、トランジスタTijの
ドレインと接続され、他の一電極は、前の行の画
素をアドレスするアドレス電極Gi−１に接続さ
れている。トランジスタTijは、ゲート電圧VON
でON状態となり、ゲート電圧VOFFで、OFF状
態となる。一般にアクテイブ・マトリツクスパネ
ルの駆動方法は、アドレス電極Gi（ｉ＝１…ｎ）
に電圧をVONを印加し、その間に、アドレス電
極GiをゲートとするトランジスタTij（ｊ＝１…
ｍ）に画像信号を書き込み、書き込み終えたら、
電極Giに電圧VOFFを印加し、同時に次の行の
アドレス電極Gi＋１に電圧VONを印加し、新し
い画像信号をトランジスタＴ（ｉ＋１）ｊに書き
込んでいく。この操作を繰り返し、パネル全体に
画像信号を書き込んでいく。
いま、アドレス電極Gi−１の電位がVONから
VOFFに変化したとする。すると同時に次の行の
アドレス電極Giに印加される電圧がVOFFから
VONになり、ｉ行に属するトランジスタTijが
ON状態となり、新しい画像信号が信号を供給す
る電極SjからトランジスタTIJを通りキヤパシタ
Cijに保持される。次に、Giの電位がVONから
VOFFに変り、同時に、Gi＋１の電位がVOFFか
らVONにと変わるが、キヤパシタCijの電位はそ
のまま保持される。
このようにして、１フレーム分の走査が終わる
と、再びアドレス電極Gi−１の電位がVOFFか
らVONに変化する。このときのアドレス電極Gi
−１の電位の変化によりキヤパシタCijの電位も
変化するが、再びVONからVOFFに戻つたとき、
同時に次行のアドレス電極Giに電圧VONが印加
されるので、トランジスタTijはON状態となる。
このキパヤシタCijの一電極の電位が大きく変化
する時間的割合は、およそ１フレーム時間あたり
１／ｎである。ここでｎはアドレス電極である。
逆にいえば、キヤパシタCijの一電極の電位が固
定されている時間は、１フレーム時間あたりおよ
そ（（ｎ−１）／ｎ）の割合である。
そのため、アドレス電極の数が多ければ、書き
込まれた信号電圧は実質的にシフトすることなく
そのまま保持される。
通常アクテイブ・マトリツクスパネルのアドレ
ス電極の数ｎは、200前後であるから、通常のパ
ネルの画面ではほとんどコントラストむらの判別
がつかないほど良好な映像が得られた。
このように、トランジスタTijとしては、特に
絶縁基板上に作製できる薄膜トランジスタを用い
るとき、本発明におけるようにキヤパシタCijの
一電極を前行のアドレス電極と接属することが、
良好な画像を得るために欠かせない要件である。
以上のごとく構成したので、本発明によれば、
従来のアクテイブ・マトリツクスパネルに見られ
た製作上の不具合によつて生じた線欠陥の数を大
幅に減少させることができる上、パネル内に製作
されたトランジスタの特性のバラツキによる画像
不良をなくし、製造保留りを高めることができ
る。
【図面の簡単な説明】
第１図は、従来のアクテイブ・マトリツクスパ
ネルの等価回路図、第２図は、本発明の一実施例
であるアクテイブ・マトリツクスパネルの等価回
路図、第３図は、特性の劣る薄膜トランジスタの
電圧、電流特性図、第４図は、従来のアクテイ
ブ・マトリツクスパネルの等価回路図を示す。 Tij……スイツチングトランジスタ、Ｓ……ソ
ース、Ｄ……ドレイン、Ｇ……ゲート、LCij……
液晶セル、Cij……キヤパシタ、Sj……画像信号
供給電極、Gi……アドレス電極。

Claims (1)

    【特許請求の範囲】
  1. １ 液晶セルと、スイツチングトランジスタとキ
    ヤパシタとから構成される単位画素をマトリツク
    ス状に配置されてなるアクテイブ・マトリツクス
    画像表示装置において、前記キヤパシタの一方の
    電極は上記スイツチングトランジスタの電極に接
    続され、他方の電極は前記キヤパシタの一行前に
    アドレスされた画素のアドレス電極に接続されて
    いることを特徴とする画像表示装置。
JP57228184A 1982-12-23 1982-12-23 画像表示装置 Granted JPS59116685A (ja)

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JP57228184A JPS59116685A (ja) 1982-12-23 1982-12-23 画像表示装置
GB08329170A GB2133602B (en) 1982-12-23 1983-11-01 An active-matrix addressed picture display device
US06/562,079 US4928095A (en) 1982-12-23 1983-12-16 Active matrix-addressed picture display device

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JPS59116685A JPS59116685A (ja) 1984-07-05
JPH0561616B2 true JPH0561616B2 (ja) 1993-09-06

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